JPH04290257A - プリント回路板上に搭載するための半導体装置 - Google Patents
プリント回路板上に搭載するための半導体装置Info
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- JPH04290257A JPH04290257A JP3337816A JP33781691A JPH04290257A JP H04290257 A JPH04290257 A JP H04290257A JP 3337816 A JP3337816 A JP 3337816A JP 33781691 A JP33781691 A JP 33781691A JP H04290257 A JPH04290257 A JP H04290257A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 110
- 239000004033 plastic Substances 0.000 claims abstract description 71
- 239000000463 material Substances 0.000 claims abstract description 12
- 238000000034 method Methods 0.000 claims description 22
- 238000000465 moulding Methods 0.000 claims description 18
- WABPQHHGFIMREM-OIOBTWANSA-N lead-204 Chemical compound [204Pb] WABPQHHGFIMREM-OIOBTWANSA-N 0.000 abstract description 10
- 239000012778 molding material Substances 0.000 description 4
- 238000010137 moulding (plastic) Methods 0.000 description 4
- 239000011888 foil Substances 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 241000272168 Laridae Species 0.000 description 2
- 239000002991 molded plastic Substances 0.000 description 2
- 239000007787 solid Substances 0.000 description 2
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 238000005452 bending Methods 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000010949 copper Substances 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 238000012536 packaging technology Methods 0.000 description 1
- 230000003014 reinforcing effect Effects 0.000 description 1
- 238000001721 transfer moulding Methods 0.000 description 1
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- H—ELECTRICITY
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- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
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- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
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- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
- H01L2224/491—Disposition
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- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/10—Details of components or other objects attached to or integrated in a printed circuit board
- H05K2201/10227—Other objects, e.g. metallic pieces
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- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
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- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
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- H05K2203/166—Alignment or registration; Control of registration
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- Packaging Of Annular Or Rod-Shaped Articles, Wearing Apparel, Cassettes, Or The Like (AREA)
- Packaging Frangible Articles (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】この発明は、半導体装置のパッケ
ージングに関し、特にDIP(デュアルインラインパッ
ケージ;dual in−line package)
、PQFP(プラスチッククォードフラットパック;p
lastic quad flat pack)および
PLCC(プラスチックリーデットチップキャリヤ;p
lastic leaded chip carrie
r )などのタイプの半導体装置パッケージに関するも
のである。
ージングに関し、特にDIP(デュアルインラインパッ
ケージ;dual in−line package)
、PQFP(プラスチッククォードフラットパック;p
lastic quad flat pack)および
PLCC(プラスチックリーデットチップキャリヤ;p
lastic leaded chip carrie
r )などのタイプの半導体装置パッケージに関するも
のである。
【0002】
【従来の技術】現在のプラスチックパッケージング技術
は、半導体ダイ(半導体チップ)の周囲にプラスチック
“ボディ”を成形することを含む。成形に先立ち、半導
体ダイは、複数のリードを有するリードフレームに取付
けられる。この複数のリードは、最終的には、半導体装
置をプリント回路板上の導電部の如き外部回路に接続す
るために、パッケージから突出する。従来から、DIP
、PQFP、およびPLCCを含む種々のタイプのプラ
スチックパッケージが知られている。
は、半導体ダイ(半導体チップ)の周囲にプラスチック
“ボディ”を成形することを含む。成形に先立ち、半導
体ダイは、複数のリードを有するリードフレームに取付
けられる。この複数のリードは、最終的には、半導体装
置をプリント回路板上の導電部の如き外部回路に接続す
るために、パッケージから突出する。従来から、DIP
、PQFP、およびPLCCを含む種々のタイプのプラ
スチックパッケージが知られている。
【0003】図1および図2に、従来の典型的なプラス
チックパッケージされた半導体装置100を示す。半導
体チップ(半導体ダイ)102は、例えば多数のボンド
ワイヤ104によって、対応する数のリード106の内
側端部に接続される。半導体チップをリードの内側端部
に接続する技術としては、そのほかの技術も知られてい
る。プラスチックボディ108は、種々の成形技術のう
ちのいずれかによって、半導体チップ102およびリー
ド106の内側端部を囲むように成形される。リード1
06における、ボディ108の外部へ露出する外側部分
は、(鎖線Cで示す位置で)下方へ折曲げられ、さらに
(鎖線Dで示す位置で)外方へ折曲げられて、一般に“
ガルウィング”(かもめの翼)と称される形状になされ
る。各リード106は、その幅(w)が千分の6インチ
(約0.2mm)のオーダーとされ、その隣り合うリー
ド106間の間隔(s)は典型的には、千分の10イン
チ(約0.25mm)のオーダーとされている。
チックパッケージされた半導体装置100を示す。半導
体チップ(半導体ダイ)102は、例えば多数のボンド
ワイヤ104によって、対応する数のリード106の内
側端部に接続される。半導体チップをリードの内側端部
に接続する技術としては、そのほかの技術も知られてい
る。プラスチックボディ108は、種々の成形技術のう
ちのいずれかによって、半導体チップ102およびリー
ド106の内側端部を囲むように成形される。リード1
06における、ボディ108の外部へ露出する外側部分
は、(鎖線Cで示す位置で)下方へ折曲げられ、さらに
(鎖線Dで示す位置で)外方へ折曲げられて、一般に“
ガルウィング”(かもめの翼)と称される形状になされ
る。各リード106は、その幅(w)が千分の6インチ
(約0.2mm)のオーダーとされ、その隣り合うリー
ド106間の間隔(s)は典型的には、千分の10イン
チ(約0.25mm)のオーダーとされている。
【0004】この発明では、リードの“ピッチ”すなわ
ち隣り合うリードの中心間距離が0.5mm以下の場合
に特に重要となる。このようなリードの中心間距離は、
隣り合うリードの間の間隔(s)が0.25mm以下の
場合に相当する。
ち隣り合うリードの中心間距離が0.5mm以下の場合
に特に重要となる。このようなリードの中心間距離は、
隣り合うリードの間の間隔(s)が0.25mm以下の
場合に相当する。
【0005】図2には、多数のリード106を有するリ
ードフォーム(リードフレーム)120を示す。このリ
ードフレーム106は、千分の数インチ(すなわち0.
004〜0.006インチ)のオーダーの厚み(t)を
有する導電箔から作られる。リード106の材料として
は、典型的には銅もしくは“42合金”が用いられる。 図示されるように、リード106の外側端部は、リード
フレーム120の外側角環状部分122に続いている。 最終的には、この外側角環状部分122から、完成した
(パッケージングされた)装置が鎖線Aに示す位置で切
取られる。図2における特別の注釈として、鎖線Bで示
す位置(ボディ108の外縁に最近接するかまたはその
外縁位置)において、隣り合うリード106間が“ダム
バー”124によってブリッジされていることがある。 このダムバー124は、リード106を形成する導電材
料によって作られており、したがってその厚みもリード
106と同じである。ダムバー124は、各リードの内
側端部の整列状態を維持するに役立つが、このほか典型
的には箔によって作られるダイ取付けパッド(図示せず
)が適用されてこれも同じ役割を果たす。より重要なこ
とには、ダムバー124は、成形プロセスでは微妙な問
題がある。
ードフォーム(リードフレーム)120を示す。このリ
ードフレーム106は、千分の数インチ(すなわち0.
004〜0.006インチ)のオーダーの厚み(t)を
有する導電箔から作られる。リード106の材料として
は、典型的には銅もしくは“42合金”が用いられる。 図示されるように、リード106の外側端部は、リード
フレーム120の外側角環状部分122に続いている。 最終的には、この外側角環状部分122から、完成した
(パッケージングされた)装置が鎖線Aに示す位置で切
取られる。図2における特別の注釈として、鎖線Bで示
す位置(ボディ108の外縁に最近接するかまたはその
外縁位置)において、隣り合うリード106間が“ダム
バー”124によってブリッジされていることがある。 このダムバー124は、リード106を形成する導電材
料によって作られており、したがってその厚みもリード
106と同じである。ダムバー124は、各リードの内
側端部の整列状態を維持するに役立つが、このほか典型
的には箔によって作られるダイ取付けパッド(図示せず
)が適用されてこれも同じ役割を果たす。より重要なこ
とには、ダムバー124は、成形プロセスでは微妙な問
題がある。
【0006】成形工程においては、リードフレーム12
0(これは半導体チップ102に取付けられている)は
、金型(図示せず)の貝殻状の2つの半型(上型および
下型)の間に挟まれる。半導体チップ102およびリー
ド106の内側端部は金型内(その金型のキャビティ内
)に位置させられ、金型内にプラスチックが充填される
。リード106は金型の上型および下型の間にギャップ
をもたらすが、各リード106の間からボディ108の
外側へプラスチックが飛び出すことをダムバー124が
阻止する。半導体チップがプラスチックボディ内にパッ
ケージされた後には、ダムバー124は切取られ、リー
ド106の外側端部の間に飛び出して残っているプラス
チックは“デジャンキング”工程で除去される。
0(これは半導体チップ102に取付けられている)は
、金型(図示せず)の貝殻状の2つの半型(上型および
下型)の間に挟まれる。半導体チップ102およびリー
ド106の内側端部は金型内(その金型のキャビティ内
)に位置させられ、金型内にプラスチックが充填される
。リード106は金型の上型および下型の間にギャップ
をもたらすが、各リード106の間からボディ108の
外側へプラスチックが飛び出すことをダムバー124が
阻止する。半導体チップがプラスチックボディ内にパッ
ケージされた後には、ダムバー124は切取られ、リー
ド106の外側端部の間に飛び出して残っているプラス
チックは“デジャンキング”工程で除去される。
【0007】
【発明が解決しようとする課題】半導体装置におけるリ
ードの数が増加すれば、リードは薄くかつ細くなる傾向
を有する(各リードの間の間隔は実操業上の条件によっ
てその最小値が制限される。)。したがって半導体装置
の取扱い上において、各リードを整列状態に保つこと、
とりわけ各リードが同一平面上に位置しかつ互いに平行
であるように(そしてゆがみがないように)維持するこ
とが困難となる。さらに、各リードは、より脆弱となる
から、半導体装置が搭載されるプリント回路板上の配線
パターンの各導電部に対して各リードが正しく対応する
ように、各リードを整列状に保つことが困難となる。
ードの数が増加すれば、リードは薄くかつ細くなる傾向
を有する(各リードの間の間隔は実操業上の条件によっ
てその最小値が制限される。)。したがって半導体装置
の取扱い上において、各リードを整列状態に保つこと、
とりわけ各リードが同一平面上に位置しかつ互いに平行
であるように(そしてゆがみがないように)維持するこ
とが困難となる。さらに、各リードは、より脆弱となる
から、半導体装置が搭載されるプリント回路板上の配線
パターンの各導電部に対して各リードが正しく対応する
ように、各リードを整列状に保つことが困難となる。
【0008】したがってこの発明は、より堅固で強いリ
ードを有する、プラスチックパッケージされた半導体装
置を提供することを目的とする。
ードを有する、プラスチックパッケージされた半導体装
置を提供することを目的とする。
【0009】またこの発明の目的は、より堅固でかつ強
いリードを有する、プラスチックパッケージされた半導
体装置を形成する技術を提供するにある。
いリードを有する、プラスチックパッケージされた半導
体装置を形成する技術を提供するにある。
【0010】さらにこの発明は、プリント回路板上の配
線パターンに対して整列状態を維持することが容易なリ
ードを有する、プラスチックパッケージされた半導体装
置を提供することを目的とする。
線パターンに対して整列状態を維持することが容易なリ
ードを有する、プラスチックパッケージされた半導体装
置を提供することを目的とする。
【0011】さらにこの発明は、プリント回路板上の配
線パターンに対して整列状態を維持することが容易なリ
ードを有する、プラスチックパッケージされた半導体装
置を形成する技術を提供することを目的とする。
線パターンに対して整列状態を維持することが容易なリ
ードを有する、プラスチックパッケージされた半導体装
置を形成する技術を提供することを目的とする。
【0012】さらにこの発明の他の目的は、プリント回
路板上の配線パターンの各導電部に対して、プラスチッ
クパッケージされた半導体装置の各リードを容易に整列
状態に維持することができるような、プラスチックパッ
ケージされた半導体装置とプリント回路板との配置関係
についての位置決め技術を提供するにある。
路板上の配線パターンの各導電部に対して、プラスチッ
クパッケージされた半導体装置の各リードを容易に整列
状態に維持することができるような、プラスチックパッ
ケージされた半導体装置とプリント回路板との配置関係
についての位置決め技術を提供するにある。
【0013】
【課題を解決するための手段】前述のような目的を達成
するため、この発明の、プリント回路板上に搭載するた
めの半導体装置は、基本的には、請求項1で規定してい
るように、半導体チップと;内側端部および外側端部を
有する複数の導電リードと;前記半導体チップを前記リ
ードの内側端部に接続するための手段と;前記半導体チ
ップおよびリードの内側端部を囲むように形成されたプ
ラスチックボディと;前記リードの外側端部を、互いに
整列状に維持するための手段とを有してなり;リードの
外側端部を互いに整列状に維持するための前記手段が、
隣り合う各リード間のプラスチック製のウェッブからな
り、そのウェッブは、前記プラスツチックボディと連続
一体に作られるとともに、そのプラスチックボディから
各リードの間をそのリードの外側端部へ向けて延出され
ていることを特徴としている。
するため、この発明の、プリント回路板上に搭載するた
めの半導体装置は、基本的には、請求項1で規定してい
るように、半導体チップと;内側端部および外側端部を
有する複数の導電リードと;前記半導体チップを前記リ
ードの内側端部に接続するための手段と;前記半導体チ
ップおよびリードの内側端部を囲むように形成されたプ
ラスチックボディと;前記リードの外側端部を、互いに
整列状に維持するための手段とを有してなり;リードの
外側端部を互いに整列状に維持するための前記手段が、
隣り合う各リード間のプラスチック製のウェッブからな
り、そのウェッブは、前記プラスツチックボディと連続
一体に作られるとともに、そのプラスチックボディから
各リードの間をそのリードの外側端部へ向けて延出され
ていることを特徴としている。
【0014】また請求項2の発明の、プリント回路板上
に搭載するための半導体装置は、半導体チップと;内側
端部および外側端部を有する複数の半導体リードと;前
記半導体チップを前記リードの内側端部に接続するため
の手段と;前記半導体チップとリードの内側端部とを囲
むように形成されたプラスチックボディと;前記リード
の外側端部を、互いに整列状に維持するための手段とを
有してなり;リードの外側端部を互いに整列状に維持す
るための前記手段が、隣り合う各リード間のプラスチッ
ク製のウェッブからなり;さらに、プリント回路板上の
配線パターンからなる導電部に対してリードの外側端部
を整列状に維持するための手段を有し;リードの外側端
部をプリント回路上の配線パターンからなる導電部に対
して整列状に維持するための前記手段が、前記各ウェッ
ブに形成された突起からなり、その突起は、前記プラス
チックボディおよびウェッブと同じプラスチック材料か
らなることを特徴としている。
に搭載するための半導体装置は、半導体チップと;内側
端部および外側端部を有する複数の半導体リードと;前
記半導体チップを前記リードの内側端部に接続するため
の手段と;前記半導体チップとリードの内側端部とを囲
むように形成されたプラスチックボディと;前記リード
の外側端部を、互いに整列状に維持するための手段とを
有してなり;リードの外側端部を互いに整列状に維持す
るための前記手段が、隣り合う各リード間のプラスチッ
ク製のウェッブからなり;さらに、プリント回路板上の
配線パターンからなる導電部に対してリードの外側端部
を整列状に維持するための手段を有し;リードの外側端
部をプリント回路上の配線パターンからなる導電部に対
して整列状に維持するための前記手段が、前記各ウェッ
ブに形成された突起からなり、その突起は、前記プラス
チックボディおよびウェッブと同じプラスチック材料か
らなることを特徴としている。
【0015】さらに請求項3の発明の、プリント回路板
上に搭載するための半導体装置は、半導体チップと;内
側端部および外側端部を有する複数の導電リードと;前
記半導体チップを前記リードの内側端部へ接続するため
の手段と;前記半導体チップおよびリードの内側端部を
囲むように形成されたプラスチックボディと;前記リー
ドの外側端部を、互いに整列状に維持するための手段と
;プリント回路板上の配線パターンからなる導電部に対
してリードの外側端部を整列状に維持するための手段と
を有してなり;リードの外側端部をプリント回路上の配
線パターンからなる導電部に対して整列状に維持するた
めの前記手段が、隣り合う各リード外側端部の間に形成
された突起からなることを特徴としている。
上に搭載するための半導体装置は、半導体チップと;内
側端部および外側端部を有する複数の導電リードと;前
記半導体チップを前記リードの内側端部へ接続するため
の手段と;前記半導体チップおよびリードの内側端部を
囲むように形成されたプラスチックボディと;前記リー
ドの外側端部を、互いに整列状に維持するための手段と
;プリント回路板上の配線パターンからなる導電部に対
してリードの外側端部を整列状に維持するための手段と
を有してなり;リードの外側端部をプリント回路上の配
線パターンからなる導電部に対して整列状に維持するた
めの前記手段が、隣り合う各リード外側端部の間に形成
された突起からなることを特徴としている。
【0016】そしてまた請求項4の発明の、プリント回
路板上に搭載するための半導体装置は、半導体チップと
;内側端部および外側端部を有する複数の導電リードと
;前記半導体チップを前記リードの内側端部に接続する
ための手段と;前記半導体チップおよびリードの内側端
部を囲むように形成されたプラスチックボディと;前記
リードの外側端部を、互いに整列状に維持するための手
段と;前記リードの外側端部を、プリント回路板上の配
線パターンからなる導電部に対して整列状に維持するた
めの手段とを有してなり;前記プリント回路板に複数の
凹部が形成されており、かつその各凹部は、前記配線パ
ターンの隣り合う各導電部の間に位置しており、;さら
に、プリント回路板上の配線パターンからなる導電部に
対してリードの外側端部を整列状に維持するための前記
手段が、各リードの外側端部の間に形成された突起から
なり、各突起は、プリント回路板に形成された前記複数
の凹部のうちの対応するものに適合するような寸法およ
び形状に作られていることを特徴としている。
路板上に搭載するための半導体装置は、半導体チップと
;内側端部および外側端部を有する複数の導電リードと
;前記半導体チップを前記リードの内側端部に接続する
ための手段と;前記半導体チップおよびリードの内側端
部を囲むように形成されたプラスチックボディと;前記
リードの外側端部を、互いに整列状に維持するための手
段と;前記リードの外側端部を、プリント回路板上の配
線パターンからなる導電部に対して整列状に維持するた
めの手段とを有してなり;前記プリント回路板に複数の
凹部が形成されており、かつその各凹部は、前記配線パ
ターンの隣り合う各導電部の間に位置しており、;さら
に、プリント回路板上の配線パターンからなる導電部に
対してリードの外側端部を整列状に維持するための前記
手段が、各リードの外側端部の間に形成された突起から
なり、各突起は、プリント回路板に形成された前記複数
の凹部のうちの対応するものに適合するような寸法およ
び形状に作られていることを特徴としている。
【0017】一方請求項5の発明および請求項6の発明
は、プラスチックパッケージされた半導体装置のリード
の端部にウェッブを形成する方法についてのものである
。そのうち請求項5の発明の方法は、半導体チップを複
数のリードに接続する工程と;リードの外側端部がボデ
ィの外部へ延出するように、前記半導体チップを囲むプ
ラスチックボディを成形する工程とを有し;ボディを成
形する工程において、ボディを形成するプラスチック材
料が、隣り合う各リード間でボディの外側へ飛び出るよ
うにし、これによりボディの外部の隣り合う各リード間
にボディと一体となるウェッブを形成し;さらに各ウェ
ッブの外側端部に、プリント回路板の対応する凹部に適
合するような寸法・形状を有する突起を形成することを
特徴とするものである。
は、プラスチックパッケージされた半導体装置のリード
の端部にウェッブを形成する方法についてのものである
。そのうち請求項5の発明の方法は、半導体チップを複
数のリードに接続する工程と;リードの外側端部がボデ
ィの外部へ延出するように、前記半導体チップを囲むプ
ラスチックボディを成形する工程とを有し;ボディを成
形する工程において、ボディを形成するプラスチック材
料が、隣り合う各リード間でボディの外側へ飛び出るよ
うにし、これによりボディの外部の隣り合う各リード間
にボディと一体となるウェッブを形成し;さらに各ウェ
ッブの外側端部に、プリント回路板の対応する凹部に適
合するような寸法・形状を有する突起を形成することを
特徴とするものである。
【0018】また請求項6の発明の方法は、半導体チッ
プを複数のリードに接続する工程と;リードの外側端部
がボディの外側へ延出するように、前記半導体チップを
囲むプラスチックボディを成形する工程とを有し;ボデ
ィを成形する工程において、ボディを形成するプラスチ
ック材料が、隣り合う各リード間でボディの外側へ飛び
出るようにし、これによりボディの外部の隣り合う各リ
ード間にボディと一体となるウェッブを形成し;さらに
各ウェッブの外側の部分がリードの外側端部の間をブリ
ッジするつなぎ部材として残るように、各ウェッブの内
側の部分を切り取ることを特徴とするものである。
プを複数のリードに接続する工程と;リードの外側端部
がボディの外側へ延出するように、前記半導体チップを
囲むプラスチックボディを成形する工程とを有し;ボデ
ィを成形する工程において、ボディを形成するプラスチ
ック材料が、隣り合う各リード間でボディの外側へ飛び
出るようにし、これによりボディの外部の隣り合う各リ
ード間にボディと一体となるウェッブを形成し;さらに
各ウェッブの外側の部分がリードの外側端部の間をブリ
ッジするつなぎ部材として残るように、各ウェッブの内
側の部分を切り取ることを特徴とするものである。
【0019】さらに請求項7の発明は、プラスチックパ
ッケージされた半導体装置とプリント回路板との間の整
列位置決め方法についてのものであり、この請求項7の
発明は、隣り合う各リードの外側端部の間にプラスチッ
クからなるウェッブを備えた、プラスチックパッケージ
された半導体装置を形成することと;前記各ウェッブに
整列用の突起を形成することと;プリント回路板に、前
記各突起に対応する凹部を形成することと;プリント回
路板上に、前記突起が前記凹部に適合するように半導体
装置を搭載すること;とからなることを特徴とするもの
である。
ッケージされた半導体装置とプリント回路板との間の整
列位置決め方法についてのものであり、この請求項7の
発明は、隣り合う各リードの外側端部の間にプラスチッ
クからなるウェッブを備えた、プラスチックパッケージ
された半導体装置を形成することと;前記各ウェッブに
整列用の突起を形成することと;プリント回路板に、前
記各突起に対応する凹部を形成することと;プリント回
路板上に、前記突起が前記凹部に適合するように半導体
装置を搭載すること;とからなることを特徴とするもの
である。
【0020】
【作用】この発明においては、プラスチックパッケージ
された半導体装置は、成形されたプラスチックボディと
、それから延出する複数のリードとを有している。ボデ
ィを成形する際においては、プラスチックは隣り合うリ
ード間でボディの外側へ飛び出て、各リードの間にウェ
ッブを形成する。このウェッブは、リードを補強して、
各リードが平坦性、平行性を保つように整列状態に維持
する機能を果たす。なおこれらのウェッブは、リードが
折曲げられる領域では切取られても良く、その場合には
、ウェッブはリードの先端部間にのみタイバー(つなぎ
部材)として残る。さらに、そのウェッブにおけるリー
ドの先端近くの位置には、プリント回路板に対向する側
に突起(バンプ)が形成され、その突起は、各リードを
プリント回路板上の配線パターンの各導電部(各リード
を接続するべき部分)に対して正しく対応するように整
列させる機能を果たす。具体的には、その突起は、それ
を受けるべくその突起に対応する凹部が形成されている
プリント回路板に適合して半導体装置を位置決めする役
割を果たす。
された半導体装置は、成形されたプラスチックボディと
、それから延出する複数のリードとを有している。ボデ
ィを成形する際においては、プラスチックは隣り合うリ
ード間でボディの外側へ飛び出て、各リードの間にウェ
ッブを形成する。このウェッブは、リードを補強して、
各リードが平坦性、平行性を保つように整列状態に維持
する機能を果たす。なおこれらのウェッブは、リードが
折曲げられる領域では切取られても良く、その場合には
、ウェッブはリードの先端部間にのみタイバー(つなぎ
部材)として残る。さらに、そのウェッブにおけるリー
ドの先端近くの位置には、プリント回路板に対向する側
に突起(バンプ)が形成され、その突起は、各リードを
プリント回路板上の配線パターンの各導電部(各リード
を接続するべき部分)に対して正しく対応するように整
列させる機能を果たす。具体的には、その突起は、それ
を受けるべくその突起に対応する凹部が形成されている
プリント回路板に適合して半導体装置を位置決めする役
割を果たす。
【0021】この発明のプラスチックパッケージされた
半導体装置は、プリント回路板以外の媒体にも搭載でき
るが、その媒体は、プリント回路板の配線パターンの如
く接続されるべき部分を有する媒体でなければならない
。
半導体装置は、プリント回路板以外の媒体にも搭載でき
るが、その媒体は、プリント回路板の配線パターンの如
く接続されるべき部分を有する媒体でなければならない
。
【0022】
【実施例】図1および図2には、従来技術によるプラス
チックパッケージされた半導体装置100が示されるが
、これについては既に説明した。このようなパッケージ
を形成する技術すなわち、リードフレームに半導体ダイ
(半導体チップ)を搭載し、半導体チップおよびリード
の内側部分を囲むようにプラスチックボディを成形し、
リードフレームを切離し、そして各リードの間の余分な
プラスチックの突出部分を“デジャンキング”(除去)
する技術は良く知られている。
チックパッケージされた半導体装置100が示されるが
、これについては既に説明した。このようなパッケージ
を形成する技術すなわち、リードフレームに半導体ダイ
(半導体チップ)を搭載し、半導体チップおよびリード
の内側部分を囲むようにプラスチックボディを成形し、
リードフレームを切離し、そして各リードの間の余分な
プラスチックの突出部分を“デジャンキング”(除去)
する技術は良く知られている。
【0023】図3、図4および図5には、この発明によ
るプラスチックパッケージされた半導体装置200を、
その製造過程の種々の段階で示す。図3において、半導
体装置200は、ボディ202(図1におけるボディ1
08に対応する)と、複数のリード204(図1におけ
るリード106に対応する)とを有している。従来技術
と同様に、リード204は、千分の数インチのオーダー
の厚さ(t)を有する導電箔によって作られ、リード2
04それ自体は千分の6インチのオーダーの幅(w)を
有している。隣り合うリード204間の間隔(s)は千
分の15インチのオーダーである。このようにして、隣
り合うリード204の間の隙間に空間206が形成され
る。図示はしないが、図1および図2に関して説明した
ように、半導体チップがリード204の内側端部に取付
けられる。
るプラスチックパッケージされた半導体装置200を、
その製造過程の種々の段階で示す。図3において、半導
体装置200は、ボディ202(図1におけるボディ1
08に対応する)と、複数のリード204(図1におけ
るリード106に対応する)とを有している。従来技術
と同様に、リード204は、千分の数インチのオーダー
の厚さ(t)を有する導電箔によって作られ、リード2
04それ自体は千分の6インチのオーダーの幅(w)を
有している。隣り合うリード204間の間隔(s)は千
分の15インチのオーダーである。このようにして、隣
り合うリード204の間の隙間に空間206が形成され
る。図示はしないが、図1および図2に関して説明した
ように、半導体チップがリード204の内側端部に取付
けられる。
【0024】図3、図4に示されるように、リード20
4は従来技術と同様にリードフレーム210の外側環状
部分208に連続している。図3、図4で明らかなよう
に、ダムバー(図2のダムバー124)は存在しない。 したがって空間206は、隣り合うリード204と、ボ
ディ202の外側縁部(鎖線“B”で示す)と、角環状
部分208とによって画定される。
4は従来技術と同様にリードフレーム210の外側環状
部分208に連続している。図3、図4で明らかなよう
に、ダムバー(図2のダムバー124)は存在しない。 したがって空間206は、隣り合うリード204と、ボ
ディ202の外側縁部(鎖線“B”で示す)と、角環状
部分208とによって画定される。
【0025】この発明によれば、ボディ202を成形す
るために用いられるプラスチック成形材料は隣り合うリ
ード204の間の隙間に飛び出て(滲み出て)、空間2
06を実質的に完全に埋める。これによって導電リード
204の隣り合う各1対の間にプラスチック“ウェッブ
”220が形成される。各ウェッブ220はリード20
4の厚み(t)と実質的に等しい厚みを有し、かつ隣り
合うリード204の間の間隔(s)と実質的に等しい幅
を有する。最終的には、角環状部分208は切取られる
(図2について説明したと同様に鎖線Aに沿って)。 その後半導体装置200を取り扱うにあたっては、リー
ドの間の隙間のプラスチックウェッブ220は、リード
を保持しかつリードの平坦性および平行性(および歪み
のなさ)を維持するに役立つ。
るために用いられるプラスチック成形材料は隣り合うリ
ード204の間の隙間に飛び出て(滲み出て)、空間2
06を実質的に完全に埋める。これによって導電リード
204の隣り合う各1対の間にプラスチック“ウェッブ
”220が形成される。各ウェッブ220はリード20
4の厚み(t)と実質的に等しい厚みを有し、かつ隣り
合うリード204の間の間隔(s)と実質的に等しい幅
を有する。最終的には、角環状部分208は切取られる
(図2について説明したと同様に鎖線Aに沿って)。 その後半導体装置200を取り扱うにあたっては、リー
ドの間の隙間のプラスチックウェッブ220は、リード
を保持しかつリードの平坦性および平行性(および歪み
のなさ)を維持するに役立つ。
【0026】実際上の価値はないが、リードフレーム2
10には、初期においてはダムバーが形成されていても
良い。しかしながら空間206にプラスチック成形材料
が流れ込むことを妨げないように、成形に先立ってダム
バーは切取られている必要がある。
10には、初期においてはダムバーが形成されていても
良い。しかしながら空間206にプラスチック成形材料
が流れ込むことを妨げないように、成形に先立ってダム
バーは切取られている必要がある。
【0027】図に示すような、対称な側にそれぞれ複数
の導電リードが並んでいるDIP半導体装置の例では、
半導体装置の各々の側にn本のリードとn−1個のウェ
ッブが存在する。その他のプラスチックパッケージされ
た半導体装置でも同様な原則が適用される。図4および
図5に詳細に示されるように、各ウェップ220には、
そのウェッブの外側部分に下方(これらの図における下
方)へ突出する“バンプ”(突起)222が形成されて
いる。これらの突起222は、成形工程中(図6に関し
て後に説明する)において、各リード204の中間でか
つリード204の外側端部近くの位置に形成される。
の導電リードが並んでいるDIP半導体装置の例では、
半導体装置の各々の側にn本のリードとn−1個のウェ
ッブが存在する。その他のプラスチックパッケージされ
た半導体装置でも同様な原則が適用される。図4および
図5に詳細に示されるように、各ウェップ220には、
そのウェッブの外側部分に下方(これらの図における下
方)へ突出する“バンプ”(突起)222が形成されて
いる。これらの突起222は、成形工程中(図6に関し
て後に説明する)において、各リード204の中間でか
つリード204の外側端部近くの位置に形成される。
【0028】図5に示されるように、各リード204は
、その最も先端の部分をプリント回路板(図7参照)の
上の配線パターンなどに取り付けるため、その先端部分
がボディ202と平行でかつボディ202よりも下側の
位置で外側へ延出するように、最終的にはガルウィング
(かもめの翼)形状に成形される。
、その最も先端の部分をプリント回路板(図7参照)の
上の配線パターンなどに取り付けるため、その先端部分
がボディ202と平行でかつボディ202よりも下側の
位置で外側へ延出するように、最終的にはガルウィング
(かもめの翼)形状に成形される。
【0029】以上の説明では、ウェッブ220は、隣り
合うリードの各対の間のすべての空間206に形成され
ている。しかしながら、ウェッブ220は隣り合うリー
ドの各対のうち、少なくとも最も外側(終端側)に位置
するリード対の間(半導体装置200のコーナー部分に
相当する位置)に形成されていれば良い。
合うリードの各対の間のすべての空間206に形成され
ている。しかしながら、ウェッブ220は隣り合うリー
ドの各対のうち、少なくとも最も外側(終端側)に位置
するリード対の間(半導体装置200のコーナー部分に
相当する位置)に形成されていれば良い。
【0030】さらにリードをガルウィング形状に成形す
る際において、ウェッブ220のうち本来重要なのは突
起222が形成されている先端部分である。最終的には
、ウェッブ220の内側部分は切取られても良い。
る際において、ウェッブ220のうち本来重要なのは突
起222が形成されている先端部分である。最終的には
、ウェッブ220の内側部分は切取られても良い。
【0031】図には示していないが、以上の変形例とし
て、プラスチック材料は突起222の反対側においてリ
ードを越えて流れても良い。
て、プラスチック材料は突起222の反対側においてリ
ードを越えて流れても良い。
【0032】図6には、プラスチックボディ202とプ
ラスチックウェッブ220および突起222を成形する
ために用いられる金型300の下型302を示す。この
下型302には突起222を形成するための複数の凹部
304が存在する。リード204の位置を鎖線で示して
いる。好ましい成形方法は高圧のトランスファー成形で
ある。金型の上型と下型の間には、リードによってギャ
ップが形成される。従来技術では、ダムバーが金型中に
プラスチック成形材料を閉じ込めておく機能を果たして
いた。この発明では、プラスチック成形材料がリードの
間からボディの外側へ滲み出てウェッブ220を形成す
ることが許容(促進)される。それよりも過剰なプラス
チック材料の滲出は外側角環状部分208(図3参照)
によって制限される。
ラスチックウェッブ220および突起222を成形する
ために用いられる金型300の下型302を示す。この
下型302には突起222を形成するための複数の凹部
304が存在する。リード204の位置を鎖線で示して
いる。好ましい成形方法は高圧のトランスファー成形で
ある。金型の上型と下型の間には、リードによってギャ
ップが形成される。従来技術では、ダムバーが金型中に
プラスチック成形材料を閉じ込めておく機能を果たして
いた。この発明では、プラスチック成形材料がリードの
間からボディの外側へ滲み出てウェッブ220を形成す
ることが許容(促進)される。それよりも過剰なプラス
チック材料の滲出は外側角環状部分208(図3参照)
によって制限される。
【0033】図7には、プリント回路板400に搭載さ
れるべきこの発明による完成された半導体装置200を
示す。プリント回路板には、リード204の形状(リー
ド204の外側端部の形状)に対応する(符合する)よ
うな配線パターンの導電部402が形成されている。さ
らにプリント回路板には、突起222に対応するように
間隔をおいて配列された複数の凹部406が形成されて
いる。これらの凹部はプリント回路板を貫通する単純な
孔であっても良い。プラスチックパッケージされた半導
体装置200がプリント回路板400に搭載される際に
は、リード204の外側端部は導電部402上に位置し
、突起222は凹部406に位置する。突起222は半
導体装置200をプリント回路板400に搭載する際に
位置決め部材として機能し、プリント回路板400に対
して半導体装置200を正しい位置に維持すること、特
に導電部406に対しリード204を正しい位置に維持
することに寄与する。これは、半導体装置と回路基板を
組立てるに際して極めて有利となる。また各リードの間
のウェッブが取扱い上の支持機能を有することは明らか
である。
れるべきこの発明による完成された半導体装置200を
示す。プリント回路板には、リード204の形状(リー
ド204の外側端部の形状)に対応する(符合する)よ
うな配線パターンの導電部402が形成されている。さ
らにプリント回路板には、突起222に対応するように
間隔をおいて配列された複数の凹部406が形成されて
いる。これらの凹部はプリント回路板を貫通する単純な
孔であっても良い。プラスチックパッケージされた半導
体装置200がプリント回路板400に搭載される際に
は、リード204の外側端部は導電部402上に位置し
、突起222は凹部406に位置する。突起222は半
導体装置200をプリント回路板400に搭載する際に
位置決め部材として機能し、プリント回路板400に対
して半導体装置200を正しい位置に維持すること、特
に導電部406に対しリード204を正しい位置に維持
することに寄与する。これは、半導体装置と回路基板を
組立てるに際して極めて有利となる。また各リードの間
のウェッブが取扱い上の支持機能を有することは明らか
である。
【0034】リード(すなわち符号204)が導電部(
符号402)上に載置される場合には、リードは導電部
に例えばリフロー処理等によって半田付けされる。導電
部がリードの外縁を囲むようなパターンで形成されてい
る場合には、リードはワイヤーボンド等の手段により導
電部に接続される。
符号402)上に載置される場合には、リードは導電部
に例えばリフロー処理等によって半田付けされる。導電
部がリードの外縁を囲むようなパターンで形成されてい
る場合には、リードはワイヤーボンド等の手段により導
電部に接続される。
【0035】図7に示すように、ウェッブ220の内側
端部、特にリードが折曲げられる領域(折曲げ位置を鎖
線CおよびDによって示す)の部分は除去(デジャンキ
ング)しても良く、この場合にはウェッブ220は、リ
ード204の先端部間をブリッジするプラスチック“タ
イバー”(つなぎ部材)220aの部分のみが残される
。これらのつなぎ部材、すなわち“狭められたウェッブ
”220aの長さ(リードに沿った方向の長さ)は千分
の10から20インチのオーダーであれば良い。
端部、特にリードが折曲げられる領域(折曲げ位置を鎖
線CおよびDによって示す)の部分は除去(デジャンキ
ング)しても良く、この場合にはウェッブ220は、リ
ード204の先端部間をブリッジするプラスチック“タ
イバー”(つなぎ部材)220aの部分のみが残される
。これらのつなぎ部材、すなわち“狭められたウェッブ
”220aの長さ(リードに沿った方向の長さ)は千分
の10から20インチのオーダーであれば良い。
【0036】
【発明の効果】この発明の半導体装置によれば、ボディ
から延出するリード間に形成されているウェッブが、リ
ードを補強する役割を果たし、そのためリード部分が堅
固となり、その平坦性、平行性を確実に維持して、半導
体装置の取扱いを容易にすることができる。またそのウ
ェッブによってリードが正しく整列状態に維持されると
ころから、プリント回路板上に半導体装置を搭載するに
あたって、プリント回路板上の配線パターンの各導電部
(リードを接続すべき部分)に対してリードを正しい位
置に保つことが容易となる。
から延出するリード間に形成されているウェッブが、リ
ードを補強する役割を果たし、そのためリード部分が堅
固となり、その平坦性、平行性を確実に維持して、半導
体装置の取扱いを容易にすることができる。またそのウ
ェッブによってリードが正しく整列状態に維持されると
ころから、プリント回路板上に半導体装置を搭載するに
あたって、プリント回路板上の配線パターンの各導電部
(リードを接続すべき部分)に対してリードを正しい位
置に保つことが容易となる。
【0037】さらに、特にリードの先端近くの位置にお
いてウェッブに突起を形成した場合、その突起がリード
をプリント回路板上の配線パターンの導電部に対して位
置決めさせる機能を果たすから、プリント回路板上に半
導体装置を搭載しかつリードをプリント回路板上の導電
部に接続するにあたって、リードの位置を容易かつ正確
に導電部の位置に合致させることができる。
いてウェッブに突起を形成した場合、その突起がリード
をプリント回路板上の配線パターンの導電部に対して位
置決めさせる機能を果たすから、プリント回路板上に半
導体装置を搭載しかつリードをプリント回路板上の導電
部に接続するにあたって、リードの位置を容易かつ正確
に導電部の位置に合致させることができる。
【0038】したがってこの発明によれば、半導体装置
の取扱いが容易となるとともに、プリント回路板上への
半導体装置の搭載、接続作業を従来よりも格段に簡単か
つ容易に行なうことが可能となる。
の取扱いが容易となるとともに、プリント回路板上への
半導体装置の搭載、接続作業を従来よりも格段に簡単か
つ容易に行なうことが可能となる。
【図1】従来技術によって完成されたプラスチックパッ
ケージ半導体装置の斜視図である。
ケージ半導体装置の斜視図である。
【図2】図1に示される半導体装置を、その製造過程に
おける中間段階で示す部分省略平面図であってリードフ
レームが示されている。
おける中間段階で示す部分省略平面図であってリードフ
レームが示されている。
【図3】この発明のプラスチックパッケージ半導体装置
について、その製造過程における中間段階で示す平面図
である。
について、その製造過程における中間段階で示す平面図
である。
【図4】図3の半導体装置を図3中のX−X線の位置で
示す断面図である。
示す断面図である。
【図5】この発明によって完成されたプラスチックパッ
ケージ半導体装置を図3のY−Y線に相当する位置で示
す正面図である。
ケージ半導体装置を図3のY−Y線に相当する位置で示
す正面図である。
【図6】この発明においてプラスチックパッケージ半導
体装置を成形するための金型の下型を示す斜視図である
。
体装置を成形するための金型の下型を示す斜視図である
。
【図7】この発明により完成された半導体装置をプリン
ト回路板上に搭載する状況を示す拡大斜視図である。
ト回路板上に搭載する状況を示す拡大斜視図である。
102 半導体チップ
200 半導体装置
202 プラスチックボディ
204 リード
220 ウェッブ
220a つなぎ部材
222 突起
400 プリント回路板
402 導電部
406 凹部
Claims (7)
- 【請求項1】 半導体チップと;内側端部および外側
端部を有する複数の導電リードと;前記半導体チップを
前記リードの内側端部に接続するための手段と;前記半
導体チップおよびリードの内側端部を囲むように形成さ
れたプラスチックボディと;前記リードの外側端部を、
互いに整列状に維持するための手段とを有してなり;リ
ードの外側端部を互いに整列状に維持するための前記手
段が、隣り合う各リード間のプラスチック製のウェッブ
からなり、そのウェッブは、前記プラスツチックボディ
と連続一体に作られるとともに、そのプラスチックボデ
ィから各リードの間をそのリードの外側端部へ向けて延
出されていることを特徴とする、プリント回路板上に搭
載するための半導体装置。 - 【請求項2】 半導体チップと;内側端部および外側
端部を有する複数の半導体リードと;前記半導体チップ
を前記リードの内側端部に接続するための手段と;前記
半導体チップとリードの内側端部とを囲むように形成さ
れたプラスチックボディと;前記リードの外側端部を、
互いに整列状に維持するための手段とを有してなり;リ
ードの外側端部を互いに整列状に維持するための前記手
段が、隣り合う各リード間のプラスチック製のウェッブ
からなり;さらに、プリント回路板上の配線パターンか
らなる導電部に対してリードの外側端部を整列状に維持
するための手段を有し;リードの外側端部をプリント回
路上の配線パターンからなる導電部に対して整列状に維
持するための前記手段が、前記各ウェッブに形成された
突起からなり、その突起は、前記プラスチックボディお
よびウェッブと同じプラスチック材料からなることを特
徴とする、プリント回路板上に搭載するための半導体装
置。 - 【請求項3】 半導体チップと;内側端部および外側
端部を有する複数の導電リードと;前記半導体チップを
前記リードの内側端部へ接続するための手段と;前記半
導体チップおよびリードの内側端部を囲むように形成さ
れたプラスチックボディと;前記リードの外側端部を、
互いに整列状に維持するための手段と;プリント回路板
上の配線パターンからなる導電部に対してリードの外側
端部を整列状に維持するための手段とを有してなり;リ
ードの外側端部をプリント回路上の配線パターンからな
る導電部に対して整列状に維持するための前記手段が、
隣り合う各リード外側端部の間に形成された突起からな
ることを特徴とする、プリント回路板上に搭載するため
の半導体装置。 - 【請求項4】 半導体チップと;内側端部および外側
端部を有する複数の導電リードと;前記半導体チップを
前記リードの内側端部に接続するための手段と;前記半
導体チップおよびリードの内側端部を囲むように形成さ
れたプラスチックボディと;前記リードの外側端部を、
互いに整列状に維持するための手段と;前記リードの外
側端部を、プリント回路板上の配線パターンからなる導
電部に対して整列状に維持するための手段とを有してな
り;前記プリント回路板に複数の凹部が形成されており
、かつその各凹部は、前記配線パターンの隣り合う各導
電部の間に位置しており、;さらに、プリント回路板上
の配線パターンからなる導電部に対してリードの外側端
部を整列状に維持するための前記手段が、各リードの外
側端部の間に形成された突起からなり、各突起は、プリ
ント回路板に形成された前記複数の凹部のうちの対応す
るものに適合するような寸法および形状に作られている
ことを特徴とする、プリント回路板上に搭載するための
半導体装置。 - 【請求項5】 半導体チップを複数のリードに接続す
る工程と;リードの外側端部がボディの外部へ延出する
ように、前記半導体チップを囲むプラスチックボディを
成形する工程とを有し;ボディを成形する工程において
、ボディを形成するプラスチック材料が、隣り合う各リ
ード間でボディの外側へ飛び出るようにし、これにより
ボディの外部の隣り合う各リード間にボディと一体とな
るウェッブを形成し;さらに各ウェッブの外側端部に、
プリント回路板の対応する凹部に適合するような寸法・
形状を有する突起を形成することを特徴とする、プラス
チックパッケージされた半導体装置のリードの端部にウ
ェッブを形成する方法。 - 【請求項6】 半導体チップを複数のリードに接続す
る工程と;リードの外側端部がボディの外側へ延出する
ように、前記半導体チップを囲むプラスチックボディを
成形する工程とを有し;ボディを成形する工程において
、ボディを形成するプラスチック材料が、隣り合う各リ
ード間でボディの外側へ飛び出るようにし、これにより
ボディの外部の隣り合う各リード間にボディと一体とな
るウェッブを形成し;さらに各ウェッブの外側の部分が
リードの外側端部の間をブリッジするつなぎ部材として
残るように、各ウェッブの内側の部分を切り取ることを
特徴とする、プラスチックパッケージされた半導体装置
のリードの端部にウェッブを形成する方法。 - 【請求項7】 隣り合う各リードの外側端部の間にプ
ラスチックからなるウェッブを備えた、プラスチックパ
ッケージされた半導体装置を形成することと;前記各ウ
ェッブに整列用の突起を形成することと;プリント回路
板に、前記各突起に対応する凹部を形成することと;プ
リント回路板上に、前記突起が前記凹部に適合するよう
に半導体装置を搭載すること;とからなることを特徴と
する、プラスチックパッケージされた半導体装置とプリ
ント回路板との間の整列位置決め方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US07/619,108 US5051813A (en) | 1989-12-19 | 1990-11-27 | Plastic-packaged semiconductor device having lead support and alignment structure |
US07/619108 | 1990-11-27 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04290257A true JPH04290257A (ja) | 1992-10-14 |
Family
ID=24480488
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3337816A Pending JPH04290257A (ja) | 1990-11-27 | 1991-11-27 | プリント回路板上に搭載するための半導体装置 |
Country Status (5)
Country | Link |
---|---|
US (1) | US5051813A (ja) |
EP (1) | EP0488091B1 (ja) |
JP (1) | JPH04290257A (ja) |
DE (1) | DE69127799T2 (ja) |
ES (1) | ES2109931T3 (ja) |
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- 1991-11-22 DE DE69127799T patent/DE69127799T2/de not_active Expired - Fee Related
- 1991-11-22 EP EP91120009A patent/EP0488091B1/en not_active Expired - Lifetime
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19991026 |