JPH0354919B2 - - Google Patents
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- JPH0354919B2 JPH0354919B2 JP58239609A JP23960983A JPH0354919B2 JP H0354919 B2 JPH0354919 B2 JP H0354919B2 JP 58239609 A JP58239609 A JP 58239609A JP 23960983 A JP23960983 A JP 23960983A JP H0354919 B2 JPH0354919 B2 JP H0354919B2
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- 238000001514 detection method Methods 0.000 claims description 10
- 238000010168 coupling process Methods 0.000 claims description 4
- 238000005859 coupling reaction Methods 0.000 claims description 4
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- 238000006243 chemical reaction Methods 0.000 description 11
- 238000010586 diagram Methods 0.000 description 3
- 230000003321 amplification Effects 0.000 description 2
- 238000001914 filtration Methods 0.000 description 2
- 230000006870 function Effects 0.000 description 2
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- 239000013078 crystal Substances 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N11/00—Colour television systems
- H04N11/06—Transmission systems characterised by the manner in which the individual colour picture signal components are combined
- H04N11/12—Transmission systems characterised by the manner in which the individual colour picture signal components are combined using simultaneous signals only
- H04N11/14—Transmission systems characterised by the manner in which the individual colour picture signal components are combined using simultaneous signals only in which one signal, modulated in phase and amplitude, conveys colour information and a second signal conveys brightness information, e.g. NTSC-system
- H04N11/16—Transmission systems characterised by the manner in which the individual colour picture signal components are combined using simultaneous signals only in which one signal, modulated in phase and amplitude, conveys colour information and a second signal conveys brightness information, e.g. NTSC-system the chrominance signal alternating in phase, e.g. PAL-system
- H04N11/165—Decoding means therefor
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Processing Of Color Television Signals (AREA)
- Color Television Systems (AREA)
Description
【発明の詳細な説明】
本発明はサンプリング信号によつてサンプリン
グ周波数でサンプリングしたカラーテレビジヨン
信号の内のデジタル化した搬送色信号用の復調回
路にあつて、搬送色信号復調用のサンプリング周
波数にて発生する搬送色信号の副搬送波周波数に
係わるデジタル基準信号をサンプリング信号から
得るための第１デジタル発振器を具え、搬送色信
号を復調するために、前記第１デジタル発振器の
位相制御信号入力を色同期信号位相検波回路の出
力に結合させるようにした復調回路に関するもの
である。
グ周波数でサンプリングしたカラーテレビジヨン
信号の内のデジタル化した搬送色信号用の復調回
路にあつて、搬送色信号復調用のサンプリング周
波数にて発生する搬送色信号の副搬送波周波数に
係わるデジタル基準信号をサンプリング信号から
得るための第１デジタル発振器を具え、搬送色信
号を復調するために、前記第１デジタル発振器の
位相制御信号入力を色同期信号位相検波回路の出
力に結合させるようにした復調回路に関するもの
である。
英国特許願第2061053号には、水平偏向周波数
に結合されるサンプリング周波数でサンプリング
される搬送色信号用の上述した種類の復調回路が
記載されている。水平偏向周波数が変動する際
に、これらが例えばビデオレコーダから到来する
カラーテレビジヨン信号のような非標準カラーテ
レビジヨン信号中に発生すると、斯かる復調回路
は最早満足に作動しなくなることを確めた。
に結合されるサンプリング周波数でサンプリング
される搬送色信号用の上述した種類の復調回路が
記載されている。水平偏向周波数が変動する際
に、これらが例えばビデオレコーダから到来する
カラーテレビジヨン信号のような非標準カラーテ
レビジヨン信号中に発生すると、斯かる復調回路
は最早満足に作動しなくなることを確めた。
本発明の目的は水平偏向周波数が変動し得るカ
ラーテレビジヨン信号にも適するように適切に接
線配置した上述した種類の復調回路を提供するこ
とにある。
ラーテレビジヨン信号にも適するように適切に接
線配置した上述した種類の復調回路を提供するこ
とにある。
本発明は冒頭にて述べた種類の復調回路におい
て、サンプリング信号を定周波信号源から第２デ
ジタル発振器を介して得るようにし、該第２デジ
タル発振器のデジタル数に対する入力を位相検波
回路の出力に結合させて、サンプリング信号と水
平偏向周波数の信号との間の周波数と位相の比を
一定に保つようにし、前記デジタル数に対する入
力を除算回路の入力にも結合させて、色同期信号
位相検波回路の出力から得られるデジタル数を前
記第２デジタル発振器へのデジタル数で除算せし
めるようにし、前記除算回路の出力を第１デジタ
ル発振器のデジタル数に対する入力に結合させる
ようにしたことを特徴とする。
て、サンプリング信号を定周波信号源から第２デ
ジタル発振器を介して得るようにし、該第２デジ
タル発振器のデジタル数に対する入力を位相検波
回路の出力に結合させて、サンプリング信号と水
平偏向周波数の信号との間の周波数と位相の比を
一定に保つようにし、前記デジタル数に対する入
力を除算回路の入力にも結合させて、色同期信号
位相検波回路の出力から得られるデジタル数を前
記第２デジタル発振器へのデジタル数で除算せし
めるようにし、前記除算回路の出力を第１デジタ
ル発振器のデジタル数に対する入力に結合させる
ようにしたことを特徴とする。
定周波信号源およびサンプリング信号を得るた
めの第２デジタル発振器の使用によつて、水平偏
向周波数の周波数変動を確認し得ると共に、その
変動を第１デジタル発振器の位相制御ループにて
補償することができる。従つて、第１デジタル発
振器の位相制御ループは色同期信号の側波帯周波
数の１つに引込まれなくなり（本発明による手段
を探らない回路の場合には引込まれる）、第１デ
ジタル発振器の出力信号に係わる位相の必要な安
定度が得られる。
めの第２デジタル発振器の使用によつて、水平偏
向周波数の周波数変動を確認し得ると共に、その
変動を第１デジタル発振器の位相制御ループにて
補償することができる。従つて、第１デジタル発
振器の位相制御ループは色同期信号の側波帯周波
数の１つに引込まれなくなり（本発明による手段
を探らない回路の場合には引込まれる）、第１デ
ジタル発振器の出力信号に係わる位相の必要な安
定度が得られる。
定周波信号源は、例えばテレテキスト信号処
理、フイールド数変換および時間軸補償のような
作用の１つ以上を行なうのにも使用することがで
きる。
理、フイールド数変換および時間軸補償のような
作用の１つ以上を行なうのにも使用することがで
きる。
図面につき本発明を説明する。
本発明による復調回路の一例を示す第１図にお
いて、アナログ−デジタル変換器３の入力１には
カラーテレビジヨン信号を供給する。アナログ−
デジタル変換器３は入力５にてサンプリング信号
をサンプリング周波数ｎ・fHにて受信し、このサ
ンプリング周波数は水平偏向周波数fHのｎ倍であ
り、こゝにｎは必ずしも整数とする必要はない。
いて、アナログ−デジタル変換器３の入力１には
カラーテレビジヨン信号を供給する。アナログ−
デジタル変換器３は入力５にてサンプリング信号
をサンプリング周波数ｎ・fHにて受信し、このサ
ンプリング周波数は水平偏向周波数fHのｎ倍であ
り、こゝにｎは必ずしも整数とする必要はない。
アナログ−デイジタル変換器３の出力７から得
られるデジタル化されたカラーテレビジヨン信号
はフイルタリング装置（図示せず）によつて輝度
信号Ｙと搬送色信号CHRとに分けられ、輝度信
号Ｙはフイールド数変換用回路１１の入力９に供
給され、搬送色信号CHRはデジタル同期復調器
１７および１９の各入力１３および１５にそれぞ
れ供給される。
られるデジタル化されたカラーテレビジヨン信号
はフイルタリング装置（図示せず）によつて輝度
信号Ｙと搬送色信号CHRとに分けられ、輝度信
号Ｙはフイールド数変換用回路１１の入力９に供
給され、搬送色信号CHRはデジタル同期復調器
１７および１９の各入力１３および１５にそれぞ
れ供給される。
各復調器１７および１９の各基準信号入力２１
および２３には、前述したサンプリング周波数で
サンプリングされる搬送色信号の色副搬送波周波
数の基準信号が供給される。この基準信号は、読
取り専用メモリ（ROM）形態のものとし得る関
数発生器またはデコーダ２９の各出力２５および
２７からそれぞれ得られ、デコーダ２９の入力３
１にはサンプリング周波数ｎ・fHでサンプリング
される色副搬送波周波数fSの信号を供給する。
および２３には、前述したサンプリング周波数で
サンプリングされる搬送色信号の色副搬送波周波
数の基準信号が供給される。この基準信号は、読
取り専用メモリ（ROM）形態のものとし得る関
数発生器またはデコーダ２９の各出力２５および
２７からそれぞれ得られ、デコーダ２９の入力３
１にはサンプリング周波数ｎ・fHでサンプリング
される色副搬送波周波数fSの信号を供給する。
デコーダ２９の入力３１に現われる信号は第１
デジタル発振器３５の出力３３から到来する。こ
の第１デジタル発振器３５の入力３７にはアナロ
グ−デジタル変換器３の入力５にも供給されるサ
ンプリング信号ｎ・fHを供給する。第１デジタル
発振器３５の入力３９は組合わせデジタル信号を
受信し、このデジタル信号は発振器３５の出力３
３に周波数fSの信号を得るために、デジタル数
１／ｎ・fH・fSを表わすものとし、このデイジタル数 によつて出力３３におけるサンプリング周波数で
サンプリングされる信号の周波数および位相を決
定する。第１デジタル発振器３５の作動について
は後に第２図につき詳述する。
デジタル発振器３５の出力３３から到来する。こ
の第１デジタル発振器３５の入力３７にはアナロ
グ−デジタル変換器３の入力５にも供給されるサ
ンプリング信号ｎ・fHを供給する。第１デジタル
発振器３５の入力３９は組合わせデジタル信号を
受信し、このデジタル信号は発振器３５の出力３
３に周波数fSの信号を得るために、デジタル数
１／ｎ・fH・fSを表わすものとし、このデイジタル数 によつて出力３３におけるサンプリング周波数で
サンプリングされる信号の周波数および位相を決
定する。第１デジタル発振器３５の作動について
は後に第２図につき詳述する。
第１デジタル発振器３５の入力３９に現われる
デジタル数１／ｎ・fH・fSは除算回路４３の出力４１ から得られ、この除算回路４３の入力４５は色同
期信号処理回路４９の出力４７に接続する。処理
回路４９の入力５１および５３には各復調器１７
および１９の出力５５および５７からそれぞれ到
来する各復調色差信号ＵおよびＶをそれぞれ供給
する。これらの色差信号は復調色同期信号も含ん
でいるため、復調器１７，１９は色同期信号処理
回路４９と共に色同期信号位相検波回路を構成
し、この位相検波回路には周知の如く、所要に応
じ別個の復調器を設けることもできる。
デジタル数１／ｎ・fH・fSは除算回路４３の出力４１ から得られ、この除算回路４３の入力４５は色同
期信号処理回路４９の出力４７に接続する。処理
回路４９の入力５１および５３には各復調器１７
および１９の出力５５および５７からそれぞれ到
来する各復調色差信号ＵおよびＶをそれぞれ供給
する。これらの色差信号は復調色同期信号も含ん
でいるため、復調器１７，１９は色同期信号処理
回路４９と共に色同期信号位相検波回路を構成
し、この位相検波回路には周知の如く、所要に応
じ別個の復調器を設けることもできる。
色同期信号位相検波回路１７，１９，４９の出
力４７からはデジタル数fS／fCを表わす組合せデ
ジタル信号が得られ、この信号は色副搬送波周波
数fSに比例すると共に一定周波数fCに反比例する。
なお、これについては後に詳述する。
力４７からはデジタル数fS／fCを表わす組合せデ
ジタル信号が得られ、この信号は色副搬送波周波
数fSに比例すると共に一定周波数fCに反比例する。
なお、これについては後に詳述する。
fSに対する比例項は、例えば慣例の位相検波器
の出力量に公称色副搬送波周波数を表わす値f0を
加えことによつて得られる。ループ増幅度を適当
に選定することによつて、除算回路４３の入力４
５に供給される信号値をfS／fCに等しくする。
の出力量に公称色副搬送波周波数を表わす値f0を
加えことによつて得られる。ループ増幅度を適当
に選定することによつて、除算回路４３の入力４
５に供給される信号値をfS／fCに等しくする。
除算回路４３の出力４１にデジタル数
１／ｎ・fH・fSを得るために、除算回路４３の別の入 力５６にはデジタル数ｎ／fC・fHを供給する必要が ある。このデジタル数は位相検波器５９の出力５
８から得られ、この検波器の一方の入力６１は
１／ｎの分周器６３を介して変換器６７の出力６
５に接続し、変換器６７の出力６５はアナログ−
デジタル変換器３の入力５および第１デジタル発
振器３５の入力３７にも接続する。位相検波器５
９の他方の入力６９は同期信号分離回路７１を介
してアナログ−デジタル変換器３の出力７に接続
して、テレビジヨン信号から水平偏向周波数fHの
同期信号を受信する。
１／ｎ・fH・fSを得るために、除算回路４３の別の入 力５６にはデジタル数ｎ／fC・fHを供給する必要が ある。このデジタル数は位相検波器５９の出力５
８から得られ、この検波器の一方の入力６１は
１／ｎの分周器６３を介して変換器６７の出力６
５に接続し、変換器６７の出力６５はアナログ−
デジタル変換器３の入力５および第１デジタル発
振器３５の入力３７にも接続する。位相検波器５
９の他方の入力６９は同期信号分離回路７１を介
してアナログ−デジタル変換器３の出力７に接続
して、テレビジヨン信号から水平偏向周波数fHの
同期信号を受信する。
変換器６７の入力７３は第２デジタル発振器７
７の出力７５に接続する。この発振器７７の入力
７９は発振器８３の出力８１から一定周波数fCの
信号を受信する。なお、デジタル発振器７７の入
力８４には位相検波器５９の出力５８に現われる
デジタル数ｎ／fC・fHを供給する。変換器６７は、 周波数fCでサンプリングした周波数ｎ・fHのこぎ
り波状信号となるデジタル発振器７７の出力信号
をパルス状信号に変換し、この信号から周波数fC
および他の妨害周波数信号をろ波する。
７の出力７５に接続する。この発振器７７の入力
７９は発振器８３の出力８１から一定周波数fCの
信号を受信する。なお、デジタル発振器７７の入
力８４には位相検波器５９の出力５８に現われる
デジタル数ｎ／fC・fHを供給する。変換器６７は、 周波数fCでサンプリングした周波数ｎ・fHのこぎ
り波状信号となるデジタル発振器７７の出力信号
をパルス状信号に変換し、この信号から周波数fC
および他の妨害周波数信号をろ波する。
位相検波器５９の出力信号を上述したように、
第１デジタル発振器３５の位相制御ループに導入
する場合には、水平偏向周波数の変動を必ずしも
位相検波回路１７，１９，４９によつて斯かる制
御ループにて再調整する必要はない。従つて、水
平偏向周波数の変動時に斯かる位相制御ループが
色副搬送波の測波帯周波数に引込まれなくなる。
第１デジタル発振器３５の出力信号における位相
誤差をなくすためには、発振器８３の周波数を安
定させ、好ましくはこの目的のために水晶発振器
を用いるようにする必要がある。
第１デジタル発振器３５の位相制御ループに導入
する場合には、水平偏向周波数の変動を必ずしも
位相検波回路１７，１９，４９によつて斯かる制
御ループにて再調整する必要はない。従つて、水
平偏向周波数の変動時に斯かる位相制御ループが
色副搬送波の測波帯周波数に引込まれなくなる。
第１デジタル発振器３５の出力信号における位相
誤差をなくすためには、発振器８３の周波数を安
定させ、好ましくはこの目的のために水晶発振器
を用いるようにする必要がある。
この場合、発振器８３の出力８１に現われる信
号fCはフイールド数変換用回路１１の読取クロツ
ク信号入力８５にも供給する。フイールド数変換
用回路１１の書込クロツク信号入力８７は変換器
６７の出力６５に接続する。所要に応じ、所望な
周波数比を得るために、発振器８３の出力８１か
ら第２デジタル発振器７７の入力７９およびフイ
ールド数変換用回路１１の読取クロツク信号入力
８５に至る信号通路に分周回路を配置することが
できることは勿論である。
号fCはフイールド数変換用回路１１の読取クロツ
ク信号入力８５にも供給する。フイールド数変換
用回路１１の書込クロツク信号入力８７は変換器
６７の出力６５に接続する。所要に応じ、所望な
周波数比を得るために、発振器８３の出力８１か
ら第２デジタル発振器７７の入力７９およびフイ
ールド数変換用回路１１の読取クロツク信号入力
８５に至る信号通路に分周回路を配置することが
できることは勿論である。
発振器８３の出力信号は、例えばテレテキスト
信号処理回路（図示せず）にも使用することがで
きる。
信号処理回路（図示せず）にも使用することがで
きる。
フイールド数変換用回路１１は、その入力９に
て周波数ｎ・fHでサンプリングされた輝度信号Ｙ
を受信する以外に、入力８９および９１でもそれ
ぞれ色差信号ＵおよびＶを受信し、これらの色差
信号も周波数ｎ・fHでサンプリングされて、復調
器１７，１９の出力５５，５７から得られる。こ
れらの３つの信号を、例えば本来既知の方法で書
込クロツク周波数ｎ・fHの信号によつてフイール
ド数変換用回路１１におけるメモリ回路に書込む
と共に、読取クロツク信号周波数fCの信号によつ
て読取つて、フイールド周波数の異なる３つの出
力９３，９５，９７に供給せしめる。
て周波数ｎ・fHでサンプリングされた輝度信号Ｙ
を受信する以外に、入力８９および９１でもそれ
ぞれ色差信号ＵおよびＶを受信し、これらの色差
信号も周波数ｎ・fHでサンプリングされて、復調
器１７，１９の出力５５，５７から得られる。こ
れらの３つの信号を、例えば本来既知の方法で書
込クロツク周波数ｎ・fHの信号によつてフイール
ド数変換用回路１１におけるメモリ回路に書込む
と共に、読取クロツク信号周波数fCの信号によつ
て読取つて、フイールド周波数の異なる３つの出
力９３，９５，９７に供給せしめる。
所要に応じ、フイールド数変換用回路１１の代
りに時間軸補正回路を使用し得ることは明らかで
ある。
りに時間軸補正回路を使用し得ることは明らかで
ある。
第２図は第１図に示す復調回路の一部を詳細に
示すブロツク線図であり、こゝに第１図のものに
対応する部分には同一符号を付して示してある。
示すブロツク線図であり、こゝに第１図のものに
対応する部分には同一符号を付して示してある。
第１デジタル発振器３５の出力３３をモジユロ
−１−加算器１０３の出力１０１に接続する。こ
の出力１０１は遅延回路１０５を介して加算器１
０３の入力１０７にも接続する。遅延回路１０５
のクロツク信号入力１０９には第１デジタル発振
器３５の入力３７に供給されるサンプリング周波
数ｎ・fHのサンプリング信号を供給する。従つ
て、加算器１０３の出力１０１の信号は、サンプ
リング信号周期だけその都度遅延された後にその
加算器の入力１０７に帰還される。加算器１０３
の別の入力１１１には、発振器３５の入力３９に
到来するデジタル信号１／ｎ・fH・fSを表わす組合わ せデジタル信号をメモリ回路１１３を経て供給す
る。メモリ回路の入力１１５にパルス発生する度
毎に、その瞬間に第１デジタル発振器３５の入力
３９に現われる組合わせ信号がメモリ回路１１３
に記憶され、かつその信号はつぎのパルスが発生
するまで加算器１０３の入力１１１に供給され
る。
−１−加算器１０３の出力１０１に接続する。こ
の出力１０１は遅延回路１０５を介して加算器１
０３の入力１０７にも接続する。遅延回路１０５
のクロツク信号入力１０９には第１デジタル発振
器３５の入力３７に供給されるサンプリング周波
数ｎ・fHのサンプリング信号を供給する。従つ
て、加算器１０３の出力１０１の信号は、サンプ
リング信号周期だけその都度遅延された後にその
加算器の入力１０７に帰還される。加算器１０３
の別の入力１１１には、発振器３５の入力３９に
到来するデジタル信号１／ｎ・fH・fSを表わす組合わ せデジタル信号をメモリ回路１１３を経て供給す
る。メモリ回路の入力１１５にパルス発生する度
毎に、その瞬間に第１デジタル発振器３５の入力
３９に現われる組合わせ信号がメモリ回路１１３
に記憶され、かつその信号はつぎのパルスが発生
するまで加算器１０３の入力１１１に供給され
る。
サンプリング信号パルスが遅延回路１０５の入
力１０９に発生する際にはその都度、加算器１０
３の入力１１１に現われるデジタル数と以前の加
算処理によつて得られる加算器１０３の入力１０
７に現われるデジタル数との和が加算器１０３の
出力１０１に発生する。この和が値１以上となる
場合には、斯かる和と値１との差を入力１０７に
帰還させる。この結果、１サンプル当り好ましく
は16ビツト以上のデジタルのこぎり波状信号が出
力１０１に発生する。斯かるのこぎり波状信号は
色副搬送波周波数fSで発生する。その最上位ビツ
トを、好ましくは１サンプル当り10ビツト以上の
組合わせ信号として出力３３に供給する。
力１０９に発生する際にはその都度、加算器１０
３の入力１１１に現われるデジタル数と以前の加
算処理によつて得られる加算器１０３の入力１０
７に現われるデジタル数との和が加算器１０３の
出力１０１に発生する。この和が値１以上となる
場合には、斯かる和と値１との差を入力１０７に
帰還させる。この結果、１サンプル当り好ましく
は16ビツト以上のデジタルのこぎり波状信号が出
力１０１に発生する。斯かるのこぎり波状信号は
色副搬送波周波数fSで発生する。その最上位ビツ
トを、好ましくは１サンプル当り10ビツト以上の
組合わせ信号として出力３３に供給する。
第２デジタル発振器７７はモジユロ−１−加算
器１１７を有しており、この加算器の入力１１９
には入力８４に到来するデジタル数ｎ／fC・fHを表 わす組合わせデジタル信号をメモリ回路１２１を
介して供給する。メモリ回路１２１は、第１デジ
タル発振器３５のメモリ回路１１３の入力１１５
に供給される信号と同じ信号が供給される書込信
号入力１２３と、第２デジタル発振器７７の入力
７９の信号が供給される読取信号入力１２５とを
有している。加算器１１７の出力１２７は遅延回
路１２９を介してこの加算器１１７の別の入力１
３１に接続する。遅延回路１２９のクロツク信号
入力１３５には第２デジタル発振器７７の入力７
９に発生する周波数fCの信号を供給する。さら
に、第２デジタル発振器７７の作動は第１デジタ
ル発振器３５の作動に対応する。加算器１１７の
出力１２７に出力させる組合わせ信号は１サンプ
ル当り12ビツト以上で作るのが好適であり、これ
らのビツト数の内の例えば最上位の４〜８ビツト
のようなビツト数の組合わせ信号を出力７５に供
給する。この組合わせ信号は周波数fCでサンプリ
ングされる周波数ｎ・fHののこぎり波状信号を表
わす。
器１１７を有しており、この加算器の入力１１９
には入力８４に到来するデジタル数ｎ／fC・fHを表 わす組合わせデジタル信号をメモリ回路１２１を
介して供給する。メモリ回路１２１は、第１デジ
タル発振器３５のメモリ回路１１３の入力１１５
に供給される信号と同じ信号が供給される書込信
号入力１２３と、第２デジタル発振器７７の入力
７９の信号が供給される読取信号入力１２５とを
有している。加算器１１７の出力１２７は遅延回
路１２９を介してこの加算器１１７の別の入力１
３１に接続する。遅延回路１２９のクロツク信号
入力１３５には第２デジタル発振器７７の入力７
９に発生する周波数fCの信号を供給する。さら
に、第２デジタル発振器７７の作動は第１デジタ
ル発振器３５の作動に対応する。加算器１１７の
出力１２７に出力させる組合わせ信号は１サンプ
ル当り12ビツト以上で作るのが好適であり、これ
らのビツト数の内の例えば最上位の４〜８ビツト
のようなビツト数の組合わせ信号を出力７５に供
給する。この組合わせ信号は周波数fCでサンプリ
ングされる周波数ｎ・fHののこぎり波状信号を表
わす。
斯かる組合わせ信号を変換器６７の入力７３に
供給し、この変換器６７により周波数ｎ・fHのパ
ルス信号に変換する。この目的のため、入力７３
に到来する組合わせ信号を先づデジタル−アナロ
グ変換器１３３によつてアナログのこぎり波状信
号に変換し、この信号を位相検波器１３７の入力
１３５に供給する。位相検波器１３７の他方の入
力１３９は可制御発振器１４３の出力に接続す
る。位相検波器１３７の出力１４５は低域通過フ
イルター１４７を介して加算器１５１の入力１４
９に接続する。加算器１５１の出力１５３は発振
器１４３の制御信号入力１５５に接続する。発振
器１４３は、位相検波器１３７および低域通過フ
イルター１４７と共に位相−結合ループを構成
し、これは位相検波器１３７の入力１３５に現わ
れるのこぎり波状信号の第１高調波に対して極め
て選択性に富んだフイルターを構成する。それに
も拘らず、そのフイルターが信号ｎ・fHの周波数
変動に十分迅速に応答し得るようにするために、
加算器１５１の他方の入力１５７には第２デジタ
ル発振器７７の加算器１１７の入力１１９からデ
ジタル−アナログ変換器１５９を経て取出される
信号を供給する。これがため、フイルターとして
作用する位相結合ループの同調は急速な周波数変
動に直ちに適合される。
供給し、この変換器６７により周波数ｎ・fHのパ
ルス信号に変換する。この目的のため、入力７３
に到来する組合わせ信号を先づデジタル−アナロ
グ変換器１３３によつてアナログのこぎり波状信
号に変換し、この信号を位相検波器１３７の入力
１３５に供給する。位相検波器１３７の他方の入
力１３９は可制御発振器１４３の出力に接続す
る。位相検波器１３７の出力１４５は低域通過フ
イルター１４７を介して加算器１５１の入力１４
９に接続する。加算器１５１の出力１５３は発振
器１４３の制御信号入力１５５に接続する。発振
器１４３は、位相検波器１３７および低域通過フ
イルター１４７と共に位相−結合ループを構成
し、これは位相検波器１３７の入力１３５に現わ
れるのこぎり波状信号の第１高調波に対して極め
て選択性に富んだフイルターを構成する。それに
も拘らず、そのフイルターが信号ｎ・fHの周波数
変動に十分迅速に応答し得るようにするために、
加算器１５１の他方の入力１５７には第２デジタ
ル発振器７７の加算器１１７の入力１１９からデ
ジタル−アナログ変換器１５９を経て取出される
信号を供給する。これがため、フイルターとして
作用する位相結合ループの同調は急速な周波数変
動に直ちに適合される。
発振器１４３の出力１４１の信号はパルス整形
器１６１を経て変換器６７の出力６５に供給し、
こゝから分周器６３の入力１６３に供給する。
器１６１を経て変換器６７の出力６５に供給し、
こゝから分周器６３の入力１６３に供給する。
分周器６３は入力１６３に接続される計数回路
１６５と、この計数回路に結合されるデコーダ回
路１６７とを具えている。計数回路１６５は除算
係数ｎを決定する。ｎの値が整数でない場合に
は、計数回路を他の適当な分周回路と置換えるこ
とができる。デコーダ回路１６７は周波数fHで出
力１６９および１７１に現われる出力信号の発生
瞬時およびその出力信号の形状を決定する。出力
１６９は周波数fHのパルス信号をそれぞれメモリ
回路１１３および１２１の各入力１１５および１
２３に供給する。分周器６３の出力１７１は周波
数fHの信号を位相検波器５９の入力６１に供給す
る。分周器６３の出力１６９には、除算回路４３
にて除算が行われた後に、その都度パルス信号が
発生する。
１６５と、この計数回路に結合されるデコーダ回
路１６７とを具えている。計数回路１６５は除算
係数ｎを決定する。ｎの値が整数でない場合に
は、計数回路を他の適当な分周回路と置換えるこ
とができる。デコーダ回路１６７は周波数fHで出
力１６９および１７１に現われる出力信号の発生
瞬時およびその出力信号の形状を決定する。出力
１６９は周波数fHのパルス信号をそれぞれメモリ
回路１１３および１２１の各入力１１５および１
２３に供給する。分周器６３の出力１７１は周波
数fHの信号を位相検波器５９の入力６１に供給す
る。分周器６３の出力１６９には、除算回路４３
にて除算が行われた後に、その都度パルス信号が
発生する。
位相検波器５９の入力６１および６９は乗算器
１７３に接続する。入力６１における信号は半周
期の間は正の信号であり、他の半周期の間は負の
信号である。乗算器１７３は、デジタル数を表わ
すと共に所望な位相比からのずれを表わす組合わ
せ信号を周期的に供給する。この組合わせ信号を
デジタル低域通過フイルター１７５を介して加算
回路１７９の入力１７７に供給する。この加算回
路１７９は別の入力１８３にてメモリ回路１８１
から公称水平偏向周波数に相当する数値信号を受
信する。加算回路１７９の出力１８５は位相検波
器５９の出力５８に接続し、この出力からはデジ
タル数を表わす組合わせ信号を出力させる。この
組合わせ信号は、ループ増幅度を適当に選定した
場合にｎ／fC・fHに等しくなり、これを除算回路４ ３の入力５６および第２デジタル発振器７７の入
力８４に供給する。
１７３に接続する。入力６１における信号は半周
期の間は正の信号であり、他の半周期の間は負の
信号である。乗算器１７３は、デジタル数を表わ
すと共に所望な位相比からのずれを表わす組合わ
せ信号を周期的に供給する。この組合わせ信号を
デジタル低域通過フイルター１７５を介して加算
回路１７９の入力１７７に供給する。この加算回
路１７９は別の入力１８３にてメモリ回路１８１
から公称水平偏向周波数に相当する数値信号を受
信する。加算回路１７９の出力１８５は位相検波
器５９の出力５８に接続し、この出力からはデジ
タル数を表わす組合わせ信号を出力させる。この
組合わせ信号は、ループ増幅度を適当に選定した
場合にｎ／fC・fHに等しくなり、これを除算回路４ ３の入力５６および第２デジタル発振器７７の入
力８４に供給する。
除算回路４３の入力４５にて得られるデジタル
数１／fC・fCは、色同期信号に第１デジタル発振器 ３５の出力信号を乗じた後に、入力５６に得られ
るデジタル数と同様な方法で得られる。
数１／fC・fCは、色同期信号に第１デジタル発振器 ３５の出力信号を乗じた後に、入力５６に得られ
るデジタル数と同様な方法で得られる。
デジタル−アナログ変換器１３３を逓倍変換器
として構成する場合には、発振器１４３の出力１
４１から到来する信号を斯かる逓倍変換器に供給
することができ、この場合には位相検波器１３７
を省くことができる。
として構成する場合には、発振器１４３の出力１
４１から到来する信号を斯かる逓倍変換器に供給
することができ、この場合には位相検波器１３７
を省くことができる。
フイルターとして作用する変換器６７の位相−
結合ループは、所要に応じデコーダ回路および帯
域通過フイルターと置き換え、斯かるデコーダ回
路をデジタル−アナログ変換器１３３の前に配置
して、サンプリングしたのこぎり波状信号をサン
プリングした正弦波に変換せしめるようにすると
共に、線形位相特性を有する前記帯域通過フイル
ターをデジタル−アナログ変換器１３３の後方に
配置することができる。
結合ループは、所要に応じデコーダ回路および帯
域通過フイルターと置き換え、斯かるデコーダ回
路をデジタル−アナログ変換器１３３の前に配置
して、サンプリングしたのこぎり波状信号をサン
プリングした正弦波に変換せしめるようにすると
共に、線形位相特性を有する前記帯域通過フイル
ターをデジタル−アナログ変換器１３３の後方に
配置することができる。
本例では、デジタル発振器にモジユロ−１−加
算器を設ける。所要に応じ、回路の残りの部分を
その加算器に適合させる場合には他のモジユロ値
を選定し得ることは明らかである。
算器を設ける。所要に応じ、回路の残りの部分を
その加算器に適合させる場合には他のモジユロ値
を選定し得ることは明らかである。
フイルターを切換えなくても、分周器６３の除
算係数ｎを切換え得るようにすることによつて復
調回路を、PAL並びにNTSC信号を処理するの
に適するようにすることができる。除算係数の切
換えは所要に応じ、方式識別回路を用いて自動的
に行なうことができる。
算係数ｎを切換え得るようにすることによつて復
調回路を、PAL並びにNTSC信号を処理するの
に適するようにすることができる。除算係数の切
換えは所要に応じ、方式識別回路を用いて自動的
に行なうことができる。
本例の周波数ｎ・fHは第２デジタル発振器７７
の出力信号からのこぎり波状信号の第１高周波を
フイルタリングすることによつて得る。のこぎり
波状信号の多数の高調波以外に、斯かる出力信号
は周波数fCからのこぎり波状信号周波数の多数倍
ずれている側波帯周波数を各々有している周波数
fCの信号に係わる多数の高調波も含んでいる。所
要に応じ、周波数ｎ・fHはこれらの側波帯周波数
の１つから得ることができる。例えば、fCの第１
上側波帯周波数を選定する場合には、fC＋fZ＝
ｎ・fH、従つてfZ＝ｎ・fH−fCとなるようにのこ
ぎり波状周波数fZを作る必要がある。この場合、
累算回路１１７，１２９の入力端子１１９におけ
るデジタル数は、 ｎ・fH−fC／fC＝ｎ・fH／fC−１ となるように作る必要がある。
の出力信号からのこぎり波状信号の第１高周波を
フイルタリングすることによつて得る。のこぎり
波状信号の多数の高調波以外に、斯かる出力信号
は周波数fCからのこぎり波状信号周波数の多数倍
ずれている側波帯周波数を各々有している周波数
fCの信号に係わる多数の高調波も含んでいる。所
要に応じ、周波数ｎ・fHはこれらの側波帯周波数
の１つから得ることができる。例えば、fCの第１
上側波帯周波数を選定する場合には、fC＋fZ＝
ｎ・fH、従つてfZ＝ｎ・fH−fCとなるようにのこ
ぎり波状周波数fZを作る必要がある。この場合、
累算回路１１７，１２９の入力端子１１９におけ
るデジタル数は、 ｎ・fH−fC／fC＝ｎ・fH／fC−１ となるように作る必要がある。
所要に応じ、サンプリング周波数を低減させる
回路を色同期処理回路およびフイールド数変換用
回路に至る信号通路に設けることができる。
回路を色同期処理回路およびフイールド数変換用
回路に至る信号通路に設けることができる。
なお、“入力”または“出力”とは、１ビツト
以上の組合わせ信号を伝送すべき場合の多数の組
合わせ入力または出力も意味するものとする。
以上の組合わせ信号を伝送すべき場合の多数の組
合わせ入力または出力も意味するものとする。
第１図は本発明による復調回路の一例を示すブ
ロツク線図；第２図は第１図の復調回路の一部を
詳細に示すブロツク線図である。 ３……アナログ−デジタル変換器、１１……フ
イールド数変換用回路、１７，１９……デジタル
同期復調器、２９……デコーダ、３５……第１デ
ジタル発振器、４３……除算回路、４９……色同
期信号処理回路、５９……位相検波器、６３……
分周器、６７……変換器、７１……同期信号分離
回路、７７……第２デジタル発振器、１０３……
モジユロ−１−加算器、１０５……遅延回路、１
１３……メモリ回路、１１７……モジユロ−１−
加算器、１２１……メモリ回路、１２９……遅延
回路、１３３……デジタル−アナログ変換器、１
３７……位相検波器、１４３……可制御発振器、
１４７……低域通過フイルター、１５１……加算
器、１５９……デジタル−アナログ変換器、１６
１……パルス整形器、１６５……計数回路、１６
７……デコーダ回路、１７３……乗算器、１７５
……デジタル低域通過フイルター、１７９……加
算回路、１８１……メモリ回路。
ロツク線図；第２図は第１図の復調回路の一部を
詳細に示すブロツク線図である。 ３……アナログ−デジタル変換器、１１……フ
イールド数変換用回路、１７，１９……デジタル
同期復調器、２９……デコーダ、３５……第１デ
ジタル発振器、４３……除算回路、４９……色同
期信号処理回路、５９……位相検波器、６３……
分周器、６７……変換器、７１……同期信号分離
回路、７７……第２デジタル発振器、１０３……
モジユロ−１−加算器、１０５……遅延回路、１
１３……メモリ回路、１１７……モジユロ−１−
加算器、１２１……メモリ回路、１２９……遅延
回路、１３３……デジタル−アナログ変換器、１
３７……位相検波器、１４３……可制御発振器、
１４７……低域通過フイルター、１５１……加算
器、１５９……デジタル−アナログ変換器、１６
１……パルス整形器、１６５……計数回路、１６
７……デコーダ回路、１７３……乗算器、１７５
……デジタル低域通過フイルター、１７９……加
算回路、１８１……メモリ回路。
Claims (1)
- 【特許請求の範囲】 １ サンプリング信号によつてサンプリング周波
数でサンプリングしたカラーテレビジヨン信号の
内のデジタル化した搬送色信号用の復調回路にあ
つて、搬送色信号復調用のサンプリング周波数に
て発生する搬送色信号の副搬送波周波数に係わる
デジタル基準信号をサンプリング信号から得るた
めの第１デジタル発振器を具え、搬送色信号を復
調するために、前記第１デジタル発振器の位相制
御信号入力を色同期信号位相検波回路の出力に結
合させるようにした復調回路において、サンプリ
ング信号を定周波信号源８１から第２デジタル発
振器７７を介して得るようにし、該第２デジタル
発振器のデジタル数に対する入力８４を位相検波
回路５９の出力５８に結合させて、サンプリング
信号（出力６５における）と水平偏向周波数の信
号（入力６９における）との間の周波数と位相の
比を一定に保つようにし、前記デジタル数に対す
る入力８４を除算回路４３の入力５６にも結合さ
せて、色同期信号位相検波回路１７，１９，４９
の出力４７から得られるデジタル数を前記第２デ
ジタル発振器へのデジタル数で除算せしめるよう
にし、前記除算回路の出力４１を第１デジタル発
振器３５のデジタル数に対する入力３９に結合さ
せるようにしたことを特徴とする復調回路。 ２ 特許請求の範囲第１記載の復調回路におい
て、第２デジタル発振器７７の出力７５と、少な
くとも搬送色信号をデジタル化するためのアナロ
グ−デジタル変換器３のサンプリング信号入力５
との間にデジタル−アナログ変換器１３３および
位相結合ループ１３７，１４７，１５１，１４３
を配置し、該ループに第２デジタル発振器７７の
組合わせ入力信号（入力１１９における）をデジ
タル−アナログ変換器１５９を経て供給するよう
にしたことを特徴とする復調回路。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| NL8204936A NL8204936A (nl) | 1982-12-22 | 1982-12-22 | Demodulatieschakeling voor een gedigitaliseerd chrominantiesignaal. |
| NL8204936 | 1982-12-22 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59122095A JPS59122095A (ja) | 1984-07-14 |
| JPH0354919B2 true JPH0354919B2 (ja) | 1991-08-21 |
Family
ID=19840784
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58239609A Granted JPS59122095A (ja) | 1982-12-22 | 1983-12-19 | 復調回路 |
Country Status (8)
| Country | Link |
|---|---|
| US (1) | US4625232A (ja) |
| EP (1) | EP0111981B1 (ja) |
| JP (1) | JPS59122095A (ja) |
| AU (1) | AU560814B2 (ja) |
| CA (1) | CA1223061A (ja) |
| DE (1) | DE3365024D1 (ja) |
| FI (1) | FI73854C (ja) |
| NL (1) | NL8204936A (ja) |
Families Citing this family (19)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3345143A1 (de) * | 1983-12-14 | 1985-06-27 | Telefunken Fernseh Und Rundfunk Gmbh, 3000 Hannover | Geraet und verfahren zur aufzeichnung und/oder uebertragung von farbfernsehsignalen |
| JPS61177096A (ja) * | 1985-01-31 | 1986-08-08 | Sony Corp | デジタルコンポ−ネント色信号の位相制御回路 |
| DE3511440A1 (de) * | 1985-03-29 | 1986-10-09 | Philips Patentverwaltung Gmbh, 2000 Hamburg | Fernsehempfaenger mit einer schaltungsanordnung zur demodulation eines ntsc-codierten farbsignals |
| JPH0666954B2 (ja) * | 1985-08-07 | 1994-08-24 | 日本電気株式会社 | 色信号復調装置 |
| US4694326A (en) * | 1986-03-28 | 1987-09-15 | Rca Corporation | Digital phase locked loop stabilization circuitry including a secondary digital phase locked loop which may be locked at an indeterminate frequency |
| JPS62230286A (ja) * | 1986-03-31 | 1987-10-08 | Matsushita Electric Ind Co Ltd | デイジタルテレビジヨン受像機 |
| US4686560A (en) * | 1986-05-30 | 1987-08-11 | Rca Corporation | Phase locked loop system including analog and digital components |
| US4700217A (en) * | 1986-08-05 | 1987-10-13 | Rca Corporation | Chrominance signal phase locked loop system for use in a digital television receiver having a line-locked clock signal |
| MY102145A (en) * | 1986-08-26 | 1992-04-30 | Nippon Denki Home Electronics | Digital color demodulator. |
| US4736237A (en) * | 1987-03-31 | 1988-04-05 | Rca Corporation | Chroma demodulation apparatus for use with skew corrected clock signal |
| NL8800320A (nl) * | 1988-02-10 | 1989-09-01 | Philips Nv | Kleurentelevisiesignaaldecodeerschakeling. |
| JP2539024B2 (ja) * | 1988-06-30 | 1996-10-02 | 富士通株式会社 | 複合映像信号生成方法 |
| JPH0591522A (ja) * | 1991-09-30 | 1993-04-09 | Toshiba Corp | デイジタル発振器及びこれを用いた色副搬送波再生回路 |
| US5289828A (en) * | 1992-07-13 | 1994-03-01 | Toth Julie O | Abduction pillow for orthopedic support |
| US5359368A (en) * | 1993-04-12 | 1994-10-25 | Zenith Electronics Corporation | Demodulating a line locked digital color television signal |
| GB9311953D0 (en) * | 1993-06-10 | 1993-07-28 | Snell & Wilcox Ltd | Demodulation |
| JP3320576B2 (ja) * | 1994-12-22 | 2002-09-03 | 株式会社東芝 | 発振回路 |
| US5537702A (en) * | 1995-06-20 | 1996-07-23 | Mount Sinai School Of Medicine Of The City University Of New York | Tomographic pillow with upper arm support |
| JP4679872B2 (ja) * | 2004-10-13 | 2011-05-11 | パナソニック株式会社 | クロック発生装置 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB2059711B (en) * | 1979-09-12 | 1983-07-20 | British Broadcasting Corp | Digital demodulation or modulation of television chrominance signals |
| GB2084424B (en) * | 1980-09-10 | 1984-07-25 | British Broadcasting Corp | Generating clock pulses for sampling pal colour television signals |
| US4502074A (en) * | 1981-11-09 | 1985-02-26 | Rca Corporation | Digital television signal processing system |
| NL8200901A (nl) * | 1982-03-05 | 1983-10-03 | Philips Nv | Digitale kleurentelevisiesignaalverwerkingsschakeling. |
-
1982
- 1982-12-22 NL NL8204936A patent/NL8204936A/nl not_active Application Discontinuation
-
1983
- 1983-12-12 US US06/560,768 patent/US4625232A/en not_active Expired - Lifetime
- 1983-12-15 EP EP83201798A patent/EP0111981B1/en not_active Expired
- 1983-12-15 DE DE8383201798T patent/DE3365024D1/de not_active Expired
- 1983-12-15 CA CA000443370A patent/CA1223061A/en not_active Expired
- 1983-12-19 FI FI834674A patent/FI73854C/fi not_active IP Right Cessation
- 1983-12-19 JP JP58239609A patent/JPS59122095A/ja active Granted
- 1983-12-20 AU AU22573/83A patent/AU560814B2/en not_active Ceased
Also Published As
| Publication number | Publication date |
|---|---|
| CA1223061A (en) | 1987-06-16 |
| EP0111981A1 (en) | 1984-06-27 |
| US4625232A (en) | 1986-11-25 |
| NL8204936A (nl) | 1984-07-16 |
| FI834674A (fi) | 1984-06-23 |
| FI73854B (fi) | 1987-07-31 |
| FI73854C (fi) | 1987-11-09 |
| DE3365024D1 (en) | 1986-09-04 |
| JPS59122095A (ja) | 1984-07-14 |
| AU560814B2 (en) | 1987-04-16 |
| EP0111981B1 (en) | 1986-07-30 |
| AU2257383A (en) | 1984-06-28 |
| FI834674A0 (fi) | 1983-12-19 |
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