JPH032271B2 - - Google Patents
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- JPH032271B2 JPH032271B2 JP58034727A JP3472783A JPH032271B2 JP H032271 B2 JPH032271 B2 JP H032271B2 JP 58034727 A JP58034727 A JP 58034727A JP 3472783 A JP3472783 A JP 3472783A JP H032271 B2 JPH032271 B2 JP H032271B2
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Description
【発明の詳細な説明】
発明の背景
本発明は、通信方式に関し、特に監視局範囲に
入る１個または複数個の独立タグ回路群を検出識
別する方式に関すると共に、これに用いられるタ
グ回路に関する。 生物又は無生物に関わりなく特定物体の行き来
及び居所を追跡できる通信方式の用途は数多くあ
る。これまで固定設備を通る割合に知られた道を
走行する車を追跡する方式が開発されている。例
えば米国特許第3859624号には、応答タグを取付
けた車が質問装置に接近する際に電力を受信する
応答タグを用いる質問応答（1R）装置が記載さ
れている。誘導結合で電力を受信し、特定の応答
タグに特有な独自の符号化情報フイールドを発生
する様に応答タグに命令する。質問装置は符号化
情報フイールドを受信してタグを表わす情報信号
に変換する。タグが自勢している場合質問装置は
AC電力フイールドを発生せず、タグと質問装置
との間の誘導結合は符号化情報フイールドに限定
される。上記発明の開示によると、応答タグは、
自勢又は質問局から送られてくる電力を受けると
連続作動する。この方式はデジタル技術を利用し
ており、32ビツトから成る応答メツセージ形式を
採つている。32ビツトのうち、最初の７ビツトは
同期化パターンを表わし、次にパリテイビツト及
び６けたの識別番号を形成する２進化10進形式の
６組の４ビツトがくる。応答タグは最も本質的な
ものに保持され、質問装置だけがタグからの受信
信号の妥当性を検査する手段を備えている。 応答タグはまた当局側の職員を識別すると共
に、制御領域からの出入りを監視する資格審査方
式の一部として用いられて来た。上記を目的とす
る方式は、米国エネルギー省（テネシー州37830、
ホクリツジ私書箱62）発行の、サーロー、ダブリ
ユ、エイチ、カフイー（ThurlowW.H.Coffey）、
デビツト、イー、バーンズ（David.E.Barnes）
共著の「プルトニウム保護方式の自勢型資格審査
方式（The Selp.Energiged Credential Syptem
for the Plutonium Protection System）」（書類
番号：SAND78−2156、1978年12月印刷）と称
するプロジエクトレポートに記載されている。こ
の方式では、入口ループが110キロヘルツの連続
トーンを送り、資格審査方式が55キロヘルツトー
ンのバースト型識別コードを送る。55キルヘルツ
トーンバーストは増幅され、デコーダで２進形に
変換され、一定の様式及びパリテイ条件が満たさ
れているか否かを調べるために検査される。２進
コードの妥当性が確認されると、オペレーション
センタに伝送することができる。特定のコード形
式は、４つの16進数字を１組としてこれを２対に
分け、各対に夫々３個の同期化ビツト及び１個の
パリテイビツトを加えて、全体で24ビツト長さの
コードワードになる様にしている。各16進数字対
の最初の数字は夫々１及び０として定められてい
るため、最初の16進数字は常に８以上であり、一
方３番目の16進数字は７を越えることはない。こ
の様な符号化形式及び妥当性検査方法を採つてい
るため、確実に利用できるコード数は65，536個
の可能コードのうちの16，192個に限られてしま
う。 上記の方式は何れも、１個以上の応答タグが質
問点を同時に通過するのを処理することができな
い。タグが一列縦隊で制御点を通過するのが当然
又は予測されている場合はこの様な限界を黙認で
きるが、キヤリヤの通常の移動を妨げるものがあ
る場合はこれを最少限にとどめた監視機能が望ま
れる場合が多い。例えば病院では医師、看護婦そ
の他の職員の居所を常時知ることができれば所望
の個人との連絡を容易にする点で非常に有益であ
る。また職員の居所がわかつていると何時誰がど
の患者の看護にあたつていたか又は手術室もしく
は薬局に居たかを把握して記録に残すことができ
る。その用途は広く思い付くもの全てがその対象
となる。 しかし居所の記録及び重要な管理目的にこの種
の方式を使用する場合は仮に１個以上のタグが同
時に監視局範囲に入つても、監視局を通過するこ
れらのタグを確実に検出できることが肝要であ
る。本発明はこの種の方式を提供するものであ
り、また以上の説明から判る様に、本発明実施例
の方式は複数個の入口を通る65，536個のタグを
監視するものであり、何れかの入口を同時に通過
する６個までのタグを確実に処理することができ
る。 発明の概要 本発明の第１様相によると、監視局に入る１個
以上の複数個の独立タグ回路を検出すると共に、
同時に監視範囲に入る１個以上のタグ回路を識別
する通信方式が提供されている。この方式は監視
局に配置されて該局の識別コードである第１コー
ドパターンを有する質問信号を送出する手段、監
視範囲に入つて質問信号を受信する手段と、質問
信号に応答すると共に第１コードパターンと異な
りかつタグ回路の識別コードである所定の第２コ
ードパターンを有する一連の応答信号を送出する
手段及び少くとも擬似ランダム要領で連続する応
答信号を変える手段で構成される手段とを備える
タグ回路、及び監視局に配置されて、監視範囲に
入る信号を受信検査して、これらがタブの識別コ
ードである所定のコードパターンを有しているか
否かを決定し、所定のコードパターンが存在する
場合に限り、受信信号を処理装置に渡す手段から
成つている。 本発明の第２様相によると、監視局範囲に入る
と同時に範囲内に存在する他のタグ回路とは別に
監視局と連絡してこれに識別信号を送るタグ回路
が提供されている。このタグ回路は監視局の監視
範囲に入ると該局から第１コードパターンを有す
る質問信号を受信する手段、及び質問信号に応答
すると共に、タグ回路の識別コードである第１コ
ードパターンと異なる所定の第２コードパターン
を有する一連の応答信号を発する手段と、少くと
も擬似ランダム要領で連続する応答信号の間隔を
変える手段とで構成される手段から成つている。 次に添付図面を参照して、本発明の好適実施例
の詳細を説明する。図中、同一符号は同一又は類
似部品を指す。 実施例の説明 第１図は廊下１２に向つて開く戸口１１を有す
る室１０の見取図である。但しこれは例示を目的
とする任意例である。この場合室１０を病院の手
術室と仮定し、同時誰が室に入つたか又は室から
出たかを連続的に記録する必要があると仮定して
おく。本図は２名の医師１３と１４とがほとんど
同時に室１０に入ろうとしている状態を示してい
るが、一方が室から出ていく間に他方が室に入ろ
うとして反対方向から戸口１１に近づくこともあ
り得る。入口装置１５は戸口１１に隣接配置され
ている。以下に詳細を説明する様に、入口装置１
５は戸口１１と関連する磁気ループ（図示せず）
に接続されている。医師１３と１４とは戸口の磁
気ループと磁気結合して入口装置１５と相互作用
する小型の識別タグを付けている。入口装置１５
と関連入口ループとを監視局と考えることができ
る。 本発明は入口装置と識別タグとを確実に通信す
る方式に関するものであるが、入口装置が集めた
情報を利用する下流装置を含むものではないの
で、余計な複雑さをさけるため、最も簡単な場合
を想定して例示してある。識別タグは入口装置１
５の範囲に入る場合は常に戸口を通過すると思わ
れるので、探知される人物の位置をある時点で知
つていれば、特定の識別タグが室に持ち込まれた
（廊下にあつたことが予めわかつている場合）又
は室から持ち出された（室にあつたことがわかつ
ている場合）ことを示す明確な信号を得ることが
できる。 本方式の基本的構成部品を第２図に示す。 入口装置１５は、タグの所持者と同一符号で示
す複数個の識別タグと通信する質問送受信装置を
含んでいる。入口装置１５によつて導出された情
報は出力線１６を通つて情報利用局にリレーされ
る。これは図示されていないが、中央処理装置へ
のインターフエイス装置又は中央処理装置そのも
のと考えて良い。 入口装置１５は、関連する受信部がタグ応答信
号を聞き取る沈黙期間に離間した周期的な質問信
号を発生する送信部（第３図にブロツク線図を、
また第６図に詳細図を示す）を有している。受信
部のブロツク線図を第４図に、また詳細図を第１
０Ａ図及び第１０Ｂ図に示す。第２図に示す各識
別タグは、第５図にブロツク線図、また第８Ａ，
８Ｂ，９Ａ、及び９Ｂ図に詳細図を示す回路を有
している。 第３図に示す様に、入口装置の送信部は、２相
マーク変調器即ちマンチエスタ変調器１９のゲー
ト１８を通つて、低域フイルタ・パワーアンプ２
０に送られるキヤリヤ信号を、例えば25.6キルヘ
ルツの周波数で発生する水晶制御クロツク17を有
している。フイルタ・アンプ２０から出される出
力は、スイツチ２１の通電即ち閉路時に、該スイ
ツチを通つて入口ループ２２に送られる。該ルー
プについては、例えば第１図に示す戸口１１の枠
の周りに巻付けて、戸口１１の周辺に磁界を形成
するエネルギを放射し、ループ２２が形成する磁
界に入る識別タグの受信コイルと相互作用する様
に配置することができる。 またクロツク１７が発するクロツク信号出力
は、デイバイダ・２相発生器２３にも送られ、32
で割られると共に分相されて、２つのパルス列を
形成する。発生器２３から出される出力信号を実
際の分周信号を単に移相したものと見なすのは、
余りに短絡的すぎる。第６図に示す詳細な回路図
から判る様に、25.6キルヘルツのクロツク出力を
２進カウントで二分し、スケールダウンすること
により25.6キルヘルツ信号の２つの全サイクルに
等しいパルス幅、即ち78.125マイクロ秒のパルス
幅を有するパルスを形成する。これらのパルスは
800ppsのパルス繰返数で繰返し、位相１出力パ
ルスから0.625ミリ秒遅れて位相２出力パルスが
発生する。任意に位相１とした２相発生器２３か
ら出される信号出力は、タイマ２４及び変調器１
９のゲート２５に送られ、一方位相２出力はタイ
マ２４からも出力の供給を受ける識別コード発生
器２６に送られる。コード発生器２６は発生器２
３から送られる信号で刻時されると共に、タイマ
出力で順序付けされ、出力線２７を通つてゲート
２５に送られてこれを制御する信号を発生する。
ゲート２５の出力は、切換デイバイダ２８に送ら
れる。デイバイダ２８はタイマ２４から出力線２
９を通つて送られて来る信号で作動し、ゲート２
５から送られる信号を二分してゲート１８に送
る。ゲート１８と２５及びデイバイダ２８は集合
的に２相マーク変調器を構成し、クロツク１７か
らフイルタ・アンプ２０にパルス変調されたキヤ
リヤ信号を送る。これと同時にタイマ２４から出
される動作信号は、出力線２９を通つてスイツチ
２１に印加され、これをオンにして変調信号を入
口ループに送る。 送信部が質問信号を送出する間は、時分割共用
される入口ループ２２と受信部との接続を切つて
おくことが望ましいがこれはタイマ出力線２９か
らインバータ３０を介してスイツチ３１に信号を
送りこれをオフにすることによつて達成される。
図示の様にスイツチ３１への入力は入口ループ２
２との接合点３２から得られ、第４図に示す受信
プリアンプAGC・フイルタ回路８１に送られる。 入口装置の受信部を説明する前に、送信部の詳
細及びタグ回路の構成と作動を説明しておく。識
別タグと入口装置との通信は25.6キルヘルツの周
波数で質問応答形式で行われる。第３図に関する
上記の様に、情報は自己刻時２相マーク変調器に
よつて25.6キルヘルツのキヤリヤ周波数に変調さ
れる。質問情報は、メツセージ長さを６ビツトと
する毎秒800ビツトの速度で発生する。最初の３
ビツトは110の固定パターンをフオローし、残り
の３ビツトを用いてタグに施設の識別子を与える
訳であるが、これらの３ビツトは８つの異なるコ
ードパターンを形成する。２相マーク形式を用い
ると、第７図に示す様な質問パターンになる。以
下に説明する様に、質問シーケンスは7.5ミリ秒
続く。識別タグは入口装置範囲内に入ると、入口
装置から質問シーケンスに含まれている情報を受
信する。タグ回路は、応答すべきと思われる以前
にプログラム編成された周波数とビツト速度の適
切性、110のプリアングルシーケンス及び３ビツ
ト施設識別子をチエツクする。応答情報は28ビツ
トのメツセージ長さで、毎秒1600ビツト速度で、
識別タグから入口装置に戻る。28ビツトのうちで
最初の４ビツトは1110の固定パターンをフオロー
し、次の16ビツトはタグの識別にあたり、次の６
ビツトは誤り検査コードを含み、また最後の２ビ
ツトは当座の予備として00を含んでいる。入口装
置は識別タグから送られて来る情報を受信し、周
波数とビツト速度の適切性、及び1110のプリアン
ブルシーケンスを検査してから、識別子、誤り検
査コード及び次の00パターンを予備的に受入れ
る。 タグ応答形式を第７図の１行目に示す。この形
式は、2.5ミリ秒間にプリアンブルを伝送し、次
の10ミリ秒間にタグ識別コードを伝送し、その後
1.25ミリ秒の休止を入れてから５ミリ秒で誤り訂
正コードを伝送することを意味している。これら
の時間に0.625ミリ秒の予備伝送形式休止を入れ
ると、全タイムスロツト期間は19.375ミリ秒にな
る。またタグ伝送全サイクルには32のタイムスロ
ツトがあるため、全部で620ミリ秒となり、これ
に11.5625ミリ秒の事後遅延時間と0.9375ミリ秒
の応答休止を加えると、全サイクルは632.5ミリ
秒になる。 第６図に示す様に水晶制御クロツク１７は、端
子３３でパルス出力を形成する従来型の水晶制御
発振器で構成されている。端子の出力信号は、結
線３４を介してNORゲート１８の第１入力端に
直送されると共に、２相発生装置23のＤフリツプ
フロツプ３５のクロツク端子に送られる。フリツ
プフロツプ３５は図示の様に接続されているた
め、クロツク１７から送られる信号を二分し、そ
の出力端Ｑから出される出力信号を２進カウンタ
３６のクロツク入力端に送る。カウンタ３６の出
力端Q0乃至Q3は、図示の様にNORゲート３７及
び３８の入力端に接続されている。NORゲート
３７の出力端はリード線３９を介してゲート２５
の第１入力端に接続されている。リード線４０
は、ゲート３７の出力線をタイマ２４の２進カウ
ンタ４１のクロツク入力端に接続している。カウ
ンタ４１の出力端Q0乃至Q2は、夫々８チヤネル
データセレクタ４２の入力端Ａ，Ｂ及びＣに接続
されている。データセレクタの入力端Ｘは、施設
のプリアンブル及び識別コードの形成に用いられ
る。第６図に示す様に、入力端X1及びX2は高値
即ち論理１状態を示す電圧源に接続されている。
また入力端X3は、論理０状態を示す電圧源に接
続されており、一方入力端X4，X5及びX6は、入
口装置の識別コードを第７図に示す８つのパター
ンの１つに予備選定できる様にするセレクタスイ
ツチ４３，４４及び４５に接続されている。図示
の様にスイツチ４３，４４及び４５が開くと、こ
れらが接続されている各端子が論理０レベルに等
価接続されることは理解されよう。データセレク
タの特定入力端を論理１レベルに接続したい場合
は、当該スイツチを閉じてこれを正の電圧源に接
続する。端子X0及びX7は、ある種の妨害に対す
る防御措置として、コードパターンの前後に保護
間隔又はスペースを入れるためのものである。図
中これらの端子は、低圧即ち論理０レベルに接続
されている。 データセレクタ４２はさらに禁止入力端を備え
ている。NANDゲート４７の出力端はリード線
４６を介して該入力端に接続されており、一方入
力端は相互接続されて、NORゲート３８の出力
端に接続されている。NANDゲート４７はNOR
ゲート３８の出力を反転して、２相発生器２３の
位相２から出力パルスを導出する短期間を除いて
データセレクタ４２の作動を禁止する。この場合
データセレクタの出力端２は、カウンタ４１から
その入力端Ａ，Ｂ及びＣに印加される２進信号で
決定される何れかの入力端に接続され、これらの
２進信号は結線２７を介してゲート２５の第２入
力端に印加される。 NORゲート２５の出力は、切換デイバイダ２
８を構成するＤ型フリツプフロツプのクロツク入
力端に送られる。Ｄ型フリツプフロツプ２８の出
力端は、その入力端ＤとNORゲート１８の入
力端とに接続されている。またＤ型フリツプフロ
ツプ２８のリセツト端子はタイマ２４のNORゲ
ート４８から導出される出力線２９に接続されて
いる。NORゲート４８は、相互接続されて、多
入力ORゲート４９の出力端に接続された入力端
を有するインバータの役目をする。NORゲート
４９の６個の入力端は夫々７段リプルカウンタ５
０の出力端Q1乃至Q6に接続されている。該カウ
ンタのリセツト端子は接地され、一方クロツク入
力端はリード線５１及び５２を介してカウンタ４
１の出力端Q2に接続されている。カウンタ４１
の出力端Q2はそのクロツク端子で２相発生器２
３の出力線３９から８個の入力パルスを受信する
度に状態を変更するので、リプルカウンタ５０に
印加される信号は、ゲート３７から送られて来る
信号を８で割つたものになる。 NORゲート４９には、カウンタ４１の３個の
出力端に接続された３個の入力端を有するNOR
ゲート５３の出力端からさらにもう一つの入力が
印加される。カウンタ４１の該３出力端は夫々イ
ンバータ５４，５５及び５６を介してNORゲー
ト５７の３個の入力端に接続されており、NOR
ゲート５７の出力端はNORゲート４９のさらに
別の入力端に接続されている。 第６図の種々の論理部品に付した４桁数字は
CMOSの型番号であり、これによつて当該の部
品を完全に識別できる様にしている。第６図に関
して説明した入口送信部の作動については当業者
であれば理解し得るものと思われる。切換デイバ
イダ２８の作動はそのリセツト端子がリード線２
９を介して印加される論理１を有する限り禁止さ
れる。これは、NORゲート４９の何れかの入力
端が論理１信号を有する限り何時でも起こる。回
路を分析すると、256キロヘルツクロツク信号で
作動する時に、６ビツトコードの送信ウインドウ
が7.5ミリ秒続き、一方無音期間が632.5ミリ秒続
くことが判かる。無音期間中に第３図に示すスイ
ツチ３１はインバータ３０を介して印加された信
号でオンになり、第４図に示す受信回路を作動さ
せる。識別タグが一定の入口装置の範囲に入るか
否かに関わらず、入口装置は質問信号を周期的に
送り続けてから応答を聴取し、聴取期間中に得ら
れる応答の妥当性を検査して記録する。仮に応答
が得られなくても作動し続ける。 本発明方式と共に使用される識別タグは入口ル
ープに接続する独自のアンテナループを有する小
型の電池作動式ソリツドステート回路装置であ
る。第５図は、識別タグに内蔵された回路のブロ
ツク線図である。該回路はキヤリヤ包絡線検波器
６２に出力を送るプリアンプ・フイルタ回路６１
に接続されて受信する端子を有する送受信タグル
ープ６０を有している。キヤリヤ包絡線検波器の
出力は低域フイルタ６３を通つて遷移検波器６４
に送られる。遷移検波器６４から出される検波出
力はパス６５を介してクロツク・データセパレー
タ６６に送られ、セパレータの出力は質問シーケ
ンス認識回路６７に送られる。回路６７の出力は
接合点６８に送られ、そこからリード線６９を通
つてゲート７０の入力端に印加されると共に、リ
ード線７１を通つてセパレータ６６に戻される。
接合点６８はさらに、インバータ７３を介して回
路６２，６３，６４及び６６の各入力端にリード
線７２で接続されると共に、リード線７４を介し
てフレームカウンタ７５及びタイマ７６の入力端
にも接続されている。 25.6キロヘルツの周波数を有する水晶制御クロ
ツク７７の出力端はリード線７８を介してゲート
７０に接続され、リード線７９及び８０に切換ク
ロツク信号を送る。リード線７９上の切換クロツ
ク信号は、質問シーケンス認識回路６７及びキヤ
リヤ包絡線検波器６２に送られる。リード線８０
上のクロツク信号は回路６２，６３及び６４に送
られる。またクロツク７７は、リード線７８を介
してタイマ７６、クロツク・データセパレータ６
６、マンチエスタ変調器８３および２相発生器８
４に直接出力している。該発生器は、クロツク７
７から送られる信号を16で割る。フレームカウン
タ７５は、リード線８５を介してクロツク・デー
タセパレータ６６に接続された出力端と、リード
線８６を介してゲート８７の入力端に接続された
出力端とを有している。タイマ７６はリード線８
８及び８８Ａを介してゲート８７に第２入力を導
出し、ゲート８７の出力は、擬似ランダム２進シ
ーケンス応答カウンタ８９の入力端に送られる。
応答カウンタ８９は、リード線９０を介してタイ
マ７６から及びリード線９１を介してマンチエス
タ変調器８３からも入力を受信する。応答カウン
タ８９の出力は、マンチエスタ変調器８３及びタ
イマ７６の入力端への接合点９２に送られる。タ
イマ７６は、リード線９３を介してフレームカウ
ンタ７５に、及びリード線９４を介してハミング
発生器９５に出力を送る。ハミング発生器９５は
リード線９６を介して発生器８４の出力端φ1か
ら追加入力を受ける。タイマ６から出力端９７を
通じ、識別シーケンス発生器９８を介してハミン
グ発生器９５に至る別の回路が出来る。シーケン
ス発生器９８の出力端は、リード線９９を介して
シーケンス制御回路１００の第１入力端に接続さ
れている。回路１００は、リード線１０１を介し
てハミング発生器９５から第２入力を受けると共
に、リード線１０２を介してタイマ７６から第３
入力を受ける。 第５図に示す様に、２相発生器８４の出力端
φ1はリード線１０３を介してマンチエスタ変調
器８３に接続され、一方出力端φ2は、リード線
１０４を介して変調器８３の入力端に接続されて
いる。変調器８３には、リード線１０５を介して
シーケンス制御回路１００から別の入力が送ら
れ、またその出力はリード線１０６を介してパワ
ーアンプ駆動器１０７に送られる。駆動器１０７
の出力端は、タグループ６６の両端に接続されて
いる。 上記の通り第５図を参照して識別タグ回路部品
の概略を説明したが、次に第８Ａ，８Ｂ，９Ａ及
び９Ｂ図を参照して第５図の回路が内蔵する機能
素子の実現例の詳細を説明する。先ず第８Ａ図及
び第８Ｂ図に示す水晶制御クロツク７７は、出力
線７８からクロツク出力を送る従来形式のもので
ある。タグループ６０（第５図参照）の受信信号
はプリアンプ・フイルタ回路６１からリード線１
１０を通つて、キヤリヤ包絡線検波器６２のＤ型
フリツプフロツプ１１１と１１２のセツト入力端
に印加される。図示の様のリード線７９及び８０
上の切換クロツク信号は、夫々フリツプフロツプ
１１２及び１１１のクロツク入力端に送られる。
また入力線７９は、他のＤ型フリツプフロツプ１
１３のクロツク入力端に接続されているが、入力
線８０は別のＤ型フリツプフロツプ１１４のクロ
ツク入力端に接続されている。フリツプフロツプ
１１１，１１２，１１３及び１１４のリセツト端
子は全て、リード線７２Ａを介して質問シーケン
ス認識回路６７のインバータ７３の出力端に接続
されている。フリツプフロツプ１１１及び１１２
の入力端Ｄは論理０電圧レベルに接続されている
が、フリツプフロツプ１１１の出力端Ｑはフリツ
プフロツプ１１３の入力端Ｄに接続され、フリツ
プフロツプ１１２の出力端Ｑはフリツプフロツプ
１１４の入力端Ｄに接続されている。フリツプフ
ロツプ１１３及び１１４の出力端Ｑは、NAND
ゲート１１５の入力端に接続され、該ゲートの出
力はキヤリヤ包絡線検波器６２の出力端になつて
いる。 低域フイルタ６２の出力端になつている。 低域フイルタ６３は、4175型４連式Ｄフリツプ
フロツプ１１６及び４個のNANDゲート１１７，
１１８，１１９，１２０で構成されており、これ
らの素子は図示の様に相互接続されている。４連
式フリツプフロツプ１１６のフリツプフロツプ構
成素子のクロツク入力端は全て切換クロツク線８
０に接続されており、一方リセツト端子はインバ
ータ１２１の出力端に接続されている。またイン
バータ１２１の入力端は、リード線７２Ａを介し
てインバータ７３の出力端に接続されている。
NANDゲート１１９の出力は低域フイルタ６３
の出力として、遷移検波器６４のＤ型フリツプフ
ロツプ１２２の入力端Ｄと、排他的ORゲート１
２３の第１入力端に送られる。フリツプフロツプ
１２２のクロツク入力端は切換クロツク線８０
に、一方出力端Ｑはゲート１２３の第２入力端に
接続されている。ゲート１２３の出力は遷移検波
器の出力として、リード線６５を通つてクロツ
ク・データセパレータ６６内のNANDゲート１
２４の第１入力端に送られる。 NANDゲート１２４の第２入力は、質問シー
ケンス認識回路６７の出力端から線７１Ａを通つ
て送られて来る。クロツク・データセパレータ６
６は、NORゲート１２５、Ｄ型フリツプフロツ
プ１２６，１２７，１２８と１２９、4017型10進
カウンタ１３０、NORゲート１３１，１３２，
１３３，１３４，１３５，１３６と１３７、OR
ゲート１３８と１３９、及びインバータ１４０と
１４１で構成されている。これらの種々の部品は
従来の記号法により図示の様に相互接続されてい
る。 クロツク・データセパレータ６６は、質問シー
ケンス認識回路６７に通じる一連の出力線１４
２，１４３，１４４，１４５及び１４６を有して
いる。リード線１４２はカウンタ１３０の出力端
Q5とＤ型フリツプフロツプ１４７の出力端Ｄと
の間に接続されると共に、NANDゲート１４８
の第１入力端に接続されている。リード線１４３
は、クロツク・データセパレータ６６のフリツプ
フロツプ１２８の出力端Ｑと２進カウンタ１４９
のクロツク入力端との間に接続されている。リー
ド線１４４は、NORゲート１３１の出力端と
NORゲート１５０の第１入力端との間に接続さ
れている。NORゲート１５０の第２入力は、ゲ
ート１３６の出力端に接続されたリード線１４５
を通つて送られて来る。リード線１４６は、ゲー
ト１３７の出力端と、図示の様にNORゲート１
５２に交差接続されたNORゲート１５１の入力
端との間に接続されている。インバータ１５３
は、ゲート１５０の出力端とゲート１５２の第１
入力端とを相互接続している。カウンタ１４９の
出力端は、図示の様にNANDゲート１５４の両
入力端及び4051型アナログマルチプレクサ・デマ
ルチプレクサ１５５の入力端A.B.Cに接続されて
いる。マルチプレクサ１５５は８チヤネル型装置
であり、その出力端X0乃至X5は、組端子１５７
又は１５８の相当する端子と選択的に相互接続す
る夫々のストラツプ端子１５６に接続されてい
る。図示の様に装置１５５の出力端X0及びX1に
接続されているストラツプ端子１５６は組端子１
５８側の端子に接続されているが、出力端X2は
組端子１５７側の端子に接続されている。これら
は入口装置の識別シーケンスの一部として使用さ
れるプリアンブル１１０を先決する固定接続であ
る。出力端X3，X4及びX5に接続された残りのス
トラツプ端子は、識別タグを用いる特定施設用の
識別コードに応じて、組端子１５７又は１５８の
何れかに接続されることが理解されよう。装置１
５５の端子X6は、論理１電位に接続されており、
入口装置が発する６ビツトの質問信号を認識して
からNORゲート１５９の第１入力端に阻止信号
を印加する。図示の様にゲート１５９の出力端
は、クロツク・データセパレータ６６のリセツト
部の一部を構成するORゲート１３８の一入力端
に接続されている。第８Ａ図及び第８Ｂ図を参照
して説明した回路の作動については、第９Ａ図及
び第９Ｂ図の詳細を説明するまで保留しておく。 第９Ａ図及び第９Ｂ図に示す様に16進２相発生
器８４は一対のNORゲート１６１及び１６２に
接続された出力端を有する２進カウンタ１６０で
構成されている。ゲート１６１の出力は位相１と
なり、ゲート１６２の出力は位相２となる。図示
の様に出力端φ1（位相１）は、リード線９６によ
つてハミング発生器９５の4174型６連式Ｄフリツ
プフロツプ１６３の夫々のフリツプフロツプ構成
素子のクロツク端子に接続されている。フリツプ
フロツプ１６３のリセツト端子は全て、タイマ７
６の4017型10進カウンタ・デイバイダ１６５の出
力端Q1からリード線９４Ｂを介して入力を受信
するインバータ１６４の出力端に接続されてい
る。ハミング発生器９５はさらに排他的ORゲー
ト１６６，１６７，１６８，１６９と１７０及び
ANDゲート１７１を有しており、これらは図示
の様に接続されている。排他的ORゲート１７０
の制御入力は、識別シーケンス発生器９８の出力
端の接合点９９から送られ、一方ANDゲート１
７１の制御入力はリード線９４Ａ及び９４Ｃを介
して10進カウンタ・デイバイダ１６５の出力端
Q2から送られて来る。 識別シーケンス発生器９８は、4051型８チヤネ
ルアナログマルチプレクサ・デマルチプレクサ１
７２及び１７３で構成されている。ストラツプ又
はジヤンパを接続できる一組の端子対１７４の各
対の一側端子は、素子１７２又は１７３の夫々の
出力端X0乃至X7に接続されており、一方他側端
子は、接合されて論理０電圧レベルに接続されて
いる。任意の端子対１７４が開路すると論理１状
態となり、一方端子対をストラツプで橋絡すると
論理０状態となる。識別シーケンス発生器９８の
素子１７２及び１７３の制御入力はタイマ７６か
ら得られる。即ちタイマ７６は、4516型２進可逆
カウンタ１７５を備えており、該カカンタの出力
端Q0乃至Q3は、ケーブル線９７を介してアナロ
グマルチプレクサ１７２及び１７３のＡ，Ｂ，Ｃ
及び禁止端子に接続（但し、マルチプレクサ１７
２の禁止端子への接続はインバータ１７６を介し
て行われる）されている。周知の通り、４つの２
進ビツトは16の異なる状態を表わす容量を有して
おり、インバータ１７６は２進カウンタ１７５か
ら最初の８カウントが送られて来る間にマルチプ
レクサ１７２に周期動作を与え、一方マルチプレ
クサ１７３は接続の８カウントで周期動作する。
マルチプレクサ１７２と１７３とは集合的に16個
の異なるビツト値を順次に選択して識別コードを
構成する。 識別シーケンス発生器９８のマルチプレクサ１
７２及び１７３の出力端Ｘは、相互接続されて接
合点９９に接続されると共に、抵抗器１７７及び
リード線９４Ｄを介してリード線９４Ａと９４Ｃ
との接合点に接続されている。 タイマ７６の10進カウンタ１６５の出力端Q0
乃至Q3は、一連のORゲート１７８，１７９及び
１８０を介して２進可逆カウンタ１７５の入力端
P0乃至P3に接続されている。カウンタ１７５の
キヤリーイン端子と可逆端子とは論理０電圧レベ
ルに接続されている。このためカウンタ１７５は
ダウンカウンタとして作動する。カウンタ１７５
のプリセツト可能（PE）端子は、Ｄ型フリツプ
フロツプ１８１の出力端に接続されており、一
方その出力端Ｑはカウンタ１６５のクロツク端子
及びNANDゲート１８２の一入力端に接続され
ている。ゲート１８２への第２入力はORゲート
１８４の出力端に接続されたリード線１８３から
導出される。またリード線１８３は、フリツプフ
ロツプ１８１の入力端Ｄ及びNORゲート１８５
の第１入力端にも接続されている。 ゲート１８４の第１入力端は、カウンタ１７５
のキヤリーアウト即ち出力端に接続されてお
り、一方第２入力端はNANDゲート１８６の出
力端に接続されている。またカウンタ１７５のク
ロツク端子は、ゲート１８６の出力端にも接続さ
れている。ゲート１８６には、リード線１０３と
NANDゲート１８７の出力端とから入力され、
またゲート１８７にはリード線７４とカウンタ１
６５の出力端Q4とから入力される。リード線７
４は、フレームカウンタ回路７５の4024型７段リ
プルカウンタ１８８のリセツト端子にも接続され
ており、カウンタ１８８のクロツク端子はカウン
タ１６５の出力端Q4に接続されている。 フレームカウンタ７５のリプルカウンタ１８８
の出力端Q1及びQ6は、インバータ１９０を通し
て出力線８５に接続されている出力端を有する
NANDゲート１８９の２つの入力端に接続され
ている。ゲート１８９の第３入力は、タイマ７６
のカウンタ１６５の出力端Q1から得られる。カ
ウンタ１８８の出力端Q6は、リード線８６を介
してゲート８７のインバータ１９１にも接続され
ている。インバータ１９１の出力端は、カウンタ
１６５の出力端Q3に接続されたリード線８８Ａ
から第２入力を受けるANDゲート１９２の第１
入力端に接続されている。カウンタ１６５の出力
端Q3は、リード線８８Ｂを介してマンチエスタ
変調器８３のＤ型フリツプフロツプ１９３のセツ
ト入力端にも接続されている。タイマ７６を構成
する残りの素子としては、Ｄ型フリツプフロツプ
１９４、NDNDゲート１９５及びANDゲート１
９６があり、これらは全て図示の様に接続されて
いる。 マンチエスタ変調器８３はインバータ１９７、
NANDゲート１９８と１９９、NORゲート２０
０と２０１、及びインバータ２０２を有してお
り、これらは全て図示の様に相互接続されてい
る。 擬似ランダム２進シーケンス応答カウンタ８９
は、マンチエスタ変調器８３の出力端から到来す
るリード線９１に接続されたクロツク入力端とＤ
型フリツプフロツプ２０４，２０５及び２０６の
クロツク入力端に接続された出力端Q5とを有す
る4024型７段リプルカウンタ２０３を備えてい
る。フリツプフロツプ２０４，２０５及び２０６
の出力端Ｑは、夫々NORゲート２０７の入力端
に接続されており、また該ゲートの出力端はフリ
ツプフロツプの各セツト端子に接続されて、フリ
ツプフロツプが２進数０に等しいリセツト状態に
同時にならない様にしている。またフリツプフロ
ツプ２０４及び２０６の出力端Ｑは、フリツプフ
ロツプ２０４の入力端Ｄに接続された出力端を有
する排他的ORゲート２０８の各入力端に接続さ
れている。この様にフリツプフロツプ２０４，２
０５及び２０６は擬似ランダム２進シーケンスカ
ウンタ内で相互接続されている。図示の特定実施
例ではカウント７，６，５，２，４，１，３の順
序で計数し、次にカウント７に戻つてこの順序を
無限に繰返していく。応答カウンタは、フリツプ
フロツプ２０４，２０５及び２０６の出力端Ｑに
夫々接続されたポリセツト端子P0，P1及びP2を
有する4516型２進可逆カウンタ２０９を備えてい
る。カウンタ２０９のカヤリーアウト（）端
子は、接合点９２に接続されており、そこからゲ
ート２０１及び１８５に接続されている。またカ
ウンタ２０９はタイマ７６のフリツプフロツプ１
９４の出力端から到来するリード線９０に接続
されたプリセツト可能（PE）端子を有しており、
またそのクロツク端子はゲート１９２の出力端に
接続されており、一方プリセツト端子P3は論理
０電位値に接続されている。 シーケンス制御回路１００は、NANDゲート
２１０，２１１，２１２と２１３及びNORゲー
ト２１４で構成されており、これらは全て図示の
様に接続されている。 第３図及び第６図を参照して説明した様に、入
口装置は６ビツトデジタル識別コードパターンを
有する質問信号を周期的に発する。識別タグが入
口装置の範囲に入ると、そのタグループはプリア
ンプ・フイルタ６１に送られる信号をピツクアツ
プする。該信号はそこから、パルス列情報を論理
レベル出力に変換して、タグの内部クロツク速度
の２分の１より早い速度で発生する信号遷移を排
除するキヤリヤ包絡線検波器に進む。キヤリヤ包
絡線検波器６２は、質問シーケンスのトーンバー
スト変調包絡線のレプリカを出力する。この変調
包絡線はさらに、４クロツク周期以下に離間され
た遷移信号の伝搬を阻止する低域フイルタ６３内
で処理される。低域フイルタの出力は変調包絡線
のレベルが変わる度にパルスを発生する遷移検波
器６４で処理される。遷移検波器６４の出力は、
クロツク・データセパレータ６６のゲート１２４
に入る。該セパレータは、変調包絡線から発生す
るパルスを３方向のうちの１方向に伝搬できる様
に制御されたタイミングを有する状態カウンタで
ある。最大タイミング公差を越える期間後最初に
受信される信号は、妥当なメツセージ状態をセツ
トする新メツセージの最初のパルスと見なされ
る。事の推移を把握するには該パルスの受信直前
の回路状態を考える必要がある。即ちフリツプフ
ロツプ１２９がリセツト状態にあり、その出力
が１であると、カウンタ１４９はリセツトされて
その出力Ｑは全て論理０となるため、接合点６８
は論理１となり、このためゲート７０は駆動され
てフレームカウンタ７５がリセツトされると共
に、ゲート１２４、キヤリヤ包絡線検波器６２、
低域フイルタ６３及び遷移検波器６４が駆動され
る。フリツプフロツプ１２９の出力Ｄは論理０で
ありまた遷移検波器６４の出力は論理０であるた
め、ゲート１２４の出力は論理１となり、一方ゲ
ート１２５の出力は論理０となる。フリツプフロ
ツプ１２８はセツトされて出力Ｑが０となり、カ
ウンタ１３０はカウント“９”にあつて出力Q9
が１となるため、インバータ１４１はゲート１３
１に作動可能論理０を印加する。 低域フイルタ６３の論理レベルが到来するパル
スの印加によつて最初に変化する際に、遷移検波
器６４は論理１を出力する。このためゲート１２
４の出力は０となり、フリツプフロツプ１２９は
ゲート１３１を介してセツトされ、一方カウンタ
１３０はゲート１２５を介してリセツトされる。
ゲート１２５の出力パルスは高レベルに向うクロ
ツクパルスに応答して０に戻ると、フリツプフロ
ツプ１２８を刻時して出力Ｑが０になり出力が
１になるリセツト状態にする。 カウンタ１３０はリセツトされると、水晶クロ
ツク周波数を因数４で割るフリツプフロツプ１２
６及び１２７を介して受信される内部クロツクパ
ルスを即座に計数し始める。データクロツク遷移
に対して予測されるタイミング公差内で遷移検波
器６４が送出する後続の遷移パルスは、ゲート１
３６を介してクロツク・データセパレータ６６か
ら導出される。一方データ１遷移の予測タイミン
グ公差範囲で受信される遷移パルスはゲート１３
７を介してデータパルスとして回路から導出さ
れ、さらに予測公差外で受信される遷移パルス
は、回路をリセツトして新メツセージを作成する
様に導出される。この様なパルス発生がカウンタ
１３０の動作と一致してその端子Q1，Q2，Q5又
はQ6に出力が印加されると、ゲート１３５及び
１３８を介してフリツプフロツプ１２９にリセツ
トパルスが印加される。しかしパルスがカウント
“９”以上のカウント数と一致する場合はフリツ
プフロツプ１２９の入力端Ｄに論理０が印加され
ているため、カウンタ１３０の端子Q9が論理１
になり、フリツプフロツプ１２９を刻時してリセ
ツト状態にする。何れの場合にせよゲート１３５
及び１３８を介してリセツト信号がフリツプフロ
ツプ１２９に印加されても、カウンタ１３０はカ
ウント９まで計数し続け、ゲート１３１に作動可
能信号を印加することにより、次に到来する遷移
パルスを受信して、フリツプフロツプ１２９のセ
ツトに備える。これと同様にフリツプフロツプ１
２８はゲート１３９を介してセツトされるため、
ゲート１２５を作動させてカウンタ１３０にリセ
ツト信号を送り出せる様にする。カウンタ１３０
の出力端Q9はそのクロツク作動可能（）端子
にフイードバツク接続されているため、カウンタ
１３０がリセツト信号を受信するまで論理１にあ
つてカウンタがそれ以上計数できない様にする。 クロツク・データセパレータ６６から送出され
る分離されたデータ信号及びクロツク信号は、質
問シーケンス認識回路６７で、上記の様に接点１
５６，１５７及び１５８をストラツプ接続するこ
とによつて得られるプリセツトコードパターンと
比較される。到来する信号はこのプリセツトパタ
ーンとビツト毎に比較される。カウンタ１４９は
ビツト毎に歩進してセレクタ１５５を順序付け
る。受信シーケンスがプリセツトシーケンスと相
違すると、マルチプレクサ１５５の出力端Ｘから
ゲート１５９及び１３８を介してリセツト信号が
印加され、フリツプフロツプ１２９及びカウンタ
１４９をリセツトする。こうして初期起動状態に
戻つて上記の手順で次の受信信号に応答する。 110プリアンブル及びプリセツトパターンの最
後の３ビツトを構成する妥当な６ビツト信号を受
信すると、カウンタ１４９は、カウント“６”に
到達し、接合点６８に論理０を印加することによ
り数種の機能を達成できる様にする。論理０はカ
ウンタ１４９のクロツク作動可能入力端にフイー
ドバツクされてカウンタの計数機能を禁止し、ま
たゲート１２４を非作動状態にすると共に、信号
がキヤリヤ包絡線検波器６２、低域フイルタ６３
及び遷移検波器６４を通過できない様にする。即
ちこの信号は接合点６８にあつて、受信モードの
動作終了と送信モードの開始とを前ぶれする。 第９Ａ図及び第９Ｂ図に示す様に、導線７４を
通る論理０信号は、フレームカウンタ７５のカウ
ンタ１８８からリセツト入力を除去することによ
り、カウンタ１８８が起動できる様にする。また
ゲート１８７はゲート１８６に作動可能信号を印
加することにより、ダウンカウンタとして作動す
る様に接続されたカウンタ１７５のクロツク端子
に、結線１０３を通つて２相発生器８４から供給
されるクロツク信号を印加できる様にする。タグ
回路の受信部が受信モードにある間は、カウンタ
１６５が端子Q4に論理１出力を印加した状態に
なることは明白である。受信モードが働いている
間は導線７４に論理１が存在するので、ゲート１
８７は論理０を出力してゲート１８６をオフにす
ることによりダウンカウンタ１７５にクロツクパ
ルスが伝わらない様にする。導線７４に論理０が
出現すると、この状態が逆転する。 ダウンカウンタ１７５がカウントゼロに達する
と、そのキヤリーアウト（）出力端から論理
０信号を出力して、ゲート１８４が論理０を出力
できる様にする。このためフリツプフロツプ１８
１はリセツトされて出力Ｑが論理１に等しくな
り、カウンタ１７５のプリセツト作動可能端子が
働いて、カウンタ１６５からその入力端P0乃至
P3に印加される次の数字を読取れる様にする。
この様にカウンタ１７５がゼロ以外のある数値に
セツトされると、その端子からの論理１を出
力する。このためゲート１８４の出力は論理１に
戻る。リード線７８に次の正クロツクパルスが伝
わると、フリツプフロツプ１８１は復元され、そ
の出力Ｑは１に、また出力は０になる。出力端
Ｑに現われる論理１はカウンタ１６５を刻時して
次のカウントに送る。カウンタ１６５の出力Q0
が高い時カウンタ１７５が３カウント間セツトさ
れ、出力Q2が高い時７カウント間セツトされ、
出力Q3が高い時１カウント間セツトされ、また
Q4が高い時、ゼロカウント間セツトされる様に、
カウンタ１６５からカウンタ１７５の各プリセツ
ト入力端に信号が印加される。 タイマは最初の0.625ミリ秒だけ遅延して送信
を行わない様に作動する。カウンタ１６５の出力
Q0が高値になる次のタイマ間隔は2.5ミリ秒であ
るがこれはプリアンブルパターン1110を送信する
ことができる４ビツトの長さに相当する。また次
のタイマ間隔で16ビツトの送信時間に相当する10
ミリ秒が得られる。カウンタ１７５はこの10ミリ
秒間に順序付けされて識別シーケンス発生器９８
内にプログラム編成された16個の異なるビツトを
選択する。これらのビツトはシーケンス発生器９
８からゲート１７０及び１７１を通つてハミング
発生器９５に送出されると共にリード線９９Ａ及
びゲート２１０と２１３を通つてマンチエスタ変
調器８３に送出される。 タイマが与える次の５ミリ秒間にデータはハミ
ング発生器９５からゲート２１１及び２１３を通
つて変調器８３の制御ゲート１９８にシフトアウ
トされる。 タイマ７６の全状態で構成される全応答は夫々
フレームと呼ばれており、プロセス内のフレーム
の数はフレームカウンタ７５に蓄積される。全部
で32個のフレームを蓄積することができ、33番目
のフレームの間にパルスが発生してタグを送信モ
ードから受信モードに戻す。 マンチエスタ変調器は各フレーム間に変調され
るが、キヤリヤが擬似ランダム２進シーケンス応
答カウンタ８９からリード線９２を通つて送られ
る出力信号によつてゲートされているため、各フ
レーム間に変調キヤリヤ出力を発生することはな
い。カウンタ２０９で構成される応答カウンタ部
は、32番目のフレーム後を除いてタイマ７６の各
サイクルの間に漸減するダウンカウンタであり、
キヤリヤはダウンカウンタ２０９がゼロ状態にあ
る間だけマンチエスタ変調器の出力端に渡され
る。マンチエスタ変調器８３は、リード線１０６
に出力信号を送ると同時に、応答カウンタ８９の
リプルカウンタ２０３にクロツク信号を戻す。カ
ウンタ２０３は、フリツプフロツプ２０４，２０
５及び２０６で構成される擬似２進シーケンス回
路を順序付けする信号を発する前に変調器８３の
出力端から受信した信号を因数64で割る。応答カ
ウンタはフレーム終了時にゼロ状態になり、擬似
ランダム２進シーケンス発生器を構成するフリツ
プフロツプ２０４，２０５及び２０６から発生さ
れる乱数で再ロードされる。 第５図には示されていないが、タグ回路の受信
モード中にパワーアンプ駆動器１０７が、タグル
ープ６０をロードダウンしない様に高インピーダ
ンスを有することは理解されよう。 第１０Ａ図及び第１０Ｂ図は、入口装置１５の
受信部の詳細図である。入口受信部の回路段の構
成及び作動は、特に第８Ａ図を参照して説明した
タグ回路段と同一であるため、第１０Ａ図にはそ
のブロツク線図のみを示しておく。その他の類似
点もいくつかあるので同様の構成及び機能を有す
る部品については第８Ａ図の符号に「−１」を付
けてある。例えば第１０Ａ図のキヤリヤ包絡線検
波器６２−１は第８Ａ図の検波器６２と同一であ
る。従つてスイツチ３１をオンにした受信モード
中に入口受信部が信号を受信すると、キヤリヤ包
絡線検波器６２−１、低域フイルタ６３−１及び
遷移検波器６４−１はこれらの入力信号を検査し
て遷移パルスに変える。検波器６４−１から出さ
れる出力は、導線６５−１を通つてゲート１２４
−１の第１入力端に印加される。ゲート１２４−
１の第２入力端はインバータ３００の出力端に接
続されており、インバータ３００の入力端は接合
点３０１に接続されている。これらの接続の詳細
を以下に示す。 第１０Ｂ図の入口受信部は、第８Ｂ図のクロツ
ク・データセパレータ６６とほぼ同一のクロツ
ク・データセパレータ３０２を有している。主な
相違点は、10進カウンタ・デイバイダ１３０−１
のクロツク入力を供給する回路部品にある。即ち
第１０Ｂ図に示す様に、10進装置１３０−１のク
ロツク入力端はＤ型フリツプフロツプ３０３の出
力端Ｄに接続されており、また該フリツプフロツ
プの端子Ｄととは相互接続されて分周器を構成
している。フリツプフロツプ３０３のクロツク入
力端には第１０Ａ図に示すインバータ３０５の出
力端に接続されたリード線３０４からクロ
ツク信号が供給される。また該インバータの入力
端は水晶制御クロツク７７−１のクロツク出力線
７８−１に接続されている。従つて、第８Ｂ図に
示す回路の10進カウンタ・デイバイダ１３０に供
給されるクロツク周波数は四分されるが、第１０
Ｂ図に示す回路のこれに匹敵するクロツク周波数
は二分されるだけである。識別タブ送信部のボー
速度は入口送信部の２倍であることからしてその
理由は自明である。入口送信部のボー速度が低い
のは、第６図に示す該送信部のクロツク１７と２
進カウンタ３６との間に追加のフリツプフロツプ
３５が配設されているからである。 入口受信部のクロツク・データセパレータ３０
２とタグ受信部のセパレータとの他の相違点は、
前者のゲート１３８−１の一入力端をフレームカ
ウンタの出力端に接続する代りにリード線３０６
を介して処理装置（P.U.）３０７の出力端に接
続している点にある。またリード線３０６は抵抗
器３０８を介して論理０電位レベルに接続されて
いる。従つて処理装置３０７から論理１が出力さ
れない場合は、リード線３０６は論理０値とな
り、処理装置が論理１電圧レベルを出力すると、
これは論理１値に変わる。その他の点については
クロツク・データセパレータ３０２の構成及び機
能はクロツク・データセパレータ６６と同一であ
る。 セパレータ３０２は適切なクロツク及びデータ
パルスを受信すると、これらを識別シーケンス認
識回路３０９に渡す。回路３０９は第８Ｂ図に示
す質問シーケンス認識回路６７と同様の多くの構
成部品を有しているため、これらが同一のもので
ある限りは、同一符号に「−１」を付けてある。
識別シーケンス認識回路３０９が推定識別タグか
ら到来する信号を検査できる様にするため、可能
タグから受信される最初の４ビツト即ちプリアン
ブルをビツト単位で比較する回路が設けられてい
る。これは4017型10進カウンタ・デイバイダ３１
０と4016型４連アナログスイツチとを組合せ前者
の出力端Q0乃至Q3を後者の４区分３１１，３１
２，３１３及び３１４の制御入力端に接続するこ
とによつて得られる。スイツチ部３１１，３１２
及び３１３のIN端子は相互接続されてゲート１
５２−１の出力端に接続されており、一方スイツ
チ部３１４の入力端はゲート１５１−１の出力端
に接続されている。スイツチ部３１１乃至３１４
の出力端は全て相互接続され、抵抗器３１５を介
して論理１電位レベルに接続されている。抵抗器
３１５とスイツチ出力端との間の接合点はゲート
１５９−１の第１入力端に接続されている。カウ
ンタ３１０のリセツト端子は、クロツク・データ
セパレータ３０２のフリツプフロツプ１２９−１
の出力端に接続されている。カウンタ３１０の
クロツク作動可能（）端子は、その出力端Q4
及び24ビツトシフトレジスタ３１８のインバータ
３１７に接続された出力端３１６に接続されてい
る。レジスタ３１８は図示の様に縦列接続された
３個の4015型双対４ビツト静止シフトレジスタで
構成されている。第14ビツトレジスタ３１９のデ
ータ入力端即ちＤは、リード線３２０を介して識
別シーケンス認識回路３０９のゲート１５２−１
の出力端に接続されている。レジスタ３１８を構
成するシフトレジスタ部のクロツク入力端は全て
相互接続されて、クロツク・データセパレータ３
０２のフリツプフロツプ１２８−１の出力端Ｑに
接続されたリード線１４３−１に接続され、リセ
ツト端子は相互接続されてインバータ３１７の出
力端に接続されており、また出力端Ｑは、情報を
並列転送する様に、ケーブル線３２１を介して処
理装置３０７に接続されている。処理装置には、
先にレジスタ３１８にシフトインされた符号化メ
ツセージを受信して後続の処理を行う適宜のバツ
フア及びレジスタが周知要領で設けられている。 入力メツセージをビツト単位で計時するため、
２個の4022型８進カウンタ・デイバイダ回路３２
３及び３２４で構成される24ビツトカウンタ３２
２が設けられている。カウンタ３２３のキヤリー
アウト端子は、カウンタ３２４のクロツク端子に
接続されているため、カウンタ３２３は各８進パ
ルスをカウンタ３２４に送る。またカウンタ３２
４の出力端Q3は接合点３０１に接続されている。
カウンタ３２３と３２４とはこの要領で24個の入
力パルスに対して１個の出力パルスを発生する。
カウンタ３２３と３２４とのリセツト端子はイン
バータ３１７の出力端に接続されているため、24
ビツトカウンタ３２２は24ビツトシフトレジスタ
３１８と同時にリセツトされる。カウンタ３２３
と３２４とのクロツク作動可能端子は、図示の様
に論理０電位レベルに続されているため、これら
のカウンタのリセツト端子にリセツト信号が印加
されない場合は作動可能状態に保持されて計数す
ることができる。 24ビツトカウンタ３２２から信号出力を印加さ
れる接合点３０１は、処理装置３０７の入力端及
び接合点３０１に接続された上記の部品に接続さ
れており、これらは全て第１０Ｂ図に明示されて
いる。 入口装置の受信部の作動を具像化する便宜上、
第１０Ａ図及び第１０Ｂ図と同一符号を付した第
４図のブロツク線図を参照されたい。入口装置受
信部は以下の様に作動する。即ち識別シーケンス
認識回路３０９は最初の４個の妥当な受信パルス
をビツト単位で比較して、これらが方式の一部を
構成する識別タグの固定識別コードを構成する
1110パターンに従つているか否かを調べる。入力
信号がこの特定要件を満たしていると、カウンタ
３１０はカウント“４”に到達し、その出力Q4
が論理１となる。該出力端はその入力端CEにフ
イードバツク接続されているため、カウンタ３１
０の計数作用を禁止する。出力Q4は、さらにイ
ンバータ３１７を介して、シフトレジスタ３１８
のレジスタ部及びカウンタ３２２のカウンタ部か
らリセツト信号を除去する役目もする。このため
追加の妥当な24ビツトを受信すると、これらは順
次にシフトレジスタ３１８にシフトされると共
に、24ビツトカウンタ３２２に送られて計数され
る。カウンタ３２２は24ビツトを受信して論理１
を出力し、処理装置に信号を送つて、レジスタ３
１８から信号を転送するケーブル線３２１から信
号を受信できる様にする。 これと同時に接合点３０１の信号は、ゲート１
２４−１と７０−１、リセツトキヤリヤ包絡線検
波器６２−１、低域フイルタ６３−１及び遷移検
波器６４−１をブロツクする。さらにシフトレジ
スタ３１８から処理装置３０７への全メツセージ
の転送を妨害する信号受信は、処理装置３０７が
ケーブル線３２１を介してメツセージを受信し終
えるまでブロツクされる。この機能を完了する
と、処理装置３０７は論理１出力をリード線３０
６に送り、ゲート１３８−１を介してフリツプフ
ロツプ１２９−１にリセツト信号を印加する。リ
セツト信号はカウンタをリセツトしてその出力
Q4を論理０に戻すことにより、シフトレジスタ
３１８及びカウンタ３２２をリセツトする。この
ため接合点３０１の信号は論理０レベルに戻り、
第１０Ａ図及び第１０Ｂ図に示す入口受信部の部
品を受信モードに復元する。さらにタイマ２４が
設定した受信モード期間中に識別タグから連続メ
ツセージを受信する。入口受信部はこの受信モー
ド期間中に１個以上のタグから識別信号を受信す
るが、これらの信号の受信は各タグの擬似ランダ
ム発生器の出力に応じて、ランダムに選択された
異なる期間中に行われるため、信号の大半は干渉
しあわないことが理解されよう。上記の様にタグ
からの各全送信サイクルには、識別信号を送信で
きる32個の可能なタイムスロツトが設けられてい
るが、所定のタグを送信するには、少くとも４個
で一般に８個以下のタイムスロツトで済む。タグ
は全て入口質問信号と同期化されているため、
夫々の送信期間はほぼ同時に始まる。各タグから
少くとも数回の応答がある場合、異なるタイムス
ロツト中に各タグから信号が送信される可能性は
極めて高い、各識別タグが独自の識別信号パター
ンを有していることからして、入口受信部の処理
装置３０７は各受信信号群を識別し、特定のタグ
と関連付けることができる。処理装置によるその
他の妥当性の検査については所望に応じて達成す
ることができる。 信号をランダムに送信するため、１個以上のタ
グから同時に送信されることがある。使用する信
号には、タグから送られて来るキヤリヤ信号が位
相はずれしていると、入口受信部のキヤリヤ包絡
線検波器、低域フイルタ及び遷移検波器を通らな
いため、通常プリアンブルが完全に抹消されたり
ひずんだりして欠損する性質がある。しかし、複
数個のタグから送られて来るキヤリヤ信号を充分
位相合わせすることにより、遷移検波器ばかりで
なくクロツク・データセパレータを通して識別シ
ーケンス認識回路３０９に信号を送ることができ
る。各タグから送られるプリアンブルが回路３０
９に入りプリアンブル検査に通るとシフトレジス
タ３１８が作動して送信信号の後続部を受ける様
になる。識別コードはタグによつて違うため、無
効制御をしないとレジスタ３１８は誤伝識別タグ
を受入れてしまうが、入口受信部の独自の回路部
品でこの様な不詳事を阻止している。 第１１図はプリアンブルの位相が合つたタグＡ
及びＢから同時に応答を送信する可能な状態を示
している。識別コード（このうち最初の数ビツト
だけを図示する）は相違していると思われる。２
つのタグから送られる信号を合計すると、ほぼ
（Ａ＋Ｂ）で示す線の様になる。コードが異なる
領域ではクロツク信号ぎ欠損していることがわか
る。従つて符号４００付近で信号が発生すると、
クロツク信号が抹消されているのでカウンタ１３
０−１はカウント“９”に達し、その出力Q9が
１となつて回路をリセツトすることにより、別の
妥当なプリアンブルを受信するまで受信できない
様にする。しかし送信間隔はランダムに選択され
ているため各タグからの送信信号は上記要領で受
信される。 要約すると本発明は、特定のデジタルコード形
式を用いて入口装置即ち監視局と識別タグとの間
の通信を成立させようとするものである。変調器
が用いるコード化構成は、マンチエスタとも呼ば
れている２相マークコーデイングとして知られて
いる。この種のコーデイングは、論理１がビツト
セルの中間に第２遷移を有するが論理０は有さな
いという特徴があり、形式内の２つの異なるコー
ドパターンを合計すると、自蔵のクロツク速度遷
移が少くともある程度抹消するという特徴を有す
る電信方式の一種であり、上記の様にこの特徴を
活かして１つ以上の信号源から同時に受信する信
号を拒絶する訳である。 図には１台の入口装置しか示してないが、病院
等の施設では何百という複数台の入口装置を設
け、これらを１台以上の中央処理装置（CPU）
と相互接続することにより、最終的な記録保持及
び管理機能を達成できることを理解されたい。入
口装置がタグを識別できると同時に、中央処理装
置は入口装置を識別することができる。CPUは
周知の多重送信構成を用いて各入口処理装置から
記憶情報を順次に引き出すことができ、こうして
CPUは各識別タグの所在に関する情報を得てい
る。 入口装置の送信部は、入口装置から発せられた
信号を受信する全ての識別タグを総称的に表わす
プリアンブルから成る質問信号を連続的に発す
る。また入口装置の質問信号には該装置を設置し
た特定の病院その他の施設を表わすコード標識が
含まれており、その病院又は施設に対して符号化
されたタグだけが質問に応答する。 質問範囲に入る全てのタグは、質問信号の妥当
性を検査する。信号は認められると、所定のタグ
に対して全て同一の複数の応答を送信期間中にラ
ンダムに選択して間隔で送信する応答送信の開始
を同期化する役目をする。本実施例では夫々約
19.375ミリ秒継続する32個の送信タイムスロツト
を設けているが、入口装置とタグとの間の通信に
利用できる時間及び使用するビツト速度に応じて
タイムスロツトの数を変えられるのは勿論であ
る。またビツト速度を変えるには水晶時計の周波
数を変えれば良い。このため本方式は“ｔ”時間
継続する“ｎ”個のタイムスロツトを配備できる
ものと考えることができる。 ここに記載したタグ回路は擬似ランダムシーケ
ンス発生器を用いている。真ランダム発生源を利
用することもできるが、その必要はない。しか
し、擬似ランダム発生器から応答カウンタに向う
７桁出力の周波数を変えることは有益であるの
で、タグから送信する１回の全サイクル間に必要
とされる平均応答数に応じて選択すれば良い。 各タグは入口送信部との混線を避けると共に、
タグから信号を受信する入口装置に対する総称的
識別子として作用する様に設計された固定された
４ビツトのプリアンブル1110から成る28ビツトメ
ツセージで応答する。タグは入口受信部を同期化
して、タグ識別コード及びリチヤードハミング
（Richard Hamming）が開発した原理に基づく
誤り検査コードを有する次の24ビツトを受信でき
る様に作用する。 上記の通り監視局と複数個のタグ回路との間の
通信を確立する方式に関し、本発明を説明した
が、その原理を広範に応用できることを理解され
たい。即ち、同一時間内に全てのトランスポンダ
回路に質問したい場合に質問局と複数個のトラン
スポンダ回路との間の同時通信を確立する方式は
これらの原理を基にしている。この場合トランス
ポンダ回路はタグ回路に相当し、また質問局は監
視局に相当する。 また特定実施例に関して本発明を説明したが、
添付の特許請求の範囲で限定する本発明の真意か
ら逸脱することなくその構成及び作動を種々に変
更できることは理解されよう。同じ機能を果たす
多くの等価のソリツドステート素子があり、また
本発明では個別の論理素子を用いたが、周知技法
によつて同一回路部品又は等価素子を集積するこ
とができる。実際現用のマイクロコンピユータチ
ツプは、複数の等価の機能を果たす様にプログラ
ム編成することができ、これらの変形は全て本発
明の範ちゆうに入るものと考えられる。
入る１個または複数個の独立タグ回路群を検出識
別する方式に関すると共に、これに用いられるタ
グ回路に関する。 生物又は無生物に関わりなく特定物体の行き来
及び居所を追跡できる通信方式の用途は数多くあ
る。これまで固定設備を通る割合に知られた道を
走行する車を追跡する方式が開発されている。例
えば米国特許第3859624号には、応答タグを取付
けた車が質問装置に接近する際に電力を受信する
応答タグを用いる質問応答（1R）装置が記載さ
れている。誘導結合で電力を受信し、特定の応答
タグに特有な独自の符号化情報フイールドを発生
する様に応答タグに命令する。質問装置は符号化
情報フイールドを受信してタグを表わす情報信号
に変換する。タグが自勢している場合質問装置は
AC電力フイールドを発生せず、タグと質問装置
との間の誘導結合は符号化情報フイールドに限定
される。上記発明の開示によると、応答タグは、
自勢又は質問局から送られてくる電力を受けると
連続作動する。この方式はデジタル技術を利用し
ており、32ビツトから成る応答メツセージ形式を
採つている。32ビツトのうち、最初の７ビツトは
同期化パターンを表わし、次にパリテイビツト及
び６けたの識別番号を形成する２進化10進形式の
６組の４ビツトがくる。応答タグは最も本質的な
ものに保持され、質問装置だけがタグからの受信
信号の妥当性を検査する手段を備えている。 応答タグはまた当局側の職員を識別すると共
に、制御領域からの出入りを監視する資格審査方
式の一部として用いられて来た。上記を目的とす
る方式は、米国エネルギー省（テネシー州37830、
ホクリツジ私書箱62）発行の、サーロー、ダブリ
ユ、エイチ、カフイー（ThurlowW.H.Coffey）、
デビツト、イー、バーンズ（David.E.Barnes）
共著の「プルトニウム保護方式の自勢型資格審査
方式（The Selp.Energiged Credential Syptem
for the Plutonium Protection System）」（書類
番号：SAND78−2156、1978年12月印刷）と称
するプロジエクトレポートに記載されている。こ
の方式では、入口ループが110キロヘルツの連続
トーンを送り、資格審査方式が55キロヘルツトー
ンのバースト型識別コードを送る。55キルヘルツ
トーンバーストは増幅され、デコーダで２進形に
変換され、一定の様式及びパリテイ条件が満たさ
れているか否かを調べるために検査される。２進
コードの妥当性が確認されると、オペレーション
センタに伝送することができる。特定のコード形
式は、４つの16進数字を１組としてこれを２対に
分け、各対に夫々３個の同期化ビツト及び１個の
パリテイビツトを加えて、全体で24ビツト長さの
コードワードになる様にしている。各16進数字対
の最初の数字は夫々１及び０として定められてい
るため、最初の16進数字は常に８以上であり、一
方３番目の16進数字は７を越えることはない。こ
の様な符号化形式及び妥当性検査方法を採つてい
るため、確実に利用できるコード数は65，536個
の可能コードのうちの16，192個に限られてしま
う。 上記の方式は何れも、１個以上の応答タグが質
問点を同時に通過するのを処理することができな
い。タグが一列縦隊で制御点を通過するのが当然
又は予測されている場合はこの様な限界を黙認で
きるが、キヤリヤの通常の移動を妨げるものがあ
る場合はこれを最少限にとどめた監視機能が望ま
れる場合が多い。例えば病院では医師、看護婦そ
の他の職員の居所を常時知ることができれば所望
の個人との連絡を容易にする点で非常に有益であ
る。また職員の居所がわかつていると何時誰がど
の患者の看護にあたつていたか又は手術室もしく
は薬局に居たかを把握して記録に残すことができ
る。その用途は広く思い付くもの全てがその対象
となる。 しかし居所の記録及び重要な管理目的にこの種
の方式を使用する場合は仮に１個以上のタグが同
時に監視局範囲に入つても、監視局を通過するこ
れらのタグを確実に検出できることが肝要であ
る。本発明はこの種の方式を提供するものであ
り、また以上の説明から判る様に、本発明実施例
の方式は複数個の入口を通る65，536個のタグを
監視するものであり、何れかの入口を同時に通過
する６個までのタグを確実に処理することができ
る。 発明の概要 本発明の第１様相によると、監視局に入る１個
以上の複数個の独立タグ回路を検出すると共に、
同時に監視範囲に入る１個以上のタグ回路を識別
する通信方式が提供されている。この方式は監視
局に配置されて該局の識別コードである第１コー
ドパターンを有する質問信号を送出する手段、監
視範囲に入つて質問信号を受信する手段と、質問
信号に応答すると共に第１コードパターンと異な
りかつタグ回路の識別コードである所定の第２コ
ードパターンを有する一連の応答信号を送出する
手段及び少くとも擬似ランダム要領で連続する応
答信号を変える手段で構成される手段とを備える
タグ回路、及び監視局に配置されて、監視範囲に
入る信号を受信検査して、これらがタブの識別コ
ードである所定のコードパターンを有しているか
否かを決定し、所定のコードパターンが存在する
場合に限り、受信信号を処理装置に渡す手段から
成つている。 本発明の第２様相によると、監視局範囲に入る
と同時に範囲内に存在する他のタグ回路とは別に
監視局と連絡してこれに識別信号を送るタグ回路
が提供されている。このタグ回路は監視局の監視
範囲に入ると該局から第１コードパターンを有す
る質問信号を受信する手段、及び質問信号に応答
すると共に、タグ回路の識別コードである第１コ
ードパターンと異なる所定の第２コードパターン
を有する一連の応答信号を発する手段と、少くと
も擬似ランダム要領で連続する応答信号の間隔を
変える手段とで構成される手段から成つている。 次に添付図面を参照して、本発明の好適実施例
の詳細を説明する。図中、同一符号は同一又は類
似部品を指す。 実施例の説明 第１図は廊下１２に向つて開く戸口１１を有す
る室１０の見取図である。但しこれは例示を目的
とする任意例である。この場合室１０を病院の手
術室と仮定し、同時誰が室に入つたか又は室から
出たかを連続的に記録する必要があると仮定して
おく。本図は２名の医師１３と１４とがほとんど
同時に室１０に入ろうとしている状態を示してい
るが、一方が室から出ていく間に他方が室に入ろ
うとして反対方向から戸口１１に近づくこともあ
り得る。入口装置１５は戸口１１に隣接配置され
ている。以下に詳細を説明する様に、入口装置１
５は戸口１１と関連する磁気ループ（図示せず）
に接続されている。医師１３と１４とは戸口の磁
気ループと磁気結合して入口装置１５と相互作用
する小型の識別タグを付けている。入口装置１５
と関連入口ループとを監視局と考えることができ
る。 本発明は入口装置と識別タグとを確実に通信す
る方式に関するものであるが、入口装置が集めた
情報を利用する下流装置を含むものではないの
で、余計な複雑さをさけるため、最も簡単な場合
を想定して例示してある。識別タグは入口装置１
５の範囲に入る場合は常に戸口を通過すると思わ
れるので、探知される人物の位置をある時点で知
つていれば、特定の識別タグが室に持ち込まれた
（廊下にあつたことが予めわかつている場合）又
は室から持ち出された（室にあつたことがわかつ
ている場合）ことを示す明確な信号を得ることが
できる。 本方式の基本的構成部品を第２図に示す。 入口装置１５は、タグの所持者と同一符号で示
す複数個の識別タグと通信する質問送受信装置を
含んでいる。入口装置１５によつて導出された情
報は出力線１６を通つて情報利用局にリレーされ
る。これは図示されていないが、中央処理装置へ
のインターフエイス装置又は中央処理装置そのも
のと考えて良い。 入口装置１５は、関連する受信部がタグ応答信
号を聞き取る沈黙期間に離間した周期的な質問信
号を発生する送信部（第３図にブロツク線図を、
また第６図に詳細図を示す）を有している。受信
部のブロツク線図を第４図に、また詳細図を第１
０Ａ図及び第１０Ｂ図に示す。第２図に示す各識
別タグは、第５図にブロツク線図、また第８Ａ，
８Ｂ，９Ａ、及び９Ｂ図に詳細図を示す回路を有
している。 第３図に示す様に、入口装置の送信部は、２相
マーク変調器即ちマンチエスタ変調器１９のゲー
ト１８を通つて、低域フイルタ・パワーアンプ２
０に送られるキヤリヤ信号を、例えば25.6キルヘ
ルツの周波数で発生する水晶制御クロツク17を有
している。フイルタ・アンプ２０から出される出
力は、スイツチ２１の通電即ち閉路時に、該スイ
ツチを通つて入口ループ２２に送られる。該ルー
プについては、例えば第１図に示す戸口１１の枠
の周りに巻付けて、戸口１１の周辺に磁界を形成
するエネルギを放射し、ループ２２が形成する磁
界に入る識別タグの受信コイルと相互作用する様
に配置することができる。 またクロツク１７が発するクロツク信号出力
は、デイバイダ・２相発生器２３にも送られ、32
で割られると共に分相されて、２つのパルス列を
形成する。発生器２３から出される出力信号を実
際の分周信号を単に移相したものと見なすのは、
余りに短絡的すぎる。第６図に示す詳細な回路図
から判る様に、25.6キルヘルツのクロツク出力を
２進カウントで二分し、スケールダウンすること
により25.6キルヘルツ信号の２つの全サイクルに
等しいパルス幅、即ち78.125マイクロ秒のパルス
幅を有するパルスを形成する。これらのパルスは
800ppsのパルス繰返数で繰返し、位相１出力パ
ルスから0.625ミリ秒遅れて位相２出力パルスが
発生する。任意に位相１とした２相発生器２３か
ら出される信号出力は、タイマ２４及び変調器１
９のゲート２５に送られ、一方位相２出力はタイ
マ２４からも出力の供給を受ける識別コード発生
器２６に送られる。コード発生器２６は発生器２
３から送られる信号で刻時されると共に、タイマ
出力で順序付けされ、出力線２７を通つてゲート
２５に送られてこれを制御する信号を発生する。
ゲート２５の出力は、切換デイバイダ２８に送ら
れる。デイバイダ２８はタイマ２４から出力線２
９を通つて送られて来る信号で作動し、ゲート２
５から送られる信号を二分してゲート１８に送
る。ゲート１８と２５及びデイバイダ２８は集合
的に２相マーク変調器を構成し、クロツク１７か
らフイルタ・アンプ２０にパルス変調されたキヤ
リヤ信号を送る。これと同時にタイマ２４から出
される動作信号は、出力線２９を通つてスイツチ
２１に印加され、これをオンにして変調信号を入
口ループに送る。 送信部が質問信号を送出する間は、時分割共用
される入口ループ２２と受信部との接続を切つて
おくことが望ましいがこれはタイマ出力線２９か
らインバータ３０を介してスイツチ３１に信号を
送りこれをオフにすることによつて達成される。
図示の様にスイツチ３１への入力は入口ループ２
２との接合点３２から得られ、第４図に示す受信
プリアンプAGC・フイルタ回路８１に送られる。 入口装置の受信部を説明する前に、送信部の詳
細及びタグ回路の構成と作動を説明しておく。識
別タグと入口装置との通信は25.6キルヘルツの周
波数で質問応答形式で行われる。第３図に関する
上記の様に、情報は自己刻時２相マーク変調器に
よつて25.6キルヘルツのキヤリヤ周波数に変調さ
れる。質問情報は、メツセージ長さを６ビツトと
する毎秒800ビツトの速度で発生する。最初の３
ビツトは110の固定パターンをフオローし、残り
の３ビツトを用いてタグに施設の識別子を与える
訳であるが、これらの３ビツトは８つの異なるコ
ードパターンを形成する。２相マーク形式を用い
ると、第７図に示す様な質問パターンになる。以
下に説明する様に、質問シーケンスは7.5ミリ秒
続く。識別タグは入口装置範囲内に入ると、入口
装置から質問シーケンスに含まれている情報を受
信する。タグ回路は、応答すべきと思われる以前
にプログラム編成された周波数とビツト速度の適
切性、110のプリアングルシーケンス及び３ビツ
ト施設識別子をチエツクする。応答情報は28ビツ
トのメツセージ長さで、毎秒1600ビツト速度で、
識別タグから入口装置に戻る。28ビツトのうちで
最初の４ビツトは1110の固定パターンをフオロー
し、次の16ビツトはタグの識別にあたり、次の６
ビツトは誤り検査コードを含み、また最後の２ビ
ツトは当座の予備として00を含んでいる。入口装
置は識別タグから送られて来る情報を受信し、周
波数とビツト速度の適切性、及び1110のプリアン
ブルシーケンスを検査してから、識別子、誤り検
査コード及び次の00パターンを予備的に受入れ
る。 タグ応答形式を第７図の１行目に示す。この形
式は、2.5ミリ秒間にプリアンブルを伝送し、次
の10ミリ秒間にタグ識別コードを伝送し、その後
1.25ミリ秒の休止を入れてから５ミリ秒で誤り訂
正コードを伝送することを意味している。これら
の時間に0.625ミリ秒の予備伝送形式休止を入れ
ると、全タイムスロツト期間は19.375ミリ秒にな
る。またタグ伝送全サイクルには32のタイムスロ
ツトがあるため、全部で620ミリ秒となり、これ
に11.5625ミリ秒の事後遅延時間と0.9375ミリ秒
の応答休止を加えると、全サイクルは632.5ミリ
秒になる。 第６図に示す様に水晶制御クロツク１７は、端
子３３でパルス出力を形成する従来型の水晶制御
発振器で構成されている。端子の出力信号は、結
線３４を介してNORゲート１８の第１入力端に
直送されると共に、２相発生装置23のＤフリツプ
フロツプ３５のクロツク端子に送られる。フリツ
プフロツプ３５は図示の様に接続されているた
め、クロツク１７から送られる信号を二分し、そ
の出力端Ｑから出される出力信号を２進カウンタ
３６のクロツク入力端に送る。カウンタ３６の出
力端Q0乃至Q3は、図示の様にNORゲート３７及
び３８の入力端に接続されている。NORゲート
３７の出力端はリード線３９を介してゲート２５
の第１入力端に接続されている。リード線４０
は、ゲート３７の出力線をタイマ２４の２進カウ
ンタ４１のクロツク入力端に接続している。カウ
ンタ４１の出力端Q0乃至Q2は、夫々８チヤネル
データセレクタ４２の入力端Ａ，Ｂ及びＣに接続
されている。データセレクタの入力端Ｘは、施設
のプリアンブル及び識別コードの形成に用いられ
る。第６図に示す様に、入力端X1及びX2は高値
即ち論理１状態を示す電圧源に接続されている。
また入力端X3は、論理０状態を示す電圧源に接
続されており、一方入力端X4，X5及びX6は、入
口装置の識別コードを第７図に示す８つのパター
ンの１つに予備選定できる様にするセレクタスイ
ツチ４３，４４及び４５に接続されている。図示
の様にスイツチ４３，４４及び４５が開くと、こ
れらが接続されている各端子が論理０レベルに等
価接続されることは理解されよう。データセレク
タの特定入力端を論理１レベルに接続したい場合
は、当該スイツチを閉じてこれを正の電圧源に接
続する。端子X0及びX7は、ある種の妨害に対す
る防御措置として、コードパターンの前後に保護
間隔又はスペースを入れるためのものである。図
中これらの端子は、低圧即ち論理０レベルに接続
されている。 データセレクタ４２はさらに禁止入力端を備え
ている。NANDゲート４７の出力端はリード線
４６を介して該入力端に接続されており、一方入
力端は相互接続されて、NORゲート３８の出力
端に接続されている。NANDゲート４７はNOR
ゲート３８の出力を反転して、２相発生器２３の
位相２から出力パルスを導出する短期間を除いて
データセレクタ４２の作動を禁止する。この場合
データセレクタの出力端２は、カウンタ４１から
その入力端Ａ，Ｂ及びＣに印加される２進信号で
決定される何れかの入力端に接続され、これらの
２進信号は結線２７を介してゲート２５の第２入
力端に印加される。 NORゲート２５の出力は、切換デイバイダ２
８を構成するＤ型フリツプフロツプのクロツク入
力端に送られる。Ｄ型フリツプフロツプ２８の出
力端は、その入力端ＤとNORゲート１８の入
力端とに接続されている。またＤ型フリツプフロ
ツプ２８のリセツト端子はタイマ２４のNORゲ
ート４８から導出される出力線２９に接続されて
いる。NORゲート４８は、相互接続されて、多
入力ORゲート４９の出力端に接続された入力端
を有するインバータの役目をする。NORゲート
４９の６個の入力端は夫々７段リプルカウンタ５
０の出力端Q1乃至Q6に接続されている。該カウ
ンタのリセツト端子は接地され、一方クロツク入
力端はリード線５１及び５２を介してカウンタ４
１の出力端Q2に接続されている。カウンタ４１
の出力端Q2はそのクロツク端子で２相発生器２
３の出力線３９から８個の入力パルスを受信する
度に状態を変更するので、リプルカウンタ５０に
印加される信号は、ゲート３７から送られて来る
信号を８で割つたものになる。 NORゲート４９には、カウンタ４１の３個の
出力端に接続された３個の入力端を有するNOR
ゲート５３の出力端からさらにもう一つの入力が
印加される。カウンタ４１の該３出力端は夫々イ
ンバータ５４，５５及び５６を介してNORゲー
ト５７の３個の入力端に接続されており、NOR
ゲート５７の出力端はNORゲート４９のさらに
別の入力端に接続されている。 第６図の種々の論理部品に付した４桁数字は
CMOSの型番号であり、これによつて当該の部
品を完全に識別できる様にしている。第６図に関
して説明した入口送信部の作動については当業者
であれば理解し得るものと思われる。切換デイバ
イダ２８の作動はそのリセツト端子がリード線２
９を介して印加される論理１を有する限り禁止さ
れる。これは、NORゲート４９の何れかの入力
端が論理１信号を有する限り何時でも起こる。回
路を分析すると、256キロヘルツクロツク信号で
作動する時に、６ビツトコードの送信ウインドウ
が7.5ミリ秒続き、一方無音期間が632.5ミリ秒続
くことが判かる。無音期間中に第３図に示すスイ
ツチ３１はインバータ３０を介して印加された信
号でオンになり、第４図に示す受信回路を作動さ
せる。識別タグが一定の入口装置の範囲に入るか
否かに関わらず、入口装置は質問信号を周期的に
送り続けてから応答を聴取し、聴取期間中に得ら
れる応答の妥当性を検査して記録する。仮に応答
が得られなくても作動し続ける。 本発明方式と共に使用される識別タグは入口ル
ープに接続する独自のアンテナループを有する小
型の電池作動式ソリツドステート回路装置であ
る。第５図は、識別タグに内蔵された回路のブロ
ツク線図である。該回路はキヤリヤ包絡線検波器
６２に出力を送るプリアンプ・フイルタ回路６１
に接続されて受信する端子を有する送受信タグル
ープ６０を有している。キヤリヤ包絡線検波器の
出力は低域フイルタ６３を通つて遷移検波器６４
に送られる。遷移検波器６４から出される検波出
力はパス６５を介してクロツク・データセパレー
タ６６に送られ、セパレータの出力は質問シーケ
ンス認識回路６７に送られる。回路６７の出力は
接合点６８に送られ、そこからリード線６９を通
つてゲート７０の入力端に印加されると共に、リ
ード線７１を通つてセパレータ６６に戻される。
接合点６８はさらに、インバータ７３を介して回
路６２，６３，６４及び６６の各入力端にリード
線７２で接続されると共に、リード線７４を介し
てフレームカウンタ７５及びタイマ７６の入力端
にも接続されている。 25.6キロヘルツの周波数を有する水晶制御クロ
ツク７７の出力端はリード線７８を介してゲート
７０に接続され、リード線７９及び８０に切換ク
ロツク信号を送る。リード線７９上の切換クロツ
ク信号は、質問シーケンス認識回路６７及びキヤ
リヤ包絡線検波器６２に送られる。リード線８０
上のクロツク信号は回路６２，６３及び６４に送
られる。またクロツク７７は、リード線７８を介
してタイマ７６、クロツク・データセパレータ６
６、マンチエスタ変調器８３および２相発生器８
４に直接出力している。該発生器は、クロツク７
７から送られる信号を16で割る。フレームカウン
タ７５は、リード線８５を介してクロツク・デー
タセパレータ６６に接続された出力端と、リード
線８６を介してゲート８７の入力端に接続された
出力端とを有している。タイマ７６はリード線８
８及び８８Ａを介してゲート８７に第２入力を導
出し、ゲート８７の出力は、擬似ランダム２進シ
ーケンス応答カウンタ８９の入力端に送られる。
応答カウンタ８９は、リード線９０を介してタイ
マ７６から及びリード線９１を介してマンチエス
タ変調器８３からも入力を受信する。応答カウン
タ８９の出力は、マンチエスタ変調器８３及びタ
イマ７６の入力端への接合点９２に送られる。タ
イマ７６は、リード線９３を介してフレームカウ
ンタ７５に、及びリード線９４を介してハミング
発生器９５に出力を送る。ハミング発生器９５は
リード線９６を介して発生器８４の出力端φ1か
ら追加入力を受ける。タイマ６から出力端９７を
通じ、識別シーケンス発生器９８を介してハミン
グ発生器９５に至る別の回路が出来る。シーケン
ス発生器９８の出力端は、リード線９９を介して
シーケンス制御回路１００の第１入力端に接続さ
れている。回路１００は、リード線１０１を介し
てハミング発生器９５から第２入力を受けると共
に、リード線１０２を介してタイマ７６から第３
入力を受ける。 第５図に示す様に、２相発生器８４の出力端
φ1はリード線１０３を介してマンチエスタ変調
器８３に接続され、一方出力端φ2は、リード線
１０４を介して変調器８３の入力端に接続されて
いる。変調器８３には、リード線１０５を介して
シーケンス制御回路１００から別の入力が送ら
れ、またその出力はリード線１０６を介してパワ
ーアンプ駆動器１０７に送られる。駆動器１０７
の出力端は、タグループ６６の両端に接続されて
いる。 上記の通り第５図を参照して識別タグ回路部品
の概略を説明したが、次に第８Ａ，８Ｂ，９Ａ及
び９Ｂ図を参照して第５図の回路が内蔵する機能
素子の実現例の詳細を説明する。先ず第８Ａ図及
び第８Ｂ図に示す水晶制御クロツク７７は、出力
線７８からクロツク出力を送る従来形式のもので
ある。タグループ６０（第５図参照）の受信信号
はプリアンプ・フイルタ回路６１からリード線１
１０を通つて、キヤリヤ包絡線検波器６２のＤ型
フリツプフロツプ１１１と１１２のセツト入力端
に印加される。図示の様のリード線７９及び８０
上の切換クロツク信号は、夫々フリツプフロツプ
１１２及び１１１のクロツク入力端に送られる。
また入力線７９は、他のＤ型フリツプフロツプ１
１３のクロツク入力端に接続されているが、入力
線８０は別のＤ型フリツプフロツプ１１４のクロ
ツク入力端に接続されている。フリツプフロツプ
１１１，１１２，１１３及び１１４のリセツト端
子は全て、リード線７２Ａを介して質問シーケン
ス認識回路６７のインバータ７３の出力端に接続
されている。フリツプフロツプ１１１及び１１２
の入力端Ｄは論理０電圧レベルに接続されている
が、フリツプフロツプ１１１の出力端Ｑはフリツ
プフロツプ１１３の入力端Ｄに接続され、フリツ
プフロツプ１１２の出力端Ｑはフリツプフロツプ
１１４の入力端Ｄに接続されている。フリツプフ
ロツプ１１３及び１１４の出力端Ｑは、NAND
ゲート１１５の入力端に接続され、該ゲートの出
力はキヤリヤ包絡線検波器６２の出力端になつて
いる。 低域フイルタ６２の出力端になつている。 低域フイルタ６３は、4175型４連式Ｄフリツプ
フロツプ１１６及び４個のNANDゲート１１７，
１１８，１１９，１２０で構成されており、これ
らの素子は図示の様に相互接続されている。４連
式フリツプフロツプ１１６のフリツプフロツプ構
成素子のクロツク入力端は全て切換クロツク線８
０に接続されており、一方リセツト端子はインバ
ータ１２１の出力端に接続されている。またイン
バータ１２１の入力端は、リード線７２Ａを介し
てインバータ７３の出力端に接続されている。
NANDゲート１１９の出力は低域フイルタ６３
の出力として、遷移検波器６４のＤ型フリツプフ
ロツプ１２２の入力端Ｄと、排他的ORゲート１
２３の第１入力端に送られる。フリツプフロツプ
１２２のクロツク入力端は切換クロツク線８０
に、一方出力端Ｑはゲート１２３の第２入力端に
接続されている。ゲート１２３の出力は遷移検波
器の出力として、リード線６５を通つてクロツ
ク・データセパレータ６６内のNANDゲート１
２４の第１入力端に送られる。 NANDゲート１２４の第２入力は、質問シー
ケンス認識回路６７の出力端から線７１Ａを通つ
て送られて来る。クロツク・データセパレータ６
６は、NORゲート１２５、Ｄ型フリツプフロツ
プ１２６，１２７，１２８と１２９、4017型10進
カウンタ１３０、NORゲート１３１，１３２，
１３３，１３４，１３５，１３６と１３７、OR
ゲート１３８と１３９、及びインバータ１４０と
１４１で構成されている。これらの種々の部品は
従来の記号法により図示の様に相互接続されてい
る。 クロツク・データセパレータ６６は、質問シー
ケンス認識回路６７に通じる一連の出力線１４
２，１４３，１４４，１４５及び１４６を有して
いる。リード線１４２はカウンタ１３０の出力端
Q5とＤ型フリツプフロツプ１４７の出力端Ｄと
の間に接続されると共に、NANDゲート１４８
の第１入力端に接続されている。リード線１４３
は、クロツク・データセパレータ６６のフリツプ
フロツプ１２８の出力端Ｑと２進カウンタ１４９
のクロツク入力端との間に接続されている。リー
ド線１４４は、NORゲート１３１の出力端と
NORゲート１５０の第１入力端との間に接続さ
れている。NORゲート１５０の第２入力は、ゲ
ート１３６の出力端に接続されたリード線１４５
を通つて送られて来る。リード線１４６は、ゲー
ト１３７の出力端と、図示の様にNORゲート１
５２に交差接続されたNORゲート１５１の入力
端との間に接続されている。インバータ１５３
は、ゲート１５０の出力端とゲート１５２の第１
入力端とを相互接続している。カウンタ１４９の
出力端は、図示の様にNANDゲート１５４の両
入力端及び4051型アナログマルチプレクサ・デマ
ルチプレクサ１５５の入力端A.B.Cに接続されて
いる。マルチプレクサ１５５は８チヤネル型装置
であり、その出力端X0乃至X5は、組端子１５７
又は１５８の相当する端子と選択的に相互接続す
る夫々のストラツプ端子１５６に接続されてい
る。図示の様に装置１５５の出力端X0及びX1に
接続されているストラツプ端子１５６は組端子１
５８側の端子に接続されているが、出力端X2は
組端子１５７側の端子に接続されている。これら
は入口装置の識別シーケンスの一部として使用さ
れるプリアンブル１１０を先決する固定接続であ
る。出力端X3，X4及びX5に接続された残りのス
トラツプ端子は、識別タグを用いる特定施設用の
識別コードに応じて、組端子１５７又は１５８の
何れかに接続されることが理解されよう。装置１
５５の端子X6は、論理１電位に接続されており、
入口装置が発する６ビツトの質問信号を認識して
からNORゲート１５９の第１入力端に阻止信号
を印加する。図示の様にゲート１５９の出力端
は、クロツク・データセパレータ６６のリセツト
部の一部を構成するORゲート１３８の一入力端
に接続されている。第８Ａ図及び第８Ｂ図を参照
して説明した回路の作動については、第９Ａ図及
び第９Ｂ図の詳細を説明するまで保留しておく。 第９Ａ図及び第９Ｂ図に示す様に16進２相発生
器８４は一対のNORゲート１６１及び１６２に
接続された出力端を有する２進カウンタ１６０で
構成されている。ゲート１６１の出力は位相１と
なり、ゲート１６２の出力は位相２となる。図示
の様に出力端φ1（位相１）は、リード線９６によ
つてハミング発生器９５の4174型６連式Ｄフリツ
プフロツプ１６３の夫々のフリツプフロツプ構成
素子のクロツク端子に接続されている。フリツプ
フロツプ１６３のリセツト端子は全て、タイマ７
６の4017型10進カウンタ・デイバイダ１６５の出
力端Q1からリード線９４Ｂを介して入力を受信
するインバータ１６４の出力端に接続されてい
る。ハミング発生器９５はさらに排他的ORゲー
ト１６６，１６７，１６８，１６９と１７０及び
ANDゲート１７１を有しており、これらは図示
の様に接続されている。排他的ORゲート１７０
の制御入力は、識別シーケンス発生器９８の出力
端の接合点９９から送られ、一方ANDゲート１
７１の制御入力はリード線９４Ａ及び９４Ｃを介
して10進カウンタ・デイバイダ１６５の出力端
Q2から送られて来る。 識別シーケンス発生器９８は、4051型８チヤネ
ルアナログマルチプレクサ・デマルチプレクサ１
７２及び１７３で構成されている。ストラツプ又
はジヤンパを接続できる一組の端子対１７４の各
対の一側端子は、素子１７２又は１７３の夫々の
出力端X0乃至X7に接続されており、一方他側端
子は、接合されて論理０電圧レベルに接続されて
いる。任意の端子対１７４が開路すると論理１状
態となり、一方端子対をストラツプで橋絡すると
論理０状態となる。識別シーケンス発生器９８の
素子１７２及び１７３の制御入力はタイマ７６か
ら得られる。即ちタイマ７６は、4516型２進可逆
カウンタ１７５を備えており、該カカンタの出力
端Q0乃至Q3は、ケーブル線９７を介してアナロ
グマルチプレクサ１７２及び１７３のＡ，Ｂ，Ｃ
及び禁止端子に接続（但し、マルチプレクサ１７
２の禁止端子への接続はインバータ１７６を介し
て行われる）されている。周知の通り、４つの２
進ビツトは16の異なる状態を表わす容量を有して
おり、インバータ１７６は２進カウンタ１７５か
ら最初の８カウントが送られて来る間にマルチプ
レクサ１７２に周期動作を与え、一方マルチプレ
クサ１７３は接続の８カウントで周期動作する。
マルチプレクサ１７２と１７３とは集合的に16個
の異なるビツト値を順次に選択して識別コードを
構成する。 識別シーケンス発生器９８のマルチプレクサ１
７２及び１７３の出力端Ｘは、相互接続されて接
合点９９に接続されると共に、抵抗器１７７及び
リード線９４Ｄを介してリード線９４Ａと９４Ｃ
との接合点に接続されている。 タイマ７６の10進カウンタ１６５の出力端Q0
乃至Q3は、一連のORゲート１７８，１７９及び
１８０を介して２進可逆カウンタ１７５の入力端
P0乃至P3に接続されている。カウンタ１７５の
キヤリーイン端子と可逆端子とは論理０電圧レベ
ルに接続されている。このためカウンタ１７５は
ダウンカウンタとして作動する。カウンタ１７５
のプリセツト可能（PE）端子は、Ｄ型フリツプ
フロツプ１８１の出力端に接続されており、一
方その出力端Ｑはカウンタ１６５のクロツク端子
及びNANDゲート１８２の一入力端に接続され
ている。ゲート１８２への第２入力はORゲート
１８４の出力端に接続されたリード線１８３から
導出される。またリード線１８３は、フリツプフ
ロツプ１８１の入力端Ｄ及びNORゲート１８５
の第１入力端にも接続されている。 ゲート１８４の第１入力端は、カウンタ１７５
のキヤリーアウト即ち出力端に接続されてお
り、一方第２入力端はNANDゲート１８６の出
力端に接続されている。またカウンタ１７５のク
ロツク端子は、ゲート１８６の出力端にも接続さ
れている。ゲート１８６には、リード線１０３と
NANDゲート１８７の出力端とから入力され、
またゲート１８７にはリード線７４とカウンタ１
６５の出力端Q4とから入力される。リード線７
４は、フレームカウンタ回路７５の4024型７段リ
プルカウンタ１８８のリセツト端子にも接続され
ており、カウンタ１８８のクロツク端子はカウン
タ１６５の出力端Q4に接続されている。 フレームカウンタ７５のリプルカウンタ１８８
の出力端Q1及びQ6は、インバータ１９０を通し
て出力線８５に接続されている出力端を有する
NANDゲート１８９の２つの入力端に接続され
ている。ゲート１８９の第３入力は、タイマ７６
のカウンタ１６５の出力端Q1から得られる。カ
ウンタ１８８の出力端Q6は、リード線８６を介
してゲート８７のインバータ１９１にも接続され
ている。インバータ１９１の出力端は、カウンタ
１６５の出力端Q3に接続されたリード線８８Ａ
から第２入力を受けるANDゲート１９２の第１
入力端に接続されている。カウンタ１６５の出力
端Q3は、リード線８８Ｂを介してマンチエスタ
変調器８３のＤ型フリツプフロツプ１９３のセツ
ト入力端にも接続されている。タイマ７６を構成
する残りの素子としては、Ｄ型フリツプフロツプ
１９４、NDNDゲート１９５及びANDゲート１
９６があり、これらは全て図示の様に接続されて
いる。 マンチエスタ変調器８３はインバータ１９７、
NANDゲート１９８と１９９、NORゲート２０
０と２０１、及びインバータ２０２を有してお
り、これらは全て図示の様に相互接続されてい
る。 擬似ランダム２進シーケンス応答カウンタ８９
は、マンチエスタ変調器８３の出力端から到来す
るリード線９１に接続されたクロツク入力端とＤ
型フリツプフロツプ２０４，２０５及び２０６の
クロツク入力端に接続された出力端Q5とを有す
る4024型７段リプルカウンタ２０３を備えてい
る。フリツプフロツプ２０４，２０５及び２０６
の出力端Ｑは、夫々NORゲート２０７の入力端
に接続されており、また該ゲートの出力端はフリ
ツプフロツプの各セツト端子に接続されて、フリ
ツプフロツプが２進数０に等しいリセツト状態に
同時にならない様にしている。またフリツプフロ
ツプ２０４及び２０６の出力端Ｑは、フリツプフ
ロツプ２０４の入力端Ｄに接続された出力端を有
する排他的ORゲート２０８の各入力端に接続さ
れている。この様にフリツプフロツプ２０４，２
０５及び２０６は擬似ランダム２進シーケンスカ
ウンタ内で相互接続されている。図示の特定実施
例ではカウント７，６，５，２，４，１，３の順
序で計数し、次にカウント７に戻つてこの順序を
無限に繰返していく。応答カウンタは、フリツプ
フロツプ２０４，２０５及び２０６の出力端Ｑに
夫々接続されたポリセツト端子P0，P1及びP2を
有する4516型２進可逆カウンタ２０９を備えてい
る。カウンタ２０９のカヤリーアウト（）端
子は、接合点９２に接続されており、そこからゲ
ート２０１及び１８５に接続されている。またカ
ウンタ２０９はタイマ７６のフリツプフロツプ１
９４の出力端から到来するリード線９０に接続
されたプリセツト可能（PE）端子を有しており、
またそのクロツク端子はゲート１９２の出力端に
接続されており、一方プリセツト端子P3は論理
０電位値に接続されている。 シーケンス制御回路１００は、NANDゲート
２１０，２１１，２１２と２１３及びNORゲー
ト２１４で構成されており、これらは全て図示の
様に接続されている。 第３図及び第６図を参照して説明した様に、入
口装置は６ビツトデジタル識別コードパターンを
有する質問信号を周期的に発する。識別タグが入
口装置の範囲に入ると、そのタグループはプリア
ンプ・フイルタ６１に送られる信号をピツクアツ
プする。該信号はそこから、パルス列情報を論理
レベル出力に変換して、タグの内部クロツク速度
の２分の１より早い速度で発生する信号遷移を排
除するキヤリヤ包絡線検波器に進む。キヤリヤ包
絡線検波器６２は、質問シーケンスのトーンバー
スト変調包絡線のレプリカを出力する。この変調
包絡線はさらに、４クロツク周期以下に離間され
た遷移信号の伝搬を阻止する低域フイルタ６３内
で処理される。低域フイルタの出力は変調包絡線
のレベルが変わる度にパルスを発生する遷移検波
器６４で処理される。遷移検波器６４の出力は、
クロツク・データセパレータ６６のゲート１２４
に入る。該セパレータは、変調包絡線から発生す
るパルスを３方向のうちの１方向に伝搬できる様
に制御されたタイミングを有する状態カウンタで
ある。最大タイミング公差を越える期間後最初に
受信される信号は、妥当なメツセージ状態をセツ
トする新メツセージの最初のパルスと見なされ
る。事の推移を把握するには該パルスの受信直前
の回路状態を考える必要がある。即ちフリツプフ
ロツプ１２９がリセツト状態にあり、その出力
が１であると、カウンタ１４９はリセツトされて
その出力Ｑは全て論理０となるため、接合点６８
は論理１となり、このためゲート７０は駆動され
てフレームカウンタ７５がリセツトされると共
に、ゲート１２４、キヤリヤ包絡線検波器６２、
低域フイルタ６３及び遷移検波器６４が駆動され
る。フリツプフロツプ１２９の出力Ｄは論理０で
ありまた遷移検波器６４の出力は論理０であるた
め、ゲート１２４の出力は論理１となり、一方ゲ
ート１２５の出力は論理０となる。フリツプフロ
ツプ１２８はセツトされて出力Ｑが０となり、カ
ウンタ１３０はカウント“９”にあつて出力Q9
が１となるため、インバータ１４１はゲート１３
１に作動可能論理０を印加する。 低域フイルタ６３の論理レベルが到来するパル
スの印加によつて最初に変化する際に、遷移検波
器６４は論理１を出力する。このためゲート１２
４の出力は０となり、フリツプフロツプ１２９は
ゲート１３１を介してセツトされ、一方カウンタ
１３０はゲート１２５を介してリセツトされる。
ゲート１２５の出力パルスは高レベルに向うクロ
ツクパルスに応答して０に戻ると、フリツプフロ
ツプ１２８を刻時して出力Ｑが０になり出力が
１になるリセツト状態にする。 カウンタ１３０はリセツトされると、水晶クロ
ツク周波数を因数４で割るフリツプフロツプ１２
６及び１２７を介して受信される内部クロツクパ
ルスを即座に計数し始める。データクロツク遷移
に対して予測されるタイミング公差内で遷移検波
器６４が送出する後続の遷移パルスは、ゲート１
３６を介してクロツク・データセパレータ６６か
ら導出される。一方データ１遷移の予測タイミン
グ公差範囲で受信される遷移パルスはゲート１３
７を介してデータパルスとして回路から導出さ
れ、さらに予測公差外で受信される遷移パルス
は、回路をリセツトして新メツセージを作成する
様に導出される。この様なパルス発生がカウンタ
１３０の動作と一致してその端子Q1，Q2，Q5又
はQ6に出力が印加されると、ゲート１３５及び
１３８を介してフリツプフロツプ１２９にリセツ
トパルスが印加される。しかしパルスがカウント
“９”以上のカウント数と一致する場合はフリツ
プフロツプ１２９の入力端Ｄに論理０が印加され
ているため、カウンタ１３０の端子Q9が論理１
になり、フリツプフロツプ１２９を刻時してリセ
ツト状態にする。何れの場合にせよゲート１３５
及び１３８を介してリセツト信号がフリツプフロ
ツプ１２９に印加されても、カウンタ１３０はカ
ウント９まで計数し続け、ゲート１３１に作動可
能信号を印加することにより、次に到来する遷移
パルスを受信して、フリツプフロツプ１２９のセ
ツトに備える。これと同様にフリツプフロツプ１
２８はゲート１３９を介してセツトされるため、
ゲート１２５を作動させてカウンタ１３０にリセ
ツト信号を送り出せる様にする。カウンタ１３０
の出力端Q9はそのクロツク作動可能（）端子
にフイードバツク接続されているため、カウンタ
１３０がリセツト信号を受信するまで論理１にあ
つてカウンタがそれ以上計数できない様にする。 クロツク・データセパレータ６６から送出され
る分離されたデータ信号及びクロツク信号は、質
問シーケンス認識回路６７で、上記の様に接点１
５６，１５７及び１５８をストラツプ接続するこ
とによつて得られるプリセツトコードパターンと
比較される。到来する信号はこのプリセツトパタ
ーンとビツト毎に比較される。カウンタ１４９は
ビツト毎に歩進してセレクタ１５５を順序付け
る。受信シーケンスがプリセツトシーケンスと相
違すると、マルチプレクサ１５５の出力端Ｘから
ゲート１５９及び１３８を介してリセツト信号が
印加され、フリツプフロツプ１２９及びカウンタ
１４９をリセツトする。こうして初期起動状態に
戻つて上記の手順で次の受信信号に応答する。 110プリアンブル及びプリセツトパターンの最
後の３ビツトを構成する妥当な６ビツト信号を受
信すると、カウンタ１４９は、カウント“６”に
到達し、接合点６８に論理０を印加することによ
り数種の機能を達成できる様にする。論理０はカ
ウンタ１４９のクロツク作動可能入力端にフイー
ドバツクされてカウンタの計数機能を禁止し、ま
たゲート１２４を非作動状態にすると共に、信号
がキヤリヤ包絡線検波器６２、低域フイルタ６３
及び遷移検波器６４を通過できない様にする。即
ちこの信号は接合点６８にあつて、受信モードの
動作終了と送信モードの開始とを前ぶれする。 第９Ａ図及び第９Ｂ図に示す様に、導線７４を
通る論理０信号は、フレームカウンタ７５のカウ
ンタ１８８からリセツト入力を除去することによ
り、カウンタ１８８が起動できる様にする。また
ゲート１８７はゲート１８６に作動可能信号を印
加することにより、ダウンカウンタとして作動す
る様に接続されたカウンタ１７５のクロツク端子
に、結線１０３を通つて２相発生器８４から供給
されるクロツク信号を印加できる様にする。タグ
回路の受信部が受信モードにある間は、カウンタ
１６５が端子Q4に論理１出力を印加した状態に
なることは明白である。受信モードが働いている
間は導線７４に論理１が存在するので、ゲート１
８７は論理０を出力してゲート１８６をオフにす
ることによりダウンカウンタ１７５にクロツクパ
ルスが伝わらない様にする。導線７４に論理０が
出現すると、この状態が逆転する。 ダウンカウンタ１７５がカウントゼロに達する
と、そのキヤリーアウト（）出力端から論理
０信号を出力して、ゲート１８４が論理０を出力
できる様にする。このためフリツプフロツプ１８
１はリセツトされて出力Ｑが論理１に等しくな
り、カウンタ１７５のプリセツト作動可能端子が
働いて、カウンタ１６５からその入力端P0乃至
P3に印加される次の数字を読取れる様にする。
この様にカウンタ１７５がゼロ以外のある数値に
セツトされると、その端子からの論理１を出
力する。このためゲート１８４の出力は論理１に
戻る。リード線７８に次の正クロツクパルスが伝
わると、フリツプフロツプ１８１は復元され、そ
の出力Ｑは１に、また出力は０になる。出力端
Ｑに現われる論理１はカウンタ１６５を刻時して
次のカウントに送る。カウンタ１６５の出力Q0
が高い時カウンタ１７５が３カウント間セツトさ
れ、出力Q2が高い時７カウント間セツトされ、
出力Q3が高い時１カウント間セツトされ、また
Q4が高い時、ゼロカウント間セツトされる様に、
カウンタ１６５からカウンタ１７５の各プリセツ
ト入力端に信号が印加される。 タイマは最初の0.625ミリ秒だけ遅延して送信
を行わない様に作動する。カウンタ１６５の出力
Q0が高値になる次のタイマ間隔は2.5ミリ秒であ
るがこれはプリアンブルパターン1110を送信する
ことができる４ビツトの長さに相当する。また次
のタイマ間隔で16ビツトの送信時間に相当する10
ミリ秒が得られる。カウンタ１７５はこの10ミリ
秒間に順序付けされて識別シーケンス発生器９８
内にプログラム編成された16個の異なるビツトを
選択する。これらのビツトはシーケンス発生器９
８からゲート１７０及び１７１を通つてハミング
発生器９５に送出されると共にリード線９９Ａ及
びゲート２１０と２１３を通つてマンチエスタ変
調器８３に送出される。 タイマが与える次の５ミリ秒間にデータはハミ
ング発生器９５からゲート２１１及び２１３を通
つて変調器８３の制御ゲート１９８にシフトアウ
トされる。 タイマ７６の全状態で構成される全応答は夫々
フレームと呼ばれており、プロセス内のフレーム
の数はフレームカウンタ７５に蓄積される。全部
で32個のフレームを蓄積することができ、33番目
のフレームの間にパルスが発生してタグを送信モ
ードから受信モードに戻す。 マンチエスタ変調器は各フレーム間に変調され
るが、キヤリヤが擬似ランダム２進シーケンス応
答カウンタ８９からリード線９２を通つて送られ
る出力信号によつてゲートされているため、各フ
レーム間に変調キヤリヤ出力を発生することはな
い。カウンタ２０９で構成される応答カウンタ部
は、32番目のフレーム後を除いてタイマ７６の各
サイクルの間に漸減するダウンカウンタであり、
キヤリヤはダウンカウンタ２０９がゼロ状態にあ
る間だけマンチエスタ変調器の出力端に渡され
る。マンチエスタ変調器８３は、リード線１０６
に出力信号を送ると同時に、応答カウンタ８９の
リプルカウンタ２０３にクロツク信号を戻す。カ
ウンタ２０３は、フリツプフロツプ２０４，２０
５及び２０６で構成される擬似２進シーケンス回
路を順序付けする信号を発する前に変調器８３の
出力端から受信した信号を因数64で割る。応答カ
ウンタはフレーム終了時にゼロ状態になり、擬似
ランダム２進シーケンス発生器を構成するフリツ
プフロツプ２０４，２０５及び２０６から発生さ
れる乱数で再ロードされる。 第５図には示されていないが、タグ回路の受信
モード中にパワーアンプ駆動器１０７が、タグル
ープ６０をロードダウンしない様に高インピーダ
ンスを有することは理解されよう。 第１０Ａ図及び第１０Ｂ図は、入口装置１５の
受信部の詳細図である。入口受信部の回路段の構
成及び作動は、特に第８Ａ図を参照して説明した
タグ回路段と同一であるため、第１０Ａ図にはそ
のブロツク線図のみを示しておく。その他の類似
点もいくつかあるので同様の構成及び機能を有す
る部品については第８Ａ図の符号に「−１」を付
けてある。例えば第１０Ａ図のキヤリヤ包絡線検
波器６２−１は第８Ａ図の検波器６２と同一であ
る。従つてスイツチ３１をオンにした受信モード
中に入口受信部が信号を受信すると、キヤリヤ包
絡線検波器６２−１、低域フイルタ６３−１及び
遷移検波器６４−１はこれらの入力信号を検査し
て遷移パルスに変える。検波器６４−１から出さ
れる出力は、導線６５−１を通つてゲート１２４
−１の第１入力端に印加される。ゲート１２４−
１の第２入力端はインバータ３００の出力端に接
続されており、インバータ３００の入力端は接合
点３０１に接続されている。これらの接続の詳細
を以下に示す。 第１０Ｂ図の入口受信部は、第８Ｂ図のクロツ
ク・データセパレータ６６とほぼ同一のクロツ
ク・データセパレータ３０２を有している。主な
相違点は、10進カウンタ・デイバイダ１３０−１
のクロツク入力を供給する回路部品にある。即ち
第１０Ｂ図に示す様に、10進装置１３０−１のク
ロツク入力端はＤ型フリツプフロツプ３０３の出
力端Ｄに接続されており、また該フリツプフロツ
プの端子Ｄととは相互接続されて分周器を構成
している。フリツプフロツプ３０３のクロツク入
力端には第１０Ａ図に示すインバータ３０５の出
力端に接続されたリード線３０４からクロ
ツク信号が供給される。また該インバータの入力
端は水晶制御クロツク７７−１のクロツク出力線
７８−１に接続されている。従つて、第８Ｂ図に
示す回路の10進カウンタ・デイバイダ１３０に供
給されるクロツク周波数は四分されるが、第１０
Ｂ図に示す回路のこれに匹敵するクロツク周波数
は二分されるだけである。識別タブ送信部のボー
速度は入口送信部の２倍であることからしてその
理由は自明である。入口送信部のボー速度が低い
のは、第６図に示す該送信部のクロツク１７と２
進カウンタ３６との間に追加のフリツプフロツプ
３５が配設されているからである。 入口受信部のクロツク・データセパレータ３０
２とタグ受信部のセパレータとの他の相違点は、
前者のゲート１３８−１の一入力端をフレームカ
ウンタの出力端に接続する代りにリード線３０６
を介して処理装置（P.U.）３０７の出力端に接
続している点にある。またリード線３０６は抵抗
器３０８を介して論理０電位レベルに接続されて
いる。従つて処理装置３０７から論理１が出力さ
れない場合は、リード線３０６は論理０値とな
り、処理装置が論理１電圧レベルを出力すると、
これは論理１値に変わる。その他の点については
クロツク・データセパレータ３０２の構成及び機
能はクロツク・データセパレータ６６と同一であ
る。 セパレータ３０２は適切なクロツク及びデータ
パルスを受信すると、これらを識別シーケンス認
識回路３０９に渡す。回路３０９は第８Ｂ図に示
す質問シーケンス認識回路６７と同様の多くの構
成部品を有しているため、これらが同一のもので
ある限りは、同一符号に「−１」を付けてある。
識別シーケンス認識回路３０９が推定識別タグか
ら到来する信号を検査できる様にするため、可能
タグから受信される最初の４ビツト即ちプリアン
ブルをビツト単位で比較する回路が設けられてい
る。これは4017型10進カウンタ・デイバイダ３１
０と4016型４連アナログスイツチとを組合せ前者
の出力端Q0乃至Q3を後者の４区分３１１，３１
２，３１３及び３１４の制御入力端に接続するこ
とによつて得られる。スイツチ部３１１，３１２
及び３１３のIN端子は相互接続されてゲート１
５２−１の出力端に接続されており、一方スイツ
チ部３１４の入力端はゲート１５１−１の出力端
に接続されている。スイツチ部３１１乃至３１４
の出力端は全て相互接続され、抵抗器３１５を介
して論理１電位レベルに接続されている。抵抗器
３１５とスイツチ出力端との間の接合点はゲート
１５９−１の第１入力端に接続されている。カウ
ンタ３１０のリセツト端子は、クロツク・データ
セパレータ３０２のフリツプフロツプ１２９−１
の出力端に接続されている。カウンタ３１０の
クロツク作動可能（）端子は、その出力端Q4
及び24ビツトシフトレジスタ３１８のインバータ
３１７に接続された出力端３１６に接続されてい
る。レジスタ３１８は図示の様に縦列接続された
３個の4015型双対４ビツト静止シフトレジスタで
構成されている。第14ビツトレジスタ３１９のデ
ータ入力端即ちＤは、リード線３２０を介して識
別シーケンス認識回路３０９のゲート１５２−１
の出力端に接続されている。レジスタ３１８を構
成するシフトレジスタ部のクロツク入力端は全て
相互接続されて、クロツク・データセパレータ３
０２のフリツプフロツプ１２８−１の出力端Ｑに
接続されたリード線１４３−１に接続され、リセ
ツト端子は相互接続されてインバータ３１７の出
力端に接続されており、また出力端Ｑは、情報を
並列転送する様に、ケーブル線３２１を介して処
理装置３０７に接続されている。処理装置には、
先にレジスタ３１８にシフトインされた符号化メ
ツセージを受信して後続の処理を行う適宜のバツ
フア及びレジスタが周知要領で設けられている。 入力メツセージをビツト単位で計時するため、
２個の4022型８進カウンタ・デイバイダ回路３２
３及び３２４で構成される24ビツトカウンタ３２
２が設けられている。カウンタ３２３のキヤリー
アウト端子は、カウンタ３２４のクロツク端子に
接続されているため、カウンタ３２３は各８進パ
ルスをカウンタ３２４に送る。またカウンタ３２
４の出力端Q3は接合点３０１に接続されている。
カウンタ３２３と３２４とはこの要領で24個の入
力パルスに対して１個の出力パルスを発生する。
カウンタ３２３と３２４とのリセツト端子はイン
バータ３１７の出力端に接続されているため、24
ビツトカウンタ３２２は24ビツトシフトレジスタ
３１８と同時にリセツトされる。カウンタ３２３
と３２４とのクロツク作動可能端子は、図示の様
に論理０電位レベルに続されているため、これら
のカウンタのリセツト端子にリセツト信号が印加
されない場合は作動可能状態に保持されて計数す
ることができる。 24ビツトカウンタ３２２から信号出力を印加さ
れる接合点３０１は、処理装置３０７の入力端及
び接合点３０１に接続された上記の部品に接続さ
れており、これらは全て第１０Ｂ図に明示されて
いる。 入口装置の受信部の作動を具像化する便宜上、
第１０Ａ図及び第１０Ｂ図と同一符号を付した第
４図のブロツク線図を参照されたい。入口装置受
信部は以下の様に作動する。即ち識別シーケンス
認識回路３０９は最初の４個の妥当な受信パルス
をビツト単位で比較して、これらが方式の一部を
構成する識別タグの固定識別コードを構成する
1110パターンに従つているか否かを調べる。入力
信号がこの特定要件を満たしていると、カウンタ
３１０はカウント“４”に到達し、その出力Q4
が論理１となる。該出力端はその入力端CEにフ
イードバツク接続されているため、カウンタ３１
０の計数作用を禁止する。出力Q4は、さらにイ
ンバータ３１７を介して、シフトレジスタ３１８
のレジスタ部及びカウンタ３２２のカウンタ部か
らリセツト信号を除去する役目もする。このため
追加の妥当な24ビツトを受信すると、これらは順
次にシフトレジスタ３１８にシフトされると共
に、24ビツトカウンタ３２２に送られて計数され
る。カウンタ３２２は24ビツトを受信して論理１
を出力し、処理装置に信号を送つて、レジスタ３
１８から信号を転送するケーブル線３２１から信
号を受信できる様にする。 これと同時に接合点３０１の信号は、ゲート１
２４−１と７０−１、リセツトキヤリヤ包絡線検
波器６２−１、低域フイルタ６３−１及び遷移検
波器６４−１をブロツクする。さらにシフトレジ
スタ３１８から処理装置３０７への全メツセージ
の転送を妨害する信号受信は、処理装置３０７が
ケーブル線３２１を介してメツセージを受信し終
えるまでブロツクされる。この機能を完了する
と、処理装置３０７は論理１出力をリード線３０
６に送り、ゲート１３８−１を介してフリツプフ
ロツプ１２９−１にリセツト信号を印加する。リ
セツト信号はカウンタをリセツトしてその出力
Q4を論理０に戻すことにより、シフトレジスタ
３１８及びカウンタ３２２をリセツトする。この
ため接合点３０１の信号は論理０レベルに戻り、
第１０Ａ図及び第１０Ｂ図に示す入口受信部の部
品を受信モードに復元する。さらにタイマ２４が
設定した受信モード期間中に識別タグから連続メ
ツセージを受信する。入口受信部はこの受信モー
ド期間中に１個以上のタグから識別信号を受信す
るが、これらの信号の受信は各タグの擬似ランダ
ム発生器の出力に応じて、ランダムに選択された
異なる期間中に行われるため、信号の大半は干渉
しあわないことが理解されよう。上記の様にタグ
からの各全送信サイクルには、識別信号を送信で
きる32個の可能なタイムスロツトが設けられてい
るが、所定のタグを送信するには、少くとも４個
で一般に８個以下のタイムスロツトで済む。タグ
は全て入口質問信号と同期化されているため、
夫々の送信期間はほぼ同時に始まる。各タグから
少くとも数回の応答がある場合、異なるタイムス
ロツト中に各タグから信号が送信される可能性は
極めて高い、各識別タグが独自の識別信号パター
ンを有していることからして、入口受信部の処理
装置３０７は各受信信号群を識別し、特定のタグ
と関連付けることができる。処理装置によるその
他の妥当性の検査については所望に応じて達成す
ることができる。 信号をランダムに送信するため、１個以上のタ
グから同時に送信されることがある。使用する信
号には、タグから送られて来るキヤリヤ信号が位
相はずれしていると、入口受信部のキヤリヤ包絡
線検波器、低域フイルタ及び遷移検波器を通らな
いため、通常プリアンブルが完全に抹消されたり
ひずんだりして欠損する性質がある。しかし、複
数個のタグから送られて来るキヤリヤ信号を充分
位相合わせすることにより、遷移検波器ばかりで
なくクロツク・データセパレータを通して識別シ
ーケンス認識回路３０９に信号を送ることができ
る。各タグから送られるプリアンブルが回路３０
９に入りプリアンブル検査に通るとシフトレジス
タ３１８が作動して送信信号の後続部を受ける様
になる。識別コードはタグによつて違うため、無
効制御をしないとレジスタ３１８は誤伝識別タグ
を受入れてしまうが、入口受信部の独自の回路部
品でこの様な不詳事を阻止している。 第１１図はプリアンブルの位相が合つたタグＡ
及びＢから同時に応答を送信する可能な状態を示
している。識別コード（このうち最初の数ビツト
だけを図示する）は相違していると思われる。２
つのタグから送られる信号を合計すると、ほぼ
（Ａ＋Ｂ）で示す線の様になる。コードが異なる
領域ではクロツク信号ぎ欠損していることがわか
る。従つて符号４００付近で信号が発生すると、
クロツク信号が抹消されているのでカウンタ１３
０−１はカウント“９”に達し、その出力Q9が
１となつて回路をリセツトすることにより、別の
妥当なプリアンブルを受信するまで受信できない
様にする。しかし送信間隔はランダムに選択され
ているため各タグからの送信信号は上記要領で受
信される。 要約すると本発明は、特定のデジタルコード形
式を用いて入口装置即ち監視局と識別タグとの間
の通信を成立させようとするものである。変調器
が用いるコード化構成は、マンチエスタとも呼ば
れている２相マークコーデイングとして知られて
いる。この種のコーデイングは、論理１がビツト
セルの中間に第２遷移を有するが論理０は有さな
いという特徴があり、形式内の２つの異なるコー
ドパターンを合計すると、自蔵のクロツク速度遷
移が少くともある程度抹消するという特徴を有す
る電信方式の一種であり、上記の様にこの特徴を
活かして１つ以上の信号源から同時に受信する信
号を拒絶する訳である。 図には１台の入口装置しか示してないが、病院
等の施設では何百という複数台の入口装置を設
け、これらを１台以上の中央処理装置（CPU）
と相互接続することにより、最終的な記録保持及
び管理機能を達成できることを理解されたい。入
口装置がタグを識別できると同時に、中央処理装
置は入口装置を識別することができる。CPUは
周知の多重送信構成を用いて各入口処理装置から
記憶情報を順次に引き出すことができ、こうして
CPUは各識別タグの所在に関する情報を得てい
る。 入口装置の送信部は、入口装置から発せられた
信号を受信する全ての識別タグを総称的に表わす
プリアンブルから成る質問信号を連続的に発す
る。また入口装置の質問信号には該装置を設置し
た特定の病院その他の施設を表わすコード標識が
含まれており、その病院又は施設に対して符号化
されたタグだけが質問に応答する。 質問範囲に入る全てのタグは、質問信号の妥当
性を検査する。信号は認められると、所定のタグ
に対して全て同一の複数の応答を送信期間中にラ
ンダムに選択して間隔で送信する応答送信の開始
を同期化する役目をする。本実施例では夫々約
19.375ミリ秒継続する32個の送信タイムスロツト
を設けているが、入口装置とタグとの間の通信に
利用できる時間及び使用するビツト速度に応じて
タイムスロツトの数を変えられるのは勿論であ
る。またビツト速度を変えるには水晶時計の周波
数を変えれば良い。このため本方式は“ｔ”時間
継続する“ｎ”個のタイムスロツトを配備できる
ものと考えることができる。 ここに記載したタグ回路は擬似ランダムシーケ
ンス発生器を用いている。真ランダム発生源を利
用することもできるが、その必要はない。しか
し、擬似ランダム発生器から応答カウンタに向う
７桁出力の周波数を変えることは有益であるの
で、タグから送信する１回の全サイクル間に必要
とされる平均応答数に応じて選択すれば良い。 各タグは入口送信部との混線を避けると共に、
タグから信号を受信する入口装置に対する総称的
識別子として作用する様に設計された固定された
４ビツトのプリアンブル1110から成る28ビツトメ
ツセージで応答する。タグは入口受信部を同期化
して、タグ識別コード及びリチヤードハミング
（Richard Hamming）が開発した原理に基づく
誤り検査コードを有する次の24ビツトを受信でき
る様に作用する。 上記の通り監視局と複数個のタグ回路との間の
通信を確立する方式に関し、本発明を説明した
が、その原理を広範に応用できることを理解され
たい。即ち、同一時間内に全てのトランスポンダ
回路に質問したい場合に質問局と複数個のトラン
スポンダ回路との間の同時通信を確立する方式は
これらの原理を基にしている。この場合トランス
ポンダ回路はタグ回路に相当し、また質問局は監
視局に相当する。 また特定実施例に関して本発明を説明したが、
添付の特許請求の範囲で限定する本発明の真意か
ら逸脱することなくその構成及び作動を種々に変
更できることは理解されよう。同じ機能を果たす
多くの等価のソリツドステート素子があり、また
本発明では個別の論理素子を用いたが、周知技法
によつて同一回路部品又は等価素子を集積するこ
とができる。実際現用のマイクロコンピユータチ
ツプは、複数の等価の機能を果たす様にプログラ
ム編成することができ、これらの変形は全て本発
明の範ちゆうに入るものと考えられる。
第１図は、本発明を活用する環境の概略図であ
る。第２図は、本発明の実施例の基本素子のブロ
ツク線図である。第３図は、第２図に示す質問送
受信入口装置の質問送信部のブロツク線図であ
る。第４図は、第２図に示す入口装置の質問受信
部のブロツク線図である。第５図は、第２図に示
す方式の識別タグに組込まれる回路のブロツク線
図である。第６図は、第３図に示す素子の概略的
論理図である。第７図は、装置の作動の説明に有
益なタイミング図である。第８Ａ図及び第８Ｂ図
は、第５図に示す方式の受信部に示す素子の概略
的論理図であ。第９Ａ図及び第９Ｂ図は、第５図
に示す方式の送信部に示す素子の概略的論理図で
ある。第１０Ａ図及び第１０Ｂ図は、第４図に示
す素子の概略的論理図である。及び第１１図は２
つのタグからの送信信号の最初の部分、及び入口
受信部に発生する応答信号の概略図である。 主要部分の符号の説明、１３，１４……識別タ
グ、１５……入口装置（質問送受信部）、１７…
…水晶制御クロツク、１９……２相マーク変調
器、２０……低域フイルタ・パワーアンプ、２２
……入口ループ、２３……２相発生器、２４……
タイマ、２６……識別コード発生器、６０……タ
グループ、６１……プリアンプ・フイルタ、６
２，６２−１……キヤリヤ包絡線検波器、６３，
６３−１……低域フイルタ、６４，６４−１……
遷移検波器、６６……クロツク・データセパレー
タ、６７……質問シーケンス認識回路、７５……
フレームカウンタ、７６……タイマ、７７，７７
−１……水晶制御クロツク、８３……マンチエス
タ変調器、８４……２相発生器、８９……擬似ラ
ンダム２進シーケンス応答カウンタ、９５……ハ
ミング発生器、９８……識別シーケンス発生器、
１００……シーケンス制御回路、１０７……パワ
ーアンプ駆動器、３０２……クロツク・データセ
パレータ、３０７……処理装置、３０９……識別
シーケンス認識回路、３１８……24ビツトシフト
レジスタ、３２２……24ビツトカウンタ。
る。第２図は、本発明の実施例の基本素子のブロ
ツク線図である。第３図は、第２図に示す質問送
受信入口装置の質問送信部のブロツク線図であ
る。第４図は、第２図に示す入口装置の質問受信
部のブロツク線図である。第５図は、第２図に示
す方式の識別タグに組込まれる回路のブロツク線
図である。第６図は、第３図に示す素子の概略的
論理図である。第７図は、装置の作動の説明に有
益なタイミング図である。第８Ａ図及び第８Ｂ図
は、第５図に示す方式の受信部に示す素子の概略
的論理図であ。第９Ａ図及び第９Ｂ図は、第５図
に示す方式の送信部に示す素子の概略的論理図で
ある。第１０Ａ図及び第１０Ｂ図は、第４図に示
す素子の概略的論理図である。及び第１１図は２
つのタグからの送信信号の最初の部分、及び入口
受信部に発生する応答信号の概略図である。 主要部分の符号の説明、１３，１４……識別タ
グ、１５……入口装置（質問送受信部）、１７…
…水晶制御クロツク、１９……２相マーク変調
器、２０……低域フイルタ・パワーアンプ、２２
……入口ループ、２３……２相発生器、２４……
タイマ、２６……識別コード発生器、６０……タ
グループ、６１……プリアンプ・フイルタ、６
２，６２−１……キヤリヤ包絡線検波器、６３，
６３−１……低域フイルタ、６４，６４−１……
遷移検波器、６６……クロツク・データセパレー
タ、６７……質問シーケンス認識回路、７５……
フレームカウンタ、７６……タイマ、７７，７７
−１……水晶制御クロツク、８３……マンチエス
タ変調器、８４……２相発生器、８９……擬似ラ
ンダム２進シーケンス応答カウンタ、９５……ハ
ミング発生器、９８……識別シーケンス発生器、
１００……シーケンス制御回路、１０７……パワ
ーアンプ駆動器、３０２……クロツク・データセ
パレータ、３０７……処理装置、３０９……識別
シーケンス認識回路、３１８……24ビツトシフト
レジスタ、３２２……24ビツトカウンタ。
Claims (1)
- 【特許請求の範囲】 １ 監視局範囲に入る１個または複数個の個別タ
グ回路群を検出すると共に、監視範囲に同時に入
る１個以上のタグ回路を識別する通信方式であつ
て、 監視局に配設されて監視局の識別コードである
第１コードパターンを含む質問信号を発する手
段； 監視局範囲に入ると質問信号を受信する手段
と、 質問信号に応答すると共に、第１コードパター
ンと異なりかつタグ回路の識別コードである第２
コードパターンを含む一連の応答信号を発する手
段と少くとも擬似ランダム要領で連続する応答信
号の間隔を変える手段とを備える手段、 とを有するタグ回路； 及び監視局に配設されて監視範囲に入る信号を
受信して検査することにより、信号がタグの識別
コードである所定のコードパターンを有している
か否かを決定し、前記コードパターンを有する場
合に限り、受信信号を処理装置に送る手段から成
ることを特徴とするタグ回路用通信方式。 ２ 特許請求の範囲第１項に記載の方式であつ
て、前記質問信号発生手段が、信号の発生を停止
し、その間にタグから複数の応答信号を受信する
充分な間隔に続いて周期的に質問信号発生サイク
ルに入れる様にするタイミング素子を備えること
を特徴とするタグ回路用通信方式。 ３ 特許請求の範囲第２項に記載の方式であつ
て、前記タグ回路が応答信号を発生する“ｔ”時
間継続する“ｎ”個のタイムスロツトを確立する
手段を含み、１回の全作動サイクルの間に実際に
発生する応答信号の数は全サイクルの間に確立さ
れる擬似ランダム間隔の関数であり、また前記質
問信号発生手段による無信号期間が少くともｎ×
ｔに等しいことを特徴とするタグ回路用通信方
式。 ４ 特許請求の範囲第１項に記載の方式であつ
て、一連の応答信号を発生する前記手段が、キヤ
リヤ周波数信号源及びキヤリヤ信号を前記応答信
号連で変調する手段を備え、また連続する応答信
号の間隔を変える前記手段が変調手段の出力端に
接続されたクロツク入力端を有する擬似ランダム
２進シーケンス発生器を備えることを特徴とする
タグ回路用通信方式。 ５ 特許請求の範囲第４項に記載の方式であつ
て、連続する応答信号の間隔を変える前記手段が
さらに、プリセツト自在の２進ダウンカウンタ、
ダウンカウンタがカウントゼロに達すると、ダウ
ンカウンタを擬似ランダム発生器に接続すること
によつてダウンカウンタを擬似ランダム発生器内
にその時存在するカウントにプリセツトする手
段、及び応答信号を発生する“ｎ”個のタイムス
ロツトの度にダウンカウンタを刻時して、ダウン
カウンタがカウントゼロに達する各タイムスロツ
トの間に応答信号を発する手段を備えることを特
徴とするタグ回路用通信方式。 ６ 特許請求の範囲第５項に記載の方式であつ
て、前記タグ回路が夫々“ｔ”時間継続する
“ｎ”個のタイムスロツトを確立する手段を有し、
また質問信号発生手段による無信号発生期間が少
くともｎ×ｔに等しいことを特徴とするタグ回路
用通信方式。 ７ 特許請求の範囲第２項に記載の方式であつ
て、質問信号を発生する前記手段が、第１コード
パターンを形成し、かつ監視局からの信号を総称
的に示す第１プリアンブルコードパターン及び特
定の監視局を識別する第１のプリセツト自在のコ
ードパターンから成るコードパターンを発生する
様に構成配置された手段を備えることを特徴とす
るタグ回路用通信方式。 ８ 特許請求の範囲第７項に記載の方式であつ
て、応答信号連を発生する前記手段が、タグ回路
からの信号を総称的に表わすと共に第１プリアン
ブルコードパターンと異なる第２プリアンブルコ
ードパターン及び特定のタグ回路を特異的に識別
する第２のプリセツト自在のコードパターンを含
む第２コードパターンを発生する様に構成配置さ
れた手段を備えることを特徴とするタグ回路用通
信方式。 ９ 監視局範囲に入る１個または複数個の個別タ
グ回路群を検出すると共に、監視範囲に同時に入
る１個以上のタグ回路を識別する通信方式であつ
て、 監視局に配設された監視局の識別コードである
第１コードパターンを含む質問信号を発生する手
段； 監視局範囲に入ると質問信号を受信する手段、 質問信号を検査して第１コードパターンがプリ
セツト質問コードパターンに相当するか否かを決
定する手段、 質問信号の検査からパターンが一致することが
判つた場合に限り質問信号に応答すると共に、第
１コードパターンと異なりかつその識別コードで
ある所定の第２コードパターンを含む一連の応答
信号を発生する手段、及び少くとも擬似ランダム
要領で連続する応答信号の間隔を変える手段、 から成る手段とを備えるタグ回路； 及び監視局に配設されて、監視範囲に入る信号
を受信検査して信号がタグの識別コードである所
定のコードパターンを有するか否かを決定し、前
記コードパターンが存在する場合に限り受信信号
を処理装置に送る手段から成ることを特徴とする
タグ回路用通信方式。 １０ 監視局範囲に入ると同時に監視範囲に入つ
た他のタグ回路とは別に監視局と通信して識別信
号を送るタグ回路であつて、 監視範囲に入ると、監視局から第１コードパタ
ーンを含む質問信号を受信する手段と 質問信号に応答すると共に、第１コードパター
ンと異なりかつタグ回路の識別コードである所定
の第２コードパターンを含む一連の応答信号を発
生する手段と少くとも擬似ランダム要領で連続す
る応答信号の間隔を変える手段とを備える手段； から成ることを特徴とするタグ回路。 １１ 特許請求の範囲第１０項に記載の回路であ
つて、さらに応答信号を発する“ｔ”時間継続す
る“ｎ”個のタイムスロツトを確立する手段から
成り、また１回の全作動サイクル中に実際に発せ
られる応答信号の数が全サイクル中に確立される
擬似ランダム間隔の関数であることを特徴とする
タグ回路。 １２ 特許請求の範囲第１０項に記載の回路であ
つて、前記応答信号連発生手段が、キヤリヤ周波
数信号源及びキヤリヤ信号を応答信号連で変調す
る手段を備え、また連続応答信号の間隔を変える
前記手段が、変調手段の出力端に接続された入力
端を有する擬似ランダム２進シーケンス発生器を
備えることを特徴とするタグ回路。 １３ 特許請求の範囲第１２項に記載の回路であ
つて、連続する応答信号の間隔を変える前記手段
がさらに、プリセツト自在の２進ダウンカウン
タ、ダウンカウンタがカウントゼロに達すると、
ダウンカウンタを擬似ランダム発生器に接続して
ダウンカウンタを擬似ランダム発生器内にその時
存在するカウントにプリセツトする手段、及び応
答信号を発する“ｎ”個のタイムスロツトの度に
ダウンカウンタを刻時してダウンカウンタがカウ
ントゼロに達する前記タイムスロツトの度に応答
信号を発生する手段とを備えることを特徴とする
タグ回路。 １４ 特許請求の範囲第１３項に記載の回路であ
つて、前記タグ回路が夫々“ｔ”時間継続する
“ｎ”個のタイムスロツトを確立する手段を含み、
また質問信号発生手段による無信号発生期間が少
くともｎ＋ｔに等しいことを特徴とするタグ回
路。 １５ 特許請求の範囲第１０項に記載の回路であ
つて、前記応答信号連発生手段が、タグ回路から
送られてくる信号を総称的に表わすプリアンブル
コードパターン及び特定のタグ回路を特異に識別
するプリセツト自在のコードパターンを含むコー
ドパターンを発生する様に構成配置された手段を
含むことを特徴とするタグ回路。 １６ 特許請求の範囲第１５項に記載の回路であ
つて、前記応答信号連発生手段がさらに各応答信
号にプリセツト自在のコードパターンに関係する
誤り訂正コードパターンを付加する手段を含むこ
とを特徴とするタグ回路。 １７ 特許請求の範囲第１６項に記載の回路であ
つて、前記誤り訂正コードパターン付加手段がハ
ミング発生器であることを特徴とするタグ回路。 １８ 監視局範囲に入ると、同時に監視範囲に入
る他のタグ回路とは別に監視局と通信してこれに
識別信号を送るタグ回路であつて、 監視範囲に入る際に監視局から第１コードパタ
ーンを含む質問信号を受信する手段； 質問信号を検査して第１コードパターンがプリ
セツト質問コードパターンに相当するか否かを決
定する手段； 及び検査によりパターンが一致する場合に限り
質問信号に応答すると共に、第１コードパターン
と異なりかつそのタグ回路の識別コードである所
定の第２コードパターンを含む一連の応答信号を
発する手段と少くとも擬似ランダム要領で連続す
る応答信号の間隔を変える手段とを備える手段； から成ることを特徴とするタグ回路。 １９ 監視局範囲に入る１個または複数個の個別
タグ回路群を検出すると共に、監視範囲に同時に
入る１個以上のタグ回路を識別する通信方式であ
つて、 監視局に配設されて監視局を表わす質問信号を
発する手段； 監視範囲に入ると質問信号を受信する手段と、 質問信号に応答すると共に、各タグ回路の識別
コードである所定のコードパターンを含む一連の
応答信号を発する手段と少くとも擬似ランダム要
領で連続する応答信号の間隔を変える手段とを有
する手段、 とを備える複数個のタグ回路； 及び監視局に配設されて監視範囲に入る信号を
受信すると共に、他のタグ回路からの応答信号と
同時に一タグ回路から監視局に到達する応答信号
を何れも拒絶する手段から成ることを特徴とする
タグ回路用通信方式。 ２０ 特許請求の範囲第１９項に記載の方式であ
つて、監視局にある前記信号受信手段が、受信信
号に存在するコードパターン遷移の発生を計時す
る手段、及び前記手段に応答してコードパターン
遷移が応答信号クロツク速度に相当する所定の計
時間隔で発生しない場合に信号を拒絶する手段と
を備えることを特徴とするタグ回路用通信方式。 ２１ 質問局と複数個のトランスポンダ回路との
間を同時に連絡する通信方式であつて、 質問局に配設された質問信号を送信する手段； 質問信号を受信する手段と、 質問信号に応答すると共に、各トランスポンダ
回路と関連しかつ２つの異なるコードパターンを
合計すると自蔵のクロツク速度遷移が少なくとも
ある程度消滅する電信形式に基づく所定のコード
パターンを含む一連の応答信号を送信する手段と
少くとも擬似ランダム要領で各トランスポンダ回
路から出される連続する応答信号の間隔を変える
手段とを有する手段、 とを備える複数個のトランスポンダ回路； 及び質問局に配設されて、トランスポンダ回路
からの送信信号を受信すると共に、他のトランス
ポンダ回路からの応答信号と同時に一トランスポ
ンダ回路から質問局に到達する応答信号を何れも
拒絶する手段から成ることを特徴とする通信方
式。 ２２ 特許請求の範囲第２１項に記載の方式であ
つて、質問局に配設された前記受信手段が受信信
号に存在するコードパターン遷移の発生を計時す
る手段、及び前記手段に応答して自蔵のクロツク
速度遷移が消滅すると何れの信号も拒絶する手段
を備えることを特徴とする通信方式。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US354156 | 1982-03-05 | ||
| US06/354,156 US4471345A (en) | 1982-03-05 | 1982-03-05 | Randomized tag to portal communication system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58162881A JPS58162881A (ja) | 1983-09-27 |
| JPH032271B2 true JPH032271B2 (ja) | 1991-01-14 |
Family
ID=23392089
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58034727A Granted JPS58162881A (ja) | 1982-03-05 | 1983-03-04 | タグ回路及びそれを用いる通信方式 |
Country Status (15)
| Country | Link |
|---|---|
| US (1) | US4471345A (ja) |
| JP (1) | JPS58162881A (ja) |
| AR (1) | AR231364A1 (ja) |
| BE (1) | BE895864A (ja) |
| BR (1) | BR8301091A (ja) |
| CA (1) | CA1211522A (ja) |
| DE (1) | DE3305685C2 (ja) |
| ES (1) | ES8407270A1 (ja) |
| FR (1) | FR2522829B1 (ja) |
| GB (1) | GB2116808B (ja) |
| IE (1) | IE830193L (ja) |
| IT (2) | IT8309358A1 (ja) |
| MX (1) | MX155097A (ja) |
| NL (1) | NL8300643A (ja) |
| SE (1) | SE456278B (ja) |
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