JPH0320091B2 - - Google Patents
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- JPH0320091B2 JPH0320091B2 JP58014779A JP1477983A JPH0320091B2 JP H0320091 B2 JPH0320091 B2 JP H0320091B2 JP 58014779 A JP58014779 A JP 58014779A JP 1477983 A JP1477983 A JP 1477983A JP H0320091 B2 JPH0320091 B2 JP H0320091B2
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- oscillation
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Links
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L3/00—Starting of generators
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
- H03B2200/00—Indexing scheme relating to details of oscillators covered by H03B
- H03B2200/006—Functional aspects of oscillators
- H03B2200/0082—Lowering the supply voltage and saving power
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
- H03B2201/00—Aspects of oscillators relating to varying the frequency of the oscillations
- H03B2201/02—Varying the frequency of the oscillations by electronic means
- H03B2201/0208—Varying the frequency of the oscillations by electronic means the means being an element with a variable capacitance, e.g. capacitance diode
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
- H03B5/00—Generation of oscillations using amplifier with regenerative feedback from output to input
- H03B5/30—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator
- H03B5/32—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator being a piezoelectric resonator
- H03B5/36—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator being a piezoelectric resonator active element in amplifier being semiconductor device
- H03B5/366—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator being a piezoelectric resonator active element in amplifier being semiconductor device and comprising means for varying the frequency by a variable voltage or current
Landscapes
- Oscillators With Electromechanical Resonators (AREA)
- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【発明の詳細な説明】
(イ) 産業上の利用分野
本発明は、直流電圧に応じて発振周波数が変化
する電圧制御型、もしくは直流電流に応じて発振
周波数が変化する電流制御型の発振回路に関する
もので、特に制御信号により自動的に、もしくは
停止スイツチの操作により発振停止を行い得る発
振回路に関する。 (ロ) 従来技術 入力基準信号に同期した信号を得る為に、最近
PLL（フエーズロツクドループ）回路が多用され
ている。例えば、入力コンポジツト信号から左右
ステレオ信号を得る為のステレオ復調回路は、入
力コンポジツト信号中に含まれる19KHzステレオ
パイロツト信号に同期した38KHzステレオスイツ
チング信号を作成する為に、第１図の如きPLL
回路が用いられている。第１図において、１は位
相比較回路、２は該位相比較回路１の出力信号中
の直流分を取り出すローパスフイルタ、３は該ロ
ーパスフイルタ２の出力直流分を増幅する直流増
幅回路、４は発振部５と振動子６と発振周波数制
御部７とから成り前記直流増幅回路３の出力直流
信号（電圧もしくは電流）に応じた周波数の発振
信号を発生する発振回路、及び８は該発振回路４
の発振信号を分周する分周回路で、入力端子９に
印加される入力信号に同期した発振信号を得るこ
とが出来る様に成されている。 しかして、AMチユーナ付のFMチユーナのス
テレオ復調回路に第１図のPLL回路を使用する
場合、AM受信時にビート妨害等を防止する為
に、発振回路４の発振を停止させる必要がある。
しかしながら、発振回路４の発振を停止させる為
に単に発振部５の動作停止のみを行うと、発振動
作の再開時に、発振部５に発振周波数制御回路７
の出力電流が流れ込み、起動不良等が生じるとい
う欠点を有していた。 (ハ) 発明の目的 本発明は、上述の点に鑑み成されたもので、発
振動作の停止及び再開を時間遅れなく短時間で行
い得る発振回路を提供することを目的とする。 (ニ) 発明の構成 本発明に係る発振回路は、発振停止スイツチの
停止動作に応じて発振部及び発振周波数制御部を
同時に停止させるとともに、前記発振停止スイツ
チの停止解除動作に応じて発振部を先に動作状態
にし、発振周波数制御部を遅れて動作状態にする
制御回路を有するものである。 (ホ) 実施例 第２図は、本発明の一実施例を示すもので、１
０は差動接続された第１及び第２トランジスタ１
１及び１２と、その共通エミツタに接続された定
電流トランジスタ１３と、前記第１トランジスタ
１１のベースと前記第２トランジスタ１２のコレ
クタとの間に接続されたコンデンサ１４と、前記
第１及び第２トランジスタ１１及び１２のコレク
タ間に接続されたダイオード１５及びトランジス
タ１６から成る電流ミラー回路１７とを含む発振
部、１８は該発振部１０の第２トランジスタ１２
のコレクタとアースとの間に接続された水晶振動
子等の振動子、１９は差動接続された第３及び第
４トランジスタ２０及び２１と、その共通エミツ
タに接続された定電流トランジスタ２３と、前記
第３トランジスタ２０のベース・コレクタ間に接
続されたコンデンサ２４と、前記第３及び第４ト
ランジスタ２０及び２１のベース間に接続された
抵抗２５と、前記第３及び第４トランジスタ２０
及び２１のコレクタ間に接続されたダイオード２
６及びトランジスタ２７から成る電流ミラー回路
２８とを含む発振周波数制御部、２９は導通時に
発振回路の発振動作を停止させる発振停止スイツ
チ、及び３０は一端が前記発振停止スイツチ２９
に接続されたコンデンサ３１と、該コンデンサ３
１の一端と電源３２との間に接続された第１抵抗
３３と、前記コンデンサ３１の他端と前記電源３
２との間に接続された第２抵抗３４と、ベースが
前記電源３２にエミツタが電流制限抵抗３５を介
して前記コンデンサ３１の一端に接続された第１
制御トランジスタ３６と、ベースが前記コンデン
サ３１の他端にエミツタが電流制限抵抗３７を介
して前記コンデンサの一端に接続された第２制御
トランジスタ３８と、ベースが前記第１制御トラ
ンジスタ３６のコレクタにコレクタが発振部１０
の定電流トランジスタ１３のベースに接続された
第３制御トランジスタ３９と、ベースが第２制御
トランジスタ３８のコレクタにコレクタが発振周
波数制御部１９の定電流トランジスタ２３のベー
スに接続された第４制御トランジスタ４０とを含
む制御回路である。 しかして、前記発振部１０は、コンデンサ１４
の正帰還により発振を行う従来一般に使用されて
いるものであるから、その詳細な説明は省略す
る。また、発振周波数制御部１９は等価的に可変
容量となるものであり、コンデンサ２４の容量を
C1、抵抗２５の値をR1、第２及び第３トランジ
スタ２０及び２１から成る差動部の相互コンダク
タンスをgmとすれば、点Ａから見た等価容量Ｃ
は、 Ｃ＝C1R1gm ……(1) となる。前記相互コンダクタンスgmは、定電流
トランジスタ２３のコレクタ電流に応じて変化す
る。その為、前記定電流トランジスタ２３のベー
スに印加される直流信号を可変することにより、
等価容量Ｃの値を変えることが出来、振動子１８
と並列に等価可変容量が接続される結果、第１図
の直流増幅回路３の出力直流信号を定電流トラン
ジスタ２３のベースに印加することにより、発振
回路の発振周波数の可変が達成される。 いま、発振停止スイツチ２９が第２図の如く遮
断状態にあるとすれば、電源３２の電圧V1が第
１及び第２抵抗３３及び３４を介してコンデンサ
３１の両端に印加される。前記第１及び第２抵抗
３３及び３４の抵抗値を等しくR2とすれば、コ
ンデンサ３１の両端電圧は等しくV1となり、該
コンデンサ３１の充電は行なわれない。その場合
は、第１制御トランジスタ３６のベース・エミツ
タ間電圧及び第２制御トランジスタ３８のベー
ス・エミツタ間電圧は、略零となり両トランジス
タ３６及び３８はオフとなつている。その為、第
３及び第４制御トランジスタ３９及び４０もオフ
となり、制御回路３０は発振部１０及び発振周波
数制御部１９に対して何ら作用せず、発振回路は
安定に発振動作を継続する。 次に、時刻t1で発振停止スイツチ２９を導通状
態にしたとすれば、第３図に示す如く、点Ｂの電
圧が直ちに電源４１の電圧V2に上昇する。その
為、第１及び第２制御トランジスタ３６及び３８
が直ちにオンとなり、それに応じて第３及び第４
制御トランジスタ３９及び４０もオンとなる。第
３制御トランジスタ３９がオンになると、発振部
１０の定電流トランジスタ１３のベースが接地さ
れ、第１及び第２トランジスタ１１及び１２の動
作電流が流れなくなるので、前記発振部１０の動
作が停止する。同時に、第４制御トランジスタ４
０のオンにより、発振周波数制御部１９の定電流
トランジスタ２３のベースが接地され、第３及び
第４トランジスタ２０及び２１の動作電流が流れ
なくなり、前記発振周波数制御部１９の動作が停
止する。発振停止スイツチ２９が導通状態にある
間、その状態は持続され、発振回路の出力端子４
２に出力が発生しない。 時刻t2に、発振動作を再開させる為、発振停止
スイツチ２９を遮断したとすれば、電源４１が制
御回路３０から切り離され、コンデンサ３１の放
電が開始される。その時のコンデンサ３１の放電
電流Ｉは、 （ただし、C2はコンデンサ３１の容量） となる。また、その時の点Ｂの電圧VB及び点Ｃ
の電圧VCは、 VB＝V1＋IR2 ……(3) VC＝V1−IR2 ……(4) となるから、第(2)乃至第(4)式より、ｔ＝０とした
時の点Ｂ及び点Ｃの電圧は、 VB＝V1＋V2−V1／２ ……(5) VC＝V1−V2−V1／２ ……(6) となる。発振停止スイツチ２９の遮断後時間の経
過に従つて、点Ｂの電圧は、2C2R2の時定数でV1
に向つて低下し、時刻t3でV1となる。一方、点Ｃ
の電圧は、2C2R2の時定数でV1に向つて上昇し、
時刻t3でV1となる。従つて、ベースが電圧V1の
電源３２に、エミツタが点Ｂに接続された第１制
御トランジスタ３６のベース・エミツタ間電圧
が、ベースが点Ｃに、エミツタが点Ｂに接続され
た第２制御トランジスタ３８のベース・エミツタ
間電圧よりも先に立上り電圧以下となり、前記第
１制御トランジスタ３６が先にオフとなり、その
後第２制御トランジスタ３８がオフとなる。それ
故、第３制御トランジスタ３９が先にオフとな
り、発振部１０と振動子１８とによるフリーラン
発振が開始され、その後第４制御トランジスタ４
０のオフにより発振周波数制御部１９が動作を開
始し、出力端子４２に得られる出力発振信号が所
定の周波数となる。 仮りに、発振部１０と発振周波数制御部１９と
の動作が同時に開始される様に、第１乃至第４制
御トランジスタ３６乃至４０を同時にオフにする
と、第１図の位相比較回路１で生じているオフセ
ツトに起因する電流が前記第１乃至第４制御トラ
ンジスタ３６乃至４０のオフと同時に発振部１０
に流入し、発振回路が起動不良を生じる。すなわ
ち、前記第１乃至第４制御トランジスタ３６乃至
４０がオフすると、位相比較回路１の出力が発振
周波数制御部１９に印加されるが、該発振周波数
制御部１９が過渡状態にある為、そこから直流電
流が発生し、発振部１０に供給される。前記第１
乃至第４制御トランジスタ３６乃至４０がオフし
た直後には、発振部１０も過渡状態にあり、前記
発振周波数制御部１９の出力直流電流が供給され
ると、前記発振部１０の直流的バランスがくず
れ、発振の条件が整わず、起動不良を生じる。 それに対し、本発明の如く、発振部１０を先に
動作状態とすれば、該発振部１０が安定になつた
後に、発振周波数制御部１９の出力直流電流が発
振部１０に供給されるので、発振部１０が起動不
良を起こすのを防止し得る。ちなみに、第３図の
t2からt3迄の時間は、数十ｍ秒からせいぜい百ｍ
秒程度であり、従来回路の安定化時間数秒に比べ
十分に短くなつている。 第４図は、本考案に係る制御回路３０の別の実
施例を示すもので、第１制御トランジスタ３６の
ベースを第２制御トランジスタ３８のベースとと
もに点Ｃに接続し、かつ第１及び第２制御トラン
ジスタ３６及び３８のエミツタを共通接続すると
ともに、第３制御トランジスタ３９のエミツタに
電源４３を接続した点を特徴とする。尚、その他
の点は、第２図の制御回路と同一に付、同一の図
番を付して説明を省略する。第４図において、第
３制御トランジスタ３９は、点Ｂの電圧が電源４
３の電圧V3、第３制御トランジスタ３９のベー
ス・エミツタ間電圧VBE、第１制御トランジスタ
３６のコレクタ・エミツタ間電圧VCE、及び電流
制限抵抗３７の電圧降下VRの和電圧以下になる
とオフになる。一方、第４制御トランジスタ４０
は、該第４制御トランジスタ４０のベース・エミ
ツタ間電圧VBE、第２制御トランジスタ３８のコ
レクタ・エミツタ間電圧VCE、及び電流制限抵抗
３７の電圧降下VRの和電圧以下になるとオフに
なる。従つて、第３制御トランジスタ３９が先に
オフとなり、第２図の発振部１０が先に動作状態
となり、その後、第４制御トランジスタ４０がオ
フとなつて、発振周波数制御部１９が動作状態と
なる。尚、第３制御トランジスタ３９のエミツタ
に電源４３が設けられる為に、第４図の回路を使
用する場合には、第２図の発振部１０の定電流ト
ランジスタ１３のエミツタにも同一の電源を接続
する必要がある。 (ヘ) 発明の効果 以上述べた如く、本発明に依れば、発振回路の
発振部と発振周波数制御部とを同時に停止させる
とともに、発振部を先に発振周波数制御部をその
後に停止解除して動作状態にすることが出来るの
で、発振回路を時間遅れなく制御することが出
来、聴取者に異和感を与えないという利点を有す
る。
する電圧制御型、もしくは直流電流に応じて発振
周波数が変化する電流制御型の発振回路に関する
もので、特に制御信号により自動的に、もしくは
停止スイツチの操作により発振停止を行い得る発
振回路に関する。 (ロ) 従来技術 入力基準信号に同期した信号を得る為に、最近
PLL（フエーズロツクドループ）回路が多用され
ている。例えば、入力コンポジツト信号から左右
ステレオ信号を得る為のステレオ復調回路は、入
力コンポジツト信号中に含まれる19KHzステレオ
パイロツト信号に同期した38KHzステレオスイツ
チング信号を作成する為に、第１図の如きPLL
回路が用いられている。第１図において、１は位
相比較回路、２は該位相比較回路１の出力信号中
の直流分を取り出すローパスフイルタ、３は該ロ
ーパスフイルタ２の出力直流分を増幅する直流増
幅回路、４は発振部５と振動子６と発振周波数制
御部７とから成り前記直流増幅回路３の出力直流
信号（電圧もしくは電流）に応じた周波数の発振
信号を発生する発振回路、及び８は該発振回路４
の発振信号を分周する分周回路で、入力端子９に
印加される入力信号に同期した発振信号を得るこ
とが出来る様に成されている。 しかして、AMチユーナ付のFMチユーナのス
テレオ復調回路に第１図のPLL回路を使用する
場合、AM受信時にビート妨害等を防止する為
に、発振回路４の発振を停止させる必要がある。
しかしながら、発振回路４の発振を停止させる為
に単に発振部５の動作停止のみを行うと、発振動
作の再開時に、発振部５に発振周波数制御回路７
の出力電流が流れ込み、起動不良等が生じるとい
う欠点を有していた。 (ハ) 発明の目的 本発明は、上述の点に鑑み成されたもので、発
振動作の停止及び再開を時間遅れなく短時間で行
い得る発振回路を提供することを目的とする。 (ニ) 発明の構成 本発明に係る発振回路は、発振停止スイツチの
停止動作に応じて発振部及び発振周波数制御部を
同時に停止させるとともに、前記発振停止スイツ
チの停止解除動作に応じて発振部を先に動作状態
にし、発振周波数制御部を遅れて動作状態にする
制御回路を有するものである。 (ホ) 実施例 第２図は、本発明の一実施例を示すもので、１
０は差動接続された第１及び第２トランジスタ１
１及び１２と、その共通エミツタに接続された定
電流トランジスタ１３と、前記第１トランジスタ
１１のベースと前記第２トランジスタ１２のコレ
クタとの間に接続されたコンデンサ１４と、前記
第１及び第２トランジスタ１１及び１２のコレク
タ間に接続されたダイオード１５及びトランジス
タ１６から成る電流ミラー回路１７とを含む発振
部、１８は該発振部１０の第２トランジスタ１２
のコレクタとアースとの間に接続された水晶振動
子等の振動子、１９は差動接続された第３及び第
４トランジスタ２０及び２１と、その共通エミツ
タに接続された定電流トランジスタ２３と、前記
第３トランジスタ２０のベース・コレクタ間に接
続されたコンデンサ２４と、前記第３及び第４ト
ランジスタ２０及び２１のベース間に接続された
抵抗２５と、前記第３及び第４トランジスタ２０
及び２１のコレクタ間に接続されたダイオード２
６及びトランジスタ２７から成る電流ミラー回路
２８とを含む発振周波数制御部、２９は導通時に
発振回路の発振動作を停止させる発振停止スイツ
チ、及び３０は一端が前記発振停止スイツチ２９
に接続されたコンデンサ３１と、該コンデンサ３
１の一端と電源３２との間に接続された第１抵抗
３３と、前記コンデンサ３１の他端と前記電源３
２との間に接続された第２抵抗３４と、ベースが
前記電源３２にエミツタが電流制限抵抗３５を介
して前記コンデンサ３１の一端に接続された第１
制御トランジスタ３６と、ベースが前記コンデン
サ３１の他端にエミツタが電流制限抵抗３７を介
して前記コンデンサの一端に接続された第２制御
トランジスタ３８と、ベースが前記第１制御トラ
ンジスタ３６のコレクタにコレクタが発振部１０
の定電流トランジスタ１３のベースに接続された
第３制御トランジスタ３９と、ベースが第２制御
トランジスタ３８のコレクタにコレクタが発振周
波数制御部１９の定電流トランジスタ２３のベー
スに接続された第４制御トランジスタ４０とを含
む制御回路である。 しかして、前記発振部１０は、コンデンサ１４
の正帰還により発振を行う従来一般に使用されて
いるものであるから、その詳細な説明は省略す
る。また、発振周波数制御部１９は等価的に可変
容量となるものであり、コンデンサ２４の容量を
C1、抵抗２５の値をR1、第２及び第３トランジ
スタ２０及び２１から成る差動部の相互コンダク
タンスをgmとすれば、点Ａから見た等価容量Ｃ
は、 Ｃ＝C1R1gm ……(1) となる。前記相互コンダクタンスgmは、定電流
トランジスタ２３のコレクタ電流に応じて変化す
る。その為、前記定電流トランジスタ２３のベー
スに印加される直流信号を可変することにより、
等価容量Ｃの値を変えることが出来、振動子１８
と並列に等価可変容量が接続される結果、第１図
の直流増幅回路３の出力直流信号を定電流トラン
ジスタ２３のベースに印加することにより、発振
回路の発振周波数の可変が達成される。 いま、発振停止スイツチ２９が第２図の如く遮
断状態にあるとすれば、電源３２の電圧V1が第
１及び第２抵抗３３及び３４を介してコンデンサ
３１の両端に印加される。前記第１及び第２抵抗
３３及び３４の抵抗値を等しくR2とすれば、コ
ンデンサ３１の両端電圧は等しくV1となり、該
コンデンサ３１の充電は行なわれない。その場合
は、第１制御トランジスタ３６のベース・エミツ
タ間電圧及び第２制御トランジスタ３８のベー
ス・エミツタ間電圧は、略零となり両トランジス
タ３６及び３８はオフとなつている。その為、第
３及び第４制御トランジスタ３９及び４０もオフ
となり、制御回路３０は発振部１０及び発振周波
数制御部１９に対して何ら作用せず、発振回路は
安定に発振動作を継続する。 次に、時刻t1で発振停止スイツチ２９を導通状
態にしたとすれば、第３図に示す如く、点Ｂの電
圧が直ちに電源４１の電圧V2に上昇する。その
為、第１及び第２制御トランジスタ３６及び３８
が直ちにオンとなり、それに応じて第３及び第４
制御トランジスタ３９及び４０もオンとなる。第
３制御トランジスタ３９がオンになると、発振部
１０の定電流トランジスタ１３のベースが接地さ
れ、第１及び第２トランジスタ１１及び１２の動
作電流が流れなくなるので、前記発振部１０の動
作が停止する。同時に、第４制御トランジスタ４
０のオンにより、発振周波数制御部１９の定電流
トランジスタ２３のベースが接地され、第３及び
第４トランジスタ２０及び２１の動作電流が流れ
なくなり、前記発振周波数制御部１９の動作が停
止する。発振停止スイツチ２９が導通状態にある
間、その状態は持続され、発振回路の出力端子４
２に出力が発生しない。 時刻t2に、発振動作を再開させる為、発振停止
スイツチ２９を遮断したとすれば、電源４１が制
御回路３０から切り離され、コンデンサ３１の放
電が開始される。その時のコンデンサ３１の放電
電流Ｉは、 （ただし、C2はコンデンサ３１の容量） となる。また、その時の点Ｂの電圧VB及び点Ｃ
の電圧VCは、 VB＝V1＋IR2 ……(3) VC＝V1−IR2 ……(4) となるから、第(2)乃至第(4)式より、ｔ＝０とした
時の点Ｂ及び点Ｃの電圧は、 VB＝V1＋V2−V1／２ ……(5) VC＝V1−V2−V1／２ ……(6) となる。発振停止スイツチ２９の遮断後時間の経
過に従つて、点Ｂの電圧は、2C2R2の時定数でV1
に向つて低下し、時刻t3でV1となる。一方、点Ｃ
の電圧は、2C2R2の時定数でV1に向つて上昇し、
時刻t3でV1となる。従つて、ベースが電圧V1の
電源３２に、エミツタが点Ｂに接続された第１制
御トランジスタ３６のベース・エミツタ間電圧
が、ベースが点Ｃに、エミツタが点Ｂに接続され
た第２制御トランジスタ３８のベース・エミツタ
間電圧よりも先に立上り電圧以下となり、前記第
１制御トランジスタ３６が先にオフとなり、その
後第２制御トランジスタ３８がオフとなる。それ
故、第３制御トランジスタ３９が先にオフとな
り、発振部１０と振動子１８とによるフリーラン
発振が開始され、その後第４制御トランジスタ４
０のオフにより発振周波数制御部１９が動作を開
始し、出力端子４２に得られる出力発振信号が所
定の周波数となる。 仮りに、発振部１０と発振周波数制御部１９と
の動作が同時に開始される様に、第１乃至第４制
御トランジスタ３６乃至４０を同時にオフにする
と、第１図の位相比較回路１で生じているオフセ
ツトに起因する電流が前記第１乃至第４制御トラ
ンジスタ３６乃至４０のオフと同時に発振部１０
に流入し、発振回路が起動不良を生じる。すなわ
ち、前記第１乃至第４制御トランジスタ３６乃至
４０がオフすると、位相比較回路１の出力が発振
周波数制御部１９に印加されるが、該発振周波数
制御部１９が過渡状態にある為、そこから直流電
流が発生し、発振部１０に供給される。前記第１
乃至第４制御トランジスタ３６乃至４０がオフし
た直後には、発振部１０も過渡状態にあり、前記
発振周波数制御部１９の出力直流電流が供給され
ると、前記発振部１０の直流的バランスがくず
れ、発振の条件が整わず、起動不良を生じる。 それに対し、本発明の如く、発振部１０を先に
動作状態とすれば、該発振部１０が安定になつた
後に、発振周波数制御部１９の出力直流電流が発
振部１０に供給されるので、発振部１０が起動不
良を起こすのを防止し得る。ちなみに、第３図の
t2からt3迄の時間は、数十ｍ秒からせいぜい百ｍ
秒程度であり、従来回路の安定化時間数秒に比べ
十分に短くなつている。 第４図は、本考案に係る制御回路３０の別の実
施例を示すもので、第１制御トランジスタ３６の
ベースを第２制御トランジスタ３８のベースとと
もに点Ｃに接続し、かつ第１及び第２制御トラン
ジスタ３６及び３８のエミツタを共通接続すると
ともに、第３制御トランジスタ３９のエミツタに
電源４３を接続した点を特徴とする。尚、その他
の点は、第２図の制御回路と同一に付、同一の図
番を付して説明を省略する。第４図において、第
３制御トランジスタ３９は、点Ｂの電圧が電源４
３の電圧V3、第３制御トランジスタ３９のベー
ス・エミツタ間電圧VBE、第１制御トランジスタ
３６のコレクタ・エミツタ間電圧VCE、及び電流
制限抵抗３７の電圧降下VRの和電圧以下になる
とオフになる。一方、第４制御トランジスタ４０
は、該第４制御トランジスタ４０のベース・エミ
ツタ間電圧VBE、第２制御トランジスタ３８のコ
レクタ・エミツタ間電圧VCE、及び電流制限抵抗
３７の電圧降下VRの和電圧以下になるとオフに
なる。従つて、第３制御トランジスタ３９が先に
オフとなり、第２図の発振部１０が先に動作状態
となり、その後、第４制御トランジスタ４０がオ
フとなつて、発振周波数制御部１９が動作状態と
なる。尚、第３制御トランジスタ３９のエミツタ
に電源４３が設けられる為に、第４図の回路を使
用する場合には、第２図の発振部１０の定電流ト
ランジスタ１３のエミツタにも同一の電源を接続
する必要がある。 (ヘ) 発明の効果 以上述べた如く、本発明に依れば、発振回路の
発振部と発振周波数制御部とを同時に停止させる
とともに、発振部を先に発振周波数制御部をその
後に停止解除して動作状態にすることが出来るの
で、発振回路を時間遅れなく制御することが出
来、聴取者に異和感を与えないという利点を有す
る。
第１図は本発明の説明に供する為の回路ブロツ
ク図、第２図は本発明の一実施例を示す回路図、
第３図はその動作を説明する為の特性図、及び第
４図は本発明の別の実施例を示す回路図である。 主な図番の説明、１０……発振部、１８……振
動子、１９……発振周波数制御部、３０……制御
部、３６，３８，３９，４０……制御トランジス
タ。
ク図、第２図は本発明の一実施例を示す回路図、
第３図はその動作を説明する為の特性図、及び第
４図は本発明の別の実施例を示す回路図である。 主な図番の説明、１０……発振部、１８……振
動子、１９……発振周波数制御部、３０……制御
部、３６，３８，３９，４０……制御トランジス
タ。
Claims (1)
- １ 発振部と、発振周波数を定める為一端が前記
発振部の出力端に接続された振動子と、前記発振
周波数を変化させる為出力端が前記発振部の出力
端に接続された発振周波数制御部とを備え、該発
振周波数制御部に印加される直流信号に応じた発
振周波数を得ることの出来る発振回路において、
発振停止スイツチと、該発振停止スイツチの停止
動作に応じて前記発振部及び発振周波数制御部を
同時に停止させるとともに、前記発振停止スイツ
チの停止解除動作に応じて前記発振部を先に動作
状態に、前記発振周波数制御部を遅れて動作状態
にする制御回路とを設けたことを特徴とする発振
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58014779A JPS59140703A (ja) | 1983-01-31 | 1983-01-31 | 発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58014779A JPS59140703A (ja) | 1983-01-31 | 1983-01-31 | 発振回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59140703A JPS59140703A (ja) | 1984-08-13 |
| JPH0320091B2 true JPH0320091B2 (ja) | 1991-03-18 |
Family
ID=11870536
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58014779A Granted JPS59140703A (ja) | 1983-01-31 | 1983-01-31 | 発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59140703A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5534826A (en) * | 1994-10-24 | 1996-07-09 | At&T Corp. | Oscillator with increased reliability start up |
-
1983
- 1983-01-31 JP JP58014779A patent/JPS59140703A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59140703A (ja) | 1984-08-13 |
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