JPH03152966A - 半導体装置用リードフレーム - Google Patents
半導体装置用リードフレームInfo
- Publication number
- JPH03152966A JPH03152966A JP29273689A JP29273689A JPH03152966A JP H03152966 A JPH03152966 A JP H03152966A JP 29273689 A JP29273689 A JP 29273689A JP 29273689 A JP29273689 A JP 29273689A JP H03152966 A JPH03152966 A JP H03152966A
- Authority
- JP
- Japan
- Prior art keywords
- leads
- lead frame
- semiconductor device
- lead
- outer leads
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000004065 semiconductor Substances 0.000 title claims abstract description 28
- 238000007789 sealing Methods 0.000 claims description 2
- 238000000034 method Methods 0.000 abstract description 2
- 230000000694 effects Effects 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 239000000463 material Substances 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/0554—External layer
- H01L2224/0555—Shape
- H01L2224/05552—Shape in top view
- H01L2224/05554—Shape in top view being square
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48245—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
- H01L2224/48247—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
Landscapes
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置用リードフレームに関し、特にその
内部リードの構造を改良した半導体装置用リードフレー
ムに関する。
内部リードの構造を改良した半導体装置用リードフレー
ムに関する。
従来、この種の半導体装置に用いるリードフレームは、
第3図に示すように、半導体素子4上の電極5と内部リ
ード2をワイヤボンディングするために、電極5の位置
を考慮して内部リード2を設計する必要があった。
第3図に示すように、半導体素子4上の電極5と内部リ
ード2をワイヤボンディングするために、電極5の位置
を考慮して内部リード2を設計する必要があった。
上述した従来の半導体装置用リードフレームは、半導体
素子−Fの電極の配置を考慮して内部リードを設計する
ので、同じサイズの半導体素子であっても電極の配置の
違いによっては、別々のリードフレームを用いることに
なるという欠点がある。
素子−Fの電極の配置を考慮して内部リードを設計する
ので、同じサイズの半導体素子であっても電極の配置の
違いによっては、別々のリードフレームを用いることに
なるという欠点がある。
本発明の目的は、同しサイズの半導体素子に共用できる
半導体装置用リードフレームを提供することにある。
半導体装置用リードフレームを提供することにある。
本発明は、封止領域より外部に導出された複数の外部リ
ードと、該外部リードのそれぞれの内側の先端部に接続
する内部リードとを有する半導体装置用リードフレーム
において、前記外部リードのそれぞれの先端部に位置し
該先端部に接続する内部リードと、前記外部リードのそ
れぞれの中間部に位置し隣接する前記外部リードのそれ
ぞれに少くとも1ケ所接続する少くとも1ケの内部リー
ドとを有している。
ードと、該外部リードのそれぞれの内側の先端部に接続
する内部リードとを有する半導体装置用リードフレーム
において、前記外部リードのそれぞれの先端部に位置し
該先端部に接続する内部リードと、前記外部リードのそ
れぞれの中間部に位置し隣接する前記外部リードのそれ
ぞれに少くとも1ケ所接続する少くとも1ケの内部リー
ドとを有している。
第1図(a)、(b)は本発明の第1の実施例の半導体
装置用リードフレームを用いた半導体装置の製造方法を
説明する工程順に示した平面図である。
装置用リードフレームを用いた半導体装置の製造方法を
説明する工程順に示した平面図である。
第1の実施例は、第1図(a)、(b)に示すように、
外部リード1のそれぞれの先端部に位置し、これらの先
端部に接続する内部リード2aと、外部リード1のそれ
ぞれの中間部に位置し、隣接する外部リード]のそれぞ
れに少くとも1ケ所接続する内部リード2bが形成され
ている。
外部リード1のそれぞれの先端部に位置し、これらの先
端部に接続する内部リード2aと、外部リード1のそれ
ぞれの中間部に位置し、隣接する外部リード]のそれぞ
れに少くとも1ケ所接続する内部リード2bが形成され
ている。
半導体装置を製造する場音には、半導体素子4上の電極
5の配置に合わせ内部リード2bを選択し、不要な接続
部を切断し半導体装置用リードフレームとして用いる。
5の配置に合わせ内部リード2bを選択し、不要な接続
部を切断し半導体装置用リードフレームとして用いる。
第2図は本発明の第2の実施例の平面図である。
第2の実施例は、第2図に示すように、第1の実施例と
同様に、外部リード1と外部リード1の間に形成される
内部リード2dは格子状に接続された構造で、半導体素
子4上の電極5の配置に合わせて使用する内部リード2
dを選択し、不用な接続部を切断する。
同様に、外部リード1と外部リード1の間に形成される
内部リード2dは格子状に接続された構造で、半導体素
子4上の電極5の配置に合わせて使用する内部リード2
dを選択し、不用な接続部を切断する。
この実施例では、加工能力、内部リードの強度等の可能
な限り格子を細かくすることにより、内部リード2dの
選択の自由度を増すことができる利点がある。例えば、
通常用いられる板厚0.15mmのリードフレーム材な
らば、格子の線幅を0.12mm程度、また、さらに薄
い0.12mm厚リードすレーム材ならば、格子の線幅
を0.1.1mm程度にできる為、1mm当り4へ・5
木の格子を形成することかできる。
な限り格子を細かくすることにより、内部リード2dの
選択の自由度を増すことができる利点がある。例えば、
通常用いられる板厚0.15mmのリードフレーム材な
らば、格子の線幅を0.12mm程度、また、さらに薄
い0.12mm厚リードすレーム材ならば、格子の線幅
を0.1.1mm程度にできる為、1mm当り4へ・5
木の格子を形成することかできる。
以上説明したように本発明は、隣り合う外部リードのそ
れぞれと少なくとも1ケ所接続する内部リードを形成し
、半導体素子上の電極の配置に合わせて内部リードを選
択して使用できることにより、同じサイズの半導体素子
に対してそれぞれリードフレームを設計、生産しなくて
よいので途中工程丈では多品種の共用ができる効果があ
る。
れぞれと少なくとも1ケ所接続する内部リードを形成し
、半導体素子上の電極の配置に合わせて内部リードを選
択して使用できることにより、同じサイズの半導体素子
に対してそれぞれリードフレームを設計、生産しなくて
よいので途中工程丈では多品種の共用ができる効果があ
る。
また、ボンディングワイヤの長さを比較的短かくするこ
とができ、安定した半導体装置の製造が可能となる効果
がある。
とができ、安定した半導体装置の製造が可能となる効果
がある。
さらに、あらかじめリードフレームを設計、生産してお
けるので半導体装置の開発期間が短縮できるという効果
もある。
けるので半導体装置の開発期間が短縮できるという効果
もある。
図は従来の半導体装置用リードフレームの一例の平面図
である。
である。
1・・・外部リード、2.2a、2b、2c、2d・・
・内部リード、3・・・半導体素子搭載台部、4・・・
半導体素子、5・・・電極、6・・・金線。
・内部リード、3・・・半導体素子搭載台部、4・・・
半導体素子、5・・・電極、6・・・金線。
Claims (1)
- 封止領域より外部に導出された複数の外部リードと、
該外部リードのそれぞれの内側の先端部に接続する内部
リードとを有する半導体装置用リードフレームにおいて
、前記外部リードのそれぞれの先端部に位置し該先端部
に接続する内部リードと、前記外部リードのそれぞれの
中間部に位置し隣接する前記外部リードのそれぞれに少
くとも1ケ所接続する少くとも1ケの内部リードとを有
することを特徴とする半導体装置用リードフレーム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1292736A JP2504232B2 (ja) | 1989-11-09 | 1989-11-09 | 半導体装置用リ―ドフレ―ム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1292736A JP2504232B2 (ja) | 1989-11-09 | 1989-11-09 | 半導体装置用リ―ドフレ―ム |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH03152966A true JPH03152966A (ja) | 1991-06-28 |
JP2504232B2 JP2504232B2 (ja) | 1996-06-05 |
Family
ID=17785662
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1292736A Expired - Lifetime JP2504232B2 (ja) | 1989-11-09 | 1989-11-09 | 半導体装置用リ―ドフレ―ム |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2504232B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6194779B1 (en) * | 1989-11-28 | 2001-02-27 | Kabushiki Kaisha Toshiba | Plastic mold type semiconductor device |
JP2009176912A (ja) * | 2008-01-24 | 2009-08-06 | Sumitomo Metal Mining Co Ltd | フィルムキャリアテープ及びそれを用いた半導体装置 |
CN106531709A (zh) * | 2015-09-15 | 2017-03-22 | 株式会社东芝 | 半导体装置的制造方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5010967A (ja) * | 1973-05-28 | 1975-02-04 | ||
JPS5029163A (ja) * | 1973-07-17 | 1975-03-25 |
-
1989
- 1989-11-09 JP JP1292736A patent/JP2504232B2/ja not_active Expired - Lifetime
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5010967A (ja) * | 1973-05-28 | 1975-02-04 | ||
JPS5029163A (ja) * | 1973-07-17 | 1975-03-25 |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6194779B1 (en) * | 1989-11-28 | 2001-02-27 | Kabushiki Kaisha Toshiba | Plastic mold type semiconductor device |
JP2009176912A (ja) * | 2008-01-24 | 2009-08-06 | Sumitomo Metal Mining Co Ltd | フィルムキャリアテープ及びそれを用いた半導体装置 |
CN106531709A (zh) * | 2015-09-15 | 2017-03-22 | 株式会社东芝 | 半导体装置的制造方法 |
JP2017059613A (ja) * | 2015-09-15 | 2017-03-23 | 株式会社東芝 | 半導体装置の製造方法 |
CN110034086A (zh) * | 2015-09-15 | 2019-07-19 | 东芝存储器株式会社 | 引线架 |
CN110034086B (zh) * | 2015-09-15 | 2024-03-01 | 铠侠股份有限公司 | 引线架 |
Also Published As
Publication number | Publication date |
---|---|
JP2504232B2 (ja) | 1996-06-05 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3547704B2 (ja) | リードフレーム及び半導体装置 | |
JP2002198482A (ja) | 半導体装置およびその製造方法 | |
JPS63258050A (ja) | 半導体装置 | |
JPH03152966A (ja) | 半導体装置用リードフレーム | |
JPH0287637A (ja) | 半導体集積回路装置の製造方法 | |
JPH03230556A (ja) | 半導体装置用リードフレーム | |
JPH0730042A (ja) | 半導体装置用リードフレーム、それを用いた半導体装置及びその製造方法 | |
JPH06326234A (ja) | 半導体装置用リードフレームおよび前記リードフレームを使用した半導体装置 | |
JP2507271Y2 (ja) | 半導体装置 | |
JPH0498861A (ja) | 樹脂封止型半導体装置 | |
JPH02271654A (ja) | リードフレームおよび半導体集積回路装置 | |
JPH02156662A (ja) | 樹脂封止型半導体装置 | |
JPH02159752A (ja) | リードフレーム | |
JPH0513658A (ja) | 半導体装置用リードフレーム | |
JPS59198744A (ja) | 樹脂封止型半導体装置 | |
JPH03283648A (ja) | 樹脂封止型半導体装置 | |
JPH04320361A (ja) | リードフレーム及び半導体装置 | |
JPH02134852A (ja) | 樹脂封止型半導体装置 | |
JP2002305267A (ja) | 半導体装置およびその製造方法 | |
JPS634355B2 (ja) | ||
JPH02216856A (ja) | リードフレーム | |
JPH03245560A (ja) | リードフレーム | |
JPH0451553A (ja) | 半導体装置 | |
JPH0382068A (ja) | 半導体リードフレーム | |
JPH02253648A (ja) | 半導体装置用リードフレーム |