JPH02123738A - 基板を貫く電気接続部の作製方法 - Google Patents
基板を貫く電気接続部の作製方法Info
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- JPH02123738A JPH02123738A JP1251729A JP25172989A JPH02123738A JP H02123738 A JPH02123738 A JP H02123738A JP 1251729 A JP1251729 A JP 1251729A JP 25172989 A JP25172989 A JP 25172989A JP H02123738 A JPH02123738 A JP H02123738A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、基板を貫く電気接続部の作製方法に関する0
本発明は集積回路又は磁気録音用装置の製造に、更に一
般的にはマイクロエレクロトニクス及びオプトエレクト
ロニクスで使用される。
本発明は集積回路又は磁気録音用装置の製造に、更に一
般的にはマイクロエレクロトニクス及びオプトエレクト
ロニクスで使用される。
磁気録音装置の製造については、ヨーロッパ特許公開第
269489号が、一方の面に読み取り及び書き込みヘ
ッドが位置し、他方の面に集積回路が位置する基板によ
り構成される磁気ヘッドについて記載している。従って
、“内部接続部”が基板を貫いてヘッドと回路との間に
形成される。
269489号が、一方の面に読み取り及び書き込みヘ
ッドが位置し、他方の面に集積回路が位置する基板によ
り構成される磁気ヘッドについて記載している。従って
、“内部接続部”が基板を貫いてヘッドと回路との間に
形成される。
このような内部接続部を製造するために、基板に完全な
穿孔が行われ、作られた穴は2つの基板面の間の電気接
続を行うために使用される。
穿孔が行われ、作られた穴は2つの基板面の間の電気接
続を行うために使用される。
−船釣に、基板の穿孔又は貫通は化学エツチング(ch
emical etching)又はドライエツチング
(dryetchin8)により実施され得る。しかし
ながら、これら2つのいずれの方法も欠点を有する。前
者は等方性なので、横方向及び垂直方向のエツチング速
度が等しくなり、それにより直径が小さく深さの大きい
穴を得ることができない。これらの方法の2番目は50
μIllを越えて形成された材料の放電に関して問題を
生じ、それによりエツチング速度が遅くなる。しかしな
がら、深さが限定されている場合でもエツチング速度は
遅いまま(約0.5μW/分)なので、エツチング時間
が数時間となる。
emical etching)又はドライエツチング
(dryetchin8)により実施され得る。しかし
ながら、これら2つのいずれの方法も欠点を有する。前
者は等方性なので、横方向及び垂直方向のエツチング速
度が等しくなり、それにより直径が小さく深さの大きい
穴を得ることができない。これらの方法の2番目は50
μIllを越えて形成された材料の放電に関して問題を
生じ、それによりエツチング速度が遅くなる。しかしな
がら、深さが限定されている場合でもエツチング速度は
遅いまま(約0.5μW/分)なので、エツチング時間
が数時間となる。
レーザの場合、基板に穴を作る他の方法が提供されてい
る。レーザビームの集束作用の調整には大きな柔軟性が
あり、それに加えてレーザパルス持続時間及びパワーの
調整が可能であるために、レーザは小径穴の作製のため
の効果的な手段となっている。
る。レーザビームの集束作用の調整には大きな柔軟性が
あり、それに加えてレーザパルス持続時間及びパワーの
調整が可能であるために、レーザは小径穴の作製のため
の効果的な手段となっている。
このような方法は、例えば“その中を通る伝導性を有す
るシリコン−オン・サファイア(silicon−on
−Sapphire Body u+ith Cond
uctive PathsT h e r e t h
r o u B h ) ”について1984年3月
13日にT、R。
るシリコン−オン・サファイア(silicon−on
−Sapphire Body u+ith Cond
uctive PathsT h e r e t h
r o u B h ) ”について1984年3月
13日にT、R。
ANTIIONY等に認可された米国特許第44371
09号に記載されている。
09号に記載されている。
集積回路の内部接続が問題となるとき、レーザを使用す
れば六の位置決めに必要な極度の精度を得ることができ
る。精度は該回路上にパターンを作製する機械の精度と
同一レベルになければならない。−旦穴が得られると、
該層には金属被膜が施され(meta l 1zed)
、各基板面上に接点(contacts)が形成される
。
れば六の位置決めに必要な極度の精度を得ることができ
る。精度は該回路上にパターンを作製する機械の精度と
同一レベルになければならない。−旦穴が得られると、
該層には金属被膜が施され(meta l 1zed)
、各基板面上に接点(contacts)が形成される
。
しかしながら、この方法はそれでも尚欠点を有する。従
って、基板を形成する半導体材料のウェーハ又はプレー
トは、補足的に行われる幾つかの回路の製造作業のため
に操作されなければならない。大半のマイクロエレクト
ロニクス装置で使用されている方法に基づくこの操作は
吸引(suction)により行う。しかしながら、こ
のようなウエーノ1で複数の穴が作られると、吸引を使
用することができず、従って他の操作手段が提供されね
ばならない。更に、レーザによる貫通は微粉材料の放出
を招き、これは短絡又は回路の異常を引き起こし得る。
って、基板を形成する半導体材料のウェーハ又はプレー
トは、補足的に行われる幾つかの回路の製造作業のため
に操作されなければならない。大半のマイクロエレクト
ロニクス装置で使用されている方法に基づくこの操作は
吸引(suction)により行う。しかしながら、こ
のようなウエーノ1で複数の穴が作られると、吸引を使
用することができず、従って他の操作手段が提供されね
ばならない。更に、レーザによる貫通は微粉材料の放出
を招き、これは短絡又は回路の異常を引き起こし得る。
本発明の目的はこれらの欠点を解消することである。従
って、本発明は吸引による穿孔ウェーハの操作方法で問
題を引き起こさず且つ放出の危険性を排除する方法を提
起する。
って、本発明は吸引による穿孔ウェーハの操作方法で問
題を引き起こさず且つ放出の危険性を排除する方法を提
起する。
本発明においては、この目的は以下の方法で達成される
。レーザビームを使用して基板を穿孔する前に、レーザ
ビームの波長に対して基板より小さい吸収係数を有する
材料層を少な(とも1つ基板に被覆させる。従って、穿
孔作業は好ましくは銀層により被覆される面とは反対側
の面で行う。
。レーザビームを使用して基板を穿孔する前に、レーザ
ビームの波長に対して基板より小さい吸収係数を有する
材料層を少な(とも1つ基板に被覆させる。従って、穿
孔作業は好ましくは銀層により被覆される面とは反対側
の面で行う。
そのとき基板が従来技術でのようにレーザビームの作用
下で穿孔されるならば、基板を被覆する層はビームによ
る損害を受けることなく通過を受け、その結果ウェーハ
で最終的に得られる穴は層により閉じられる。換言すれ
ば、盲穴が得られる。
下で穿孔されるならば、基板を被覆する層はビームによ
る損害を受けることなく通過を受け、その結果ウェーハ
で最終的に得られる穴は層により閉じられる。換言すれ
ば、盲穴が得られる。
ウェーハ又はプレートが完全に穿孔又は貫通されていな
いときは、該ウェーハ又はプレートは吸引により簡単に
操作され得る。その上、層が穴を閉じているために、層
の側への材料の放出はない。
いときは、該ウェーハ又はプレートは吸引により簡単に
操作され得る。その上、層が穴を閉じているために、層
の側への材料の放出はない。
中でも特に本発明は、レーザビームを使用して基板に穴
が作られ、このようにして作られた穴に従って基板を貫
く電気接続部が作製される基板を貫く電気接続部作製方
法に関する。本発明は、基板を穿孔する前に基板の第1
の面に、該レーザビームの波長に対して基板より小さい
吸収係数を有する材料の薄層を少なくとも1つ付着させ
、該レーザビームへの露出を行い、かくして作られた穴
は盲穴の状態で、基板のみに作用が及んでいることを特
徴とする。
が作られ、このようにして作られた穴に従って基板を貫
く電気接続部が作製される基板を貫く電気接続部作製方
法に関する。本発明は、基板を穿孔する前に基板の第1
の面に、該レーザビームの波長に対して基板より小さい
吸収係数を有する材料の薄層を少なくとも1つ付着させ
、該レーザビームへの露出を行い、かくして作られた穴
は盲穴の状態で、基板のみに作用が及んでいることを特
徴とする。
方法の効果を改善するために、基板より低い異なる吸収
係数を有する幾つかの材料層が使用され得る。レーザー
ビームに対して透明な層を使用することもできる。
係数を有する幾つかの材料層が使用され得る。レーザー
ビームに対して透明な層を使用することもできる。
盲穴を伝導材料で部分的に又は完全にふさいで2つのウ
ェーハ面上に作られた接続部との適切な接触部を作るこ
とにより、公知の方法で種々の接続部が得られる。
ェーハ面上に作られた接続部との適切な接触部を作るこ
とにより、公知の方法で種々の接続部が得られる。
使用する材料の電気的性質に関してはあらゆる組み合わ
せが可能であり、特に絶縁層を備える導体若しくは半導
体基板の使用又は伝導層を備える絶縁基板の使用が可能
である。
せが可能であり、特に絶縁層を備える導体若しくは半導
体基板の使用又は伝導層を備える絶縁基板の使用が可能
である。
層が伝導性のときは、盲穴の底部が導体要素を構成し、
該要素は盲穴に付着された金属層と接触する。従って、
接触部が即座に得られる。
該要素は盲穴に付着された金属層と接触する。従って、
接触部が即座に得られる。
層が絶縁性のときは、穴の底部、即ち層を時々穿孔する
必要がある。この穿孔は、エツチングのような任意の公
知の手段を採用する方法のMt t&に実施され得る。
必要がある。この穿孔は、エツチングのような任意の公
知の手段を採用する方法のMt t&に実施され得る。
非制限的な実施例及び添付図面に関して本発明の詳細な
説明する。
説明する。
使用されるレーザ放射の波長に対して基板より低い吸収
係数を有する材料の1i12が付着される基板10を第
1図に示す。このようにして得られたウェーハ又はプレ
ートは“後”面14及び前”面16を有する。
係数を有する材料の1i12が付着される基板10を第
1図に示す。このようにして得られたウェーハ又はプレ
ートは“後”面14及び前”面16を有する。
例えば、基板10はシリコンからなり、層12はシリカ
(SiO2)からなり得る。この場合、シリカ層12は
熱気相成長(thermal vapour phas
e growth)又はプラズマ蒸着(plas+ma
deposition)により得られ得る。しかしな
がら、任意の他の方法も可能である。
(SiO2)からなり得る。この場合、シリカ層12は
熱気相成長(thermal vapour phas
e growth)又はプラズマ蒸着(plas+ma
deposition)により得られ得る。しかしな
がら、任意の他の方法も可能である。
厚さに関しては、厚さが500〜800μmの基板と厚
さが0.5〜4μ糟の層とを使用することができる。
さが0.5〜4μ糟の層とを使用することができる。
しかしながら、添付図面は明確にするためにそのまま縮
尺されていないことが指摘される。
尺されていないことが指摘される。
第2図は、本発明の盲穴の製造を示す、レーザ20がビ
ーム22を発し、ず−ムは手段24により集束され且つ
ウェーハの後面14に向けられる。レーザは材料10が
送られた波長で吸収性であるように選択される。この選
択は現在何等問題を生じていない。基板が半導体のとき
は、光子エネルギが材料の禁止帯域幅Egを上回るパワ
ーレーザ(powerlaser)が適し得る(吸収係
数は禁止帯域幅の関数である)、特にシリコンの場合(
Eg・1.1eV)、1.06μm(1,32eV)で
放出するHd−YへGレーザが完全に適する。このレー
ザはqスイッチモードで有利に作動し得る。前述の米国
特許はこのようなレーザの使用条件を記載しており、こ
れらの条件を本発明中に再度記載することができる。
ーム22を発し、ず−ムは手段24により集束され且つ
ウェーハの後面14に向けられる。レーザは材料10が
送られた波長で吸収性であるように選択される。この選
択は現在何等問題を生じていない。基板が半導体のとき
は、光子エネルギが材料の禁止帯域幅Egを上回るパワ
ーレーザ(powerlaser)が適し得る(吸収係
数は禁止帯域幅の関数である)、特にシリコンの場合(
Eg・1.1eV)、1.06μm(1,32eV)で
放出するHd−YへGレーザが完全に適する。このレー
ザはqスイッチモードで有利に作動し得る。前述の米国
特許はこのようなレーザの使用条件を記載しており、こ
れらの条件を本発明中に再度記載することができる。
層12は使用される波長に対してシリコンより低い吸収
係数を有さねばならない。波長が1.06μmのときの
シリカの場合がまさにそうである。波長が1.06μ諭
のときのシリコンの吸収係数は約103cffl−’で
あり、同じ波長でのシリカの吸収係数は1c「1より低
い。
係数を有さねばならない。波長が1.06μmのときの
シリカの場合がまさにそうである。波長が1.06μ諭
のときのシリコンの吸収係数は約103cffl−’で
あり、同じ波長でのシリカの吸収係数は1c「1より低
い。
後面14に当たる集束ビーム26が基板を穿孔するにの
ためにはレーザパルス列が必要である)。得られた穴2
7は、実質的に集束光ビームの直径に相当する。六の入
り口での直径は数十μ隋である。
ためにはレーザパルス列が必要である)。得られた穴2
7は、実質的に集束光ビームの直径に相当する。六の入
り口での直径は数十μ隋である。
最終的に得られた穴は僅かに円錐形であり、閉じられた
端部において約10μ輪の直径を有し得る。
端部において約10μ輪の直径を有し得る。
これらの直径は改良された集束手段の場合には明らかに
小さくされ得る。
小さくされ得る。
ビームがJli12に到達すると、ビームはごく僅かし
か吸収されず、射出ビーム28を形成するために層を穿
孔することなく通過する。このような盲穴の穿孔は1〜
10m5ecを要する。
か吸収されず、射出ビーム28を形成するために層を穿
孔することなく通過する。このような盲穴の穿孔は1〜
10m5ecを要する。
次に、このような盲穴が穿孔されたウェーハは、実際の
内部接続部を製造するために従来の手段により処理され
得る。基板10が導体(例えばシリコン)で層12が絶
縁体く例えばSiO□)であると想定される幾つかの段
階を非制限的に第3図から第6図に示す。
内部接続部を製造するために従来の手段により処理され
得る。基板10が導体(例えばシリコン)で層12が絶
縁体く例えばSiO□)であると想定される幾つかの段
階を非制限的に第3図から第6図に示す。
従って、第3図は穴の壁及びその端部上に付着された絶
縁層30を示す。熱酸化又はLPCVD(低圧化学蒸着
)によりこの層を得ることができる。
縁層30を示す。熱酸化又はLPCVD(低圧化学蒸着
)によりこの層を得ることができる。
第4図はあらかじめ前記層30で被覆された穴の内壁上
に付着される伝導層32を示す。伝導層は穴の端部にも
及んでいる。この層は蒸着又は電解的に付着され得る。
に付着される伝導層32を示す。伝導層は穴の端部にも
及んでいる。この層は蒸着又は電解的に付着され得る。
電気分解又は電解めっきにより伝導材料(Cu、FeN
i等)で盲穴を完全にふさぐこともできる。
i等)で盲穴を完全にふさぐこともできる。
金属層32どの接触を可能とするために、盲穴の底部が
穿孔される。開口部34が層12のマスキング及びエツ
チングにより設けられる。
穿孔される。開口部34が層12のマスキング及びエツ
チングにより設けられる。
従って、接続部のパターンは前面上の接触手段36と適
切にエツチングされた層32とを備えるウェーハの8両
面上で特定され得る(第6図)。
切にエツチングされた層32とを備えるウェーハの8両
面上で特定され得る(第6図)。
第7図は、基板10が絶縁体で層12が伝導性の場合の
本発明方法の他の実施例を示す。この場合、第3図から
第6図の絶縁層30は無用で、伝導層32が穴の壁土に
直接付着され得る。更には、層12が伝導性のときは、
銀層は層32との接触部36を直接確保する。
本発明方法の他の実施例を示す。この場合、第3図から
第6図の絶縁層30は無用で、伝導層32が穴の壁土に
直接付着され得る。更には、層12が伝導性のときは、
銀層は層32との接触部36を直接確保する。
この実施例に適する透明な伝導材料は、例えば約400
nmを越える波長で放射を伝達するITO(インジウム
及び酸化m ) 、 InSn 、5nOz 、 In
zOzSn02である。
nmを越える波長で放射を伝達するITO(インジウム
及び酸化m ) 、 InSn 、5nOz 、 In
zOzSn02である。
第1図は基板より低い吸収係数を有する層で被覆された
基板を示す図、第2図は穿孔作業を示す図、第3図から
第6図は基板が半導体性で層が絶縁性の場合の内部接続
部製造の4段階を示す区、第7図は基板が絶縁性で層が
伝導性の場合に対応する変形例を示す図である。 10、 、 、基板、12.、、層、20.、、レーザ
、22.、、ビーム、30、、、絶縁層、32.、、伝
導層、34.、、開口部、36、、、接触部。
基板を示す図、第2図は穿孔作業を示す図、第3図から
第6図は基板が半導体性で層が絶縁性の場合の内部接続
部製造の4段階を示す区、第7図は基板が絶縁性で層が
伝導性の場合に対応する変形例を示す図である。 10、 、 、基板、12.、、層、20.、、レーザ
、22.、、ビーム、30、、、絶縁層、32.、、伝
導層、34.、、開口部、36、、、接触部。
Claims (10)
- (1)レーザビームを使用して基板に穴が作られ、この
ようにして作られた穴に従つて電気接続部が基板を貫い
て作製される基板を貫く電気接続部の作製方法であって
、基板を穿孔する前に基板の第1の面に、該レーザビー
ムの波長に対して基板より小さい吸収係数を有する材料
の薄層を少なくとも1つ付着させ、該レーザビームへの
露出を行い、かくして作られた穴は盲穴の状態で基板の
みに作用が及んでいることを特徴とする方法。 - (2)基板が伝導性又は半導体性であり層が絶縁性であ
ることを特徴とする請求項1に記載の方法。 - (3)基板がシリコンからなることを特徴とする請求項
2に記載の方法。 - (4)層がシリカからなることを特徴とする請求項2に
記載の方法。 - (5)穴の作製作業後に絶縁層が穴の壁上に付着させら
れることを特徴とする請求項2に記載の方法。 - (6)基板が絶縁性で層が伝導性であることを特徴とす
る請求項1に記載の方法。 - (7)伝導層がITO、InSn、SnO_2及びIn
_2O_3SnO_2からなる群の中から選択される材
料であることを特徴とする請求項6に記載の方法。 - (8)伝導層がエッチングされ且つ接触手段として役立
つことを特徴とする請求項6に記載の方法。 - (9)伝導材料が少なくとも穴の一部に付着させられる
ことを特徴とする請求項5又は6に記載の方法。 - (10)層が絶縁性のときに該層は穴に対面して貫通し
てエッチングされ且つ接触部が該層上に設けられること
を特徴とする請求項8に記載の方法。
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---|---|---|---|
FR8812750A FR2637151A1 (fr) | 1988-09-29 | 1988-09-29 | Procede de realisation de connexions electriques a travers un substrat |
FR8812750 | 1988-09-29 |
Publications (1)
Publication Number | Publication Date |
---|---|
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Family
ID=9370533
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1251729A Pending JPH02123738A (ja) | 1988-09-29 | 1989-09-27 | 基板を貫く電気接続部の作製方法 |
Country Status (5)
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---|---|
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JP (1) | JPH02123738A (ja) |
DE (1) | DE68901329D1 (ja) |
FR (1) | FR2637151A1 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007067082A (ja) * | 2005-08-30 | 2007-03-15 | Disco Abrasive Syst Ltd | ウエーハの穿孔方法 |
JP2008212999A (ja) * | 2007-03-06 | 2008-09-18 | Disco Abrasive Syst Ltd | レーザー加工装置 |
JP2008543072A (ja) * | 2005-06-01 | 2008-11-27 | フォルシュングフェアブント ベルリン エー.ファウ. | 半導体ウェハにおける垂直な電気コンタクト接続の作製方法 |
Families Citing this family (111)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3121146A1 (de) * | 1981-05-27 | 1983-01-05 | Siemens AG, 1000 Berlin und 8000 München | Digitales funksystem |
US5108553A (en) * | 1989-04-04 | 1992-04-28 | Olin Corporation | G-tab manufacturing process and the product produced thereby |
US5062204A (en) * | 1990-07-10 | 1991-11-05 | The United States Of America As Represented By The Secretary Of The Army | Method of making a flexible membrane circuit tester |
US5062203A (en) * | 1990-07-10 | 1991-11-05 | The United States Of America As Represented By The Secretary Of The Army | Method of making a flexible membrane circuit tester |
US5046239A (en) * | 1990-07-10 | 1991-09-10 | The United States Of America As Represented By The Secretary Of The Army | Method of making a flexible membrane circuit tester |
US5151389A (en) * | 1990-09-10 | 1992-09-29 | Rockwell International Corporation | Method for dicing semiconductor substrates using an excimer laser beam |
US5293025A (en) * | 1991-08-01 | 1994-03-08 | E. I. Du Pont De Nemours And Company | Method for forming vias in multilayer circuits |
US5292686A (en) * | 1991-08-21 | 1994-03-08 | Triquint Semiconductor, Inc. | Method of forming substrate vias in a GaAs wafer |
US5536579A (en) * | 1994-06-02 | 1996-07-16 | International Business Machines Corporation | Design of high density structures with laser etch stop |
US5637834A (en) * | 1995-02-03 | 1997-06-10 | Motorola, Inc. | Multilayer circuit substrate and method for forming same |
US5976974A (en) * | 1997-04-22 | 1999-11-02 | W. L. Gore & Associates, Inc. | Method of forming redundant signal traces and corresponding electronic components |
FR2767223B1 (fr) * | 1997-08-06 | 1999-09-17 | Commissariat Energie Atomique | Procede d'interconnexion a travers un materiau semi-conducteur, et dispositif obtenu |
DE69737262T2 (de) * | 1997-11-26 | 2007-11-08 | Stmicroelectronics S.R.L., Agrate Brianza | Herstellungsverfahren für einen Vorder-Hinterseiten-Durchkontakt in mikro-integrierten Schaltungen |
IL123207A0 (en) * | 1998-02-06 | 1998-09-24 | Shellcase Ltd | Integrated circuit device |
GB2338201A (en) * | 1998-06-13 | 1999-12-15 | Exitech Ltd | Laser drilling of holes in materials |
JP2000031640A (ja) * | 1998-07-08 | 2000-01-28 | Ibiden Co Ltd | プリント配線板及びその製造方法 |
US6413839B1 (en) | 1998-10-23 | 2002-07-02 | Emcore Corporation | Semiconductor device separation using a patterned laser projection |
US6221769B1 (en) * | 1999-03-05 | 2001-04-24 | International Business Machines Corporation | Method for integrated circuit power and electrical connections via through-wafer interconnects |
US6080959A (en) * | 1999-03-12 | 2000-06-27 | Lexmark International, Inc. | System and method for feature compensation of an ablated inkjet nozzle plate |
US6935023B2 (en) | 2000-03-08 | 2005-08-30 | Hewlett-Packard Development Company, L.P. | Method of forming electrical connection for fluid ejection device |
US6509546B1 (en) | 2000-03-15 | 2003-01-21 | International Business Machines Corporation | Laser excision of laminate chip carriers |
DE10044540C1 (de) * | 2000-09-05 | 2002-01-31 | Siemens Ag | Verfahren zum Herstellen von elektrisch leitenden Schichten auf der Wandung von Durchgangslöchern in einem Substrat |
US6930256B1 (en) | 2002-05-01 | 2005-08-16 | Amkor Technology, Inc. | Integrated circuit substrate having laser-embedded conductive patterns and method therefor |
US7334326B1 (en) | 2001-06-19 | 2008-02-26 | Amkor Technology, Inc. | Method for making an integrated circuit substrate having embedded passive components |
US6659592B2 (en) | 2001-08-16 | 2003-12-09 | Hewlett-Packard Development Company, L.P. | Multiple redundant through hole electrical interconnects and method for forming the same |
GB2385199A (en) * | 2002-02-08 | 2003-08-13 | Qinetiq Ltd | Substrate with conducting vias |
US6960490B2 (en) * | 2002-03-14 | 2005-11-01 | Epitactix Pty Ltd. | Method and resulting structure for manufacturing semiconductor substrates |
US6930257B1 (en) | 2002-05-01 | 2005-08-16 | Amkor Technology, Inc. | Integrated circuit substrate having laminated laser-embedded circuit layers |
US7028400B1 (en) * | 2002-05-01 | 2006-04-18 | Amkor Technology, Inc. | Integrated circuit substrate having laser-exposed terminals |
US7670962B2 (en) | 2002-05-01 | 2010-03-02 | Amkor Technology, Inc. | Substrate having stiffener fabrication method |
US9691635B1 (en) | 2002-05-01 | 2017-06-27 | Amkor Technology, Inc. | Buildup dielectric layer having metallization pattern semiconductor package fabrication method |
US7399661B2 (en) * | 2002-05-01 | 2008-07-15 | Amkor Technology, Inc. | Method for making an integrated circuit substrate having embedded back-side access conductors and vias |
US7548430B1 (en) | 2002-05-01 | 2009-06-16 | Amkor Technology, Inc. | Buildup dielectric and metallization process and semiconductor package |
US7633765B1 (en) | 2004-03-23 | 2009-12-15 | Amkor Technology, Inc. | Semiconductor package including a top-surface metal layer for implementing circuit features |
US6902872B2 (en) | 2002-07-29 | 2005-06-07 | Hewlett-Packard Development Company, L.P. | Method of forming a through-substrate interconnect |
US6716737B2 (en) | 2002-07-29 | 2004-04-06 | Hewlett-Packard Development Company, L.P. | Method of forming a through-substrate interconnect |
TWI248244B (en) * | 2003-02-19 | 2006-01-21 | J P Sercel Associates Inc | System and method for cutting using a variable astigmatic focal beam spot |
EP1482553A3 (en) * | 2003-05-26 | 2007-03-28 | Sanyo Electric Co., Ltd. | Semiconductor device and manufacturing method thereof |
JP4130158B2 (ja) * | 2003-06-09 | 2008-08-06 | 三洋電機株式会社 | 半導体装置の製造方法、半導体装置 |
US8084866B2 (en) | 2003-12-10 | 2011-12-27 | Micron Technology, Inc. | Microelectronic devices and methods for filling vias in microelectronic devices |
US7091124B2 (en) | 2003-11-13 | 2006-08-15 | Micron Technology, Inc. | Methods for forming vias in microelectronic devices, and methods for packaging microelectronic devices |
JP4850392B2 (ja) * | 2004-02-17 | 2012-01-11 | 三洋電機株式会社 | 半導体装置の製造方法 |
US11081370B2 (en) | 2004-03-23 | 2021-08-03 | Amkor Technology Singapore Holding Pte. Ltd. | Methods of manufacturing an encapsulated semiconductor device |
US10811277B2 (en) | 2004-03-23 | 2020-10-20 | Amkor Technology, Inc. | Encapsulated semiconductor package |
US7145238B1 (en) | 2004-05-05 | 2006-12-05 | Amkor Technology, Inc. | Semiconductor package and substrate having multi-level vias |
US20050247894A1 (en) * | 2004-05-05 | 2005-11-10 | Watkins Charles M | Systems and methods for forming apertures in microfeature workpieces |
US7232754B2 (en) * | 2004-06-29 | 2007-06-19 | Micron Technology, Inc. | Microelectronic devices and methods for forming interconnects in microelectronic devices |
US7087463B2 (en) * | 2004-08-04 | 2006-08-08 | Gelcore, Llc | Laser separation of encapsulated submount |
US7425499B2 (en) | 2004-08-24 | 2008-09-16 | Micron Technology, Inc. | Methods for forming interconnects in vias and microelectronic workpieces including such interconnects |
US7083425B2 (en) * | 2004-08-27 | 2006-08-01 | Micron Technology, Inc. | Slanted vias for electrical circuits on circuit boards and other substrates |
US7300857B2 (en) * | 2004-09-02 | 2007-11-27 | Micron Technology, Inc. | Through-wafer interconnects for photoimager and memory wafers |
US7390740B2 (en) * | 2004-09-02 | 2008-06-24 | Micron Technology, Inc. | Sloped vias in a substrate, spring-like contacts, and methods of making |
JP4443379B2 (ja) * | 2004-10-26 | 2010-03-31 | 三洋電機株式会社 | 半導体装置の製造方法 |
JP4873517B2 (ja) * | 2004-10-28 | 2012-02-08 | オンセミコンダクター・トレーディング・リミテッド | 半導体装置及びその製造方法 |
US7271482B2 (en) | 2004-12-30 | 2007-09-18 | Micron Technology, Inc. | Methods for forming interconnects in microelectronic workpieces and microelectronic workpieces formed using such methods |
US7485967B2 (en) * | 2005-03-10 | 2009-02-03 | Sanyo Electric Co., Ltd. | Semiconductor device with via hole for electric connection |
US8826531B1 (en) | 2005-04-05 | 2014-09-09 | Amkor Technology, Inc. | Method for making an integrated circuit substrate having laminated laser-embedded circuit layers |
US7795134B2 (en) | 2005-06-28 | 2010-09-14 | Micron Technology, Inc. | Conductive interconnect structures and formation methods using supercritical fluids |
US20070045120A1 (en) * | 2005-09-01 | 2007-03-01 | Micron Technology, Inc. | Methods and apparatus for filling features in microfeature workpieces |
US7622377B2 (en) | 2005-09-01 | 2009-11-24 | Micron Technology, Inc. | Microfeature workpiece substrates having through-substrate vias, and associated methods of formation |
US7262134B2 (en) * | 2005-09-01 | 2007-08-28 | Micron Technology, Inc. | Microfeature workpieces and methods for forming interconnects in microfeature workpieces |
US7863187B2 (en) * | 2005-09-01 | 2011-01-04 | Micron Technology, Inc. | Microfeature workpieces and methods for forming interconnects in microfeature workpieces |
US8154105B2 (en) * | 2005-09-22 | 2012-04-10 | International Rectifier Corporation | Flip chip semiconductor device and process of its manufacture |
US7749899B2 (en) * | 2006-06-01 | 2010-07-06 | Micron Technology, Inc. | Microelectronic workpieces and methods and systems for forming interconnects in microelectronic workpieces |
JP2008010659A (ja) * | 2006-06-29 | 2008-01-17 | Disco Abrasive Syst Ltd | ビアホールの加工方法 |
US7629249B2 (en) | 2006-08-28 | 2009-12-08 | Micron Technology, Inc. | Microfeature workpieces having conductive interconnect structures formed by chemically reactive processes, and associated systems and methods |
US7902643B2 (en) * | 2006-08-31 | 2011-03-08 | Micron Technology, Inc. | Microfeature workpieces having interconnects and conductive backplanes, and associated systems and methods |
JP5016876B2 (ja) * | 2006-09-06 | 2012-09-05 | 株式会社ディスコ | ビアホールの加工方法 |
US7589398B1 (en) | 2006-10-04 | 2009-09-15 | Amkor Technology, Inc. | Embedded metal features structure |
US7550857B1 (en) | 2006-11-16 | 2009-06-23 | Amkor Technology, Inc. | Stacked redistribution layer (RDL) die assembly package |
US7750250B1 (en) | 2006-12-22 | 2010-07-06 | Amkor Technology, Inc. | Blind via capture pad structure |
US7752752B1 (en) | 2007-01-09 | 2010-07-13 | Amkor Technology, Inc. | Method of fabricating an embedded circuit pattern |
GB2446875A (en) * | 2007-02-23 | 2008-08-27 | Intense Ltd | Production of fine geometric openings in thin film materials |
US7919410B2 (en) * | 2007-03-14 | 2011-04-05 | Aptina Imaging Corporation | Packaging methods for imager devices |
US8323771B1 (en) | 2007-08-15 | 2012-12-04 | Amkor Technology, Inc. | Straight conductor blind via capture pad structure and fabrication method |
SG150410A1 (en) | 2007-08-31 | 2009-03-30 | Micron Technology Inc | Partitioned through-layer via and associated systems and methods |
US7884015B2 (en) | 2007-12-06 | 2011-02-08 | Micron Technology, Inc. | Methods for forming interconnects in microelectronic workpieces and microelectronic workpieces formed using such methods |
US8872329B1 (en) | 2009-01-09 | 2014-10-28 | Amkor Technology, Inc. | Extended landing pad substrate package structure and method |
US7960827B1 (en) | 2009-04-09 | 2011-06-14 | Amkor Technology, Inc. | Thermal via heat spreader package and method |
US8623753B1 (en) | 2009-05-28 | 2014-01-07 | Amkor Technology, Inc. | Stackable protruding via package and method |
US8222538B1 (en) | 2009-06-12 | 2012-07-17 | Amkor Technology, Inc. | Stackable via package and method |
US8471154B1 (en) | 2009-08-06 | 2013-06-25 | Amkor Technology, Inc. | Stackable variable height via package and method |
US8796561B1 (en) | 2009-10-05 | 2014-08-05 | Amkor Technology, Inc. | Fan out build up substrate stackable package and method |
US8937381B1 (en) | 2009-12-03 | 2015-01-20 | Amkor Technology, Inc. | Thin stackable package and method |
US9691734B1 (en) | 2009-12-07 | 2017-06-27 | Amkor Technology, Inc. | Method of forming a plurality of electronic component packages |
US20110132885A1 (en) * | 2009-12-07 | 2011-06-09 | J.P. Sercel Associates, Inc. | Laser machining and scribing systems and methods |
US20130256286A1 (en) * | 2009-12-07 | 2013-10-03 | Ipg Microsystems Llc | Laser processing using an astigmatic elongated beam spot and using ultrashort pulses and/or longer wavelengths |
US8536462B1 (en) | 2010-01-22 | 2013-09-17 | Amkor Technology, Inc. | Flex circuit package and method |
US8300423B1 (en) | 2010-05-25 | 2012-10-30 | Amkor Technology, Inc. | Stackable treated via package and method |
US8294276B1 (en) | 2010-05-27 | 2012-10-23 | Amkor Technology, Inc. | Semiconductor device and fabricating method thereof |
US8338229B1 (en) | 2010-07-30 | 2012-12-25 | Amkor Technology, Inc. | Stackable plasma cleaned via package and method |
US8717775B1 (en) | 2010-08-02 | 2014-05-06 | Amkor Technology, Inc. | Fingerprint sensor package and method |
US8337657B1 (en) | 2010-10-27 | 2012-12-25 | Amkor Technology, Inc. | Mechanical tape separation package and method |
US8482134B1 (en) | 2010-11-01 | 2013-07-09 | Amkor Technology, Inc. | Stackable package and method |
US9748154B1 (en) | 2010-11-04 | 2017-08-29 | Amkor Technology, Inc. | Wafer level fan out semiconductor device and manufacturing method thereof |
US8525318B1 (en) | 2010-11-10 | 2013-09-03 | Amkor Technology, Inc. | Semiconductor device and fabricating method thereof |
US8557629B1 (en) | 2010-12-03 | 2013-10-15 | Amkor Technology, Inc. | Semiconductor device having overlapped via apertures |
US8535961B1 (en) | 2010-12-09 | 2013-09-17 | Amkor Technology, Inc. | Light emitting diode (LED) package and method |
US9721872B1 (en) | 2011-02-18 | 2017-08-01 | Amkor Technology, Inc. | Methods and structures for increasing the allowable die size in TMV packages |
US9013011B1 (en) | 2011-03-11 | 2015-04-21 | Amkor Technology, Inc. | Stacked and staggered die MEMS package and method |
KR101140113B1 (ko) | 2011-04-26 | 2012-04-30 | 앰코 테크놀로지 코리아 주식회사 | 반도체 디바이스 |
US8653674B1 (en) | 2011-09-15 | 2014-02-18 | Amkor Technology, Inc. | Electronic component package fabrication method and structure |
US8633598B1 (en) | 2011-09-20 | 2014-01-21 | Amkor Technology, Inc. | Underfill contacting stacking balls package fabrication method and structure |
US9029962B1 (en) | 2011-10-12 | 2015-05-12 | Amkor Technology, Inc. | Molded cavity substrate MEMS package fabrication method and structure |
FR2985088B1 (fr) | 2011-12-23 | 2015-04-17 | Commissariat Energie Atomique | Via tsv dote d'une structure de liberation de contraintes et son procede de fabrication |
KR101366461B1 (ko) | 2012-11-20 | 2014-02-26 | 앰코 테크놀로지 코리아 주식회사 | 반도체 디바이스 및 그 제조 방법 |
US9799592B2 (en) | 2013-11-19 | 2017-10-24 | Amkor Technology, Inc. | Semicondutor device with through-silicon via-less deep wells |
KR101488590B1 (ko) | 2013-03-29 | 2015-01-30 | 앰코 테크놀로지 코리아 주식회사 | 반도체 디바이스 및 그 제조 방법 |
KR101607981B1 (ko) | 2013-11-04 | 2016-03-31 | 앰코 테크놀로지 코리아 주식회사 | 반도체 패키지용 인터포저 및 이의 제조 방법, 제조된 인터포저를 이용한 반도체 패키지 |
US9960328B2 (en) | 2016-09-06 | 2018-05-01 | Amkor Technology, Inc. | Semiconductor device and manufacturing method thereof |
CN109128513B (zh) * | 2018-08-27 | 2020-09-29 | 蓝思科技(长沙)有限公司 | 一种盲孔的加工方法 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE1460187A1 (de) * | 1963-08-26 | 1968-11-28 | Patentdienst Anstalt F | Verfahren und Vorrichtung zum Behandeln von bahnfoermigen Textilguetern,Fadenkablen,Baendern,Kammerzug od.dgl. |
DE2548258A1 (de) * | 1975-10-28 | 1977-05-05 | Siemens Ag | Verfahren zur herstellung mehrlagiger mikroverdrahtungen |
US4417393A (en) * | 1981-04-01 | 1983-11-29 | General Electric Company | Method of fabricating high density electronic circuits having very narrow conductors |
US4348253A (en) * | 1981-11-12 | 1982-09-07 | Rca Corporation | Method for fabricating via holes in a semiconductor wafer |
EP0164564A1 (de) * | 1984-05-18 | 1985-12-18 | Siemens Aktiengesellschaft | Anordnung zur Sacklocherzeugung in einem laminierten Aufbau |
US4642160A (en) * | 1985-08-12 | 1987-02-10 | Interconnect Technology Inc. | Multilayer circuit board manufacturing |
US4842699A (en) * | 1988-05-10 | 1989-06-27 | Avantek, Inc. | Method of selective via-hole and heat sink plating using a metal mask |
-
1988
- 1988-09-29 FR FR8812750A patent/FR2637151A1/fr not_active Withdrawn
-
1989
- 1989-09-08 US US07/404,410 patent/US4964212A/en not_active Expired - Lifetime
- 1989-09-27 DE DE8989402652T patent/DE68901329D1/de not_active Expired - Lifetime
- 1989-09-27 EP EP89402652A patent/EP0363256B1/fr not_active Expired - Lifetime
- 1989-09-27 JP JP1251729A patent/JPH02123738A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008543072A (ja) * | 2005-06-01 | 2008-11-27 | フォルシュングフェアブント ベルリン エー.ファウ. | 半導体ウェハにおける垂直な電気コンタクト接続の作製方法 |
JP2007067082A (ja) * | 2005-08-30 | 2007-03-15 | Disco Abrasive Syst Ltd | ウエーハの穿孔方法 |
JP2008212999A (ja) * | 2007-03-06 | 2008-09-18 | Disco Abrasive Syst Ltd | レーザー加工装置 |
Also Published As
Publication number | Publication date |
---|---|
EP0363256B1 (fr) | 1992-04-22 |
EP0363256A1 (fr) | 1990-04-11 |
US4964212A (en) | 1990-10-23 |
DE68901329D1 (de) | 1992-05-27 |
FR2637151A1 (fr) | 1990-03-30 |
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