JPH01302740A - 誘電体分離半導体基板およびその製造方法 - Google Patents
誘電体分離半導体基板およびその製造方法Info
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- JPH01302740A JPH01302740A JP13230388A JP13230388A JPH01302740A JP H01302740 A JPH01302740 A JP H01302740A JP 13230388 A JP13230388 A JP 13230388A JP 13230388 A JP13230388 A JP 13230388A JP H01302740 A JPH01302740 A JP H01302740A
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- 239000000758 substrate Substances 0.000 title claims abstract description 39
- 239000004065 semiconductor Substances 0.000 title claims abstract description 23
- 238000002955 isolation Methods 0.000 title claims abstract description 16
- 239000010410 layer Substances 0.000 claims description 29
- 239000011241 protective layer Substances 0.000 claims description 11
- 235000012431 wafers Nutrition 0.000 abstract description 42
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 abstract description 37
- 229910052710 silicon Inorganic materials 0.000 abstract description 37
- 239000010703 silicon Substances 0.000 abstract description 37
- 229910052814 silicon oxide Inorganic materials 0.000 abstract description 17
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 abstract description 16
- 229910021420 polycrystalline silicon Inorganic materials 0.000 abstract description 15
- 238000005498 polishing Methods 0.000 abstract description 5
- 230000001681 protective effect Effects 0.000 abstract description 3
- 238000000034 method Methods 0.000 description 18
- 238000010438 heat treatment Methods 0.000 description 7
- 238000004519 manufacturing process Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 6
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 4
- 239000000853 adhesive Substances 0.000 description 4
- 230000001070 adhesive effect Effects 0.000 description 4
- 239000012298 atmosphere Substances 0.000 description 4
- 230000000694 effects Effects 0.000 description 4
- 238000005530 etching Methods 0.000 description 4
- 238000000151 deposition Methods 0.000 description 3
- 239000000203 mixture Substances 0.000 description 3
- 238000000926 separation method Methods 0.000 description 3
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 2
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 2
- 238000004518 low pressure chemical vapour deposition Methods 0.000 description 2
- 239000001301 oxygen Substances 0.000 description 2
- 229910052760 oxygen Inorganic materials 0.000 description 2
- 230000003071 parasitic effect Effects 0.000 description 2
- 238000011282 treatment Methods 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- 230000005856 abnormality Effects 0.000 description 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 1
- QZPSXPBJTPJTSZ-UHFFFAOYSA-N aqua regia Chemical compound Cl.O[N+]([O-])=O QZPSXPBJTPJTSZ-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 230000008602 contraction Effects 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000005489 elastic deformation Effects 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 239000001257 hydrogen Substances 0.000 description 1
- 229910052739 hydrogen Inorganic materials 0.000 description 1
- 125000004435 hydrogen atom Chemical class [H]* 0.000 description 1
- 239000011261 inert gas Substances 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 239000011259 mixed solution Substances 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- QJGQUHMNIGDVPM-UHFFFAOYSA-N nitrogen group Chemical group [N] QJGQUHMNIGDVPM-UHFFFAOYSA-N 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- 229910052594 sapphire Inorganic materials 0.000 description 1
- 239000010980 sapphire Substances 0.000 description 1
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 1
- 239000000243 solution Substances 0.000 description 1
- 239000004575 stone Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 238000001947 vapour-phase growth Methods 0.000 description 1
- 238000005406 washing Methods 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
本発明は、2枚の基板を接着して得られる誘電体分離半
導体基板に関する。
導体基板に関する。
(従来の技術)
従来より、半導体装置の素子分離法として。
pn接合接合分離や誘電体分離が知られている。
誘電体分離法は、pn接合分離法に比べて以下のような
優れた特徴を有する。
優れた特徴を有する。
■高温動作時においても漏れ電流が少ない。
■寄生サイリスタによるラッチアップがない。
■高耐圧素子を分離する場合にも分離に要する面積が少
ない。
ない。
■電圧印加の極性を考慮する必要がない。
■寄生容量が少ない。
誘電体分離構造を実現するためにはいくつかの方法が知
られている。例えば、シリコン基板を間に絶縁膜を挟ん
で直接接着する方法、SOSと呼ばれるサファイア基板
上にシリコンを気相成長させる方法、絶縁膜上に非晶質
シリコン膜を堆積してこれを再結晶化させる方法、シリ
コン基板の一部をエツチングし酸化膜を形成した後多結
晶シリコン膜を堆積し裏面から研磨して多結晶シリコン
膜で保持された島状シリコン層を得る方法1等である。
られている。例えば、シリコン基板を間に絶縁膜を挟ん
で直接接着する方法、SOSと呼ばれるサファイア基板
上にシリコンを気相成長させる方法、絶縁膜上に非晶質
シリコン膜を堆積してこれを再結晶化させる方法、シリ
コン基板の一部をエツチングし酸化膜を形成した後多結
晶シリコン膜を堆積し裏面から研磨して多結晶シリコン
膜で保持された島状シリコン層を得る方法1等である。
これらの中で、直接接着技術は、簡便に良質の誘電体分
離半導体基板を得ることができるものとして最近注目さ
れている。
離半導体基板を得ることができるものとして最近注目さ
れている。
第5図は、従来の直接接着技術による誘電体分離基板の
製造工程を示す。(a)に示すように。
製造工程を示す。(a)に示すように。
接着すべき面を鏡面研磨した2枚のシリコン・ウェハ1
.2を用意する。一方のウェハ1には1図示のように表
面に酸化膜3,4を形成する。このような2枚のウェハ
1,2を直接接着して(b)に示すように一体化する。
.2を用意する。一方のウェハ1には1図示のように表
面に酸化膜3,4を形成する。このような2枚のウェハ
1,2を直接接着して(b)に示すように一体化する。
続いて素子形成を行なう活性層側、この例ではウェハ1
側を研磨して。
側を研磨して。
(c)に示すように所定厚みに設定する。次に活性層側
のウェハ1を異方性エツチングにより選択エツチングし
て、(d)に示すように酸化膜4に達する深さの断面V
字状の分離溝5を形成する。
のウェハ1を異方性エツチングにより選択エツチングし
て、(d)に示すように酸化膜4に達する深さの断面V
字状の分離溝5を形成する。
これにより、各素子形成領域が島状に分離される。
その後更に各島状のシリコン層を電気的に分離するため
、(e)に示すように酸化膜6を形成する。
、(e)に示すように酸化膜6を形成する。
そして各分離溝5に多結晶シリコン膜7を埋込み。
必要に応じて表面の平坦化処理を行なって、(f)に示
すような誘電体分離基板を得る。
すような誘電体分離基板を得る。
この直接接着技術を利用した方法では、厚くて良質の誘
電体分離されたシリコン層を得ることができ、多結晶シ
リコン膜を厚く堆積する必要がないため、基板の反りも
少ない。しかし、この基板に全く反りがない訳ではない
。接着したウェハは。
電体分離されたシリコン層を得ることができ、多結晶シ
リコン膜を厚く堆積する必要がないため、基板の反りも
少ない。しかし、この基板に全く反りがない訳ではない
。接着したウェハは。
熱処理により一体化されるが、熱処理後室温に戻る際に
、シリコンとシリコン酸化膜との熱膨張率の差により応
力が発生する。即ち、シリコンの方が酸化膜より熱収縮
が大きいので、室温においてシリコンは引張り応力が働
いた状態で縮もうとし。
、シリコンとシリコン酸化膜との熱膨張率の差により応
力が発生する。即ち、シリコンの方が酸化膜より熱収縮
が大きいので、室温においてシリコンは引張り応力が働
いた状態で縮もうとし。
酸化膜は圧縮応力が働いた状態で伸びようとしている。
第6図は、その応力の様子を活性層側の研磨か済んだ第
5図(C)の状態について示している。
5図(C)の状態について示している。
研磨の結果、基板の厚み方向の中心は図の破線で示す位
置にある。そして酸化膜4は伸びようとしているから、
この基板は研磨した活性層側が凸になるように反りが生
じる。この反りは、−枚のウェハの片面に熱酸化膜を形
成した時と同じく熱収縮差による弾性変形である。そし
てこの様な反りがあると、特にウェハの大口径化や素子
の微細化に連れてPEP工程に支障を来たし、所望の素
子パターン形成が難しくなる。
置にある。そして酸化膜4は伸びようとしているから、
この基板は研磨した活性層側が凸になるように反りが生
じる。この反りは、−枚のウェハの片面に熱酸化膜を形
成した時と同じく熱収縮差による弾性変形である。そし
てこの様な反りがあると、特にウェハの大口径化や素子
の微細化に連れてPEP工程に支障を来たし、所望の素
子パターン形成が難しくなる。
(発明が解決しようとする課題)
以上のように接着技術により得られる誘電体分離基板は
1反りが生じて精度の高いパターン形成ができない2
という問題があった。
1反りが生じて精度の高いパターン形成ができない2
という問題があった。
本発明は5 この様な問題を解決した誘電体分離半導体
基板を提供することを目的とする。
基板を提供することを目的とする。
[発明の構成]
(課題を解決するための手段)
本発明にかかる誘電体分離半導体基板は1間に第1の絶
縁膜を挟んで接着により一体化された第1の半導体層と
これより厚い第2の半導体層を有する構造において、第
2の半導体層の裏面に第2の絶縁膜とこれを覆う保護膜
を設けたことを特徴とする。
縁膜を挟んで接着により一体化された第1の半導体層と
これより厚い第2の半導体層を有する構造において、第
2の半導体層の裏面に第2の絶縁膜とこれを覆う保護膜
を設けたことを特徴とする。
(作用)
本発明によれば、ウェハの中心からずれた位置に第1の
絶縁膜が存在することによるウェハ表裏の応力の差が、
第2の絶縁膜を厚い方の半導体層にも設けることによっ
て緩和され、ウェハの反りが防止ないし低減される。
絶縁膜が存在することによるウェハ表裏の応力の差が、
第2の絶縁膜を厚い方の半導体層にも設けることによっ
て緩和され、ウェハの反りが防止ないし低減される。
一方、半導体ウェハに素子を形成するに当たっては、弗
酸等を用いた絶縁膜エツチング工程が入る。従って単に
ウェハ裏面に絶縁膜を設けておくだけでは、エツチング
工程でこれが除去されてしまう。本発明ではこの第2の
絶縁膜を保護膜で覆っておくことにより、これが防止さ
れ、素子製造工程を通じてウェハの反りが効果的に防止
される。
酸等を用いた絶縁膜エツチング工程が入る。従って単に
ウェハ裏面に絶縁膜を設けておくだけでは、エツチング
工程でこれが除去されてしまう。本発明ではこの第2の
絶縁膜を保護膜で覆っておくことにより、これが防止さ
れ、素子製造工程を通じてウェハの反りが効果的に防止
される。
(実施例)
以下1本発明の詳細な説明する。
n型、比抵抗20〜30Ω・α2面方位(100)、厚
み500μmのシリコン・ウェハを用いて、直接接着に
より誘電体分離基板を作製した。直接接着の具体的な工
程は次の通りである。
み500μmのシリコン・ウェハを用いて、直接接着に
より誘電体分離基板を作製した。直接接着の具体的な工
程は次の通りである。
まず接着するウェハをH2SO4−H2o2混合液、H
CN −H20□混合液、王水等で洗浄した後、10分
程度水洗し、スピンナーで脱水乾燥する。これらの処理
を経たウェハを1例えばクラス100以下の清浄な雰囲
気中に設置して実質的に異物が介在しない状態でその鏡
面研磨面同志を密着させる。これにより、2枚のウェハ
はある程度の強度をもって接着する。こうして接着した
基板を拡散炉等で熱処理することにより、接着強度が上
がり、2枚のウェハは完全に一体化される。接着強度の
向上は約200℃以上の熱処理で観4p1される。熱処
理の雰囲気は特に選ばず、酸素、窒素。
CN −H20□混合液、王水等で洗浄した後、10分
程度水洗し、スピンナーで脱水乾燥する。これらの処理
を経たウェハを1例えばクラス100以下の清浄な雰囲
気中に設置して実質的に異物が介在しない状態でその鏡
面研磨面同志を密着させる。これにより、2枚のウェハ
はある程度の強度をもって接着する。こうして接着した
基板を拡散炉等で熱処理することにより、接着強度が上
がり、2枚のウェハは完全に一体化される。接着強度の
向上は約200℃以上の熱処理で観4p1される。熱処
理の雰囲気は特に選ばず、酸素、窒素。
水素、不活性ガス、水蒸気、或いはこれらの混合雰囲気
中で行なうことができる。本実施例では7洗浄をH2S
O4−H202混合液とHCΩ−H202202℃行な
い、熱処理は少量の酸素を含む窒素中で1100’C,
2時間行なった。
中で行なうことができる。本実施例では7洗浄をH2S
O4−H202混合液とHCΩ−H202202℃行な
い、熱処理は少量の酸素を含む窒素中で1100’C,
2時間行なった。
実施例1
第1図に一実施例の誘電体分離シリコン・ウェハを示す
。11が活性層となる第1のシリコン層であり、一体化
後の研磨により50μmに厚みが調整されている。12
は第1のシリコン層11より厚い台ウェハとなる第2の
シリコン層であり。
。11が活性層となる第1のシリコン層であり、一体化
後の研磨により50μmに厚みが調整されている。12
は第1のシリコン層11より厚い台ウェハとなる第2の
シリコン層であり。
これらの接着界面に第1のシリコン酸化膜13が形成さ
れている。この第1のシリコン酸化膜13は、2μmの
熱酸化膜である。シリコン層12の裏面には、1μmの
第2のシリコン酸化膜14が形成され、更にその表面を
保護層としての5μmの多結晶シリコン膜15で覆って
いる。
れている。この第1のシリコン酸化膜13は、2μmの
熱酸化膜である。シリコン層12の裏面には、1μmの
第2のシリコン酸化膜14が形成され、更にその表面を
保護層としての5μmの多結晶シリコン膜15で覆って
いる。
第2図(a)(b)は、その製造工程を示す。
前述のように500 tt mの2枚のシリコン・ウェ
ハ2i、、22をそれぞれにI At 7′11のシリ
コン酸化膜231,24,232.25を形成した状態
で接着して一体化する(a)。そし゛Cシリコン・″1
エバ21側を研磨して厚みを50μmとし、シリコン・
ウェハ22側には多結晶シリコン膜26を堆積すること
により、第1図に示した所望の誘電体分離基板構造が得
られる(b)。
ハ2i、、22をそれぞれにI At 7′11のシリ
コン酸化膜231,24,232.25を形成した状態
で接着して一体化する(a)。そし゛Cシリコン・″1
エバ21側を研磨して厚みを50μmとし、シリコン・
ウェハ22側には多結晶シリコン膜26を堆積すること
により、第1図に示した所望の誘電体分離基板構造が得
られる(b)。
比較のため、多結晶シリコン膜15および第2のシリコ
ン酸化膜14がない他、実施例と同じ条件の基板を作っ
た。側基板の反りを比較した結果。
ン酸化膜14がない他、実施例と同じ条件の基板を作っ
た。側基板の反りを比較した結果。
実施例の方は反りがほとんどなく1本発明の効果が確認
された。
された。
実施例2
保護層として多結晶シリコン膜の代わりに0.3μmの
CVDシリコン窒化膜を用いた他。
CVDシリコン窒化膜を用いた他。
実施例1と同じ条件で誘電体分離基板を形成した。
この実施例でも、実施例1と同様反りのない基板が得ら
れた。
れた。
実施例3
第3図(a)(b)は、他の実施例の接着工程後の基板
構造である。この実施例では、第1のシリコン・ウェハ
31側に1μmのシリコン酸化膜33.34を形成し、
第2のシリコン・ウェハ32には酸化膜を設けない状態
で両者を接石し。
構造である。この実施例では、第1のシリコン・ウェハ
31側に1μmのシリコン酸化膜33.34を形成し、
第2のシリコン・ウェハ32には酸化膜を設けない状態
で両者を接石し。
その後水蒸気雰囲気中で熱処理をして接着基板の外側に
1μmのシリコン酸化膜35を形成している(a)。そ
してこの基板に600℃の減圧CVDて多結晶シリコン
膜36を2μm堆積し。
1μmのシリコン酸化膜35を形成している(a)。そ
してこの基板に600℃の減圧CVDて多結晶シリコン
膜36を2μm堆積し。
1100°Cで熱処理を行なった後、研磨して第1のシ
リコン・ウェハ31側を50μm厚に設定した(b)。
リコン・ウェハ31側を50μm厚に設定した(b)。
この実施例によれば、研磨する方即ち薄い活性層となる
方のみに酸化膜を形成しており1両方に酸化膜を形成す
る方法、或いは逆側に酸化膜を形成する方法に比べてよ
り基板の反りが小さくなることが明らかになった。また
、減圧CVDて成長させた多結晶シリコン膜を1100
℃で熱処理することにより、多結晶シリコン膜の化学的
耐久性が向上し、保護層として優れたものとなることが
分った。
方のみに酸化膜を形成しており1両方に酸化膜を形成す
る方法、或いは逆側に酸化膜を形成する方法に比べてよ
り基板の反りが小さくなることが明らかになった。また
、減圧CVDて成長させた多結晶シリコン膜を1100
℃で熱処理することにより、多結晶シリコン膜の化学的
耐久性が向上し、保護層として優れたものとなることが
分った。
実施例4
第4図(a)(b)に接着後の構造を示す。両面を研磨
して厚さ474μmとしたシリコン・ウェハ42に1両
面に熱酸化により1μmの酸化膜44.45を形成した
シリコン・ウェハ41と。
して厚さ474μmとしたシリコン・ウェハ42に1両
面に熱酸化により1μmの酸化膜44.45を形成した
シリコン・ウェハ41と。
同様に両面に1μmの酸化膜46.47を形成したシリ
コン・ウェハ43を両側から接着して一体化した(a)
。この接着基板を両側から研磨してシリコン・ウェハ4
1,43を厚み50μmに設定した(b)。第1図と比
較して、一方のウェハ41が活性層として第1のシリコ
ン層11に対応し、他方のウェハ47が保護層としての
多結晶シリコン膜15に対応する。
コン・ウェハ43を両側から接着して一体化した(a)
。この接着基板を両側から研磨してシリコン・ウェハ4
1,43を厚み50μmに設定した(b)。第1図と比
較して、一方のウェハ41が活性層として第1のシリコ
ン層11に対応し、他方のウェハ47が保護層としての
多結晶シリコン膜15に対応する。
この実施例の基板は上下対称であり2反りがなく1本発
明の効果が確認された。
明の効果が確認された。
なお2保護層の効果を確認するため、上記各実施例の基
板を1.096の弗酸に10分間浸し、保護層とその下
にある第2の酸化膜の状態および基板の反りを調べた。
板を1.096の弗酸に10分間浸し、保護層とその下
にある第2の酸化膜の状態および基板の反りを調べた。
その結果、保護層とその丁の酸化膜に異常は認められず
、基板の反りも認められなかった。
、基板の反りも認められなかった。
以上では、直接接着による誘電体分離基板を説明したが
1本発明は他の接着法1例えば静電接着法やスピンオン
グラス接着法等を用いた誘電体分離基数に同様に適用す
ることが可能である。
1本発明は他の接着法1例えば静電接着法やスピンオン
グラス接着法等を用いた誘電体分離基数に同様に適用す
ることが可能である。
[発明の効果]
以上述べたように本発明によれば、接萱技術による誘電
体分離基数に特有の応力歪みによる反りを防止ないし抑
制し、大口径化載板でのPEP工程の高精度化、素子の
微細化を図ることができる。
体分離基数に特有の応力歪みによる反りを防止ないし抑
制し、大口径化載板でのPEP工程の高精度化、素子の
微細化を図ることができる。
第1図は1本を明の一実施例の誘電体分離基板仝示す図
、第2図(a)(b)はその具体的な製造工程例を説明
するための図、第3図(a)(b)は他の製造工程例を
説明するための図、第4図(a)(b)は更に他の製造
工程例を説明するための図、第5図(a)〜(f)は従
来の誘電体基板の製造工程例を説明するための図、第6
図はその基板の反りを説明するための図である。 11・・・第1のシリコン層、12・・・第2のシリコ
ン層、13・・第1のシリコン酸化膜、14・・・第2
のシリコン酸化膜、15・・・多結晶シリコン股(保護
層)、21.31・第1のシリコン・ウェハ(第1の半
導体層)、22.32・・・第2のシリコン・ウェハ(
第2の半導体層)。 23.33・・・シリコン酸化膜(第1の絶縁膜)。 24.34・・・シリコン酸化膜、25.35中シリコ
ン酸化膜(第2の絶縁膜)、26.36・・・多結晶シ
リコン膜(保護層)、41・・・シリコン・ウェハ(第
1の半導体層)、42・・・シリコン・ウェハ(第2の
半導体層)、43・・・シリコン・ウェハ(保護層)、
44.47・シリコン酸化膜。 45・・・シリコン酸化膜(第1の絶縁膜)、46・・
・シリコン酸化膜(第2の絶縁膜)。 出願人代理人 弁理士 鈴江武彦 第1図 第2図 第3図 第50
、第2図(a)(b)はその具体的な製造工程例を説明
するための図、第3図(a)(b)は他の製造工程例を
説明するための図、第4図(a)(b)は更に他の製造
工程例を説明するための図、第5図(a)〜(f)は従
来の誘電体基板の製造工程例を説明するための図、第6
図はその基板の反りを説明するための図である。 11・・・第1のシリコン層、12・・・第2のシリコ
ン層、13・・第1のシリコン酸化膜、14・・・第2
のシリコン酸化膜、15・・・多結晶シリコン股(保護
層)、21.31・第1のシリコン・ウェハ(第1の半
導体層)、22.32・・・第2のシリコン・ウェハ(
第2の半導体層)。 23.33・・・シリコン酸化膜(第1の絶縁膜)。 24.34・・・シリコン酸化膜、25.35中シリコ
ン酸化膜(第2の絶縁膜)、26.36・・・多結晶シ
リコン膜(保護層)、41・・・シリコン・ウェハ(第
1の半導体層)、42・・・シリコン・ウェハ(第2の
半導体層)、43・・・シリコン・ウェハ(保護層)、
44.47・シリコン酸化膜。 45・・・シリコン酸化膜(第1の絶縁膜)、46・・
・シリコン酸化膜(第2の絶縁膜)。 出願人代理人 弁理士 鈴江武彦 第1図 第2図 第3図 第50
Claims (1)
- (1)素子分離誘電体膜となる第1の絶縁膜を介して接
着されて一体化された、第1の半導体層とこれより厚い
第2の半導体層とからなる誘電体分離半導体基板におい
て、前記第2の半導体層の裏面に第2の絶縁膜とこれを
覆う保護層が設けられていることを特徴とする誘電体分
離半導体基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63132303A JP2763107B2 (ja) | 1988-05-30 | 1988-05-30 | 誘電体分離半導体基板およびその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63132303A JP2763107B2 (ja) | 1988-05-30 | 1988-05-30 | 誘電体分離半導体基板およびその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01302740A true JPH01302740A (ja) | 1989-12-06 |
JP2763107B2 JP2763107B2 (ja) | 1998-06-11 |
Family
ID=15078145
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63132303A Expired - Lifetime JP2763107B2 (ja) | 1988-05-30 | 1988-05-30 | 誘電体分離半導体基板およびその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2763107B2 (ja) |
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JP2763107B2 (ja) | 1998-06-11 |
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