JPH01166375A - 同期信号の検出及び保護回路 - Google Patents
同期信号の検出及び保護回路Info
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- JPH01166375A JPH01166375A JP62325669A JP32566987A JPH01166375A JP H01166375 A JPH01166375 A JP H01166375A JP 62325669 A JP62325669 A JP 62325669A JP 32566987 A JP32566987 A JP 32566987A JP H01166375 A JPH01166375 A JP H01166375A
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- counter
- synchronization signal
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- G11B20/10—Digital recording or reproducing
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- G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
- G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel
- G11B27/19—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier
- G11B27/28—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording
- G11B27/30—Indexing; Addressing; Timing or synchronising; Measuring tape travel by using information detectable on the record carrier by using information signals recorded by the same method as the main recording on the same track as the main recording
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- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Synchronizing For Television (AREA)
- Television Signal Processing For Recording (AREA)
- Details Of Television Scanning (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野〕
この発明は、例えばディジタルオーディオディスク（所
謂コンパクトディスク）のフレーム同期の検出に適用さ
れる同期信号の検出及び保護回路に関する。
謂コンパクトディスク）のフレーム同期の検出に適用さ
れる同期信号の検出及び保護回路に関する。
この発明では、再生された同期信号とウィンドウ信号と
が供給されるゲート回路と、ゲート回路からの出力信号
と同期するように構成されると共に、再生信号から形成
されたクロック信号を計数し、内挿同期信号を発生する
第１のカウンタと、ゲート回路からの出力信号と同期す
るように構成されると共に、固定のクロック信号を計数
し、ウィンドウ信号を発生する第２のカウンタとが備え
られ、ゲート回路からの出力信号又は内挿同期信号を同
期検出出力とすることにより、フレーム同期信号の検出
を安定に行うことができる。
が供給されるゲート回路と、ゲート回路からの出力信号
と同期するように構成されると共に、再生信号から形成
されたクロック信号を計数し、内挿同期信号を発生する
第１のカウンタと、ゲート回路からの出力信号と同期す
るように構成されると共に、固定のクロック信号を計数
し、ウィンドウ信号を発生する第２のカウンタとが備え
られ、ゲート回路からの出力信号又は内挿同期信号を同
期検出出力とすることにより、フレーム同期信号の検出
を安定に行うことができる。
ディジタルオーディオディスクの再生信号は、フレーム
同期信号により区切られるフレーム構造を有している。
同期信号により区切られるフレーム構造を有している。
この再生信号は、ＥＦＭ （８−１４）変調されており
、復調するには、フレーム同期信号を基準として、フレ
ーム内の３３個のデータを区別する必要がある。このた
め、同期信号の検出回路が設けられる。
、復調するには、フレーム同期信号を基準として、フレ
ーム内の３３個のデータを区別する必要がある。このた
め、同期信号の検出回路が設けられる。
実際にはイディスクからの再生信号は、ディスクの傷等
により、フレーム同期信号と類似する信号が含まれたり
、フレーム同期信号の欠落が生じる。この問題に対処す
るために、フレーム同期信号の保護回路が必要とされる
。この種の同期信号の検出及び保護回路としては、例え
ば特開昭５８−９８８１３号公報に記載されているよう
に、多数決論理を使用するものが知られている。
により、フレーム同期信号と類似する信号が含まれたり
、フレーム同期信号の欠落が生じる。この問題に対処す
るために、フレーム同期信号の保護回路が必要とされる
。この種の同期信号の検出及び保護回路としては、例え
ば特開昭５８−９８８１３号公報に記載されているよう
に、多数決論理を使用するものが知られている。
従来では、基本的には、フレーム同期信号以外の信号を
同期信号と誤って検出するのを防止するのに、ウィンド
ウ保護を行っている。また、フレーム同期信号の欠落に
対処するために、内挿保護を行っていた。更に、内挿保
護が所定回数、続いたら、ウィンドウを開（ようにして
いた。
同期信号と誤って検出するのを防止するのに、ウィンド
ウ保護を行っている。また、フレーム同期信号の欠落に
対処するために、内挿保護を行っていた。更に、内挿保
護が所定回数、続いたら、ウィンドウを開（ようにして
いた。
従来の同期信号の検出及び保護回路では、ウィンドウ信
号を形成するのに、ＰＬＬで形成されたピットクロック
を使用していた。このピットクロックは、再生信号に同
期しているので、ディスクの傷等により乱された再生信
号に対しても追従して変化する。その結果、正しいフレ
ーム同期信号が得られているにもかかわらず、ウィンド
ウ信号のタイミングがずれる欠点があった。
号を形成するのに、ＰＬＬで形成されたピットクロック
を使用していた。このピットクロックは、再生信号に同
期しているので、ディスクの傷等により乱された再生信
号に対しても追従して変化する。その結果、正しいフレ
ーム同期信号が得られているにもかかわらず、ウィンド
ウ信号のタイミングがずれる欠点があった。
従って、この発明の目的は、フレーム同期信号の検出及
び保護を従来より安定にできる同期信号の検出及び保護
回路を提供することにある。
び保護を従来より安定にできる同期信号の検出及び保護
回路を提供することにある。
〔問題点を解決するための手段］
この発明では、再生された同期信号とウィンドウ信号と
が供給されるゲート回路と、ゲート回路からの出力信号
と同期するように構成されると共に、再生信号から形成
されたクロック信号を計数し、内挿同期信号を発生する
第１のカウンタと、ゲート回路からの出力信号と同期す
るように構成されると共に、固定のクロック信号を計数
し、ウィンドウ信号を発生する第２のカウンタとが備え
られ、ゲート回路からの出力信号又は内挿同期信号を同
期検出出力とされる。
が供給されるゲート回路と、ゲート回路からの出力信号
と同期するように構成されると共に、再生信号から形成
されたクロック信号を計数し、内挿同期信号を発生する
第１のカウンタと、ゲート回路からの出力信号と同期す
るように構成されると共に、固定のクロック信号を計数
し、ウィンドウ信号を発生する第２のカウンタとが備え
られ、ゲート回路からの出力信号又は内挿同期信号を同
期検出出力とされる。
ディジタルオーディオディスクからの再生信号から抽出
されたピットクロックを第１のカウンタが計数すること
により、内挿同期信号が形成される。この内挿同期信号
により、再生フレーム同期信号が消失する場合の内挿を
行うことができる。
されたピットクロックを第１のカウンタが計数すること
により、内挿同期信号が形成される。この内挿同期信号
により、再生フレーム同期信号が消失する場合の内挿を
行うことができる。
また、再生同期信号に対するウィンドウ信号は、固定の
クロック信号を計数する第２のカウンタにより形成され
る。固定のクロック信号を計数することにより、再生信
号から分離されたピットクロックが乱れた時でも、安定
にウィンドウ信号を発生することができる。従って、正
しいフレーム同期信号が再生される時に、このフレーム
同期信号がウィンドウの幅から外れることがなく、安定
にフレーム同期信号を検出することができる。
クロック信号を計数する第２のカウンタにより形成され
る。固定のクロック信号を計数することにより、再生信
号から分離されたピットクロックが乱れた時でも、安定
にウィンドウ信号を発生することができる。従って、正
しいフレーム同期信号が再生される時に、このフレーム
同期信号がウィンドウの幅から外れることがなく、安定
にフレーム同期信号を検出することができる。
以下、この発明の一実施例について説明する。
この説明は、下記の順序に従ってなされる。
ａ、ディジタルオーディオディスクの再生回路す、同期
信号の検出及び保護回路 ａ、ディジタルオーディオディスクの再生回路第１図は
、この発明を適用することができるディジタルオーディ
オディスクの再生回路の一例である。第１図において、
１がディジタルオーディオディスクを示す、このディジ
タルオーディオディスクｌから光ピツクアップ２により
再生されたＲＦ倍信号ＲＦアンプ３に供給される。
信号の検出及び保護回路 ａ、ディジタルオーディオディスクの再生回路第１図は
、この発明を適用することができるディジタルオーディ
オディスクの再生回路の一例である。第１図において、
１がディジタルオーディオディスクを示す、このディジ
タルオーディオディスクｌから光ピツクアップ２により
再生されたＲＦ倍信号ＲＦアンプ３に供給される。
第２図は、ディジタルオーディオディスクから再生され
るＲＦ倍信号フレーム構成を示している。
るＲＦ倍信号フレーム構成を示している。
■フレームの先頭に、２４チヤンネルビツトのフレーム
同期信号が位置し、次に、制御及び表示用のサブコード
の１シンボルが位置する。この後に、オーディオＰＣＭ
信号（１２シンボル）、エラー訂正コードのパリティ（
４シンボル）、オーディオＰＣＭ信号（１２シンボル）
及びパリティ（４シンボル）が順次位置している。１シ
ンボルは、１４チヤンネルビツトである。１フレームは
、下記のように、５８８チヤンネルビツトの長さとされ
ている。
同期信号が位置し、次に、制御及び表示用のサブコード
の１シンボルが位置する。この後に、オーディオＰＣＭ
信号（１２シンボル）、エラー訂正コードのパリティ（
４シンボル）、オーディオＰＣＭ信号（１２シンボル）
及びパリティ（４シンボル）が順次位置している。１シ
ンボルは、１４チヤンネルビツトである。１フレームは
、下記のように、５８８チヤンネルビツトの長さとされ
ている。
２４Ｘ１４ （オーディオ信号）＋８ｘ１４（パリティ
）＋ｌＸ１４ （サブコード）＋２４（フレーム同期
信号）＋３４Ｘ３（マージンビット）＝５８８チャンネ
ルビット ＲＦアンプ３の出力信号がＰＬＬから構成されたクロッ
ク抽出回路４に供給される。クロック抽出回路４からの
再生ＲＦ信号及びピットクロックがフレーム同期検出及
び保護回路５に供給される。
）＋ｌＸ１４ （サブコード）＋２４（フレーム同期
信号）＋３４Ｘ３（マージンビット）＝５８８チャンネ
ルビット ＲＦアンプ３の出力信号がＰＬＬから構成されたクロッ
ク抽出回路４に供給される。クロック抽出回路４からの
再生ＲＦ信号及びピットクロックがフレーム同期検出及
び保護回路５に供給される。
このフレーム同期検出及び保護回路５は、後述のように
、フレーム同期信号の検出と検出されたフレーム同期信
号の保護を行う。
、フレーム同期信号の検出と検出されたフレーム同期信
号の保護を行う。
フレーム同期検出及び保護回路５の出力には、ＥＦＭｍ
調回路６が設けられている。ＥＦＭ変調は、１シンボル
の８ビツトのパターンを好ましい（直流成分を少なくで
き、ビットクロックの抽出を容易とできる意味で）１４
ビツトのパターンに変換するチャンネルコーディングで
ある。ＥＦＭ復調回路６により、１シンボルが８ビツト
に戻された再生データが復号回路７に供給される。
調回路６が設けられている。ＥＦＭ変調は、１シンボル
の８ビツトのパターンを好ましい（直流成分を少なくで
き、ビットクロックの抽出を容易とできる意味で）１４
ビツトのパターンに変換するチャンネルコーディングで
ある。ＥＦＭ復調回路６により、１シンボルが８ビツト
に戻された再生データが復号回路７に供給される。
復号回路７では、エラー訂正符号（クロスインターリー
ブ・リード・ソロモン符号と称される）の復号がなされ
る。デイインターリーブ等のために再生データが書き込
まれるメモリ８が復号回路７と関連して設けられている
。前述のフレーム同期検出及び保護回路５からトラック
ジャンプ等によりフレーム同期がロックしなくなったこ
とを示す信号が復号回路７に供給されている。
ブ・リード・ソロモン符号と称される）の復号がなされ
る。デイインターリーブ等のために再生データが書き込
まれるメモリ８が復号回路７と関連して設けられている
。前述のフレーム同期検出及び保護回路５からトラック
ジャンプ等によりフレーム同期がロックしなくなったこ
とを示す信号が復号回路７に供給されている。
復号回路７から出力される再生オーディオデータがデー
タ補間回路９に供給される。データ補間回路９では、復
号回路７により訂正できなかったエラーデータに関して
、平均値補間、前値ホールド等の補間がされる。データ
補間回路９の出力信号がＤ／Ａ変換器１０Ｌ及びＩＯＨ
に供給され、オーディオＰＣＭ信号がアナログ信号に戻
される。
タ補間回路９に供給される。データ補間回路９では、復
号回路７により訂正できなかったエラーデータに関して
、平均値補間、前値ホールド等の補間がされる。データ
補間回路９の出力信号がＤ／Ａ変換器１０Ｌ及びＩＯＨ
に供給され、オーディオＰＣＭ信号がアナログ信号に戻
される。
これらのＤ／Ａ変換器１０Ｌ及びＩＯＲの夫々の出力信
号がローパスフィルタＩＩＬ及びＩＩＲを介して出力端
子１２Ｌ及び１２Ｒに取り出される。
号がローパスフィルタＩＩＬ及びＩＩＲを介して出力端
子１２Ｌ及び１２Ｒに取り出される。
フレーム同期検出及び保護回路５の出力側にサブコード
復調回路１３が設けられている。サブコード復調回路１
３から得られたサブコードがシステムコントローラ１４
に供給される。システムコントローラ１４と関連して、
操作部１５及び表示部１６が設けられている。
復調回路１３が設けられている。サブコード復調回路１
３から得られたサブコードがシステムコントローラ１４
に供給される。システムコントローラ１４と関連して、
操作部１５及び表示部１６が設けられている。
ディジタルオーディオディスク１を回転させるモータ１
７は、スピンドルサーボ回路１８により、ＣＬＶ （線
速度一定）で駆動される。光ピツクアップ２と関連して
、送りサーボ回路１９、トラッキングサーボ回路２０及
びフォーカスサーボ回路２１が設けられている。
７は、スピンドルサーボ回路１８により、ＣＬＶ （線
速度一定）で駆動される。光ピツクアップ２と関連して
、送りサーボ回路１９、トラッキングサーボ回路２０及
びフォーカスサーボ回路２１が設けられている。
ｂ、同期信号の検出及び保護回路
第３図は、フレーム同期検出及び保護回路５の一例を示
す。第３図において、３１及び３２は、夫々（ｍｏｄ、
５８Ｂ）のカウンタを示す。カウンタ３１は、端子３３
からのクロックＰＬＣを計数し、カウンタ３２は、端子
３４からのクロックＦＩＣを計数する。クロックＰＬＣ
は、クロック抽出回路４により、再生ＲＦ信号から取り
出されたピットクロックである。クロックＦＩＣは、例
えば水晶発振回路（図示せず）により形成された固定の
安定なりロックである。クロックＦＩＣの周波数は、ク
ロックＰＬＯの中心周波数と等しい４．３２１８ＭＨｚ
である。
す。第３図において、３１及び３２は、夫々（ｍｏｄ、
５８Ｂ）のカウンタを示す。カウンタ３１は、端子３３
からのクロックＰＬＣを計数し、カウンタ３２は、端子
３４からのクロックＦＩＣを計数する。クロックＰＬＣ
は、クロック抽出回路４により、再生ＲＦ信号から取り
出されたピットクロックである。クロックＦＩＣは、例
えば水晶発振回路（図示せず）により形成された固定の
安定なりロックである。クロックＦＩＣの周波数は、ク
ロックＰＬＯの中心周波数と等しい４．３２１８ＭＨｚ
である。
カウンタ３１及び３２の出力がデコーダ３５及び３６に
夫々供給される。デコーダ３５からは、カウンタ３１の
出力が５８８となる毎に内挿同期信号Ｎ５ＹＮＣが発生
し、デコーダ３６からは、カウンタ３２の出力が５８８
となるタイミングを中心として、（±８クロック）の幅
で１”となるウィンドウ信号ＬＭＡＳＫが発生する。カ
ウンタ３１及び３２は、ＡＮＤゲート４１からの検出同
期信号ＭＫＤＳＹにより、リセットされる。
夫々供給される。デコーダ３５からは、カウンタ３１の
出力が５８８となる毎に内挿同期信号Ｎ５ＹＮＣが発生
し、デコーダ３６からは、カウンタ３２の出力が５８８
となるタイミングを中心として、（±８クロック）の幅
で１”となるウィンドウ信号ＬＭＡＳＫが発生する。カ
ウンタ３１及び３２は、ＡＮＤゲート４１からの検出同
期信号ＭＫＤＳＹにより、リセットされる。
３７は、シフトレジスタを示し、このシフトレジスタ３
７に再生ＲＦ信号ＥＦＭがクロックＰＬＯにより取り込
まれる。シフトレジスタ３７は、２３ビツトのもので、
シフトレジスタ３７の出力信号がフレーム同期検出回路
４０に供給される。
７に再生ＲＦ信号ＥＦＭがクロックＰＬＯにより取り込
まれる。シフトレジスタ３７は、２３ビツトのもので、
シフトレジスタ３７の出力信号がフレーム同期検出回路
４０に供給される。
フレーム同期検出回路４０により、所定のビットパター
ンのフレーム同期信号が検出される。同期検出回路４０
からの再生同期信号５ＹＮＣがＡＮＤゲート４１に供給
される。ＡＮＤゲート４１の他方の入力信号として、Ｏ
Ｒゲート５７からのウィンドウ信号ＭＡＳＫが供給され
る。
ンのフレーム同期信号が検出される。同期検出回路４０
からの再生同期信号５ＹＮＣがＡＮＤゲート４１に供給
される。ＡＮＤゲート４１の他方の入力信号として、Ｏ
Ｒゲート５７からのウィンドウ信号ＭＡＳＫが供給され
る。
ＡＮＤゲート４１からの検出同期信号ＭＫＤＳＹが上述
のカウンタ３１及び３２に対してリセット信号として供
給されると共に、ＡＮＤゲート４２及びインバータ４３
に供給される。インバータ４３の出力信号がＡＮＤゲー
ト４４に供給される。
のカウンタ３１及び３２に対してリセット信号として供
給されると共に、ＡＮＤゲート４２及びインバータ４３
に供給される。インバータ４３の出力信号がＡＮＤゲー
ト４４に供給される。
これらのＡＮＤゲート４２及び４４には、デコーダ３５
からの内挿同期信号Ｎ５ＹＮＣが供給される。ＡＮＤゲ
ート４２から信号ＧＤＳＹが取り出されると共に、ＡＮ
Ｄゲート４４から信号ＮＧＳＹが取り出される。信号Ｇ
ＤＳＹは、検出同期信号ＭＫＤＳＹ及び内挿同期信号Ｎ
５ＹＮＣが同時に発生した時に得られる信号である。信
号ＮＧＳＹは、内挿同期信号Ｎ５ＹＮＣが発生した時に
、検出同期信号ＭＫＤＳＹが発生しない時に得られる信
号である。また、これらの信号ＧＤＳＹ及び信号ＮＣ３
Ｙにより、セット及びリセットされるＲＳフリップフロ
ップ４５が設けられ、ＲＳフリップフロップ４５から信
号ＧＦＳが取り出される。
からの内挿同期信号Ｎ５ＹＮＣが供給される。ＡＮＤゲ
ート４２から信号ＧＤＳＹが取り出されると共に、ＡＮ
Ｄゲート４４から信号ＮＧＳＹが取り出される。信号Ｇ
ＤＳＹは、検出同期信号ＭＫＤＳＹ及び内挿同期信号Ｎ
５ＹＮＣが同時に発生した時に得られる信号である。信
号ＮＧＳＹは、内挿同期信号Ｎ５ＹＮＣが発生した時に
、検出同期信号ＭＫＤＳＹが発生しない時に得られる信
号である。また、これらの信号ＧＤＳＹ及び信号ＮＣ３
Ｙにより、セット及びリセットされるＲＳフリップフロ
ップ４５が設けられ、ＲＳフリップフロップ４５から信
号ＧＦＳが取り出される。
上述の内挿同期信号Ｎ５ＹＮＣと検出同期信号ＭＫＤＳ
ＹがＯＲゲート４６に供給され、出力端子４７にリセッ
ト（ＲＥＳＥ’ｌ’）信号が取り出される。このリセッ
ト信号が再生ＲＦ信号中のフレーム同期信号に対応する
タイミングを規定する出力信号である。即ち、データク
ロックであるリセット信号を基準として、再生ＲＦ信号
の各シンボルが分離される。
ＹがＯＲゲート４６に供給され、出力端子４７にリセッ
ト（ＲＥＳＥ’ｌ’）信号が取り出される。このリセッ
ト信号が再生ＲＦ信号中のフレーム同期信号に対応する
タイミングを規定する出力信号である。即ち、データク
ロックであるリセット信号を基準として、再生ＲＦ信号
の各シンボルが分離される。
ＡＮＤゲート４２からの信号ＧＤＳＹがＮ１カウンタ４
８にクロック人力として供給される。ＡＮＤゲート４４
からの信号ＮＧＳＹがＮ２カウンタ４９にクロッグ入力
として供給される。Ｎ１カウンタ４８のキャリー出力が
ＯＲゲー）５０を介して自分自身のリセット入力とされ
ると共に、ＲＳフリップフロップ５２のリセット入力と
される。
８にクロック人力として供給される。ＡＮＤゲート４４
からの信号ＮＧＳＹがＮ２カウンタ４９にクロッグ入力
として供給される。Ｎ１カウンタ４８のキャリー出力が
ＯＲゲー）５０を介して自分自身のリセット入力とされ
ると共に、ＲＳフリップフロップ５２のリセット入力と
される。
ＯＲゲート５０の他方の入力として、ＲＳフリップフロ
ップ５２の出力信号ＧＤＦが供給されている。
ップ５２の出力信号ＧＤＦが供給されている。
Ｎ２カウンタ４９のキャリー出力がＯＲゲート５１を介
して自分自身のリセット人力とされると共に、ＯＲゲー
ト５３に供給される。ＯＲゲート５１の他方の入力とし
て、検出同期信号ＭＫＤＳＹが供給されている。ＯＲゲ
ート５３には、ＡＮＤゲート５４の出力信号と端子５５
からの信号とが供給される。ＡＮＤゲート５４には、Ｒ
Ｓフリップフロップ５２の出力信号Ｃ，ＤＦと信号ＮＧ
ＳＹとが供給されている。端子５５からの信号は、トラ
ッキングエラー等が発生した時に“１”となる信号であ
る。この信号は、トラックジャンプ後に、前方保護を外
す制御のために使用される。
して自分自身のリセット人力とされると共に、ＯＲゲー
ト５３に供給される。ＯＲゲート５１の他方の入力とし
て、検出同期信号ＭＫＤＳＹが供給されている。ＯＲゲ
ート５３には、ＡＮＤゲート５４の出力信号と端子５５
からの信号とが供給される。ＡＮＤゲート５４には、Ｒ
Ｓフリップフロップ５２の出力信号Ｃ，ＤＦと信号ＮＧ
ＳＹとが供給されている。端子５５からの信号は、トラ
ッキングエラー等が発生した時に“１”となる信号であ
る。この信号は、トラックジャンプ後に、前方保護を外
す制御のために使用される。
ＯＲゲート５３の出力信号がＳＲフリップフロップ５２
及び５６に対して夫々のセット入力として供給される。
及び５６に対して夫々のセット入力として供給される。
ＲＳフリップフロップ５６のリセット入力として、検出
同期信号ＭＫＤＳＹが供給される。ＲＳフリップフロッ
プ５６の出力に得られる信号ＧＴＯＰがＯＲゲート５７
に供給される。
同期信号ＭＫＤＳＹが供給される。ＲＳフリップフロッ
プ５６の出力に得られる信号ＧＴＯＰがＯＲゲート５７
に供給される。
このＯＲゲート５７には、ウィンドウ信号ＬＭＡＳＫが
供給されている。
供給されている。
上述のＮｌカウンタ４８は、信号ＧＤＳＹがＮ１回発生
したこと即ち、フレーム同期の検出がロックしているこ
とを検出する保護（後方保護）のために設けられている
。一方、Ｎ２カウンタ４９は、信号ＮＧＳＹがＮ２回発
生したこと即ち、ロックが外れたことを検出する保護（
前方保護）のために設けられている。−例として、（Ｎ
１＝２）（Ｎ２＝３）と設定されている。
したこと即ち、フレーム同期の検出がロックしているこ
とを検出する保護（後方保護）のために設けられている
。一方、Ｎ２カウンタ４９は、信号ＮＧＳＹがＮ２回発
生したこと即ち、ロックが外れたことを検出する保護（
前方保護）のために設けられている。−例として、（Ｎ
１＝２）（Ｎ２＝３）と設定されている。
第４図は、上述の一実施例の動作を示すタイミングチャ
ートである。第４図Ａがフレーム同期検出回路４０から
の再生同期信号５ＹＮＣを示す。
ートである。第４図Ａがフレーム同期検出回路４０から
の再生同期信号５ＹＮＣを示す。
第４図ＢがＡＮＤゲート４１に供給されるウィンドウ信
号ＭＡＳＫを示す。通常、第４図Ｊに示す信号ＧＴＯＰ
は、“０”であるため、デコーダ３６からのウィンドウ
信号ＬＭＡＳＫがウィンドウ信号ＭＡＳＫとなる。従っ
て、第４図Ｃに示す検出同期信号ＭＫＤＳＹが得られる
。
号ＭＡＳＫを示す。通常、第４図Ｊに示す信号ＧＴＯＰ
は、“０”であるため、デコーダ３６からのウィンドウ
信号ＬＭＡＳＫがウィンドウ信号ＭＡＳＫとなる。従っ
て、第４図Ｃに示す検出同期信号ＭＫＤＳＹが得られる
。
第４図りは、デコーダ３５から発生する内挿同期信号Ｎ
５ＹＮＣを示す。クロックＰＬＣの乱れにより、内挿同
期信号Ｎ５ＹＮＣは、周期が正規のものと異なるビット
スリップ或いは消失を含んでいる。第４図Ｃに示す検出
同期信号ＭＫＤＳＹと内挿同期信号Ｎ５ＹＮＣから第４
図已に示す信号ＧＤＳＹと第４図Ｆに示す信号ＮＧＳＹ
とが形成される。
５ＹＮＣを示す。クロックＰＬＣの乱れにより、内挿同
期信号Ｎ５ＹＮＣは、周期が正規のものと異なるビット
スリップ或いは消失を含んでいる。第４図Ｃに示す検出
同期信号ＭＫＤＳＹと内挿同期信号Ｎ５ＹＮＣから第４
図已に示す信号ＧＤＳＹと第４図Ｆに示す信号ＮＧＳＹ
とが形成される。
信号ＧＤＳＹがＮ１カウンタ４８に供給され、Ｎｌカウ
ンタ４８の出力が第４図Ｇに示すように、変化する。（
Ｎｌ＝２）と設定されているので、Ｎ１カウンタ４８は
、２迄計数すると、キャリー出力を発生し、このキャリ
ー出力により、Ｎ１カウンタ４８及びＲＳフリップフロ
ップ５２がリセットされる。従って、ＲＳフリップフロ
ップ５２の出力信号ＧＤＦが第４図１に示すように、“
０”である。また、信号ＮＧＳＹがＮ２カウンタ４９に
供給され、Ｎ２カウンタ４９の出力が第４図Ｈに示すよ
うに、変化する。Ｎ２カウンタ４９は、検出同期信号Ｍ
ＫＤＳＹにより、リセットされるので、Ｎ２カウンタ４
９からのキャリー出力が発生しない、従って、ＲＳフリ
ップフロップ５６からの信号ＧＴＯＰは、第４図Ｊに示
すように、４０“である。
ンタ４８の出力が第４図Ｇに示すように、変化する。（
Ｎｌ＝２）と設定されているので、Ｎ１カウンタ４８は
、２迄計数すると、キャリー出力を発生し、このキャリ
ー出力により、Ｎ１カウンタ４８及びＲＳフリップフロ
ップ５２がリセットされる。従って、ＲＳフリップフロ
ップ５２の出力信号ＧＤＦが第４図１に示すように、“
０”である。また、信号ＮＧＳＹがＮ２カウンタ４９に
供給され、Ｎ２カウンタ４９の出力が第４図Ｈに示すよ
うに、変化する。Ｎ２カウンタ４９は、検出同期信号Ｍ
ＫＤＳＹにより、リセットされるので、Ｎ２カウンタ４
９からのキャリー出力が発生しない、従って、ＲＳフリ
ップフロップ５６からの信号ＧＴＯＰは、第４図Ｊに示
すように、４０“である。
ＯＲゲート４６には、内挿同期信号Ｎ５ＹＮＣと検出同
期信号ＭＫＤＳＹが供給されているので、出力端子４７
には、第４図Ｋに示すリセット信号が取り出される。こ
のリセット信号において、内挿同期信号Ｎ５ＹＮＣ及び
検出同期信号ＭＫＤＳＹの両者が生じる場合、内挿同期
信号Ｎ５ＹＮＣと検出同期信号ＭＫＤＳＹとの間の期間
がバーストエラーの期間となる。しかし、このバースト
エラーの期間は、比較的短（、ディジタルオーディオデ
ィスクのエラー訂正符号により、訂正するこ、とができ
る。
期信号ＭＫＤＳＹが供給されているので、出力端子４７
には、第４図Ｋに示すリセット信号が取り出される。こ
のリセット信号において、内挿同期信号Ｎ５ＹＮＣ及び
検出同期信号ＭＫＤＳＹの両者が生じる場合、内挿同期
信号Ｎ５ＹＮＣと検出同期信号ＭＫＤＳＹとの間の期間
がバーストエラーの期間となる。しかし、このバースト
エラーの期間は、比較的短（、ディジタルオーディオデ
ィスクのエラー訂正符号により、訂正するこ、とができ
る。
第５図は、トラックジャンプ時等で、再生同期信号がエ
ラーとなった時の動作を示すタイミングチャートである
。第５図Ａに示すように、再生同期信号が消失したり、
正しくない再生同期信号（Ｘ印を付す）が発生している
。信号ＧＴＯＰ（第５図Ｊ）が°０”の時には、デコー
ダ３６から第５図已において、（±８クロック）の幅の
ウィンドウ信号ＬＭＡＳＫが発生している。従って、第
５図Ｃに示す検出同期信号ＭＫＤＳＹが得られる。この
検出同期信号ＭＫＤＳＹにより、カウンタ３１がリセッ
トされるので、第５図りに示す内挿同期信号Ｎ５ＹＮＣ
が発生する。従って、再生同期信号が消失した時でも、
内挿同期信号Ｎ５ＹＮＣが得られ、出力端子４７に第５
図Ｋに示すように、リセット信号が得られる。
ラーとなった時の動作を示すタイミングチャートである
。第５図Ａに示すように、再生同期信号が消失したり、
正しくない再生同期信号（Ｘ印を付す）が発生している
。信号ＧＴＯＰ（第５図Ｊ）が°０”の時には、デコー
ダ３６から第５図已において、（±８クロック）の幅の
ウィンドウ信号ＬＭＡＳＫが発生している。従って、第
５図Ｃに示す検出同期信号ＭＫＤＳＹが得られる。この
検出同期信号ＭＫＤＳＹにより、カウンタ３１がリセッ
トされるので、第５図りに示す内挿同期信号Ｎ５ＹＮＣ
が発生する。従って、再生同期信号が消失した時でも、
内挿同期信号Ｎ５ＹＮＣが得られ、出力端子４７に第５
図Ｋに示すように、リセット信号が得られる。
第５図Ｅ及び第５図Ｆは、夫々信号ＧＤＳＹ及びＮＧＳ
Ｙを示している。これらの信号ＧＤＳＹ及びＮＧＳＹを
Ｎ１カウンタ４Ｂ及びＮ２カウンタ４９が計数し、夫々
の出力が第５図Ｇ及び第５図Ｈに示すように変化する。
Ｙを示している。これらの信号ＧＤＳＹ及びＮＧＳＹを
Ｎ１カウンタ４Ｂ及びＮ２カウンタ４９が計数し、夫々
の出力が第５図Ｇ及び第５図Ｈに示すように変化する。
信号ＮＧＳＹが３個計数されると、Ｎ２カウンタ４９か
らキャリー出力が発生し、ＲＳフリップフロップ５２及
び５６がセットされる。従って、第５図Ｉ及び第５図Ｊ
に示すように、信号ＧＤＦ及び信号ＧＴＯＰが“ｌ”と
なる、ＲＳフリップフロップ５６は、検出同期信号ＭＫ
ＤＳＹにより、リセットされるので、第５図Ｊに示す信
号ＧＴＯＰが発生する。また、信号ＧＤＦが“１”の期
間で発生する信号ＮＧＳＹにより、ＲＳフリップフロッ
プ５６がセットされる。
らキャリー出力が発生し、ＲＳフリップフロップ５２及
び５６がセットされる。従って、第５図Ｉ及び第５図Ｊ
に示すように、信号ＧＤＦ及び信号ＧＴＯＰが“ｌ”と
なる、ＲＳフリップフロップ５６は、検出同期信号ＭＫ
ＤＳＹにより、リセットされるので、第５図Ｊに示す信
号ＧＴＯＰが発生する。また、信号ＧＤＦが“１”の期
間で発生する信号ＮＧＳＹにより、ＲＳフリップフロッ
プ５６がセットされる。
また、２個の信号ＧＤＳＹをＮｌカウンタ４８が計数す
ると、Ｎ１カウンタ４８からキャリー出力が発生し、Ｒ
Ｓフリップフロップ５２がリセットされる。従って、信
号ＧＤＦが第５図■に示すように、立ち下がる。
ると、Ｎ１カウンタ４８からキャリー出力が発生し、Ｒ
Ｓフリップフロップ５２がリセットされる。従って、信
号ＧＤＦが第５図■に示すように、立ち下がる。
第５図Ｋに示すリセット信号が出力端子４７に取り出さ
れる。信号ＧＴＯＰが“１”の期間でバーストエラーが
発生する。このエラーの期間を短くできる。
れる。信号ＧＴＯＰが“１”の期間でバーストエラーが
発生する。このエラーの期間を短くできる。
上述の動作説明から明らかなように、Ｎ１カウンタ４．
８は、フレ、−ム同期の検出動作が正常に復帰したこと
を検出する後方保護の動作を行い。Ｎ２カウンタ４９は
、フレーム同期の検出動作が誤っていることを検出する
前方保護の動作を行う。
８は、フレ、−ム同期の検出動作が正常に復帰したこと
を検出する後方保護の動作を行い。Ｎ２カウンタ４９は
、フレーム同期の検出動作が誤っていることを検出する
前方保護の動作を行う。
この両者の保護により、フレーム同期の検出動作が異常
となったこと及び検出動作が正常に復帰したことを迅速
に検出できる。
となったこと及び検出動作が正常に復帰したことを迅速
に検出できる。
この発明に依れば、カウンタが固定のクロック信号を計
数することにより、ウィンドウ信号を形成しているので
、ウィンドウ信号は、再生信号から抽出されたビットク
ロックに影響されない所定のタイミングで発生し、従っ
て、正規のフレーム同期信号が発生している場合に、こ
のフレーム同期信号を確実に検出することができる。
数することにより、ウィンドウ信号を形成しているので
、ウィンドウ信号は、再生信号から抽出されたビットク
ロックに影響されない所定のタイミングで発生し、従っ
て、正規のフレーム同期信号が発生している場合に、こ
のフレーム同期信号を確実に検出することができる。
第１図はこの発明を通用することができるディジタルオ
ーディオディスクの再生装置の一例のブロック図、第２
図はディジタルオーディオディスクの再生信号のフレー
ム構成を示す路線図、第３図はこの発明が通用されたフ
レーム同期検出及び保護回路のブロック図、第４図及び
第５図はフレーム同期検出及び保護回路の動作説明のた
めのタイミングチャートである。 図面における主要な符号の説明 １：ディジタルオーディオディスク、 ４：クロック抽出回路、 ５：フレーム同期検出及び保護回路、 ３１：第１のカウンタ、３２：第２のカウンタ、４０：
フレーム同期検出回路。 代理人 弁理士 杉 浦 正 知
ーディオディスクの再生装置の一例のブロック図、第２
図はディジタルオーディオディスクの再生信号のフレー
ム構成を示す路線図、第３図はこの発明が通用されたフ
レーム同期検出及び保護回路のブロック図、第４図及び
第５図はフレーム同期検出及び保護回路の動作説明のた
めのタイミングチャートである。 図面における主要な符号の説明 １：ディジタルオーディオディスク、 ４：クロック抽出回路、 ５：フレーム同期検出及び保護回路、 ３１：第１のカウンタ、３２：第２のカウンタ、４０：
フレーム同期検出回路。 代理人 弁理士 杉 浦 正 知
Claims (1)
- 【特許請求の範囲】 再生された同期信号とウィンドウ信号とが供給されるゲ
ート回路と、 上記ゲート回路からの出力信号と同期するように構成さ
れると共に、再生信号から形成されたクロック信号を計
数し、内挿同期信号を発生する第１のカウンタと、 上記ゲート回路からの出力信号と同期するように構成さ
れると共に、固定のクロック信号を計数し、上記ウィン
ドウ信号を発生する第２のカウンタとを備え、 上記ゲート回路からの出力信号又は上記内挿同期信号を
同期検出出力とするようにしたことを特徴とする同期信
号の検出及び保護回路。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62325669A JP2712212B2 (ja) | 1987-12-23 | 1987-12-23 | 同期信号の検出及び保護回路 |
| AU27037/88A AU629522B2 (en) | 1987-12-23 | 1988-12-19 | Circuit for detecting a synchronizing signal |
| US07/286,714 US4979192A (en) | 1987-12-23 | 1988-12-20 | Circuit for detecting a synchronizing signal |
| KR1019880017176A KR0124314B1 (ko) | 1987-12-23 | 1988-12-22 | 동기신호검출회로 |
| DE3888498T DE3888498T2 (de) | 1987-12-23 | 1988-12-23 | Schaltung zum Detektieren eines Synchronisierungssignals. |
| AT88121576T ATE103093T1 (de) | 1987-12-23 | 1988-12-23 | Schaltung zum detektieren eines synchronisierungssignals. |
| EP88121576A EP0322782B1 (en) | 1987-12-23 | 1988-12-23 | Circuit for detecting a synchronizing signal |
| HK181995A HK181995A (en) | 1987-12-23 | 1995-11-30 | Circuit for detecting a synchronizing signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62325669A JP2712212B2 (ja) | 1987-12-23 | 1987-12-23 | 同期信号の検出及び保護回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01166375A true JPH01166375A (ja) | 1989-06-30 |
| JP2712212B2 JP2712212B2 (ja) | 1998-02-10 |
Family
ID=18179393
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62325669A Expired - Lifetime JP2712212B2 (ja) | 1987-12-23 | 1987-12-23 | 同期信号の検出及び保護回路 |
Country Status (8)
| Country | Link |
|---|---|
| US (1) | US4979192A (ja) |
| EP (1) | EP0322782B1 (ja) |
| JP (1) | JP2712212B2 (ja) |
| KR (1) | KR0124314B1 (ja) |
| AT (1) | ATE103093T1 (ja) |
| AU (1) | AU629522B2 (ja) |
| DE (1) | DE3888498T2 (ja) |
| HK (1) | HK181995A (ja) |
Families Citing this family (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03173975A (ja) * | 1989-09-20 | 1991-07-29 | Canon Inc | 信号抽出方法および信号抽出装置 |
| JPH03185684A (ja) * | 1989-12-14 | 1991-08-13 | Asaka Co Ltd | マルチビーム光ディスク装置の同期信号検出回路 |
| JP2606090B2 (ja) * | 1993-07-14 | 1997-04-30 | 日本電気株式会社 | 光学的情報制御装置 |
| CA2114193A1 (en) * | 1994-01-25 | 1995-07-26 | Hiroyuki Shimizu | Time-division multiplex communication transmission apparatus |
| CN1040824C (zh) * | 1994-07-08 | 1998-11-18 | 日本胜利株式会社 | 数字调制/解调方法和设备 |
| JP2972657B2 (ja) * | 1997-06-20 | 1999-11-08 | 山形日本電気株式会社 | Ｅｆｍ信号のフレーム周期検出回路及びｅｆｍ信号再生用ビット同期クロック信号の周波数制御方法 |
| KR100287141B1 (ko) * | 1997-11-21 | 2001-04-16 | 윤종용 | 비정상동기신호제거방법 |
| KR100258332B1 (ko) * | 1997-12-26 | 2000-06-01 | 윤종용 | 싱크검출장치와 그에 따른 광 디스크 재생장치 |
| US6087867A (en) * | 1998-05-29 | 2000-07-11 | Lsi Logic Corporation | Transaction control circuit for synchronizing transactions across asynchronous clock domains |
| US6320881B1 (en) * | 1998-06-25 | 2001-11-20 | Cypress Semiconductor Corp. | Method, architecture and circuit for locking a data transmission frame |
| KR100555464B1 (ko) * | 1999-02-08 | 2006-03-03 | 삼성전자주식회사 | 광학시스템의 프레임 동기 신호 삽입 장치 및 방법 |
| JP2004007267A (ja) * | 2002-05-31 | 2004-01-08 | Panasonic Communications Co Ltd | Ｄｓｌモデム装置及びｄｓｌ通信における通信制御方法 |
| JP2004056432A (ja) * | 2002-07-19 | 2004-02-19 | Sony Corp | 同期信号検出装置、同期信号検出方法 |
| US7372928B1 (en) * | 2002-11-15 | 2008-05-13 | Cypress Semiconductor Corporation | Method and system of cycle slip framing in a deserializer |
| KR100524954B1 (ko) * | 2003-03-17 | 2005-11-01 | 삼성전자주식회사 | 광 디스크 시스템에서 데이터 복조 에러를 감소시키는프레임 싱크 신호 검출 장치 및 검출 방법 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6423765U (ja) * | 1987-07-29 | 1989-02-08 |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3159812A (en) * | 1962-03-26 | 1964-12-01 | Bell Telephone Labor Inc | Frame synchronization of pulse transmission systems |
| US4611335A (en) * | 1981-09-30 | 1986-09-09 | Hitachi, Ltd. | Digital data synchronizing circuit |
| CA1212729A (en) * | 1981-12-08 | 1986-10-14 | Hiroshi Ogawa | Digital signal detecting and compensating circuit with adjustable window signal |
| US4453260A (en) * | 1982-06-15 | 1984-06-05 | Tokyo Shibaura Denki Kabushiki Kaisha | Synchronizing circuit for detecting and interpolating sync signals contained in digital signal |
| JPS6083264A (ja) * | 1983-10-14 | 1985-05-11 | Nippon Gakki Seizo Kk | フレ−ム同期したカウンタ回路 |
| JPS60106073A (ja) * | 1983-11-14 | 1985-06-11 | Toshiba Corp | 記録再生装置 |
| JPH0640419B2 (ja) * | 1985-05-28 | 1994-05-25 | ソニー株式会社 | 同期信号の検出回路 |
| US4872155A (en) * | 1987-03-13 | 1989-10-03 | Pioneer Electronic Corporation | Clock generator circuit and a synchronizing signal detection method in a sampled format system and a phase comparator circuit suited for generation of the clock |
-
1987
- 1987-12-23 JP JP62325669A patent/JP2712212B2/ja not_active Expired - Lifetime
-
1988
- 1988-12-19 AU AU27037/88A patent/AU629522B2/en not_active Expired
- 1988-12-20 US US07/286,714 patent/US4979192A/en not_active Expired - Lifetime
- 1988-12-22 KR KR1019880017176A patent/KR0124314B1/ko not_active Expired - Lifetime
- 1988-12-23 DE DE3888498T patent/DE3888498T2/de not_active Expired - Lifetime
- 1988-12-23 EP EP88121576A patent/EP0322782B1/en not_active Expired - Lifetime
- 1988-12-23 AT AT88121576T patent/ATE103093T1/de not_active IP Right Cessation
-
1995
- 1995-11-30 HK HK181995A patent/HK181995A/en not_active IP Right Cessation
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6423765U (ja) * | 1987-07-29 | 1989-02-08 |
Also Published As
| Publication number | Publication date |
|---|---|
| HK181995A (en) | 1995-12-08 |
| DE3888498T2 (de) | 1994-06-23 |
| DE3888498D1 (de) | 1994-04-21 |
| AU629522B2 (en) | 1992-10-08 |
| EP0322782A3 (en) | 1991-02-27 |
| KR890010810A (ko) | 1989-08-10 |
| ATE103093T1 (de) | 1994-04-15 |
| EP0322782A2 (en) | 1989-07-05 |
| KR0124314B1 (ko) | 1997-11-28 |
| JP2712212B2 (ja) | 1998-02-10 |
| EP0322782B1 (en) | 1994-03-16 |
| US4979192A (en) | 1990-12-18 |
| AU2703788A (en) | 1989-06-29 |
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