JPH01109966A - 画像処理装置 - Google Patents
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- JPH01109966A JPH01109966A JP62268849A JP26884987A JPH01109966A JP H01109966 A JPH01109966 A JP H01109966A JP 62268849 A JP62268849 A JP 62268849A JP 26884987 A JP26884987 A JP 26884987A JP H01109966 A JPH01109966 A JP H01109966A
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- 230000000593 degrading effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
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- H04N1/48—Picture signal generators
- H04N1/486—Picture signal generators with separate detectors, each detector being used for one specific colour component
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、画像信号を処理する画像処理装置に関し、特
に平行に並べられたラインセンサからの画像信号の処理
に関するものである。
に平行に並べられたラインセンサからの画像信号の処理
に関するものである。
従来、平行に並べられたラインセンサを用い、原稿を読
み取る際、読み取り原稿上での各ラインセンサに対応す
る読み取り画素の位置が異なる。
み取る際、読み取り原稿上での各ラインセンサに対応す
る読み取り画素の位置が異なる。
そこで、同一画素上の画像データを得るために、ライン
センサそれぞれの読み取り駆動のタイミングを別々のタ
イミングで制御する必要があった。
センサそれぞれの読み取り駆動のタイミングを別々のタ
イミングで制御する必要があった。
〔発明が解決しようとしている問題点〕上記従来例では
、並列に並べられたラインセンサを、それぞれ異なった
タイミングで駆動するため、ラインセンサ間のクロスト
ークによるノイズ信号が発生し、画質が劣化するという
間層があった。
、並列に並べられたラインセンサを、それぞれ異なった
タイミングで駆動するため、ラインセンサ間のクロスト
ークによるノイズ信号が発生し、画質が劣化するという
間層があった。
本発明は上述の如き問題点を解決し、平行に並べられた
ラインセンサの駆動タイミングをほぼ同一で行うことを
可能とした画像処理装置の提供を目的としている。その
構成として、倍率（等倍を含む）及びラインセンサ間の
間隔に応じて画像信号の補間を行う補間手段を用いて、
みかけ上同−位置の読取信号を得るものである。
ラインセンサの駆動タイミングをほぼ同一で行うことを
可能とした画像処理装置の提供を目的としている。その
構成として、倍率（等倍を含む）及びラインセンサ間の
間隔に応じて画像信号の補間を行う補間手段を用いて、
みかけ上同−位置の読取信号を得るものである。
以下、図面にて本発明の実施例を示す。
第１図は、本実施例の画像処理装置のブロック図である
。同図において、１−１はＲ（レッド）カラーセンサ、
ｌ−２はＧ（グリーン）カラーセンサ、１−３はＢ（ブ
ルー）カラーセンサ、１−４．１−５゜１−６はアナロ
グ／デジタル変換器、ｌ−７はＲセンサ信号遅延メモリ
、１−８はＧセンサ信号遅延メモリ、■−９はＲセンサ
信号補間器、１−１０はＧセンサ信号補間器である。■
−１１はクロック発生器でセンサ１−１． １−２．
１−３を同一のクロックより駆動する。クロック発生器
はプリンタ或は第２図のマイクロプロセッサから送られ
る水平同期信号に同期して画素クロック（ＣＣＤの転送
りロックを発生する）。
。同図において、１−１はＲ（レッド）カラーセンサ、
ｌ−２はＧ（グリーン）カラーセンサ、１−３はＢ（ブ
ルー）カラーセンサ、１−４．１−５゜１−６はアナロ
グ／デジタル変換器、ｌ−７はＲセンサ信号遅延メモリ
、１−８はＧセンサ信号遅延メモリ、■−９はＲセンサ
信号補間器、１−１０はＧセンサ信号補間器である。■
−１１はクロック発生器でセンサ１−１． １−２．
１−３を同一のクロックより駆動する。クロック発生器
はプリンタ或は第２図のマイクロプロセッサから送られ
る水平同期信号に同期して画素クロック（ＣＣＤの転送
りロックを発生する）。
第２図は第１図の遅延メモリ１−７． １−８及び補間
器１−９．１−１０の構成図である。
器１−９．１−１０の構成図である。
２−１はＦＩＦＯメモリで構成されるＲ信号遅延メモリ
、２−２はＦＩＦＯメモリで構成されるＧ信号遅延メモ
リ、２−３及び２−４はＦＩＦＯメモリのどの部分のセ
ンサラインデータを乗算器に送るかを選択するセレクタ
、２−’５． ２−６． ２−７． ２−８は乗算器、
２−９．２−１０は加算器である。２−１４は倍率等を
入力し、表示する操作部、２−１１はマイクロプロセッ
サであり、操作部２−１４から倍率データに基づいて乗
算器２−５． ２−６． ２−７． ２−８及びセレク
タ２−３．２−４を制御する。
、２−２はＦＩＦＯメモリで構成されるＧ信号遅延メモ
リ、２−３及び２−４はＦＩＦＯメモリのどの部分のセ
ンサラインデータを乗算器に送るかを選択するセレクタ
、２−’５． ２−６． ２−７． ２−８は乗算器、
２−９．２−１０は加算器である。２−１４は倍率等を
入力し、表示する操作部、２−１１はマイクロプロセッ
サであり、操作部２−１４から倍率データに基づいて乗
算器２−５． ２−６． ２−７． ２−８及びセレク
タ２−３．２−４を制御する。
第３図は３ライン並列カラーセンサの構成図である。３
０１はＲ（レッド）ラインセンサ、３０２はＧ（グリー
ン）ラインセンサ、３０３はＢ（ブルー）ラインセンサ
、３０４はカラーセンサＩＣ本体である。
０１はＲ（レッド）ラインセンサ、３０２はＧ（グリー
ン）ラインセンサ、３０３はＢ（ブルー）ラインセンサ
、３０４はカラーセンサＩＣ本体である。
本実施例において、ラインセンサ間の間隔１８０μｍ１
センサ画素幅ｌＯμｍであり、等倍読み取り時に必要な
第２図２−１及び２−２の遅延メモリサイズは、それぞ
れ２−１のＲ信号遅延メモリが３６ラインメモリ、Ｇ信
号２−２のＧ信号遅延メモリが１８ラインメモリである
。
センサ画素幅ｌＯμｍであり、等倍読み取り時に必要な
第２図２−１及び２−２の遅延メモリサイズは、それぞ
れ２−１のＲ信号遅延メモリが３６ラインメモリ、Ｇ信
号２−２のＧ信号遅延メモリが１８ラインメモリである
。
本実施例では、１００％〜４００％までの副走査方向の
変倍を可能とする為に、第２図２−１のＲ信号遅延メモ
リサイズは１４４ラインメモリ、Ｇ信号遅延メモリサイ
ズは７２ラインメモリで構成されている。
変倍を可能とする為に、第２図２−１のＲ信号遅延メモ
リサイズは１４４ラインメモリ、Ｇ信号遅延メモリサイ
ズは７２ラインメモリで構成されている。
第４図は読み取り装置構成図である。
４０１はカラーセンサＩＣ本体、４０２はＲラインセン
サ、４０３はＧラインセンサ、４０４はＢラインセンサ
、４０５は第３反射ミラー、４０６は第２反射ミラー、
４０７は第１反射ミラー、４０８は原稿板ガラス、４０
９は原稿圧板、４１１は原稿を露光する照明ランプ、４
１２は結像レンズ、４１０は読み取り装置本体である。
サ、４０３はＧラインセンサ、４０４はＢラインセンサ
、４０５は第３反射ミラー、４０６は第２反射ミラー、
４０７は第１反射ミラー、４０８は原稿板ガラス、４０
９は原稿圧板、４１１は原稿を露光する照明ランプ、４
１２は結像レンズ、４１０は読み取り装置本体である。
原稿は図中矢印方向に走査される。
第５図は、第２図マイクロプロセッサ２−１１の処理流
れ図である。
れ図である。
以下、第５図の処理流れ図に従って説明する。
変倍率Ｎ、ｍをＲセンサとＢセンサ間の距離をセンサの
副走査方向の距離或は等倍時の副走査方向の読取画素ピ
ッチで割った数とする。
副走査方向の距離或は等倍時の副走査方向の読取画素ピ
ッチで割った数とする。
今、１０５％の副走査方向の変倍をする場合について考
えると、Ｎ＝１．０５倍率。前述した通り、本実施例で
はｍ＝３６であるからＲラインセンサとＢラインセンサ
の間隔内に含まれる画素数はＮＸｍ＝１．０５Ｘ３６＝
３７．８ （画素）となる。ここでＮＸｍは倍率Ｎにお
けるセンサ間の読取画素数である。
えると、Ｎ＝１．０５倍率。前述した通り、本実施例で
はｍ＝３６であるからＲラインセンサとＢラインセンサ
の間隔内に含まれる画素数はＮＸｍ＝１．０５Ｘ３６＝
３７．８ （画素）となる。ここでＮＸｍは倍率Ｎにお
けるセンサ間の読取画素数である。
第２図２−１のＦＩＦＯメモリにおいて＋３７ラインの
画素データをＤ （３７）、＋３８ラインの画素データ
をＤ （３８）とし、式（１）の線形演算により現在Ｂ
（ブルー）センサが読みとって、いる原稿位置と同じ位
置に対応するＲ（レッド）信号の値を求める。
画素データをＤ （３７）、＋３８ラインの画素データ
をＤ （３８）とし、式（１）の線形演算により現在Ｂ
（ブルー）センサが読みとって、いる原稿位置と同じ位
置に対応するＲ（レッド）信号の値を求める。
Ｄ （３７，８） ＝０．２ＸＤ （３７） ＋０．８
ＸＤ （３８）・・・・・式（１）上記補間処理に対応
する制御をマイクロプロセッサ２−１１が行う。
ＸＤ （３８）・・・・・式（１）上記補間処理に対応
する制御をマイクロプロセッサ２−１１が行う。
５００でＮ、ｍをセットし、５０１でマイクロプロセッ
サ２−１１は式（２）の演算を行う。
サ２−１１は式（２）の演算を行う。
Ａ＝ＮＸｍ・［ＮＸｍ］・・・・・・・・・・・・式（
２）ここで［］は少数部を切り捨てる整数化処理である
。
２）ここで［］は少数部を切り捨てる整数化処理である
。
本実施例の場合、ｍ＝３６であるから１０５％の副走査
方向変倍の場合、 Ａ＝３６Ｘ１．０５・ ［３６Ｘ１．０５］ ＝０．８
・・・・・・・・式（３）となる。
方向変倍の場合、 Ａ＝３６Ｘ１．０５・ ［３６Ｘ１．０５］ ＝０．８
・・・・・・・・式（３）となる。
５０２でマイクロプロセッサ２−１１は、乗算器２−５
に係数Ａを乗算係数として設定する。
に係数Ａを乗算係数として設定する。
５０３で［Ｎ Ｘ ｍ ］の値を求め、セレクタ２−３
の設定を行う。［Ｎ Ｘ ｍ ］の値は変倍時のＲライ
ンセンサとＢラインセンサの副走査方向の画素間隔の整
数部分である。ｍ＝３６． Ｎ＝１．０５の場合［ＮＸ
ｍＸｍコニ３フり、ＦＩＦＯメそり２−１のＤ （３７
） （： ＋３７ラインの画素データ）のデータが乗算
器２−６に流れ、ＦＩＦＯメモリ２−１のＤ （３７＋
１）のデータが乗算器２−５に流れる様、マイクロプロ
セッサ２−１１はセレクタ２−３の設定を行う。
の設定を行う。［Ｎ Ｘ ｍ ］の値は変倍時のＲライ
ンセンサとＢラインセンサの副走査方向の画素間隔の整
数部分である。ｍ＝３６． Ｎ＝１．０５の場合［ＮＸ
ｍＸｍコニ３フり、ＦＩＦＯメそり２−１のＤ （３７
） （： ＋３７ラインの画素データ）のデータが乗算
器２−６に流れ、ＦＩＦＯメモリ２−１のＤ （３７＋
１）のデータが乗算器２−５に流れる様、マイクロプロ
セッサ２−１１はセレクタ２−３の設定を行う。
５０４で（１−Ａ）の値を求め、乗算器２−６に乗算の
係数として設定する。こうして式（１）の演算が行われ
、Ｒのデータが得られる。
係数として設定する。こうして式（１）の演算が行われ
、Ｒのデータが得られる。
次にＧのデータを求める為に、式（４）の演算を行う。
Ｅ＝ＮＸ ｆ ・［ＮＸ ｊ！’］・・・・・・・・・
・・・式（４）ここでｌはＧセンサとＢセンサ間の距離
をセンサの副走査方向の距離、或は等倍時の読取画素ピ
ッチで割った数である。
・・・式（４）ここでｌはＧセンサとＢセンサ間の距離
をセンサの副走査方向の距離、或は等倍時の読取画素ピ
ッチで割った数である。
本実施例の場合１＝１８であるから、今１０５％の副走
査方向の変倍をする場合、 Ｎ＝１．０５であり、ＮＸ ｆ ＝１８．９であるから
、Ｄ （１８，９） ＝０．ＩＸＤ （１８） ＋０．
９ＸＤ （１９）・・・・式（５）を求める必要がある
。そこで、 Ｅ＝１８Ｘ１．０５・ ［１８刈、０５］ ＝０．９・
・・・・・・・式（６）を設定し、５０６で［ＮＸｊ７
］の値を求め、セレクタ２−４の設定を行う。［ＮＸｊ
７］の値は、変倍時のＧラインセンサとＢラインセンサ
の副走査方向の画素間隔の整数部分である。４２ ＝１
８． Ｎ＝１．０５の場合［ＮＸｊｌ！］＝１８であ
り、ＦＩＦＯメモリ２−２のＤ （１８） （＋１８ラ
インの画素データ）のデータが加算器２−８に流れ、Ｆ
ＩＦＯメモリ２−２のＤ （１８＋１）ラインのデータ
が乗算器２−７に流れる様マイクロプロセッサ２−１１
はセレクタ２−４の設定を行う。
査方向の変倍をする場合、 Ｎ＝１．０５であり、ＮＸ ｆ ＝１８．９であるから
、Ｄ （１８，９） ＝０．ＩＸＤ （１８） ＋０．
９ＸＤ （１９）・・・・式（５）を求める必要がある
。そこで、 Ｅ＝１８Ｘ１．０５・ ［１８刈、０５］ ＝０．９・
・・・・・・・式（６）を設定し、５０６で［ＮＸｊ７
］の値を求め、セレクタ２−４の設定を行う。［ＮＸｊ
７］の値は、変倍時のＧラインセンサとＢラインセンサ
の副走査方向の画素間隔の整数部分である。４２ ＝１
８． Ｎ＝１．０５の場合［ＮＸｊｌ！］＝１８であ
り、ＦＩＦＯメモリ２−２のＤ （１８） （＋１８ラ
インの画素データ）のデータが加算器２−８に流れ、Ｆ
ＩＦＯメモリ２−２のＤ （１８＋１）ラインのデータ
が乗算器２−７に流れる様マイクロプロセッサ２−１１
はセレクタ２−４の設定を行う。
５０７でＥ＝０．９の値を乗算係数として乗算器２−７
に設定する。５０８で（１−Ｅ） ＝０．１の値を乗算
器２−８に乗算係数として設定する。こうして式（４）
の演算が行われ、ＧのデータＤ （１８，９）が求めら
れる。
に設定する。５０８で（１−Ｅ） ＝０．１の値を乗算
器２−８に乗算係数として設定する。こうして式（４）
の演算が行われ、ＧのデータＤ （１８，９）が求めら
れる。
以上の例はｍ 、 ｉ！が整数であったが、実際にはＲ
センサとＢセンサ間及びＧセンサとＢセンサ間の距離を
正確に作成することは難しい。例えばセンサの副走査方
向の距離（或は、等倍時の副走査方向の読取画素間隔）
を１０μｍとした時、ＲセンサとＢセンサの距離が３６
５μｍ、Ｇセンサと Ｂセンサの距離が１７８μｍとな
った場合には、ｍは３６，５、ｌは１７．８となる。こ
の場合には等倍時、即ちＮ＝１．０の場合にも補間処理
が必要となり、式（１）２式（４）は夫々下記の如（な
る。
センサとＢセンサ間及びＧセンサとＢセンサ間の距離を
正確に作成することは難しい。例えばセンサの副走査方
向の距離（或は、等倍時の副走査方向の読取画素間隔）
を１０μｍとした時、ＲセンサとＢセンサの距離が３６
５μｍ、Ｇセンサと Ｂセンサの距離が１７８μｍとな
った場合には、ｍは３６，５、ｌは１７．８となる。こ
の場合には等倍時、即ちＮ＝１．０の場合にも補間処理
が必要となり、式（１）２式（４）は夫々下記の如（な
る。
Ａ’ ＝ＩＸ３６．５− ［ｌＸ３６．５］ ＝０．５
、“、Ｄ （３６，５） ＝０．５ｘＤ （３６） ＋
０．５ｘＤ （３７）・・・・・式（１）′Ｅ’ ＝
ｌｘｉ７．８− ［１ｘ１７．８コ ＝０．８、’、
Ｄ （１７，８） ＝０．２ＸＤ （１７） ＋〇、８
ＸＤ （１８）・・・・・式（２）′いづれにしても第
５図の流れ図により実現できる。
、“、Ｄ （３６，５） ＝０．５ｘＤ （３６） ＋
０．５ｘＤ （３７）・・・・・式（１）′Ｅ’ ＝
ｌｘｉ７．８− ［１ｘ１７．８コ ＝０．８、’、
Ｄ （１７，８） ＝０．２ＸＤ （１７） ＋〇、８
ＸＤ （１８）・・・・・式（２）′いづれにしても第
５図の流れ図により実現できる。
次に本発明の第２実施例について説明する。
並行に並べられたラインセンサ間の等倍時、読み取り画
素間隔をｔとすると、副走査方向Ｎ倍変倍時、ラインセ
ンサ間の変倍時画素間隔はＮＸｔとなる。
素間隔をｔとすると、副走査方向Ｎ倍変倍時、ラインセ
ンサ間の変倍時画素間隔はＮＸｔとなる。
ＮＸｔが整数となる時、すなわち変倍時、ラインセンサ
間の読み取り画素間隔が読み取り単位画素間隔の整数倍
である時は、第１図１−９．１−１０の補間演算は不要
となる。従って副走査方向変倍時ＮＸｔの値が少数部の
値を持つ時は、補間演算をし、Ｎ Ｘ ｔ、の値が整数
の時は補間演算をしない様にすれば、補間演算に伴う、
デジタル演算誤差を小さくすることができる。
間の読み取り画素間隔が読み取り単位画素間隔の整数倍
である時は、第１図１−９．１−１０の補間演算は不要
となる。従って副走査方向変倍時ＮＸｔの値が少数部の
値を持つ時は、補間演算をし、Ｎ Ｘ ｔ、の値が整数
の時は補間演算をしない様にすれば、補間演算に伴う、
デジタル演算誤差を小さくすることができる。
第６図は第２実施例に関する信号処理ブロック図である
。
。
６−１はＲｏ（レッド）ラインセンサ、６−２はＧ（グ
リーン）ラインセンサ、６−３はＢ（ブルー）ラインセ
ンサである。各ラインセンサはクロック発生器６−１３
により、水平同期信号に同期して同一のタイミングで発
生される画素クロックにより駆動される。
リーン）ラインセンサ、６−３はＢ（ブルー）ラインセ
ンサである。各ラインセンサはクロック発生器６−１３
により、水平同期信号に同期して同一のタイミングで発
生される画素クロックにより駆動される。
６−４． ６−５．６−６はアナログ／デジタル変換器
、６−７はＲラインセンサ信号の遅延メモリ、６−８は
Ｂラインセンサ信号の遅延メモリである。
、６−７はＲラインセンサ信号の遅延メモリ、６−８は
Ｂラインセンサ信号の遅延メモリである。
６−９は信号セレクタであり、ＮＸｔ＋が整数である場
合、補間演算器６−１１をバイパスする様制御され、Ｎ
Ｘ ｔ ＋が少数部を持つ場合、補間演算器６−１１
を信号が流れる様制御される。（ｔ＋：Ｒラインセンサ
とＢラインセンサの等倍時画素間隔）６−１０は信号セ
レクタであり、ＮＸｔ２（ｔ２：ＧラインセンサとＢラ
インセンサの等倍時画素間隔）が繋数の場合、補間演算
器６−１２をバイパスする様制御され、ＮＸｔ２が少数
部を持つ場合、補間演算器６−１２を信号が流れる様制
御される。
合、補間演算器６−１１をバイパスする様制御され、Ｎ
Ｘ ｔ ＋が少数部を持つ場合、補間演算器６−１１
を信号が流れる様制御される。（ｔ＋：Ｒラインセンサ
とＢラインセンサの等倍時画素間隔）６−１０は信号セ
レクタであり、ＮＸｔ２（ｔ２：ＧラインセンサとＢラ
インセンサの等倍時画素間隔）が繋数の場合、補間演算
器６−１２をバイパスする様制御され、ＮＸｔ２が少数
部を持つ場合、補間演算器６−１２を信号が流れる様制
御される。
又、ＮＸｔの値が整数値のみをとる様Ｎの値を限定する
と、すなわちＮＸｔの値が整数の値となる。
と、すなわちＮＸｔの値が整数の値となる。
変倍のみを読み取り装置が実行する時は、補間演算が不
要となり遅延メモリのみで画像同期制御が可能となる。
要となり遅延メモリのみで画像同期制御が可能となる。
次に本発明の第３実施例について説明する。
前記、実施例は３ラインカラーセンサについてのもので
あったが、例えば赤画像と白黒画像を読み取る２ライン
センサの場合でも、本方式の回路構成により、センサ間
の読み取り画素間隔を制御することは可能である。
あったが、例えば赤画像と白黒画像を読み取る２ライン
センサの場合でも、本方式の回路構成により、センサ間
の読み取り画素間隔を制御することは可能である。
第７図は２ラインセンサの構成図である。７０１は赤の
みに感度を有する赤ラインセンサであり、７０２は可視
全波長域に感度を有する白黒ラインセンサである。
みに感度を有する赤ラインセンサであり、７０２は可視
全波長域に感度を有する白黒ラインセンサである。
第８図は２ラインセンサの場合の信号処理ブロック図で
ある。
ある。
８−１は赤ラインセンサ、８−２は白黒ラインセンサ、
８−３．８−４はアナログ／デジタル変換器、８−５は
赤信号遅延メモリ、８−６は補間演算器、８−１３はク
ロック発生器で、センサ８−１゜８−２を同一の画素ク
ロックで駆動するものである。
８−３．８−４はアナログ／デジタル変換器、８−５は
赤信号遅延メモリ、８−６は補間演算器、８−１３はク
ロック発生器で、センサ８−１゜８−２を同一の画素ク
ロックで駆動するものである。
補間演算器８−６は第１１第２の実施例と同様に動作す
る。
る。
以上説明した様に、本実施例に依れば並行に並べられた
ラインセンサ間の画像データの同期制御に関し、入力さ
れたデジタル画像信号に対し、補間演算を行う事により
、各々のラインセンサの駆動タイミングを同一にしなが
ら画像同期制御が行え、ラインセンサ相互のクロストー
クの発生を押えることができる。
ラインセンサ間の画像データの同期制御に関し、入力さ
れたデジタル画像信号に対し、補間演算を行う事により
、各々のラインセンサの駆動タイミングを同一にしなが
ら画像同期制御が行え、ラインセンサ相互のクロストー
クの発生を押えることができる。
又、変倍読み取り時、或は等倍時でもセンサ間隔が読取
画素ピッチの整数倍でないときも、補間処理により同一
位置の画像データを得ることができる。又、センサ間隔
が読取画素ピッチの整数倍となったときは、各々のライ
ンセンサの駆動タイミングを同一にしながら補間演算を
行わないで画像同期制御が行える。
画素ピッチの整数倍でないときも、補間処理により同一
位置の画像データを得ることができる。又、センサ間隔
が読取画素ピッチの整数倍となったときは、各々のライ
ンセンサの駆動タイミングを同一にしながら補間演算を
行わないで画像同期制御が行える。
本発明に依れば、はぼ同一のタイミングで複数のライン
センサを駆動することにより、各ラインセンサ間のクロ
ストークの発生を防止できると共に、各ラインセンサに
ついてみかけ上、同−位置−の画像信号を得ることが可
能となる。
センサを駆動することにより、各ラインセンサ間のクロ
ストークの発生を防止できると共に、各ラインセンサに
ついてみかけ上、同−位置−の画像信号を得ることが可
能となる。
第１図は本発明の第１の実施例の信号処理ブロック図、
第２図は遅延メモリ及び補間演算の構成図、第３図は３
ライン並列カラーセンサの構成図、第４図は読み取り装
置構成図、 第５図はマイクロプロセッサの処理流れ図、第６図は第
２実施例に関する信号処理ブロック図、第７図は第３実
施例の２ラインセンサの構成図、第８図は第３実施例の
信号処理ブロック図である。
ライン並列カラーセンサの構成図、第４図は読み取り装
置構成図、 第５図はマイクロプロセッサの処理流れ図、第６図は第
２実施例に関する信号処理ブロック図、第７図は第３実
施例の２ラインセンサの構成図、第８図は第３実施例の
信号処理ブロック図である。
Claims (1)
- 【特許請求の範囲】 所定の間隔を置いて並列に配列された複数のラインセン
サ、 前記複数のラインセンサからほぼ同一のタイミングで並
列に画像信号を取り出す手段、 画像の倍率及び前記所定の間隔に応じて画像信号を遅延
する遅延手段、及び、 前記倍率及び前記所定の間隔に応じて画像信号の補間を
行う補間手段より成ることを特徴とする画像処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62268849A JP2632876B2 (ja) | 1987-10-23 | 1987-10-23 | 画像処理装置 |
| US07/255,466 US4953014A (en) | 1987-10-23 | 1988-10-11 | Image processing apparatus compensating for distance between document portions read by respective sensors |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62268849A JP2632876B2 (ja) | 1987-10-23 | 1987-10-23 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01109966A true JPH01109966A (ja) | 1989-04-26 |
| JP2632876B2 JP2632876B2 (ja) | 1997-07-23 |
Family
ID=17464121
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62268849A Expired - Lifetime JP2632876B2 (ja) | 1987-10-23 | 1987-10-23 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4953014A (ja) |
| JP (1) | JP2632876B2 (ja) |
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1987
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-
1988
- 1988-10-11 US US07/255,466 patent/US4953014A/en not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| US4953014A (en) | 1990-08-28 |
| JP2632876B2 (ja) | 1997-07-23 |
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