JP7247124B2 - 半導体モジュール - Google Patents

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Description

本開示は、半導体モジュールに関する。
半導体モジュールは、発電、送電、効率的なエネルギーの利用又は再生など、あらゆる場面で利用される。昨今、半導体モジュールの耐湿性の要求が高くなっている。モジュール内部への水分の侵入経路の形成を防ぐため、封止材内の気泡の発生を抑制する必要がある。これに対して、封止材を注入するための注入口と排気口をフタに設けた半導体モジュールが提案されている(例えば、特許文献1参照)。注入時に封止材内に気泡が形成されても排気口から気泡が排出される。
特開2008-103514号公報
しかし、注入口と排気口の両方をフタに設ける必要があるため、封止材が大気に露出する面積が増え、耐湿性が損なわれるという問題がある。
本開示は、上述のような課題を解決するためになされたもので、その目的は耐湿性を向上させることができる半導体モジュールを得るものである。
本開示に係る半導体モジュールは、ケースと、前記ケースの内部に設けられた半導体チップと、前記ケースの内部に注入され前記半導体チップを封止する封止材と、前記封止材の上面に接するように前記ケースの内部に設けられたフタとを備え、前記フタの端部の上面側にテーパーが設けられ、前記フタの前記端部の側面と前記ケースの内側面との間に隙間が設けられ、前記隙間から前記テーパーに前記封止材が這い上がっており、前記フタの下面に中央部が突出した錘状の突出部が設けられていることを特徴とする。
本開示では、フタの端部の上面側にテーパーが設けられ、フタの端部の側面とケースの内側面との間に隙間が設けられ、隙間からテーパーに封止材が這い上がっている。これにより、気泡が含まれないように封止材がケースの内部に充填されたことを容易に確認することができるため、気泡からの水分の侵入を防ぐことができる。また、隙間は、樹脂注入が必要ないことから低面積化できる。従って、水分の侵入経路を低面積化して水分透過性を下げることができるため、半導体モジュール内への水分の侵入量が少なくなり、耐湿性を向上させることができる。
実施の形態1に係る半導体モジュールを示す断面図である。 実施の形態1に係る半導体モジュールを示す上面図である。 図2の破線で囲った部分を拡大した上面図である。 実施の形態1に係る半導体モジュールの製造工程を示す断面図である。 実施の形態1に係る半導体モジュールの製造工程を示す断面図である。 実施の形態1に係る半導体モジュールの製造工程を示す断面図である。 実施の形態2に係る半導体モジュールのフタを示す断面図である。 実施の形態2に係る半導体モジュールを示す断面図である。 実施の形態2に係る半導体モジュールの製造工程を示す断面図である。 実施の形態3に係る半導体モジュールのフタの下面側を示す斜視図である。 実施の形態3に係る半導体モジュールのフタを示す上面図である。 図11のI-IIに沿った断面図である。 実施の形態3に係る半導体モジュールのフタを示す側面図である。 実施の形態3に係る半導体モジュールのフタを示す下面図である。 実施の形態4に係る半導体モジュールのフタを示す上面図である。 図15のI-IIに沿った断面図である。 実施の形態4に係る半導体モジュールを示す断面図である。 実施の形態5に係る半導体モジュールのフタを示す上面図である。 図18のI-IIに沿った断面図である。 実施の形態5に係る半導体モジュールを示す断面図である。 実施の形態6に係る半導体モジュールのフタを示す上面図である。 図21のI-IIに沿った断面図である。 実施の形態6に係る半導体モジュールを示す断面図である。 実施の形態6に係る半導体モジュールのフタを封止材の上面に載せる様子を示す断面図である。
実施の形態に係る半導体モジュールについて図面を参照して説明する。同じ又は対応する構成要素には同じ符号を付し、説明の繰り返しを省略する場合がある。
実施の形態1.
図1は、実施の形態1に係る半導体モジュールを示す断面図である。図2は、実施の形態1に係る半導体モジュールを示す上面図である。図1は図2のI-IIに沿った断面図である。図3は図2の破線で囲った部分を拡大した上面図である。
ベース板1の上に樹脂製又はセラミック製の絶縁層3が形成されている。絶縁層3の上に回路パターン4が形成されている。回路パターン4に半導体チップ5がはんだ6により実装されている。半導体チップ5はIGBTチップ又はダイオードチップである。ケース7が回路パターン4及び半導体チップ5を囲むようにベース板1及び絶縁層3の外周部に接合されている。ケース7の端子電極8と半導体チップ5の上面電極がワイヤ9により接続されている。
シリコンゲルなどの封止材10がケース7の内部に注入され半導体チップ5及びワイヤ9を封止している。封止材10の上面に接するようにケース7の内部にフタ11が設けられている。フタ11の端部の上面側にテーパー12が設けられている。フタ11の端部の側面とケース7の内側面との間に隙間13が設けられている。隙間13からテーパー12に封止材10が這い上がっている。
図4から図6は、実施の形態1に係る半導体モジュールの製造工程を示す断面図である。まず、図4に示すように、ケース7の内部に封止材10を注入して半導体チップ5及びワイヤ9を封止する。次に、図5に示すように、封止材10の上面にフタ11を載せる。この際にフタ11と封止材10の界面に気泡が形成される場合がある。封止材10内に気泡があると、水分の侵入経路となる。ただし、気泡が形成されたとしても、フタ11を封止材10側に押し込むことでケース7とフタ11の隙間13から気泡が排出される。このため、キュア後の封止材10に気泡が含まれない状態を確保できる。
また、フタ11を封止材10側に押し込むと、図6に示すように隙間13からフタ11のテーパー12に封止材10が這い上がる。この様子を観察することで、気泡が含まれないように封止材10がケース7の内部に充填されたことを容易に確認することができる。このため、キュア後の封止材10の出来栄えをX線などで確認する工程が不要となる。また、封止材10とフタ11の間に気泡が含まれないため、気泡からの水分の侵入を防ぐことができる。
水分は大気と接する封止材10の上面からケース7の内部へ侵入する。これに対し、本実施の形態ではケース7とフタ11の隙間13が水分の侵入経路となる。従来技術では、樹脂注入するためにフタに設けられた注入口の直径を5mm以上にする必要があるため、注入口からの水分の侵入経路を低面積化できない。一方、本実施の形態の隙間13は、樹脂注入が必要ないことから低面積化できる。従って、水分の侵入経路を低面積化して水分透過性を下げることができるため、半導体モジュール内への水分の侵入量が少なくなり、耐湿性を向上させることができる。
例えば、低粘度の封止材10を用いた場合は、隙間13による開口は2mm×1mm程度の長方形でもよい。ここで、2mmはケース7の内部空間又はフタ11の幅、1mmは隙間13の幅である。ただし、隙間13を通ってテーパー12に封止材10が這い上がるのに必要な隙間13の幅の下限値は1mmに限らず、封止材10の粘度、フタ11への押さえ力などの様々な要素に依存する。封止材10として非常に粘度の低い樹脂を用いた場合が、隙間13の幅が0.5mm以下でも隙間13を通ってテーパー12に封止材10が這い上がることができる。一方、水分の侵入を抑制するため、隙間13の幅は2mm以下にすることが好ましい。ただし、隙間13の幅の上限値は、半導体モジュールのサイズ、使用するフタ11の種類、吸湿を抑制したい半導体チップ5などの部材、封止材10の厚みなどの様々な要素に依存する。
実施の形態2.
図7は、実施の形態2に係る半導体モジュールのフタを示す断面図である。図8は、実施の形態2に係る半導体モジュールを示す断面図である。本実施の形態では、フタ11の下面に中央部が封止材10に向かって突出した錘状の突出部14が設けられている。
図9は、実施の形態2に係る半導体モジュールの製造工程を示す断面図である。封止材10の上面にフタ11を載せた時に封止材10とフタ11の界面に気泡が形成されたとしても、突出部14のテーパーに沿って気泡が押し出され、ケース7とフタ11の隙間13から排出される。これにより、気泡の排出機能が実施の形態1よりも高くなる。そして、隙間13の面積を小さくすることができる。この結果、半導体モジュール内への水分の侵入量が少なくなり、耐湿性を更に向上させることができる。
実施の形態3.
図10は、実施の形態3に係る半導体モジュールのフタの下面側を示す斜視図である。図11は、実施の形態3に係る半導体モジュールのフタを示す上面図である。図12は図11のI-IIに沿った断面図である。図13は、実施の形態3に係る半導体モジュールのフタを示す側面図である。図14は、実施の形態3に係る半導体モジュールのフタを示す下面図である。
フタ11の端部に向かって封止材10が流れる流路15がフタ11の下面に設けられている。流路15の両サイドには封止材10の流れる方向を制限するための壁が設けられている。その流路15の先端にケース7とフタ11の隙間13ができる。ここで、封止材10は突出部14のテーパーに沿ってフタ11の外周全体に向けて流れ、流れる方向が限定されない。これに対して、封止材10は流路15に沿って隙間13に向かって流れる。
上記のように流路15を設けることにより気泡の排出機能が更に高くなる。そして、隙間13の面積を更に小さくすることができる。この結果、半導体モジュール内への水分の侵入量が少なくなり、耐湿性を更に向上させることができる。
実施の形態4.
図15は、実施の形態4に係る半導体モジュールのフタを示す上面図である。図16は図15のI-IIに沿った断面図である。図17は、実施の形態4に係る半導体モジュールを示す断面図である。フタ11の下面に外周から中央に向けて凹むように錐状の凹部16が設けられている。凹部16の頂点にフタ11を厚み方向に貫通する穴17が設けられている。
封止材10の上面にフタ11を載せた時に封止材10とフタ11の界面に気泡が形成されたとしても、錐状の凹部16のテーパーに沿って気泡が押し出され、穴17から排出される。低粘度の封止材10を用いた場合は直径2mm程度の穴17でも気泡を十分に排出できる。ただし、気泡を排出できる穴17の直径の下限値は様々な要素に依存する。一方、水分の侵入を抑制するため、穴17の直径は5mm以下にすることが好ましい。ただし、穴の直径の上限値は様々な要素に依存する。
上記のように穴17の直径を小さくすることができるため、水分の侵入経路を低面積化でき、低面積部の水分透過性が下がる。このため、半導体モジュール内への水分の侵入量が少なくなり、耐湿性を向上させることができる。また、ケース7とフタ11の間に隙間13を設ける必要がないので設計自由度が向上する。
実施の形態5.
図18は、実施の形態5に係る半導体モジュールのフタを示す上面図である。図19は図18のI-IIに沿った断面図である。図20は、実施の形態5に係る半導体モジュールを示す断面図である。錐状の凹部16と穴17がフタ11に2つ設けられている。
半導体モジュールのサイズの仕様上、錐状の凹部16の高さを増やせない場合、フタ11に凹部16と穴17を複数設ける。これにより、凹部16のテーパーの傾斜が大きくなるため、気泡の排出機能が高くなる。また、ケース7内においてワイヤ9がフタ11の外周部周辺にある場合に、ワイヤ9を避けて錐状の凹部16を形成することができるため、設計自由度が向上する。
実施の形態6.
図21は、実施の形態6に係る半導体モジュールのフタを示す上面図である。図22は図21のI-IIに沿った断面図である。図23は、実施の形態6に係る半導体モジュールを示す断面図である。穴17は、フタ11の下面側の第1の穴17aと、第1の穴17aに対してフタ11の上面側に配置され第1の穴17aよりも開口面積が広い第2の穴17bとを有する。従って、穴17は、フタ11の上面側の開口面積がフタ11の下面側の開口面積よりも広い。なお、穴17は、開口面積が異なる2つの穴からなる構成に限らず、テーパー形状でもよい。
図24は、実施の形態6に係る半導体モジュールのフタを封止材の上面に載せる様子を示す断面図である。フタ11を封止材10側に押し込むと、フタ11の上面側にある開口面積が広い第2の穴17bに封止材10が這い上がる。この様子を観察することで、封止材10がケース7の内部に隙間なく充填されたことを容易に確認することができる。このため、キュア後の封止材10の出来栄えをX線などで確認する工程が不要となる。また、封止材10とフタ11の間に隙間が無くなるため、当該隙間からの水分の侵入を防ぐことができる。
なお、実施の形態1-6において、可視光に対して透明なフタ11を用いてもよい。これにより、気泡有無の視認性が向上し、気泡が入り込む異常が発生した際の検知が容易になる。また、封止材10としてシリコンゲルではなく、耐吸湿性の高いエポキシ樹脂を使用してもよい。これにより、半導体モジュール内への水分の侵入量が更に少なくなり、耐湿性を向上させることができる。
なお、半導体チップ5は、珪素によって形成されたものに限らず、珪素に比べてバンドギャップが大きいワイドバンドギャップ半導体によって形成されたものでもよい。ワイドバンドギャップ半導体は、例えば、炭化珪素、窒化ガリウム系材料、又はダイヤモンドである。このようなワイドバンドギャップ半導体によって形成された半導体チップは、耐電圧性や許容電流密度が高いため、小型化できる。この小型化された半導体チップを用いることで、この半導体チップを組み込んだ半導体モジュールも小型化・高集積化できる。また、半導体チップの耐熱性が高いため、ヒートシンクの放熱フィンを小型化でき、水冷部を空冷化できるので、半導体モジュールを更に小型化できる。また、半導体チップの電力損失が低く高効率であるため、半導体モジュールを高効率化できる。
5 半導体チップ、7 ケース、10 封止材、11 フタ、12 テーパー、13 隙間、14 突出部、15 流路、16 凹部、17,17a,17b 穴

Claims (8)

  1. ケースと、
    前記ケースの内部に設けられた半導体チップと、
    前記ケースの内部に注入され前記半導体チップを封止する封止材と、
    前記封止材の上面に接するように前記ケースの内部に設けられたフタとを備え、
    前記フタの端部の上面側にテーパーが設けられ、
    前記フタの前記端部の側面と前記ケースの内側面との間に隙間が設けられ、
    前記隙間から前記テーパーに前記封止材が這い上がっており、
    前記フタの下面に中央部が突出した錘状の突出部が設けられていることを特徴とする半導体モジュール。
  2. 前記フタの前記端部に向かって前記封止材が流れる流路が前記フタの下面に設けられていることを特徴とする請求項に記載の半導体モジュール。
  3. ケースと、
    前記ケースの内部に設けられた半導体チップと、
    前記ケースの内部に注入され前記半導体チップを封止する封止材と、
    前記封止材の上面に接するように前記ケースの内部に設けられたフタとを備え、
    前記フタの下面全面に錐状の凹部が設けられ、
    前記凹部の頂点に前記フタを厚み方向に貫通する穴が設けられていることを特徴とする半導体モジュール。
  4. 前記フタに前記凹部と前記穴が複数設けられていることを特徴とする請求項に記載の半導体モジュール。
  5. 前記穴は、前記フタの上面側の開口面積が前記フタの下面側の開口面積よりも広いことを特徴とする請求項又はに記載の半導体モジュール。
  6. 前記フタは透明であることを特徴とする請求項1~の何れか1項に記載の半導体モジュール。
  7. 前記封止材はエポキシ樹脂であることを特徴とする請求項1~の何れか1項に記載の半導体モジュール。
  8. 前記半導体チップはワイドバンドギャップ半導体によって形成されていることを特徴とする請求項1~の何れか1項に記載の半導体モジュール。
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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN113916068B (zh) * 2021-12-13 2022-04-12 成都瑞迪威科技有限公司 一种弹载产品抗过载灌封工艺

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017107915A (ja) 2015-12-07 2017-06-15 株式会社デンソー 電子回路装置
WO2019239615A1 (ja) 2018-06-12 2019-12-19 三菱電機株式会社 パワー半導体モジュール及び電力変換装置

Family Cites Families (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59110141A (ja) * 1982-12-15 1984-06-26 Fuji Electric Co Ltd 半導体装置の製造方法
JPS60216571A (ja) 1984-04-11 1985-10-30 Mitsubishi Electric Corp 半導体装置
JP2874720B2 (ja) 1991-10-25 1999-03-24 日本電気株式会社 混成集積回路装置
JP3142398B2 (ja) * 1992-11-06 2001-03-07 三菱電機株式会社 携帯用半導体装置及びその製造方法
JPH06268102A (ja) 1993-01-13 1994-09-22 Fuji Electric Co Ltd 樹脂封止形半導体装置
US5693981A (en) * 1993-12-14 1997-12-02 Lsi Logic Corporation Electronic system with heat dissipating apparatus and method of dissipating heat in an electronic system
US5909056A (en) * 1997-06-03 1999-06-01 Lsi Logic Corporation High performance heat spreader for flip chip packages
TW411595B (en) * 1999-03-20 2000-11-11 Siliconware Precision Industries Co Ltd Heat structure for semiconductor package device
US6987032B1 (en) * 2002-07-19 2006-01-17 Asat Ltd. Ball grid array package and process for manufacturing same
US6979594B1 (en) * 2002-07-19 2005-12-27 Asat Ltd. Process for manufacturing ball grid array package
DE10310842B4 (de) * 2003-03-11 2007-04-05 Infineon Technologies Ag Elektronisches Bauteil mit Halbleiterchip und Kunststoffgehäuse
US7527090B2 (en) * 2003-06-30 2009-05-05 Intel Corporation Heat dissipating device with preselected designed interface for thermal interface materials
US7250576B2 (en) * 2005-05-19 2007-07-31 International Business Machines Corporation Chip package having chip extension and method
US20080042302A1 (en) * 2006-08-16 2008-02-21 Crispell Robert B Plastic overmolded packages with molded lid attachments
JP5358056B2 (ja) 2006-10-19 2013-12-04 矢崎総業株式会社 電子部品装置
US7989942B2 (en) * 2009-01-20 2011-08-02 Altera Corporation IC package with capacitors disposed on an interposal layer
US20140167243A1 (en) * 2012-12-13 2014-06-19 Yuci Shen Semiconductor packages using a chip constraint means
GB2514547A (en) * 2013-05-23 2014-12-03 Melexis Technologies Nv Packaging of semiconductor devices
JP6589631B2 (ja) * 2015-12-25 2019-10-16 富士電機株式会社 半導体装置
JP7077157B2 (ja) 2018-06-26 2022-05-30 エヌ・イーケムキャット株式会社 パラジウムを非成型の活性炭粒子表面に偏在担持した活性炭触媒の製造方法

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2017107915A (ja) 2015-12-07 2017-06-15 株式会社デンソー 電子回路装置
WO2019239615A1 (ja) 2018-06-12 2019-12-19 三菱電機株式会社 パワー半導体モジュール及び電力変換装置

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