JP7005604B2 - 統合されたエピタキシャル金属電極 - Google Patents

統合されたエピタキシャル金属電極 Download PDF

Info

Publication number
JP7005604B2
JP7005604B2 JP2019515652A JP2019515652A JP7005604B2 JP 7005604 B2 JP7005604 B2 JP 7005604B2 JP 2019515652 A JP2019515652 A JP 2019515652A JP 2019515652 A JP2019515652 A JP 2019515652A JP 7005604 B2 JP7005604 B2 JP 7005604B2
Authority
JP
Japan
Prior art keywords
layer
metal
layered structure
metal layer
rare earth
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
JP2019515652A
Other languages
English (en)
Other versions
JP2019535134A5 (ja
JP2019535134A (ja
Inventor
ロドニー ペルゼル,
アンドリュー クラーク,
リーティス ダルジス,
パトリック チン,
マイケル レビー,
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
IQE PLC
Original Assignee
IQE PLC
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by IQE PLC filed Critical IQE PLC
Publication of JP2019535134A publication Critical patent/JP2019535134A/ja
Publication of JP2019535134A5 publication Critical patent/JP2019535134A5/ja
Application granted granted Critical
Publication of JP7005604B2 publication Critical patent/JP7005604B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/0226Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
    • H01L21/02293Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process formation of epitaxial layers by a deposition process
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/49Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
    • H01L29/51Insulating materials associated therewith
    • H01L29/511Insulating materials associated therewith with a compositional variation, e.g. multilayer structures
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/02414Oxide semiconducting materials not being Group 12/16 materials, e.g. ternary compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02172Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides
    • H01L21/02175Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides characterised by the metal
    • H01L21/02178Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides characterised by the metal the material containing aluminium, e.g. Al2O3
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/02373Group 14 semiconducting materials
    • H01L21/02381Silicon, silicon germanium, germanium
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/0242Crystalline insulating materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/02433Crystal orientation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02439Materials
    • H01L21/02483Oxide semiconducting materials not being Group 12/16 materials, e.g. ternary compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02439Materials
    • H01L21/02488Insulating materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02439Materials
    • H01L21/02491Conductive materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02494Structure
    • H01L21/02496Layer structure
    • H01L21/02502Layer structure consisting of two layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02494Structure
    • H01L21/02496Layer structure
    • H01L21/02505Layer structure consisting of more than two layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02521Materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having at least one potential-jump barrier or surface barrier, e.g. PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic System or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
    • H01L21/28008Making conductor-insulator-semiconductor electrodes
    • H01L21/28017Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/40Electrodes ; Multistep manufacturing processes therefor
    • H01L29/43Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
    • H01L29/49Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
    • H01L29/51Insulating materials associated therewith
    • H01L29/517Insulating materials associated therewith the insulating material comprising a metallic compound, e.g. metal oxide, metal silicate

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Chemical & Material Sciences (AREA)
  • Materials Engineering (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Ceramic Engineering (AREA)
  • Recrystallisation Techniques (AREA)
  • Crystals, And After-Treatments Of Crystals (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)
  • Electrodes Of Semiconductors (AREA)

Description

(関連出願の引用)
本願は、米国仮出願第62/398,416号(2016年9月22日出願)の米国特許法§119(e)に基づく利益を主張し、上記出願は、その全体が参照により本明細書に引用される。本願は、同時係属の米国出願第______号(______出願、代理人事件番号111848-0016-101)に関連し、上記出願は、その全体が参照により本明細書に引用される。
(使用の分野)
本用途は、半導体設計に関し、より具体的には、エピタキシャル金属が下側エピタキシャル酸化物と上側エピタキシャル半導体との間に導入される統合されたエピタキシャル金属電極のための層状構造に関する。
エピタキシ、エピタキシャル成長、およびエピタキシャル堆積は、結晶基板上の結晶層の成長または堆積を指す。結晶層は、エピタキシャル層と称される。結晶基板は、テンプレートとしての役割を果たし、結晶層の配向および格子間隔を決定する。結晶層は、いくつかの例では、格子整合または格子合致されることができる。格子整合結晶層は、結晶基板の上部表面と同一または非常に類似する格子間隔を有することができる。格子合致結晶層は、結晶基板の格子間隔整数倍数である格子間隔を有することができる。エピタキシの品質は、部分的に結晶層の結晶度に基づく。実践上、高品質エピタキシャル層は、最小限の瑕疵を伴い、殆どまたは全く粒界を伴わない単結晶であろう。従来、金属接触層が、上流処理におけるある点においてエピタキシャル構造に適用される。多くの場合、2つ以上の素子機能性を組み込む今日の複雑なエピタキシャル構造では、これは、大量のトポグラフィを伴うウエハ上における金属の広範なエッチングおよび堆積を要求し得る。
金属と半導体との間の相互作用は、多くの場合、素子動作に重要である。金属と半導体との間のそのような相互作用の一例は、全体的音響性能が電極の音響インピーダンスと圧電材料の音響インピーダンスの積によって定義されるRFフィルタ等の薄膜共振器において生じる。実際、高共振周波数にアクセスするために、電極および圧電材料の両方を非常に薄くすることが不可欠である。これは、異なる厚さの金属電極に対してAlNの厚さの関数としての共振周波数を示す図17に要約されている(その全体が参照することによって組み込まれる、S.Tanifuji、他のProceedings 2009 IEEE International Ultrasonic Symposium,p.2170から引用)。ここでは、結晶品質も、重要である。何故なら、それがなければ、多結晶金属層内の瑕疵および結晶粒界の増加影響に起因して、抵抗率が厚さが減少するにつれて増加すると考えられるからである。
InPの成長も、Zheng、他のJournal of Applied Physics,vol.111,p.123112(2012年)(その全体が参照することによって組み込まれる)に説明されるように、シリコンエンジニアリング基板を覆う金属上で試みられている。しかしながら、Zhengは、エピタキシャルではなく、多結晶である膜を説明している。
イットリア安定化ジルコニア(YSZ)上での金属のエピタキシャル成長は、Gsell、他のJournal of Crystal Growth,vol.311,p.3731(2009年)(その全体が参照することによって組み込まれる)に説明されている。Gsellは、YSZを使用することによって下層シリコン基板から金属を分離することを説明しており、これが、任意のエピタキシャル金属の望ましくないケイ素化を防止するからである。YSZは、ジルコニアおよびイットリア標的を使用してスパッタリングされた(またはパルスレーザ堆積を用いて堆積された)材料である。それは、単結晶材料ではなく、結晶粒界を有し、混合結晶性(立方晶系および正方晶系)であり得る。したがって、それは、金属のエピタキシャル成長のために準最適テンプレートである。加えて、YSZ/シリコン界面の制御は、技術的に困難である。
故に、半導体材料を覆って良好な結晶品質の金属をエピタキシャルに成長させることは、困難であることが証明されている。
層状構造内に統合されたエピタキシャル金属電極の使用のためのシステムおよび方法が本明細書に説明され、半導体層が、エピタキシャル金属電極を覆って成長させられ得る。本明細書に説明されるシステムおよび方法は、基板と、基板を覆ってエピタキシャルに成長させられた第1の希土類酸化物層と、希土類酸化物(REO)層を覆ってエピタキシャルに成長させられた第1の金属層と、第1の金属層を覆ってエピタキシャルに成長させられた第1の半導体層とを備えている層状構造を含み得る。いくつかの実施形態では、基板は、限定ではないが、シリコン(Si)、ゲルマニウム(Ge)、絶縁体上シリコン(SOI)、SiGeを含む1つ以上の第IV族元素を含む。いくつかの実施形態では、基板は、最大10度のミスカットを伴う<100>または<111>のいずれかの結晶配向を有する。いくつかの実施形態では、基板は、限定ではないが、GaAs、InP、GaNを含む。第III族および第V族からの元素を含む。いくつかの実施形態では、基板は、限定ではないが、GaおよびAlを含む別の金属酸化物である。
いくつかの実施形態では、希土類酸化物層は、周期表のランタニド基、スカンジウム(Sc)、およびイットリウム(Y)から選択される希土類金属元素を含む。いくつかの実施形態では、REO層は、1~2の酸素/金属比を有するREOから成る。いくつかの実施形態では、第1の金属層は、周期表の遷移金属基から選択される金属元素を含む。いくつかの実施形態では、第1の半導体層は、第III族、第IV族、第V族から選択される元素を含む。いくつかの実施形態では、基板は、シリコンから成り、REO層は、1.5の酸素/金属比を有するエルビウム酸化物(ErO1.5)から成り、第1の金属層は、モリブデン(Mo)から成る。いくつかの実施形態では、第1の半導体層は、AlSc1-xN(0≦x<1)から成る。いくつかの実施形態では、基板は、Siから成るとき、<100>の結晶配向を有し、REO層は、ErO1.5から成るとき、<110>の結晶配向を有し、第1の金属層は、Moから成るとき、<211>の結晶配向を有する。例えば、シリコンから成る基板は、<111>の配向を有し得、REO層は、ErO1.5から成るとき、<110>の結晶配向を有する。いくつかの実施形態では、REO層は、複数の希少金属酸化物成分から成り、複数の希少金属酸化物成分は、異なる金属元素または異なる酸素/金属比を有する。
いくつかの実施形態では、REO層は、第1のREOから成る第1の副層と、第2のREOから成る第2の副層とを含む。いくつかの実施形態では、REO層は、第1のREOから成る第1の領域と、第2のREOから成る第2の領域とを含み、第1の領域は、勾配パターンにおいて、第2の領域に遷移する。いくつかの実施形態では、REO層は、第1のREOから成る第1の副層と、第2のREOから成る第2の副層とを含み、第1の副層および第2の副層は、超格子構造において繰り返される。いくつかの実施形態では、第2の金属酸化物は、第III族元素をさらに備えている。いくつかの実施形態では、第1の金属層は、第1の金属から成る第1の副層と、第2の金属から成る第2の副層とを含む。いくつかの実施形態では、第1の金属層は、第1の金属から成る第1の領域と、第2の金属から成る第2の領域とを含み、第1の領域は、勾配パターンにおいて、第2の領域に遷移する。いくつかの実施形態では、金属層は、第1の金属から成る第1の副層と、第2の金属から成る第2の副層とを含み、第1の副層および第2の副層は、超格子構造において繰り返される。いくつかの実施形態では、層状構造は、半導体層を覆ってエピタキシャルに成長させられた第2の金属層をさらに備えている。
いくつかの実施形態では、層状構造は、第2の金属層を覆ってエピタキシャルに成長させられた第2の半導体層をさらに備えている。いくつかの実施形態では、層状構造は、金属層と半導体層との組み合わせの最大20反復をさらに備えている。いくつかの実施形態では、層状構造は、金属層とREO層の組み合わせの反復をさらに備えている。いくつかの実施形態では、層状構造は、半導体層を覆って成長させられた第2のREO層をさらに備えている。いくつかの実施形態では、第2の金属層が、第2のREO層を覆ってエピタキシャルに成長させられる。いくつかの実施形態では、請求項1に記載の層状構造は、第1の金属層から成長させられたエピタキシャル層であって、2次元(2D)材料、キャップ層、および絶縁体から成る群から選択される成分を含むエピタキシャル層をさらに備えている。いくつかの実施形態では、2D材料は、グラフェンおよび遷移金属二硫化物から成る群から選択される。いくつかの実施形態では、キャップ層は、金属酸化物および金属ケイ化物から成る群から選択される材料から成る。いくつかの実施形態では、絶縁体は、REOから成る。いくつかの実施形態では、中間層が、第1の金属層から第1の半導体層に遷移する。いくつかの実施形態では、中間層は、金属窒化物、金属プニクタイド、およびテンプレート2D電極から成る群から選択される1つ以上の成分から成る。
いくつかの実施形態では、中間層が、第1のREO層から第1の金属層に遷移する。いくつかの実施形態では、中間層は、第1の金属層からの金属成分および酸素を伴うように成長させられる。いくつかの実施形態では、第1の金属層は、第1の金属層の第1の部分と第1の金属層の第2の部分との間に第1の間隙空間を伴う非連続パターンを有し、第1の半導体層は、間隙および金属領域の両方を覆って成長させられる。
本発明は、例えば、以下を提供する。
(項目1)
層状構造であって、前記層状構造は、
基板と、
前記基板を覆ってエピタキシャルに成長させられた第1の希土類酸化物層と、
前記希土類酸化物層を覆ってエピタキシャルに成長させられた第1の金属層と、
前記第1の金属層を覆ってエピタキシャルに成長させられた第1の半導体層と
を備えている、層状構造。
(項目2)
前記基板は、シリコン(Si)、ゲルマニウム(Ge)、絶縁体上シリコン(SOI)、およびSiGeから成る群から選択される1つ以上の第IV族元素を含む、項目1に記載の層状構造。
(項目3)
前記基板は、最大10度のミスカットを伴う<100>または<111>のいずれかの結晶配向を有する、項目1に記載の層状構造。
(項目4)
前記基板は、第III族および第V族からの元素を含む、項目1に記載の層状構造。
(項目5)
前記基板は、Ga およびAl から成る群から選択される、項目1に記載の層状構造。
(項目6)
前記希土類酸化物層は、周期表のランタニド基、スカンジウム(Sc)、およびイットリウム(Y)から選択される希土類金属元素を含む、項目1に記載の層状構造。
(項目7)
前記希土類酸化物層は、1~2の酸素/金属比を有する希土類酸化物から成る、項目1に記載の層状構造。
(項目8)
前記第1の金属層は、周期表の遷移金属基から選択される金属元素を含む、項目1に記載の層状構造。
(項目9)
前記第1の半導体層は、第III族、第IV族、第V族から選択される元素を含む、項目1に記載の層状構造。
(項目10)
前記基板は、シリコンから成り、
前記希土類酸化物層は、1.5の酸素/金属比を有するエルビウム酸化物(ErO 1.5 )から成り、
前記第1の金属層は、モリブデン(Mo)から成る、
項目1に記載の層状構造。
(項目11)
前記第1の半導体層は、Al Sc 1-x N(0≦x<1)から成る、項目9に記載の層状構造。
(項目12)
前記基板は、Siから成るとき、<100>の結晶配向を有し、
前記希土類酸化物層は、ErO 1.5 から成るとき、<110>の結晶配向を有し、
前記第1の金属層は、Moから成るとき、<211>の結晶配向を有する、
項目10に記載の層状構造。
(項目13)
前記希土類酸化物層は、複数の希少金属酸化物成分から成り、前記複数の希少金属酸化物成分は、異なる金属元素または異なる酸素/金属比を有する、項目1に記載の層状構造。
(項目14)
前記希土類酸化物層は、第1の希土類酸化物から成る第1の副層と、第2の希土類酸化物から成る第2の副層とを含む、項目1に記載の層状構造。
(項目15)
前記希土類酸化物層は、第1の希土類酸化物から成る第1の領域と、第2の希土類酸化物から成る第2の領域とを含み、前記第1の領域は、勾配パターンにおいて、前記第2の領域に遷移する、項目1に記載の層状構造。
(項目16)
前記希土類酸化物層は、第1の希土類酸化物から成る第1の副層と、第2の希土類酸化物から成る第2の副層とを含み、前記第1の副層および前記第2の副層は、超格子構造において繰り返される、項目1に記載の層状構造。
(項目17)
前記第2の金属酸化物は、第III族元素をさらに備えている、項目13に記載の層状構造。
(項目18)
前記第1の金属層は、第1の金属から成る第1の副層と、第2の金属から成る第2の副層とを含む、項目1に記載の層状構造。
(項目19)
前記第1の金属層は、第1の金属から成る第1の領域と、第2の金属から成る第2の領域とを含み、前記第1の領域は、勾配パターンにおいて、前記第2の領域に遷移する、項目1に記載の層状構造。
(項目20)
前記金属層は、第1の金属から成る第1の副層と、第2の金属から成る第2の副層とを含み、前記第1の副層および前記第2の副層は、超格子構造において繰り返される、項目1に記載の層状構造。
(項目21)
前記半導体層を覆ってエピタキシャルに成長させられた第2の金属層をさらに備えている、項目1に記載の層状構造。
(項目22)
前記第2の金属層を覆ってエピタキシャルに成長させられた第2の半導体層をさらに備えている、項目21に記載の層状構造。
(項目23)
金属層と半導体層との組み合わせの最大20反復をさらに備えている、項目1に記載の層状構造。
(項目24)
金属層と希土類酸化物層との組み合わせの反復をさらに備えている、項目1に記載の層状構造。
(項目25)
前記半導体層を覆って成長させられた第2の希土類酸化物層をさらに備えている、項目1に記載の層状構造。
(項目26)
前記第2の希土類酸化物層を覆ってエピタキシャルに成長させられた第2の金属層をさらに備えている、項目25に記載の層状構造。
(項目27)
前記第1の金属層から成長させられたエピタキシャル層をさらに備え、前記エピタキシャル層は、2次元(2D)材料、キャップ層、および絶縁体から成る群から選択される成分を含む、項目1に記載の層状構造。
(項目28)
前記2D材料は、グラフェンおよび遷移金属二硫化物から成る群から選択される、項目27に記載の層状構造。
(項目29)
前記キャップ層は、金属酸化物および金属ケイ化物から成る群から選択される材料から成る、項目27に記載の層状構造。
(項目30)
前記絶縁体は、希土類酸化物から成る、項目27に記載の層状構造。
(項目31)
前記第1の金属層から前記第1の半導体層に遷移する中間層をさらに備えている、項目1に記載の層状構造。
(項目32)
前記中間層は、金属窒化物、金属プニクタイド、およびテンプレート2D電極から成る群から選択される1つ以上の成分から成る、項目31に記載の層状構造。
(項目33)
前記第1の希土類酸化物層から前記第1の金属層に遷移する中間層をさらに備えている、項目1に記載の層状構造。
(項目34)
前記中間層は、前記第1の金属層からの金属成分と酸素とを用いて成長させられる、項目33に記載の層状構造。
(項目35)
前記第1の金属層は、前記第1の金属層の第1の部分と前記第1の金属層の第2の部分との間に第1の間隙空間を伴う非連続パターンを有し、
前記第1の半導体層は、前記間隙および前記金属領域の両方を覆って成長させられる、
項目1に記載の層状構造。
(項目36)
層状構造を成長させる方法であって、前記方法は、
基板を取得することと、
第1の希土類酸化物層を前記基板を覆ってエピタキシャルに成長させることと、
第1の金属層を前記希土類酸化物層を覆ってエピタキシャルに成長させることと、
第1の半導体層を前記第1の金属層を覆ってエピタキシャルに成長させることと
を含む、方法。
(項目37)
シリコン(Si)、ゲルマニウム(Ge)、絶縁体上シリコン(SOI)、およびSiGeから成る群から選択される第IV族元素を含む前記基板を選択することをさらに含む、項目36に記載の方法。
(項目38)
前記基板は、最大10度のミスカットを伴う<100>または<111>のいずれかの結晶配向を有する、項目36に記載の方法。
(項目39)
第III族および第V族からの元素を含む前記基板層を選択することをさらに含む、項目36に記載の方法。
(項目40)
前記基板は、Ga およびAl から成る群から選択される、項目36に記載の方法。
(項目41)
周期表のランタニド基、スカンジウム(Sc)、およびイットリウム(Y)から選択される希土類金属元素を伴う前記希土類酸化物層を成長させることをさらに含む、項目36に記載の方法。
(項目42)
1~2の酸素/金属比を有する希土類酸化物から成る前記希土類酸化物層を成長させることをさらに含む、項目36に記載の方法。
(項目43)
周期表の遷移金属基から選択される金属元素を含む前記第1の金属層を成長させることをさらに含む、項目36に記載の方法。
(項目44)
第III族、第IV族、第V族から選択される元素を含む前記第1の半導体層を成長させることをさらに含む、項目36に記載の方法。
(項目45)
シリコンから成る前記基板を選択することと、
1.5の酸素/金属比を有するエルビウム酸化物(ErO 1.5 )から成る前記希土類酸化物層を成長させることと、
モリブデン(Mo)から成る前記第1の金属層を成長させることと
をさらに含む、項目36に記載の方法。
(項目46)
前記第1の半導体層は、Al Sc 1-x N(0≦x<1)から成る、項目44に記載の方法。
(項目47)
<100>の結晶配向を有するSiから成る前記基板を選択することと、
<110>の結晶配向を有するErO 1.5 から成る前記希土類酸化物層を成長させることと、
<211>の結晶配向を有するMoから成る前記第1の金属層を成長させることと
をさらに含む、項目45に記載の方法。
(項目48)
複数の希少金属酸化物成分から成る前記希土類酸化物層を成長させることをさらに含み、前記複数の希少金属酸化物成分は、異なる金属元素または異なる酸素/金属比を有する、項目36に記載の方法。
(項目49)
第1の希土類酸化物から成る第1の副層と、第2の希土類酸化物から成る第2の副層とを含む前記希土類酸化物層を成長させることをさらに含む、項目36に記載の方法。
(項目50)
第1の領域と、第2の領域とを含む前記希土類酸化物層を成長させることをさらに含み、前記第1の領域は、第1の比率における元素を伴う第1の希土類酸化物合金を含み、前記第2の領域は、第2の比率における元素を伴う第2の希土類酸化物合金を含み、前記第1の領域は、勾配パターンにおいて、前記第2の領域に遷移する、項目36に記載の方法。
(項目51)
第1の希土類酸化物から成る第1の副層と、第2の希土類酸化物から成る第2の副層とを含む前記希土類酸化物層を成長させることをさらに含み、前記第1の副層および前記第2の副層は、超格子構造において繰り返される、項目36に記載の方法。
(項目52)
第III族元素から成る前記第2の金属酸化物を成長させることをさらに含む、項目48に記載の方法。
(項目53)
第1の金属から成る第1の副層と、第2の金属から成る第2の副層とを含む前記第1の金属層を成長させることをさらに含む、項目36に記載の方法。
(項目54)
第1の金属から成る第1の領域と、第2の金属から成る第2の領域とを含む前記第1の金属層を成長させることをさらに含み、前記第1の領域は、勾配パターンにおいて、前記第2の領域に遷移する、項目36に記載の方法。
(項目55)
第1の金属から成る第1の副層と、第2の金属から成る第2の副層とを含む前記金属層を成長させることをさらに含み、前記第1の副層および前記第2の副層は、超格子構造において繰り返される、項目36に記載の方法。
(項目56)
前記半導体層を覆ってエピタキシャルに成長させられる第2の金属層を成長させることをさらに含む、項目36に記載の方法。
(項目57)
前記第2の金属層を覆ってエピタキシャルに成長させられる第2の半導体層を成長させることをさらに含む、項目56に記載の方法。
(項目58)
金属層と半導体層との組み合わせの最大20反復を成長させることをさらに含む、項目36に記載の方法。
(項目59)
金属層と希土類酸化物との組み合わせの反復を後に成長させることをさらに含む、項目36に記載の方法。
(項目60)
前記半導体層を覆って成長させられる第2の希土類酸化物層酸化物を成長させることをさらに含む、項目36に記載の方法。
(項目61)
前記第2の希土類酸化物層を覆ってエピタキシャルに成長させられる第2の金属層を成長させることをさらに含む、項目60に記載の方法。
(項目62)
前記第1の金属層からエピタキシャル層を成長させることをさらに含み、前記エピタキシャル層は、2次元(2D)材料、キャップ層、および絶縁体から成る群から選択される成分を含む、項目36に記載の方法。
(項目63)
前記2D材料は、グラフェンおよび遷移金属二硫化物から成る群から選択される、項目62に記載の方法。
(項目64)
前記キャップ層は、金属窒化物、金属酸化物、および金属ケイ化物から成る群から選択される材料から成る、項目62に記載の方法。
(項目65)
前記絶縁体は、希土類酸化物から成る、項目62に記載の方法。
(項目66)
前記第1の金属層から前記第1の半導体層に遷移する中間層を成長させることをさらに含む、項目36に記載の方法。
(項目67)
前記中間層は、金属窒化物、金属プニクタイド、およびテンプレート2D電極から成る群から選択される1つ以上の成分から成る、項目66に記載の方法。
(項目68)
前記第1の希土類酸化物層から前記第1の金属層に遷移する中間層を成長させることをさらに含む、項目36に記載の方法。
(項目69)
前記第1の金属層からの金属成分と酸素とを用いて前記中間層を成長させることをさらに含む、項目68に記載の層状構造。
(項目70)
前記第1の金属層の第1の部分と前記第1の金属層の第2の部分との間に第1の間隙空間を伴う非連続パターンを伴う前記第1の金属層を成長させることと、
前記間隙および前記間隙空間における前記金属領域の両方を覆って前記第1の半導体層を成長させることと
をさらに含む、項目36に記載の方法。
本開示のさらなる特徴、その性質、および種々の利点が、付随の図面と関連して検討される以下の詳述される説明の考慮に応じて、より明白となるであろう。
図1は、例証的実施形態による、エピタキシャル金属層を基板と半導体層との間に成長させるための層状構造を描写する。
図2は、例証的実施形態による、図1に示される層状構造を成長させるためのフロー図を描写する。
図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。 図3-16は、層状構造の種々の例を描写し、それらの各々は、例証的実施形態による、図1に示される層状構造の具体的例である。
図17は、従来技術のある実施形態による、異なる厚さの金属電極に対するAlN厚の関数としての共振周波数を描写する。
図18は、エピタキシャル金属電極の有無別の計算された分布ブラッグ反射器(DBR)の反射率を描写し、標準的III族窒化物DBRの真下への結晶REOおよび金属の追加は、ピーク反射率を2%増加させる。
図19は、例証的実施形態による、DBRがAlNおよびGaNの11周期から構築される方法を示すグラフを描写する。
図20は、例証的実施形態による、Moを覆って単一対のAlN上に構築されたAlN-GaN DBRおよびAlN-GaN DBRの両方に対してプロットされる450nmにおける計算された反射率を描写する。
図21は、例証的実施形態による、図1に示される層状構造を成長させるための方法のフローチャートを描写する。
本明細書に説明される構造および方法は、エピタキシャル金属をエピタキシャルスタック内に組み込み、それによって、埋込接触層を組み込む統合されたエピタキシャル金属電極を提供する。本明細書に開示される構造および方法は、高品質エピタキシャル金属層と、エピタキシャル金属層の上方での半導体材料の成長を継続する能力とを含む。一例では、結晶REO層が、基板または半導体を覆ってエピタキシャルに成長させられ得、金属層が、結晶REO層を覆ってエピタキシャルに成長させられ得る。半導体層が、エピタキシャル金属層を覆って成長させられ得る。REO層は、1つ以上の希土類(RE)種と、酸素とを含む層である。希土類種は、ランタン(La)、セリウム(Ce)、プラセオジム(Pr)、ネオジム(Nd)、プロメチウム(Pm)、サマリウム(Sm)、ユウロピウム(Eu)、ガドリニウム(Gd)、テルビウム(Tb)、ジスプロシウム(Dy)、ホルミウム(Ho)、エルビウム(Er)、ツリウム(Tm)、イッテルビウム(Yb)、ルテチウム(Lu)、スカンジウム(Sc)、およびイットリウム(Y)を含む。
REOは、蛍石型構造を呈することが知られている。これらの構造は、任意の他の要因の中でもとりわけ、酸化物中に存在する希土類カチオンの原子重量の関数として形態差を呈する。
特に、より軽い希土類を備えている酸化物は、+2および/または+3および/または+4の可能なイオン化状態の結果として、立方CaF型結晶構造を形成する。この結晶構造を有する酸化物は、可能な酸化状態の多重度に起因して、有意な正味荷電瑕疵を呈する(希土類酸化物に対して)。
一方、より重い希土類から形成される酸化物(例えば、RE等)は、RE<3+>のイオン化状態に起因して、アニオン空孔を含む歪んだCaF型結晶構造を呈する。より重い希土類の希土類酸化物に関連付けられた結晶構造は、「ビクスビ鉱」としても知られる。
式REを有する希土類酸化物の例証的例は、Erである。Erの単位胞の結晶構造は、酸素空孔誘導蛍石誘導体(すなわち、ビクスビ鉱構造)である。REO誘電層は、これらの単位胞の集合を備えていることができる。
アニオン空孔の数および位置は、RE単位胞の結晶形状を決定する。この胞の結晶形状は、好適な整合を下層半導体基板の格子定数に提供するようにエンジニアリングされることができる。体対角線および/または面対角線に沿った酸素空孔は、C型立方構造につながる。例えば、蛍石単位胞あたり2つのアニオン空孔は、Erの単位胞をSiの単位胞サイズのほぼ2倍まで増加させる。これは、次に、低歪み単相Erが、直接、シリコン基板上にエピタキシャルに成長させられることを可能にする。
さらに、アニオン空孔の数および位置は、所望の歪み(引張または圧縮)を誘電層および/または過成長層内に誘発するようにエンジニアリングされることができる。例えば、いくつかの実施形態では、半導体層内の歪みが、キャリア移動度に影響を及ぼすために所望される。
各蛍石単位胞は、2つの酸素空孔を有し、それらは、体対角線に沿ってある。これらの2つの酸素空孔の存在は、Er単位胞のサイズを2倍にさせ、それによって、その格子定数を2倍にし、それは、好適な整合を<100>シリコンの格子定数に提供する。
いくつかの例では、酸素空孔は、面対角線の端部にある。ある他の例では、酸素空孔は、面対角線および体対角線の端部間に分散される。
埋められた金属接触層が、半導体層を覆う金属のエピタキシャル堆積を使用して成長させられることができる。エピタキシャル金属層は、直接半導体層および/または直接基板上に成長させられることができる。いくつかの例では、随意の遷移層が、エピタキシャル金属層と下層半導体層との間および/またはエピタキシャル金属層と下層基板との間にあることができる。電気的利点だけではなく、埋められた接触層は、多くの場合、利用され得る金属と上層半導体との間の相互作用をもたらすであろう。RFフィルタにおけるようなこれらの相互作用は、金属と半導体(および任意の介在界面)との間の界面が瑕疵が殆どない高品質であるとき、より有用である。加えて、エピタキシャル金属は、高膜品質を保存しながら、スパッタリングされた金属より薄くされることができる。これは、部分的に、エピタキシャル界面がより高い品質であり、層が薄くされるにつれて、界面が全体的材料のより大きい比率となるからである。したがって、厚膜は、低品質界面によって殆ど影響されず、その性質は、バルク材料性質によって左右されるが、薄膜の性質は、界面性質によってより左右される。したがって、高品質界面は、薄膜を堆積させるとき、重要である。
加えて、エピタキシャル金属層が、層のエピタキシャルスタックの反射率を修正するために使用され得る。光放出が上部表面から生じる素子に対して、基板に向かって放出される光は、概して、全体的出力電力に対して喪失されると見なされる。垂直共振器面発光レーザ(VCSEL)では、例えば、背面ミラーは、反射率>99.8%を有する必要がある。これは、半導体材料のみを通して達成することが困難である。
図18は、エピタキシャル金属電極を有する場合および有しない場合の計算されたDBR反射率を描写するグラフを示し、標準的III族窒化物DBRの真下への結晶希土類酸化物および金属の追加は、ピーク反射率を2%増加させる。III族窒化物材料は、第III族種と、窒素とを備えている材料である。第III族種は、B、Al、Ga、In、およびTlを含む周期表の第III族内の1つ以上の元素を含み得る。III族窒化物層は、複数の第III族元素を含む化合物であり得る。III族窒化物層は、GaN等の二元化合物、AlxGa1-xN(0≦x≦1)およびInGa1-xN(0≦x≦1)等の三元化合物、InAlGa1-x-yN(0≦x,y≦1)等の四元化合物、ならびにGaIn1-xAsSb1-y-z(0≦x,y,z≦1)等の五元化合物を含み得る。III族窒化物層は、ドープされないか、非意図的にドープされるか、またはドナーもしくはアクセプタドーパントでドープされ得る。
結晶希土類酸化物(REO)エピタキシャル層は、シリコン等の半導体基板上のエピタキシャル金属のためのテンプレートとして使用され得る。シリコン以外の基板も、使用され得、例は、ゲルマニウム、Si-Ge合金、サファイア、二酸化ケイ素、絶縁体上シリコン(SOI)、および絶縁体上半導体(SOS)、前述のうちの1つの最上層を伴う基板、ならびに任意の半導体基板を含む。金属エピタキシの目的のために、結晶REOは、YSZと比較してより優れた材料である。まず第一に、結晶REOと基板との間の界面が、エピタキシャルプロセスの一部として設定される。希土類酸化物の適切な選択肢を用いることで、結晶REOテンプレートが、二次相を伴わずに、100%(またはほぼ100%)立方であるエピタキシャルに成長させられ得る。全体的エピタキシャルスタックに有益である結晶REOの他のパラメータおよびプロセス特性は、任意の寄生電荷がない酸化物-シリコン界面、YSZより高い密度(8.6~6.1g/cm)、およびYSZより5倍も優れた熱伝導性である。エピタキシャル金属成長のためのテンプレートとしての役割を果たすことに加え、結晶REO層は、エピタキシャル金属層と下方の任意の基板との間の相互拡散を防止し得る。これは、例えば、望ましくない金属ケイ化物の形成を防止する(基板がシリコンである場合)。
図1は、例証的実施形態による、層状構造400を図示する例示的略図を示す。構造100は、基板102と、基板102を覆って成長させられるREO層104と、REO層104を覆ってエピタキシャルに成長させられる金属層106と、金属層106を覆ってエピタキシャルに成長させられる半導体層108とを含む。REO層104の厚さは、toxとして定義され、典型的には、酸化物の厚さは、0<=tox<=500nmとして定義され得る。図1に描写される層構造100は、分子線エピタキシャル成長法(MBE)、有機金属気相エピタキシャル成長法(MOCVD)、または他の周知のエピタキシャル堆積技法のいずれかによって、単一エピタキシャルプロセスにおいて製造され得る。プロセスによって要求されるように、材料を堆積させるための堆積ツールは、単一チャンバであり得るか、プロセスの特定の部分が異なる相互接続されたチャンバ内で行われる周知のクラスタツールフォーマットのいずれかの使用であり得るか、または、複数の堆積ツールが、使用され得る。結晶REO層104は、エピタキシャル金属層106のためのテンプレートであり、エピタキシャル金属層106は、1つ以上の成分エピタキシャル金属層を備えていることができる。半導体層108は、III族窒化物材料、III-V材料、およびIV族材料のうちの1つ以上のものを備えていることができる。III-V材料は、周期表のIII族からの1つ以上の種(B、Al、Ga、In、およびTl等)と、周期表のV族からの1つ以上の種(N、P、As、Sb、およびBi等)とを含む。III族窒化物は、III-V材料であり、III族からの種と、窒素とを含む。III族窒化物材料の例は、GaN、InAlGa1-x-yN(0≦x、y≦1)、および/またはAlNを含む。他のIII-V材料の例は、GaAs、InP、InAs、InSb、InGaAs、GaAsP、InGaAsP等のうちの1つ以上のものを含む。いくつかの実施形態では、REO層104のための酸素/金属比は、1~2の範囲である。いくつかの実施形態では、REO層104のための酸素/金属比は、1.4~1.6であり得る。
図1の層構造100は、シリコン基板等の基板102を覆って成長させられ得る。フィルタ内の半導体材料が、エピタキシャルである場合、それは、フィルタの上方に成長させられ得る追加の半導体元素の統合に役立つ(必ずしも、直接、フィルタに電気的に接続されるわけではない)。例えば、トランジスタ(その例は、電界効果トランジスタ、高電子移動度トランジスタ、およびヘテロ接合バイポーラトランジスタを含む)が、フィルタを覆って成長させられ、したがって、所与のシステムのために要求されるチップ面積を低減させ得る。
図2は、図1に描写される層構造を製作するための単一エピタキシャルプロセスを図示するプロセス概略200を描写する。結晶REO層104が、基板102を覆ってエピタキシャルに成長させられる。金属層106が、結晶REO層104を覆ってエピタキシャルに成長させられる。半導体層108が、金属層106を覆ってエピタキシャルに成長させられる。いくつかの実施形態では、追加の金属層210が、半導体層108を覆ってエピタキシャルに成長させられ得る。図2に描写される層の各々は、1つ以上の副層を含むことができる。各層の組成は、図3-13にさらに詳細に説明される。
使用されるエピタキシャル金属は、ルテニウムまたはモリブデン等の希土類金属または金属、または、以下の表1にリストアップされた他の代表的金属であり得る。エピタキシャル金属層210の金属元素を選択するために考慮すべき属性は、抵抗率だけではなく、層の光学および音響性質を決定する密度、ヤング係数、および屈折率も含む。表1にリストアップされていない他の金属も、使用され得る。
Figure 0007005604000001
例えば、基板102は、シリコンから成り得、REO層104は、1.5(ErO1.5)の酸素/金属比を有するエルビウム酸化物から成り得、第1の金属層106は、モリブデン(Mo)から成り得る。第1の半導体層は、AlSc1-xN(0≦x<1)から成り得る。基板102は、Siから成るとき、<111>の結晶配向を有し得、第1の金属層は、Moから成るとき、<110>の結晶配向を有する。この例では、REOにおける酸素/金属比は、1.4~1.6の範囲を有し得る。
別の例に対して、シリコンから成る基板102は、<100>の配向を有し得、REO層104は、ErO1.5から成るとき、<110>の結晶配向を有し得、第1の金属層106は、Moから成るとき、<211>の結晶配向を有し得る。この例では、REOにおける酸素/金属比は、1.4~1.6の範囲を有し得、半導体層108は、種々の組成を有し得る。
図3-5は、結晶REO層104を覆って複数のエピタキシャル金属層を含む構造を描写する。図3-5におけるエピタキシャル金属層は、複数の金属層を含み得る。複数の金属層は、図3-4におけるようにスタックされた、例えば、あるタイプの金属から別のタイプの金属への段階的変化、または図5に示されるような勾配変化のいずれかとして成長させられ得る。例証目的のみのために、2つのタイプの金属層が、図3-5に描写されるが、3つ以上のタイプの金属層も、図3-5に示される類似様式において、構造内で使用され得る。
図3は、例証的実施形態による、層状構造300を図示する例示的略図を示す。構造300は、段階的タイプ構成において、REO層104を覆ってエピタキシャルに成長させられた第1の金属層302と、第1の金属層302を覆ってエピタキシャルに成長させられた第2の金属層304とを含む。いくつかの実施形態では、第1の金属層302および第2の金属層304内の金属は、同一であり得る。いくつかの実施形態では、第1の層302および第2の金属層304内の金属は、異なり得る。いくつかの実施形態では、第1の金属層302および第2の金属層304は、同一厚さを有し得る。いくつかの実施形態では、第1の金属層302は、第2の金属層304と異なる厚さを有し得る。
図4は、例証的実施形態による、層状構造400を図示する例示的略図を示す。構造400は、超格子タイプ構成において、REO層104を覆ってエピタキシャルに成長させられる第1の金属(層402、406)と第2の金属(層404、408)との複数の交互する層を含む。いくつかの実施形態では、第1の金属層402、406および第2の金属層404、408内の金属は、同一であり得る。いくつかの実施形態では、第1の層402、406内の金属と第2の層404および406内の金属とは、異なり得る。いくつかの実施形態では、第1の金属層402、406および第2の金属層404、408は、同一厚さを有し得る。いくつかの実施形態では、第1の金属層402、406は、第2の金属層404および408と異なる厚さを有し得る。2つの異なるタイプの金属層の2つの反復が、例証目的のみのために図4に示されるが、異なる数の反復(例えば、3つ、4つ、5つ等)が、構造内で使用され得ることに留意されたい。
図5は、例証的実施形態による、層状構造500を図示する例示的略図を示す。構造500は、REO層104を覆ってエピタキシャルに成長させられる金属層106を含み、金属層106は、第1の領域502と、第2の領域504とを有し、第1の金属の第1の濃度および第2の金属の第2の濃度は、勾配構成において修正される。図5における第1および第2の金属の第1および第2の濃度の勾配は、線形(例えば、第1の金属から第2の金属への組成における線形変化)、超線形(superlinear、例えば、より高次の多項式)、劣線形(sublinear)、または段階的(例えば、材料組成における離散変化)であり得る。いくつかの実施形態では、第1の濃度は、第1の領域502において第1の値を有し、第2の領域504において第2の値を有し得る。第1の金属の濃度は、層106の厚さにわたり変動し得る。同様に、第2の金属の第2の濃度は、第1の領域502において第3の値を有し、第2の領域504において第4の値を有し得る。第2の金属の濃度は、層106の厚さにわたり変動し得る。
図3-5に描写される層構造300-500は、無線周波数(RF)フィルタ内に含まれ得る。エピタキシャル金属層106を覆って成長させられる半導体層108は、結合された電気機械的共振器として機能を果たす圧電材料であり得る。第1のエピタキシャル金属層(302、402)は、RFフィルタのための第1の電極であり得、第2の金属層(304、404)は、RFフィルタのための第2の電極であり得る。エピタキシャル金属層は、特に、それらが金属層を覆う単結晶層(例えば、半導体層)の後続成長のためのテンプレートとしての役割を果たす単結晶構造と金属の高伝導性を提供するので、RFフィルタ内の電極のために有用である。単結晶半導体層は、それらが、より高い圧電係数、より狭い帯域幅、およびより低い損失を提供するため、RFフィルタ内の半導体材料として有用である。部分的に、性能増加は、エピタキシャル金属電極の品質および結晶位置合わせに起因し、それは、後続膜のより高い品質をもたらす。
図3-5に描写される構造のいずれも、光学素子内に含まれ得る。1つのそのような用途は、分布ブラッグ反射器(DBR)におけるものであろう。DBRに対して、1つの重要な考慮点は、成分層間の屈折率である。屈折率が異なるほど、より少ない周期が要求され、阻止域がより広くなる。これは、総合的層スタック厚さの低減、それによって、製造コスト/複雑性の削減への道筋をもたらす。例えば、半導体AlNおよびGaNを採用するDBRでは、420nmでの屈折率におけるデルタは、0.34である。2つの材料が、エピタキシャルMoを覆うAlNに変化させられる場合、この差異は、0.85まで増加するであろう。
多くのフォトニック素子において、全ての光が、エピタキシャル表面に対して直角に進行するわけではない。DBRが、屈折率にわずかな差異のみをもたらす半導体から構築されるとき、入射角への反射率の著しい依存が存在する。エピタキシャル金属層106を伴わない層状構造100と比較した層状構造100の反射率の性能の例は、図18-20に示される。
図6-8は、基板102を覆う複数の結晶REO層を含む構造を描写する。図6および7におけるREO層106は、複数のREO層を含み得る。複数の希土類酸化物層が、図6-7におけるようにスタックされたものとして(例えば、あるタイプのREOから別のタイプのREOへの段階的変化)、または、図8に示されるような勾配変化のいずれかとして成長させられ得る。いくつかの実施形態では、基板102に隣接して設置された第1の最適REOと、金属層106のエピタキシを支援するように設置された第2の最適REOとが存在する事例も存在し得る。例証目的のみのために、2つのタイプのREO層が、図6-8に描写されるが、3つ以上のタイプのREO層も、図6-8に示される類似様式において、構造内で使用され得る。
図6は、段階的タイプ構成において、基板102を覆ってエピタキシャルに成長させられる第1のREO層602と、第1の希土類酸化物層602を覆ってエピタキシャルに成長させられる希土類酸化物層604とを含む層構造600を描写する。いくつかの実施形態では、第1の希土類酸化物層602および第2の希土類酸化物層604内の希土類金属は、同一であり得る。いくつかの実施形態では、第1の希土類酸化物層602と第2の希土類酸化物層604内の希土類金属とは、異なり得る。いくつかの実施形態では、第1のREO層602および第2のREO層604は、同一厚さを有し得る。いくつかの実施形態では、第1のREO層602は、第2のREO層604と異なる厚さを有し得る。いくつかの実施形態では、第1の希土類金属は、第1の層602において第1の濃度を有し、第2の層604において第2の濃度を有し得る。同様に、第2の希土類金属は、第1の層602において第3の濃度を有し、第2の層604において第4の濃度を有し得る。いくつかの実施形態では、酸素の濃度は、第1の層602と第2の層604とで異なり得る。
図7は、超格子タイプ構成において、基板102を覆ってエピタキシャルに成長させられる第1のREO(層702、706)および第2のREO(層704、708)の複数の交互する層を含む層構造700を描写する。いくつかの実施形態では、第1のREO層702、706および第2の希土類金属酸化物層704、708内の希土類金属は、同一であり得る。いくつかの実施形態では、第1の層702、706内の希土類金属と第2の層704および706内の希土類金属とは、異なり得る。いくつかの実施形態では、第1のREO層702、706および第2のREO層704、708は、同一厚さを有し得る。いくつかの実施形態では、第1のREO層702、706は、第2のREO層704および708と異なる厚さを有し得る。いくつかの実施形態では、第1の希土類金属は、層702において第1の濃度を有し、層704において第2の濃度を有し得る。同様に、第2の希土類金属は、層702において第3の濃度を有し、層704において第4の濃度を有し得る。いくつかの実施形態では、酸素の濃度は、層702と層704とで異なり得る。2つの異なるタイプのREO層の2つの反復が、例証目的のみのために、図7に示されるが、異なる数の反復(例えば、3つ、4つ、5つ等)が、構造内で使用され得ることに留意されたい。
図8は、例証的実施形態による、層状構造800を図示する例示的略図を示す。構造800は、基板102を覆ってエピタキシャルに成長させられるREO層104を含み、REO層106は、第1の領域802と、第2の領域804とを有し、第1の希土類金属の第1の濃度および第2の希土類金属の第2の濃度は、勾配構成において修正される。図8における第1および第2の希土類金属の第1および第2の濃度の勾配は、線形(例えば、第1の金属から第2の金属への組成における線形変化)、超線形(例えば、より高次の多項式)、劣線形、または段階的(例えば、材料組成における離散変化)であり得る。いくつかの実施形態では、第1の希土類金属の第1の濃度は、第1の領域802において第1の値を有し、第2の領域804において第2の値を有し得る。第1の希土類金属の濃度は、層106の厚さを横断して変動し得る。同様に、第2の金属の第2の濃度は、第1の領域802において第3の値を有し、第2の領域804において第4の値を有し得る。第2の金属の濃度は、層106の厚さを横断して変動し得る。
図9は、例証的実施形態による、層状構造900を図示する例示的略図を示す。構造800は、図1に示される構造の例を描写し、半導体層108は、III族窒化物層、特に、Al1-xScN(0≦x≦1)層であり、金属層106は、Mo層であり、REO層104は、Er層であり、基板102は、Si<111>基板である。図9に示される構造の他の例も、可能であり、層の各々は、図3-8に説明されるように、1つ以上の副層を含み得る。
いくつかの実施形態では、図1に示されるような層状構造100は、エピタキシャル金属層106と半導体108との間またはREO層104とエピタキシャル金属層106との間のいずれかに中間層を含むように修正され得る。そのような層の目的は、酸化物から金属または金属から半導体への遷移の化学的または結晶学的エンジニアリングを可能にすることである。化学的エンジニアリングは、半導体または金属層の初期エピタキシャル堆積中の半導体または金属原子の核生成または移動を促すことを含むことができる。結晶学的エンジニアリングは、金属と半導体層との間の結晶構造または格子定数における遷移を補助することを含むことができる。結晶構造内の遷移の例は、六方型結晶構造から立方型結晶構造への遷移である。
図10は、例証的実施形態による、層状構造1000を図示する例示的略図を示す。構造1000は、結晶REO層104を覆ってエピタキシャルに成長させられる中間層1002を覆うエピタキシャル金属106を描写する。いくつかの実施形態では、中間層1002は、エピタキシャル金属層106内の金属と酸素との組み合わせを用いて作製される金属酸化物1004であり得る。
図11は、例証的実施形態による、層状構造1100を図示する例示的略図を示す。構造1100は、REO層104を覆うエピタキシャル金属層106と、エピタキシャル金属層を覆うエピタキシャル中間層1102と、中間層1102を覆うエピタキシャル半導体層106とを描写する。いくつかの実施形態では、中間層は、金属ケイ化物から成り得る。いくつかの実施形態では、中間層は、金属窒化物1104から成り得る。いくつかの実施形態では、中間層1102は、希土類プニクタイド1106から成り得、希土類プニクタイド1106は、一般に、希土類窒化物、希土類ヒ化物、および希土類リン化物を含む。いくつかの実施形態では、中間層1102は、2次元(2D)電極1108から成り得る。
いくつかの実施形態では、異なる組成/タイプのより多くの半導体が、他の半導体層108を覆ってエピタキシャルに成長させられ得る。いくつかの実施形態では、第2の金属が、半導体層を覆って成長させられ得る。本実施形態に対して、前述の金属エピタキシスキームのいずれかが、利用され得、金属と半導体との間にエピタキシャルに成長させられる前述の中間層のいずれかが、最終エピタキシャルスタックの要求される特徴に応じて、全体的エピタキシャルプロセスのために使用され得る。半導体の上方の層は、半導体のその下方のものに合致する必要はない。例えば、半導体の上方の層は、半導体の下方の層と同一であることも、異なることもある。
いくつかの実施形態では、エピタキシャル金属層が、半導体層108を覆って成長させられ得る。いくつかの実施形態では、3つの可能なエピタキシャル中間層である金属ケイ化物、金属窒化物、および希土類プニクタイドが、半導体層108とエピタキシャル金属層との間に成長させられ得る。エピタキシャル金属層を半導体108を覆って成長させるための選択が行われる場合、前述の例のいずれかまたは全てが、別の半導体層を金属を覆ってエピタキシャルに成長させる目的のために繰り返され得る。
図12は、例証的実施形態による、層状構造1202および1204の単位から成る素子を図示する例示的略図を示す。構造1200は、随意の中間層を伴う繰り返される金属/半導体構造の例を描写する。図12は、3つの単位1204の層スタックを描写する。層スタックは、他の数の単位を含み得るが、3つが、例証目的のためにここでは示される。各単位は、同一であり得るか、または層スタック内の単位のうちの1つ以上のものは、異なり得る。層状構造1202は、層スタック1204内の例示的単位を描写する。この例示的単位は、第1のエピタキシャル金属層を覆ってエピタキシャルに成長させられる第1の中間層と、第1の中間層を覆ってエピタキシャルに成長させられる半導体層108と、半導体層を覆ってエピタキシャルに成長させられる第2の中間層と、第2の中間層を覆ってエピタキシャルに成長させられる第2のエピタキシャル金属層とを含む。層スタック内の単位のいずれかは、第1および第2の中間層を含まないか、そのうちの一方を含むか、または両方を含み得る。加えて、1つの単位内の第2のエピタキシャル金属層は、上方の単位内の第1のエピタキシャル金属層と同一であることができる。単位内のエピタキシャル金属層およびの一方または両方は、単一金属、傾斜金属層、複数の副層を伴う金属層、および/または複数の金属層を伴う超格子であり得る。1204に描写されるもの等の層スタックは、フォトニック用途において使用され得る。例えば、層スタックは、DBR等の金属-半導体ミラーであり得る。
図13は、例証的実施形態による、層状構造1302、1304、1306を図示する例示的略図を示す。構造1302、1304、および1306は、下方の層を現場外処理および/または素子動作に整合させるための最終エピタキシャル層の例を描写する。これらは、限定ではないが、1302に示されるような上側金属層を酸化から保護するための金属ケイ化物の使用、1304に示されるような伝導性を向上させるためのグラフェンまたは他の2D構造の追加、および1306に示されるような下層エピタキシャルスタックを電気的に隔離するための誘電または絶縁体のいずれかとしての結晶REO層の追加を含む。いくつかの実施形態では、第2のエピタキシャル金属層が、半導体108を覆って成長させられるようなREO層を覆って成長させられ得る。これらの3つの最上層は、単一層実体として示されるが、そのような層の提供がここに示されない追加の層を要求し得ることが予期されることに留意されたい。
図14は、例証的実施形態による、層状構造100への修正を図示する例示的略図を示す。構造1402は、半導体層108を覆う第2のエピタキシャル金属層1404を描写する。構造1406は、第2のエピタキシャル金属層1404を覆って成長させられる第2の半導体層1408を描写する。いくつかの実施形態では、第2のエピタキシャル金属層1404と第2の半導体層1408の組み合わせは、ミラーであり得る。第2のエピタキシャル金属層1404の上方の層は、エピタキシの次の位相のためのテンプレートとして使用され、追加の機能性を送達し得る。酸化物の成長は、部分1406を、それを覆って部分1406が成長させられ得る、層構造100から電気的に隔離し得る。
図15は、例証的実施形態による、層状構造1500を図示する例示的略図を示す。構造1500は、半導体108がスタックを覆って成長させられる前にスタック1504を構築するための、複数回のREO層104とエピタキシャル金属層106との組み合わせ1502のための反復パターンを描写する。いくつかの実施形態では、部分1502は、半導体108をスタック1504を覆って成長させる前に、1、2、3・・・20・・・または任意の他の回数であり得る。
図16は、例証的実施形態による、層状構造1602および1606を図示する例示的略図を示す。構造1602は、エピタキシャル金属層106を描写し、エピタキシャル金属層は、成長が、2Dではなく3Dであるように、マスクを反応器内に組み込むこと、酸化物の表面上のパターン、または金属の化学的性質の制御のいずれかによって区分される。いくつかの実施形態では、半導体層108は、区分された金属層106を覆う連続区分として成長させられ得る。いくつかの実施形態では、半導体層108も、1606に示されるように、成長が、2Dではなく、3Dであるように、マスクを反応器内に組み込むこと、酸化物の表面上のパターン、または金属の化学的性質の制御のいずれかによって区分され得る。いくつかの実施形態では、第2の金属層1604が、分断された半導体層108を覆って成長させられ得、金属層1404は、層108内の種々の半導体区分間の空洞内に成長させられる。第2の金属層は、半導体層の異なる区分を覆って成長させられ得る。いくつかの実施形態では、上流プロセスは、第2の金属層金属にアクセスし、追加の処理ステップ(例えば、厚い接点の電気めっき)のためのテンプレート/シードとして使用し得る。いくつかの実施形態では、半導体層108は、金属を覆って成長させられる場合、または酸化物を覆って成長させられる場合、異なる機能を有し得る。
図17は、従来技術(その全体が参照することによって組み込まれる、S.Tanifuji、他のProceedings 2009 IEEE International Ultrasonic Symposium,p.2170から引用)のある実施形態による、異なる厚さの金属電極に対するAlN厚の関数としての共振周波数を示す。ここでは、結晶品質も、重要である。それがなければ、多結晶金属層内の瑕疵および結晶粒界の増加影響に起因して、抵抗率が厚さが減少するにつれて増加すると考えられるからである。
図19は、DBRがAlNおよびGaNの11周期から構築される方法を示す、グラフを描写する。入射角が増加すると、有効層厚は、阻止域をより低い波長にシフトさせる結果をもたらし、ある角度では、設計波長(この例では、450nm)が、中心阻止域外にあるであろうことを意味する。
金属(この場合、モリブデン)を覆うAlNの追加は、入射角に対するこの感度を著しく減少させる。
図20は、Moを覆って単一対のAlN上に構築された11周期AlN-GaN DBRおよび10周期AlN-GaN DBRの両方に対してプロットされた450nmにおける計算された反射率を描写する。60°の入射角に見られ得るように、エピタキシャル金属層の追加は、反射率を30%から65%に増加させた。
エピタキシャル金属層は、より大きい結晶粒径およびより少ない結晶粒界をもたらし、それは、結晶粒界および瑕疵に関連付けられた損失が有意となる前に、より薄い金属層を可能にする。加えて、金属層と半導体との間の界面は、クリーンかつ個別的であり、その両方は、多結晶/スパッタリングDBR構造体と比較して、半導体-金属DBRの損失を低減させる。
図21は、例証的実施形態による、層状構造100を成長させるプロセス2100のフローチャートである。プロセスは、2102において、基板102が取得されると開始する。2104では、第1のREO層104が、基板102を覆って成長させられる。2106では、第1の金属層106が、第1のREO層104を覆ってエピタキシャルに成長させられる。2108では、半導体層108が、第1の金属層106を覆ってエピタキシャルに成長させられる。
2102では、基板(例えば、図1における基板102参照)が、取得される。いくつかの実施形態では、基板は、シリコン(Si)、ゲルマニウム(Ge)、絶縁体上シリコン(SOI)、および炭化ケイ素(SiC)から成る群から選択される第IV族元素を含み、基板は、一例では、最大10度のミスカットを伴う<100>または<111>のいずれかの結晶配向を有する。
2104では、第1のREO層(例えば、図1におけるREO層104参照)が、基板を覆ってエピタキシャルに成長させられる。
2106では、第1の金属層(例えば、図1における金属層106参照)が、第1のREO層を覆ってエピタキシャルに成長させられる。
2108では、第1の半導体層(例えば、図1における半導体層104参照)が、第1の金属層を覆ってエピタキシャルに成長させられる。
本明細書に説明される成長および/または堆積は、化学蒸着法(CVD)、有機金属化学蒸着法(MOCVD)、有機金属気相成長法(OMVPE)、原子層堆積法(ALD)、分子線成長法(MBE)、水素化物気相成長法(HVPE)、パルスレーザ堆積法(PLD)、および/または物理蒸着法(PVD)のうちの1つ以上のものを使用して行われ得る。
本明細書に説明されるように、層は、表面を被覆する実質的に均一厚の材料を意味する。層は、連続または断続(すなわち、材料の領域間に間隙を有する)のいずれかであることができる。例えば、層は、表面を完全に被覆するか、または集合的に層を画定する個別的な領域(すなわち、選択的エリアエピタキシを使用して形成される領域)に区分され得る。
「モノリシックに統合される」とは、典型的には、表面上に配置される層を堆積させることによって、基板の表面上に形成されることを意味する。
「上に配置される」とは、下層材料または層の「上に存在する」ことを意味する。この層は、好適な表面を確実にするために必要な遷移層等の中間層を備え得る。例えば、材料が「基板上に配置される」ように説明される場合、これは、(1)材料が基板と直に接触すること、または(2)材料が基板上に常駐する1つ以上の遷移層と接触することのいずれかを意味することができる。
「単結晶」とは、実質的に1つのみのタイプの単位胞を備えている結晶構造を意味する。しかしながら、単結晶層は、積層瑕疵、転位、または他の一般に生じる結晶瑕疵等、いくつかの結晶瑕疵を呈し得る。
「単分域」とは、単位胞の実質的に1つのみの構造と、その単位胞の実質的に1つのみの配向とを備えている結晶構造を意味する。言い換えると、単分域結晶は、双晶形成または逆相分域を呈さない。
「単相」とは、単結晶および単分域の両方である結晶構造を意味する。
「基板」とは、堆積される層が形成される材料を意味する。例示的基板は、限定ではないが、ウエハが単結晶シリコンの均質厚を備えているバルクシリコンウエハ、バルクシリコンハンドルウエハ上に配置される二酸化ケイ素層の上に配置されるシリコンの層を備えている絶縁体上シリコンウエハ等の複合ウエハ、またはその上もしくはその中に素子が形成される基層としての役割を果たす、任意の他の材料を含む。用途に応じて、基板層およびバルク基板として使用するために好適なそのような他の材料の例は、限定ではないが、ゲルマニウム、アルミナ、ヒ化ガリウム、リン化インジウム、シリカ、二酸化ケイ素、ホウケイ酸ガラス、パイレックス(登録商標)、およびサファイアを含む。
「ミスカット基板」とは、基板の結晶構造に関連付けられたそれに対してある角度で配向される表面結晶構造を備えている基板を意味する。例えば、6°ミスカット<100>シリコンウエハは、別の主要結晶配向(<110>等)に向かって6°だけ<100>結晶配向に対して斜めに切断された<100>シリコンウエハを備えている。典型的には、必ずしもではないが、ミスカットは、最大約20°となるであろう。具体的に記載されない限り、語句「ミスカット基板」は、任意の主要結晶配向を有するミスカットウエハを含む。すなわち、<011>方向に向かってミスカットされた<111>ウエハ、<110>方向に向かってミスカットされた<100>ウエハ、および<001>方向に向かってミスカットされた<011>ウエハで。
「絶縁体上半導体」とは、単結晶半導体層と、単相誘電層と、基板とを備え、誘電層が半導体層と基板との間に挿入される組成を意味する。この構造は、典型的には、単結晶シリコン基板と、非単相誘電層(例えば、非晶質二酸化ケイ素等)と、単結晶シリコン半導体層とを含む従来技術の絶縁体上シリコン(「SOI」)組成を連想させる。
絶縁体上半導体組成は、単相形態を有する誘電層を含む一方、SOIウエハは、含まない。実際、典型的SOIウエハの絶縁体層は、単結晶ですらない。
絶縁体上半導体組成は、シリコン、ゲルマニウム、またはシリコン-ゲルマニウム「活性」層を含む一方、従来技術のSOIウエハは、シリコン活性層を使用する。言い換えると、例示的絶縁体上半導体組成は、限定ではないが、絶縁体上シリコン、絶縁体上ゲルマニウム、および絶縁体上シリコンゲルマニウムを含む。
本明細書において第2の層「上に存在する」またはそれ「を覆う」ものとして説明ならびに/もしくは描写される第1の層は、第2の層に直接的に隣接することができるか、または第1の層と第2の層との間に存在し得る1つ以上の介在層であることができる。本明細書において「直接的に」第2の層または基板「上に存在する」もしくはそれ「を覆う」ものとして説明および/または描写される第1の層は、第1の層と第2の層もしくは基板との混合に起因してある場合生じ得る介在合金層以外の介在層を伴わない第2の層または基板に直接的に隣接する。加えて、本明細書において第2の層または基板「上に存在する」、それ「を覆う」、「直接的に」その「上に存在する」、もしくは「直接的に」それ「を覆う」ものとして説明および/または描写される第1の層は、第2の層もしくは基板全体、または第2の層もしくは基板の一部を被覆し得る。
基板は、層成長中に基板ホルダ上に設置され、従って、上面または上側表面は、基板ホルダから最も遠い基板または層の表面である一方、底部表面または下側表面は、基板ホルダに最も近い基板または層の表面である。本明細書に描写され、説明される構造のいずれかは、描写された構造の上方および/または下方に追加の層を伴うより大きい構造の部分であることができる。明確化のために、本明細書における図は、これらの追加の層を省略し得るが、これらの追加の層は、開示される構造の一部であることができる。加えて、描写される構造は、たとえ反復が図内に描写されていなくても、その単位で反復されることができる。
上記説明から、種々の技法が、本開示の範囲から逸脱することなく、本明細書に説明される概念の実装の使用され得ることが、明白である。説明される実施形態は、全ての点で、例証的でありかつ制限的ではないと見なされるべきである。本明細書に説明される技法および構造が、本明細書に説明される特定の例に限定されるものではないが、本開示の範囲から逸脱することなく他の例に実装されることができることも理解されたい。同様に、動作は、図面内に特定の順序で描写されるが、これは、望ましい結果を達成するために、そのような動作が示される特定の順序または連続した順序で実施されること、もしくは全ての図示される動作が示される特定の順序または連続した順序で実施されることを要求するものではないことを理解されたい。

Claims (17)

  1. 層状構造であって、前記層状構造は、
    基板と、
    前記基板を覆ってエピタキシャルに成長させられた第1の希土類酸化物層と、
    前記第1の希土類酸化物層を覆ってエピタキシャルに成長させられた第1の金属層であって、前記第1の金属層は、前記第1の金属層の第1の部分と前記第1の金属層の第2の部分との間に第1の間隙空間を伴う非連続パターンを有する、第1の金属層と、
    前記第1の間隙空間と前記第1の金属層の前記第1の部分および前記第2の部分との両方を含む前記第1の金属層を覆ってエピタキシャルに成長させられた第1の半導体層
    を備えている、層状構造。
  2. 前記基板は、<100>の結晶配向を有するSi、<111>の結晶配向を有するSi、GaAs、InP、Ga、およびAlのうちのいずれかを含む、請求項1に記載の層状構造。
  3. 前記第1の希土類酸化物層は、1~2の酸素/金属比を有する希土類酸化物を備えている、請求項1または請求項2のいずれか一項に記載の層状構造。
  4. 前記第1の金属層は、周期表の遷移金属基から選択される金属元素を含む、請求項1~3のいずれか一項に記載の層状構造。
  5. 前記第1の半導体層は、第III族、第IV族、第V族から選択される元素を含む、請求項1~4のいずれか一項に記載の層状構造。
  6. 前記基板は、シリコン(Si)を備え、
    前記第1の希土類酸化物層は、1.5の酸素/金属比を有するエルビウム酸化物(ErO1.5)を備え、
    前記第1の金属層は、モリブデン(Mo)を備えている、請求項1~5のいずれか一項に記載の層状構造。
  7. 前記第1の半導体層は、AlSc1-xN(0≦x<1)を備えている、請求項5に記載の層状構造。
  8. 前記基板は、Siを備えているとき、<100>の結晶配向を有し、
    前記第1の希土類酸化物層は、ErO1.5を備えているとき、<110>の結晶配向を有し、
    前記第1の金属層は、Moを備えているとき、<211>の結晶配向を有する、請求項6に記載の層状構造。
  9. 前記第1の希土類酸化物層は、複数の希少金属酸化物成分を備え、前記複数の希少金属酸化物成分は、異なる金属元素または異なる酸素/金属比を有する、請求項1~8のいずれか一項に記載の層状構造。
  10. 前記第1の金属層は、第1の金属を備えている第1の副層と、第2の金属を備えている第2の副層とを含む、請求項1~9のいずれか一項に記載の層状構造。
  11. 前記第1の金属層は、第1の金属を備えている第1の領域と、第2の金属を備えている第2の領域とを含み、前記第1の領域は、勾配パターンにおいて、前記第2の領域に遷移する、請求項1~10のいずれか一項に記載の層状構造。
  12. 前記第1の金属層は、第1の金属を備えている第1の副層と、第2の金属を備えている第2の副層とを含み、前記第1の副層および前記第2の副層は、超格子構造において繰り返される、請求項1~11のいずれか一項に記載の層状構造。
  13. 前記第1の半導体層を覆ってエピタキシャルに成長させられた第2の金属層と、
    前記第2の金属層を覆ってエピタキシャルに成長させられた第2の半導体層と
    をさらに備えている、請求項1~12のいずれか一項に記載の層状構造。
  14. 前記第1の金属層と前記第1の半導体層との組み合わせ、または、前記第1の半導体層を覆ってエピタキシャルに成長させられた第2の金属層と前記第2の金属層を覆ってエピタキシャルに成長させられた第2の半導体層との組み合わせの最大20反復をさらに備えている、請求項1~13のいずれか一項に記載の層状構造。
  15. 前記第1の半導体層を覆って成長させられた第2の希土類酸化物層と、
    前記第2の希土類酸化物層を覆ってエピタキシャルに成長させられた第2の金属層と
    をさらに備えている、請求項1~14のいずれか一項に記載の層状構造。
  16. 前記第1の金属層から前記第1の半導体層に遷移する中間層をさらに備えている、請求項1~15のいずれか一項に記載の層状構造。
  17. 前記第1の希土類酸化物層から前記第1の金属層に遷移する中間層をさらに備え、前記中間層は、前記第1の金属層からの金属成分と酸素とを備えている、請求項1~16のいずれか一項に記載の層状構造。
JP2019515652A 2016-09-22 2017-09-21 統合されたエピタキシャル金属電極 Active JP7005604B2 (ja)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
US201662398416P 2016-09-22 2016-09-22
US62/398,416 2016-09-22
PCT/US2017/052803 WO2018057797A1 (en) 2016-09-22 2017-09-21 Integrated epitaxial metal electrodes

Publications (3)

Publication Number Publication Date
JP2019535134A JP2019535134A (ja) 2019-12-05
JP2019535134A5 JP2019535134A5 (ja) 2020-10-08
JP7005604B2 true JP7005604B2 (ja) 2022-01-21

Family

ID=60009744

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2019515652A Active JP7005604B2 (ja) 2016-09-22 2017-09-21 統合されたエピタキシャル金属電極

Country Status (7)

Country Link
US (2) US10128350B2 (ja)
EP (1) EP3516681A1 (ja)
JP (1) JP7005604B2 (ja)
KR (1) KR102400476B1 (ja)
CN (1) CN109964302A (ja)
TW (1) TWI764930B (ja)
WO (1) WO2018057797A1 (ja)

Families Citing this family (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP3375091A1 (en) 2015-11-13 2018-09-19 IQE Plc. Layer structures for rf filters fabricated using rare earth oxides and epitaxial aluminum nitride
US10128350B2 (en) 2016-09-22 2018-11-13 Iqe Plc Integrated epitaxial metal electrodes
US10418457B2 (en) 2016-09-22 2019-09-17 Iqe Plc Metal electrode with tunable work functions
US11495670B2 (en) 2016-09-22 2022-11-08 Iqe Plc Integrated epitaxial metal electrodes
US10347483B2 (en) * 2017-05-29 2019-07-09 Franck Natali Rare earth nitride structure or device and fabrication method
TWI805620B (zh) * 2017-09-21 2023-06-21 英商Iqe有限公司 具可調功函數之金屬電極
JP2021525961A (ja) * 2018-05-29 2021-09-27 アイキューイー ピーエルシーIQE plc 緩衝材にわたって形成される光電子デバイス
EP3896850A1 (en) 2020-04-14 2021-10-20 IQE plc Layered structure with regions of localized strain in crystalline rare earth oxides
CN112582541B (zh) * 2020-12-06 2022-07-29 南开大学 一种基于二维叠层异质结构的垂直单分子膜场效应晶体管及其制备方法
US11532642B2 (en) 2020-12-14 2022-12-20 Taiwan Semiconductor Manufacturing Company, Ltd. Multi-function substrate
CN113113294B (zh) * 2021-04-07 2022-06-07 厦门市三安集成电路有限公司 一种复合衬底及制备方法、射频集成芯片制备方法

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004006722A (ja) 2002-03-27 2004-01-08 Seiko Epson Corp 圧電アクチュエータ、インクジェット式ヘッド及び吐出装置
US20130062610A1 (en) 2011-09-14 2013-03-14 Andrew Clark Lattice matched crystalline reflector
JP2015162905A (ja) 2014-02-27 2015-09-07 アバゴ・テクノロジーズ・ジェネラル・アイピー(シンガポール)プライベート・リミテッド ドープされた圧電層を有するバルク音響共振器
JP2016515299A (ja) 2013-02-22 2016-05-26 トランスルーセント インコーポレイテッドTranslucent, Inc. 希土類酸化物ゲート誘電体を備えた、シリコン基板上に成長したiii−n半導体素子
JP2016100592A (ja) 2014-11-26 2016-05-30 株式会社Flosfia 結晶性積層構造体およびその製造方法

Family Cites Families (59)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4857415A (en) 1987-05-29 1989-08-15 Raytheon Company Method of producing single crystalline magnetic film having bi-axial anisotropy
US5594280A (en) 1987-10-08 1997-01-14 Anelva Corporation Method of forming a thin film and apparatus of forming a metal thin film utilizing temperature controlling means
JP2680468B2 (ja) 1989-07-01 1997-11-19 株式会社東芝 半導体装置および半導体装置の製造方法
EP0498580A1 (en) 1991-02-04 1992-08-12 Canon Kabushiki Kaisha Method for depositing a metal film containing aluminium by use of alkylaluminium halide
US5387459A (en) * 1992-12-17 1995-02-07 Eastman Kodak Company Multilayer structure having an epitaxial metal electrode
US5828080A (en) * 1994-08-17 1998-10-27 Tdk Corporation Oxide thin film, electronic device substrate and electronic device
JP3193302B2 (ja) * 1996-06-26 2001-07-30 ティーディーケイ株式会社 膜構造体、電子デバイス、記録媒体および強誘電体薄膜の製造方法
JP3813740B2 (ja) * 1997-07-11 2006-08-23 Tdk株式会社 電子デバイス用基板
US6610548B1 (en) 1999-03-26 2003-08-26 Sony Corporation Crystal growth method of oxide, cerium oxide, promethium oxide, multi-layered structure of oxides, manufacturing method of field effect transistor, manufacturing method of ferroelectric non-volatile memory and ferroelectric non-volatile memory
US6437667B1 (en) * 2000-02-04 2002-08-20 Agere Systems Guardian Corp. Method of tuning thin film resonator filters by removing or adding piezoelectric material
US6709776B2 (en) 2000-04-27 2004-03-23 Tdk Corporation Multilayer thin film and its fabrication process as well as electron device
US6555946B1 (en) 2000-07-24 2003-04-29 Motorola, Inc. Acoustic wave device and process for forming the same
US20020089023A1 (en) * 2001-01-05 2002-07-11 Motorola, Inc. Low leakage current metal oxide-nitrides and method of fabricating same
US6936837B2 (en) * 2001-05-11 2005-08-30 Ube Industries, Ltd. Film bulk acoustic resonator
JP4115789B2 (ja) * 2001-09-19 2008-07-09 株式会社東芝 半導体装置の製造方法
WO2003098714A1 (fr) 2002-05-15 2003-11-27 Seiko Epson Corporation Actionneur piezo-electrique et tête à jet d'encre
JP4457587B2 (ja) 2002-09-05 2010-04-28 セイコーエプソン株式会社 電子デバイス用基体の製造方法及び電子デバイスの製造方法
JP4734823B2 (ja) 2003-06-11 2011-07-27 富士通株式会社 膜多層構造体及びこれを用いるアクチュエータ素子、容量素子、フィルタ素子
JP4165347B2 (ja) 2003-06-25 2008-10-15 セイコーエプソン株式会社 圧電素子の製造方法
JP2005150990A (ja) * 2003-11-13 2005-06-09 Tdk Corp 薄膜バルク波共振器ウェハ及び薄膜バルク波共振器の製造方法
WO2005048318A2 (en) 2003-11-17 2005-05-26 Osemi, Inc. Nitride metal oxide semiconductor integrated transistor devices
US7384481B2 (en) 2003-12-29 2008-06-10 Translucent Photonics, Inc. Method of forming a rare-earth dielectric layer
JP2005294452A (ja) * 2004-03-31 2005-10-20 Fujitsu Ltd 薄膜積層体、その薄膜積層体を用いたアクチュエータ素子、フィルター素子、強誘電体メモリ、および光偏向素子
US7605531B1 (en) 2005-10-25 2009-10-20 Translucent, Inc. Full color display including LEDs with rare earth active areas and different radiative transistions
JP4768427B2 (ja) * 2005-12-12 2011-09-07 株式会社東芝 半導体記憶装置
US7643526B1 (en) 2006-06-21 2010-01-05 Michael Lebby Spontaneous/stimulated light emitting μ-cavity device
US20080217695A1 (en) * 2007-03-05 2008-09-11 Translucent Photonics, Inc. Heterogeneous Semiconductor Substrate
US8049100B2 (en) * 2007-07-26 2011-11-01 Translucent, Inc. Multijunction rare earth solar cell
CN100508229C (zh) * 2007-08-30 2009-07-01 鹤山丽得电子实业有限公司 一种无掩膜半导体外延片制作方法
AU2008349509B2 (en) 2008-01-28 2013-12-19 Amit Goyal Semiconductor-based large-area flexible electronic devices
US8878363B2 (en) 2009-06-26 2014-11-04 Intel Corporation Fermi-level unpinning structures for semiconductive devices, processes of forming same, and systems containing same
US8564094B2 (en) * 2009-09-09 2013-10-22 Micron Technology, Inc. Capacitors including at least two portions of a metal nitride material, methods of forming such structures, and semiconductor devices including such structures
US9847768B2 (en) * 2009-11-23 2017-12-19 Avago Technologies General Ip (Singapore) Pte. Ltd. Polarity determining seed layer and method of fabricating piezoelectric materials with specific C-axis
US9136819B2 (en) 2012-10-27 2015-09-15 Avago Technologies General Ip (Singapore) Pte. Ltd. Bulk acoustic wave resonator having piezoelectric layer with multiple dopants
US9602073B2 (en) * 2013-05-31 2017-03-21 Avago Technologies General Ip (Singapore) Pte. Ltd. Bulk acoustic wave resonator having piezoelectric layer with varying amounts of dopant
US9450561B2 (en) * 2009-11-25 2016-09-20 Avago Technologies General Ip (Singapore) Pte. Ltd. Bulk acoustic wave (BAW) resonator structure having an electrode with a cantilevered portion and a piezoelectric layer with varying amounts of dopant
US20120264284A1 (en) 2011-04-14 2012-10-18 Wang shao-wei Manufacturing method for metal gate structure
US8618525B2 (en) * 2011-06-09 2013-12-31 Intermolecular, Inc. Work function tailoring for nonvolatile memory applications
US9105471B2 (en) 2011-08-03 2015-08-11 Translucent, Inc. Rare earth oxy-nitride buffered III-N on silicon
US8698119B2 (en) * 2012-01-19 2014-04-15 Sandisk 3D Llc Nonvolatile memory device using a tunnel oxide as a current limiter element
JP6083262B2 (ja) * 2012-03-14 2017-02-22 Tdk株式会社 ヘテロエピタキシャルpn接合酸化物薄膜を有する積層薄膜
DE102013010187A1 (de) * 2012-06-27 2014-01-02 Fairchild Semiconductor Corp. Schottky-Barriere-Vorrichtung mit lokal planarisierter Oberfläche und zugehöriges Halbleitererzeugnis
US8823055B2 (en) 2012-12-17 2014-09-02 Translucent, Inc. REO/ALO/A1N template for III-N material growth on silicon
US9129985B2 (en) 2013-03-05 2015-09-08 United Microelectronics Corp. Semiconductor device having metal gate and manufacturing method thereof
US8748900B1 (en) 2013-03-27 2014-06-10 Translucent, Inc. Re-silicide gate electrode for III-N device on Si substrate
US8796121B1 (en) 2013-11-19 2014-08-05 Translucent, Inc. Stress mitigating amorphous SiO2 interlayer
JP6347086B2 (ja) 2014-02-18 2018-06-27 アドバンストマテリアルテクノロジーズ株式会社 強誘電体セラミックス
US9520855B2 (en) 2014-02-26 2016-12-13 Avago Technologies General Ip (Singapore) Pte. Ltd. Bulk acoustic wave resonators having doped piezoelectric material and frame elements
US9876483B2 (en) * 2014-03-28 2018-01-23 Avago Technologies General Ip (Singapore) Pte. Ltd. Acoustic resonator device including trench for providing stress relief
US9853626B2 (en) * 2014-03-31 2017-12-26 Avago Technologies General Ip (Singapore) Pte. Ltd. Acoustic resonator comprising acoustic redistribution layers and lateral features
US10340885B2 (en) 2014-05-08 2019-07-02 Avago Technologies International Sales Pte. Limited Bulk acoustic wave devices with temperature-compensating niobium alloy electrodes
US9621126B2 (en) * 2014-10-22 2017-04-11 Avago Technologies General Ip (Singapore) Pte. Ltd. Bulk acoustic resonator device including temperature compensation structure comprising low acoustic impedance layer
EP3375091A1 (en) 2015-11-13 2018-09-19 IQE Plc. Layer structures for rf filters fabricated using rare earth oxides and epitaxial aluminum nitride
US10283349B2 (en) 2016-05-27 2019-05-07 Taiwan Semiconductor Manufacturing Co., Ltd. Single-crystal rare earth oxide grown on III-V compound
CN109478591B (zh) 2016-06-19 2023-07-25 Iqe公司 用于RF滤波器应用的外延AlN/稀土氧化物结构
US11495670B2 (en) 2016-09-22 2022-11-08 Iqe Plc Integrated epitaxial metal electrodes
US10128350B2 (en) 2016-09-22 2018-11-13 Iqe Plc Integrated epitaxial metal electrodes
US10418457B2 (en) 2016-09-22 2019-09-17 Iqe Plc Metal electrode with tunable work functions
TWI805620B (zh) 2017-09-21 2023-06-21 英商Iqe有限公司 具可調功函數之金屬電極

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2004006722A (ja) 2002-03-27 2004-01-08 Seiko Epson Corp 圧電アクチュエータ、インクジェット式ヘッド及び吐出装置
US20130062610A1 (en) 2011-09-14 2013-03-14 Andrew Clark Lattice matched crystalline reflector
JP2016515299A (ja) 2013-02-22 2016-05-26 トランスルーセント インコーポレイテッドTranslucent, Inc. 希土類酸化物ゲート誘電体を備えた、シリコン基板上に成長したiii−n半導体素子
JP2015162905A (ja) 2014-02-27 2015-09-07 アバゴ・テクノロジーズ・ジェネラル・アイピー(シンガポール)プライベート・リミテッド ドープされた圧電層を有するバルク音響共振器
JP2016100592A (ja) 2014-11-26 2016-05-30 株式会社Flosfia 結晶性積層構造体およびその製造方法

Also Published As

Publication number Publication date
KR102400476B1 (ko) 2022-05-20
US20190074365A1 (en) 2019-03-07
TWI764930B (zh) 2022-05-21
WO2018057797A1 (en) 2018-03-29
TW201826327A (zh) 2018-07-16
US10128350B2 (en) 2018-11-13
US10825912B2 (en) 2020-11-03
JP2019535134A (ja) 2019-12-05
EP3516681A1 (en) 2019-07-31
CN109964302A (zh) 2019-07-02
US20180138284A1 (en) 2018-05-17
KR20190065314A (ko) 2019-06-11

Similar Documents

Publication Publication Date Title
JP7005604B2 (ja) 統合されたエピタキシャル金属電極
JP7217781B2 (ja) 希土類酸化物およびエピタキシャル窒化アルミニウムを用いて加工されるrfフィルタのための層構造
US11495670B2 (en) Integrated epitaxial metal electrodes
US10923345B2 (en) Epitaxial metal oxide as buffer for epitaxial III-V layers
US10418457B2 (en) Metal electrode with tunable work functions
TWI805620B (zh) 具可調功函數之金屬電極
JP2019522358A (ja) GaN基板用途のためのプニクタイド緩衝材構造およびデバイス
US20200388489A1 (en) Integrated epitaxial metal electrodes for modified devices
JP2022517537A (ja) 集積化エピタキシャル金属電極
US11611001B2 (en) Localized strain fields in epitaxial layer over cREO

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20200828

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20200828

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20210915

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20210916

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20211126

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20211214

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20220105

R150 Certificate of patent or registration of utility model

Ref document number: 7005604

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150