JP6418050B2 - 増幅器 - Google Patents
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Description
図1は、本発明の実施の形態1に係る増幅器の平面図である。この増幅器はパッケージ10を備えている。パッケージ10には入力端子12が取り付けられている。パッケージ10の中には入力側分配回路16が設けられている。入力側分配回路16は、例えばアルミナ基板に金メッキを施して形成される。入力側分配回路16と入力端子12は入力端子ワイヤ14で接続されている。
図4は、実施の形態2に係る増幅器の平面図である。第1増幅素子18、20と第2増幅素子22、24の間隔(X1)は2mm以上4mm以下である。第1増幅素子18、20と第2増幅素子22、24の間隔を十分とることで、動作時に高温になった複数の増幅素子が互いに温度を高めあい増幅素子の出力を低下させることを防止できる。
図6は、実施の形態3に係る増幅器の平面図である。第1増幅素子18、20と第2増幅素子22、24の間に中間基板100(スルー線路基板)が設けられている。図7は、図6の一部拡大図である。中間基板100は、例えば0.2mm、0.254mm、0.635mm、又は1mmのいずれかの厚みを有するアルミナ基板を備えている。そのアルミナ基板の上に第1パターン100aと第2パターン100bが形成されている。第1パターン100aと第2パターン100bは例えば幅が0.1mmの細長い形状を有している。
図8は、実施の形態4に係る増幅器の平面図である。第1増幅素子18、20及び第2増幅素子22、24は、図1の増幅素子を90度回転させた位置にある。したがって、第1増幅素子18、20への信号入力方向、第1増幅素子18、20の信号出力方向、第2増幅素子22、24への信号入力方向、及び第2増幅素子22、24の信号出力方向は、入力端子12と出力端子36を結ぶ線に交差する方向となっている。入力端子12と出力端子36を結ぶ線と平行方向を伝送方向と称する。
実施の形態1−4の増幅素子は、1つの増幅素子(FETチップ)に複数の単位セルのトランジスタが敷き詰められたマルチセル構造となっている。これに対し、実施の形態5の増幅素子は、1つの増幅素子(FETチップ)に1つの単位セルのトランジスタがもうけられた単位セル構造で形成する。
図14は、実施の形態6に係る増幅器の平面図である。分配パターン16Pが形成された入力側分配回路16が設けられている。入力端子ワイヤ14が入力端子12と分配パターン16Pを接続している。さらに、この増幅器は合成パターン34Pが形成された出力側合成回路34を備えている。出力端子ワイヤ38が出力端子36と合成パターン34Pを接続している。入力側分配回路16と出力側合成回路34の間に、ゲートパッド200aとドレインパッド200bを有する第1増幅素子200と、ゲートパッド202aとドレインパッド202bを有する第2増幅素子202が設けられている。
Claims (7)
- パッケージと、
前記パッケージの中に設けられた入力側分配回路と、
前記パッケージの中に設けられた出力側合成回路と、
第1ゲートパッドと第1ドレインパッドを有し、前記パッケージの中に前記入力側分配回路に沿って設けられた複数の第1増幅素子と、
第2ゲートパッドと第2ドレインパッドを有し、前記パッケージの中に前記出力側合成回路に沿って設けられた、前記第1増幅素子と同じ形状の複数の第2増幅素子と、
前記複数の第1増幅素子と前記複数の第2増幅素子の間に設けられた、第1パターンと第2パターンが形成された中間基板と、
前記入力側分配回路と前記第1ゲートパッドを接続する入力ワイヤと、
前記入力側分配回路と第1パターンを接続する第1接続ワイヤと、
前記第1パターンと前記第2ゲートパッドを接続する第2接続ワイヤと、
前記第2ドレインパッドと前記出力側合成回路を接続する出力ワイヤと、
前記第1ドレインパッドと前記第2パターンを接続する第3接続ワイヤと、
前記第2パターンと前記出力側合成回路を接続する第4接続ワイヤと、を備え、
前記複数の第1増幅素子と前記複数の第2増幅素子が千鳥状に設けられ、
前記入力ワイヤの長さは、前記第1接続ワイヤの長さと、前記第2接続ワイヤの長さと、前記第1パターンの前記第1接続ワイヤの固定点から前記第2接続ワイヤの固定点までの長さと、の和に等しく、
前記出力ワイヤの長さは、前記第3接続ワイヤの長さと、前記第4接続ワイヤの長さと、前記第2パターンの前記第3接続ワイヤの固定点から前記第4接続ワイヤの固定点までの長さと、の和に等しいことを特徴とする増幅器。 - 前記中間基板は、0.2mm、0.254mm、0.635mm、又は1mmのいずれかの厚みを有するアルミナ基板を備え、
前記第1パターンと前記第2パターンが前記アルミナ基板上に設けられ、
前記第1パターンと前記第2パターンの幅が0.1mmであることを特徴とする請求項1に記載の増幅器。 - 前記パッケージに取り付けられた入力端子と、
前記パッケージに取り付けられた出力端子と、
前記入力側分配回路のパターンである分配パターンと、
前記入力端子と前記分配パターンを接続する入力端子ワイヤと、を備え、
前記入力ワイヤと前記第1接続ワイヤは前記分配パターンに接続され、
前記分配パターンは、前記入力端子ワイヤが打たれた入力点から、前記入力ワイヤ及び前記第1接続ワイヤが接続された出力点までの信号経路長を均一にするように形成されたことを特徴とする請求項1又は2に記載の増幅器。 - 前記パッケージに取り付けられた入力端子と、
前記パッケージに取り付けられた出力端子と、
前記出力側合成回路のパターンである合成パターンと、
前記出力端子と前記合成パターンを接続する出力端子ワイヤと、を備え、
前記第4接続ワイヤと前記出力ワイヤは前記合成パターンに接続され、
前記合成パターンは、前記出力端子ワイヤが打たれた出力点から、前記第4接続ワイヤ及び前記出力ワイヤが接続された入力点までの信号経路長を均一にするように形成されたことを特徴とする請求項1又は2に記載の増幅器。 - 前記入力側分配回路と前記出力側合成回路は、0.2mm、0.254mm、0.635mm、又は1mmのいずれかの厚みを有するアルミナ基板、又は0.18mm、0.2mm、0.25mm、0.3mm、0.38mm、又は0.4mmのいずれかの厚みを有し比誘電率が38、89、又は150のいずれかの高誘電率基板に、金メッキを施したものであることを特徴とする請求項1〜4のいずれか1項に記載の増幅器。
- 前記複数の第1増幅素子のそれぞれと、前記複数の第2増幅素子のそれぞれは単位セルで構成されたことを特徴とする請求項1〜5のいずれか1項に記載の増幅器。
- 前記パッケージに取り付けられた入力端子と、
前記パッケージに取り付けられた出力端子と、
前記複数の第1増幅素子への信号入力方向、前記複数の第1増幅素子の信号出力方向、前記複数の第2増幅素子への信号入力方向、及び前記複数の第2増幅素子の信号出力方向は、前記入力端子と前記出力端子を結ぶ線に交差する方向であることを特徴とする請求項1又は2に記載の増幅器。
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