JP5642935B2 - インピーダンス調整回路及びこれを備える半導体装置 - Google Patents
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Description
120 内部回路
130 出力回路
131 プルアップ駆動回路
132 プルダウン駆動回路
133 前段回路
140,140a インピーダンス調整回路
141,141a,242 インピーダンス調整制御回路
1421,1422 カウンタ回路
1441,1442,1443 レプリカ回路
1451,1452 基準電圧発生回路
1461,1462,4162 比較回路
1471〜1473,2471,2471a,2472,2472a,3471,3472,347,5472 判定回路
3473 切り換え器
Claims (5)
- 出力端子と、
それぞれが前記出力端子に接続され、それぞれが前記出力端子を駆動する第1及び第2の駆動回路と、
前記第1の駆動回路に接続された第1のカウンタ回路であって、前記第1の駆動回路の第1のインピーダンスが第1の基準インピーダンスに接近するように、又は、当該第1のインピーダンスが当該第1の基準インピーダンスと実質的に等しくなるように、前記第1の駆動回路の前記第1のインピーダンスを変化させる前記第1のカウンタ回路と、
前記第1の駆動回路の前記第1のインピーダンスが前記第1の基準インピーダンスよりも高いレベル又は低いレベルのいずれか一方のレベルから前記第1の基準インピーダンスよりも高いレベル又は低いレベルの他方のレベルへと変化し、さらに、前記第1の駆動回路の前記第1のインピーダンスが前記第1の基準インピーダンスよりも高いレベル又は低いレベルのいずれか前記他方のレベルから前記第1の基準インピーダンスよりも高いレベル又は低いレベルの前記一方のレベルへと変化したときに、第1の判定信号を発生する第1の判定回路と、
前記第2の駆動回路に接続された第2のカウンタ回路であって、前記第1の判定回路が前記第1の判定信号を発生した後に、前記第2の駆動回路の第2のインピーダンスが第2の基準インピーダンスに接近するように、又は、当該第2のインピーダンスが当該第2の基準インピーダンスと実質的に等しくなるように、前記第2の駆動回路の前記第2のインピーダンスを変化させる前記第2のカウンタ回路と、
前記第2の駆動回路の前記第2のインピーダンスが前記第2の基準インピーダンスよりも高いレベル又は低いレベルの前記他方のレベルから前記第2の基準インピーダンスよりも高いレベル又は低いレベルの前記一方のレベルへと変化し、さらに、前記第2の駆動回路の前記第2のインピーダンスが前記第2の基準インピーダンスよりも高いレベル又は低いレベルのいずれか前記一方のレベルから前記第2の基準インピーダンスよりも高いレベル又は低いレベルの前記他方のレベルへと変化したときに、第2の判定信号を発生する第2の判定回路と、
前記第1の判定信号に応答して前記第1のカウンタ回路が前記第1の駆動回路の前記第1のインピーダンスを変化させる動作を停止し、前記第2の判定信号に応答して前記第2のカウンタ回路が前記第2の駆動回路の前記第2のインピーダンスを変化させる動作を停止する制御回路と、
を備えることを特徴とする半導体装置。 - 前記第1の判定回路が、前記第2の判定回路と実質的に同一の回路構成を有することを特徴とする請求項1に記載の半導体装置。
- 前記第1の判定回路が、互いに直列に接続された少なくとも3つの第1のフリップフロップ回路を有し、前記第2の判定回路が、互いに直列に接続された少なくとも3つの第2のフリップフロップ回路を有することを特徴とする請求項1に記載の半導体装置。
- キャリブレーション端子と、
前記キャリブレーション端子に接続され、前記第1の駆動回路の前記第1のインピーダンスに関連する第3のインピーダンスを示す第1のレプリカ回路と、
前記キャリブレーション端子の電位と基準電圧とを比較し、比較結果に応じて第1又は第2の論理レベルをとる第1の比較信号を発生する第1の比較回路と、
前記第1のレプリカ回路の前記第3のインピーダンスと実質的に同一の第4のインピーダンスを示す第2のレプリカ回路と、
前記第2のレプリカ回路と第1のノードで接続され、前記第2の駆動回路の前記第2のインピーダンスに関連する第5のインピーダンスを示す第3のレプリカ回路と、
前記第1のノードの電位と前記基準電圧とを比較し、比較結果に応じて前記第1又は前記第2の論理レベルをとる第2の比較信号を発生する第2の比較回路と、を有し、
前記第1の判定回路は、互いに直列に接続された少なくとも3つの第1のフリップフロップ回路であって、当該少なくとも3つの第1のフリップフロップ回路のうちの先頭の1つは、自身の入力端子で前記第1の比較信号を受け取る少なくとも3つの前記第1のフリップフロップ回路を含み、
前記第2の判定回路は、互いに直列に接続された少なくとも3つの第2のフリップフロップ回路であって、当該少なくとも3つの第2のフリップフロップ回路のうちの先頭の1つは、自身の入力端子で前記第2の比較信号を受け取る少なくとも3つの前記第2のフリップフロップ回路を含む、ことを特徴とする請求項1に記載の半導体装置。 - 出力端子に接続された第1の駆動回路のインピーダンスを第1の基準インピーダンスに向かって段階的に調整し、
前記第1の駆動回路の前記インピーダンスが前記第1の基準インピーダンスと少なくとも2回交差し、前記第1の駆動回路の前記インピーダンスが前記第1の基準インピーダンスよりも第1の幅高い状態と前記第1の基準インピーダンスよりも第2の幅低い状態のいずれか一方である第1の最終インピーダンスに調整されたときに、前記第1の駆動回路の前記インピーダンスの調整を終了し、
前記出力端子に接続された第2の駆動回路のインピーダンスを第2の基準インピーダンスに向かって段階的に調整し、
前記第2の駆動回路の前記インピーダンスが前記第2の基準インピーダンスと少なくとも2回交差し、前記第2の駆動回路の前記インピーダンスが前記第2の基準インピーダンスよりも第3の幅高い状態と前記第2の基準インピーダンスよりも第4の幅低い状態のいずれか一方である第2の最終インピーダンスに調整されたときに、前記第2の駆動回路の前記インピーダンスの調整を終了し、
前記第1の駆動回路の前記第1の最終インピーダンスが前記第1の基準インピーダンスよりも前記第1の幅高い状態であるときは、前記第2の駆動回路の前記第2の最終インピーダンスを選択的に前記第2の基準インピーダンスよりも前記第4の幅低い状態とし、前記第1の駆動回路の前記第1の最終インピーダンスが前記第1の基準インピーダンスよりも前記第2の幅低い状態であるときは、前記第2の駆動回路の前記第2の最終インピーダンスを選択的に前記第2の基準インピーダンスよりも前記第3の幅高い状態とする、ことを特徴とする半導体装置の制御方法。
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