JP4674474B2 - パラレル駆動バイアンプ切換回路 - Google Patents
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Description
(1/48000)÷4×(2/256)=0.041μs
程度となる。この遅延時間は、上記の値を最低値として、パラレル鼓動した場合の回路での歪等の最適値を勘案して決定する.
この場合、多チャンネル再生時にはLチャンネル用増幅器となる増幅器4AとCチャンネル用増幅器となる増幅器4Bは、パラレルに接続されLチャンネルスピーカ5を低インピーダンスで駆動し、低域成分の音質向上に効果があるダンピングファクターを増加する効果が期待できる。
2 プロロジックデコード部デコーダ
3L,3C,3R,3S 出力端子
4A 第1の増幅器
4B 第2の増幅器
4C 第3の増幅器
4D 第4の増幅器
5 Lチャンネル用スピーカ
6 Rチャンネル用スピーカ
8L,8R 遅延回路
S1〜S14 スイッチ
101 CPU
102 ROM
103 RAM
105 チャンネル選択部
Claims (4)
- 多チャンネル再生モードと2チャンネルステレオ再生モードとを選択的に切換可能なAVアンプに用いるパラレル駆動バイアンプ切換回路であって、
PWM方式の第1の増幅器と、
PWM方式の第2の増幅器と、
前記第1の増幅器に接続する第1のスピーカと、
前記第2の増幅器に接続する第2のスピーカと、
遅延回路とを備え、
多チャンネル再生の時は第1の信号源の信号を前記第1の増幅器で増幅して前記第1のスピーカの端子に出力し前記第2の信号源の信号を前記第2の増幅器で増幅して前記第2のスピーカの端子に出力し、
2チャンネルステレオ再生の時は第1の信号源の信号を前記遅延回路を介して前記第1の増幅器で増幅して前記第1のスピーカの端子に出力すると共に前記第1の信号源の信号を前記第2の増幅器で増幅して前記第1のスピーカの同一端子に同一入力信号のタイミングを一致させることなく出力するように構成した事を特徴とするパラレル駆動バイアンプ切換回路。 - 多チャンネル再生モードと2チャンネルステレオ再生モードとを選択的に切換可能なAVアンプに用いるパラレル駆動バイアンプ切換回路であって、
入力端子を第1の信号源にスイッチを介して接続し出力端子を第1のスピーカの端子に接続するPWM方式の第1の増幅器と、
入力端子を第2の信号源にスイッチを介して接続し出力をスイッチを介して前記第1のスピーカの端子に接続するかまたはスイッチを介して第2のスピーカの端子に接続するPWM方式の第2の増幅器と、
前記第1の信号源と前記第1の増幅器の入力との間にスイッチを介して接続された遅延回路と、
前記第1の信号源と前記第2の増幅器の入力との間にスイッチを介して接続された信号経路とを備え、
前記各部に配置された複数のスイッチの切換によって、
多チャンネル再生の時は第1の信号源の信号を前記第1の増幅器で増幅して前記第1のスピーカの端子に出力し前記第2の信号源の信号を前記第2の増幅器で増幅して前記第2のスピーカの端子に出力し、
2チャンネルステレオ再生の時は第1の信号源の信号を前記遅延回路を介して前記第1の増幅器で増幅して前記第1のスピーカの端子に出力すると共に前記第1の信号源の信号を前記第2の増幅器で増幅して前記第1のスピーカの同一出力端子に同一入力信号のタイミングを一致させることなく出力するように構成した事を特徴とするパラレル駆動バイアンプ切換回路。 - 増幅器は3個以上であり、遅延回路の数は増幅器の数より1個少ないものである請求項1記載のパラレル駆動バイアンプ切換回路。
- 前記信号源となるデコーダと、
前記複数のスイッチのオン、オフを制御するコンピュータ装置と、
前記コンピュータ装置に指示を与えるモード選択部とをさらに備えた請求項1から3のいずれかに記載のパラレル駆動バイアンプ切換回路。
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