JP4111282B2 - 薄膜トランジスタ液晶表示装置及びその製造方法 - Google Patents

薄膜トランジスタ液晶表示装置及びその製造方法 Download PDF

Info

Publication number
JP4111282B2
JP4111282B2 JP17830297A JP17830297A JP4111282B2 JP 4111282 B2 JP4111282 B2 JP 4111282B2 JP 17830297 A JP17830297 A JP 17830297A JP 17830297 A JP17830297 A JP 17830297A JP 4111282 B2 JP4111282 B2 JP 4111282B2
Authority
JP
Japan
Prior art keywords
layer
etch stopper
liquid crystal
scanning line
display device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP17830297A
Other languages
English (en)
Other versions
JPH1090722A (ja
Inventor
ジン オ ヨン
ナン リン キョン
Original Assignee
エルジー.フィリップス エルシーデー カンパニー,リミテッド
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by エルジー.フィリップス エルシーデー カンパニー,リミテッド filed Critical エルジー.フィリップス エルシーデー カンパニー,リミテッド
Publication of JPH1090722A publication Critical patent/JPH1090722A/ja
Application granted granted Critical
Publication of JP4111282B2 publication Critical patent/JP4111282B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/136Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
    • G02F1/1362Active matrix addressed cells
    • G02F1/1368Active matrix addressed cells in which the switching element is a three-electrode device
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/136Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit

Landscapes

  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Mathematical Physics (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • General Physics & Mathematics (AREA)
  • Optics & Photonics (AREA)
  • Liquid Crystal (AREA)
  • Thin Film Transistor (AREA)

Description

【0001】
【発明の属する技術分野】
本発明は薄膜トランジスタ液晶表示装置(TFT-LCD:Thin Film Transister-Liquid Crystal Display)及びその製造方法に係り、特にフォトマスクを追加に使用しなくても容易にエッチストッパを形成することのできる薄膜トランジスタ液晶表示装置及びその製造方法に関する。
【0002】
【従来の技術】
アクティブマトリックス液晶表示装置のマトリックスアレイは薄膜トランジスタのようなスイッチング素子と、これに電気的に連結されており光を透過したり反射する画素電極を基本単位とする画素子が縦横に配列された構造を有する。この際、画素の特性を向上させるために補助容量キャパシタを追加して形成する場合もある。また、この画素を互いに連結する複数本のゲ−トバスラインと複数本のデ−タバスライン及び各ゲ−トバスラインと各デ−タバスラインの終端に形成された複数のパッドなどが含まれた構造である。
【0003】
図1は従来の薄膜トランジスタ液晶表示装置の第1例を説明するための図面であり、背面露光によってエッチストッパを形成した構造を示す。図1Aは平面図を、図1Bはその断面図を示す。
【0004】
図1に示したように、従来の一般のアクティブマトリックス液晶表示装置は、絶縁基板10上に走査線1と信号線2がマトリックス状に交差して画素部を形成している。ゲート電極11は走査線1から突出しており、ゲート絶縁膜13を介して、チャネルの生成されるドープされていない非晶質シリコン層からなる半導体活性層14がゲート電極11の上部に形成されている。半導体活性層14上にはゲート電極11の形状通りに形成されたエッチストッパ15が位置しているが、この時のエッチストッパ15は半導体活性層14上に窒化膜を形成した後、絶縁基板の下部で予め形成された走査線1をマスクとして背面露光(back exposure)することにより、走査線1の形状通りに得ることができる。
【0005】
エッチストッパ15の上端両側部分と半導体活性層14上にはドープされた非晶質シリコン層からなるオーム接触層6が形成されており、その上に下部のゲート電極11と一部重畳するようにソース電極16と、ソース電極16に対応し、ゲート電極11と一部重畳したドレイン電極17が形成されている。そして、ソース/ドレイン電極16,17とエッチストッパ15の上端にはドレイン電極17を外部と通じさせるコンタクトホールのある保護膜(passivation)18が形成されており、このコンタクトホールを介してドレイン電極17に連結された画素電極19が形成されている。
【0006】
未説明の図面符号12はゲート電極の表面に形成された陽極酸化膜を示す。
【0007】
しかし、前記従来の薄膜トランジスタ液晶表示装置はフォトレジストを使用せずに背面露光によってエッチストッパを形成するという容易な利点があるが、工程がらゲート電極の突出した走査線の形状によって開口率を向上させようとする目的の下では不適な構造をもっている。
【0008】
図2は従来の薄膜トランジスタ液晶表示装置の第2例を説明するための図面であり、フォトレジストによる選択露光によってエッチストッパを形成した構造を示す。図2Aは平面図を、図2Bはその断面図を示す。
【0009】
図2に示したように、従来の薄膜トランジスタ液晶表示装置は絶縁基板20上に走査線22と信号線21がマトリックス状に交差して画素部を形成している。走査線22はゲート電極のための突出部を形成していない直線形状である。信号線21は走査線22の下部で査線22の長手方向にソース電極23を突出させる。前記ソース電極23に対応する位置には信号線21と同一の配線材であるドレイン電極24が形成されている。この際、ドレイン電極24が走査線22の一部と重畳するように形成されることにより、ソース23とドレイン24が位置した走査線22部分はゲートの役割を果たしている。(以下、上部にソース電極とドレイン電極の位置した走査線の部位をゲート領域という。)
ゲート領域22の上部にはゲート絶縁膜26−1を介して、チャネルの生成されるドープされていない非晶質シリコン層からなる半導体活性層27が形成されている。半導体活性層27上には所定の形状を有するエッチストッパ28が位置しているが、この時のエッチストッパ28は半導体活性層27上に窒化膜を形成した後、フォトレジストを用いて所定の形状通りにフォトエッチングすることにより得られる。
【0010】
エッチストッパ28の上端両側部分と半導体活性層27上にはドープされた非晶質シリコン層からなるオーム接触層25が形成されており、その上に下部のゲート領域22と一部重畳するようにソース電極23と、ソース電極23に対応し、ゲート領域22と一部重畳するドレイン電極24が形成されている。ソース/ドレイン電極23,24とエッチストッパ28の上端にはドレイン電極24を外部と通じさせるコンタクトホールのある保護膜26-2が形成されており、このコンタクトホールを介してドレイン電極24に連結された画素電極29が形成されている。
【0011】
未説明の図面符号25はゲート領域の表面に形成された陽極酸化膜を示す。
【0012】
前記従来の薄膜トランジスタ液晶表示装置は、走査線の一部をゲート領域として使用することにより、走査線からの突出部を形成しないために開口率を高めることができる。しかし、エッチストッパの形成時、配線露光を行えないために、その代案としてフォトレジストを形成し、フォトマスクを追加に使用してパターン通りに選択露光し現像しなければならない煩わしさがあった。これは背面露光によって走査線の形状通りにエッチストッパを形成すると、ソース電極と活性層との接触が不如意であって本来の薄膜トランジスタの機能であるスイッチング素子としての機能を果たせないためである。
【0013】
【発明が解決しようとする課題】
本発明はかかる問題点を解決するためのもので、その目的は走査線に所定の形状に形成されたホールを用いて別途のマスクを用意せずに背面露光によってエッチストッパを形成することにある。
【0014】
【課題を解決するための手段】
発明の実施の形態1
上記目的を達成するために、本発明の薄膜トランジスタ液晶表示装置は、絶縁基板と、前記絶縁基板上にコンタクトホールをもって直線状に形成され、ゲート領域と非ゲート領域が定義される走査線と、前記走査線を覆う第1絶縁膜と、前記走査線の前記コンタクトホールの一部と前記走査線の前記ゲート領域に重畳する半導体活性層と、前記半導体活性層上に前記半導体活性層の一部を露出させるように形成されるエッチストッパと、前記走査線に交差し、前記走査線の方向に突出部を有し、前記突出部が前記露出された半導体活性層に接するように形成される信号線と、前記信号線の前記突出部と前記信号線の内側の一部を含む部分に定義されるソース電極と、前記ソース電極に対応するように形成されるドレイン電極とを含むことを特徴とする。
【0015】
また、本発明の薄膜トランジスタ液晶表示装置の製造方法は、絶縁基板上に第1導電層を積層する工程と、前記第1導電層をパターン食刻して、ゲート領域と非ゲート領域が定義され且つコンタクトホールのある走査線を形成する工程と、前記走査線と前記絶縁基板の露出された表面に第1絶縁膜を積層する工程と、前記第1絶縁膜上に非晶質シリコン層を積層する工程と、前記非晶質シリコン層をパターン食刻して前記走査線のゲート領域と前記コンタクトホールの一部に重畳する半導体活性層を形成する工程と、前記半導体活性層上と前記第1絶縁膜の露出された表面に窒化膜を積層する工程と、前記窒化膜を背面露光工程を用いてパターン食刻して前記走査線の形状通りに形成され、前記活性層の一部を露出させるエッチストッパを形成する工程と、前記エッチストッパ上と前記半導体活性層の露出された表面にドープされた非晶質シリコン層と第2導電層を順次積層する工程と、前記第2導電層と前記ドープされた非晶質層をパターン食刻して、前記半導体活性層に一部が接するソース電極と、前記ソース電極に連結される信号線と、前記ソース電極に対応するドレイン電極を形成する工程とを含むことを特徴とする。
【0016】
【発明の実施の形態】
以下、添付図面に基づき本発明の望ましい実施の形態を詳述する。
【0017】
図3は本発明による薄膜トランジスタ液晶表示装置を説明するための図面であり、図3Aは平面図を、図3Bはその断面図を示す。
【0018】
図3Aを参照すると、絶縁基板30上に直線状であり、所定の位置にコンタクトホールTが形成されたゲートライン32が形成されている。コンタクトホールTのあるゲートライン32部分はコンタクトホールTによりゲート領域と非ゲート領域とに区分される。そして、ゲートライン32に交差してデータライン31が形成されている。データライン31はゲートライン32と重畳する領域でゲートライン82の長手方向に位置し、ゲートライン32に形成されたコンタクトホールTの一部を覆う突起部、即ちソース電極33に当たる部分を有している。本実施形態において、ソース電極33はエッチストッパのコンタクトホールを介して非晶質シリコン36に接触する。そして、画素電極39がソース電極33と同一導電物質で形成されたドレイン電極34に連結され形成されている。
【0019】
図3Bを参照すると、ソース電極33とドレイン電極34の下部には半導体活性層36が形成されており、その下部にゲートライン32のゲート領域32-1が位置している。従って、ソース電極33、ドレイン電極34、及び非晶質シリコン36が形成された部位の下部に位置したゲートライン32の部分のゲート領域32-1はスイッチング素子の機能を果たす薄膜トランジスタをなす。一方、図示したように、ソース電極33とドレイン電極34の下部に位置した非晶質シリコン層36には非直線的なチャネル領域が形成されている。ドレイン電極34は保護膜35-2に形成されたコンタクトホールを通して上部の画素電極39に連結される。そして、エッチストッパ37が走査線のゲート領域32-1と同形状に半導体活性層36上にオーム接触層40と接して形成されている。
【0020】
未説明の32-2はコンタクトホールを挟んで両側に位置したゲートラインのうち非ゲート領域を、35-1はゲート絶縁膜を、38は走査線の表面上に形成される陽極酸化膜を示す。
【0021】
図4Aないし図6Fは本発明による液晶表示装置の製造工程図である。
【0022】
まず、図4Aに示したように、絶縁基板30上にスパッタ装備を用いて第1導電物質層を形成する。以後、導電層をパターン食刻して所定部分にコンタクトホールTが形成されたゲートライン32を形成する。コンタクトホールのあつゲートライン部分は2つの領域32-1、32-2に分けられるが、このうち一つの領域32-1はゲート領域となり、もう一つの領域は非ゲート領域32-2となる。第1導電物質としてはアルミニウム、アルミニウム合金、モリブデン、モリブデン合金、及び陽極酸化可能な金属うちいずれか一つを用いる。以後、ゲートライン32の表面上に陽極酸化膜を形成する。
【0023】
次いで、図4Bに示したように、陽極酸化膜上に第1絶縁膜35-1を形成する。この際、第1絶縁膜としてシリコン酸化膜或いはシリコン窒化膜が使われる。以後、第1絶縁膜35-1上に非晶質シリコン層を積層した後、非晶質シリコン層をゲートラインのゲート領域32-1に当たる部分に重畳するようにパターン食刻して半導体活性層36を形成する。
【0024】
その後、図5Cに示したように、半導体活性層36とゲート絶縁膜35-1の露出された表面上にエッチストッパ用絶縁膜37aを積層し、引き続き陽性感光性をもつフォトレジスト層を積層した後、基板の背面から光を照射する背面露光を施す。従って、光は走査線を除いた部分を通過してフォトレジスト層に達する。以後、現像工程を施すと、フォトレジストの非露光部分、即ち走査線のような形状のフォトレジストパターン50が形成される。この際、エッチストッパ用絶縁膜としては窒化膜を形成して用いることができる。
【0025】
次に、図5Dに示したように、フォトレジストパターン50をマスクとして下部にあるエッチストッパ用絶縁膜を食刻して、走査線のような形状のエッチストッパ37を形成する。以後、次の工程のためにフォトレジストパターンを除去する。
【0026】
次いで、図6Eに示したように、エッチストッパ37、露出された非晶質シリコン層及び露出された第1絶縁膜上にドープされた非晶質シリコン層と第2導電層を連続的に形成する。以後、所定の形状通りに第2導電層をパターン食刻して突出部を有するデータラインとドレイン電極84を形成する。以後、データラインとドレイン電極34をマスクとして下部のドープされた非晶質シリコン層を食刻してオーム接触層40を形成する。
【0027】
この際、データラインの突出部と突出部の近傍のデータラインの内側の一部がソース電極33に限定される。従って、平面図に示したように非直線形、即ちL形のチャネルが得られる。
【0028】
図6Fに示したように、露出された基板の表面にスパッタ装置を用いてシリコン酸化膜或いはシリコン窒化膜からなる保護膜35-2を形成する。以後、保護膜35-2をパターン食刻してドレイン電極34の一部を露出させるコンタクトホールを形成する。
【0029】
その後、保護膜85−2とドレイン電極34の露出された表面に透明導電層を蒸着した後、パターン食刻してドレイン電極34に連結される画素電極39を形成する。
【0030】
発明の実施の形態2
上述した製造方法によって完成されるエッチストッパは言及したように、走査線のような形状に形成される。ところが、エッチストッパはオーム接触層を食刻する過程で生じる半導体活性層の食刻を防止するために形成するものであって、半導体活性層上にのみ形成することもできる。
【0031】
まず、図4Aで説明したように、絶縁基板上にコンタクトホ−ル、ゲ−ト領域32−1及び非ゲ−ト領域32−2を有するゲ−トラインと陽極酸化膜38を形成する。
【0032】
その後、図7Aに示したように、第1絶縁膜35−1、非晶質シリコン層36a、エッチストッパ用絶縁膜を蒸着し続ける。図5Cに基づき説明したように、一般の背面露光方法を用いてエッチストッパ用絶縁膜を形成する。従って、ゲ−トラインのような形状を有するエッチストッパ37が得られる。
【0033】
その後、図7Bに示したように、走査線のような形状を有するエッチストッパ37をパタ−ン食刻して所定部分のみ残し全部取り除く。すなわち、走査線のゲ−ト領域32−1に当たる部分にのみエッチストッパ37を残すが、これは予め作られたマスクパタ−ンを用いて得られる。以後、全面に蒸着された非晶質シリコン層36aをパタ−ン食刻してエッチストッパ37の外側に所定部分が露出される非晶質シリコン層36を形成する。
【0034】
次いで、図6Eないし図6Fを参照して説明した通り、後続工程を進行してオーム接触層、信号線、ソ−ス電極、ドレイン電極、保護膜、及び画素電極を形成する。
【0035】
【発明の効果】
以上述べたように、本発明のアクティブマトリックス液晶表示装置のマトリックスアレイは、ゲ−トライン上にコンタクトホ−ルを形成する場合には開口率を減少せずに背面露光によりエッチストッパを容易に形成しうる。すなわち、マスクを別に備えなくても予め形成されたゲ−トラインをマスクとしてエッチストッパを形成することができて、工程上有利である。
【図面の簡単な説明】
【図1】従来の薄膜トランジスタ液晶表示装置の第1例を説明するための図面。
【図2】従来の薄膜トランジスタ液晶表示装置の第2例を説明するための図面。
【図3】本発明による薄膜トランジスタ液晶表示装置の平面図。
【図4】本発明による薄膜トランジスタ液晶表示装置の製造工程図。
【図5】本発明による薄膜トランジスタ液晶表示装置の製造工程図。
【図6】本発明による薄膜トランジスタ液晶表示装置の製造工程図。
【図7】本発明による薄膜トランジスタ液晶表示装置の他の製造工程図。
【符号の説明】
30 絶縁基板
31 信号線
32 走査線
32−1 ゲート領域
33 ソース電極
34 ドレイン電極
35−1 ゲート絶縁膜
35−2 保護膜
36 半導体活性層
37 エッチストッパ
38 陽極酸化膜
39 画素電極
40 オーム接触層

Claims (3)

  1. 絶縁基板上に第1導電層を積層する工程と、
    前記第1導電層をパターン食刻して、幅方向にゲート領域と非ゲート領域が定義され且つ前記絶縁基板を露出させるコンタクトホールがあり、長手方向が直線状の走査線を形成する工程と、
    前記走査線と前記絶縁基板の露出された表面に第1絶縁膜を積層する工程と、
    前記第1絶縁膜上に非晶質シリコン層を積層する工程と、
    前記非晶質シリコン層をパターン食刻して前記走査線のゲート領域と前記コンタクトホールの一部に重畳する半導体活性層を形成する工程と、
    前記半導体活性層上と前記第1絶縁膜の露出された表面に窒化膜を積層する工程と、
    前記窒化膜を背面露光工程を用いてパターン食刻して前記走査線の形状通りに形成され、前記活性層の一部を露出させるエッチストッパを形成する工程と、
    前記エッチストッパ上と前記半導体活性層の露出された表面にドープされた非晶質シリコン層と第2導電層を順次積層する工程と、
    前記第2導電層と前記ドープされた非晶質層をパターン食刻して、前記半導体活性層に一部が接するソース電極と、前記ソース電極に連結される信号線と、前記ソース電極に対応するドレイン電極を形成する工程とを含むことを特徴とする薄膜トランジスタ液晶表示装置の製造方法。
  2. 前記背面露光工程を用いる前記エッチストッパの形成工程は、
    前記窒化膜上に陽性形のフォトレジスト層を連続蒸着する工程と、
    前記基板の背面で前記走査線をマスクとして前記フォトレジスト層を選択露光する工程と、
    前記選択露光されたフォトレジスト層を現像してフォトレジストパターンを形成する工程と、
    前記フォトレジストパターンをマスクとして前記窒化膜を食刻してエッチストッパを形成する工程とを含むことを特徴とする請求項記載の薄膜トランジスタ液晶表示装置の製造方法。
  3. 前記基板の全面に第2絶縁層を積層する工程と、
    前記第2絶縁膜をパターン食刻して前記ドレイン電極の一部を露出させるコンタクトホールを形成する工程と、
    前記ドレイン電極の一部を露出させるコンタクトホールを通して前記ドレイン電極に連結される画素電極を形成する工程とをさらに含むことを特徴とする請求項記載の薄膜トランジスタ液晶表示装置の製造方法。
JP17830297A 1996-08-30 1997-07-03 薄膜トランジスタ液晶表示装置及びその製造方法 Expired - Lifetime JP4111282B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
KR1019960036719A KR100219118B1 (ko) 1996-08-30 1996-08-30 박막트랜지스터 액정표시장치 및 그 제조방법
KR96-36719 1996-08-30

Publications (2)

Publication Number Publication Date
JPH1090722A JPH1090722A (ja) 1998-04-10
JP4111282B2 true JP4111282B2 (ja) 2008-07-02

Family

ID=19471617

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17830297A Expired - Lifetime JP4111282B2 (ja) 1996-08-30 1997-07-03 薄膜トランジスタ液晶表示装置及びその製造方法

Country Status (3)

Country Link
US (2) US5969778A (ja)
JP (1) JP4111282B2 (ja)
KR (2) KR100219118B1 (ja)

Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100262954B1 (ko) * 1997-09-03 2000-08-01 구본준 액정 표시 장치 제조 방법 및 그 제조 방법에 의한 구조
KR100660813B1 (ko) * 1999-12-31 2006-12-26 엘지.필립스 엘시디 주식회사 엑스레이 디텍터용 어레이기판 제조방법
JP4118484B2 (ja) 2000-03-06 2008-07-16 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP2001257350A (ja) 2000-03-08 2001-09-21 Semiconductor Energy Lab Co Ltd 半導体装置およびその作製方法
JP4700160B2 (ja) * 2000-03-13 2011-06-15 株式会社半導体エネルギー研究所 半導体装置
JP4118485B2 (ja) 2000-03-13 2008-07-16 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP4683688B2 (ja) 2000-03-16 2011-05-18 株式会社半導体エネルギー研究所 液晶表示装置の作製方法
JP4393662B2 (ja) 2000-03-17 2010-01-06 株式会社半導体エネルギー研究所 液晶表示装置の作製方法
TW498178B (en) * 2000-05-02 2002-08-11 Hannstar Display Corp Manufacturing method and structure for in-plane switching mode liquid crystal display unit
JP4785229B2 (ja) * 2000-05-09 2011-10-05 株式会社半導体エネルギー研究所 半導体装置の作製方法
US6734924B2 (en) * 2000-09-08 2004-05-11 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device
JP4596101B2 (ja) * 2000-10-18 2010-12-08 日本電気株式会社 液晶表示装置
US7167226B2 (en) * 2000-11-02 2007-01-23 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device having particular configuration of pixel electrodes
KR100617027B1 (ko) * 2000-12-15 2006-08-30 엘지.필립스 엘시디 주식회사 액정표시소자 제조방법
KR100379824B1 (ko) * 2000-12-20 2003-04-11 엘지.필립스 엘시디 주식회사 식각용액 및 식각용액으로 패턴된 구리배선을 가지는전자기기용 어레이기판
US7071037B2 (en) 2001-03-06 2006-07-04 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
JP4728507B2 (ja) * 2001-06-08 2011-07-20 Nec液晶テクノロジー株式会社 アクティブマトリクス型液晶表示装置及びその製造方法
KR100838185B1 (ko) * 2001-09-24 2008-06-13 엘지디스플레이 주식회사 어레이 기판 및 이를 이용한 액정 표시 장치와, 이의 제조방법
KR100475108B1 (ko) * 2001-12-22 2005-03-10 엘지.필립스 엘시디 주식회사 액정표시장치 및 그 제조 방법
TW540137B (en) * 2002-07-16 2003-07-01 Hannstar Display Corp TFT LCD, the semiconductor structure thereof, and the fabrication method thereof
KR100519372B1 (ko) * 2002-12-31 2005-10-07 엘지.필립스 엘시디 주식회사 액정표시장치 및 그 제조방법
KR100640216B1 (ko) * 2004-05-29 2006-10-31 엘지.필립스 엘시디 주식회사 액정 표시패널 및 그 제조방법
KR101189709B1 (ko) * 2006-10-09 2012-10-10 삼성디스플레이 주식회사 표시 기판, 이의 제조 방법 및 이를 구비하는 표시 장치
KR101329406B1 (ko) * 2006-12-23 2013-11-14 엘지디스플레이 주식회사 박막 트랜지스터 어레이 기판 및 그 제조방법
CN101364603A (zh) * 2007-08-10 2009-02-11 北京京东方光电科技有限公司 一种tft阵列基板结构及其制造方法
CN104345510B (zh) * 2014-09-26 2017-10-03 京东方科技集团股份有限公司 液晶面板以及液晶面板的制造方法
TWI685694B (zh) * 2019-03-05 2020-02-21 友達光電股份有限公司 畫素結構

Family Cites Families (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2605442B1 (fr) * 1986-10-17 1988-12-09 Thomson Csf Ecran de visualisation electrooptique a transistors de commande et procede de realisation
US4955697A (en) * 1987-04-20 1990-09-11 Hitachi, Ltd. Liquid crystal display device and method of driving the same
US5032883A (en) * 1987-09-09 1991-07-16 Casio Computer Co., Ltd. Thin film transistor and method of manufacturing the same
JP2807496B2 (ja) * 1989-08-11 1998-10-08 シャープ株式会社 アクティブマトリクス基板
US5058995A (en) * 1990-03-15 1991-10-22 Thomson Consumer Electronics, Inc. Pixel electrode structure for liquid crystal display devices
KR920006894A (ko) * 1990-09-27 1992-04-28 쓰지 하루오 액티브 매트릭스 표시장치
JPH0534720A (ja) * 1991-07-29 1993-02-12 Toshiba Corp アクテイブマトリクス型液晶表示装置
US5441905A (en) * 1993-04-29 1995-08-15 Industrial Technology Research Institute Process of making self-aligned amorphous-silicon thin film transistors
US5414283A (en) * 1993-11-19 1995-05-09 Ois Optical Imaging Systems, Inc. TFT with reduced parasitic capacitance
JPH07221316A (ja) * 1994-02-03 1995-08-18 Casio Comput Co Ltd 薄膜トランジスタの製造方法
JPH07271020A (ja) * 1994-03-18 1995-10-20 Internatl Business Mach Corp <Ibm> ブラックマトリックス形成用感光性組成物、カラーフィルター基板及びそれを用いた液晶表示装置
JP2797972B2 (ja) * 1994-06-28 1998-09-17 日本電気株式会社 アクティブマトリクス型液晶表示装置

Also Published As

Publication number Publication date
KR100219118B1 (ko) 1999-09-01
KR100248124B1 (ko) 2000-03-15
JPH1090722A (ja) 1998-04-10
US6130729A (en) 2000-10-10
KR19980072402A (ko) 1998-11-05
US5969778A (en) 1999-10-19
KR19980016969A (ko) 1998-06-05

Similar Documents

Publication Publication Date Title
JP4111282B2 (ja) 薄膜トランジスタ液晶表示装置及びその製造方法
USRE38901E1 (en) Manufacturing methods of liquid crystal displays
US5793460A (en) Liquid crystal display device and method for manufacturing the same
US7049215B2 (en) Thin film transistor array panel and fabricating method thereof
US6927105B2 (en) Thin film transistor array substrate and manufacturing method thereof
JP3654474B2 (ja) アクティブマトリックス液晶表示装置のマトリックスアレイ及び液晶表示装置並びにその製造方法
US5998230A (en) Method for making liquid crystal display device with reduced mask steps
US7663143B2 (en) Thin film transistor having a short channel formed by using an exposure mask with slits
JP4131297B2 (ja) 液晶表示装置の製造方法
US5751020A (en) Structure of a liquid crystal display unit having exposed channel region
US5008218A (en) Method for fabricating a thin film transistor using a silicide as an etch mask
CN113948533A (zh) 阵列基板及其制作方法
KR101087398B1 (ko) 액정표시장치의 패드 구조 및 그 제조방법
CN113782493A (zh) 阵列基板的制备方法及阵列基板
JP2004531086A (ja) 薄膜トランジスタ基板及びその製造方法
KR20020095997A (ko) 액정 표시장치의 제조방법
US6746887B1 (en) Method of preventing a data pad of an array substrate from overetching
CN111446264A (zh) 阵列基板及其制造方法
KR100491820B1 (ko) 저온폴리실리콘 액정표시장치용 어레이 기판과 그 제조방법
KR100590925B1 (ko) 박막트랜지스터-액정표시장치의 제조방법
JP4152396B2 (ja) 薄膜トランジスタアレイの製造方法
KR100764273B1 (ko) 박막트랜지스터 제조방법
KR100601171B1 (ko) 액정 표시 장치용 박막 트랜지스터 기판 및 그 제조 방법
JP3071964B2 (ja) 液晶表示装置の製造方法
JPH09260678A (ja) 薄膜半導体装置の製造方法

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20040617

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20071105

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20080205

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20080310

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20080402

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110418

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110418

Year of fee payment: 3

S533 Written request for registration of change of name

Free format text: JAPANESE INTERMEDIATE CODE: R313533

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110418

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120418

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130418

Year of fee payment: 5

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20140418

Year of fee payment: 6

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

EXPY Cancellation because of completion of term