JP2752487B2 - ネツトワークインターフエース - Google Patents

ネツトワークインターフエース

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JP2752487B2
JP2752487B2 JP1502087A JP50208789A JP2752487B2 JP 2752487 B2 JP2752487 B2 JP 2752487B2 JP 1502087 A JP1502087 A JP 1502087A JP 50208789 A JP50208789 A JP 50208789A JP 2752487 B2 JP2752487 B2 JP 2752487B2
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circuit
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bus
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Description

【発明の詳細な説明】 従来技術 本発明はメインクレームの上位概念に記載するネット
ワークインターフェースに関するものである。
ネットワークインターフェースは、例えばコンピュー
ター技術においては広く用いられている。特に、自動車
におけるコントローラーエリアネットワークインターフ
ェースと呼ばれるものは多数の構成要素、サブシステム
および／またはシステムを接続するものとして知られて
いる。このネットワークの情報は２つのバスライン上で
運ばれる。短絡または断線によって２つの信号線の１つ
に何らかの障害が発生すると、結果として全体のネット
ワークがくずれてしまう。
本発明の利点 これに関連して、請求の範囲第１項に記載の特徴を持
つ本発明によるインターフェースは、ネットワークの信
号またはバスラインの１つに障害が発生しても、または
ネットワーク加入者のバスラインに接続されたドライブ
段に不良が発生しても、インターフェースの動作は維持
され、そしてその欠点は診断可能であるという利点を有
している。バスラインのうちの１本が機能していないこ
とが確認されると直ちに、非常用回路が作動し、それは
単に１本の動作用バスラインをもってでも、バスに接続
されている総ての加入者を機能させ続けることが可能な
ものである。
最初の実施例においては、監視回路はバスラインに配
属されたカウンターを有している。このカウンターは例
えば、連続的にアップカウントをするように設計され
る。これはバスライン上で到達した信号によってリセッ
トされる。信号ライン上に何の情報も到達しないと、カ
ウンターは長らくリセットされないので、カウントは継
続される。前もって決められたカウンター状態に達する
と、非常用回路が作動し、そして単線モードが維持され
る。
さらに望ましい実施例においては、少なくとも１つの
ウインドーコンパレーターがバスラインに割当てられ
て、前記ウインドーコンパレーターはバスラインに印加
されている電圧を検出する。前もって決められた範囲の
外に、その電位が存在するようになると直ちに、制御信
号がウインドーコンパレーターから非常用回路に発生さ
れ、非常用回路は次に、単線モードを調整設定する。
この実施例においては、前もって決められた電位はバ
スラインに対応付けられていることが望ましく、前記電
位はネットワークまたは自動車において生じる他の電位
とは異なっているものである。この方法によって、断
線、短絡またはネットワークの電源への接続及び入力結
合した不良ノイズが特に容易に検出することができる。
メインクレームにおいて与えられるネットワークイン
ターフェースの、さらに有利な発展や改善は、サブクレ
ームに記載されている方法によって可能となる。このイ
ンターフェースはラインの不良、障害の場合にインター
フェース動作を維持するためだけでなく、信号冗長性に
よって妨害耐性（障害耐力）を改善するためにも利用で
きる。この方法によって、インターフェースの高度な活
用が可能となる。
図面類 本発明の２つの実施例が図面に描かれており、そして
以下の説明中で詳細に説明される。
第１図は基本的原理を説明する目的で、この技術に関
するインターフェースを示しており、 第２図は差動信号と共に、バスまたは信号ラインに印
加される電位の特性を示し、 第３図はネットワーク加入者のレシーバーまたは信号
評価回路、前記回路はコンパレーターを有している、の
入力における電圧特性を示し、 第４図は第１図による回路の、本発明によって付加さ
れる配線の第１の実施例を示し、 第５図は第１図による回路の付加的な配線の第２の実
施例を示し、 第６図はネットワークインターフェースのさらに別の
実施例の回路図を示し、そして 第７図は第６図によるインターフェースの基本的な回
路図を示している。
実施例の説明 以下に説明するインターフェースは製造ラインに用い
られると同様、一般的にはコンピューターネットワーク
において、特に多数の構成要素、複数のサブシステムお
よび／または複数のシステム、を接続するために用いる
ことが可能である。特に、このインターフェースは自動
車のための、コントローラーエリアネットワークインタ
ーフェース（CANインターフェース）と呼ばれるものに
適している。以下の説明は、この例に関連して行なわれ
る。
この基本的な原理をよりよく理解するためには、この
回路に現われる信号と共に公知のインターフェースの詳
細が第１図から第３図において示されているが、これら
においてはシリアルデーター伝送が行なわれていると仮
定する。
明確な理解のために、第１図にはCAN−IC上の単に１
つの加入者に関する回路が示されており、ここではその
外部結線および２つの信号またはバスラインが表現され
ている。加入者はバスライン「０」に対応づけられた第
１ドライバー段T1を持っている。簡単化のために、ここ
にはドライバー段の単に１つの電子スイッチが表現され
ているのみであり、前記ドライバー段は１方では＋5Vの
電源電圧VBに、また他方ではCAN−ICの出力端子TX0に接
続されている。この端子は第１抵抗器R11を通して信号
線「０」に接続されている。第１抵抗器R11と信号線
「０」との間において、第２抵抗器R12を通してアース
に接続される。ドライバー段T1がハイインピーダンスで
あるなら、バスライン「０」はこうしてアースに接続さ
れ、もしドライバー段T1がローインピーダンスになって
いるならば、バスライン「０」はUBに接続される。
同様に簡単化のために、単に１つの電子スイッチだけ
が表現されている第２ドライバー段T2は、CAN−ICの出
力端子TX1に接続されている。この電子スイッチは１方
ではアースに、そして他方では出力端子TX1に接続され
ている。後者は抵抗器R21を通してバスライン「１」に
接続され、その接続線は抵抗器R22を通して＋5Vの電源
電圧UBに接続されている。こうして、ドライバー段T2が
ハイインピーダンスであればバスライン「１」はUBに接
続され、またローインピーダンスであればアースに接続
される。要するに、ドライバー段T1およびT2は、逆方向
に接続されている。
加入者からの信号はドライバー段を通してバスまたは
信号ライン「１」および「０」に出力される。
信号評価用または受信回路がICの端子RX0およびRX1に
接続されており、前記回路はICの端子RX0およびRX1に接
続されたコンパレーター１を有している。この受信回路
は加入者のためにバスライン上に到着した信号を変換す
る。端子RX0は抵抗器R31を通してバスライン「０」に接
続されており、そして接続端子RX1は抵抗器R32を通して
バスライン「１」に接続されている。しかも、それらの
端子は電源電圧UBおよびアースとの間に設けられた分圧
器に接続されており、前記分圧器は抵抗器R33,R34およ
びR35を有している。抵抗器R33とR34の接続点は抵抗器R
36を通して端子RX0に接続され、そして抵抗器R34とR35
の接続点は抵抗器R37を通して端子RX1に接続される。
ここで表わされている実施例では、抵抗器R11,R12,R2
1おおよびR22のために1KΩの抵抗値が選択されている。
ドライバー段T1およびT2はこうして、バスライン「１」
および「０」にハイインピーダンスをもって結合する。
接続端子RX0およびRX1はバスラインに100KΩを通して結
合する。分圧器はコンパレーター１の基本的なセッティ
ングと平衡化のために用いられる。R33およびR35は1KΩ
の値を、R36およびR37は15KΩの値を、そしてR34は180
Ωの値を持っている。この方法によって、入力端子RX0
のために約2.7Vの基本電位が、そして入力端子RX1のた
めに約2.3Vの入力電位が得られる。
受信回路のコンパレーター１の入力に加えられる、ま
たは入力端子RX0およびRX1における、電位はV0およびV1
として示されている。
第２図においては、バスラインに加えられる信号を見
ることができる。バス信号に加えて、バス信号の差動状
態が示されており、バスライン「１」上の信号はバスラ
イン「０」上の信号から差し引かれている。バスライン
「１」上の信号が値０であると仮定すれば、約2.7Vの電
位が得られる。もしバスライン「０」上の信号が値１で
あるならば、約2.3Vの電位が得られる。バスライン上の
信号１および０は、ネットワーク加入者の相応するドラ
イバー段で発生されるものである。第２図に示すよう
な、バス信号のなだらかなエッジは、第１図の抵抗器R1
1およびR21によって行なわれるドライバー段のハイイン
ピーダンス結合によって得られるものである。ライン容
量に相当するRC素子は結合用抵抗器によって得られる。
そのような電位特性は、ドライバー段の信号の供給によ
って起こり得る妨害を避けるために選択される。
第３図においては、入力コンパレーターの入力におい
て、または端子RX0およびRX1において加えられる電位V0
およびV1が表わされている。加えて、差V1−V0が示され
ている。約＋0.3Vから約−0.3Vまでの保護素子の選定の
なされている際、差V0−V1が正か負かによって当該コン
ペンセータ（コンパレータ）が切替わる。この差信号に
とっては、ゼロ線を横切ることが重要である。そうでな
い場合には、コンパレーターは反転しない。
アースまたはUBに短絡することによって断線によっ
て、または、例えばドライバー段の欠陥による入力結合
したノイズによって、２本の信号ラインの１方が機能障
害となった場合には、差信号は、ゼロ線を横切ることが
不可能な程度に歪ませられる。次いでこの回路の信号評
価回路または入力コンパレーターは、正確に入力電圧を
評価できる動作位置にはとどまれない。
第３図から、絶対的な電位のピークが差信号に影響を
与えているのではないことが理解できる。例えば加入者
自体が、または他の装置が、地絡してしまうような、コ
モンモード妨害と呼ばれているものは、こうして抑制さ
れる。
第４図は、不良の信号ラインを検出し、そしてエラー
が起きた場合には非常用回路を作動させる、第１のモニ
ター回路を示している。破線で示されているCAN−ICは
第１図と同様の配線を有している。ここで第４図におい
ては、明確化のためにドライバー段は省略されている。
このモニター回路と非常用回路とは、こうしてICの端子
RX0とRX1間に、そしてレシーバー回路のコンパレーター
１の入力端子間に接続される。
モニター回路10は、線路12を経てコンパレーター１の
出力13に接続されているカウンター11を含んでいる。こ
のカウンターは、動作上は連続的にアップカウントをす
るように設計されている。出力13側に情報が到達する
と、このカウンターはリセットされる。２つの信号また
はバスライン「０」および「１」が正確に機能している
時のみ、コンパレーター１の出力13には情報が到達す
る。
もし、例えば短絡または断線による不良のために、バ
スライン上に情報が来ないならば、カウンターはリセッ
トされることがなくなる。カウント過程は、前もって決
められたカウンター状態に達するまで、そのまま継続さ
れる。このカウンター状態に達すると直ちに、信号「エ
ラーステータス」が線路14を通して発せられ、そして非
常用回路20を制御する制御回路が駆動される。これは、
例えばステータスレジスターと呼ばれる15のような１つ
のレジスターとして設計できる。
非常用回路20は、例えばFETスイッチとして構成され
る第１アナログスイッチ21と、同様にFETスイッチとし
て構成される第２アナログスイッチ22とを含んでいる。
両方のスイッチとも１方で非常用電源電圧UB/2に接続さ
れている。この非常用電源は電源電圧とアースとの間に
設けられた、抵抗器R1およびR2からなる分圧器によって
得られるものである。この実施例においては、インピー
ダンス変換器23が低インピーダンス結合用に準備されて
いる。第１アナログスイッチ21は他方で端子RX1に、そ
してコンパレーター１の第１入力に、接続されている。
第２アナログスイッチ22は他方で端子RX0に、そしてコ
ンパレーター１の第２入力に接続されている。アナログ
スイッチ21および22は、ステータスレジスター15に接続
されている駆動線24または25を通して駆動される。
以下に非常用回路20を駆動することに関する。さらに
詳細な説明が与えられる。
ハードウェアまたはソフトウェアによっても実現する
ことのできるカウンター11が、エラーを表現する、前も
って決められたカウンター状態に達すると直ちに、これ
は線路14を通して中央コンピューターユニット16（CP
U）に信号「エラーステータス」を発する。この信号に
よって、CPU16はバスライン上にエラーが発生したこと
を検知する。定義によって例えば信号線の１方に６回分
の中断しないシーケンスがあればエラーとして判断する
と、決めることが可能である。
エラーステータス信号が来ることによって、CPU16は
最初に線路17を通してステータスレジスターを駆動し、
ステータスビットと呼ばれるビットを、線路24を通して
第１アナログスイッチ21に対して発生する。この方法に
よって、非常用電圧UB/2は、端子RX1に接続されてい
る、コンパレーター１の入力に加えられる。コンパレー
ター１の出力側13に再び情報が到達するならば、カウン
ター11は前もって決められたカウンター状態に達する前
にリセットされ、障害はバスライン「１」にあるとされ
る。コンパレーターは今やシングルワイヤモードで動作
しており、バスライン「０」上の情報を正確に評価す
る。しかし、この動作状態においては、コモンモード妨
害抑制は行なわない。
第１アナログスイッチ21を駆動した後にも、信号エラ
ーステータスが発生するならば、次にカウンター11はそ
の時にはリセットされずに、CPU16は線路18を通してス
テータスレジスター15を駆動し、続いてこれは線路25を
通して第２アナログスイッチ22にステータスビットを送
る。こうして、端子RX0に接続されたコンパレーター１
の入力は非常用電源に接続される。今や、コンパレータ
ー１の出力13に利用できる情報が到来し、そしてカウン
ター11がその時にリセットされると、バスライン「０」
が不良である。こうしてコンパレーター１は第２アナロ
グスイッチ22を駆動することによって、シングルワイヤ
ーモードにおいてバスライン「１」上に到来する情報を
正しく評価することが可能である。
第４図に示した実施例においては、モニター回路10と
非常用回路20とは両方ともCAN−IC上に配置されてい
る。
第４図に表わされた他の構成要素は第１図のそれに相
当する。それらには同じ参照記号または呼称が付されて
いる。それらの説明は、ここでは不要である。CAN−IC
の端子RX0がバスライン「０」に接続され、そして端子R
X1がバスライン「１」に接続されることは明らかであ
る。
第５図には、非常用回路の別の実施例が表わされてい
る。モニター回路は第４図のそれと相応している。明確
な理解のために、ここではそれらを表現していない。
ここでは、非常用回路200は第１アナログスイッチ201
および第２アナログスイッチ202とを有している。両方
とも、第１バスライン「１」に接続されている端子RX1
に関連している。しかも、非常用回路200は第３アナロ
グスイッチ203と第４アナログスイッチ204とを有してお
り、それらは両方とも、バスライン「０」に接続されて
いる端子RX0に関連している。端子RX1に結び付いている
アナログスイッチ201および202は線路205を通して、関
連するステータスレジスター（ここでは示されていな
い）に接続されている。端子RX0に配属されているアナ
ログスイッチ203および204は線路206を通して、関連す
るステータスレジスターに接続されている。２つの線路
によって対として駆動されるアナログスイッチ201と20
2、または203と204とは、相補的な方法で設計されてお
り、すなわち第１アナログスイッチ201は第３アナログ
スイッチ203と同様にメーク接点として設計され、１
方、第２アナログスイッチ202および第４アナログスイ
ッチ204はブレーク接点として設計されている。全体と
しての切替え機能は、これで説明される。
第１アナログスイッチ201は１方では非常用電源電圧U
B/2に、そして他方ではコンパレーター１の入力に接続
されている。ブレーク接点として設計されている第２ア
ナログスイッチ202はコンパレーター１と端子RX1との間
の接続線に設けられている。この第３アナログスイッチ
203は片側においては非常用電源電圧UB/2に、そして別
の側においてはコンパレーター１の第２入力に対応する
ように接続される。端子RX0を持つ、この入力に接続さ
れるのはブレーク接点として設計された第４アナログス
イッチ204である。
バスラインの１方において障害があった場合、ステー
タスビットと呼ばれるビットがまず線路205上に発生
し、その線路によって第１アナログスイッチ201と第２
アナログスイッチ202とが駆動される。この方法によっ
て、１方ではコンパレーター１の端子RX1への接続が断
たれ、そして他方ではコンパレーター１の、端子RX1に
配属されている入力端子が非常用電源に接続される。コ
ンパレーター１の出力13に再び、評価可能な信号が到達
すれば、障害はバスライン「１」上にあるとされる。コ
ンパレーターは今や、シングルワイヤーモードによっ
て、バスライン「０」上の情報を評価する。
しかし、コンパレーター１の出力13にはエラーが継続
しているとモニター回路が判断したならば、第３アナロ
グスイッチ203と第４アナログスイッチ204とが線路206
上のステータスビットによって作動され、これによって
コンパレーター１は信号ライン「０」から断たれて、そ
の代わりに非常用電源に接続される。
この実施例においては、非常用電源UB/2は電圧UBとア
ースとの間に設けられた抵抗器R207とR208とを含む分圧
器によって発生される。端子RX0の信号ライン「０」へ
の接続、および端子RX1の信号ライン「１」への接続
は、第１図のそれと同様である。ここでも、同等の部品
には同じ参照記号と名称を付すことによって、それらの
説明を省略している。
第４図および第５図において表現されている実施例
は、モニター回路をソフトウェア制御としているもので
ある。
第６図は、非常用回路210を制御するモニター回路100
の、さらに別の実施例を示している。この実施例は、非
常用動作がハードウェアによって実行されるものであ
る。
第６図による回路は、破線によって、CAN−ICを示し
ており、１例として加入者はデーターライン50を通して
駆動される２つのドライバーT10およびT20を持つように
取付けられている。第１ドライバー段T10はCAN−ICの供
給電圧UBと第１出力端子TX0との間に設けられている。
第１ドライバー段と並列に、ツェナーダイオードZD1が
設けられて、そのカソードは同様に供給電圧に接続され
ている。第１ドライバー段T10はデーターライン50に接
続されたインバータース51を通して駆動される。同様に
ツェナーダイオードZD2に並列に接続されている第２ド
ライバー段T20は、データーライン50を通して直接的に
駆動される。第２ドライバー段T20は第２出力端子TX1と
アースとの間に設けられる。２つのドライバー段は逆方
向に接続されている。
ドライバー段としては、例えばCMOSスイッチのよう
な、電子スイッチが用いられることが望ましい。
ドライバー段は高インピーダンスを有しており、そし
てここでは1KΩであることが望ましい抵抗器R1およびR2
を通してバスライン「０」および「１」に結合してい
る。加えて、減結合用のダイオードが設けられており、
第１減結合用ダイオードD1のアノードは端子TX0に接続
されており、そして第２ダイオードD2のカソードは出力
端子TX1に接続されている。
バスライン「０」および「１」は、ここではバスライ
ン毎に１つのインピーダンス変換器と１つの結合用抵抗
器を有している。適切な接続ユニットに接続される。バ
スライン「０」の第１インピーダンス変換器OP1は、例
えば1.5Vであるような前もって選択された電圧に接続さ
れている。結合用抵抗器R3は例えば2KΩの値を持つもの
である。バスライン「１」のインピーダンス変換器OP2
は、例えば3.5Vであるような前もって選択された電圧に
接続されている。前記インピーダンス変換器は、その出
力に接続された2KΩの結合用抵抗器R4を有している。
この回路においては他に表われないような電圧を、バ
スラインのための電位として選択することが望ましい。
このため、0Vと5Vの値は可能な限り避けるべきである。
しかし、例えば1Vおよび4Vを、1.5Vおよび3.5Vの代わり
にバスラインのために選択することは可能である。
ここでも信号評価は端子RX0およびRX1に接続された信
号評価または入力回路によって実行され、前記回路はコ
ンパレーターＫを有している。接続端子RX0は、150KΩ
であることが望ましいハイインピーダンス結合用抵抗器
R5を通してバスライン「０」に接続されている。接続端
子RX1は、同じ値を持つ結合用抵抗器R6を通してバスラ
イン「１」に接続されている。非常用電圧UB２はCAN−I
Cの中で発生され、そしてインピーダンスコンバーター5
2を通して出力端子NLに加えられている。端子RX0および
端子RX1の両方とも、この実施例の場合にはその値が15K
Ωに固定されている直列抵抗器R7またはR8を通して出力
端子NLに接続されて的確な電位に保持される。この抵抗
器R7およびR8は、コンパレーターＫの静止電位をセット
するように働く。このような配線によって、端子NLの電
位を、２本のバスラインの電位の間の中心付近に置くこ
とができる。
インバーター52の、接続用端子NLへの接続線路53は、
第１アナログスイッチ211を通して、端子RX0に関連する
コンパレーターの接続線に、そして第２アナログスイッ
チ212を通して、端子RX1に関連するコンパレーターＫの
接続線に、接続される。例えばここでは、アナログスイ
ッチとしてFETスイッチもまた使用可能であって、前記F
ETスイッチの内部抵抗は100Ω未満である。第１アナロ
グスイッチ211は線路213を通してステータスレジスター
215の第１素子に接続され、そして第２アナログスイッ
チ212は線路214を通してステータスレジスター215の第
２素子に接続される。
インバーター52と同様、２つのアナログスイッチ211
と212は非常用回路210の１部である。
モニター回路100は、ここでは端子P1およびP2を通し
てCAN−ICに接続されている一連のICとして構成されて
いる。非常用回路100は、１方では電圧UBが供給され、
そして他方ではアースに接続されている。
非常用回路100は、第１結合用抵抗器R9を通してバス
ライン「０」に接続されている第１ウィンドーコンパレ
ーターFK1を有している。他方、これは端子P1に接続さ
れている。第２ウィンドーコンパレーターFK2は結合用
抵抗器R10を通してバスライン「１」に接続され、そし
て他方ででは端子P2に接続されている。
ウィンドーコンパレーターFK1およびFK2の電圧範囲
は、バスラインに加えられる電圧に、またはエラー発生
時に表われる電位に、依存している。アースへの短絡が
生じると、バスラインは0Vに接続され、電源への短絡の
場合には、それらは5Vに接続される。ウィンドーコンパ
レーターの電圧はこうして、1Vから4Vまでの範囲内にあ
る。
バスライン上の電圧がウィンドーコンパレーターの前
もって選択した電圧範囲の外側に出ると直ちに、ウィン
ドーコンパレーターはそれぞれの端子P1またはP2にエラ
ー信号を発生する。バスにおける障害によって発生した
のではないエラー信号を避けるために、さらには同時に
多数のドライバー回路がスイッチされて接続されること
によるエラー信号を避けるために、このウィンドーコン
パレーターFK1およびFK1には遅延素子、例えばRC素子、
が組込まれており、その遅延時間T1は約300μＳであ
る。
端子P1は制御線216を通してステータスレジスター215
の第１素子に接続されており、そして端子P2は制御線21
7を通して前記ステータスレジスターの第２素子に接続
されている。
バスラインの、アースまたはUBへの短絡の場合、また
はドライバートランジスターの欠陥の場合には、障害の
あるバスラインの電位は、関連しているウィインドーコ
ンパレーターの電圧範囲の外側に出る。このエラー状態
が300μＳ以上続くと、相応するウィンドーコンパレー
ターは制御信号を、関連する端子P1またはP2に発生す
る。この方法によって、バスライン「０」上のエラーの
場合にはウィンドーコンパレーターFK1からの信号が端
子P1および第１制御線216を通して、ステータスレジス
ター215の第１素子に対して発生される。次いて、ステ
ータスビットは線路213を通して、この場合にはメーク
接点として構成されている第１アナログスイッチ211に
供給される。このことは、非常用電圧UB/2が端子RX0に
関連したコンパレーターＫの接続線に接続されることを
意味する。
バスライン「１」上にエラーがある場合には、ウィン
ドーコンパレーターFK2からの相応する制御信号が端子P
2を通して、そして第２制御線217を通してステータスレ
ジスター215の第２素子に伝達される。ステータスレジ
スターはステータスビットを発生し、これは線路214を
通して、同様にメーク接点として動作する第２アナログ
スイッチ212に伝えられる。こうして、コンパレーター
Ｋの接続線は、端子RX1側に関して電圧UB/2に接続され
る。
第６図の実施例においては、端子P1およびP2に接続さ
れる信号は直接的にステータスレジスター215に伝えら
れる。しかし、線路216および217を破線で現表してある
ことによって、端子P1およびP2に加えられる情報の評価
およびステータスレジスター215の駆動に関しては、ソ
フトウェアの介在によって実行されるよう変更すること
も可能であることも示している。
第３図を参照することによって、コンパレーターに加
えられる電圧の差異がゼロ交差すれば、コンパレーター
Ｋが評価信号を発生することが理解できる。このこと
は、バスラインの１方に障害や不良がある場合には生じ
ない。しかし、エラーの場合にはコンパレーターの入力
ラインの１方がアナログスイッチ211および212によって
UB/2に接続されているので、コンパレーターは再び評価
用出力信号を供給することができる。
ウィンドーコンパレーターFK1およびFK2のエラー信号
を基にして、どちらのバスラインが障害であるかを決め
ることが可能である。こうして、この回路を用いること
によって非常用動作モードが維持されるのみならず、不
具合の生じているバスラインの検出も行うことができ
る。
第７図では、もう１度機能的な回路図が表現されてお
り、これは２つのバスライン「０」および「１」を示し
ている。バスラインに接続されているのは終端ユニット
70であり、第６図において説明したように、前記終端ユ
ニットはバスライン「０」に関する結合抵抗器R3を持つ
第１演算増幅器OP1、および関連する抵抗器R4を持つ第
２演算増幅器OP2を有している。この実施例において
は、1.5Vの電位が第１バスライン「０」に結び付いてお
り、そして3.5Vの電位が第２バスライン「１」に対応付
けられている。
多数のシステムまたはサブシステムをこのバスライン
に接続することが可能であり、前記システムまたはサブ
システムの１つが、参照記号71を付されて、ここに示さ
れている。
端子TX0およびTX1に接続されているドライバー段T10
およびT20は、第６図のそれと同等である。同様の部品
には同じ参照記号が付されており、そのためそれらの詳
細はここでは省略されている。
ここで再び、加入者71はCAN−ICである。このICにお
いては、第６図と同様、非常用電圧UB/2が発生されて、
インピーダンス変換器52を通してICの端子NLに加えられ
る。バスライン「０」は150KΩの結合用抵抗器R5を通し
てICの端子RX0に接続されている。バスライン「１」は1
50KΩの結合用抵抗器R6を通してICの端子RX1に接続され
ている。コンパレーターＫを持つ、信号評価または受信
用回路の静止電位をセッティングするために、15KΩの
第１抵抗器R7は端子NLに、そして端子RX0に接続され、
そして例えば15KΩの第２抵抗器R8はICの端子RX1に、そ
して端子NLに接続されており、前記信号評価または受信
用回路はIC上に設けられて、端子RX0およびRX1に接続さ
れている。第６図に表わされているモニター回路100
は、非常用回路210と同様、ブロック、すなわちバスモ
ニター回路300を形成するよう、第７図においては結合
されている。
しかし、第６図においてはモニター回路100は加入者
（破線で表わされている）の上位方向に接続されている
のに対し、第７図においてはこの回路部分はCAN−IC上
に配置されている。
第７図による実施例は、その単純さと、そして良好な
組織的な設計によって特に区別されるものである。この
ため個々のモジュールは極めてコンパクトであり、しか
もバスラインへの接続は容易である。
理解のために、第７図には他の加入者は表現されてい
ない。単にそれらの接続線のみが表現されているにすぎ
ない 第７図における回路の機能は第６図におけるそれと同
等である。こうして、これはバスラインの１方における
エラーはバスモニター300によって検出されることを意
味している。エラーが発生した場合、障害のあるバスラ
インに関連した、コンパレーターＫの入力に、非常用電
圧が加えられる。
結果として、ここで説明したCANインターフェースに
よって、２本のバスラインの１方が障害を起こした場合
であっても、インターフェース動作が維持されることは
明らかである。しかし、非常用動作モードの間はコモン
モード妨害と呼ばれるものは抑制できないことに留意す
べきである。

Claims (12)

    (57)【特許請求の範囲】
  1. 【請求項１】例えば自動車においてローカルエリアネッ
    トワークの加入者局に使用するためのネットワークイン
    ターフェースであって、 少なくとも２つの加入者局が２線式バスを介して相互に
    接続されており、 差信号レシーバーとしてコンパレーター（１）を有し、
    該コンパレーター（１）の入力側はそれぞれ相補的な信
    号を伝送する前記２線式バスの両方のバスライン
    （「１」，「０」）に接続されており、 前記コンパレーター（１）の出力側に接続されるモニタ
    ー回路（10,100）を有し、該モニター回路（10,100）は
    前記バスライン（「１」，「０」の動作状態を検査し、 非常用回路（20,200,210）を有し、該非常用回路（20,2
    00,210）は前記モニター回路（10,100）の信号に依存し
    て作動されるネットワークインターフェースにおいて、 前記モニター回路（10,100）はカウンター（11）を有
    し、該カウンターはバスライン（「０」，「１」）上へ
    の信号の到着によってリセットされ、そして前もって決
    められたカウンター状態に達すると前記非常用回路（2
    0,200,210）を作動させ、 該非常用回路（20,200,210）は第１の手段を有してお
    り、該第１の手段は伝送を復旧するために第１のステッ
    プで前記コンパレーター（１）の第１の入力側（RX0,RX
    1）を前もって決められた電位に接続し、 その後で前記モニター回路（10,100）によってエラーが
    識別されない場合には情報の受信が前もって決められた
    電位を印加されていない入力ライン（RX0,RX1）を介し
    て行われ、 前記非常用回路（20,200,210）は第２の手段を有してお
    り、該第２の手段は前記モニター回路（10,100）によっ
    てさらに別のエラーが識別される場合には第２のステッ
    プで前記コンパレーター（１）の第２の入力側（RX0,RX
    1）を前もって決められた電位に接続し、さらに前記第
    １の入力側（RX0,RX1）と前もって決められた電位との
    接続を解除し、 その後で前記モニター回路（10,100）によってエラーが
    識別されない場合には情報の受信が前もって決められた
    電位を印加されていない入力ライン（RX0,RX1）を介し
    て行われることを特徴とするネットワークインターフェ
    ース。
  2. 【請求項２】前記モニター回路（100）は、各々が１本
    のバスライン（「０」，「１」）に配属された、少なく
    とも１つのウインドーコンパレーター（FK1,FK2）を有
    し、１本のバスライン（「０」，「１」）上に存在する
    電位が前もって決めることのできる範囲の外側にあるな
    らば、前記ウインドーコンパレーターは非常用回路（21
    0）に制御信号を発するような、請求項１記載のネット
    ワークインターフェース。
  3. 【請求項３】短時間の電位変動によるウインドーコンパ
    レーター（FK1,FK2）の誤った制御信号の発生を避ける
    ため、遅延時間ないしむだ時間回路が設けられて、その
    時間内の変動が無視されるような、請求項２記載のネッ
    トワークインターフェース。
  4. 【請求項４】遅延時間が、ウインドーコンパレーター
    （FK1,FK2）と非常用回路（210）との間に接続されたRC
    素子によってセットされることのできるような、請求項
    ３記載のネットワークインターフェース。
  5. 【請求項５】非常用回路（210）を制御する目的で、ス
    テータスレジスター（215）がウインドーコンパレータ
    ー（FK1,FK2）に配設されており、前記ステータスレジ
    スターは前記ウインドーコンパレーター（FK1,FK2）の
    出力信号によってセットされるような、請求項２から４
    までのいずれか１項記載のネットワークインターフェー
    ス。
  6. 【請求項６】非常用回路（20,200,210）は電気式の、お
    よび／または電子式のスイッチ（21,22;201,202,205,20
    4;211,212）を有し、該スイッチはステータスビットに
    よって作動され、該ステータスビットはカウンター（1
    1）によって前もって決められたカウンター状態に到達
    した際にセットされ、 前記電気式の、および／または電子式のスイッチ（21,2
    2;201,202,205,204;211,212）は作動状態にある時に
    は、コンパレーター（１）の所属の入力側（RX0,RX1）
    を非常用電源（UB/2）に接続するような、請求項１から
    ５までのいずれか１項記載のネットワークインターフェ
    ース。
  7. 【請求項７】２つの電子式スイッチ（201,202;203,20
    4）がコンパレーター（１）の各入力側（RX0,RX1）に配
    属されており、前記電子式スイッチは相補的に動作し
    て、作動状態にある時には、前記電子式スイッチは所属
    入力側（RX0,RX1）を非常用電源（UB/2）に接続し、同
    時に所属の不良のバスライン（「０」，「１」）への接
    続を切り離すような、請求項６記載のネットワークイン
    ターフェース。
  8. 【請求項８】スイッチ（21,22;202,203,204;211,212）
    がアナログスイッチとして構成されるような、請求項６
    記載のネットワークインターフェース。
  9. 【請求項９】FETスイッチがアナログスイッチとして使
    用されるような、請求項８記載のネットワークインター
    フェース。
  10. 【請求項１０】ウインドーコンパレーター（FK1,FK2）
    は前もって決められた電位にセットされるような、請求
    項２から５までのいずれか１項記載のネットワークイン
    ターフェース。
  11. 【請求項１１】モニター回路（10,100）と非常用回路
    （20,200,210）とは、１つのバスモニター回路（300）
    を形成するように結合され得る、請求項１から10までの
    いずれか１項記載のネットワークインターフェース。
  12. 【請求項１２】バスモニター回路（300）がネットワー
    クインターフェースのチップ上に集積されているよう
    な、請求項11記載のネットワークインターフェース。
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