JP2726571B2 - Ｐａｌ方式におけるａｐｃ回路 - Google Patents
Ｐａｌ方式におけるａｐｃ回路Info
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Description
【００１０】
【産業上の利用分野】本発明はカラ−テレビジョンのＰ
ＡＬ方式におけるＡＰＣ回路に関するものである。
ＡＬ方式におけるＡＰＣ回路に関するものである。
【００２０】
【従来の技術】ＰＡＬ方式では図４に示すようにカラ−
バ−スト信号が基準位相ＲＥＦからライン毎に±π／４
だけ位相がずれている。色復調用の色副搬送波を発生す
る回路は図５に示すようにＡＰＣ回路５０で形成されて
おり、その出力はＲ−Ｙ復調器３０とＢ−Ｙ復調器３１
へ送られる。Ｒ−Ｙ復調器３０とＢ−Ｙ復調器３１は端
子３２を介して与えられるＰＡＬクロマ信号中のＲ−Ｙ
信号とＢ−Ｙ信号をそれぞれ復調する。Ｒ−Ｙ復調器３
０とＢ−Ｙ復調器３１へＡＰＣ回路５０から送られる色
副搬送波は互いに９０°の位相差を持つように９０°移
相器３３が採用されている。
バ−スト信号が基準位相ＲＥＦからライン毎に±π／４
だけ位相がずれている。色復調用の色副搬送波を発生す
る回路は図５に示すようにＡＰＣ回路５０で形成されて
おり、その出力はＲ−Ｙ復調器３０とＢ−Ｙ復調器３１
へ送られる。Ｒ−Ｙ復調器３０とＢ−Ｙ復調器３１は端
子３２を介して与えられるＰＡＬクロマ信号中のＲ−Ｙ
信号とＢ−Ｙ信号をそれぞれ復調する。Ｒ−Ｙ復調器３
０とＢ−Ｙ復調器３１へＡＰＣ回路５０から送られる色
副搬送波は互いに９０°の位相差を持つように９０°移
相器３３が採用されている。
【００３０】ＡＰＣ回路５０は４.４３ＭＨｚの色副搬
送波を発生する発振器３４と該発振器３４の発振出力信
号を端子３２を介して与えられるＰＡＬクロマ信号中の
カラ−バ−ストと位相比較する位相比較器３５とから構
成されている。位相比較器３５で比較される入力は図６
のベクトル図に示すように発振器３４の発振出力信号Ｓ
Ｃと該発振出力信号ＳＣとは±π／４ずれたカラ−バ−
スト信号Ｂ１（ｎライン），Ｂ２（ｎ＋１ライン）であ
る。発振出力信号ＳＣの位相がずれると、比較される信
号間の位相差は±π／４からずれる。そして、そのずれ
量がロ−パスフィルタ３６を通して発振回路３４へ制御
信号として与えられる。
送波を発生する発振器３４と該発振器３４の発振出力信
号を端子３２を介して与えられるＰＡＬクロマ信号中の
カラ−バ−ストと位相比較する位相比較器３５とから構
成されている。位相比較器３５で比較される入力は図６
のベクトル図に示すように発振器３４の発振出力信号Ｓ
Ｃと該発振出力信号ＳＣとは±π／４ずれたカラ−バ−
スト信号Ｂ１（ｎライン），Ｂ２（ｎ＋１ライン）であ
る。発振出力信号ＳＣの位相がずれると、比較される信
号間の位相差は±π／４からずれる。そして、そのずれ
量がロ−パスフィルタ３６を通して発振回路３４へ制御
信号として与えられる。
【００４０】しかしながら、π／４の位相差の分はロ−
パスフィルタ３６ではカバ−できないので、図７に示す
如く電流補正回路３７を設けて、そのπ／４の分に相当
する是正を行なっている。図６のベクトル図でいえば、
ＳＣとＢ１，Ｂ２との位相差π／４に対応するＷに相当
する分をライン毎に電流補正するのである。このとき、
電流補正回路３７からはライン毎に方向が逆の電流が与
えられることになる。尚、上記従来の回路はアナログ回
路で構成されている。
パスフィルタ３６ではカバ−できないので、図７に示す
如く電流補正回路３７を設けて、そのπ／４の分に相当
する是正を行なっている。図６のベクトル図でいえば、
ＳＣとＢ１，Ｂ２との位相差π／４に対応するＷに相当
する分をライン毎に電流補正するのである。このとき、
電流補正回路３７からはライン毎に方向が逆の電流が与
えられることになる。尚、上記従来の回路はアナログ回
路で構成されている。
【００５０】
【発明が解決しようとする課題】上述の従来例はアナロ
グ回路で形成されているから電流補正をかけることがで
きるが、例えばＣＭＯＳを用いたディジタル回路では電
流補正をかけることができないので、図５の形式のＡＰ
Ｃ回路を用いると、正確なＡＰＣ動作を実現できなくな
る。本発明はこのような点に鑑みなされたものであっ
て、ＣＭＯＳ等を使ったディジタル回路で正確なＡＰＣ
動作を遂行できるようにしたＰＡＬ方式におけるＡＰＣ
回路を提供することを目的とする。
グ回路で形成されているから電流補正をかけることがで
きるが、例えばＣＭＯＳを用いたディジタル回路では電
流補正をかけることができないので、図５の形式のＡＰ
Ｃ回路を用いると、正確なＡＰＣ動作を実現できなくな
る。本発明はこのような点に鑑みなされたものであっ
て、ＣＭＯＳ等を使ったディジタル回路で正確なＡＰＣ
動作を遂行できるようにしたＰＡＬ方式におけるＡＰＣ
回路を提供することを目的とする。
【００６０】
【課題を解決するための手段】上記目的を達成するため
本発明のＡＰＣ回路は、色副搬送波周波数の信号に対し
て２n（ｎ＝２，３，・・・，ｎ）倍の周波数を発振中
心周波数とするパルスを発生する電圧制御発振器と、前
記電圧制御発振器の出力を分周してカラーバーストの非
反転成分に対応する位相をもった基本パルス信号を出力
する分周回路と、前記基本パルス信号を前記電圧制御発
振器の出力パルスをクロックとしてシフトし、−π／４
の位相をもつ第１パルス信号と＋π／４の位相を持つ第
２パルス信号とを形成するシフトレジスタと、前記第
１、第２パルス信号を１水平期間毎に切り換えて交互に
出力するスイッチ回路と、入力のカラーバースト信号と
前記スイッチ回路の出力パルス信号とを位相比較する位
相比較回路と、前記位相比較回路の出力を電圧変換して
前記電圧制御発振器へ制御信号として供給する変換回路
と、から成っている。
本発明のＡＰＣ回路は、色副搬送波周波数の信号に対し
て２n（ｎ＝２，３，・・・，ｎ）倍の周波数を発振中
心周波数とするパルスを発生する電圧制御発振器と、前
記電圧制御発振器の出力を分周してカラーバーストの非
反転成分に対応する位相をもった基本パルス信号を出力
する分周回路と、前記基本パルス信号を前記電圧制御発
振器の出力パルスをクロックとしてシフトし、−π／４
の位相をもつ第１パルス信号と＋π／４の位相を持つ第
２パルス信号とを形成するシフトレジスタと、前記第
１、第２パルス信号を１水平期間毎に切り換えて交互に
出力するスイッチ回路と、入力のカラーバースト信号と
前記スイッチ回路の出力パルス信号とを位相比較する位
相比較回路と、前記位相比較回路の出力を電圧変換して
前記電圧制御発振器へ制御信号として供給する変換回路
と、から成っている。
【００７０】
【作用】このような構成によると、図３に示すように発
振出力信号ＳＣとカラ−バ−ストＢ１，Ｂ２は発振信号
にずれがないとき同位相で位相比較されるようになって
いるので、π／４の補正をかけるといった必要性はなく
なり、従ってディジタル回路であっても正確にＡＰＣ動
作を実現できる。
振出力信号ＳＣとカラ−バ−ストＢ１，Ｂ２は発振信号
にずれがないとき同位相で位相比較されるようになって
いるので、π／４の補正をかけるといった必要性はなく
なり、従ってディジタル回路であっても正確にＡＰＣ動
作を実現できる。
【００８０】
【実施例】本発明を実施した図１において、１は水晶振
動子２を備えたパルス発生用の電圧制御発振器であり、
その発振の中心周波数は、特にこれに限る必要はない
が、４.４３ＭＨｚの８倍の周波数に選ばれている。こ
のパルス信号を図２の（ａ）に示す。３は発振パルス信
号（ａ）を分周し、４.４３ＭＨｚのパルス信号とする
分周器であり、その出力としての基本パルス信号（図２
の（ｂ））は図４に示す基準位相ＲＥＦ（換言すれば、
カラ−バ−ストの非反転成分の位相）に一致している。
４はシフトレジスタであり、前記分周器３からの基本パ
ルス信号（ｂ）を発振器１からのパルス信号（ａ）をク
ロックＣＫとして位相シフトさせる。
動子２を備えたパルス発生用の電圧制御発振器であり、
その発振の中心周波数は、特にこれに限る必要はない
が、４.４３ＭＨｚの８倍の周波数に選ばれている。こ
のパルス信号を図２の（ａ）に示す。３は発振パルス信
号（ａ）を分周し、４.４３ＭＨｚのパルス信号とする
分周器であり、その出力としての基本パルス信号（図２
の（ｂ））は図４に示す基準位相ＲＥＦ（換言すれば、
カラ−バ−ストの非反転成分の位相）に一致している。
４はシフトレジスタであり、前記分周器３からの基本パ
ルス信号（ｂ）を発振器１からのパルス信号（ａ）をク
ロックＣＫとして位相シフトさせる。
【００９０】そして、このシフトレジスタ４の第１出力
線路５には−π／４の位相の第１基本パルス信号（ｃ）
が出力され、第２出力線路６には＋π／４の位相の第２
基本パルス信号（ｉ）が出力される。ここで、±π／４
の位相を実現するのにアナログ回路では、抵抗，コンデ
ンサ，コイル等を用いてシフト回路を作成するため精度
が出にくいが、本実施例の如くディジタル回路で構成
し、基本パルス信号（ｂ）をシフトレジスタ４等でシフ
トさせるものにおいては、±π／４の位相が精度よく実
現できる。
線路５には−π／４の位相の第１基本パルス信号（ｃ）
が出力され、第２出力線路６には＋π／４の位相の第２
基本パルス信号（ｉ）が出力される。ここで、±π／４
の位相を実現するのにアナログ回路では、抵抗，コンデ
ンサ，コイル等を用いてシフト回路を作成するため精度
が出にくいが、本実施例の如くディジタル回路で構成
し、基本パルス信号（ｂ）をシフトレジスタ４等でシフ
トさせるものにおいては、±π／４の位相が精度よく実
現できる。
【０１００】７はライン毎に前記第１、第２基本パルス
信号（ｃ）（ｉ）を選択するスイッチ回路であり、水平
同期パルスに基いて形成された水平パルスＨＰによりス
イッチング動作を行なう。このスイッチ回路７の出力は
位相比較器８へ供給される。位相比較器８は別途カラ−
バ−スト供給回路１１から与えられるカラ−バ−スト信
号パルスと前記第１、第２基本パルス信号（ｃ）（ｉ）
とを位相比較する。その比較出力はカラ−バ−スト信号
パルスと第１、第２基本パルス信号（ｃ）（ｉ）との位
相差に応じた幅のパルスとなる。この位相比較出力パル
スは変換器９によって電圧値に変換され、前記発振器１
を制御する。変換器９は例えば抵抗とコンデンサを用い
た積分回路で構成できる。前記第１、第２基本パルス信
号（ｃ）（ｉ）及びカラ−バ−スト信号パルスは波高値
がＣＭＯＳレベルの５Ｖp-pであり、それらの比較出力
も５Ｖp-pである。
信号（ｃ）（ｉ）を選択するスイッチ回路であり、水平
同期パルスに基いて形成された水平パルスＨＰによりス
イッチング動作を行なう。このスイッチ回路７の出力は
位相比較器８へ供給される。位相比較器８は別途カラ−
バ−スト供給回路１１から与えられるカラ−バ−スト信
号パルスと前記第１、第２基本パルス信号（ｃ）（ｉ）
とを位相比較する。その比較出力はカラ−バ−スト信号
パルスと第１、第２基本パルス信号（ｃ）（ｉ）との位
相差に応じた幅のパルスとなる。この位相比較出力パル
スは変換器９によって電圧値に変換され、前記発振器１
を制御する。変換器９は例えば抵抗とコンデンサを用い
た積分回路で構成できる。前記第１、第２基本パルス信
号（ｃ）（ｉ）及びカラ−バ−スト信号パルスは波高値
がＣＭＯＳレベルの５Ｖp-pであり、それらの比較出力
も５Ｖp-pである。
【０１１０】本実施例のＡＰＣ回路によれば、色副搬送
波に相当する第１、第２の基本パルス信号（ｃ）（ｉ）
とカラ−バ−ストとが図３に示す如く同一位相（発振器
１に位相ずれや周波数ずれが生じれば、そのずれの分だ
け位相差が生じる）で位相比較されるため±π／４の位
相差の補償を位相比較出力に対し施すといった必要性は
生じない。
波に相当する第１、第２の基本パルス信号（ｃ）（ｉ）
とカラ−バ−ストとが図３に示す如く同一位相（発振器
１に位相ずれや周波数ずれが生じれば、そのずれの分だ
け位相差が生じる）で位相比較されるため±π／４の位
相差の補償を位相比較出力に対し施すといった必要性は
生じない。
【０１２０】１０はスイッチ回路７の反転を検出する反
転検出回路である。これはスイッチ回路７のスイッチン
グ動作が例えば受像機の電源ＯＮに伴い全く任意の反転
極性でスタ−トすることにより、カラ−バ−ストとの位
相関係において、正規の反転をする状態とは全く逆の状
態でスイッチング動作する場合が生じうるので、その場
合にスイッチ回路７のスイッチング動作を正しく直すた
めに導入されたものである。
転検出回路である。これはスイッチ回路７のスイッチン
グ動作が例えば受像機の電源ＯＮに伴い全く任意の反転
極性でスタ−トすることにより、カラ−バ−ストとの位
相関係において、正規の反転をする状態とは全く逆の状
態でスイッチング動作する場合が生じうるので、その場
合にスイッチ回路７のスイッチング動作を正しく直すた
めに導入されたものである。
【０１３０】上記シフトレジスタ４はシフトされる基本
パルス信号（ｂ）に対しクロックＣＫが８倍の周波数で
あることにより、基本パルス信号（ｂ）を図２の（ｂ）
〜（ｉ）の如くπ／４ずつシフトすることができ、それ
によって基本パルス信号（ｂ）から−π／４と＋π／４
ずれた第１、第２基本パルス信号（ｃ）（ｉ）を作るこ
とができるので、１相のクロックＣＫ（即ち（ａ））だ
けでよいが、もし発振器１の出力が基本パルス信号
（ｂ）に対し４倍の周波数のパルスであれば、シフトレ
ジスタのクロックとして４倍の周波数のパルス以外にそ
の反転パルスも必要になり、結局２相のクロックでシフ
トすることになる。勿論、そのようにして第１、第２基
本パルス信号を形成してもよい。
パルス信号（ｂ）に対しクロックＣＫが８倍の周波数で
あることにより、基本パルス信号（ｂ）を図２の（ｂ）
〜（ｉ）の如くπ／４ずつシフトすることができ、それ
によって基本パルス信号（ｂ）から−π／４と＋π／４
ずれた第１、第２基本パルス信号（ｃ）（ｉ）を作るこ
とができるので、１相のクロックＣＫ（即ち（ａ））だ
けでよいが、もし発振器１の出力が基本パルス信号
（ｂ）に対し４倍の周波数のパルスであれば、シフトレ
ジスタのクロックとして４倍の周波数のパルス以外にそ
の反転パルスも必要になり、結局２相のクロックでシフ
トすることになる。勿論、そのようにして第１、第２基
本パルス信号を形成してもよい。
【０１４０】前記発振器１の出力は分周された後、Ｒ−
Ｙ，Ｂ−Ｙ復調器へ供給される。勿論、この発振器１の
出力（従って、ＡＰＣ回路の出力）は復調用としてだけ
でなく、他の用途にも用いられうるものである。
Ｙ，Ｂ−Ｙ復調器へ供給される。勿論、この発振器１の
出力（従って、ＡＰＣ回路の出力）は復調用としてだけ
でなく、他の用途にも用いられうるものである。
【０１５０】
【発明の効果】以上説明したように、発振信号とカラー
バーストは発振信号にずれがないとき同位相で位相比較
されるようになっているので、位相比較出力に±π／４
の位相分の補正をかけるといった必要性はなくなり、従
って電流補正をかけることの不可能なディジタル回路で
構成しても正確なＡＰＣ動作を実現できるという効果が
ある。しかも、同位相での位相比較を実現するのに、予
め発振信号を±π／４シフトするための構成が必要にな
るが、本発明では色副搬送波周波数の信号に対して２ n
（ｎ＝２，３，・・・，ｎ）倍の周波数を発振中心周波
数とするパルスを発生する電圧制御発振器と、前記電圧
制御発振器の出力を分周してカラーバーストの非反転成
分に対応する位相をもった基本パルス信号を出力する分
周回路と、前記基本パルス信号を前記電圧制御発振器の
出力パルスをクロックとしてシフトし、−π／４の位相
をもつ第１パルス信号と＋π／４の位相を持つ第２パル
ス信号とを形成するシフトレジスタと、前記第１、第２
パルス信号を１水平期間毎に切り換えて交互に出力する
スイッチ回路とで構成しているため全体的にディジタル
化が可能である。
バーストは発振信号にずれがないとき同位相で位相比較
されるようになっているので、位相比較出力に±π／４
の位相分の補正をかけるといった必要性はなくなり、従
って電流補正をかけることの不可能なディジタル回路で
構成しても正確なＡＰＣ動作を実現できるという効果が
ある。しかも、同位相での位相比較を実現するのに、予
め発振信号を±π／４シフトするための構成が必要にな
るが、本発明では色副搬送波周波数の信号に対して２ n
（ｎ＝２，３，・・・，ｎ）倍の周波数を発振中心周波
数とするパルスを発生する電圧制御発振器と、前記電圧
制御発振器の出力を分周してカラーバーストの非反転成
分に対応する位相をもった基本パルス信号を出力する分
周回路と、前記基本パルス信号を前記電圧制御発振器の
出力パルスをクロックとしてシフトし、−π／４の位相
をもつ第１パルス信号と＋π／４の位相を持つ第２パル
ス信号とを形成するシフトレジスタと、前記第１、第２
パルス信号を１水平期間毎に切り換えて交互に出力する
スイッチ回路とで構成しているため全体的にディジタル
化が可能である。
【図１】 本発明を実施したＡＰＣ回路を示すブロック
回路図
回路図
【図２】 それを説明するための信号波形図
【図３】 図１の位相比較器における入力の比較原理を
示すベクトル図
示すベクトル図
【図４】 ＰＡＬ方式のカラ−バ−ストのライン毎のス
イングを示す図
イングを示す図
【図５】 従来例のＡＰＣ回路を関係回路と共に示すブ
ロック回路図
ロック回路図
【図６】 従来例の位相比較原理を示す図
【図７】 従来例を示すブロック回路図
１ 電圧制御発振器 ３ 分周器 ４ シフトレジスタ ７ スイッチ回路 ８ 位相比較器 ９ 変換器
Claims (1)
- 【請求項１】 色副搬送波周波数の信号に対して２
n（ｎ＝２，３，・・・，ｎ）倍の周波数を発振中心周
波数とするパルスを発生する電圧制御発振器と、前記電
圧制御発振器の出力を分周してカラーバーストの非反転
成分に対応する位相をもった基本パルス信号を出力する
分周回路と、 前記基本パルス信号を前記電圧制御発振器の出力パルス
をクロックとしてシフトし、−π／４の位相をもつ第１
パルス信号と＋π／４の位相を持つ第２パルス信号とを
形成するシフトレジスタと、 前記第１、第２パルス信号を１水平期間毎に切り換えて
交互に出力するスイッチ回路と、 入力のカラーバースト信号と前記スイッチ回路の出力パ
ルス信号とを位相比較する位相比較回路と、 前記位相比較回路の出力を電圧変換して前記電圧制御発
振器へ制御信号として供給する変換回路と、 から成るＰＡＬ方式におけるＡＰＣ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3045986A JP2726571B2 (ja) | 1991-02-18 | 1991-02-18 | Ｐａｌ方式におけるａｐｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3045986A JP2726571B2 (ja) | 1991-02-18 | 1991-02-18 | Ｐａｌ方式におけるａｐｃ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04263590A JPH04263590A (ja) | 1992-09-18 |
| JP2726571B2 true JP2726571B2 (ja) | 1998-03-11 |
Family
ID=12734482
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3045986A Expired - Fee Related JP2726571B2 (ja) | 1991-02-18 | 1991-02-18 | Ｐａｌ方式におけるａｐｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2726571B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60150394A (ja) * | 1984-01-18 | 1985-08-08 | Matsushita Electric Ind Co Ltd | Ｐａｌカラ−映像信号のａｐｃ色同期回路 |
-
1991
- 1991-02-18 JP JP3045986A patent/JP2726571B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04263590A (ja) | 1992-09-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |