JP2018506130A - シフトレジスタ、及び段伝送ゲートドライバ回路及び表示パネル - Google Patents
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Abstract
Description
該第2プルダウンモジュールが、第20トランジスタと第21トランジスタと第22トランジスタとを含み、該第20トランジスタと該第21トランジスタと該第22トランジスタは、いずれもゲート電極が該第5段伝送信号入力端に接続し、かついずれもソース電極が該第5信号入力端に接続し、該第20トランジスタはドレイン電極が該走査信号出力端に接続し、該第21トランジスタはドレイン電極が該第1段伝送信号出力端に接続し、該第22トランジスタはドレイン電極が該第1共有点に接続する。
スタの段伝送信号で次の1段のシフトレジスタの走査信号の出力を制御し、走査信号を出力した後、2つのプルダウンホールディングモジュールが走査信号出力端の電位を交互にプルダウンして低電位とし、かつ第2プルダウンモジュール140を組み合わせることによって共同で走査信号出力端の電位をプルダウンして低電位とする、このため回路における一部トランジスタの漏電を防ぎ、走査信号出力端の安定した低電位信号の出力を保証し、トランジスタの劣化を防ぎ、体積を減少させることができる。
第に接続する。第13トランジスタT13はドレイン電極が第1共有点Q点270に接続し、ゲート電極が第2共有点P点280に接続し、ソース電極が第5信号入力端251に接続する。第14トランジスタT14は、ドレイン電極が走査信号出力端223に接続し、ゲート電極が第2共有点P点280に接続し、ソース電極が第5信号入力端251に接続する。第15トランジスタT15と、第16トランジスタT16と、第17トランジスタT17のドレイン電極と、第17トランジスタT17のゲート電極のいずれも第4信号入力端242に接続する。第15トランジスタT15はゲート電極が第4段伝送信号入力端241に接続し、ソース電極が第16トランジスタT16のソース電極と第3共有点K点290に接続する。第16トランジスタT16はゲート電極が第17トランジスタT17のソース電極に接続し、第17トランジスタT17はソース電極が第9トランジスタT9のドレイン電極に接続する。第18トランジスタT18はドレイン電極が第1共有点Q点270に接続し、ゲート電極が第3共有点K点290に接続し、ソース電極が第5信号入力端251に接続する。第19トランジスタT19はドレイン電極が走査信号出力端223に接続し、ゲート電極が第3共有点K点290に接続し、ソー^ス電極が第5信号入力端251に接続する。
111 第1段伝送信号入力端
112 第2段伝送信号入力端
120 出力モジュール
121 第1信号入力端
122 第2信号入力端
123 走査信号出力端
124 第1段伝送信号出力端
125 第2段伝送信号出力端
130 第1プルダウンホールディングモジュール
131 第3段伝送信号入力端
132 第3信号入力端
140 第2プルダウンホールディングモジュール
141 第4段伝送信号入力端
142 第4信号入力端
150 第1プルダウンモジュール
151 第5信号入力端
160 第2プルダウンモジュール
161 第5段伝送信号入力端
170 第1共有点
210 プルダウンモジュール
211 第1段伝送信号入力端
212 第2段伝送信号入力端
222 第2信号入力端
223 走査信号出力端
224 第1段伝送信号出力端
225 第2段伝送信号出力端
230 第1プルダウンホールディングモジュール
231 第3段伝送信号入力端
232 第3信号入力端
240 第2プルダウンホールディングモジュール
241 第4段伝送信号入力端
242 第4信号入力端
250 第1プルダウンモジュール
251 第5信号入力端
260 第2プルダウンモジュール
261 第5段伝送信号入力端
270 第1共有点Q点
280 第2共有点P点
290 第3共有点K点
301 シーケンス
C コンデンサ
CK(n) 交流信号
CST(n)段伝送信号
CST(n-1) 入力信号
G(n) 走査信号
LC1 高/低電位信号
LC2 高/低電位信号
SCK(n)交流信号
ST(n) 段伝送信号
ST(n‐1)入力信号
ST(n+1)入力信号
T1 第1トランジスタ
T2 第2トランジスタ
T3 第3トランジスタ
T4 第4トランジスタ
T5 第5トランジスタ
T6 第6トランジスタ
T7 第7トランジスタ
T8 第8トランジスタ
T9 第9トランジスタ
T10 第10トランジスタ
T11 第11トランジスタ
T12 第12トランジスタ
T13 第13トランジスタ
T14 第14トランジスタ
T15 第15トランジスタ
T16 第16トランジスタ
T17 第17トランジスタ
T18 第18トランジスタ
T19 第19トランジスタ
T20 第20トランジスタ
T21 第21トランジスタ
T22 第22トランジスタ
Vss 低電位信号
Claims (17)
- トランスファーモジュールと、出力モジュールと、第1プルダウンホールディングモジュールと、第2プルダウンホールディングモジュールと、第1プルダウンモジュールと、第2プルダウンモジュールと、を含んでなり、
該トランスファーモジュールと、該出力モジュールと、該第1プルダウンホールディングモジュールと、該第2プルダウンホールディングモジュールとが第1共有点に接続し、該第1プルダウンモジュールが該第1プルダウンホールディングモジュールと、該第2プルダウンホールディングモジュールとに接続し、該第2プルダウンモジュールが該第1プルダウンモジュールと該出力モジュールとの間に接続し、
該第1共有点は、該トランスファーモジュールが前1段のシフトレジスタの高電位段伝送信号を受信する場合に高電位となり、
該第1プルダウンホールディングモジュールと、該第2プルダウンホールディングモジュールとが、次の1段のシフトレジストに入力する高電位信号を交互に受信して該第1プルダウンモジュールと該第1共有点とを
オンにし、該第1共有点をプルダウンして低電位にして保持し、同時に該第2プルダウンモジュールが、該第1プルダウンモジュールと該第1共有点とがオンとなった状態に基づき、該出力モジュールの出力する走査信号を低電位になるまでプルダウンし、かつ保持することを特徴とするシフトレジスト。 - 前記トランスファーモジュールが、第1段伝送信号入力端と第2段伝送信号入力端と、前一段のシフトレジスタに接続する第1段伝送信号出力端と、第2段伝送信号出力端とを含み、
該出力モジュールが、第1信号入力端と、第2信号入力端と、第1段伝送信号出力端と、第2段伝送信号出力端と、走査信号出力端とを含み、
該出力モジュールの第1段伝送信号出力端と該第2段伝送信号出力端とが、それぞれ前1段及び/もしくは次の1段のシフトレジスタの第1段伝送信号入力端及び第2段伝送信号入力に接続して段伝送信号を提供し、該第1信号入力端と該第2信号入力端が交流信号を受信し、
該第1プルダウンホールディングモジュールは、第3段伝送信号入力端及び第3信号入力端を含み、該第3段伝送信号入力端が次の段のシフトレジストの第1段伝送信号出力端に接続し、該第3信号入力端が交流信号を受信し、
該第2プルダウンホールディングモジュールは、第4段伝送信号入力端及び第4信号入力端を含み、該第4段伝送信号入力端が次の段のシフトレジストの第1伝送信号出力端に接続し、該第4信号入力端が交流信号を受信し、
該第1プルダウンモジュールは第5信号入力端を含み、低レベル信号を受信し、
該第2プルダウンモジュールは、第5段伝送信号入力端を含み、次の1段のシフトレジスタの第1段伝送信号出力端に接続し、
該トランスファーモジュールが該第1段伝送信号入力端及び第2段伝送信号が前1段のシフトレジスタの高電位段伝送信号を受信する場合、第1共有点の電位が上昇して高電位となり、該出力モジュールの第1信号入力端と第2信号入力端とが低電位のクロック信号を受信し、該走査信号出力端から低電位走査信号を出力し、
該トランスファーモジュールがオフになった後、該第1共有点は依然として高電位であって、該出力モジュールの第1信号入力端と第2信号入力端が高電位クロック信号を受信して走査信号出力端から高電位走査信号を出力し、
該走査信号出力端が出力した後、該第3段伝送信号入力端と、第4段伝送信号入力端と、第6段伝送信号入力端に次の1段のシフトレジスタの第1段伝送信号出力端の高電位段伝送信号が入力し、該第3信号入力端及び該第4信号入力端に高電位信号が交互に入力して該第1プルダウンモジュールと該第1共有点とがオンになり、該第1共有点と該走査信号出力端を交互にプルダウンして低電位とし、同時に該第2プルダウンモジュールが該第1共有点と該走査信号出力端をプルダウンして低電位とする。ことを特徴とする請求項1に記載のシフトレジスタ。 - 前記プルダウンモジュールが第1トランジスタを含み、該第1トランジスタは、ドレイン電極が第2段伝送信号入力端か直流電源に接続し、ソース電極が第1共有点に接続し、ゲート電極が第1段伝送信号入力端に接続することを特徴とする請求項2に記載のシフトレジスタ。
- 前記出力モジュールが、ドレイン電極が第1信号入力端に接続し、ソース電極が走査信号出力端に接続する第2トランジスタと、
ドレイン電極が第2信号入力端に接続し、ソース電極が該第1段伝送信号出力端に接続する第3トランジスタと、
ドレイン電極が該第2信号入力端に接続し、ソース電極が第2段伝送信号出力端に接続する第4トランジスタと、を含み、かつ該第2トランジスタと該第3トランジスタと該第4トランジスタのゲート電極が、いずれも該第1共有点に接続し、
該第3トランジスタのゲート電極とソース電極との間にコンデンサを接続することを特徴とする請求項2に記載のシフトレジスタ。 - 前記第1プルダウンモジュールが、第5トランジスタと、第6トランジスタと、第7トランジスタと、第8トランジスタと、第9トランジスタとを含み、
該第1プルダウンホールディングモジュールが、第10トランジスタと、第11トランジスタと、第12トランジスタと、第13トランジスタと、第14トランジスタとを含み、
該第2プルダウンホールディングモジュールが、第15トランジスタと、第16トランジスタと、第17トランジスタと、第18トランジスタと、第19トランジスタとを含み、
該第5トランジスタと、該6トランジスタと、該7トランジスタはゲート電極が第1共有点に接続し、該第6トランジスタと該7トランジスタはソース電極が該第5信号入力端に接続し、
該第8トランジスタと該第9トランジスは、ゲート電極が第1段伝送信号入力端接続し、ソース電極が該第5信号入力端に接続し、
該第10トランジスタと、該第11トランジスタと、該第12トランジスタのドレイン電極と、該第12トランジスタのゲート電極は、いずれも第3段伝送信号入力端に接続し、該第10トランジスタは、ゲートが該第3段伝送信号入力端に接続し、ソース電極が該第11トランジスタのソース電極と第2共通点とに接続し、
該第11トランジスタはゲート電極が該第12トランジスタのソース電極に接続し、
該第12トランジスタはソース電極が第8トランジスタのドレイン電極に接続し、
該第13トランジスタはドレイン電極が第1共有点に接続し、ゲート電極が第2共有点に接続し、ソース電極が該第5信号入力端に接続し、
該第14トランジスタは、ドレイン電極が該走査信号出力端に接続し、ゲート電極が該第2共有点に接続し、ソース電極が該第5信号入力端に接続し、
該第15トランジスタと、該第16トランジスタと、該第17トランジスタのドレイン電極と、該第17トランジスタのゲート電極のいずれもが該第4信号入力端に接続し、該第15トランジスタはゲート電極が該第4段伝送信号入力端に接続し、ソース電極が該第16トランジスタのソース電極と第3共有点に接続し、
該第16トランジスタはゲート電極が該第17トランジスタのソース電極に接続し、
該第17トランジスタはソース電極が該第9トランジスタのドレイン電極に接続し、
該第18トランジスタはドレイン電極が第1共有点に接続し、ゲート電極が該第3共有点に接続し、ソース電極が該第5信号入力端に接続し、
該該19トランジスタはドレイン電極が該走査信号出力端に接続し、ゲート電極が該第3共有点に接続し、ソース電極が該第5信号入力端に接続することを特徴とする請求項2に記載のシフトレジスタ。 - 前記第10トランジスタは、ゲート電極が該第4信号入力端に接続し、該第15トランジスタは、ゲート電極が該第3信号入力端に接続することを特徴とする請求項5に記載のシフトレジスタ。
- 前記第2プルダウンモジュールが、第20トランジスタと第21トランジスタと第22トランジスタとを含み、
該第20トランジスタと該第21トランジスタと該第22トランジスタは、いずれもゲート電極が該第5段伝送信号入力端に接続し、かついずれもソース電極が該第5信号入力端に接続し、
該第20トランジスタはドレイン電極が該走査信号出力端に接続し、該第21トランジスタはドレイン電極が該第1段伝送信号出力端に接続し、該第22トランジスタはドレイン電極が該第1共有点に接続することを特徴とする請求項2に記載のシフトレジスタ。 - 請求項1に記載するシフトレジストを複数含んでなる段伝送ゲートドライバ回路であって、
それぞれの該シフトレジストの第1段伝送信号出力端と第2段伝送信号出力端が前1段のシフトレジストと次の1段のシフトレジストのそれぞれの段伝送出力端に接続して段伝送信号を提供することを特徴とする段伝送ゲートドライバ回路。 - 前記段伝送ゲートドライバ回路の第1段のシフトレジストの第1段信号入力端と第2段信号入力端とがSTV信号に接続し、最後の1段のシフトレジストの第3段信号入力端と、第4段信号入力端と、第5段信号入力端とがSTV信号に接続することを特徴とする請求項8に記載の段伝送ゲードライバ回路。
- 前記トランスファーモジュールが、第1段伝送信号入力端と第2段伝送信号入力端と、前一段のシフトレジスタに接続する第1段伝送信号出力端と、第2段伝送信号出力端とを含み、
該出力モジュールが、第1信号入力端と、第2信号入力端と、第1段伝送信号出力端と、第2段伝送信号出力端と、走査信号出力端とを含み、
該出力モジュールの第1段伝送信号出力端と該第2段伝送信号出力端とが、それぞれ前1段及び/もしくは次の1段のシフトレジスタの第1段伝送信号入力端及び第2段伝送信号入力に接続して段伝送信号を提供し、該第1信号入力端と該第2信号入力端が交流信号を受信し、
該第1プルダウンホールディングモジュールは、第3段伝送信号入力端及び第3信号入力端を含み、該第3段伝送信号入力端が次の段のシフトレジストの第1段伝送信号出力端に接続し、該第3信号入力端が交流信号を受信し、
該第2プルダウンホールディングモジュールは、第4段伝送信号入力端及び第4信号入力端を含み、該第4段伝送信号入力端が次の段のシフトレジストの第1伝送信号出力端に接続し、該第4信号入力端が交流信号を受信し、
該第1プルダウンモジュールは第5信号入力端を含み、低レベル信号を受信し、
該第2プルダウンモジュールは、第5段伝送信号入力端を含み、次の1段のシフトレジスタの第1段伝送信号出力端に接続し、
該トランスファーモジュールが該第1段伝送信号入力端及び第2段伝送信号が前1段のシフトレジスタの高電位段伝送信号を受信する場合、第1共有点の電位が上昇して高電位となり、該出力モジュールの第1信号入力端と第2信号入力端とが低電位のクロック信号を受信し、該走査信号出力端から低電位走査信号を出力し、
該トランスファーモジュールがオフになった後、該第1共有点は依然として高電位であって、該出力モジュールの第1信号入力端と第2信号入力端が高電位クロック信号を受信して走査信号出力端から高電位走査信号を出力し、
該走査信号出力端が出力した後、該第3段伝送信号入力端と、第4段伝送信号入力端と、第6段伝送信号入力端に次の1段のシフトレジスタの第1段伝送信号出力端の高電位段伝送信号が入力し、該第3信号入力端及び該第4信号入力端に高電位信号が交互に入力して該第1プルダウンモジュールと該第1共有点とがオンになり、該第1共有点と該走査信号出力端を交互にプルダウンして低電位とし、同時に該第2プルダウンモジュールが該第1共有点と該走査信号出力端をプルダウンして低電位とすることを特徴とする請求項8に記載の段伝送ゲートドライバ回路。 - 前記プルダウンモジュールが第1トランジスタを含み、該第1トランジスタは、ドレイン電極が第2段伝送信号入力端か直流電源に接続し、ソース電極が第1共有点に接続し、ゲート電極が第1段伝送信号入力端に接続することを特徴とする請求項10に記載の段伝送ゲートドライバ回路。
- 前記出力モジュールが、ドレイン電極が第1信号入力端に接続し、ソース電極が走査信号出力端に接続する第2トランジスタと、
ドレイン電極が第2信号入力端に接続し、ソース電極が該第1段伝送信号出力端に接続する第3トランジスタと、
ドレイン電極が該第2信号入力端に接続し、ソース電極が第2段伝送信号出力端に接続する第4トランジスタと、を含み、かつ該第2トランジスタと該第3トランジスタと該第4トランジスタのゲート電極が、いずれも該第1共有点に接続し、
該第3トランジスタのゲート電極とソース電極との間にコンデンサを接続することを特徴とする請求項10に記載の段伝送ゲートドライバ回路。 - 前記第1プルダウンモジュールが、第5トランジスタと、第6トランジスタと、第7トランジスタと、第8トランジスタと、第9トランジスタとを含み、
該第1プルダウンホールディングモジュールが、第10トランジスタと、第11トランジスタと、第12トランジスタと、第13トランジスタと、第14トランジスタとを含み、
該第2プルダウンホールディングモジュールが、第15トランジスタと、第16トランジスタと、第17トランジスタと、第18トランジスタと、第19トランジスタとを含み、
該第5トランジスタと、該6トランジスタと、該7トランジスタはゲート電極が第1共有点に接続し、該第6トランジスタと該7トランジスタはソース電極が該第5信号入力端に接続し、
該第8トランジスタと該第9トランジスは、ゲート電極が第1段伝送信号入力端接続し、ソース電極が該第5信号入力端に接続し、
該第10トランジスタと、該第11トランジスタと、該第12トランジスタのドレイン電極と、該第12トランジスタのゲート電極は、いずれも第3段伝送信号入力端に接続し、該第10トランジスタは、ゲートが該第3段伝送信号入力端に接続し、ソース電極が該第11トランジスタのソース電極と第2共通点とに接続し、
該第11トランジスタはゲート電極が該第12トランジスタのソース電極に接続し、
該第12トランジスタはソース電極が第8トランジスタのドレイン電極に接続し、
該第13トランジスタはドレイン電極が第1共有点に接続し、ゲート電極が第2共有点に接続し、ソース電極が該第5信号入力端に接続し、
該第14トランジスタは、ドレイン電極が該走査信号出力端に接続し、ゲート電極が該第2共有点に接続し、ソース電極が該第5信号入力端に接続し、
該第15トランジスタと、該第16トランジスタと、該第17トランジスタのドレイン電極と、該第17トランジスタのゲート電極のいずれもが該第4信号入力端に接続し、該第15トランジスタはゲート電極が該第4段伝送信号入力端に接続し、ソース電極が該第16トランジスタのソース電極と第3共有点に接続し、
該第16トランジスタはゲート電極が該第17トランジスタのソース電極に接続し、
該第17トランジスタはソース電極が該第9トランジスタのドレイン電極に接続し、
該第18トランジスタはドレイン電極が第1共有点に接続し、ゲート電極が該第3共有点に接続し、ソース電極が該第5信号入力端に接続し、
該該19トランジスタはドレイン電極が該走査信号出力端に接続し、ゲート電極が該第3共有点に接続し、ソース電極が該第5信号入力端に接続することを特徴とする請求項10に記載の段伝送ゲートドライバ回路。 - 前記第10トランジスタは、ゲート電極が該第4信号入力端に接続し、該第15トランジスタは、ゲート電極が該第3信号入力端に接続することを特徴とする請求項13に記載の段伝送ゲートドライバ回路。
- 前記第2プルダウンモジュールが、第20トランジスタと第21トランジスタと第22トランジスタとを含み、
該第20トランジスタと該第21トランジスタと該第22トランジスタは、いずれもゲート電極が該第5段伝送信号入力端に接続し、かついずれもソース電極が該第5信号入力端に接続し、
該第20トランジスタはドレイン電極が該走査信号出力端に接続し、該第21トランジスタはドレイン電極が該第1段伝送信号出力端に接続し、該第22トランジスタはドレイン電極が該第1共有点に接続することを特徴とする請求項10に記載の段伝送ゲートドライバ回路。 - 請求項8に記載する段伝送ゲートドライバ回路を含んでなる表示パネル。
- 前記段伝送ゲートドライバ回路の第1段のシフトレジストの第1段信号入力端と第2段信号入力端とがSTV信号に接続し、最後の1段のシフトレジストの第3段信号入力端と、第4段信号入力端と、第5段信号入力端とがSTV信号に接続することを特徴とする請求項16に記載の表示パネル。
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