JP2017183747A - 光センサ - Google Patents
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Abstract
【課題】入射光による光電変換層の容量の変化に対応する電気信号を検出する光センサを提供する。
【解決手段】半導体層上の、光電変換層23pを含むゲート絶縁層23,33と、ゲート絶縁層上のゲート電極34と、半導体層内のソース領域およびドレイン領域のうちの一方と、ゲート電極との間に電圧を印加する電圧供給回路と、ソース領域およびドレイン領域のうちの他方に接続された信号検出回路と、を備える。光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間の、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有する。
【選択図】図1
【解決手段】半導体層上の、光電変換層23pを含むゲート絶縁層23,33と、ゲート絶縁層上のゲート電極34と、半導体層内のソース領域およびドレイン領域のうちの一方と、ゲート電極との間に電圧を印加する電圧供給回路と、ソース領域およびドレイン領域のうちの他方に接続された信号検出回路と、を備える。光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間の、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有する。
【選択図】図1
Description
本開示は、光センサに関する。
従来、光検出装置、イメージセンサなどに光検出素子が用いられている。光検出素子の典型例は、フォトダイオード、フォトトランジスタなどの光電変換素子である。よく知られているように、光の照射によって光電変換素子に生じる光電流を検出することにより、光を検出することができる。
下記の特許文献1は、図2に、所定の化合物が有機重合体中に分散された有機膜をゲート絶縁膜として有する薄膜トランジスタ(TFT)を開示している。有機膜を構成する所定の化合物としては、光の照射によって分極の状態が変化する化合物が選ばれる。特許文献1の薄膜トランジスタでは、ゲート絶縁膜に光が照射されると、ゲート絶縁膜の誘電率が変化する。そのため、ゲート絶縁膜への光の照射によって、ソース−ドレイン間を流れる電流が変化する。特許文献1には、このような薄膜トランジスタを光センサに用いることが可能であると記載されている。
新規な構成を有する光センサを提供する。
本開示の限定的ではないある例示的な実施形態によれば、以下が提供される。
ソース領域およびドレイン領域を含む半導体層と、半導体層のソース領域とドレイン領域とで挟まれた領域上に位置し、光電変換層を含むゲート絶縁層と、記ゲート絶縁層上のゲート電極と、ソース領域およびドレイン領域のうちの一方と、ゲート電極との間に電圧を印加する電圧供給回路と、ソース領域およびドレイン領域のうちの他方に接続された信号検出回路と、を備え、光電変換層は、逆方向のバイアス電圧が増大するのに従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向のバイアス電圧が増大するのに従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間であって、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有し、電圧供給回路は、光電変換層に印加されるバイアス電圧が第3電圧範囲内となるように電圧を印加し、信号検出回路は、入射光による光電変換層の容量の変化に対応する電気信号を検出する、光センサ。
包括的または具体的な態様は、素子、デバイス、装置、システム、集積回路または方法で実現されてもよい。また、包括的または具体的な態様は、素子、デバイス、装置、システム、集積回路および方法の任意の組み合わせによって実現されてもよい。
開示された実施形態の追加的な効果および利点は、明細書および図面から明らかになる。効果および/または利点は、明細書および図面に開示の様々な実施形態または特徴によって個々に提供され、これらの1つ以上を得るために全てを必要とはしない。
本開示の一態様によれば、新規な構成を有する光センサが提供される。
本開示の一態様の概要は以下のとおりである。
[項目1]
ソース領域およびドレイン領域を含む半導体層と、
半導体層のソース領域とドレイン領域とで挟まれた領域上に位置し、光電変換層を含むゲート絶縁層と、
ゲート絶縁層上のゲート電極と、
ソース領域およびドレイン領域のうちの一方と、ゲート電極との間に電圧を印加する電圧供給回路と、
ソース領域およびドレイン領域のうちの他方に接続された信号検出回路と、
を備え、
光電変換層は、逆方向のバイアス電圧が増大するのに従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向のバイアス電圧が増大するのに従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間であって、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有し、
電圧供給回路は、光電変換層に印加されるバイアス電圧が第3電圧範囲内となるように電圧を印加し、
信号検出回路は、入射光による光電変換層の容量の変化に対応する電気信号を検出する、光センサ。
ソース領域およびドレイン領域を含む半導体層と、
半導体層のソース領域とドレイン領域とで挟まれた領域上に位置し、光電変換層を含むゲート絶縁層と、
ゲート絶縁層上のゲート電極と、
ソース領域およびドレイン領域のうちの一方と、ゲート電極との間に電圧を印加する電圧供給回路と、
ソース領域およびドレイン領域のうちの他方に接続された信号検出回路と、
を備え、
光電変換層は、逆方向のバイアス電圧が増大するのに従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向のバイアス電圧が増大するのに従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間であって、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有し、
電圧供給回路は、光電変換層に印加されるバイアス電圧が第3電圧範囲内となるように電圧を印加し、
信号検出回路は、入射光による光電変換層の容量の変化に対応する電気信号を検出する、光センサ。
[項目2]
ゲート絶縁層は、光電変換層と半導体層との間に配置された第1絶縁層を含む、項目1に記載の光センサ。
ゲート絶縁層は、光電変換層と半導体層との間に配置された第1絶縁層を含む、項目1に記載の光センサ。
[項目3]
ゲート電極と半導体層との間に配置された遮光膜を備える、項目1または2に記載の光センサ。
ゲート電極と半導体層との間に配置された遮光膜を備える、項目1または2に記載の光センサ。
[項目4]
第1電極と、
第1電極に対向する第2電極と、
第1電極と記第2電極との間の光電変換層と、
ゲートが第1電極に電気的に接続されたトランジスタと、
トランジスタのソースおよびドレインのうちの一方と、第2電極との間に電圧を印加する電圧供給回路と、
トランジスタのソースおよびドレインのうちの他方に接続された信号検出回路と、
を備え、
光電変換層は、逆方向のバイアス電圧が増大するのに従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向のバイアス電圧が増大するのに従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間であって、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有し、
電圧供給回路は、光電変換層に印加されるバイアス電圧が第3電圧範囲内となるように電圧を印加し、
信号検出回路は、入射光による光電変換層の容量の変化に対応する電気信号を検出する、光センサ。
第1電極と、
第1電極に対向する第2電極と、
第1電極と記第2電極との間の光電変換層と、
ゲートが第1電極に電気的に接続されたトランジスタと、
トランジスタのソースおよびドレインのうちの一方と、第2電極との間に電圧を印加する電圧供給回路と、
トランジスタのソースおよびドレインのうちの他方に接続された信号検出回路と、
を備え、
光電変換層は、逆方向のバイアス電圧が増大するのに従って出力電流密度の絶対値が増大する第1電圧範囲と、順方向のバイアス電圧が増大するのに従って出力電流密度が増大する第2電圧範囲と、第1電圧範囲と第2電圧範囲との間であって、バイアス電圧に対する出力電流密度の変化率の絶対値が第1電圧範囲および第2電圧範囲よりも小さい第3電圧範囲と、を有する光電流特性を有し、
電圧供給回路は、光電変換層に印加されるバイアス電圧が第3電圧範囲内となるように電圧を印加し、
信号検出回路は、入射光による光電変換層の容量の変化に対応する電気信号を検出する、光センサ。
[項目5]
第1電極は、遮光性を有する、項目4に記載の光センサ。
第1電極は、遮光性を有する、項目4に記載の光センサ。
[項目6]
第1電極と光電変換層との間に配置された第1絶縁層、および、第2電極と光電変換層との間に配置された第2絶縁層のうちの少なくとも一方を備える、項目4または5に記載の光センサ。
第1電極と光電変換層との間に配置された第1絶縁層、および、第2電極と光電変換層との間に配置された第2絶縁層のうちの少なくとも一方を備える、項目4または5に記載の光センサ。
[項目7]
第3電圧範囲は、−1V以上、1V以下である、項目1から6のいずれか1項に記載の光センサ。
第3電圧範囲は、−1V以上、1V以下である、項目1から6のいずれか1項に記載の光センサ。
[項目8]
バイアス電圧が第3電圧範囲内であるとき、光電変換層に流れる電流密度は100μA/cm2以下である、項目1から6のいずれか1項に記載の光センサ。
バイアス電圧が第3電圧範囲内であるとき、光電変換層に流れる電流密度は100μA/cm2以下である、項目1から6のいずれか1項に記載の光センサ。
[項目9]
ソース領域およびドレイン領域を含む半導体基板と、
半導体基板上のゲート絶縁層と、
ゲート絶縁層上の透明ゲート電極と、を備え、
ゲート絶縁層は、光電変換層を含み、
光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲、および、第1電圧範囲と第2電圧範囲との間の第3電圧範囲において、バイアス電圧に対する出力電流密度の変化率が互いに異なる光電流特性を有し、
第3電圧範囲における変化率は、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さく、
ソース領域およびドレイン領域のうちの一方と、透明ゲート電極との間の電位差が第3電圧範囲内に維持された状態で、透明ゲート電極を介して光電変換層に入射する光を、光の入射による光電変換層の誘電率の変化に対応した、ソース領域およびドレイン領域のうちの他方からの電気信号として検出する、光センサ。
ソース領域およびドレイン領域を含む半導体基板と、
半導体基板上のゲート絶縁層と、
ゲート絶縁層上の透明ゲート電極と、を備え、
ゲート絶縁層は、光電変換層を含み、
光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲、および、第1電圧範囲と第2電圧範囲との間の第3電圧範囲において、バイアス電圧に対する出力電流密度の変化率が互いに異なる光電流特性を有し、
第3電圧範囲における変化率は、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さく、
ソース領域およびドレイン領域のうちの一方と、透明ゲート電極との間の電位差が第3電圧範囲内に維持された状態で、透明ゲート電極を介して光電変換層に入射する光を、光の入射による光電変換層の誘電率の変化に対応した、ソース領域およびドレイン領域のうちの他方からの電気信号として検出する、光センサ。
項目9の構成によれば、応答性に優れた光センサを提供することができる。例えば、応答性に優れた赤外線センサを実現し得る。
[項目10]
ソース領域およびドレイン領域のうちの一方の電位を基準としたときに第3電圧範囲内にあるゲート電圧を透明ゲート電極に供給する電圧供給回路を有する、項目9に記載の光センサ。
ソース領域およびドレイン領域のうちの一方の電位を基準としたときに第3電圧範囲内にあるゲート電圧を透明ゲート電極に供給する電圧供給回路を有する、項目9に記載の光センサ。
項目10の構成によれば、光電変換層の主面の間に第3電圧範囲の電位差を与えることが可能である。
[項目11]
ゲート絶縁層は、光電変換層と半導体基板の間に配置された第1絶縁層を含む、項目9または10に記載の光センサ。
ゲート絶縁層は、光電変換層と半導体基板の間に配置された第1絶縁層を含む、項目9または10に記載の光センサ。
項目11の構成によれば、光センサにおけるゲートリークを抑制し得る。
[項目12]
半導体基板に形成されたアドレストランジスタであって、ソースおよびドレインの一方がソース領域およびドレイン領域のうちの他方に電気的に接続されたアドレストランジスタを有し、
アドレストランジスタのゲートは、第2絶縁層を含み、
アドレストランジスタの第2絶縁層は、第1絶縁層と同層である、項目11に記載の光センサ。
半導体基板に形成されたアドレストランジスタであって、ソースおよびドレインの一方がソース領域およびドレイン領域のうちの他方に電気的に接続されたアドレストランジスタを有し、
アドレストランジスタのゲートは、第2絶縁層を含み、
アドレストランジスタの第2絶縁層は、第1絶縁層と同層である、項目11に記載の光センサ。
項目12の構成によれば、ゲート絶縁層における第1絶縁層と、アドレストランジスタのゲートにおける第2絶縁層とを、同一の工程において一括して形成し得る。したがって、フォトリソグラフィーにおけるアライメントマージンを削減することが可能である。
[項目13]
透明ゲート電極と半導体基板との間に配置された遮光膜を有する、項目9から12のいずれかに記載の光センサ。
透明ゲート電極と半導体基板との間に配置された遮光膜を有する、項目9から12のいずれかに記載の光センサ。
項目13の構成によれば、ソース領域およびドレイン領域の間に形成されるチャネル領域への迷光の入射を抑制することが可能であるので、隣接する単位画素セル間の混色などのノイズの混入を抑制し得る。
[項目14]
半導体基板と、
半導体基板に形成された電界効果トランジスタと、
電界効果トランジスタのゲートに接続された第1電極と、
第1電極に対向する透光性の第2電極と、
第1電極と第2電極との間に配置された光電変換層と、を備え、
光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲、および、第1電圧範囲と第2電圧範囲との間の第3電圧範囲において、バイアス電圧に対する出力電流密度の変化率が互いに異なる光電流特性を有し、
第3電圧範囲における変化率は、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さく、
電界効果トランジスタのソースおよびドレインのうちの一方と、第2電極との間の電位差が第3電圧範囲内に維持された状態で、第2電極を介して光電変換層に入射する光を、光の入射による光電変換層の誘電率の変化に対応した、ソースおよびドレインのうちの他方からの電気信号として検出する、光センサ。
半導体基板と、
半導体基板に形成された電界効果トランジスタと、
電界効果トランジスタのゲートに接続された第1電極と、
第1電極に対向する透光性の第2電極と、
第1電極と第2電極との間に配置された光電変換層と、を備え、
光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲、および、第1電圧範囲と第2電圧範囲との間の第3電圧範囲において、バイアス電圧に対する出力電流密度の変化率が互いに異なる光電流特性を有し、
第3電圧範囲における変化率は、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さく、
電界効果トランジスタのソースおよびドレインのうちの一方と、第2電極との間の電位差が第3電圧範囲内に維持された状態で、第2電極を介して光電変換層に入射する光を、光の入射による光電変換層の誘電率の変化に対応した、ソースおよびドレインのうちの他方からの電気信号として検出する、光センサ。
項目14の構成によれば、応答性に優れた光センサを提供することができる。例えば、応答性に優れた赤外線センサを実現し得る。
[項目15]
ソースおよびドレインのうちの一方の電位を基準としたときに第3電圧範囲内にある電圧を第2電極に供給する電圧供給回路を有する、項目14に記載の光センサ。
ソースおよびドレインのうちの一方の電位を基準としたときに第3電圧範囲内にある電圧を第2電極に供給する電圧供給回路を有する、項目14に記載の光センサ。
項目15の構成によれば、光電変換層の主面の間に第3電圧範囲の電位差を与えることが可能である。
[項目16]
半導体基板と、
半導体基板に形成された電界効果トランジスタと、
電界効果トランジスタのゲートに接続された第1電極と、
第1電極に対向する透光性の第2電極と、
第1電極と第2電極との間に配置された光電変換層と、
第1電極と光電変換層との間、および、光電変換層と第2電極との間の少なくとも一方に配置された、少なくとも1つの絶縁層と、を備え、
光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲、および、第1電圧範囲と第2電圧範囲との間の第3電圧範囲において、バイアス電圧に対する出力電流密度の変化率が互いに異なる光電流特性を有し、
第3電圧範囲における変化率は、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さく、
電界効果トランジスタのソースおよびドレインのうちの一方と、第2電極との間の電位差が第1電圧範囲内に維持された状態で、第2電極を介して光電変換層に入射する光を、光の入射による光電変換層の誘電率の変化に対応した、ソースおよびドレインのうちの他方からの電気信号として検出する、光センサ。
半導体基板と、
半導体基板に形成された電界効果トランジスタと、
電界効果トランジスタのゲートに接続された第1電極と、
第1電極に対向する透光性の第2電極と、
第1電極と第2電極との間に配置された光電変換層と、
第1電極と光電変換層との間、および、光電変換層と第2電極との間の少なくとも一方に配置された、少なくとも1つの絶縁層と、を備え、
光電変換層は、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する第1電圧範囲、順方向バイアス電圧の増大に従って出力電流密度が増大する第2電圧範囲、および、第1電圧範囲と第2電圧範囲との間の第3電圧範囲において、バイアス電圧に対する出力電流密度の変化率が互いに異なる光電流特性を有し、
第3電圧範囲における変化率は、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さく、
電界効果トランジスタのソースおよびドレインのうちの一方と、第2電極との間の電位差が第1電圧範囲内に維持された状態で、第2電極を介して光電変換層に入射する光を、光の入射による光電変換層の誘電率の変化に対応した、ソースおよびドレインのうちの他方からの電気信号として検出する、光センサ。
項目16の構成によれば、露光とは異なるタイミングで出力信号を読み出すことが可能な光センサを実現し得る。
[項目17]
ソースおよびドレインのうちの一方の電位を基準としたときに第1電圧範囲内にある電圧を第2電極に供給する電圧供給回路を有する、項目16に記載の光センサ。
ソースおよびドレインのうちの一方の電位を基準としたときに第1電圧範囲内にある電圧を第2電極に供給する電圧供給回路を有する、項目16に記載の光センサ。
項目17の構成によれば、光電変換層の主面の間に第1電圧範囲の電位差を与えることが可能である。
[項目18]
第1電極は、遮光性電極である、項目14から17のいずれかに記載の光センサ。
第1電極は、遮光性電極である、項目14から17のいずれかに記載の光センサ。
項目18の構成によれば、トランジスタのチャネル領域への迷光の入射を抑制することが可能であるので、隣接する単位画素セル間の混色などのノイズの混入を抑制し得る。
[項目19]
電界効果トランジスタのゲートは、半導体基板上に設けられた第1ゲート絶縁層および第1ゲート電極を含み、
第1電極は、第1ゲート電極と第1電極とを接続する接続部を有する、項目14から18のいずれかに記載の光センサ。
電界効果トランジスタのゲートは、半導体基板上に設けられた第1ゲート絶縁層および第1ゲート電極を含み、
第1電極は、第1ゲート電極と第1電極とを接続する接続部を有する、項目14から18のいずれかに記載の光センサ。
項目19の構成によれば、半導体基板と第1電極との間に配置される配線の設計の自由度が向上する。
[項目20]
半導体基板に形成されたアドレストランジスタであって、ソースおよびドレインの一方がソース領域およびドレイン領域のうちの他方に電気的に接続されたアドレストランジスタを有し、
アドレストランジスタのゲートは、第2ゲート電極を含み、
アドレストランジスタの第2ゲート電極は、第1ゲート電極と同層に配置されている、項目19に記載の光センサ。
半導体基板に形成されたアドレストランジスタであって、ソースおよびドレインの一方がソース領域およびドレイン領域のうちの他方に電気的に接続されたアドレストランジスタを有し、
アドレストランジスタのゲートは、第2ゲート電極を含み、
アドレストランジスタの第2ゲート電極は、第1ゲート電極と同層に配置されている、項目19に記載の光センサ。
項目20の構成によれば、電界効果トランジスタにおける第1ゲート電極と、アドレストランジスタにおける第2ゲート電極とを、同一の工程において一括して形成し得る。したがって、フォトリソグラフィーにおけるアライメントマージンを削減することが可能である。
[項目21]
アドレストランジスタのゲートは、第2ゲート絶縁層を含み、
アドレストランジスタの第2ゲート絶縁層は、第1ゲート絶縁層と同層に配置されている、項目20に記載の光センサ。
アドレストランジスタのゲートは、第2ゲート絶縁層を含み、
アドレストランジスタの第2ゲート絶縁層は、第1ゲート絶縁層と同層に配置されている、項目20に記載の光センサ。
項目21の構成によれば、電界効果トランジスタにおけるゲートの構造と、アドレストランジスタにおけるゲートの構造とが共通化されるので、電界効果トランジスタの第1ゲート絶縁層と、アドレストランジスタの第2ゲート絶縁層とを同一の工程において一括して形成し得る。また、電界効果トランジスタの第1ゲート電極と、アドレストランジスタの第2ゲート電極とを同一の工程において一括して形成し得る。したがって、製造コストを低減することが可能である。
[項目22]
半導体基板と、
半導体基板に形成された第1および第2の電界効果トランジスタと、
第1の電界効果トランジスタのゲートに接続された第1電極と、
第1電極に対向する透光性の第2電極と、
第1電極と第2電極との間に配置された光電変換層と、を備え、
第1の電界効果トランジスタのゲートは、第1ゲート電極を含み、
第2の電界効果トランジスタのゲートは、第1ゲート電極と同層に配置された第2ゲート電極を含み、
第2の電界効果トランジスタのソースおよびドレインの一方は、第1の電界効果トランジスタのソースおよびドレインの一方に電気的に接続されており、
第1の電界効果トランジスタは、第2電極を介した光電変換層への光の入射による、光電変換層の誘電率の変化に対応した電気信号をソースおよびドレインのうちの一方から出力する、光センサ。
半導体基板と、
半導体基板に形成された第1および第2の電界効果トランジスタと、
第1の電界効果トランジスタのゲートに接続された第1電極と、
第1電極に対向する透光性の第2電極と、
第1電極と第2電極との間に配置された光電変換層と、を備え、
第1の電界効果トランジスタのゲートは、第1ゲート電極を含み、
第2の電界効果トランジスタのゲートは、第1ゲート電極と同層に配置された第2ゲート電極を含み、
第2の電界効果トランジスタのソースおよびドレインの一方は、第1の電界効果トランジスタのソースおよびドレインの一方に電気的に接続されており、
第1の電界効果トランジスタは、第2電極を介した光電変換層への光の入射による、光電変換層の誘電率の変化に対応した電気信号をソースおよびドレインのうちの一方から出力する、光センサ。
項目22の構成によれば、第1ゲート電極と、第2ゲート電極とを、同一の工程において一括して形成し得る。したがって、フォトリソグラフィーにおけるアライメントマージンを削減することが可能である。
[項目23]
第1の電界効果トランジスタのゲートは、第1ゲート絶縁層を含み、
第2の電界効果トランジスタのゲートは、第1ゲート絶縁層と同層に配置された第2ゲート絶縁層を含む、項目22に記載の光センサ。
第1の電界効果トランジスタのゲートは、第1ゲート絶縁層を含み、
第2の電界効果トランジスタのゲートは、第1ゲート絶縁層と同層に配置された第2ゲート絶縁層を含む、項目22に記載の光センサ。
項目23の構成によれば、第1の電界効果トランジスタにおけるゲートの構造と、第2の電界効果トランジスタにおけるゲートの構造とが共通化されるので、第1ゲート絶縁層と、第2ゲート絶縁層とを同一の工程において一括して形成し得る。また、第1ゲート電極と、第2ゲート電極とを同一の工程において一括して形成し得る。したがって、製造コストを低減することが可能である。
[項目24]
第1電極と光電変換層との間、および、光電変換層と第2電極との間の少なくとも一方に配置された、少なくとも1つの絶縁層を有する、項目22または23に記載の光センサ。
第1電極と光電変換層との間、および、光電変換層と第2電極との間の少なくとも一方に配置された、少なくとも1つの絶縁層を有する、項目22または23に記載の光センサ。
項目24の構成によれば、露光とは異なるタイミングで出力信号を読み出すことが可能な光センサを実現し得る。
[項目25]
それぞれが、第1および第2の電界効果トランジスタならびに第1電極を含む複数の単位画素セルを有し、
第2電極および光電変換層は、複数の単位画素セルにまたがって配置されている、項目22から24のいずれかに記載の光センサ。
それぞれが、第1および第2の電界効果トランジスタならびに第1電極を含む複数の単位画素セルを有し、
第2電極および光電変換層は、複数の単位画素セルにまたがって配置されている、項目22から24のいずれかに記載の光センサ。
項目25の構成によれば、光センサが複数の単位画素セルを含む場合であっても、第1および第2ゲート絶縁層の形成におけるアライメントマージンと、第1および第2ゲート電極の形成におけるアライメントマージンとを削減可能であるので、より微細な画素の微細化に有利である。
以下、図面を参照しながら、本開示の実施形態を詳細に説明する。なお、以下で説明する実施形態は、いずれも包括的または具体的な例を示す。以下の実施形態で示される数値、形状、材料、構成要素、構成要素の配置および接続形態、ステップ、ステップの順序などは、一例であり、本開示を限定する主旨ではない。本明細書において説明される種々の態様は、矛盾が生じない限り互いに組み合わせることが可能である。また、以下の実施形態における構成要素のうち、最上位概念を示す独立請求項に記載されていない構成要素については、任意の構成要素として説明される。以下の説明において、実質的に同じ機能を有する構成要素は共通の参照符号で示し、説明を省略することがある。
(光センサの第1の実施形態)
図1は、本開示の第1の実施形態に係る光検出装置の断面を模式的に示す。図1に示す光検出装置1000は、各々が光センサ100Aを有する複数の単位画素セル10Aを含む。複数の単位画素セル10Aは、例えばマトリクス状に配列されることにより、光センサアレイを形成する。図1は、複数の単位画素セル10Aのうち、光センサアレイの行方向に沿って配置された3つの単位画素セル10Aの断面を模式的に示している。なお、図1は、光検出装置1000を構成する各部の配置をあくまでも模式的に示しており、図1に示す各部の寸法は、必ずしも現実のデバイスにおける寸法を厳密に反映しない。このことは、本開示の他の図面においても同様である。
図1は、本開示の第1の実施形態に係る光検出装置の断面を模式的に示す。図1に示す光検出装置1000は、各々が光センサ100Aを有する複数の単位画素セル10Aを含む。複数の単位画素セル10Aは、例えばマトリクス状に配列されることにより、光センサアレイを形成する。図1は、複数の単位画素セル10Aのうち、光センサアレイの行方向に沿って配置された3つの単位画素セル10Aの断面を模式的に示している。なお、図1は、光検出装置1000を構成する各部の配置をあくまでも模式的に示しており、図1に示す各部の寸法は、必ずしも現実のデバイスにおける寸法を厳密に反映しない。このことは、本開示の他の図面においても同様である。
複数の単位画素セル10Aは、半導体基板20に形成される。ここでは、半導体基板20としてp型シリコン(Si)基板を例示する。単位画素セル10Aの各々は、半導体基板20に形成された素子分離領域20tによって互いに電気的に分離されている。隣接する2つの単位画素セル10A間の距離(画素ピッチ)は、例えば2μm程度であり得る。なお、本明細書における「半導体基板」は、その全体が半導体層である基板に限定されず、光が照射される側の表面に半導体層が設けられた絶縁性基板などであってもよい。
単位画素セル10A中の光センサ100Aは、概略的には、電界効果トランジスタ(FET)に似たデバイス構造を有する。すなわち、光センサ100Aは、半導体基板20内に形成された不純物領域(ここではn型領域)20sおよび20dと、半導体基板20の不純物領域20sと不純物領域20dとで挟まれた領域上に配置されたゲート絶縁層23と、ゲート絶縁層23上に配置された透明ゲート電極22gとを含む。図1に示すように、透明ゲート電極22gは、半導体基板20を覆う層間絶縁層50上に配置される。
図1に例示する構成において、層間絶縁層50は、複数の絶縁層(典型的にはシリコン酸化膜)を含む積層構造を有する。層間絶縁層50中には、多層配線40が配置されている。多層配線40は、複数の配線層を含む。図1に例示する構成では、多層配線40は、3つの配線層を含んでおり、中央の配線層に、電源配線42、アドレス信号線44および垂直信号線46が設けられている。電源配線42、アドレス信号線44および垂直信号線46は、例えば、紙面に垂直な方向(光センサアレイにおける列方向)に沿って延びている。図1に示す例では、層間絶縁層50および多層配線40は、それぞれ、4層の絶縁層および3層の配線層を含む。しかしながら、層間絶縁層50中の絶縁層の層数および多層配線40中の配線層の層数は、この例に限定されない。
図1に例示する構成において、多層配線40の電源配線42は、コンタクトプラグ52を介して不純物領域20dに接続されている。後述するように、電源配線42には、所定の電圧を供給する電源が接続される。光検出装置1000の動作時、不純物領域20dには、電源配線42を介して所定のバイアス電圧(第1のバイアス電圧)が印加される。
ゲート絶縁層23は、層間絶縁層50を貫通して半導体基板20の上面と透明ゲート電極22gの下面とを結んでいる。なお、本明細書における「上面」および「下面」の用語は、部材間の相対的な配置を示すために用いられており、本開示の光検出装置の姿勢を限定する意図ではない。
ゲート絶縁層23は、光電変換層23pを含む。光電変換層23pの厚さ(半導体基板20の法線方向に沿って測った長さ)は、例えば1500nm程度である。光電変換層23pの構成の典型例の詳細は、後述する。図1に例示する構成では、光電変換層23pと半導体基板20との間に、絶縁層23xが配置されている。絶縁層23xは半導体基板20に接していてもよい。
図1に示す例では、層間絶縁層50上の透明ゲート電極22gは、複数の単位画素セル10Aにわたって形成されている。透明ゲート電極22gは、不図示の電源との接続を有する。透明ゲート電極22gは、半導体基板20の不純物領域20dと同様に、光検出装置1000の動作時に所定のバイアス電圧(第2のバイアス電圧)を印加可能に構成されている。
光検出装置1000の動作時、透明ゲート電極22gと不純物領域20dとにそれぞれ所定の電圧が印加されることにより、透明ゲート電極22gと不純物領域20dとの間の電位差が一定に維持される。動作時において透明ゲート電極22gと不純物領域20dとの間の電位差を一定に維持することが可能であれば、透明ゲート電極22gは、複数の単位画素セル10Aにわたって形成されていなくてもよい。例えば、単位画素セル10Aごとに分離して透明ゲート電極22gが形成されていても構わない。
後に詳しく説明するように、光の検出動作においては、透明ゲート電極22gと不純物領域20dとの間の電位差が一定に維持された状態で、光センサ100Aの透明ゲート電極22g側(図1における上側)から、光が光検出装置1000に照射される。光検出装置1000に照射された光は、透明ゲート電極22gを介してゲート絶縁層23の光電変換層23pに入射する。光電変換層23pは、光が照射されることによって電子−正孔対を発生させる。光電変換層23p中に電子−正孔対が発生することにより、光電変換層23pの誘電率が変化する。光センサ100Aを電界効果トランジスタとみなすと、光電変換層23pにおける誘電率が変化することにより、このトランジスタにおけるゲート容量が変化したときと同様の効果が生じる。すなわち、ゲート絶縁層23への光の照射により、不純物領域20sおよび20dの間に流れる電流の大きさが変化する。この電流の変化を利用することにより、光を検出することが可能である。
このような動作原理から、光センサ100Aを容量変調トランジスタと呼んでもよい。不純物領域20sおよび20dは、それぞれ、容量変調トランジスタの例えばソース領域およびドレイン領域に相当する。以下では、不純物領域20sを光センサのソース領域(またはドレイン領域)と呼ぶことがあり、不純物領域20dを光センサのドレイン領域(またはソース領域)と呼ぶことがある。また、以下では、簡単のため、不純物領域20sおよび20dの間に流れる電流を、単にドレイン電流と呼ぶことがある。
図1に示す例では、透明ゲート電極22g上に、赤外線を選択的に透過する赤外線透過フィルタ26が配置されている。つまり、図1は、光検出装置1000を赤外線検出装置として利用する場合の構成を例示している。このように、光検出装置1000によって検出される光は、可視光の波長範囲(例えば、380nm以上780nm以下)内の光に限定されない。なお、本明細書では、赤外線および紫外線を含めた電磁波全般を、便宜上「光」と表現する。本明細書における「透明」は、検出しようとする波長範囲の光の少なくとも一部を透過することを意味し、可視光の波長範囲全体にわたって光を透過することは必須ではない。
光検出装置1000を赤外線検出装置として利用する場合、透明ゲート電極22gの材料として、近赤外線に対する透過率が高く、抵抗値が小さい透明導電性酸化物(Transparent Conducting Oxide(TCO))が用いられる。TCOとして、例えば、ITO、IZO、AZO、FTO、SnO2、TiO2、ZnO2などを用いることができる。透明ゲート電極22gとして、Auなどの金属薄膜を用いてもよい。図1に示すように、照射された光を集光して光電変換層23pに入射させるマイクロレンズ28を赤外線透過フィルタ26上に配置してもよい。マイクロレンズ28と透明ゲート電極22gとの間に保護層を配置してもよい。
図1に例示する構成において、単位画素セル10Aの各々は、アドレストランジスタ30を有する。アドレストランジスタ30は、半導体基板20内に形成された不純物領域20sおよび不純物領域30sと、ゲート絶縁層33と、ゲート電極34とを含む。ゲート絶縁層33は、例えば、シリコンの熱酸化膜(二酸化シリコン膜)である。ゲート電極34は、例えば、ポリシリコン電極である。この例では、アドレストランジスタ30と光センサ100Aとは、不純物領域20sを共有しており、不純物領域20sを共有することによってこれらが電気的に接続されている。
アドレストランジスタ30における不純物領域20sは、例えば、アドレストランジスタ30のドレイン領域として機能する。アドレストランジスタ30における不純物領域30sは、例えば、アドレストランジスタ30のソース領域として機能する。アドレストランジスタ30のゲート電極34(典型的にはポリシリコン電極)は、コンタクトプラグ52を介して、多層配線40のアドレス信号線44に接続されている。アドレストランジスタ30の不純物領域30sは、コンタクトプラグ52を介して、多層配線40の垂直信号線46に接続されている。したがって、アドレス信号線44を介してゲート電極34の電位を制御し、アドレストランジスタ30をオン状態とすることにより、光センサ100Aによって生成される信号を、垂直信号線46を介して選択的に読み出すことができる。
垂直信号線46などをその一部に含む上述の多層配線40は、例えば銅などの金属によって形成される。多層配線40中の配線層により、遮光膜を形成してもよい。層間絶縁層50内に配置された配線層を遮光膜として機能させることにより、透明ゲート電極22gを透過した光のうち、光電変換層23pに入射しなかった光を、遮光性の配線層によって遮ることが可能である。これにより、光電変換層23pに入射しなかった光(ここでは赤外線)が、半導体基板20に形成されたトランジスタ(容量変調トランジスタまたはアドレストランジスタ30)のチャネル領域に入射することを抑制し得る。ゲート絶縁層23xおよび/またはゲート絶縁層33が遮光性を有していてもよい。チャネル領域への迷光の入射を抑制することにより、隣接する単位画素セル間における混色など、ノイズの混入を抑制し得る。なお、透明ゲート電極22gを透過した光のうち、光電変換層23pに向かって進行する光のほとんどは、光電変換層23pによって吸収される。そのため、光電変換層23pに向かって進行する光は、半導体基板20に形成されたトランジスタの動作に悪影響を及ぼさない。
(光検出装置の例示的な回路構成)
図2は、光検出装置1000の例示的な回路構成を示す。上述したように、光センサ100Aは、電界効果トランジスタに似たデバイス構造を有している。そのため、ここでは、トランジスタと同様の回路記号を用いて便宜的に光センサ100Aを表現する。
図2は、光検出装置1000の例示的な回路構成を示す。上述したように、光センサ100Aは、電界効果トランジスタに似たデバイス構造を有している。そのため、ここでは、トランジスタと同様の回路記号を用いて便宜的に光センサ100Aを表現する。
図2は、単位画素セル10Aが2行2列のマトリクス状に配置された例を模式的に示している。本明細書では、行および列が延びる方向を、それぞれ、行方向および列方向と呼ぶことがある。言うまでもないが、光検出装置1000における単位画素セルの数および配置は、図2に示す例に限定されない。単位画素セルは、1次元に配列されていてもよい。この場合、光検出装置1000は、ラインセンサである。光検出装置1000に含まれる単位画素セルの数は、2以上であってもよいし、1つであってもよい。
既に説明したように、各単位画素セル10Aの光センサ100Aにおける不純物領域20d(容量変調トランジスタのドレインといってもよい)は、電源配線42に接続されている。図2に示す例では、電源配線42が、光センサアレイの列ごとに配置されている。これらの電源配線42は、電圧供給回路12に接続されている。光検出装置1000の動作時、電圧供給回路12は、電源配線42を介して、光センサアレイを構成する単位画素セル10Aの各々に所定の電圧(第1のバイアス電圧)を供給する。
各単位画素セル10Aの光センサ100Aにおける透明ゲート電極22gは、ゲート電圧制御線48に接続されている。図2に例示する構成において、ゲート電圧制御線48は、電圧供給回路12に接続されている。したがって、光検出装置1000の動作時、光センサアレイにおける各光センサ100Aの透明ゲート電極22gには、ゲート電圧制御線48を介して、電圧供給回路12から所定のゲート電圧(第2のバイアス電圧)が印加される。電圧供給回路12は、特定の電源回路に限定されず、所定の電圧を生成する回路であってもよいし、他の電源から供給された電圧を所定の電圧に変換する回路であってもよい。後述するように、各光センサ100Aの透明ゲート電極22gには、光センサ100Aにおける不純物領域20dの電位を基準としたときに所定の範囲内にあるゲート電圧が印加される。
図2に例示する構成において、アドレストランジスタ30のゲートとの接続を有するアドレス信号線44は、垂直走査回路(「行走査回路」とも呼ばれる)14に接続されている。垂直走査回路14は、アドレス信号線44に所定の電圧を印加することにより、各行に配置された複数の単位画素セル10Aを行単位で選択する。これにより、アドレストランジスタ30を介して、選択された単位画素セル10Aの信号を読み出すことができる。
図示するように、アドレストランジスタ30のソースおよびドレインの一方(典型的にはドレイン)は、光センサ100Aにおける不純物領域20s(容量変調トランジスタのソースといってもよい)に接続されており、アドレストランジスタ30のソースおよびドレインの他方(ここではソース)は、光センサアレイの列ごとに設けられた垂直信号線46に接続されている。垂直信号線46は、光センサアレイからの画素信号を周辺回路へ伝達する主信号線である。
この例では、垂直信号線46と接地との間に定電流源49が接続されている。したがって、垂直信号線46の電圧の変化を検出することにより、光センサ100Aに光が照射されることに起因する、光センサ100Aにおけるドレイン電流の変化を検出することができる。すなわち、垂直信号線46の電圧の変化に基づいて、光を検出することができる。このとき、電源配線42は、ソースフォロア電源として機能する。光センサ100Aの不純物領域20sから出力される電流を検出することによって光を検出してもよい。ただし、電圧の変化を検出する方が、シリコンのフォトダイオードを用いた光センサと同様のプロセスおよび回路を適用でき、高いS/N比を得る観点からも有利である。
なお、光センサ100Aにおける不純物領域20dに所定の電圧を供給する回路と、透明ゲート電極22gに所定の電圧を供給する回路とは、図2に例示するように共通であってもよいし、異なっていてもよい。光センサ100Aにおける不純物領域20dに所定の電圧を供給する回路および透明ゲート電極22gに所定の電圧を供給する回路の少なくとも一方が、垂直走査回路14の一部であってもよい。
(光電変換層)
次に、光電変換層23pの構成の典型例を詳細に説明する。
次に、光電変換層23pの構成の典型例を詳細に説明する。
光電変換層23pを構成する材料としては、典型的には、半導体材料が用いられる。光電変換層23pは、光の照射を受けて内部に電子−正孔対を生成する。ここでは、光電変換層23pを構成する材料として有機半導体材料を用いる。光電変換層23pは、例えば、下記一般式(1)で表されるスズナフタロシアニン(以下、単に「スズナフタロシアニン」と呼ぶことがある)を含む。
一般式(1)中、R1〜R24は、独立して、水素原子または置換基を表す。置換基は、特定の置換基に限定されない。置換基は、重水素原子、ハロゲン原子、アルキル基(シクロアルキル基、ビシクロアルキル基、トリシクロアルキル基を含む)、アルケニル基(シクロアルケニル基、ビシクロアルケニル基を含む)、アルキニル基、アリール基、複素環基(ヘテロ環基といってもよい)、シアノ基、ヒドロキシ基、ニトロ基、カルボキシ基、アルコキシ基、アリールオキシ基、シリルオキシ基、ヘテロ環オキシ基、アシルオキシ基、カルバモイルオキシ基、アルコキシカルボニルオキシ基、アリールオキシカルボニルオキシ基、アミノ基(アニリノ基を含む)、アンモニオ基、アシルアミノ基、アミノカルボニルアミノ基、アルコキシカルボニルアミノ基、アリールオキシカルボニルアミノ基、スルファモイルアミノ基、アルキルスルホニルアミノ基、アリールスルホニルアミノ基、メルカプト基、アルキルチオ基、アリールチオ基、ヘテロ環チオ基、スルファモイル基、スルホ基、アルキルスルフィニル基、アリールスルフィニル基、アルキルスルホニル基、アリールスルホニル基、アシル基、アリールオキシカルボニル基、アルコキシカルボニル基、カルバモイル基、アリールアゾ基、ヘテロ環アゾ基、イミド基、ホスフィノ基、ホスフィニル基、ホスフィニルオキシ基、ホスフィニルアミノ基、ホスホノ基、シリル基、ヒドラジノ基、ウレイド基、ボロン酸基(−B(OH)2)、ホスファト基(−OPO(OH)2)、スルファト基(−OSO3H)、または、その他の公知の置換基であり得る。
上述の一般式(1)で表されるスズナフタロシアニンとしては、市販されている製品を用いることができる。あるいは、上述の一般式(1)で表されるスズナフタロシアニは、例えば特開2010−232410号公報に示されているように、下記の一般式(2)で表されるナフタレン誘導体を出発原料として合成することができる。一般式(2)中のR25〜R30は、一般式(1)におけるR1〜R24と同様の置換基であり得る。
上述の一般式(1)で表されるスズナフタロシアニンにおいて、分子の凝集状態の制御のし易さの観点から、R1〜R24のうち、8個以上が水素原子または重水素原子であると有益であり、R1〜R24のうち、16個以上が水素原子または重水素原子であるとより有益であり、全てが水素原子または重水素原子であるとさらに有益である。さらに、以下の式(3)で表されるスズナフタロシアニンは、合成の容易さの観点で有利である。
上述の一般式(1)で表されるスズナフタロシアニンは、概ね200nm以上1100nm以下の波長帯域に吸収を有する。例えば、上述の式(3)で表されるスズナフタロシアニンは、図3に示すように、波長が概ね870nmの位置に吸収ピークを有する。図3は、上述の式(3)で表されるスズナフタロシアニンを含む光電変換層における吸収スペクトルの一例である。なお、吸収スペクトルの測定においては、石英基板上に光電変換層(厚さ:30nm)が積層されたサンプルを用いている。
図3からわかるように、スズナフタロシアニンを含む材料から形成された光電変換層は、近赤外領域に吸収を有する。すなわち、光電変換層23pを構成する材料として、スズナフタロシアニンを含む材料を選択することにより、近赤外線を検出可能な光センサを実現し得る。
図4は、上述の一般式(1)で表されるスズナフタロシアニンを含む有機半導体材料を用いて形成した光電変換層を有するゲート絶縁層の一例を示す。図4に例示する構成において、ゲート絶縁層23は、光電変換構造230Aを含み、光電変換構造230Aおよび透明ゲート電極22gの間に配置された電子ブロッキング層234と、光電変換構造230Aおよび絶縁層23xとの間に配置された正孔ブロッキング層236とをさらに含んでいる。
光電変換構造230Aは、p型半導体およびn型半導体の少なくとも一方を含む。図4に例示する構成では、光電変換構造230Aは、p型半導体層230pと、n型半導体層230nと、p型半導体層230pおよびn型半導体層230nの間に挟まれた光電変換層230hとを有する。p型半導体層230pは、電子ブロッキング層234と光電変換層230hとの間に配置されており、光電変換層および/または正孔輸送層としての機能を有する。n型半導体層230nは、正孔ブロッキング層236と光電変換層230hとの間に配置されており、光電変換層および/または電子輸送層としての機能を有する。後述するように、光電変換層230hがp型半導体およびn型半導体の少なくとも一方を含んでいてもよい。
p型半導体層230pおよびn型半導体層230nは、それぞれ、有機p型半導体および有機n型半導体を含む。すなわち、光電変換構造230Aは、上述の一般式(1)で表されるスズナフタロシアニンを含む有機光電変換材料と、有機p型半導体および有機n型半導体の少なくとも一方とを含む。
有機p型半導体(化合物)は、ドナー性有機半導体(化合物)であり、主に正孔輸送性有機化合物に代表され、電子を供与しやすい性質がある有機化合物をいう。さらに詳しくは、有機p型半導体(化合物)は、2つの有機材料を接触させて用いたときにイオン化ポテンシャルの小さい方の有機化合物をいう。したがって、ドナー性有機化合物としては、電子供与性のある有機化合物であればいずれの有機化合物も使用可能である。例えば、トリアリールアミン化合物、ベンジジン化合物、ピラゾリン化合物、スチリルアミン化合物、ヒドラゾン化合物、トリフェニルメタン化合物、カルバゾール化合物、ポリシラン化合物、チオフェン化合物、フタロシアニン化合物、シアニン化合物、メロシアニン化合物、オキソノール化合物、ポリアミン化合物、インドール化合物、ピロール化合物、ピラゾール化合物、ポリアリーレン化合物、縮合芳香族炭素環化合物(ナフタレン誘導体、アントラセン誘導体、フェナントレン誘導体、テトラセン誘導体、ピレン誘導体、ペリレン誘導体、フルオランテン誘導体)、含窒素ヘテロ環化合物を配位子として有する金属錯体などを用いることができる。なお、ドナー性有機半導体は、これらに限らず、上述したように、n型(アクセプター性)化合物として用いた有機化合物よりもイオン化ポテンシャルの小さい有機化合物であればドナー性有機半導体として用い得る。上述のスズナフタロシアニンは、有機p型半導体材料の一例である。
有機n型半導体(化合物)は、アクセプター性有機半導体(化合物)であり、主に電子輸送性有機化合物に代表され、電子を受容しやすい性質がある有機化合物をいう。さらに詳しくは、有機n型半導体(化合物)は、2つの有機化合物を接触させて用いたときに電子親和力の大きい方の有機化合物をいう。したがって、アクセプター性有機化合物としては、電子受容性のある有機化合物であればいずれの有機化合物も使用可能である。例えば、フラーレン、フラーレン誘導体、縮合芳香族炭素環化合物(ナフタレン誘導体、アントラセン誘導体、フェナントレン誘導体、テトラセン誘導体、ピレン誘導体、ペリレン誘導体、フルオランテン誘導体)、窒素原子、酸素原子、硫黄原子を含有する5ないし7員のヘテロ環化合物(例えばピリジン、ピラジン、ピリミジン、ピリダジン、トリアジン、キノリン、キノキサリン、キナゾリン、フタラジン、シンノリン、イソキノリン、プテリジン、アクリジン、フェナジン、フェナントロリン、テトラゾール、ピラゾール、イミダゾール、チアゾール、オキサゾール、インダゾール、ベンズイミダゾール、ベンゾトリアゾール、ベンゾオキサゾール、ベンゾチアゾール、カルバゾール、プリン、トリアゾロピリダジン、トリアゾロピリミジン、テトラザインデン、オキサジアゾール、イミダゾピリジン、ピラリジン、ピロロピリジン、チアジアゾロピリジン、ジベンズアゼピン、トリベンズアゼピンなど)、ポリアリーレン化合物、フルオレン化合物、シクロペンタジエン化合物、シリル化合物、含窒素ヘテロ環化合物を配位子として有する金属錯体などを用いることができる。なお、これらに限らず、上述したように、p型(ドナー性)有機化合物として用いた有機化合物よりも電子親和力の大きな有機化合物であればアクセプター性有機半導体として用い得る。
光電変換層230hは、例えば、p型半導体およびn型半導体を含むバルクヘテロ接合構造層であり得る。バルクへテロ接合構造を有する層として光電変換層230hを形成する場合、上述の一般式(1)で表されるスズナフタロシアニンをp型半導体材料として用い得る。n型半導体材料としては、例えば、フラーレンおよび/またはフラーレン誘導体を用いることができる。p型半導体層230pを構成する材料が、光電変換層230hに含まれるp型半導体材料と同じであると有益である。同様に、n型半導体層230nを構成する材料が、光電変換層230hに含まれるn型半導体材料と同じであると有益である。バルクへテロ接合構造は、特許第5553727号公報において詳細に説明されている。参考のため、特許第5553727号公報の開示内容の全てを本明細書に援用する。
検出を行いたい波長域に応じて適切な材料を用いることにより、所望の波長域に感度を有する光センサを実現し得る。光電変換層23pは、アモルファスシリコンなどの無機半導体材料を含んでいてもよい。光電変換層23pは、有機材料から構成される層と無機材料から構成される層とを含んでいてもよい。ここでは、スズナフタロシアニンとC60とを共蒸着することによって得られたバルクヘテロ接合構造を光電変換層23pに適用した例を説明する。
(光電変換層における光電流特性)
図5は、光電変換層23pにおける光電流特性の典型例を示す。図5中、太い実線のグラフは、光が照射された状態における、光電変換層の例示的な電流−電圧特性(I−V特性)を示している。なお、図5には、光が照射されていない状態におけるI−V特性の一例も、太い破線によってあわせて示されている。
図5は、光電変換層23pにおける光電流特性の典型例を示す。図5中、太い実線のグラフは、光が照射された状態における、光電変換層の例示的な電流−電圧特性(I−V特性)を示している。なお、図5には、光が照射されていない状態におけるI−V特性の一例も、太い破線によってあわせて示されている。
図5は、一定の照度のもとで、光電変換層の2つの主面の間に印加するバイアス電圧を変化させたときの主面間の電流密度の変化を示している。本明細書において、バイアス電圧における順方向および逆方向は、以下のように定義される。光電変換層が、層状のp型半導体および層状のn型半導体の接合構造を有する場合には、n型半導体の層よりもp型半導体の層の電位が高くなるようなバイアス電圧を順方向のバイアス電圧と定義する。他方、n型半導体の層よりもp型半導体の層の電位が低くなるようなバイアス電圧を逆方向のバイアス電圧と定義する。有機半導体材料を用いた場合も、無機半導体材料を用いた場合と同様に、順方向および逆方向を定義することができる。光電変換層がバルクヘテロ接合構造を有する場合、上述の特許第5553727号公報の図1に模式的に示されるように、光電変換層の2つの主面のうちの一方の表面には、n型半導体よりもp型半導体が多く現れ、他方の表面には、p型半導体よりもn型半導体が多く現れる。したがって、n型半導体よりもp型半導体が多く現れた主面側の電位が、p型半導体よりもn型半導体が多く現れた主面側の電位よりも高くなるようなバイアス電圧を順方向のバイアス電圧と定義する。
図5に示すように、本開示の実施形態による光電変換層の光電流特性は、概略的には、第1〜第3の3つの電圧範囲によって特徴づけられる。第1電圧範囲は、逆バイアスの電圧範囲であって、逆方向バイアス電圧の増大に従って出力電流密度の絶対値が増大する電圧範囲である。第1電圧範囲は、光電変換層の主面間に印加されるバイアス電圧の増大に従って光電流が増大する電圧範囲といってもよい。第2電圧範囲は、順バイアスの電圧範囲であって、順方向バイアス電圧の増大に従って出力電流密度が増大する電圧範囲である。つまり、第2電圧範囲は、光電変換層の主面間に印加されるバイアス電圧の増大に従って順方向電流が増大する電圧範囲である。第3電圧範囲は、第1電圧範囲と第2電圧範囲の間の電圧範囲である。
第1〜第3の電圧範囲は、リニアな縦軸および横軸を用いたときにおける光電流特性のグラフの傾きによって区別され得る。参考のため、図5では、第1電圧範囲および第2電圧範囲のそれぞれにおけるグラフの平均的な傾きを、それぞれ、破線L1および破線L2によって示している。図5に例示されるように、第1電圧範囲、第2電圧範囲および第3電圧範囲における、バイアス電圧の増加に対する出力電流密度の変化率は、互いに異なっている。第3電圧範囲は、バイアス電圧に対する出力電流密度の変化率が、第1電圧範囲における変化率および第2電圧範囲における変化率よりも小さい電圧範囲として定義される。あるいは、I−V特性を示すグラフにおける立ち上がり(立ち下り)の位置に基づいて、第3電圧範囲が決定されてもよい。第3電圧範囲は、典型的には、−1Vよりも大きく、かつ、+1Vよりも小さい。第3電圧範囲では、バイアス電圧を変化させても、光電変換層の主面間の電流密度は、ほとんど変化しない。図5に例示されるように、第3電圧範囲では、電流密度の絶対値は、典型的には100μA/cm2以下である。後に詳しく述べるように、この第3電圧範囲では、光の照射によって生じた正孔−電子対は、光の照射をやめれば速やかに再結合して消滅する。そのため、光検出装置の動作時に光電変換層の2つの主面の間に印加するバイアス電圧を第3電圧範囲の電圧に調整することによって、高速な応答を実現することが可能となる。
再び図1および図2を参照する。本開示の典型的な実施形態では、光検出装置の動作時、光センサが有する2つの不純物領域のうち電源配線42に接続された側と、透明ゲート電極22gとの間の電位差が、上述の第3電圧範囲に維持された状態で、光の検出が実行される。例えば、図2を参照して説明した構成では、不純物領域20dを基準としたときに第3電圧範囲内にあるゲート電圧が、電圧供給回路12から透明ゲート電極22gに供給される。したがって、光の検出動作においては、光電変換層23pは、上面(透明ゲート電極22g側の主面)と下面との間に、第3電圧範囲のバイアス電圧が印加された状態にある。
光電変換層23pに光が入射すると、光電変換層23pの内部に正孔−電子対が発生する。このとき、光電変換層23pに所定のバイアス電圧が印加されているので、複数の正孔−電子対の各々における双極子モーメントは、ほぼ同じ方向に揃う。そのため、正孔−電子対に伴って光電変換層23pの誘電率が増大する。所定のバイアス電圧が印加され、光が照射された状態にある光電変換層23p内の電場の大きさをEとすれば、ガウスの法則により、E=((σf−σp)/ε0)およびE=(σf/ε)が成り立つ。ここで、σfは、電極(例えば透明ゲート電極22g)における電荷密度であり、σpは、分極により、光電変換層23pにおいて電極に対向する表面に生じた電荷の密度である。ε0およびεは、それぞれ、真空の誘電率および光電変換層23pの誘電率である。E=((σf−σp)/ε0)およびE=(σf/ε)から、ε=ε0(σf/(σf−σp))が得られ、分極に寄与する電荷(正孔−電子対)の増加により光電変換層23pの誘電率が増大することがわかる。つまり、光電変換層23pへの光の照射により、ゲート絶縁層23全体の誘電率が増大する。
光センサ100Aをトランジスタとみなせば、ゲート絶縁層23の誘電率の増大に伴い、しきい値電圧が低下する(実効的なゲート電圧が増大するといってもよい)。これにより、不純物領域20dおよび20sの間に流れるドレイン電流の大きさがゲート絶縁層23の誘電率の変化に伴って変化する。すなわち、光センサ100Aにおけるドレイン電流の大きさは、光センサ100Aへの照度の変化に応じた変化を示す。したがって、ドレイン電流の大きさの変化を適当な検出回路によって検出することにより、光を検出することが可能である。
例えば、図2に示すように垂直信号線46に定電流源49を接続し、アドレストランジスタ30をオンとすれば、垂直信号線46における電圧の変化の形で、光センサ100Aへの照度の変化に応じたしきい値電圧の変化を検出することができる。あるいは、垂直信号線46に定電圧源を接続して、垂直信号線46における電流の変化を検出してもよい。このように、光センサ100Aからの出力信号は、電圧の変化の形であってもよいし、電流の変化の形であってもよい。
ここで注目すべき点は、光の検出時に、光電変換層23pに第3電圧範囲のバイアス電圧を印加している点である。フォトダイオード(または光電変換膜)を利用した従来の光センサでは、一般に、図5に示す第1電圧範囲に対応する、逆バイアスのもとで光検出の動作が実行される。そのため、光電変換によって生じた正孔および電子は、それぞれ、フォトダイオードのカソードおよびアノードに向かって移動する。フォトダイオード(または光電変換膜)を利用した、従来の光センサの光検出においては、光電変換によって生じた電荷が、信号として外部回路に取り出される。
これに対し、本開示の光検出装置の典型例では、光の検出時、光電変換層23pには、第3電圧範囲のバイアス電圧が印加される。第3電圧範囲のバイアス電圧が印加された状態で光電変換層23pに光が照射されると、光電変換層23pに正孔−電子対が生成される。ただし、第3電圧範囲のバイアス電圧が印加された状態においては、生成された正孔および電子は、分離して電極に移動することなく、双極子を形成する。すなわち、生成された正孔および電子自体が光電変換層23pの外部に取り出されることはない。
光電変換層からの電荷の排出および光電変換層への電荷の流入は、その速度が遅い(数十ミリ秒程度)。そのため、光センサをイメージセンサに適用する場合、光電変換層からの電荷の排出または光電変換層への電荷の流入を伴う構成では、撮像開始時の光電変換層への電圧の印加、光照射などに伴ってノイズ、残像などが発生するおそれがある。光の検出時に光電変換層23pに印加するバイアス電圧を第3電圧範囲の電圧とする構成では、このような光電変換層からの電荷の排出または光電変換層への電荷の流入を伴わないので、ノイズ、残像などの発生を抑制し得る。
また、第3電圧範囲のバイアス電圧が印加された状態においては、光電変換層23pに光が入射しなくなると、正孔−電子対は、速やか(数十マイクロ秒以下)に再結合して消滅する。したがって、本開示の実施形態によれば、高速な応答を実現することが可能である。高速な応答を実現し得るので、本開示の実施形態による光センサは、飛行時間法(Time-of-flight method)を利用した距離計測、超高速撮影などへの適用に有利である。電源配線42を介して不純物領域20dに印加される第1のバイアス電圧は、例えば2.4Vであり、ゲート電圧制御線48を介して透明ゲート電極22gに印加される第2のバイアス電圧は、例えば2.5Vである。つまり、ここで説明する例では、光センサ100Aのゲート絶縁層23の上面および下面の間に、およそ0.1Vの電位差が与えられるように設定されている。なお、後述するように、光電変換層に第1電圧範囲のバイアス電圧を印加して光の検出を実行することも可能である。
(赤外線の検出)
赤外領域に吸収を有する光電変換材料は、バンドギャップが狭い。また、暗電流の原因となる、熱励起に起因する電流における活性化エネルギーは、バンドギャップに比例する。そのため、容量変調トランジスタのゲート絶縁層の材料として、赤外領域に吸収を有する光電変換材料を用いると、ゲートリークが発生し、十分なS/N比を確保できない可能性がある。0.1Vのバイアス電圧のもとでの有機光電変換層単体におけるリーク電流の大きさは、1×10-8A/cm2程度であり得る(「×」は乗算を表す)。
赤外領域に吸収を有する光電変換材料は、バンドギャップが狭い。また、暗電流の原因となる、熱励起に起因する電流における活性化エネルギーは、バンドギャップに比例する。そのため、容量変調トランジスタのゲート絶縁層の材料として、赤外領域に吸収を有する光電変換材料を用いると、ゲートリークが発生し、十分なS/N比を確保できない可能性がある。0.1Vのバイアス電圧のもとでの有機光電変換層単体におけるリーク電流の大きさは、1×10-8A/cm2程度であり得る(「×」は乗算を表す)。
ここで説明する例では、光電変換層23pとして、近赤外領域に吸収を有する光電変換層を用いている。図1に例示する構成では、光電変換層23pと半導体基板20の間に、絶縁層23xが配置されている。光電変換層23pと半導体基板20の間に絶縁層23xを配置することにより、光電変換層23pにおけるリーク電流を低減して、必要なS/N比を確保し得る。
絶縁層23xとしては、例えば、シリコンの熱酸化膜を適用し得る。図6は、0.1Vの電圧を印加したときの、シリコン熱酸化膜に流れるリーク電流の膜厚依存性を示す。本開示の実施形態の光検出方式において、光の非照射時における特性を確保する観点からは、ゲート絶縁層23におけるリーク電流が1×10-11A/cm2以下であることが有益である。このリーク電流の大きさは、半導体基板20の法線方向からゲート絶縁層23を見たときの面積(ゲート面積)を1μm2としたときの1e/s以下のリーク量に相当する(リーク量の単位における「e」は、電子数を意味する)。図6に示すように、絶縁層23xとしてシリコン熱酸化膜を適用する場合、熱酸化膜の厚さを4.6nm以上とすれば、必要な程度にまでリーク電流を低減し得ることがわかる。
上述の第3電圧範囲を利用する場合、光の検出時に光電変換層23pの上面と下面との間に印加される電圧は、例えば0.1V程度と比較的小さい。そのため、光電変換層23pの材料として、狭バンドギャップの材料を用いやすい。また、光電変換層23pと半導体基板20との間に絶縁層23xを配置することにより、容量変調トランジスタのチャネル領域へのリーク電流を低減し得る。第3電圧範囲を利用する場合、不純物領域20dと透明ゲート電極22gとの間に与えられる電位差は、比較的小さい。そのため、絶縁層23xとして比較的薄い絶縁膜を用いることができ、照度に関する情報をドレイン電流の変調の形で取得することが可能である。
このように、本開示の実施形態によれば、赤外領域に吸収を有する狭バンドギャップの光電変換材料を用いながらも、暗電流を抑制して高いS/N比を確保することが可能である。言うまでもないが、絶縁層23xを構成する材料は、二酸化シリコンに限定されない。絶縁層23xとして、シリコン半導体において一般的に用いられるシリコン酸窒化膜(SiON膜)を適用してもよいし、HfO2膜などのHigh−k膜を適用してもよい。絶縁層23xの厚さは、絶縁層23xを構成する材料に応じて適宜設定されればよい。
近赤外線を利用したイメージングは、例えば車両に搭載されて使用されるナイトビジョンシステムの用途、生体観察の用途などに有望であり、赤外領域に感度を有する光センサが望まれている。よく知られているように、シリコンのバンドギャップは1.1eVであり、シリコンのフォトダイオードを用いた光センサでは、1100nm以上の波長を有する光を検出できない。シリコンのフォトダイオードは、900nmあたりの波長域における感度を有するものの、可視光の波長範囲と比較するとその感度は低く、特にナイトビジョンシステムへの適用において性能の向上が望まれている。
狭バンドギャップを有する半導体としては、InxGa1-xAsが知られている。InxGa1-xAsは、組成比Xを調整することにより、バンドギャップを0.3eVまで狭めることが可能である。InxGa1-xAsを用いた光センサでは、最大で3μmの波長に感度を持たせることができ、InxGa1-xAsを用いた光センサを赤外線センサとして用いることが可能である。しかしながら、結晶欠陥による暗電流、狭バンドギャップに起因する熱ノイズによるS/N比の劣化を抑制するために、イメージセンサを冷却する必要がある。そのため、小型化および低コスト化が困難であり、民生用として広く普及するには至っていない。冷却装置を使わない赤外線イメージセンサとしては、マイクロボロメータおよび焦電センサが知られている。しかしながら、マイクロボロメータおよび焦電センサは、ともに熱を介した検出であるので、応答速度が数十m秒と遅く、用途が限定されてしまう。
本開示の実施形態によれば、光電変換層23pとして、赤外領域に吸収を有する材料を用いることが比較的容易である。例えば、上述の式(3)で表されるスズナフタロシアニンを含む光電変換層は、図3に示すように、800nm〜1000nmの波長域に吸収のピークを有している。式(3)で表されるスズナフタロシアニンを含む光電変換層の、波長900nmにおける量子効率は、シリコンの10倍程度であり得る。本開示の実施形態によれば、赤外領域に感度を有する光センサを比較的簡易な構成で実現し得る。本開示の実施形態による光センサにおける検出は、熱を介した検出ではないので、チャネル部分の温度変化による熱ノイズの発生を回避でき、冷却機構を設ける必要もない。
光検出装置1000は、一般的な半導体製造プロセスを用いて製造することができる。特に、半導体基板20としてシリコン基板を用いる場合には、種々のシリコン半導体プロセスを利用することによって光検出装置1000を製造することができる。本開示の光センサは、電界効果トランジスタに似たデバイス構造を有するので、他のトランジスタと本開示の光センサとを同一の半導体基板に形成することも比較的容易である。
(光センサの第2の実施形態)
図7は、本開示の第2の実施形態に係る光検出装置の断面を模式的に示す。第2の実施形態において、光検出装置1000は、各々が光センサ100Bを有する複数の単位画素セル10Bを含む。図7では、図面が複雑となることを避けるため、複数の単位画素セル10Bのうちの1つを示している。
図7は、本開示の第2の実施形態に係る光検出装置の断面を模式的に示す。第2の実施形態において、光検出装置1000は、各々が光センサ100Bを有する複数の単位画素セル10Bを含む。図7では、図面が複雑となることを避けるため、複数の単位画素セル10Bのうちの1つを示している。
図7に例示する構成において、光センサ100Bは、容量変調トランジスタ60と、光電変換部とを有する。容量変調トランジスタ60は、半導体基板20に形成された電界効果トランジスタである。容量変調トランジスタ60は、不純物領域20dおよび不純物領域20sと、半導体基板上の絶縁層23xと、絶縁層23x上のゲート電極24とを有する。不純物領域20dは、容量変調トランジスタ60のドレイン領域(またはソース領域)として機能し、不純物領域20sは、容量変調トランジスタ60のソース領域(またはドレイン領域)として機能する。第1の実施形態と同様に、不純物領域20dは、電源配線42との接続を有することにより、光検出装置1000の動作時に所定の電圧(第1のバイアス電圧)を印加可能に構成されている。絶縁層23xは、容量変調トランジスタ60のゲート絶縁層として機能する。絶縁層23xは、例えば、厚さが4.6nmのシリコン熱酸化膜である。
光センサ100Bの光電変換部は、画素電極21と、画素電極21に対向する透明電極22と、これらの間に挟まれた光電変換層23pとを含む。画素電極21は、隣接する単位画素セル10Bとの間で空間的に分離して配置されることにより、他の単位画素セル10Bにおける画素電極21と電気的に分離されている。画素電極21は、典型的には、金属電極または金属窒化物電極である。画素電極21を形成するための材料の例は、Al、Cu、Ti、TiN、Ta、TaN、Mo、RuおよびPtである。画素電極21は、不純物がドープされることにより導電性が付与されたポリシリコンなどから形成されてもよい。ここでは、画素電極21としてTiN電極を用いる。
光電変換層23pは、他の単位画素セル10Bにわたって形成されている。光電変換層23pの厚さは、例えば200nm程度であり得る。透明電極22は、第1の実施形態における透明ゲート電極22gと同様に、TCOを用いて他の単位画素セル10Bにわたって形成されている。また、透明電極22は、ゲート電圧制御線48(図7において不図示、図2参照)との接続を有し、光検出装置1000の動作時に所定の電圧(第2のバイアス電圧)を印加可能に構成されている。
図示する例では、透明電極22および光電変換層23pが層間絶縁層50上に配置されており、多層配線40の一部およびコンタクトプラグ52を含む接続部54により、光電変換部の画素電極21と、容量変調トランジスタ60のゲート電極24とが接続されている。第2の実施形態による光センサ100Bは、概略的には、第1の実施形態による光センサ100A(図1参照)における光電変換層23pと絶縁層23xとの間に電極(ここでは、画素電極21、接続部54およびゲート電極24)を介在させた構造を有するということができる。なお、容量変調トランジスタ60が、絶縁層23xを誘電体層として有するキャパシタと、光電変換層23pを誘電体層として有するキャパシタとの直列接続を含むゲート絶縁層を含んでいるとみなすこともできる。この場合、画素電極21、接続部54およびゲート電極24を間に有する、絶縁層23xおよび光電変換層23pの積層構造が、容量変調トランジスタ60におけるゲート容量(ゲート絶縁層といってもよい)を構成し、透明電極22が、容量変調トランジスタ60におけるゲート電極を構成するといえる。
光検出装置1000における光の検出の原理は、第1の実施形態とほぼ同様である。すなわち、光電変換層23pに上述の第3電圧範囲のバイアス電圧が印加された状態で、透明電極22を介して光電変換層23pに光が入射される。不純物領域20dに印加される電圧は、例えば、2.4Vである。透明電極22に印加される電圧は、例えば、2.5Vである。つまり、容量変調トランジスタ60のゲート絶縁層としての絶縁層23xと、光電変換層23pとに、全体としておよそ0.1Vのバイアス電圧が印加される。
光電変換層23pに光が入射すると、光電変換層23p内に正孔−電子対が生成され、光電変換層23pの誘電率が変化する。光電変換層23pにおける誘電率の変化に伴い、容量変調トランジスタ60の実効的なゲート電圧が変化し、容量変調トランジスタ60におけるドレイン電流が変化する。したがって、照度の変化を、例えば垂直信号線46における電圧の変化として検出することが可能である。
第2の実施形態によれば、光電変換層23pが層間絶縁層50上に配置されるので、層間絶縁層50内に光電変換層23pを埋め込んだ構造(図1参照)と比較して、多層配線40における各種の配線のレイアウトの自由度が向上する。図7に例示する構成では、単位画素セル10Bを半導体基板20の法線方向から見たときにおける、画素電極21および透明電極22が重なる領域の、単位画素セル10Bに対する割合が、単位画素セル10Bにおける開口率に相当する。そのため、層間絶縁層50内に光電変換層23pを埋め込んだ構造(図1参照)と比較して、より大きな開口率を得やすい。
また、光電変換層23pが層間絶縁層50上に配置する方が、層間絶縁層50内に光電変換層23pを埋め込むよりも製造プロセス上の難易度が低く、製造の面では有利である。容量変調トランジスタ60のゲート電極24と、アドレストランジスタ30のゲート電極34とをともにポリシリコン電極とすれば、容量変調トランジスタ60のゲートの形成と同時にアドレストランジスタ30のゲートを形成し得る。
例えば、容量変調トランジスタ60のゲート電極24と、アドレストランジスタ30のゲート電極34とを、互いに異なる材料を用いて形成するには、これらを順次に形成する必要がある。リソグラフィー技術を適用して、ゲート電極24およびゲート電極34を形成したり、不純物を注入したりする場合、ゲート電極24およびゲート電極34の間におけるアラインメントのずれを回避することは一般に困難である。したがって、容量変調トランジスタ60のゲート電極24と、アドレストランジスタ30のゲート電極34とを、互いに異なる材料を用いて形成しようとすると、アラインメントにおけるマージンを確保する必要がある。換言すれば、光検出装置における単位画素セルの微細化に不利である。
図7に例示するように、容量変調トランジスタ60におけるゲート電極24と、アドレストランジスタ30におけるゲート電極34とを同層(共通のレベル)とすることにより、共通のマスクおよび共通の材料を用いて、アラインメントのずれを考慮することなく、これらを所望の位置および形状に一括して配置し得る。同様に、容量変調トランジスタ60におけるゲート絶縁層23xと、アドレストランジスタ30におけるゲート絶縁層33とを同層とすることにより、共通のマスクおよび共通の材料を用いて、アラインメントのずれを考慮することなく、これらを所望の位置および形状に一括して配置し得る。したがって、より微細な画素を形成し得る。容量変調トランジスタ60のゲートの構造と、アドレストランジスタ30のゲートの構造とを共通化することにより、製造コストのさらなる削減が可能である。
なお、上述の第1の実施形態では、光センサ100Aは、容量変調トランジスタ60におけるゲート電極24に相当する電極を有していない(図1参照)。しかしながら、共通のマスクおよび共通の材料を用いて、光センサ100Aにおける絶縁層23xとアドレストランジスタ30におけるゲート絶縁層33とを形成することが可能である。これにより、絶縁層23xの形成後における、ゲート絶縁層33の形成のためのアライメント、あるいは、ゲート絶縁層33の形成後における、絶縁層23xの形成のためのアライメントを不要とできる。したがって、絶縁層23xとゲート絶縁層33とを同層として、絶縁層23xとゲート絶縁層33との間の位置ずれをなくし得る。
画素電極21を遮光性の電極として形成すれば、容量変調トランジスタ60のチャネル領域および/またはアドレストランジスタ30のチャネル領域への迷光の入射を抑制することが可能である。透明電極22とマイクロレンズ28との間に赤外線透過フィルタなどの光学フィルタを配置してもよい。
なお、図7に例示するデバイス構造は、一見すると、半導体基板上に光電変換層が配置された、積層型のイメージセンサのデバイス構造に似ている。しかしながら、積層型のイメージセンサでは、画素電極と、画素電極に対向する透明電極との間に比較的高いバイアス電圧が印加され、光の照射によって光電変換層内に生成された正孔および電子の一方が、信号電荷として画素電極に収集される。収集された信号電荷は、単位画素セル内のフローティングディフュージョンに一時的に蓄積され、蓄積された電荷量に応じた信号電圧が所定のタイミングで読み出される。
これに対し、本開示の光センサでは、光電変換層23pで生成された正孔および電子を電極に向けて移動させずに、光電変換層23pの誘電率の変化に応じた電気信号を読み出す。積層型のイメージセンサでは、信号電荷として正孔および電子の一方しか利用できないことに対して、本開示の光センサでは、正孔および電子をペアの形でドレイン電流の変化に利用している。そのため、より高い感度を実現し得る。また、光電変換層23pの上面と下面の間に与えられる電位差を上述の第3電圧範囲の電位差としているので、光の照射をやめれば、生成された正孔および電子のペアは、速やかに再結合する。すなわち、積層型のイメージセンサとは異なり、画素電極の電位のリセット動作が不要である。なお、本開示の光センサは、光電変換層23pで生成された正孔または電子をフローティングディフュージョンに信号電荷として蓄積する動作を行わない。そのため、積層型のイメージセンサとは異なり、半導体基板20は、信号電荷を蓄積するための電荷蓄積領域を有しない。
上述したように、光電変換層23pの上面と下面の間に与えられる電位差を上述の第3電圧範囲の電位差とした場合、光の照射をやめると、生成された正孔および電子のペアが速やかに再結合する。これは、光センサの出力が、光照射時の照度の変化に応じた変動を示し、積算光量には依存しないことを意味する。そのため、光電変換層23pの上面と下面の間に与えられる電位差を上述の第3電圧範囲の電位差とした場合には、基本的には、露光のタイミングおよび信号の読み出しのタイミングは、一致させられる。
なお、単位画素セル内に、一方の電極が半導体基板20の不純物領域20sまたは30s(例えば図7参照)に電気的に接続されたキャパシタを設けてもよい。このようなキャパシタを単位画素セル内に配置することにより、光センサに対する露光とは異なるタイミングで出力信号を読み出すことが可能になる。
(光センサの第3の実施形態)
図8は、本開示の第3の実施形態に係る光検出装置の断面を模式的に示す。図8に示す単位画素セル10C中の光センサ100Cと、図7を参照して説明した、第2の実施形態の光センサ100Bとの間の相違点は、光センサ100Cの光電変換部が、光電変換層23pと電極(画素電極21および/または透明電極22)との間に配置された絶縁層を含む点である。図8に例示する構成では、画素電極21と光電変換層23pとの間、および、光電変換層23pと透明電極22との間に、それぞれ、絶縁層29aおよび29bが配置されている。
図8は、本開示の第3の実施形態に係る光検出装置の断面を模式的に示す。図8に示す単位画素セル10C中の光センサ100Cと、図7を参照して説明した、第2の実施形態の光センサ100Bとの間の相違点は、光センサ100Cの光電変換部が、光電変換層23pと電極(画素電極21および/または透明電極22)との間に配置された絶縁層を含む点である。図8に例示する構成では、画素電極21と光電変換層23pとの間、および、光電変換層23pと透明電極22との間に、それぞれ、絶縁層29aおよび29bが配置されている。
絶縁層29aおよび29bを構成する材料としては、例えば、光電変換層23pを構成する材料よりもリーク電流の小さい材料を選択することができる。ここでは、絶縁層29aおよび29bとして、厚さが5.4nmのシリコン酸化膜を用いる。シリコン酸化膜は、例えばCVDにより形成することができる。
図8に例示する構成では、画素電極21と光電変換層23pとの間、および、光電変換層23pと透明電極22との間に、それぞれ、絶縁層29aおよび29bが配置されているので、より大きなバイアス電圧を容量変調トランジスタ60のドレイン領域(またはソース領域)と透明電極22との間に印加することが可能である。ここでは、第1のバイアス電圧として1.2Vの電圧を、第2のバイアス電圧として3.7Vの電圧を、それぞれ、不純物領域20dおよび透明電極22に印加する例を説明する。つまり、ここでは、不純物領域20dおよび透明電極22の間に、およそ2.5Vの電位差が与えられる。
図9は、2.5Vの電圧を印加したときの、シリコン酸化膜に流れるリーク電流の膜厚依存性を示す。既に説明したように、光の非照射時における特性を確保する観点からは、容量変調トランジスタ60のチャネル領域へのリーク電流が1×10-11A/cm2以下であることが有益である。図9に示すように、シリコン酸化膜に2.5Vの電圧を印加する場合には、シリコン酸化膜の厚さを5.4nm以上とすることにより、シリコン酸化膜におけるリーク電流を1×10-11A/cm2以下に低減することができる。
再び図8を参照する。図8に例示する構成では、不純物領域20dおよび透明電極22の間に印加される電圧が、それぞれがキャパシタを構成する絶縁層23x、絶縁層29a、絶縁層29bおよび光電変換層23pの間で分圧される。そのため、絶縁層23x、29aおよび29bの各々に印加される電圧は、およそ0.8V程度である。したがって、厳密には、絶縁層29aおよび29bのそれぞれが5.4nmの厚さを有している必要はない。ここでは、CVDによって形成されるシリコン酸化膜の特性バラつきを考慮して、絶縁層29aおよび29bの各々の厚さとして5.4nmの値を採用している。
このように、光電変換層23pと電極との間に絶縁層(ここでは絶縁層29a、絶縁層29b)を配置することにより、容量変調トランジスタ60のドレイン領域(またはソース領域)と透明電極22との間に、より大きなバイアス電圧を印加することが可能である。例えば、光電変換層23pの上面と下面との間に与えられる電位差が上述の第1電圧範囲となるようなバイアス電圧が、容量変調トランジスタ60のドレイン領域(またはソース領域)と透明電極22との間に印加されてもよい。
光電変換層23pに第1電圧範囲(図5参照)のバイアス電圧が印加された状態で光が光電変換層23pに照射されると、光電変換によって生成された正孔および電子の一方は、透明電極22に向かって移動し、他方は、画素電極21に向かって移動する。このように、光電変換層23pに第1電圧範囲のバイアス電圧を印加する場合には、光電変換によって生じた正の電荷および負の電荷が分離され得るので、光の照射をやめてから正孔および電子のペアが再結合するまでの時間は、光電変換層23pに第3電圧範囲のバイアス電圧を印加する場合と比較して長い。したがって、露光のタイミングと信号の読み出しのタイミングとを必ずしも一致させる必要はない。露光のタイミングと信号の読み出しのタイミングとを異ならせることが比較的容易であるので、ある側面では、光電変換層23pへの第1電圧範囲のバイアス電圧の印加は、光センサのイメージセンサへの適用に有利である。
光電変換層23pに第1電圧範囲のバイアス電圧が印加された状態では、光電変換層23pと画素電極21との間の絶縁層29aは、光電変換によって生成された正孔および電子の一方を蓄積するキャパシタとして機能し得る。このキャパシタへの電荷の蓄積に伴い、接続部54において静電誘導が起こり、容量変調トランジスタ60における実効的なゲート電圧が変化する。したがって、容量変調トランジスタ60のドレイン電流の大きさが変化する。出力信号の読み出しが終了した後は、例えば、第2のバイアス電圧とは逆極性の電圧が透明電極22に印加されることにより、キャパシタとしての絶縁層29aに蓄積された電荷をリセットするためのリセット動作が実行される。また、例えば、機械的なシャッターにより遮光することによって、キャパシタとしての絶縁層29aに蓄積された電荷と、キャパシタとして絶縁層29bに蓄積された電荷とを再結合させてよい。もちろん、上述の第3電圧範囲のバイアス電圧が光電変換層23pに印加された状態で、光の検出動作が行われてもよい。この場合は、リセット動作は不要である。
このように、光電変換層23pと画素電極21との間、および、光電変換層23pと透明電極22との間に絶縁層を配置してもよい。光電変換層23pと画素電極21との間、および、光電変換層23pと透明電極22との間に絶縁層を配置することにより、不純物領域20dおよび透明電極22の間の電位差を大きくした場合であっても、光電変換によって生じた電荷の、光電変換層23pの外部への移動を抑制し得る。したがって、残像の発生を抑制し得る。なお、光電変換層23pの外部への電荷の移動を抑制する観点からは、光電変換層23pと画素電極21との間、および、光電変換層23pと透明電極22との間の少なくとも一方に絶縁層が配置されればよい。絶縁層29aおよび/または絶縁層29bとして、シリコン酸化膜に代えて、シリコン窒化物の膜、酸化アルミニウムの膜などを用いてもよい。
上述の各実施形態では、容量変調トランジスタ60およびアドレストランジスタ30の各々がNチャンネルMOSである例を説明した。しかしながら、本開示の実施形態におけるトランジスタは、NチャンネルMOSに限定されない。容量変調トランジスタ60およびアドレストランジスタ30は、NチャンネルMOSであってもよいし、PチャンネルMOSであってもよい。また、これらがNチャンネルMOSまたはPチャンネルMOSのいずれかに統一されている必要はない。アドレストランジスタ30として、FETのほか、バイポーラトランジスタも用い得る。上述の光センサ100Aの不純物領域20dおよび不純物領域20sの間に形成されるチャネル中のキャリアは、電子であってもよいし、正孔であってもよい。
(カメラシステム)
図10は、本開示の第4の実施形態に係るカメラシステムの構成例を模式的に示す。図10に示すカメラシステム300は、レンズ光学系310と、上述の光検出装置1000と、システムコントローラ330と、カメラ信号処理部320とを有する。
図10は、本開示の第4の実施形態に係るカメラシステムの構成例を模式的に示す。図10に示すカメラシステム300は、レンズ光学系310と、上述の光検出装置1000と、システムコントローラ330と、カメラ信号処理部320とを有する。
レンズ光学系310は、例えばオートフォーカス用レンズ、ズーム用レンズおよび絞りを含む。レンズ光学系310は、光検出装置1000の撮像面に光を集光する。光センサの光電変換層23pが、可視光の波長範囲に吸収を有する材料を用いて形成されている場合、光検出装置1000の撮像面上にカラーフィルタが配置され得る。光検出装置1000は、周辺回路として、カラム信号処理回路(「行信号蓄積回路」とも呼ばれる)、水平信号読み出し回路(「列走査回路」とも呼ばれる)などを有し得る。
システムコントローラ330は、カメラシステム300全体を制御する。システムコントローラ330は、例えばマイクロコンピュータによって実現され得る。
カメラ信号処理部320は、光検出装置1000からの出力信号を処理する信号処理回路として機能する。カメラ信号処理部320は、例えばガンマ補正、色補間処理、空間補間処理、およびオートホワイトバランスなどの処理を行う。カメラ信号処理部320は、例えばDSP(Digital Signal Processor)などによって実現され得る。
システムコントローラ330およびカメラ信号処理部320の少なくとも一方が、光検出装置1000の半導体基板20上に形成されてもよい。システムコントローラ330およびカメラ信号処理部320の少なくとも一方と、光検出装置1000とを単一の半導体装置として製造することにより、カメラシステム300を小型化し得る。
本開示の光センサは、光検出装置、イメージセンサなどに適用可能である。光電変換層の材料を適切に選択することにより、赤外線を利用した画像の取得も可能である。赤外線を利用した撮像を行う光センサは、例えば、セキュリティカメラ、車両に搭載されて使用されるカメラなどに用いることができる。車両搭載用カメラは、例えば、車両が安全に走行するための、制御装置に対する入力として利用され得る。あるいは、車両が安全に走行するための、オペレータの支援に利用され得る。
10A〜10C 単位画素セル
12 電圧供給回路
14 垂直走査回路
20 半導体基板
20d,20s,30s 不純物領域
20t 素子分離領域
21 画素電極
22 透明電極
22g 透明ゲート電極
23,33 ゲート絶縁層
23p 光電変換層
24,34 ゲート電極
23x,29a,29b 絶縁層
26 赤外線透過フィルタ
30 アドレストランジスタ
40 多層配線
42 電源配線
44 アドレス信号線
46 垂直信号線
48 ゲート電圧制御線
49 定電流源
50 層間絶縁層
54 接続部
60 容量変調トランジスタ
100A〜100C 光センサ
230A 光電変換構造
230h 光電変換層
230p p型半導体層
230n n型半導体層
234 電子ブロッキング層
236 正孔ブロッキング層
300 カメラシステム
310 レンズ光学系
320 カメラ信号処理部
330 システムコントローラ
1000 光検出装置
12 電圧供給回路
14 垂直走査回路
20 半導体基板
20d,20s,30s 不純物領域
20t 素子分離領域
21 画素電極
22 透明電極
22g 透明ゲート電極
23,33 ゲート絶縁層
23p 光電変換層
24,34 ゲート電極
23x,29a,29b 絶縁層
26 赤外線透過フィルタ
30 アドレストランジスタ
40 多層配線
42 電源配線
44 アドレス信号線
46 垂直信号線
48 ゲート電圧制御線
49 定電流源
50 層間絶縁層
54 接続部
60 容量変調トランジスタ
100A〜100C 光センサ
230A 光電変換構造
230h 光電変換層
230p p型半導体層
230n n型半導体層
234 電子ブロッキング層
236 正孔ブロッキング層
300 カメラシステム
310 レンズ光学系
320 カメラ信号処理部
330 システムコントローラ
1000 光検出装置
Claims (7)
- ソース領域およびドレイン領域を含む半導体層と、
前記半導体層の前記ソース領域と前記ドレイン領域とで挟まれた領域上に位置し、光電変換層を含むゲート絶縁層と、
前記ゲート絶縁層上のゲート電極と、
前記ソース領域および前記ドレイン領域のうちの一方と、前記ゲート電極との間に電圧を印加する電圧供給回路と、
前記ソース領域および前記ドレイン領域のうちの他方に接続された信号検出回路と、
を備え、
前記電圧供給回路は、前記光電変換層に印加されるバイアス電圧が−1V以上1V以下となるように前記電圧を印加し、
前記信号検出回路は、入射光による前記光電変換層の容量の変化に対応する電気信号を検出する、光センサ。 - 前記ゲート絶縁層は、前記光電変換層と前記半導体層との間に配置された第1絶縁層を含む、請求項1に記載の光センサ。
- 前記ゲート電極と前記半導体層との間に配置された遮光膜を備える、請求項1または2に記載の光センサ。
- 第1電極と、
前記第1電極に対向する第2電極と、
前記第1電極と前記第2電極との間の光電変換層と、
ゲートが前記第1電極に電気的に接続されたトランジスタと、
前記トランジスタのソースおよびドレインのうちの一方と、前記第2電極との間に電圧を印加する電圧供給回路と、
前記トランジスタの前記ソースおよび前記ドレインのうちの他方に接続された信号検出回路と、
を備え、
前記電圧供給回路は、前記光電変換層に印加されるバイアス電圧が−1V以上1V以下となるように前記電圧を印加し、
前記信号検出回路は、入射光による前記光電変換層の容量の変化に対応する電気信号を検出する、光センサ。 - 前記第1電極は、遮光性を有する、請求項4に記載の光センサ。
- 前記第1電極と前記光電変換層との間に配置された第1絶縁層、および、前記第2電極と前記光電変換層との間に配置された第2絶縁層のうちの少なくとも一方を備える、請求項4または5に記載の光センサ。
- 前記バイアス電圧が−1V以上1V以下であるとき、前記光電変換層に流れる電流密度は100μA/cm2以下である、請求項1に記載の光センサ。
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