JP2016524432A - 構成可能な相互結合ソースディジェネレーションインダクタを持つ増幅器 - Google Patents
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Abstract
Description
一般に、任意の数のLNAが任意の数の帯域をサポートするために使用され得る。各LNAは1つまたは複数の帯域のための1つまたは複数の入力と、1つまたは複数の負荷回路に結合された1つまたは複数の出力とを含み得る。LNAは、(i)同一または異なる数の入力と、(ii)同一または異なる数の出力とを有し得る。LNAは任意の数の負荷回路に結合され得る。
ために提供される。本開示に対する様々な修正は、当業者にとって容易に明らかであり、
ここに定義された一般的な原理は、本開示の範囲から逸脱することなく、他の変形物に適
用され得る。よって、本開示は、本明細書に説明された例および設計に限定されるように
意図されたものではなく、本明細書に開示された原理および新規の特徴と矛盾しない最大
範囲であると認められるべきである。
以下に、本願の出願当初の特許請求の範囲に記載された発明を付記する。
[C1]
入力信号を受け取って増幅信号を提供するように構成される利得トランジスタと、
前記利得トランジスタに結合され、前記利得トランジスタのためのプログラマブルソースディジェネレーションインダクタンスを提供するように構成される複数のインダクタとを備え、前記複数のインダクタが相互結合される、装置。
[C2]
前記複数のインダクタは、
前記利得トランジスタのソースおよび回路グラウンド間に結合された第1のインダクタと、
スイッチに直列に結合されて前記利得トランジスタの前記ソースおよび回路グラウンド間に結合された第2のインダクタとを備える、C1に記載の装置。
[C3]
前記第1および第2のインダクタは正のカップリング係数を有する、C2に記載の装置。
[C4]
前記第1および第2のインダクタは負のカップリング係数を有する、C2に記載の装置。
[C5]
前記複数のインダクタおよび回路グラウンド間に結合された前記インダクタをさらに備え、前記負のカップリング係数は前記スイッチが閉じられたときに前記利得トランジスタで観察されるソースディジェネレーションインダクタンスを低減するものである、C4に記載の装置。
[C6]
前記第1のインダクタは第1のスパイラルパターンを有する第1の導体で形成され、前記第2のインダクタは第2のスパイラルパターンを有する第2の導体で形成される、C2に記載の装置。
[C7]
前記第1および第2のスパイラルパターンは前記第1および第2のインダクタのための正のカップリング係数を得るために同一方向に形成される、C6に記載の装置。
[C8]
前記第1および第2のスパイラルパターンは前記第1および第2のインダクタのための負のカップリング係数を得るために反対方向に形成される、C6に記載の装置。
[C9]
前記第2のインダクタは前記第1のインダクタの内側に形成される、C2に記載の装置。
[C10]
前記利得トランジスタに結合された第1のカスコードトランジスタであって、前記第1のカスコードトランジスタがイネーブルされたときに前記増幅信号を受け取って第1の出力信号を提供するように構成される第1のカスコードトランジスタと、
前記利得トランジスタに結合された第2のカスコードトランジスタであって、前記第2のカスコードトランジスタがイネーブルされたときに前記増幅信号を受け取って第2の出力信号を提供するように構成される第2のカスコードトランジスタと
をさらに備える、C1に記載の装置。
[C11]
前記第1および第2のカスコードトランジスタのうちの1つが第1の動作モードでイネーブルされ、前記第1および第2のカスコードトランジスタの両方が第2の動作モードでイネーブルされる、C10に記載の装置。
[C12]
前記複数のインダクタは前記第1の動作モードで第1のソースディジェネレーションインダクタンスを提供するか、または前記第2の動作モードで第2のソースディジェネレーションインダクタンスを提供するように構成される、C11に記載の装置。
[C13]
前記第2のソースディジェネレーションインダクタンスは前記第1のソースディジェネレーションインダクタンスよりも少ない、C12に記載の装置。
[C14]
入力信号または第2の入力信号を受け取って第2の増幅信号を提供するように構成される第2の利得トランジスタと、
前記第2の利得トランジスタに結合され、前記第2の利得トランジスタのためのプログラマブルソースディジェネレーションインダクタンスを提供するように構成される第2の複数のインダクタであって、相互結合される第2の複数のインダクタと、
前記第2の利得トランジスタに結合された第3のカスコードトランジスタであって、前記第3のカスコードトランジスタがイネーブルされたときに前記第2の増幅信号を受け取って前記第1の出力信号を提供するように構成される第3のカスコードトランジスタと、
前記第2の利得トランジスタに結合された第4のカスコードトランジスタであって、前記第4のカスコードトランジスタがイネーブルされたときに前記第2の増幅信号を受け取って前記第2の出力信号を提供するように構成される第3のカスコードトランジスタと
をさらに備える、C10に記載の装置。
[C15]
増幅信号を得るために利得トランジスタで入力信号を増幅することと、
複数の相互結合インダクタで前記利得トランジスタのためのプログラマブルソースディジェネレーションインダクタンスを提供することと
を備える、方法。
[C16]
前記複数の相互結合インダクタは第1および第2のインダクタを備え、前記プログラマブルソースディジェネレーションインダクタンスを提供することは、
前記第1のインダクタに基づいて前記利得トランジスタのための第1のソースディジェネレーションインダクタンスを提供することと、
前記第1および第2のインダクタの並列な組合せに基づいて前記利得トランジスタのための第2のソースディジェネレーションインダクタンスを提供することと
を備える、C15に記載の方法。
[C17]
前記第1および第2のインダクタは正のカップリング係数を有し、前記第2のソースディジェネレーションインダクタンスは前記第1および第2のインダクタの並列な組合せよりも大きい、C16に記載の方法。
[C18]
前記第1および第2のインダクタは負のカップリング係数を有し、前記第2のソースディジェネレーションインダクタンスは前記第1および第2のインダクタの並列な組合せよりも小さい、C16に記載の方法。
[C19]
増幅信号を提供するために入力信号を増幅するための手段と、
複数の相互接続インダクティブ手段でプログラマブルソースディジェネレーションインダクタンスを提供するための手段と
を備える、装置。
[C20]
前記複数の相互接続インダクティブ手段は第1および第2のインダクティブ手段を備え、前記プログラマブルソースディジェネレーションインダクタンスを提供するための前記手段は、
前記第1のインダクティブ手段に基づいて第1のソースディジェネレーションインダクタンスを提供するための手段と、
前記第1および第2のインダクティブ手段の並列な組合せに基づいて第2のソースディジェネレーションインダクタンスを提供するための手段と
を備える、C19に記載の装置。
Claims (20)
- 入力信号を受け取って増幅信号を提供するように構成される利得トランジスタと、
前記利得トランジスタに結合され、前記利得トランジスタのためのプログラマブルソースディジェネレーションインダクタンスを提供するように構成される複数のインダクタとを備え、前記複数のインダクタが相互結合される、装置。 - 前記複数のインダクタは、
前記利得トランジスタのソースおよび回路グラウンド間に結合された第1のインダクタと、
スイッチに直列に結合されて前記利得トランジスタの前記ソースおよび回路グラウンド間に結合された第2のインダクタとを備える、請求項1に記載の装置。 - 前記第1および第2のインダクタは正のカップリング係数を有する、請求項2に記載の装置。
- 前記第1および第2のインダクタは負のカップリング係数を有する、請求項2に記載の装置。
- 前記複数のインダクタおよび回路グラウンド間に結合された前記インダクタをさらに備え、前記負のカップリング係数は前記スイッチが閉じられたときに前記利得トランジスタで観察されるソースディジェネレーションインダクタンスを低減するものである、請求項4に記載の装置。
- 前記第1のインダクタは第1のスパイラルパターンを有する第1の導体で形成され、前記第2のインダクタは第2のスパイラルパターンを有する第2の導体で形成される、請求項2に記載の装置。
- 前記第1および第2のスパイラルパターンは前記第1および第2のインダクタのための正のカップリング係数を得るために同一方向に形成される、請求項6に記載の装置。
- 前記第1および第2のスパイラルパターンは前記第1および第2のインダクタのための負のカップリング係数を得るために反対方向に形成される、請求項6に記載の装置。
- 前記第2のインダクタは前記第1のインダクタの内側に形成される、請求項2に記載の装置。
- 前記利得トランジスタに結合された第1のカスコードトランジスタであって、前記第1のカスコードトランジスタがイネーブルされたときに前記増幅信号を受け取って第1の出力信号を提供するように構成される第1のカスコードトランジスタと、
前記利得トランジスタに結合された第2のカスコードトランジスタであって、前記第2のカスコードトランジスタがイネーブルされたときに前記増幅信号を受け取って第2の出力信号を提供するように構成される第2のカスコードトランジスタと
をさらに備える、請求項1に記載の装置。 - 前記第1および第2のカスコードトランジスタのうちの1つが第1の動作モードでイネーブルされ、前記第1および第2のカスコードトランジスタの両方が第2の動作モードでイネーブルされる、請求項10に記載の装置。
- 前記複数のインダクタは前記第1の動作モードで第1のソースディジェネレーションインダクタンスを提供するか、または前記第2の動作モードで第2のソースディジェネレーションインダクタンスを提供するように構成される、請求項11に記載の装置。
- 前記第2のソースディジェネレーションインダクタンスは前記第1のソースディジェネレーションインダクタンスよりも少ない、請求項12に記載の装置。
- 入力信号または第2の入力信号を受け取って第2の増幅信号を提供するように構成される第2の利得トランジスタと、
前記第2の利得トランジスタに結合され、前記第2の利得トランジスタのためのプログラマブルソースディジェネレーションインダクタンスを提供するように構成される第2の複数のインダクタであって、相互結合される第2の複数のインダクタと、
前記第2の利得トランジスタに結合された第3のカスコードトランジスタであって、前記第3のカスコードトランジスタがイネーブルされたときに前記第2の増幅信号を受け取って前記第1の出力信号を提供するように構成される第3のカスコードトランジスタと、
前記第2の利得トランジスタに結合された第4のカスコードトランジスタであって、前記第4のカスコードトランジスタがイネーブルされたときに前記第2の増幅信号を受け取って前記第2の出力信号を提供するように構成される第3のカスコードトランジスタと
をさらに備える、請求項10に記載の装置。 - 増幅信号を得るために利得トランジスタで入力信号を増幅することと、
複数の相互結合インダクタで前記利得トランジスタのためのプログラマブルソースディジェネレーションインダクタンスを提供することと
を備える、方法。 - 前記複数の相互結合インダクタは第1および第2のインダクタを備え、前記プログラマブルソースディジェネレーションインダクタンスを提供することは、
前記第1のインダクタに基づいて前記利得トランジスタのための第1のソースディジェネレーションインダクタンスを提供することと、
前記第1および第2のインダクタの並列な組合せに基づいて前記利得トランジスタのための第2のソースディジェネレーションインダクタンスを提供することと
を備える、請求項15に記載の方法。 - 前記第1および第2のインダクタは正のカップリング係数を有し、前記第2のソースディジェネレーションインダクタンスは前記第1および第2のインダクタの並列な組合せよりも大きい、請求項16に記載の方法。
- 前記第1および第2のインダクタは負のカップリング係数を有し、前記第2のソースディジェネレーションインダクタンスは前記第1および第2のインダクタの並列な組合せよりも小さい、請求項16に記載の方法。
- 増幅信号を提供するために入力信号を増幅するための手段と、
複数の相互接続インダクティブ手段でプログラマブルソースディジェネレーションインダクタンスを提供するための手段と
を備える、装置。 - 前記複数の相互接続インダクティブ手段は第1および第2のインダクティブ手段を備え、前記プログラマブルソースディジェネレーションインダクタンスを提供するための前記手段は、
前記第1のインダクティブ手段に基づいて第1のソースディジェネレーションインダクタンスを提供するための手段と、
前記第1および第2のインダクティブ手段の並列な組合せに基づいて第2のソースディジェネレーションインダクタンスを提供するための手段と
を備える、請求項19に記載の装置。
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