JP6345760B2 - 誘導性ディジェネレーションと、構成可能利得と、入力整合とをもつ増幅器 - Google Patents
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Description
以下に本願発明の当初の特許請求の範囲に記載された発明を付記する。
[C1]
利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記利得トランジスタと、
前記利得トランジスタと回路接地との間に結合されたインダクタと、
前記利得トランジスタの前記可変利得に基づいて前記利得トランジスタに選択的に結合される入力整合回路と
を備える装置。
[C2]
前記入力整合回路が、低利得モードで前記利得トランジスタに結合され、高利得モードで前記利得トランジスタから分離される、C1に記載の装置。
[C3]
前記入力整合回路は、
前記入力整合回路が前記利得トランジスタに結合されたとき、前記利得トランジスタと前記インダクタとを備える、増幅器の入力整合のための抵抗器と、
前記抵抗器を前記利得トランジスタに結合するか、または前記抵抗器を前記利得トランジスタから分離するように動作可能な第2のトランジスタと
を備える、C1に記載の装置。
[C4]
前記入力整合回路は、
前記抵抗器および前記第2のトランジスタと直列に結合されたキャパシタ
をさらに備える、C3に記載の装置。
[C5]
前記キャパシタが前記第2のトランジスタのソースと回路接地との間に結合され、前記抵抗器が前記第2のトランジスタのドレインと前記利得トランジスタのゲートとの間に結合された、C4に記載の装置。
[C6]
前記入力整合回路は、
バイアス電圧と前記キャパシタとの間に結合され、前記入力整合回路が前記利得トランジスタから分離されたときに前記キャパシタを前記バイアス電圧までプリチャージするように動作可能な第3のトランジスタ
をさらに備える、C4に記載の装置。
[C7]
前記利得トランジスタと前記インダクタとを備える増幅器の入力整合のためのキャパシタと、
前記キャパシタと前記利得トランジスタとに結合され、前記利得トランジスタのゲートとソースとの間の前記キャパシタを結合または分離するように動作可能な第2のトランジスタと
をさらに備える、C1に記載の装置。
[C8]
前記キャパシタが、調整可能なキャパシタンスを有する、C7に記載の装置。
[C9]
前記利得トランジスタのゲートに結合された第2の入力整合回路
をさらに備える、C1に記載の装置。
[C10]
前記第2の入力整合回路が、前記第2の入力整合回路の入力と出力との間に結合された第2のインダクタを備える、C9に記載の装置。
[C11]
前記利得トランジスタと増幅器出力との間に結合されたカスコードトランジスタと、前記可変利得に基づいて入力無線周波数(RF)信号を受信し、増幅するように動作可能な前記利得トランジスタと、出力RF信号を与えるように動作可能な前記カスコードトランジスタとをさらに備える、C1に記載の装置。
[C12]
前記利得トランジスタと第2の増幅器出力との間に結合され、第2の出力RF信号を与えるように構成可能な第2のカスコードトランジスタ
をさらに備える、C11に記載の装置。
[C13]
前記利得トランジスタに結合され、第2の利得トランジスタの第2のバイアス電流に基づいて決定される第2の可変利得を有する前記第2の利得トランジスタと、
前記第2の利得トランジスタと回路接地との間に結合された第2のインダクタと、
前記第2の利得トランジスタと前記増幅器出力との間に結合された第2のカスコードトランジスタと、
前記第2の利得トランジスタと第2の増幅器出力との間に結合された第3のカスコードトランジスタと
をさらに備える、C11に記載の装置。
[C14]
第2の利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記第2の利得トランジスタと、
前記第2の利得トランジスタと回路接地との間に結合された第2のインダクタと、
前記第2の利得トランジスタの前記可変利得に基づいて前記第2の利得トランジスタに選択的に結合される第2の入力整合回路と、
前記第2の利得トランジスタと前記増幅器出力との間に結合された第3のカスコードトランジスタと、
前記第2の利得トランジスタと前記第2の増幅器出力との間に結合された第4のカスコードトランジスタと
をさらに備える、C12に記載の装置。
[C15]
利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記利得トランジスタを用いて入力無線周波数(RF)信号を増幅することと、
前記利得トランジスタと回路接地との間に結合されたインダクタを用いて前記利得トランジスタをディジェネレートすることと、
前記利得トランジスタの前記可変利得に基づいて入力整合回路を前記利得トランジスタに選択的に結合することと
を備える方法。
[C16]
前記入力整合回路を前記選択的に結合することは、前記入力整合回路が前記利得トランジスタに結合されたとき、入力整合のために前記利得トランジスタと回路接地との間に抵抗器を結合することを備える、C15に記載の方法。
[C17]
前記入力整合回路が前記利得トランジスタから分離されたとき、前記抵抗器と直列に結合されたキャパシタをバイアス電圧までプリチャージすること
をさらに備える、C16に記載の方法。
[C18]
入力整合のために前記利得トランジスタのゲートとソースとの間にキャパシタを選択的に結合すること
をさらに備える、C15に記載の方法。
[C19]
増幅するための手段のバイアス電流に基づいて決定される可変利得を用いて入力無線周波数(RF)信号を増幅するための前記手段と、
増幅するための前記手段と回路接地との間に結合されたディジェネレートするための手段と、
増幅するための前記手段の前記可変利得に基づいて増幅するための前記手段に選択的に結合される入力整合のための手段と
を備える装置。
[C20]
入力整合のための前記手段は、増幅するための前記手段と回路接地との間に結合され、入力整合のための前記手段が増幅するための前記手段に結合されたときに入力整合のために使用される抵抗性手段を備える、C19に記載の装置。
[C21]
増幅するための前記手段のノード間に選択的に結合され、入力整合のために使用される容量性手段を
さらに備える、C19に記載の装置。
Claims (10)
- 入力無線周波数(RF)信号中のジャマーに適応される利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記利得トランジスタと、
前記利得トランジスタと回路接地との間に結合され、前記利得トランジスタにディジェネレーションを与えるように構成されたインダクタと、
前記利得トランジスタの前記可変利得に基づいて前記利得トランジスタのゲートと前記回路接地との間に選択的に結合可能な入力整合回路とを備え、
ここにおいて、前記入力整合回路は、第2のトランジスタと、抵抗器である構成要素と、前記抵抗器および前記第2のトランジスタと直列に結合されたキャパシタとを備え、前記構成要素は、前記入力整合回路が前記利得トランジスタの前記ゲートと前記回路接地との間に結合された状態で、前記利得トランジスタと前記インダクタとを備える増幅器の入力整合を与えるように構成され、前記第2のトランジスタは、前記入力整合回路を前記利得トランジスタの前記ゲートと前記回路接地との間に結合するか、または、前記入力整合回路を前記利得トランジスタの前記ゲートと前記回路接地との間から切断するように動作可能であり、前記入力整合回路は、バイアス電圧と前記キャパシタとの間に結合され、前記入力整合回路が前記利得トランジスタの前記ゲートと前記回路接地との間から切断された状態で前記キャパシタを前記バイアス電圧までプリチャージするように動作可能な第3のトランジスタをさらに備える、装置。 - 前記入力整合回路が、前記ジャマーが存在する場合のための低利得モードで前記利得トランジスタの前記ゲートと前記回路接地との間に結合され、前記ジャマーが存在しない場合のための高利得モードで前記利得トランジスタの前記ゲートと前記回路接地との間から切断される、請求項1に記載の装置。
- 前記キャパシタが前記第2のトランジスタのソースと回路接地との間に結合され、前記抵抗器が前記第2のトランジスタのドレインと前記利得トランジスタの前記ゲートとの間に結合された、請求項1に記載の装置。
- 前記入力RF信号の受信端子と前記利得トランジスタの前記ゲートとの間に結合された第2の入力整合回路をさらに備える、請求項1に記載の装置。
- 前記第2の入力整合回路が、前記第2の入力整合回路の入力と出力との間に結合された第2のインダクタを備える、請求項4に記載の装置。
- 入力無線周波数(RF)信号中のジャマーに適応される利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記利得トランジスタと、
前記利得トランジスタと回路接地との間に結合されるもので、前記利得トランジスタにディジェネレーションを与えるように構成されたインダクタと、
前記利得トランジスタの前記可変利得に基づいて前記利得トランジスタのゲートと前記回路接地との間に選択的に結合可能な入力整合回路と、
前記利得トランジスタと増幅器出力との間に結合されたカスコードトランジスタと、
を備え、
前記利得トランジスタは、前記入力RF信号を受信し、前記可変利得に基づいて増幅するように動作可能であり、前記カスコードトランジスタは、出力RF信号を与えるように動作可能である、
ここにおいて、前記入力整合回路は、第2のトランジスタと、抵抗器である構成要素と、前記抵抗器および前記第2のトランジスタと直列に結合されたキャパシタとを備え、前記構成要素は、前記入力整合回路が前記利得トランジスタの前記ゲートと前記回路接地との間に結合された状態で、前記利得トランジスタと前記インダクタとを備える増幅器の入力整合を与えるように構成され、前記第2のトランジスタは、前記入力整合回路を前記利得トランジスタの前記ゲートと前記回路接地との間に結合するか、または、前記入力整合回路を前記利得トランジスタの前記ゲートと前記回路接地との間から切断するように動作可能であり、前記入力整合回路は、バイアス電圧と前記キャパシタとの間に結合され、前記入力整合回路が前記利得トランジスタの前記ゲートと前記回路接地との間から切断された状態で前記キャパシタを前記バイアス電圧までプリチャージするように動作可能な第3のトランジスタをさらに備える、装置。 - 前記利得トランジスタと第2の増幅器出力との間に結合され、第2の出力RF信号を与えるように構成可能な第2のカスコードトランジスタをさらに備える、請求項6に記載の装置。
- 前記利得トランジスタに結合され、第2の利得トランジスタの第2のバイアス電流に基づいて決定される第2の可変利得を有する前記第2の利得トランジスタと、
前記第2の利得トランジスタと前記回路接地との間に結合され、前記第2の利得トランジスタにディジェネレーションを与えるように構成された第2のインダクタと、
前記第2の利得トランジスタと前記増幅器出力との間に結合された第2のカスコードトランジスタと、
前記第2の利得トランジスタと第2の増幅器出力との間に結合された第3のカスコードトランジスタとをさらに備える、請求項6に記載の装置。 - 第2の利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記第2の利得トランジスタと、
前記第2の利得トランジスタと前記回路接地との間に結合され、前記第2の利得トランジスタにディジェネレーションを与えるように構成された第2のインダクタと、
前記第2の利得トランジスタの前記可変利得に基づいて前記第2の利得トランジスタのゲートと前記回路接地との間に選択的に結合可能な第2の入力整合回路と、
前記第2の利得トランジスタと前記増幅器出力との間に結合された第3のカスコードトランジスタと、
前記第2の利得トランジスタと前記第2の増幅器出力との間に結合された第4のカスコードトランジスタとをさらに備える、請求項7に記載の装置。 - 入力無線周波数(RF)信号を、前記入力RF信号中のジャマーに適応される利得トランジスタのバイアス電流に基づいて決定される可変利得を有する前記利得トランジスタを用いて増幅することと、
前記利得トランジスタと回路接地との間に結合されたインダクタを用いて前記利得トランジスタをディジェネレートすることと、
前記利得トランジスタの前記可変利得に基づいて入力整合回路を前記利得トランジスタのゲートと前記回路接地との間に選択的に結合することであって、前記入力整合回路が前記利得トランジスタの前記ゲートと前記回路接地との間に結合された状態で入力整合のために、前記利得トランジスタの前記ゲートと前記回路接地との間に抵抗器を結合することと、
前記入力整合回路が前記利得トランジスタの前記ゲートと前記回路接地との間から切断された状態で、前記抵抗器と直列に結合されたキャパシタをバイアス電圧までプリチャージすることと
を備える方法。
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