JP2015043380A - 半導体装置 - Google Patents
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Abstract
【解決手段】半導体チップ4に隣接して帯状の凸部6を形成し、その凸部6の高さH1を半導体チップ4に接合するボンディングワイヤ7の接合部8の表面高さH2以上とする。これにより、モールド樹脂10の膨張、収縮によって、半導体チップ4とボンディングワイヤ7の接合部8にかかる応力Fを緩和することができる。さらに凸部6を設けることで、はんだ5の広がりを抑制し、またモールド樹脂10の密着性を向上させることができる。
【選択図】 図14
Description
このイグナイタ800は、リードフレーム71と、このリードフレーム71のダイパッド72上にはんだ73により固着されたパワー半導体チップ74と、前記のリードフレーム71のその他の箇所にはんだ付けされるICチップ75および電子部品76(コンデンサや抵抗)と、パワー半導体チップ74、ICチップ75、電子部品76(SMD:抵抗やコンデンサなどの表面実装デバイス)およびリードフレーム71などに接合されるボンディングワイヤ77と、これらをトランスファモールドで封止するモールド樹脂78を備える。
また、特許文献2では、リードフレームの裏面に精度の高い凹凸をつけたい場合、曲げ加工やプレス加工では精度が得られないため、予め圧延加工でフレーム材料に精度の高い凹凸をつけておくことが記載されている。
(1)図16において、はんだ73の厚さを厚くすると、はんだ73が広範囲に広がる。はんだ73が広がるとき、パワー半導体チップ74が移動することが起こる。そのため、リフロー時にパワー半導体チップ74が正規の位置からずれると、ワイヤボンディング装置がパワー半導体チップ74の位置を認識出来ず、ワイヤボンディングができないことがある。
(2)リードフレーム71との密着性の良い樹脂は高価であり、製造コストが増加する。
リードフレーム71の厚さが薄い場合には、溝の深さを深くすることができないため、はんだ73広がりを抑制するためには、はんだ73の厚さを十分に増やすことはできない。
また、前記の特許文献2では、リードフレームに突出部や溝については記載されていない。
また、特許文献4では、前記の凸部の高さについて具体的な限定は記載されていない。
前記した特許文献には、凸部の高さについての具体的に限定する記載やボンディングワイヤの接合部における応力と凸部の高さの関係についての記載されていない。
また、特許請求の範囲の請求項4に記載の発明によれば、請求項1に記載の発明において、前記凸部の材質が、前記ダイパッドと同一であるとよい。
<実施例1>
図1は、この発明に係る第1実施例の半導体装置に用いるリードフレーム100の構成図であり、同図(a)は要部平面図、同図(b)は要部側断面図である。
ボンディングワイヤ7の接合部8にかかる応力Fは、周囲による温度変化や半導体チップ4の冷熱変化により、モールド樹脂10が膨張、収縮することによって生じる。凸部6で囲まれた箇所に半導体チップ4は配置され、その上にボンディングワイヤ7の接合部8がある。この凸部6に囲まれた箇所のモールド樹脂10aは、凸部6がモールド樹脂10の膨張・収縮に対してストッパの働きをする(モールド樹脂10に凸部6が食い込むことで凸部6がストッパーとなる)。そのため、凸部6を設けることで、ボンディングワイヤ7の接合部8にかかる応力Fが抑制される。この凸部6の高さH1がボンディングワイヤ7の接合部8の表面高さH2以上になると、接合部8にかかる応力Fを抑制する効果は顕著になる。凸部6の高さH1とは、ダイパッド2表面から凸部6の頂点までの高さをいう。また、ボンディングワイヤ7の接合部8の表面高さH2とは、ダイパッド2表面から接合部8の表面の最大高さをいう。また、ボンディングワイヤ7の接合部8の表面とは、半導体チップ4に固着され、ボンディングで潰れたボンディングワイヤ7の表面をいう。
<実施例2>
図4は、この発明に係る第2実施例の半導体装置に用いるリードフレーム200の構成図であり、同図(a)は要部平面図、同図(b)は要部側断面図である。
<実施例3>
図5は、この発明に係る第3実施例の半導体装置に用いるリードフレーム300の構成図であり、同図(a)は要部平面図、同図(b)は要部側断面図である。
<実施例4>
図6は、この発明に係る第4実施例の半導体装置用リードフレーム400の構成図であり、同図(a)は要部平面図、同図(b)は要部側断面図、同図(c)は同図(b)のA部拡大図である。
<実施例5>
図7は、この発明に係る第5実施例の半導体装置用リードフレーム500の構成図であり、同図(a)は要部平面図、同図(b)は要部側断面図である。
尚、図4、図5、図6に示す半導体装置用リードフレーム200、300、400に、図7に示すように、凸部6に隣接する溝13を設けることで、さらに、前記した効果を高めることができる。
300,400,500の凸部6の側壁を垂直でなくテーパー状にする場合もある。
<実施例6>
図8および図9は、この発明に係る第6実施例の半導体装置用リードフレーム100の形成工程であり、工程順に示した要部形成工程断面図である。この工程断面図は図1のY−Y線で切断した断面図に相当する。
<実施例7>
図10は、この発明に係る第7実施例の半導体装置用リードフレーム100の要部形成工程断面図である。この工程断面図は図1のY−Y線で切断した断面図に相当する。
また、上部金型27に凸部6を形成する凹部28と打ち抜きするための凸部29が形成されている。この凸部29の平面パターンは打ち抜きパターンになっている。一方、下部金型30には凸部29が嵌合する凹部31が形成され、凹部31に凸部29が接触することで、半導体装置用リードフレーム100の厚さが決められる。
同図(b)において、上部金型27と下部金型30で金属板32を圧縮のためのプレス加工と打ち抜きのためのプレス加工を同時に行なう。
<実施例8>
図11および図12は、この発明に係る第8実施例の半導体装置用リードフレーム300の形成工程であり、工程順に示した要部形成工程断面図である。この工程断面図は図5のX−X線で切断した断面図に相当する。
図11(b)において、上下圧延ロール35,36を互いに逆回転させて金属板38を圧延する。このとき溝37により筋状の凸部6が形成される。
図12(d)において、打ち抜きパターンが形成された上部金型40と下部金型41の間に金属板39を挟む。上部金型40には打ち抜きパターンの凸部42と凸部6を逃がす凹部43が形成されている。下部金型41には凸部42が嵌合する凹部44が形成されている。
図13は上部圧延ロール35と下部圧延ロール36の斜視図である。複数本の筋状の溝37がロール一周に亘って形成されている。また図11は、図13のB部の箇所である。
<実施例9>
図14は、この発明に係る第9実施例のモールド型半導体装置600の構成図であり、同図(a)は要部平面図、同図(b)は同図(a)のX−X線で切断した要部断面図である。
また、凸部6をボンディングワイヤ7が横切る場合には、凸部6の高さH1は横切る箇所でのボンディングワイヤ7の高さより低くする。横切らない場合には凸部6の高さH1はモールド樹脂10から露出しない高さにする。
(1)モールド樹脂10の膨張、収縮によってボンディングワイヤ7の接合部8にかかる応力Fを大幅に緩和することができて、ボンディングワイヤ7の接合部8の信頼性を高め、モールド型半導体装置600の信頼性が高めることができる。
(2)半導体チップ4の周りに凸部6を配置することで、はんだ5の広がりを抑制でき、はんだ付け面積を縮小できる。その結果、部品の集積度を高めたモールド型半導体装置600にすることができる。
(3)はんだ5の広がりを抑制できるので、必要なはんだ厚みを確保するはんだ量を減らすことができる。
(4)はんだ5の広がりを抑制できるので、半導体装置用リードフレーム100に半導体チップ4をはんだ付けする場合に、半導体チップ4の位置決めが良好に行なわれる。
(5)この凸部6を複数本形成することで、凸部6に挟まれた凹部の箇所にモールド樹脂が入り込む。これによって、アンカー効果が発揮され、前記のボンディングワイヤ7の接合部8にかかる応力Fを減らし、さらにモールド樹脂10の半導体装置用リードフレーム100への密着性を高めることができる。この凸部6の本数が増加するほど、アンカー効果は大きくなり、接合部8にかかる応力Fの低減と密着性の向上を図ることができる。その結果、高信頼性のモールド型半導体装置600にすることができる。
(6)前記したように、凸部6があることで密着性の高い高価なモールド樹脂を用いる必要がなく、モールド型半導体装置600の製造コストを低減することができる。
<実施例10>
図15は、この発明に係る第10実施例のモールド型半導体装置700の構成図であり、同図(a)は要部平面図、同図(b)は要部側断面図である。このモールド型半導体装置700は、半導体チップ4の他に抵抗54aやコンデンサ54bなどの電子部品54を備えた複合型の半導体装置であり、ここでは、イグナイタを例に挙げた。尚、このモールド型半導体装置700の製造工程は、図17〜図21に示す従来の製造工程と類似であるので、ここでは説明を省略する。
2,52 ダイパッド
3 不要のリードフレーム部分
4 半導体チップ
5 はんだ
6、24,29,42 凸部
7 ボンディングワイヤ
8 接合部
9 点線
10 モールド樹脂
10a 凸部に囲まれた箇所のモールド樹脂
11 2点鎖線
12 隅
13 溝
15、21,27,40 上部金型
16、22,30,41 下部金型
17,20,32,38,39 金属板
18,19,25,26,28,31,37,43,44 凹部
35 上部圧延ロール
36 下部圧延ロール
51,100〜500 半導体装置用リードフレーム
53 ICチップ
54 電子部品
54a 抵抗
54b コンデンサ
600,700 モールド型半導体装置
Claims (8)
- ダイパッドを有するリードフレームと、
前記ダイパッドに配置され、はんだで固着される半導体チップと、
前記半導体チップ上に固着されるボンディングワイヤと、
前記リードフレームの一部を露出させて封止するモールド樹脂と、
を備え、
前記ダイパッドの前記半導体チップが配置される箇所の近傍に帯状の凸部が配置され、
前記凸部の高さが、前記半導体チップに固着される前記ボンディングワイヤの接合部の表面高さ以上であることを特徴とする半導体装置。 - 前記凸部の高さが、0.3mm以上であることを特徴とする請求項1に記載の半導体装置。
- 前記凸部が、前記半導体チップを取り囲むように配置されていることを特徴とする請求項1に記載の半導体装置。
- 前記凸部の材質が、前記ダイパッドと同一であることを特徴とする請求項1に記載の半導体装置。
- 前記リードフレームの前記半導体チップが固着された前記ダイパッド以外の箇所に、前記半導体チップを制御するICチップ及び電子部品が固着されて、イグナイタが構成されることを特徴とする請求項1に記載の半導体装置。
- 前記凸部を形成するための凹部を配置した上部金型と、平坦な表面の下部金型の間に金属板を挟んで第1プレス加工で前記金属板を圧縮し、該圧縮した金属板に前記凸部を形成する工程と、
前記凸部が形成された前記圧縮された金属板を打ち抜きパターンが形成された上部金型と、打ち抜きパターンが形成された下部金型の間に挟み第2のプレス加工で前記リードと前記凸部が配置されたダイパットを形成する工程と、
を含んだ工程により前記リードフレームを準備することを特徴とする請求項1に記載の半導体装置。 - 前記凸部を形成するための凹部を配置し打ち抜きパターンが形成された上部金型と、平坦な表面で打ち抜きパターンが形成された下部金型の間に金属板を挟んで、1回のプレス加工で前記リードと前記凸部が配置されたダイパットを形成することにより、前記リードフレームを準備することを特徴とする請求項1に記載の半導体装置。
- 回転方向に第1凹部の溝が形成された上部圧延ロールと、表面が平坦な下部圧延ロールの間に金属板を挟んで圧延し、直線状の凸部を形成する工程と、
前記凸部を有する圧延された金属板を打ち抜きパターンが形成された上部金型と打ち抜きパターンが形成された下部金型の間に挟みプレス加工で前記リードと前記凸部が配置されたダイパットを形成する工程と、
を含んだ工程により前記リードフレームを準備することを特徴とする請求項1に記載の半導体装置。
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2019007440A (ja) * | 2017-06-27 | 2019-01-17 | 日立オートモティブシステムズ阪神株式会社 | 内燃機関用点火装置の製造方法 |
JP2019007441A (ja) * | 2017-06-27 | 2019-01-17 | 日立オートモティブシステムズ阪神株式会社 | イグナイタ |
CN111916420A (zh) * | 2019-05-08 | 2020-11-10 | 三菱电机株式会社 | 半导体装置及其制造方法 |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54576A (en) * | 1977-06-03 | 1979-01-05 | Hitachi Ltd | Electronic parts |
JPH08204083A (ja) * | 1995-01-23 | 1996-08-09 | Tokin Corp | 半導体装置用リードフレーム |
JP2001274312A (ja) * | 2000-03-28 | 2001-10-05 | Sanyo Electric Co Ltd | 半導体装置およびその製造方法 |
JP2008060256A (ja) * | 2006-08-30 | 2008-03-13 | Renesas Technology Corp | 半導体装置 |
JP2008309146A (ja) * | 2007-05-16 | 2008-12-25 | Denso Corp | 内燃機関用点火装置 |
-
2013
- 2013-08-26 JP JP2013174807A patent/JP6492391B2/ja active Active
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54576A (en) * | 1977-06-03 | 1979-01-05 | Hitachi Ltd | Electronic parts |
JPH08204083A (ja) * | 1995-01-23 | 1996-08-09 | Tokin Corp | 半導体装置用リードフレーム |
JP2001274312A (ja) * | 2000-03-28 | 2001-10-05 | Sanyo Electric Co Ltd | 半導体装置およびその製造方法 |
JP2008060256A (ja) * | 2006-08-30 | 2008-03-13 | Renesas Technology Corp | 半導体装置 |
JP2008309146A (ja) * | 2007-05-16 | 2008-12-25 | Denso Corp | 内燃機関用点火装置 |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2019007440A (ja) * | 2017-06-27 | 2019-01-17 | 日立オートモティブシステムズ阪神株式会社 | 内燃機関用点火装置の製造方法 |
JP2019007441A (ja) * | 2017-06-27 | 2019-01-17 | 日立オートモティブシステムズ阪神株式会社 | イグナイタ |
CN111916420A (zh) * | 2019-05-08 | 2020-11-10 | 三菱电机株式会社 | 半导体装置及其制造方法 |
JP2020184578A (ja) * | 2019-05-08 | 2020-11-12 | 三菱電機株式会社 | 半導体装置およびその製造方法 |
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