JP2013195488A - 映像処理回路、映像処理方法および電子機器 - Google Patents
映像処理回路、映像処理方法および電子機器 Download PDFInfo
- Publication number
- JP2013195488A JP2013195488A JP2012059884A JP2012059884A JP2013195488A JP 2013195488 A JP2013195488 A JP 2013195488A JP 2012059884 A JP2012059884 A JP 2012059884A JP 2012059884 A JP2012059884 A JP 2012059884A JP 2013195488 A JP2013195488 A JP 2013195488A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- pixel
- video signal
- liquid crystal
- boundary
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/14—Picture signal circuitry for video frequency region
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3648—Control of matrices with row and column drivers using an active matrix
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2320/00—Control of display operating conditions
- G09G2320/02—Improving the quality of display appearance
- G09G2320/0209—Crosstalk reduction, i.e. to reduce direct or indirect influences of signals directed to a certain pixel of the displayed image on other pixels of said image, inclusive of influences affecting pixels in different frames or fields or sub-images which constitute a same image, e.g. left and right images of a stereoscopic display
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2320/00—Control of display operating conditions
- G09G2320/02—Improving the quality of display appearance
- G09G2320/0271—Adjustment of the gradation levels within the range of the gradation scale, e.g. by redistribution or clipping
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2340/00—Aspects of display data processing
Abstract
【解決手段】映像処理回路30は、ノーマリーブラックモードにおいて、映像信号Vid-inで指定される指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出する境界検出部と、前記境界検出部により検出された境界に接する前記第2画素から当該境界の反対方向へ連続するM画素(Mは1以上の整数)のうち、前記第2電圧よりも高い第3電圧を上回る前記第2画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Mを変化させて、前記第3電圧よりも低い第4電圧を指定する映像信号に補正する補正部とを備えることを特徴とする。
【選択図】図1
Description
本発明は、上述した事情に鑑みてなされたもので、その目的の一つは、リバースチルトドメインを低減させるための補正よって、非補正画素にリバースチルトドメインが発生するのを抑制することである。
本発明によれば、リバースチルトドメインを低減させるための補正よって、非補正画素にリバースチルトドメインが発生するのを抑制することができる。
本発明によれば、リバースチルトドメインを低減させるための補正よって、非補正画素にリバースチルトドメインが発生するのを抑制することができる。
本発明によれば、1画素当たりの映像信号の補正を抑えつつ、非補正画素にリバースチルトドメインが発生するのを抑制することができる。
本発明によれば、変化前からMを1だけ変化させた場合に比べて、非補正画素にリバースチルトドメインを発生しにくくすることができる。
本発明によれば、変化前からNを1だけ変化させた場合に比べて、非補正画素にリバースチルトドメインを発生しにくくすることができる。
<第1実施形態>
まず、本発明の第1実施形態について説明する。
図1は、本実施形態に係る映像処理回路を適用した液晶表示装置1の全体構成を示すブロック図である。
図1に示すように、液晶表示装置1は、制御回路10と、液晶パネル100と、走査線駆動回路130と、データ線駆動回路140とを備える。制御回路10には、映像信号Vid-inが上位装置から同期信号Syncに同期して供給される。映像信号Vid-inは、液晶パネル100における各画素の階調レベルをそれぞれ指定するデジタルデータであり、同期信号Syncに含まれる垂直走査信号、水平走査信号およびドットクロック信号(いずれも図示省略)に従った走査の順番で供給される。本実施形態では、映像信号Vid-inが供給される周波数が60Hzであり、その逆数である周期16.67ミリ秒で1フレーム(1コマ)の画像を表示するための映像信号Vid-inが供給される。
なお、映像信号Vid-inは階調レベルを指定するが、階調レベルに応じて液晶素子の印加電圧が定まるので、映像信号Vid-inは液晶素子の印加電圧を指定するものといって差し支えない。以下の説明において、映像信号の階調レベルが高いほど液晶素子に対して指定する印加電圧が高いものとする。
なお、この実施形態では、走査線112を区別するために、図において上から順に1、2、3、…、(m−1)、m行目という呼び方をする場合がある。同様に、データ線114を区別するために、図において左から順に1、2、3、…、(n−1)、n列目という呼び方をする場合がある。
なお、図1において、素子基板100aの対向面は紙面裏側であるので、当該対向面に設けられる走査線112、データ線114、TFT116および画素電極118については、破線で示すべきであるが、見難くなるのでそれぞれ実線で示す。
図2に示すように、液晶パネル100は、走査線112とデータ線114との交差に対応して、画素電極118とコモン電極108とで液晶105を挟持した液晶素子120が配列した構成である。図1では省略したが、液晶パネル100における等価回路では、実際には図2に示すように、液晶素子120に対して並列に補助容量(蓄積容量)125が設けられる。補助容量125は、一端が画素電極118に接続され、他端が容量線115に共通接続されている。容量線115は時間的に一定の電圧に保たれている。
ここで、走査線112がHレベルになると、その走査線にゲート電極が接続されたTFT116がオンとなり、画素電極118がデータ線114に接続される。このため、走査線112がHレベルであるときに、データ線114に階調に応じた電圧のデータ信号を供給すると、そのデータ信号は、オンしたTFT116を介して画素電極118に印加される。走査線112がLレベルになると、TFT116はオフするが、画素電極118に印加された電圧は、液晶素子120の容量性および補助容量125によって保持される。
液晶素子120では、画素電極118およびコモン電極108によって生じる電界に応じて液晶105の分子配向状態が変化する。このため、液晶素子120は、透過型であれば、印加・保持電圧に応じた透過率となる。液晶パネル100では、液晶素子120毎に透過率が変化するので、液晶素子120が画素に相当する。そして、この画素の配列領域が表示領域101となる。
なお、本実施形態においては、液晶105をVA方式として、液晶素子120が電圧無印加時において黒状態となるノーマリーブラックモードとする。
なお、フレームとは、液晶パネル100を駆動することによって、画像の1コマ分を液晶パネル100に表示させるのに要する期間をいう。本実施形態では、同期信号Syncにより制御される垂直走査信号の周波数が240Hzである。図5(a)に示すように、本実施形態の液晶表示装置1では、1フレームをそれぞれ第1フィールド〜第4フィールドまでの4つのフィールドに分けるとともに、各フィールドで、1〜m行目の走査線を走査する、いわゆる4倍速駆動を実現する。すなわち、上位装置から60Hzの供給速度で供給される映像信号Vid-inに基づいて、液晶表示装置1が240Hzの駆動速度で液晶パネル100を駆動することで、映像信号Vid-inに基づいて1フレームの画像を表示することとなる。1フィールドの期間は、1/4フレーム期間に相当し、ここではおよそ4.16ミリ秒である。また、図5(b)に示すように、液晶表示装置1では、第1,3フィールドにおいて正極性書込を指定し、第2,4フィールドにおいて負極性書込を指定し、フィールド毎に書込極性を反転して、画素へのデータの書き込みを行う。
なお、本説明において電圧については、液晶素子120の印加電圧を除き、特に明記しない限り図示省略した接地電位を電圧ゼロの基準とする。液晶素子120の印加電圧は、コモン電極108の電圧LCcomと画素電極118との電位差であり、他の電圧と区別するためである。
なお、液晶パネル100が、白画素を背景とした黒画素の領域がフレーム毎に2画素以上ずつ移動するとき、液晶素子の応答時間が表示画面が更新される時間間隔(つまり、1フレーム期間)より短ければ、このような尾引き現象は顕在化しない(または、視認されにくい)。この理由は、次のように考えられる。すなわち、あるフレームにおいて、白画素と黒画素とが隣接したときに、その白画素でリバースチルトドメインが発生するかもしれないが、画像の動きを考えると、リバースチルトドメインが発生する画素が離散的となるので、視覚的に目立たない、と考えられるからである。
なお、図27において見方を変えると、黒画素を背景として白画素が連続する白パターンがフレーム毎に1画素ずつ右方向に移動する場合に、その白パターンの右端縁部(動きの先端部)において黒画素から白画素に変化すべき画素がリバースチルトドメインの発生によって白画素にならない、ということもできる。また、図27においては、説明の便宜上、画像のうち、1ラインの境界付近を抜き出している。
ここで、横電界の影響を受ける場合とは、互いに隣り合う画素電極同士の電位差が大きくなる場合であり、これは、表示しようとする画像において黒レベルの(または黒レベルに近い)暗画素と、白レベルの(または白レベルに近い)明画素とが隣接する場合である。
このうち、暗画素については、印加電圧がノーマリーブラックモードにおける黒レベルの電圧Vbk以上であって閾値Vth1(第1電圧)を下回る電圧範囲Aにある液晶素子120の画素をいうことにする。また、便宜的に、液晶素子の印加電圧が電圧範囲Aにある液晶素子の透過率範囲(階調範囲)を「a」とする。
次に、明画素については、印加電圧が閾値Vth2(第2電圧)以上であってノーマリーブラックモードにおける白レベル電圧Vwt以下の電圧範囲Bにある液晶素子120とする。便宜的に、液晶素子の印加電圧が電圧範囲Bにある液晶素子の透過率範囲(階調範囲)を「b」とする。
なお、ノーマリーブラックモードにおいて、閾値Vth1は、液晶素子の相対透過率を10%とさせる光学的閾値電圧であり、閾値Vth2は、液晶素子の相対透過率を90%とさせる光学的飽和電圧である。ただし、閾値Vth1及び閾値Vth2は、Vth2>Vth1の条件の下、それぞれ他の相対透過率に対応した電圧であってもよい。
液晶素子120の印加電圧として判定電圧Vjbを規定する映像信号の階調レベルを、判定レベルjbとする。
判定レベルjbは、階調範囲aに属する階調レベルである。補正レベルcbは、少なくとも判定レベルjb以上の階調レベルであるが、ここでは、階調範囲aを上回り、且つ階調範囲bを下回る階調レベルの範囲である階調範囲dに属する。
図6(b)において、映像信号Vid-inに対応する映像信号Vid-outにあっては、図中上から順に、第1,第2,第3,第4フィールドに対応する映像信号Vid-outをそれぞれ表している。
このような考えに基づいて、現フレームの映像信号Vid-inを処理して、液晶パネル100でリバースチルトドメインの発生を未然に防ぐための回路が、図3における映像処理回路30である。
遅延回路302は、FIFO(First In First Out:先入れ先出し)メモリーや多段のラッチ回路などにより構成され、上位装置から供給される映像信号Vid-inを蓄積して、所定時間経過後に読み出して映像信号Vid-dとして出力するものである。なお、遅延回路302における蓄積及び読出は、走査制御回路20によって制御される。
現フレーム境界検出部3041は、現フレームの映像信号Vid-inで示す画像を解析して、階調範囲aにある暗画素と階調範囲bにある明画素とが隣接する部分があるか否かを判別する。そして、現フレーム境界検出部3041は、隣接する部分があると判別したとき、その隣接部分である境界を検出して、境界の位置情報を出力する(第1境界検出部)。
前フレーム境界検出部3042は、前フレームの映像信号Vid-inで示される画像を解析して、暗画素と明画素とが隣接する部分を境界として検出する。前フレーム境界検出部3042は、映像信号Vid-inに基づいて現フレーム境界検出部3041と同じ手順の処理を実行して境界を検出し、検出した境界の位置情報を出力する。
保存部3043は、前フレーム境界検出部3042によって検出された境界の位置情報を保存して、1フレーム期間だけ遅延させて出力するものである。
したがって、現フレーム境界検出部3041で検出される境界は現フレームに係るものであるのに対し、前フレーム境界検出部3042で検出されて保存部3043に保存される境界は、前フレームに係るものとなる。すなわち、前フレーム境界検出部3042は、前フレームの入力映像信号における暗画素と明画素との境界を検出する(第2境界検出部)。
なお、現フレーム境界検出部3041は、ある程度(少なくとも3行以上)の映像信号を蓄積してからでないと、表示すべき画像における垂直または水平方向にわたって境界を検出することができない。前フレーム境界検出部3042についても同様である。このため、上位装置からの映像信号Vid-inの供給タイミングを調整する意味で、遅延回路302が設けられている。
以上が、境界検出部304の構成の説明である。
なお、暗画素の或る一角において縦横に連続する境界が位置している暗画素や明画素の或る一角において縦横に連続する境界が位置している明画素も、「境界に接している」と扱う。これは、斜め方向に1画素だけ画像が移動したときに対処するためである。これに対して、暗画素の或る一角において縦または横のみに断裂した境界が位置する暗画素や明画素の或る一角において縦または横のみに断裂した境界が位置する明画素については、縦横で連続した境界が位置していないので、境界に接しているとは見做さない。
ここで、1行1列〜1行n列の映像信号Vid-outが出力される水平有効走査期間(Ha)でみたときに、処理された映像信号Vid-outは、奇数フィールドか偶数フィールドかに応じてフィールド毎に書込極性が入れ替わるように、D/A変換器308によって、図5(b)で示すように正極性または負極性のデータ信号Vxに変換される。第1フィールドでは正極性のデータ信号に変換される。このデータ信号Vxは、データ線駆動回路140によって1〜n列目のデータ線114にデータ信号X1〜Xnとしてサンプリングされる。
一方、1行1列〜1行n列の映像信号Vid-outが出力される水平走査期間では、走査制御回路20が走査線駆動回路130に対し走査信号Y1だけをHレベルとなるように制御する。走査信号Y1がHレベルであれば、1行目のTFT116がオン状態になるので、データ線114にサンプリングされたデータ信号は、オン状態にあるTFT116を介して画素電極118に印加される。これにより、1行1列〜1行n列の液晶素子には、それぞれ映像信号Vid-outで指定された階調レベルに応じた正極性電圧が書き込まれる。
2行1列〜2行n列の映像信号Vid-outが出力される水平走査期間では、走査線駆動回路130によって走査信号Y2だけがHレベルとなるので、データ線114にサンプリングされたデータ信号は、オン状態にある2行目のTFT116を介して画素電極118に印加される。これにより、2行1列〜2行n列の液晶素子には、それぞれ映像信号Vid-outで指定された階調レベルに応じた正極性電圧が書き込まれる。
以下同様な書込動作が3、4、…、m行目に対して実行され、これにより、各液晶素子に、映像信号Vid-outで指定された階調レベルに応じた電圧が書き込まれて、映像信号Vid-inで規定される透過像が作成されることなる。
次のフィールドでは、データ信号の極性反転によって映像信号Vid-outが負極性のデータ信号に変換される以外、同様な書込動作が実行される。
詳細には、データ信号Vxの電圧は、正極性であれば、白に相当する電圧Vw(+)から黒に相当する電圧Vb(+)までの範囲で、一方、負極性であれば、白に相当する電圧Vw(-)から黒に相当する電圧Vb(-)までの範囲で、それぞれ基準電圧Vcntから階調に応じた分だけ偏位させた電圧となる。
電圧Vw(+)および電圧Vw(-)は、電圧Vcntを中心に互いに対称の関係にある。電圧Vb(+)およびVb(-)についても電圧Vcntを中心に互いに対称の関係にある。
なお、図5(b)は、データ信号Vxの電圧波形を示すものであって、液晶素子120に印加される電圧(画素電極118とコモン電極108との電位差)とは異なる。また、図5(b)におけるデータ信号の電圧の縦スケールは、図5(a)における走査信号等の電圧波形と比較して拡大してある。
(第1実施形態の変形例1)上述した第1実施形態において、補正部306は、第1フィールドと第3フィールドとを同じ補正画素数とし、第2フィールドと第4フィールドとを同じ補正画素数としていたが、同じ補正画素数とする組み合わせはこれに限らない。例えば、図10に示すように、補正部306は、第1フィールドと第2フィールドとを同じ補正画素数とし、第3フィールドと第4フィールドとを同じ補正画素数としてもよい。
また、補正部306は、明画素及び暗画素のそれぞれについて補正レベルを3種類以上としてもよい。
次に、本発明の第2実施形態について説明する。
この実施形態では、映像処理回路30は、液晶分子のチルト方位角及びチルト角を考慮して補正画素をさらに絞り込む点で、上述した第1実施形態と相違する。液晶分子のチルト方位角及びチルト角を考慮する根拠についてまず説明する。
上述したように、変化前において液晶分子が不安定な状態にあった画素は、画像の動きによって暗画素と明画素とが隣接することになったときの横電界の影響によって、リバースチルトドメインが発生しやすい状況にあるということができる。ただし、液晶分子の初期配向状態を考慮して検討すると、暗画素と明画素との位置関係によってリバースチルトドメインが発生する場合と発生しない場合とがある。
図14に示すように、VA方式の液晶分子は、画素電極118とコモン電極108との電位差(液晶素子の印加電圧)がゼロである状態において、チルト角がθaで、チルト方位角がθb(=45度)で、初期配向しているものとする。ここで、リバースチルトドメインは、上述したように画素電極118同士の横電界に起因して発生することから、画素電極118が設けられた素子基板100aの側における液晶分子の振る舞いが問題となる。このため、液晶分子のチルト方位角およびチルト角については、画素電極118(素子基板100a)の側を基準にして規定する。
一方、チルト方位角θbとは、データ線114の配列方向であるY方向に沿った基板垂直面を基準にして、液晶分子の長軸Saおよび基板法線Svを含む基板垂直面(p−q線を含む垂直面)がなす角度とする。なお、チルト方位角θbについては、画素電極118の側からコモン電極108に向けて平面視したときに、画面上方向(Y方向の反対方向)から、液晶分子の長軸の一端を始点として他端に向かう方向(図14(a)では右上方向)までを、時計回りで規定した角度とする。
また、同様に画素電極118の側から平面視したときに、液晶分子における画素電極側の一端から他端に向かう方向を便宜的にチルト方位の下流側と呼び、反対に他端から一端に向かう方向(図14(a)では左下方向)を便宜的にチルト方位の上流側と呼ぶことにする。
すなわち、
(1)nフレームに着目したときに暗画素と明画素とが隣接して、すなわち、印加電圧が低い状態の画素と印加電圧が高い状態の画素とが隣接して、横電界が強くなる場合であって、かつ、
(2)nフレームにおいて、当該明画素(印加電圧高)が、隣接する暗画素(印加電圧低)に対して、液晶分子におけるチルト方位の上流側に相当する左下側、左側又は下側に位置する場合に、
(3)nフレームにおいて当該明画素に変化する画素が、1フレーム前の(n−1)フレームでは、液晶分子が不安定な状態にあったとき、
nフレームにおいて当該明画素でリバースチルトが発生する、ということになる。
既に理由を説明したが、(2)において、暗画素と明画素とが隣接する部分を示す境界が、前フレームから1画素だけ移動しているときには、より一層リバースチルトドメインの影響を受けやすくなると考えられる。
このような考えに基づいて、現フレームの映像信号Vid-inを処理して、液晶パネル100でリバースチルトドメインの発生を未然に防ぐための回路が、図15における映像処理回路30である。
境界検出部304aは、第1実施形態の境界検出部304の構成に加えて、リスク境界検出部3046を有している。リスク境界検出部3046は、現フレームの映像信号Vid-inで示す画像を解析して、階調範囲aにある暗画素と階調範囲bにある明画素とが垂直又は水平方向で隣接する部分があるか否かを判別する。そして、リスク境界検出部3046は、隣接する部分があると判別したときに、その隣接部分の境界の一部分であって、暗画素が上側に位置し明画素が下側に位置する部分と、暗画素が右側に位置し明画素が左側に位置する部分とを抽出して、これをリスク境界として検出して、境界の位置情報を出力する。このようにして、リスク境界検出部3046は、暗画素と明画素との境界の一部の境界であって、液晶105のチルト方位で定まるリスク境界を検出する(第1境界検出部)。
補正部306は、上述した第1実施形態と同様、判別部3045aから供給されるフラグQに従って動作する(図9〜13参照)。
上述した第2実施形態では、VA方式においてチルト方位角θbが45度である場合を例にとって説明したが、特開2011−107174号公報にも開示されているように、チルト方位角θbが別の角度であっても、第1実施形態よりも補正画素を減らすことが可能である。チルト方位角θbが225度である例について説明する。
まず、図17(a)に示すように、自画素および周辺画素において液晶分子が不安定な状態から自己画素だけ明画素に変化したとき、当該自己画素においてリバースチルトは、図17(b)に示すように、左辺および下辺に沿った内周領域で発生する。なお、この例では、図14に示したチルト方位角θbが45度である場合の例を180度回転させたときと等価である。
チルト方位角θbが225度である場合には、チルト方位角θbが45度である場合にリバースチルトドメインが発生する要件(1)〜(3)のうち、として、要件(2)を次のように修正する。すなわち、
(2)nフレームにおいて、当該明画素(印加電圧高)が、隣接する暗画素(印加電圧低)に対して、液晶分子におけるチルト方位の上流側に相当する右上側、右側又は上側に位置する場合に、
と修正する。なお、要件(1)及び要件(3)についての変更はない。
したがって、チルト方位角θbが225度であれば、nフレームにおいて、暗画素と明画素とが隣接する場合であって、当該暗画素が、当該明画素に対して反対に左下側、左側又は下側に位置する場合、当該暗画素に相当する液晶素子に対し、液晶分子が不安定な状態とならないような措置を施してやればよい。
このためには、映像処理回路30における補正部306が、前フレームから現フレームにかけて変化した境界のうち、暗画素が下側に位置し明画素が上側に位置する部分と、暗画素が左側に位置し明画素が右側に位置する部分のリスク境界に基づいて映像信号を補正するとよい。
よって、チルト方位角θbが225度である場合、図7(a)から図7(b)のように変化する画像は、図19(a)に示すようにリスク境界が検出される。そして、リスク境界であり、かつ、適用境界である境界は、図20(a)に示すとおりになる。
このため、チルト方位角θbが90度である場合には、チルト方位角θbが45度である場合にリバースチルトドメインが発生する要件(1)〜(3)のうち、として、要件(2)を次のように修正する。すなわち、
(2)nフレームにおいて、当該明画素(印加電圧高)が、隣接する暗画素(印加電圧低)に対して、液晶分子におけるチルト方位の上流側に相当する左側のみならず、その左側で発生する領域の影響を受ける上側又は下側に位置する場合に、
と修正する。なお、要件(1)及び要件(3)についての変更はない。
このためには、映像処理回路30における補正部306が、前フレームから現フレームにかけて変化した境界のうち、暗画素が右側に位置し明画素が左側に位置する部分と、暗画素が上側に位置し明画素が下側に位置する部分と、暗画素が下側に位置し明画素が上側に位置する部分のリスク境界に基づいて映像信号を補正するとよい。
よって、チルト方位角θbが90度である場合、図7(a)から図7(b)のように変化する画像は、図19(b)に示すようにリスク境界が検出される。そして、リスク境界であり、かつ、適用境界である境界は、図20(b)に示すとおりになる。
次に、本発明の第3実施形態について説明する。
以下の説明において、第3実施形態と同じ構成については同一の符号を付して表し、その説明については適宜省略する。
本実施形態の映像処理回路30は、現フレームにおいて暗画素と明画素とが隣接する境界を検出し、該検出した境界のうち、前フレームから現フレームにかけて1画素だけ移動した境界に接する暗画素を補正画素とし、それ以外の画素を補正画素としない。上述した第1実施形態で図27を用いて既に説明したように、明画素を背景とした暗画素の領域がフレーム毎に2画素以上ずつ移動するときに、このような尾引き現象は顕在化しない(又は、視認されにくい)。そこで、映像処理回路30がこのような1画素だけ移動した境界の隣接画素を補正画素の要件とすれば、補正画素数を更に減らせる。
図21に示すように、図21(a)に示す画像から図21(b)に示す画像に変化して、前フレームから現フレームにかけて図示のように変化した境界であっても、映像処理回路30は、図21(c)に示すように、1pixel/1flame(1フレームあたり1画素移動)の移動の条件を満たす境界に基づいて補正画素を定め、例えば2画素分境界が移動したような境界に基づいては補正画素を定めない。
これにより、補正部306は、リバースチルトドメインがより発生しやすい箇所に更に絞り込んで補正することができる。
次に、本発明の第4実施形態を説明する。
補正画素が多くなった場合、補正画素に起因する表示背反が目立つおそれがある。そこで、本実施形態では、画像の動きを考慮して以下のように補正画素の画素を定める。
図22から図24において、(a)は、1ラインの画像の画素におけるNフレームからN+5フレームまでの画像の動きの様子を説明する図であり、(b)は、(a)において右から2番目に位置する画素Pの透過率の時系列変化を説明するグラフである。
図22(a)に示すような、画像の移動方向(図中右方向)における暗画素の連続数が少ない表示パターン(ここでは、白画素を背景とした連続2画素の暗画素のパターン)が、1pixel/frameで動いた場合を考える。この場合、画素Pに注目すると、N+2及びN+3フレーム目において階調範囲aに属する電圧Vaが印加され、その前後のフレームでは階調範囲bに属する電圧Vbが印加される。仮に液晶の応答速度を無視すれば、N+2及びN+3フレーム目において、画素Pは、図22(b)に「Vaの静的透過率」と示した透過率に達するはずである。しかし、実際には、図22(b)に示すように、N+3フレーム目終了時点における透過率は、電圧Vaを印加したときの静的透過率よりも高い。これは、液晶素子の応答速度に対して電圧Vaの印加期間が短いことによるものである。このとき、液晶のチルト角はプレチルト角よりも大きい状態となっているから、仮にこの暗画素に強い横電界が掛かったとしても、リバースチルトドメインは発生しにくい。このような考えから、このような暗画素については、本実施形態ではリバースチルトドメインを低減させるための補正画素としない。
なお、応答時間Tについては、例えば、明画素の最大階調を示す電圧Vwtが印加されたときの静的透過率の液晶素子が、閾値Vth1を下回る電圧(例えば、最小階調を示す電圧Vbk)が印加されたときの静的透過率に達するまでの時間を事前に調べておけばよい。
図25(a)に示すような1ラインの画像があった場合、図25(b)に示すように、この1ラインの画像を構成する画素が補正される。具体的には、両側から明画素に挟まれた暗画素が連続して5つ並ぶ場合、暗画素の連続数R(=5)が応答時間Tを時間間隔Sで割った値の整数部の値に1を加えた値(つまり3)以上であるから、これらの暗画素のうち、明画素に隣接している2つの暗画素が補正対象となって階調レベルcbの映像信号に補正される。一方、両側から明画素に挟まれた暗画素が連続して2つ並ぶ場合、暗画素の連続数R(=2)が応答時間Tを時間間隔Sで割った値の整数部の値に1を加えた値(つまり3)未満であるであるから、これらの暗画素は補正対象とならない。
(変形例1)
上述した各実施形態において、映像処理回路30は、明画素及び暗画素の双方を補正画素としていたが、明画素又は暗画素の一方のみを補正画素としてもよい。
上述した各実施形態において、映像処理回路30は、前フレームから現フレームにかけて変化する境界を検出し、検出した境界に接する画素により補正対画素を定めていた。映像処理回路30が、前フレーム境界検出部3042、保存部3043及び適用境界決定部3044に相当する構成を有していなくても、本発明を特定可能である。このような映像処理回路30の構成であっても、リバースチルトドメインを低減させるための補正によって、非補正画素にリバースチルトドメインが発生するのを抑制することができる。
上述した各実施形態では、液晶105にVA方式を用いた例について説明したがTN方式としてもよい。その理由は特開2011−107174号公報にも開示されているとおりである。
補正部306が映像信号を補正する場合に、表示領域101の画像の明るさに応じた階調レベルの映像信号に補正してもよい。例えば、補正部306は、表示領域101の明るさの指標となる情報を取得し、取得した情報により定まる明るさのレベルが高い(つまり、明るい)ほど、補正後の映像信号の階調レベルを高くする。このようにするのは、表示領域101が明るいほど、補正による階調レベルの変化が目立ちにくいためであり、リバーススチルトドメインの低減を優先させるために補正後の階調レベルを高くしても表示背反がユーザーに知覚されにくい、ということである。表示領域101の明るさの指標となる情報としては、表示領域101周辺の映像表示環境の明るさ(例えば照度)がある。この場合、液晶表示装置1に設けられた光センサーの検知結果を補正部306が取得して、補正部306は補正後の階調レベルを決定すればよい。これ以外にも、補正部306は、入力映像信号の階調レベルを、明るさの指標となる情報(例えば、1フレームの入力映像信号の階調レベルの平均値)として取得してもよい。高階調レベルの映像信号の画像を表示する場合ほど、表示領域101も明るくなるからである。また、補正部306は、表示領域101に表示される画像の明るさ又はコントラスト比を規定する複数の映像表示モードのいずれかを指定するモード情報を取得してもよい。補正部306は、映像表示モードで定まる輝度又はコントラスト比に応じた補正量を用いる。この場合、補正部306は、いわゆるダイナミックモード>通常モード>省電力モードの順で階調レベルを高くするといった具合に、表示モードに応じた階調レベルの映像信号に補正すればよい。
また、補正後の映像信号(液晶素子120の印加電圧)の決定の仕方について、補正部306は、演算式を用いて算出する構成のほか、ルックアップテーブルを参照する構成であってもよい。
また、本発明の映像処理回路は、4倍速駆動に限られず、例えば2倍速や8倍速駆動などの倍速駆動を採用する液晶表示装置にも適用可能である。また、本発明の映像処理回路は、倍速駆動を採用する液晶表示装置に適用されるものでなくてもよい。例えば、映像処理回路は、1コマ分の映像信号Vid-inに対応した表示期間(例えば、複数フレーム期間)の少なくとも一部を補正期間とし、補正画素数を動的に変化させればよい。
上述した各各実施形態において、映像信号Vid-inは、画素の階調レベルを指定するものとしたが、液晶素子の印加電圧を直接的に指定するものとしてもよい。映像信号Vid-inが液晶素子の印加電圧を指定する場合、指定される印加電圧によって境界を判別して、電圧を補正する構成とすればよい。
また、各実施形態において、液晶素子120は、透過型に限られず、反射型であってもよい。
次に、上述した実施形態に係る液晶表示装置を用いた電子機器の一例として、液晶パネル100をライトバルブとして用いた投射型表示装置(プロジェクター)について説明する。図26は、このプロジェクターの構成を示す平面図である。
この図に示すように、プロジェクター2100の内部には、ハロゲンランプ等の白色光源からなるランプユニット2102が設けられている。このランプユニット2102から射出された投射光は、内部に配置された3枚のミラー2106および2枚のダイクロイックミラー2108によってR(赤)色、G(緑)色、B(青)色の3原色に分離されて、各原色に対応するライトバルブ100R、100Gおよび100Bにそれぞれ導かれる。なお、B色の光は、他のR色やG色と比較すると、光路が長いので、その損失を防ぐために、入射レンズ2122、リレーレンズ2123および出射レンズ2124からなるリレーレンズ系2121を介して導かれる。
ライトバルブ100R、100G、100Bによってそれぞれ変調された光は、ダイクロイックプリズム2112に3方向から入射する。そして、このダイクロイックプリズム2112において、R色およびB色の光は90度に屈折する一方、G色の光は直進する。したがって、各原色の画像が合成された後、スクリーン2120には、投射レンズ2114によってカラー画像が投射されることとなる。
Claims (9)
- 画素毎に液晶素子の印加電圧を指定する入力映像信号を補正し、補正した映像信号に基づいて前記液晶素子の印加電圧をそれぞれ規定する映像処理回路であって、
入力映像信号で指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出する境界検出部と、
前記境界検出部により検出された境界に接する前記第2画素から当該境界の反対方向へ連続するM画素(Mは1以上の整数)のうち、前記第2電圧よりも高い第3電圧を上回る前記第2画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Mを変化させて、前記第3電圧以下である第4電圧を指定する映像信号に補正する補正部と
を備えることを特徴とする映像処理回路。 - 画素毎に液晶素子の印加電圧を指定する入力映像信号を補正し、補正した映像信号に基づいて前記液晶素子の印加電圧をそれぞれ規定する映像処理回路であって、
入力映像信号で指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出する境界検出部と、
前記境界検出部により検出された境界に接する前記第1画素から当該境界の反対方向へ連続するN画素(Nは1以上の整数)のうち、前記第1電圧よりも低い第5電圧を下回る前記第1画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Nを変化させて、前記第5電圧以上である第6電圧を指定する映像信号に補正する補正部と
を備えることを特徴とする映像処理回路。 - 前記補正部は、
前記境界検出部により検出された境界に接する前記第1画素から当該境界の反対方向へ連続するN画素(Nは1以上の整数)のうち、前記第1電圧よりも低い第5電圧を下回る前記第1画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Nを変化させて、前記第5電圧以上である第6電圧を指定する映像信号に補正する補正部と
を備えることを特徴とする請求項1に記載の映像処理回路。 - 前記補正部は、
前記Mを変化前から2以上変化させる
ことを特徴とする請求項1又は3に記載の映像処理回路。 - 前記補正部は、
前記Nを変化前から2以上変化させる
ことを特徴とする請求項2又は3に記載の映像処理回路。 - 画素毎に液晶素子の印加電圧を指定する入力映像信号を補正し、補正した映像信号に基づいて前記液晶素子の印加電圧をそれぞれ規定する映像処理方法であって、
入力映像信号で指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出し、
検出した境界に接する前記第2画素から当該境界の反対方向へ連続するM画素(Mは1以上の整数)のうち、前記第2電圧よりも高い第3電圧を上回る前記第2画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Mを変化させて、前記第3電圧以下である第4電圧を指定する映像信号に補正する
ことを特徴とする映像処理方法。 - 画素毎に液晶素子の印加電圧を指定する入力映像信号を補正し、補正した映像信号に基づいて前記液晶素子の印加電圧をそれぞれ規定する映像処理方法であって、
入力映像信号で指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出し、
検出した境界に接する前記第1画素から当該境界の反対方向へ連続するN画素(Nは1以上の整数)のうち、前記第1電圧よりも低い第5電圧を下回る前記第1画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Nを変化させて、前記第5電圧以上である高い第6電圧を指定する映像信号に補正する
ことを特徴とする映像処理方法。 - 複数の画素の各々に対応して画素電極が設けられた第1基板と、コモン電極が設けられた第2基板とで液晶を挟持し、前記画素電極、前記液晶および前記コモン電極で液晶素子が構成された液晶パネルと、
画素毎に液晶素子の印加電圧を指定する入力映像信号を補正し、補正した映像信号に基づいて前記液晶素子の印加電圧をそれぞれ規定する映像処理回路と
を有する液晶表示装置を備え、
前記映像処理回路が、
入力映像信号で指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出する境界検出部と、
前記境界検出部により検出された境界に接する前記第2画素から当該境界の反対方向へ連続するM画素(Mは1以上の整数)のうち、前記第2電圧よりも高い第3電圧を上回る前記第2画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なくとも一部である補正期間において、当該補正期間内で前記Mを変化させて、前記第3電圧以下である第4電圧を指定する映像信号に補正する補正部と
を有することを特徴とする電子機器。 - 複数の画素の各々に対応して画素電極が設けられた第1基板と、コモン電極が設けられた第2基板とで液晶を挟持し、前記画素電極、前記液晶および前記コモン電極で液晶素子が構成された液晶パネルと、
画素毎に液晶素子の印加電圧を指定する入力映像信号を補正し、補正した映像信号に基づいて前記液晶素子の印加電圧をそれぞれ規定する映像処理回路と
を有する液晶表示装置を備え、
前記映像処理回路が、
入力映像信号で指定される印加電圧が第1電圧を下回る第1画素と、前記印加電圧が前記第1電圧よりも高い第2電圧を上回る第2画素との境界を検出する境界検出部と、
前記境界検出部により検出された境界に接する前記第1画素から当該境界の反対方向へ連続するN画素(Nは1以上の整数)のうち、前記第1電圧よりも低い第5電圧を下回る前記第1画素に対応する液晶素子への印加電圧を指定する映像信号を、当該映像信号に対応した表示期間の少なく以上である第6電圧を指定する映像信号に補正する補正部と
を有することを特徴とする電子機器。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012059884A JP6078959B2 (ja) | 2012-03-16 | 2012-03-16 | 映像処理回路、映像処理方法および電子機器 |
US13/794,195 US9241092B2 (en) | 2012-03-16 | 2013-03-11 | Signal processing device, liquid crystal apparatus, electronic equipment, and signal processing method |
TW102108715A TW201340087A (zh) | 2012-03-16 | 2013-03-12 | 信號處理裝置、液晶裝置、電氣機器及信號處理方法 |
CN201310084270.0A CN103310751B (zh) | 2012-03-16 | 2013-03-15 | 信号处理装置、液晶装置、电子设备及信号处理方法 |
KR20130027855A KR20130105532A (ko) | 2012-03-16 | 2013-03-15 | 신호 처리 장치, 액정 장치, 전기 기기 및 신호 처리 방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2012059884A JP6078959B2 (ja) | 2012-03-16 | 2012-03-16 | 映像処理回路、映像処理方法および電子機器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2013195488A true JP2013195488A (ja) | 2013-09-30 |
JP6078959B2 JP6078959B2 (ja) | 2017-02-15 |
Family
ID=49135907
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2012059884A Active JP6078959B2 (ja) | 2012-03-16 | 2012-03-16 | 映像処理回路、映像処理方法および電子機器 |
Country Status (5)
Country | Link |
---|---|
US (1) | US9241092B2 (ja) |
JP (1) | JP6078959B2 (ja) |
KR (1) | KR20130105532A (ja) |
CN (1) | CN103310751B (ja) |
TW (1) | TW201340087A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017053972A (ja) * | 2015-09-08 | 2017-03-16 | キヤノン株式会社 | 液晶駆動装置、画像表示装置および液晶駆動プログラム |
US10109254B2 (en) | 2014-01-22 | 2018-10-23 | Seiko Epson Corporation | Video processing circuit, video processing method, electro-optical device, and electronic apparatus |
US10163382B2 (en) | 2015-09-08 | 2018-12-25 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus capable of reducing degradation in image quality due to disclination, and storage medium storing liquid crystal drive program capable thereof |
US10198985B2 (en) | 2015-09-08 | 2019-02-05 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus and storage medium storing liquid crystal drive program |
US10229625B2 (en) | 2015-09-08 | 2019-03-12 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus and storage medium storing liquid crystal drive program |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6078959B2 (ja) * | 2012-03-16 | 2017-02-15 | セイコーエプソン株式会社 | 映像処理回路、映像処理方法および電子機器 |
KR102523424B1 (ko) | 2018-02-19 | 2023-04-20 | 삼성디스플레이 주식회사 | 액정 표시 패널의 구동 장치 및 이를 포함하는 액정 표시 장치 |
US10777155B1 (en) * | 2019-07-16 | 2020-09-15 | Himax Technologies Limited | Method for controlling polarity of each subpixels of display panel by using pattern detection manner |
US11145269B2 (en) * | 2019-08-02 | 2021-10-12 | Sakai Display Products Corporation | Display apparatus accurately reducing display non-uniformity |
KR102651861B1 (ko) | 2020-06-23 | 2024-03-27 | 엘지디스플레이 주식회사 | 디스플레이 장치, 데이터 구동 회로 및 디스플레이 패널 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010066442A (ja) * | 2008-09-10 | 2010-03-25 | Seiko Epson Corp | 液晶装置及び電子機器 |
JP2011107497A (ja) * | 2009-11-19 | 2011-06-02 | Seiko Epson Corp | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP2011145501A (ja) * | 2010-01-15 | 2011-07-28 | Seiko Epson Corp | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP2011175200A (ja) * | 2010-02-25 | 2011-09-08 | Seiko Epson Corp | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
Family Cites Families (22)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5045278B2 (ja) | 2006-07-18 | 2012-10-10 | ソニー株式会社 | 液晶表示装置および液晶表示装置の駆動方法 |
US20080018630A1 (en) | 2006-07-18 | 2008-01-24 | Yusuke Fujino | Liquid crystal display device, liquid crystal display and method of driving liquid crystal display device |
JP2008281947A (ja) | 2007-05-14 | 2008-11-20 | Toshiba Corp | 液晶表示装置 |
JP4720843B2 (ja) | 2008-03-27 | 2011-07-13 | ソニー株式会社 | 映像信号処理回路、液晶表示装置及び投射型表示装置 |
JP4661965B2 (ja) * | 2009-02-18 | 2011-03-30 | ソニー株式会社 | 液晶表示装置 |
JP5233920B2 (ja) * | 2009-09-01 | 2013-07-10 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5229162B2 (ja) | 2009-09-01 | 2013-07-03 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5370021B2 (ja) * | 2009-09-07 | 2013-12-18 | セイコーエプソン株式会社 | 液晶表示装置、駆動方法および電子機器 |
JP5454092B2 (ja) | 2009-11-12 | 2014-03-26 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5304669B2 (ja) * | 2010-01-25 | 2013-10-02 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5304684B2 (ja) | 2010-02-22 | 2013-10-02 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5598014B2 (ja) | 2010-02-22 | 2014-10-01 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5370214B2 (ja) | 2010-02-25 | 2013-12-18 | セイコーエプソン株式会社 | 映像処理回路、映像処理方法、液晶表示装置および電子機器 |
JP5381807B2 (ja) * | 2010-02-25 | 2014-01-08 | セイコーエプソン株式会社 | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP5381804B2 (ja) | 2010-02-25 | 2014-01-08 | セイコーエプソン株式会社 | 映像処理回路、映像処理方法、液晶表示装置および電子機器 |
JP5601173B2 (ja) | 2010-11-26 | 2014-10-08 | セイコーエプソン株式会社 | 映像処理方法、映像処理回路、液晶表示装置および電子機器 |
JP5720221B2 (ja) | 2010-12-13 | 2015-05-20 | セイコーエプソン株式会社 | 映像処理方法、映像処理回路、液晶表示装置および電子機器 |
JP5707973B2 (ja) | 2011-01-27 | 2015-04-30 | セイコーエプソン株式会社 | 映像処理方法、映像処理回路、液晶表示装置および電子機器 |
JP2012168229A (ja) | 2011-02-10 | 2012-09-06 | Seiko Epson Corp | 映像処理方法、映像処理回路、液晶表示装置および電子機器 |
JP2012242797A (ja) | 2011-05-24 | 2012-12-10 | Seiko Epson Corp | 映像処理方法、映像処理回路、液晶表示装置及び電子機器 |
JP2012242798A (ja) | 2011-05-24 | 2012-12-10 | Seiko Epson Corp | 補正電圧設定方法、映像処理方法、補正電圧設定装置、映像処理回路、液晶表示装置及び電子機器 |
JP6078959B2 (ja) * | 2012-03-16 | 2017-02-15 | セイコーエプソン株式会社 | 映像処理回路、映像処理方法および電子機器 |
-
2012
- 2012-03-16 JP JP2012059884A patent/JP6078959B2/ja active Active
-
2013
- 2013-03-11 US US13/794,195 patent/US9241092B2/en active Active
- 2013-03-12 TW TW102108715A patent/TW201340087A/zh unknown
- 2013-03-15 KR KR20130027855A patent/KR20130105532A/ko not_active Application Discontinuation
- 2013-03-15 CN CN201310084270.0A patent/CN103310751B/zh active Active
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010066442A (ja) * | 2008-09-10 | 2010-03-25 | Seiko Epson Corp | 液晶装置及び電子機器 |
JP2011107497A (ja) * | 2009-11-19 | 2011-06-02 | Seiko Epson Corp | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP2011145501A (ja) * | 2010-01-15 | 2011-07-28 | Seiko Epson Corp | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
JP2011175200A (ja) * | 2010-02-25 | 2011-09-08 | Seiko Epson Corp | 映像処理回路、その処理方法、液晶表示装置および電子機器 |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10109254B2 (en) | 2014-01-22 | 2018-10-23 | Seiko Epson Corporation | Video processing circuit, video processing method, electro-optical device, and electronic apparatus |
JP2017053972A (ja) * | 2015-09-08 | 2017-03-16 | キヤノン株式会社 | 液晶駆動装置、画像表示装置および液晶駆動プログラム |
US10163382B2 (en) | 2015-09-08 | 2018-12-25 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus capable of reducing degradation in image quality due to disclination, and storage medium storing liquid crystal drive program capable thereof |
US10198985B2 (en) | 2015-09-08 | 2019-02-05 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus and storage medium storing liquid crystal drive program |
US10229625B2 (en) | 2015-09-08 | 2019-03-12 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus and storage medium storing liquid crystal drive program |
US10304371B2 (en) | 2015-09-08 | 2019-05-28 | Canon Kabushiki Kaisha | Liquid crystal drive apparatus, image display apparatus and storage medium storing liquid crystal drive program |
Also Published As
Publication number | Publication date |
---|---|
KR20130105532A (ko) | 2013-09-25 |
US20130242194A1 (en) | 2013-09-19 |
CN103310751A (zh) | 2013-09-18 |
US9241092B2 (en) | 2016-01-19 |
TW201340087A (zh) | 2013-10-01 |
CN103310751B (zh) | 2016-09-21 |
JP6078959B2 (ja) | 2017-02-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6078959B2 (ja) | 映像処理回路、映像処理方法および電子機器 | |
JP5381807B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5229162B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5707973B2 (ja) | 映像処理方法、映像処理回路、液晶表示装置および電子機器 | |
JP5598014B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5233920B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5556234B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5304684B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5454092B2 (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP5903954B2 (ja) | 映像処理回路、映像処理方法および電子機器 | |
JP6078965B2 (ja) | 映像処理回路、映像処理方法及び電子機器 | |
JP2012242798A (ja) | 補正電圧設定方法、映像処理方法、補正電圧設定装置、映像処理回路、液晶表示装置及び電子機器 | |
JP2012242797A (ja) | 映像処理方法、映像処理回路、液晶表示装置及び電子機器 | |
JP6083111B2 (ja) | 映像処理回路、映像処理方法、液晶表示装置および電子機器 | |
JP2012168229A (ja) | 映像処理方法、映像処理回路、液晶表示装置および電子機器 | |
JP5574000B2 (ja) | 信号処理装置、液晶表示装置、電子機器および信号処理方法 | |
JP2013156368A (ja) | 映像処理回路、映像処理方法、液晶表示装置および電子機器 | |
JP5510580B2 (ja) | 信号処理装置、信号処理方法、液晶表示装置および電子機器 | |
JP6191150B2 (ja) | 映像処理回路、映像処理方法及び電子機器 | |
JP2014149426A (ja) | 映像処理回路、映像処理方法及び電子機器 | |
JP2014219686A (ja) | 映像処理回路、その処理方法、液晶表示装置および電子機器 | |
JP2015075698A (ja) | 電気光学装置及び電子機器 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20141119 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20150107 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20150910 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20150925 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20151118 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20160510 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20160609 |
|
RD03 | Notification of appointment of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7423 Effective date: 20160613 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20160708 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20161220 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20170102 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6078959 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |