JP2012049288A - 素子収納用パッケージ、およびこれを備えた電子装置 - Google Patents
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Abstract
【解決手段】素子収納用パッケージであって、基体1と、互いに対向して配置された第1および第3の側壁2a、2cならびに第2および第4の側壁2b,2dを有し、第1および第3の側壁2a,2cの両方の側部の一部が切り欠かれた切欠き部2fを有する、基体に設けられた枠体2と、切欠き部2fに取り付けられた入出力端子3と、枠体2の上面のシールリング5と、シールリング5の上面の蓋体7とを備えており、第2および第4の側壁2b,2dの幅が第1および第3の側壁2a,2cの幅よりも狭く、入出力端子3は、入出力端子の第1および第3の側壁2a,2c側の両端面3eが第1および第3の側壁2a,2cの外側に突き出た状態で切欠き部2fに取り付けられていることを特徴とする。
【選択図】図1
Description
<素子収納用パッケージの構成、および電子装置の構成>
本実施形態に係る素子収納用パッケージは、図1乃至図2に示すように、上側主面に光半導体素子9が載置される載置部1aを有する基体1と、上面視したときに外形が四角形状であり、互いに対向する位置に配置された第1および第3の側壁2a、2cならびに第2および第4の側壁2b、2dを有し、載置部1aを取り囲むように基体1の上側主面に設けられた、第1の側壁2aに光半導体素子9と光学的に結合する光ファイバ10を設けるための貫通孔2eを有し、第1および第3の側壁2a、2cの両方の側部の一部がそれぞれの間に位置する第2および第4の側壁2b、2dとともに切り欠かれた切欠き部2fを有する枠体2と、光半導体素子9に電気的に接続される配線導体層3dを有する、切欠き部2fにそれぞれ取り付けられた入出力端子3と、少なくとも一部を枠体2の上面に当接させて設けられたシールリング5と、シールリング5の上面に外周部が接合される蓋体7とを備えており、第2および第4の側壁の幅2b、2dが第1および第3の側壁2a、2cの幅よりも狭く、入出力端子3は、入出力端子3の第1および第3の側壁2a、2c側の両端面3eがそれぞれ第1および第3の側壁2a、2cの外側に突き出た状態で切欠き部2fに取り付けられている。
被着させておくのがよい。これらのメッキ層は、基体1が酸化腐蝕するのを有効に防止することができるとともに、基体1の上側主面の光半導体素子9の下部に配置される素子載置基台8を強固に接着固定することができる。
有してもよい。このような構成にすることによって、枠体2をさらに補強する効果が得られる。
うに、光半導体素子9にボンディングワイヤ等で電気的に接続され、枠体2の外側に位置している配線導体層3dが、外部リード端子4に電気的に接続される。入出力端子3は、枠体2の切欠き部2eに銀(Ag)ロウまたは銀(Ag)−銅(Cu)ロウ等のロウ材を介して取り付けられる。なお、入出力端子3は、枠体2およびシールリング5との接合部にメタライズ層が形成されている。また、素子載置用基台8が、ペルチャ素子等の電子冷却素子である場合は、電子冷却素子のリード線と配線導体層3dが電気的に接続される。
たは鉄(Fe)−ニッケル(Ni)合金等の金属材料から成る。また、シールリング5の熱膨張係数は、例えば、5(ppm/℃)以上15(ppm/℃)以下に設定されることが好ましい。
応力が発生する。
ここで、素子収納用パッケージ、およびこれを備えた電子装置の製造方法を説明する。
ム、酸化カルシウム等の原料粉末に、有機バインダー、可塑剤、溶剤、分散剤等を混合添加してペースト状とし、ドクターブレード法やカレンダーロール法等によって形成される。
本実施形態に係る変形例1の素子収納用パッケージでは、図6に示すように、切欠き部2fが基体1側に設けられていてもよい。そして、入出力端子3は、入出力端子3の下面が基体1の上側主面に接合されていてもよい。
1a 載置部
2 枠体
2a 第1の側壁
2b 第2の側壁
2c 第3の側壁
2d 第4の側壁
2e、20e 貫通孔
2f 切欠き部
3 入出力端子
3a 平坦部
3b 突出部
3c 立壁部
3d 配線導体層
3e 端面
4 外部リード端子
5 シールリング
6 光ファイバ固定部材
7 蓋体
8 素子載置用基台
9 光半導体素子
10 光ファイバ
Claims (4)
- 上側主面に光半導体素子が載置される載置部を有する基体と、
上面視したときに外形が四角形状であり、互いに対向する位置に配置された第1および第3の側壁ならびに第2および第4の側壁を有し、前記載置部を取り囲むように前記基体の前記上側主面に設けられた、前記第1の側壁に前記光半導体素子と光学的に結合する光ファイバを設けるための貫通孔を有し、前記第1および第3の側壁の両方の側部の一部がそれぞれの間に位置する前記第2および第4の側壁とともに切り欠かれた切欠き部を有する枠体と、
前記光半導体素子に電気的に接続される配線導体層を有する、前記切欠き部にそれぞれ取り付けられた入出力端子と、
少なくとも一部を前記枠体の上面に当接させて設けられたシールリングと、
該シールリングの上面に外周部が接合される蓋体とを備えており、
前記第2および第4の側壁の幅が前記第1および第3の側壁の幅よりも狭く、前記入出力端子は、前記入出力端子の前記第1および第3の側壁側の両端面がそれぞれ前記第1および第3の側壁の外側に突き出た状態で前記切欠き部に取り付けられていることを特徴とする素子収納用パッケージ。 - 請求項1に記載の素子収納用パッケージであって、
前記入出力端子は、上面が前記貫通孔の中心よりも上方に位置するとともに、下面が前記貫通孔の中心よりも下方に位置していることを特徴とする素子収納用パッケージ。 - 請求項1または請求項2に記載の素子収納用パッケージであって、
前記切欠き部が前記基体側に設けられており、前記入出力端子は、下面が前記基体の前記上側主面に接合されていることを特徴とする素子収納用パッケージ。 - 請求項1乃至請求項3のいずれかに記載の素子収納用パッケージと、
前記載置部に載置され、前記入出力端子の前記配線導体層に電気的に接続された光半導体素子と、
前記シールリングの上面に外周部が接合された前記蓋体と
を備えたことを特徴とする電子装置。
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JP2010189263A JP2012049288A (ja) | 2010-08-26 | 2010-08-26 | 素子収納用パッケージ、およびこれを備えた電子装置 |
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