JP2009140261A - 半導体集積回路 - Google Patents
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Abstract
【解決手段】第2の電圧GNDが供給される制御電極、ノードN3と接続された第1の電極、及び第2の電圧供給用ノードN8の電位に基づいた電流が流入する第4のノードN4と接続された第2の電極を備えると共に、第1の電極と第2の電極との間に所定量の電流を通電させるために制御電極に供給される電圧の大きさを表す閾値を所定値としたトランジスタM7、ノードN4と接続された制御電極、第1の電圧が供給される第1の電極、及びノードN2と接続された第2の電極を備えると共に、閾値を所定値より小さくしたトランジスタM5を備える。
【選択図】図1
Description
(1)I1=I2=0A(ノードN1の電位は電源電圧VDD、ノードN2の電位は接地電圧GND)
(2)トランジスタM1、M2、M3、及びM4の各々の相互コンダクタンスgmを、それぞれgm1、gm2、gm3、及びgm4とした場合
I1=k*T/q*{ln(gm1*gm2/gm3*gm4)}
I2=gm2/gm1*I1
ここで、
k:ボルツマン定数
T:絶対温度
q:電子の電荷量
である。
図1は、本発明の第1の実施の形態の半導体集積回路に係わる回路図である。
(3)トランジスタM1、M2、M3、及びM4の各々の相互コンダクタンスgmを、それぞれgm1、gm2、gm3、及びgm4とした場合
I1=k*T/q*{ln(gm1*gm2/gm3*gm4)}
I2=gm2/gm1*I1
ここで、
k:ボルツマン定数
T:絶対温度
q:電子の電荷量
であり、*は乗算記号を表す。
図2は、本発明の第2の実施の形態の半導体集積回路に係わる回路図である。
14・・・・・・・・・・・・・・・スタートアップ回路部14
101・・・・・・・・・・・・・・第1のカレントミラー回路
102・・・・・・・・・・・・・・第2のカレントミラー回路
M1、M2、M5、M6、M7・・・PチャンネルMOSトランジスタ
M3、M4・・・・・・・・・・・・NチャンネルMOSトランジスタ
Claims (4)
- 第1の電圧が供給される第1の電圧供給用ノードと接続された第1のカレントミラー回路と、
前記第1の電圧よりも低い第2の電圧が供給される第2の電圧供給用ノードと接続されると共に、前記第1のカレントミラー回路からの電流が流入する第1のノード及び第2のノードを介して前記第1のカレントミラー回路と接続された第2のカレントミラー回路と、
前記第1のノードの電圧が供給される制御電極、前記第1の電圧が供給される第1の電極、及び前記第1のノードの電圧に基づいた電流が流入する第3のノードと接続された第2の電極を備えた第1のトランジスタ、前記第2の電圧が供給される制御電極、前記第3のノードと接続された第1の電極、及び前記第2の電圧供給用ノードの電位に基づいた電流が流入する第4のノードと接続された第2の電極を備えると共に、該第1の電極と該第2の電極との間に所定量の電流を通電させるために該制御電極に供給される電圧の大きさを表す閾値を所定値とした第2のトランジスタ、前記第4のノードと接続された制御電極、前記第1の電圧が供給される第1の電極、及び前記第2のノードと接続された第2の電極を備えると共に、前記閾値を前記所定値より小さくした第3のトランジスタ、並びに一方の端子が前記第4のノードと接続され、他方の端子が前記第2の電圧供給用ノードと接続された静電容量素子を備えた起動部と、
を含む半導体集積回路。 - 第1の電圧が供給される第1の電圧供給用ノードと接続された第1のカレントミラー回路と、
前記第1の電圧よりも低い第2の電圧が供給される第2の電圧供給用ノードと接続されると共に、前記第1のカレントミラー回路からの電流が流入する第1のノード及び第2のノードを介して前記第1のカレントミラー回路と接続された第2のカレントミラー回路と、
前記第1のノードの電圧が供給される制御電極、前記第1の電圧が供給される第1の電極、及び前記第1のノードの電圧に基づいた電流が流入する第3のノードと接続された第2の電極を備えた第1のトランジスタ、前記第2の電圧が供給される制御電極、前記第3のノードと接続された第1の電極、及び前記第2の電圧供給用ノードの電位に基づいた電流が流入する第4のノードと接続された第2の電極を備えると共に、相互コンダクタンスを所定値とした第2のトランジスタ、前記第4のノードと接続された制御電極、前記第1の電圧が供給される第1の電極、及び前記第2のノードと接続された第2の電極を備えると共に、相互コンダクタンスを前記所定値より大きくした第3のトランジスタ、並びに一方の端子が前記第4のノードと接続され、他方の端子が前記第2の電圧供給用ノードと接続された静電容量素子を備えた起動部と、
を含む半導体集積回路。 - 第1の電圧が供給される第1の電圧供給用ノードと接続された第1のカレントミラー回路と、
前記第1の電圧よりも低い第2の電圧が供給される第2の電圧供給用ノードと接続されると共に、前記第1のカレントミラー回路からの電流が流入する第1のノード及び第2のノードを介して前記第1のカレントミラー回路と接続された第2のカレントミラー回路と、
一方の端子が前記第1の電圧供給用ノードの電圧に基づいた電流が流入する第3のノードと接続され他方の端子が前記第1の電圧供給用ノードと接続された静電容量素子、前記第2のノードの電圧が供給される制御電極、前記第2の電圧が供給される第1の電極、及び前記第2のノードの電圧に基づいた電流が流入する第4のノードと接続された第2の電極を備えた第1のトランジスタ、前記第1の電圧が供給される制御電極、前記第4のノードと接続された第1の電極、及び前記第3のノードと接続された第2の電極を備えると共に、該第1の電極と該第2の電極との間に所定量の電流を通電させるために該制御電極に供給される電圧の大きさを表す閾値を所定値とした第2のトランジスタ、並びに前記第3のノードと接続された制御電極、前記第2の電圧が供給される第1の電極、及び前記第1のノードと接続された第2の電極を備えると共に、前記閾値を前記所定値より小さくした第3のトランジスタを備えた起動部と、
を含む半導体集積回路。 - 第1の電圧が供給される第1の電圧供給用ノードと接続された第1のカレントミラー回路と、
前記第1の電圧よりも低い第2の電圧が供給される第2の電圧供給用ノードと接続されると共に、前記第1のカレントミラー回路からの電流が流入する第1のノード及び第2のノードを介して前記第1のカレントミラー回路と接続された第2のカレントミラー回路と、
一方の端子が前記第1の電圧供給用ノードの電圧に基づいた電流が流入する第3のノードと接続され他方の端子が前記第1の電圧供給用ノードと接続された静電容量素子、前記第2のノードの電圧が供給される制御電極、前記第2の電圧が供給される第1の電極、及び前記第2のノードの電圧に基づいた電流が流入する第4のノードと接続された第2の電極を備えた第1のトランジスタ、前記第1の電圧が供給される制御電極、前記第4のノードと接続された第1の電極、及び前記第3のノードと接続された第2の電極を備えると共に、相互コンダクタンスを所定値とした第2のトランジスタ、並びに前記第3のノードと接続された制御電極、前記第2の電圧が供給される第1の電極、及び前記第1のノードと接続された第2の電極を備えると共に、相互コンダクタンスを前記所定値より大きくした第3のトランジスタを備えた起動部と、
を含む半導体集積回路。
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN102915070A (zh) * | 2011-08-04 | 2013-02-06 | 拉碧斯半导体株式会社 | 半导体集成电路 |
KR20130033969A (ko) * | 2011-09-27 | 2013-04-04 | 세이코 인스트루 가부시키가이샤 | 기준 전압 회로 |
KR101740053B1 (ko) | 2009-12-01 | 2017-05-25 | 에스아이아이 세미컨덕터 가부시키가이샤 | 정전류 회로 |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5123679B2 (ja) * | 2008-01-28 | 2013-01-23 | ルネサスエレクトロニクス株式会社 | 基準電圧生成回路及びその起動制御方法 |
US8531056B2 (en) * | 2010-05-13 | 2013-09-10 | Texas Instruments Incorporated | Low dropout regulator with multiplexed power supplies |
JP2012252508A (ja) * | 2011-06-02 | 2012-12-20 | Lapis Semiconductor Co Ltd | 半導体集積回路 |
US11609592B2 (en) * | 2016-01-06 | 2023-03-21 | Disruptive Technologies Research As | Fast start-up bias circuits |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0659761A (ja) * | 1992-08-06 | 1994-03-04 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
JPH06332550A (ja) * | 1993-05-26 | 1994-12-02 | Oki Electric Ind Co Ltd | 定電圧発生回路 |
JP2002124637A (ja) * | 2000-10-18 | 2002-04-26 | Oki Micro Design Co Ltd | 半導体集積回路 |
JP2007249523A (ja) * | 2006-03-15 | 2007-09-27 | Ricoh Co Ltd | 定電圧回路 |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3012562B2 (ja) | 1997-06-30 | 2000-02-21 | 日本電気アイシーマイコンシステム株式会社 | 基準電圧発生回路 |
JP2002110814A (ja) | 2000-09-26 | 2002-04-12 | Toshiba Microelectronics Corp | 半導体集積回路装置およびその製造方法 |
JP2006121448A (ja) * | 2004-10-22 | 2006-05-11 | Matsushita Electric Ind Co Ltd | 電流源回路 |
-
2007
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0659761A (ja) * | 1992-08-06 | 1994-03-04 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
JPH06332550A (ja) * | 1993-05-26 | 1994-12-02 | Oki Electric Ind Co Ltd | 定電圧発生回路 |
JP2002124637A (ja) * | 2000-10-18 | 2002-04-26 | Oki Micro Design Co Ltd | 半導体集積回路 |
JP2007249523A (ja) * | 2006-03-15 | 2007-09-27 | Ricoh Co Ltd | 定電圧回路 |
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101740053B1 (ko) | 2009-12-01 | 2017-05-25 | 에스아이아이 세미컨덕터 가부시키가이샤 | 정전류 회로 |
CN102915070A (zh) * | 2011-08-04 | 2013-02-06 | 拉碧斯半导体株式会社 | 半导体集成电路 |
US8525506B2 (en) | 2011-08-04 | 2013-09-03 | Lapis Semiconductor Co., Ltd. | Semiconductor integrated circuit |
CN102915070B (zh) * | 2011-08-04 | 2016-01-06 | 拉碧斯半导体株式会社 | 半导体集成电路 |
KR20130033969A (ko) * | 2011-09-27 | 2013-04-04 | 세이코 인스트루 가부시키가이샤 | 기준 전압 회로 |
JP2013073375A (ja) * | 2011-09-27 | 2013-04-22 | Seiko Instruments Inc | 基準電圧回路 |
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