JP4415352B2 - スタートアップ回路及びこれを用いた定電流回路 - Google Patents
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Description
109、209、303、307 抵抗
105、106、110、111、205、206、210、211、305、306、310、311、405、406、410、411 PMOSトランジスタ
112、113、212、213、312、313、409、412、413 NMOSトランジスタ
Claims (5)
- 電源電圧投入時に強制的に電圧を与えて内部回路を安定動作させるスタートアップ回路において、
該内部回路は、強制的電圧を入力するための第一ノードと、該内部回路の電位を検出するための第二ノードとを有し、
該スタートアップ回路は、該第二ノードの電位に応じて導通が制御される第一のP型トランジスタを含み、該第一のP型トランジスタのドレインと該第一ノードとを電気的に接続し、該第一のP型トランジスタのソースと電源との間に容量を構成したことを特徴とするスタートアップ回路。 - 該スタートアップ回路は、第二のP型トランジスタを含み、該第二のP型トランジスタのゲートを該第二ノードに電気的に接続し、該第二のP型トランジスタのドレインを該第一のP型トランジスタのゲートに電気的に接続したことを特徴とする請求項1に記載のスタートアップ回路。
- 該第二のP型トランジスタのドレインと該第一のP型トランジスタのゲートとの間、又は、該第一のP型トランジスタのドレインと該第一ノードとの間に抵抗を構成したことを特徴とする請求項2に記載のスタートアップ回路。
- 該第二のP型トランジスタのゲートと接地電位との間に容量とトランジスタを並列接続したことを特徴とする請求項2に記載のスタートアップ回路。
- スタートアップ回路と定電流回路部とからなる定電流回路であって、
該定電流回路部は、ゲート及びソースを共通接続した第三及び第四のP型トランジスタと、ソース及びドレインを共通接続した第一及び第二のN型トランジスタとから成り、該第一のP型トランジスタのドレインと該第一のN型トランジスタのドレインとを接続して第一ノードを構成し、該第四のP型トランジスタのドレインと該第二のN型トランジスタのドレインとを接続して第二ノードを構成するとともに、
該スタートアップ回路は、該第二ノードの電位に応じて導通が制御される第一のP型トランジスタを含み、該第一のP型トランジスタのドレインと該第二ノードとを電気的に接続し、該第一のP型トランジスタのソースと電源との間に容量を構成したことを特徴とする定電流回路。
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