JP2008521033A - アクティブマトリクス型発光デバイス表示器のためのシステム及び駆動方法 - Google Patents
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Abstract
Description
となり、ここで、VGSは駆動トランジスタ14のゲート/ソース電圧を表し、VTは該駆動トランジスタ14の閾電圧を表す。この電圧は駆動フェーズ内ではキャパシタ12上に留まり、結果として、該駆動フェーズではOLED10を介して所望の電流が流れる。
となり、ここで、VnodeBはノードB11の電圧を表し、VTは駆動トランジスタ14の閾電圧を表し、βはIDS=β(VGS−VT)2により与えられるTFTの電流/電圧(I−V)特性の係数を表す。尚、IDSは駆動トランジスタ14のドレイン/ソース電流を表す。
となり、ここで、VC1は第1記憶キャパシタ32に記憶された電圧を表し、VTは駆動トランジスタ34の閾電圧を表し、βはIDS=β(VGS−VT)2により与えられるTFTの電流/電圧(I−V)特性の係数を表す。IDSは駆動トランジスタ34のドレイン/ソース電流を表す。
に自己調整され、ここで、VTは該駆動トランジスタ116の閾電圧を表し、βはIDS=β(VGS−VT)2により与えられるTFTの電流/電圧(I−V)特性の係数を表す。また、IDSは駆動トランジスタ116のドレイン/ソース電流を表す。
12,22,32,33,52,53,72,74,92,94,111,131 記憶キャパシタ
14,24,34,54,76,96 駆動トランジスタ
16,18,26,28,36,38,40,56,58,60,78,80,84,100,104 スイッチトランジスタ
114,116,134,136 ミラートランジスタ
118,120,138,140 スイッチトランジスタ
112,132 スイッチネットワーク
Claims (51)
- 発光デバイスと複数のトランジスタとを有するピクセル回路であって、前記複数のトランジスタが前記発光デバイスにピクセル電流を供給する駆動トランジスタと、信号ラインに接続されると共に第1選択ラインにより選択される第1スイッチトランジスタと、制御可能なバイアスラインに接続されると共に第2選択ラインにより選択される第2スイッチトランジスタとを含むようなピクセル回路と、
前記ピクセル回路をプログラミング及び駆動するドライバであって、前記信号ラインにプログラミングデータを供給すると共に、前記ピクセル回路の時間依存性パラメータを補償するために少なくとも前記制御可能なバイアスラインに制御可能なバイアス信号を供給するようなドライバと、
安定したピクセル電流を発生するように前記ドライバを制御するコントローラと、
を有する表示システム。 - 請求項1に記載の表示システムにおいて、前記発光デバイスが有機発光ダイオードを含むような表示システム。
- 請求項1に記載の表示システムにおいて、前記ピクセル回路が前記時間依存性パラメータを記憶するための少なくとも1つのキャパシタを更に含むような表示システム。
- 請求項1に記載の表示システムにおいて、前記トランジスタのうちの少なくとも1つが薄膜トランジスタであるような表示システム。
- 請求項1に記載の表示システムにおいて、前記トランジスタのうちの少なくとも1つがn型トランジスタであるような表示システム。
- 請求項1に記載の表示システムにおいて、前記トランジスタのうちの少なくとも1つがp型トランジスタであるような表示システム。
- 請求項1に記載の表示システムにおいて、前記ピクセル回路がAMOLED表示アレイを形成し、複数の前記ピクセル回路が行及び列に配列されるような表示システム。
- 請求項1に記載の表示システムにおいて、前記バイアス信号がバイアス電流、バイアス電圧又はこれらの組み合わせであるような表示システム。
- 請求項1に記載の表示システムにおいて、前記ピクセル回路が電流プログラム型回路又は電圧プログラム型回路であるような表示システム。
- 請求項3に記載の表示システムにおいて、前記発光デバイスが第1端子及び第2端子を有し、該発光デバイスの第1端子は電圧供給ラインに接続され、
前記キャパシタは第1端子及び第2端子を有し、
前記第1スイッチトランジスタはゲート端子、第1端子及び第2端子を有し、該第1スイッチトランジスタのゲート端子は前記第1選択ラインに接続され、該第1スイッチトランジスタの第1端子は前記信号ラインに接続され、該第1スイッチトランジスタの第2端子は前記キャパシタの第1端子に接続され、
前記第2スイッチトランジスタはゲート端子、第1端子及び第2端子を有し、該第2スイッチトランジスタのゲート端子は前記第2選択ラインに接続され、該第2スイッチトランジスタの第1端子は前記キャパシタの第2端子に接続され、該第2スイッチトランジスタの第2端子は前記制御可能なバイアスラインに接続され、
前記駆動トランジスタはゲート端子、第1端子及び第2端子を有し、該駆動トランジスタのゲート端子は前記第1スイッチトランジスタの第2端子及び前記キャパシタの第1端子に接続され、該駆動トランジスタの第1端子は電圧供給ラインに接続され、該駆動トランジスタの第2端子が前記発光デバイスの第2端子に接続されている、
表示システム。 - 請求項1又は請求項10に記載の表示システムにおいて、前記第1選択ライン及び前記第2選択ラインが共通の選択ラインであるような表示システム。
- 請求項3に記載の表示システムであって、前記発光デバイスは第1端子及び第2端子を有し、該発光デバイスの第1端子は第1電圧供給部に接続され、
前記キャパシタは、各々が第1端子及び第2端子を有するような第1キャパシタ及び第2キャパシタを含み、
前記第1選択ライン及び前記第2選択ラインは共通の選択ラインであり、
前記第1スイッチトランジスタはゲート端子、第1端子及び第2端子を有し、該第1スイッチトランジスタのゲート端子は前記選択ラインに接続され、該第1スイッチトランジスタの第1端子は前記信号ラインに接続され、該第1スイッチトランジスタの第2端子は前記第1キャパシタの第2端子及び前記第2キャパシタの第1端子に接続され、
前記第2スイッチトランジスタはゲート端子、第1端子及び第2端子を有し、該第2スイッチトランジスタのゲート端子は前記選択ラインに接続され、該第2スイッチトランジスタの第1端子は前記制御可能なバイアスラインに接続され、該第2スイッチトランジスタの第2端子は前記発光デバイスの第2端子に接続され、
前記トランジスタは、ゲート端子、第1端子及び第2端子を有する第3スイッチトランジスタを含み、該第3スイッチトランジスタのゲート端子は前記選択ラインに接続され、該第3スイッチトランジスタの第1端子は前記第2スイッチトランジスタの第2端子及び前記発光デバイスの第2端子に接続され、該第3スイッチトランジスタの第2端子は前記第1キャパシタの第1端子に接続され、
前記駆動トランジスタはゲート端子、第1端子及び第2端子を有し、該駆動トランジスタのゲート端子は前記第3スイッチトランジスタの第2端子及び前記第1キャパシタの第1端子に接続され、該駆動トランジスタの第1端子は前記発光デバイスの第2端子に接続され、該駆動トランジスタの第2端子は第2電圧供給ラインに接続されている、
表示システム。 - 請求項1ないし7及び10ないし12の何れか一項に記載の表示システムにおいて、前記ピクセル回路は電圧プログラム型ピクセル回路であり、前記プログラミングデータはプログラミング電圧であり、前記制御可能なバイアス信号は固定レベルのバイアス電流であるような表示システム。
- 請求項7に記載の表示システムにおいて、前記ピクセル回路が、n番目の行のプログラミングサイクルが(n+1)番目の行のプログラミングサイクルと重なるように構成されているような表示システム。
- 請求項8に記載のピクセル回路を駆動する方法において、
第1プログラミングサイクルにおいて、前記バイアス信号を前記ピクセル回路に供給するステップと、
第2プログラミングサイクルにおいて、プログラミング電圧を前記ピクセル回路に供給するステップと、
駆動サイクルにおいて、前記プログラミング電圧及び前記バイアス信号を不活性化するステップと、
を有するような方法。 - 請求項8に記載のピクセル回路を駆動する方法において、
第1プログラミングサイクルにおいて、前記バイアス信号を前記ピクセル回路に供給するステップと、
第2プログラミングサイクルにおいて、プログラミング電圧を前記ピクセル回路に供給すると共に、前記バイアス信号を不活性化するステップと、
駆動サイクルにおいて、前記プログラミング電圧を不活性化するステップと、
を有するような方法。 - 請求項1に記載のピクセル回路を駆動する方法において、
第1プログラミングサイクルにおいて、バイアス電流を前記ピクセル回路に供給すると共に、プログラミング電圧及びバイアス電圧により規定される電圧を供給するステップと、
第2プログラミングサイクルにおいて、前記バイアス信号を不活性化するステップと、
を有するような方法。 - 請求項1に記載のピクセル回路を駆動する方法において、
第1プログラミングサイクルにおいて、前記バイアス信号を前記ピクセル回路に供給するステップと、
第2プログラミングサイクルにおいて、前記バイアス信号を不活性化すると共に、バイアス電圧及びプログラミング電圧により規定される電圧を供給するステップと、
を有するような方法。 - 請求項1に記載のピクセル回路を駆動する方法において、
前記ピクセル回路に接続された仮想接地点上にプログラミング電圧、バイアス電圧又はこれらの組み合わせを供給するステップ、
を有するような方法。 - 請求項1に記載の表示システムにおいて、前記ピクセル回路がカレントミラー型のピクセル回路であるような表示システム。
- 発光デバイスと、
前記発光デバイスにピクセル電流を供給する駆動トランジスタと、信号ラインに接続されると共に第1選択ラインにより選択される第1スイッチトランジスタと、制御可能なバイアスラインに接続されると共に第2選択ラインにより選択される第2スイッチトランジスタとを含むような複数のトランジスタと、
を有するピクセル回路であって、
前記信号ラインにはプログラミングデータが供給され、前記ピクセル回路の時間依存性パラメータを補償するために少なくとも前記制御可能なバイアスラインに制御可能なバイアス信号が供給されるようなピクセル回路。 - 請求項21に記載のピクセル回路において、前記発光デバイスが有機発光ダイオードを含むようなピクセル回路。
- 請求項21に記載のピクセル回路において、該ピクセル回路が前記時間依存性パラメータを記憶するための少なくとも1つのキャパシタを更に含むようなピクセル回路。
- 請求項21に記載のピクセル回路において、前記トランジスタのうちの少なくとも1つが薄膜トランジスタであるようなピクセル回路。
- 請求項21に記載のピクセル回路において、前記トランジスタのうちの少なくとも1つがn型トランジスタであるようなピクセル回路。
- 請求項21に記載のピクセル回路において、前記トランジスタのうちの少なくとも1つがp型トランジスタであるようなピクセル回路。
- 請求項21に記載のピクセル回路において、該ピクセル回路がAMOLED表示アレイを形成するようなピクセル回路。
- 請求項21に記載のピクセル回路において、前記バイアス信号がバイアス電流、バイアス電圧又はこれらの組み合わせであるようなピクセル回路。
- 請求項21に記載のピクセル回路において、該ピクセル回路が電圧プログラム型ピクセル回路又は電流プログラム型ピクセル回路であるようなピクセル回路。
- 請求項21ない29の何れか一項に記載のピクセル回路において、該ピクセル回路は電圧プログラム型ピクセル回路であり、前記プログラミングデータはプログラミング電圧であり、前記制御可能なバイアス信号は固定レベルのバイアス電流であるようなピクセル回路。
- 請求項21に記載のピクセル回路において、該ピクセル回路がカレントミラー型のピクセル回路であるようなピクセル回路。
- 請求項21に記載のピクセル回路において、前記第1選択ライン及び前記第2選択ラインが共通の選択ラインであるようなピクセル回路。
- 第1電圧供給ラインに接続された第1端子と、第2端子とを有する発光デバイスと、
信号ラインに接続されると共に第1スイッチトランジスタ及び第2スイッチトランジスタを有するスイッチネットワークであって、これらトランジスタの各々がゲート端子、第1端子及び第2端子を有するようなスイッチネットワークと、
各々がゲート端子、第1端子及び第2端子を有するような第1及び第2駆動トランジスタを有するカレントミラーであって、これら駆動トランジスタのうちの一方が前記発光デバイスにピクセル電流を供給するための駆動トランジスタであるようなカレントミラーと、
前記スイッチネットワーク及び前記カレントミラーに接続されたキャパシタであって、第1端子及び第2端子を有し、該第1端子が仮想接地ラインに接続されているようなキャパシタと、
を有するピクセル回路と;
前記ピクセル回路をプログラミング及び駆動するドライバであって、前記信号ラインにプログラミングデータを供給し、前記ピクセル回路のプログラミングを加速させると共に該ピクセル回路の時間依存性パラメータを補償するために前記信号ラインに制御可能な第1バイアス信号を供給し、且つ、該第1バイアス信号を除去するために前記仮想接地ラインに制御可能な第2バイアス信号を供給するようなドライバと;
安定したピクセル電流を発生させるように前記ドライバを制御するコントローラと;
を有するような表示システム。 - 請求項33に記載の表示システムにおいて、
前記第1スイッチトランジスタのゲート端子は選択ラインに接続され、該第1スイッチトランジスタの第1端子は前記信号ラインに接続され、該第1スイッチトランジスタの第2端子は前記第2スイッチトランジスタの第1端子及び前記第1駆動トランジスタの第1端子に接続され、
前記第2スイッチトランジスタのゲート端子は前記選択ラインに接続され、該第2スイッチトランジスタの第2端子は前記キャパシタの第2端子、前記第1駆動トランジスタのゲート端子及び前記第2駆動トランジスタのゲート端子に接続され、
前記第1駆動トランジスタの第2端子は第2電圧供給ラインに接続され、
前記第2駆動トランジスタの第1端子は前記発光データの第2端子に接続され、該第2駆動トランジスタの第2端子が前記仮想接地ラインに接続されている、
表示システム。 - 請求項33に記載の表示システムにおいて、前記発光デバイスが有機発光ダイオードを含むような表示システム。
- 請求項33に記載の表示システムにおいて、前記トランジスタのうちの少なくとも1つが薄膜トランジスタであるような表示システム。
- 請求項33に記載の表示システムにおいて、前記トランジスタのうちの少なくとも1つがn型トランジスタであるような表示システム。
- 請求項33に記載の表示システムにおいて、前記トランジスタのうちの少なくとも1つがp型トランジスタであるような表示システム。
- 請求項33に記載の表示システムにおいて、前記ピクセル回路がAMOLED表示アレイを形成し、複数の前記ピクセル回路が行及び列に配列されるような表示システム。
- 請求項33に記載の表示システムにおいて、前記プログラミングデータはプログラミング電流であり、前記第1バイアス信号はバイアス電流であり、前記第2バイアス信号がバイアス電圧であるような表示システム。
- 請求項33に記載の表示システムにおいて、前記ピクセル回路が電流プログラム型回路又は電圧プログラム型回路であるような表示システム。
- 請求項33に記載の表示システムにおいて、前記ピクセル回路が、n番目の行のプログラミングサイクルが(n+1)番目の行のプログラミングサイクルと重なるように構成されているような表示システム。
- 請求項33に記載のピクセル回路を駆動する方法において、
第1プログラミングサイクルにおいて、バイアス電圧を前記仮想接地ラインに供給すると共に、プログラミング電流及びバイアス電流により規定される電流を前記信号ラインに供給するステップと、
第2プログラミングサイクルにおいて、前記バイアス電圧及び前記電流を不活性化するステップと、
を有するような方法。 - 第1電圧供給部に接続された第1端子と、第2端子とを有する発光デバイスと、
信号ラインに接続されると共に第1スイッチトランジスタ及び第2スイッチトランジスタを有するスイッチネットワークであって、これらトランジスタの各々がゲート端子、第1端子及び第2端子を有するようなスイッチネットワークと、
各々がゲート端子、第1端子及び第2端子を有するような第1及び第2駆動トランジスタを有するカレントミラーであって、これら駆動トランジスタのうちの一方が前記発光デバイスにピクセル電流を供給するための駆動トランジスタであるようなカレントミラーと、
前記スイッチネットワーク及び前記カレントミラーに接続されたキャパシタであって、第1端子及び第2端子を有し、該第1端子が仮想接地ラインに接続されているようなキャパシタと、
を有するピクセル回路であって、
前記信号ラインにプログラミングデータが供給され、前記ピクセル回路のプログラミングを加速させると共に該ピクセル回路の時間依存性パラメータを補償するために前記信号ラインに制御可能な第1バイアス信号が供給され、且つ、該第1バイアス信号を除去するために前記仮想接地ラインに制御可能な第2バイアス信号が供給されるようなピクセル回路。 - 請求項44に記載のピクセル回路において、前記発光デバイスが有機発光ダイオードを含むようなピクセル回路。
- 請求項44に記載のピクセル回路において、前記トランジスタのうちの少なくとも1つが薄膜トランジスタであるようなピクセル回路。
- 請求項44に記載のピクセル回路において、前記トランジスタのうちの少なくとも1つがn型トランジスタであるようなピクセル回路。
- 請求項44に記載のピクセル回路において、前記トランジスタのうちの少なくとも1つがp型トランジスタであるようなピクセル回路。
- 請求項44に記載のピクセル回路において、該ピクセル回路がAMOLED表示アレイを形成するようなピクセル回路。
- 請求項44に記載のピクセル回路において、前記プログラミングデータがプログラミング電流であり、前記第1バイアス信号がバイアス電流であり、前記第2バイアス信号がバイアス電圧であるようなピクセル回路。
- 請求項44に記載のピクセル回路において、該ピクセル回路が電圧プログラム型ピクセル回路又は電流プログラム型ピクセル回路であるようなピクセル回路。
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