JP2008099285A - ポップアップノイズ防止回路、これを含むデジタルアンプ及びデジタルアンプのポップアップノイズ防止方法 - Google Patents
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Abstract
【解決手段】ポップアップノイズ防止回路は、スイッチ部及びスイッチ信号発生部を含む。スイッチ部は、デジタルアンプの出力ノードと基準ノードとの間に連結された出力負荷と並列に連結され、スイッチ信号に応答して前記出力ノードと前記基準ノードとの間に導電経路を形成することにより、前記出力負荷に流れる電流を制御する。スイッチ信号発生部は、電源の印加及び遮断情報を有するスイッチ制御信号に応答して前記スイッチ信号を発生する。従って、ポップアップノイズ防止回路は、出力負荷の両端に並列に連結された導電経路を形成してデジタルアンプの電源を印加するか、遮断する場合に発生するポップアップノイズを除去することができる。
【選択図】 図2
Description
20 D級ドライビング回路
30 低域通過フィルタ
40 基準電圧発生器
400、410、420、430 ポップアップノイズ防止回路
51、52、53 スイッチ部
61、62、63 スイッチ信号発生部
71、72、73 緩和部
RL 出力負荷
C2 カップリングキャパシタ
NA 出力ノード
NB 基準ノード
SWCTL スイッチ制御信号
SC スイッチ信号
SSC 緩和スイッチ信号
Claims (31)
- デジタルアンプの出力ノードと基準ノードとの間に連結された出力負荷に並列に連結され、スイッチ信号に応答して前記出力ノードと前記基準ノードとの間に導電経路を形成することにより、前記出力負荷に流れる電流を制御するスイッチ部と、
電源の印加及び遮断情報を有するスイッチ制御信号に応答して前記スイッチ信号を発生するスイッチ信号発生部と、を含むことを特徴とするデジタルアンプのポップアップノイズ防止回路。 - 前記デジタルアンプが正常動作する場合に前記基準ノードの電圧はハイ電源電圧とロー電源電圧の中間電圧を維持することを特徴とする請求項1記載のデジタルアンプのポップアップノイズ防止回路。
- 前記デジタルアンプがミュート状態で動作する場合に前記出力ノードの電圧は前記基準ノードの電圧と同じであり、
前記デジタルアップが正常動作する場合に前記出力ノードの電圧は前記ハイ電源電圧と前記ロー電源電圧との間でスウィングすることを特徴とする請求項2記載のデジタルアンプのポップアップノイズ防止回路。 - 前記スイッチ部は、
前記出力ノードと前記基準ノードとの間に連結され、ゲートに前記スイッチ信号が印加されるスイッチング素子を含むことを特徴とする請求項1記載のデジタルアンプのポップアップノイズ防止回路。 - 前記スイッチング素子はNMOSトランジスタで、
前記スイッチ信号発生部は、電源の印加及び遮断時、ハイレベルのスイッチ信号を前記NMOSトランジスタのゲートに出力することを特徴とする請求項4記載のデジタルアンプのポップアップノイズ防止回路。 - 前記スイッチ信号発生部と前記スイッチ部との間に連結され、前記スイッチ信号の電圧レベルの遷移を緩和して出力する緩和部を更に含むことを特徴とする請求項4記載のデジタルアンプのポップアップノイズ防止回路。
- 前記緩和部は、抵抗及びキャパシタで構成されたRC回路を含むことを特徴とする請求項6記載のデジタルアンプのポップアップノイズ防止回路。
- 前記スイッチ部は、
前記出力ノードと前記基準ノードとの間に並列に連結され、それぞれのゲートに前記スイッチ信号がそれぞれ印加される複数のNMOSトランジスタを含むことを特徴とする請求項1記載のデジタルアンプのポップアップノイズ防止回路。 - 前記スイッチ信号発生部と前記スイッチ部との間に連結され、前記それぞれのスイッチ信号の電圧レベルの遷移を緩和して出力する緩和部を更に含むことを特徴とする請求項8記載のデジタルアンプのポップアップノイズ防止回路。
- 前記緩和部は、前記複数のNMOSトランジスタのゲートにそれぞれ連結され、抵抗及びキャパシタで構成された複数のRC回路を含むことを特徴とする請求項9記載のデジタルアンプのポップアップノイズ防止回路。
- 前記スイッチ信号発生部は、
前記スイッチ制御信号に応答して順次にハイレベルに遷移する複数のスイッチ信号を発生して、前記発生された複数のスイッチ信号を前記複数のNMOSトランジスタのゲートにそれぞれ出力することを特徴とする請求項8記載のデジタルアンプのポップアップノイズ防止回路。 - 前記スイッチ信号発生部は、
前記スイッチ制御信号のレベル遷移を遅延させて順次にハイレベルに遷移する前記複数のスイッチ信号を出力する複数の遅延バッファを含むことを特徴とする請求項11記載のデジタルアンプのポップアップノイズ防止回路。 - 前記スイッチ信号発生部は、
前記スイッチ制御信号及びクロック信号に応答して、前記クロック信号の1周期間隔に順次にハイレベルに遷移する前記複数のスイッチ信号を出力する複数のD−フリップフロップを含むことを特徴とする請求項11記載のデジタルアンプのポップアップノイズ防止回路。 - 前記複数のNMOSトランジスタは、
順次に増加するターンオン抵抗を有することを特徴とする請求項8記載のデジタルアンプのポップアップノイズ防止回路。 - 前記複数のNMOSトランジスタは、
ターンオン抵抗の大きいトランジスタであるほど、先にターンオンされることを特徴とする請求項14記載のデジタルアンプのポップアップノイズ防止回路。 - 出力ノードと基準ノードとの間に連結された出力負荷を駆動するために、ハイ電源電圧とロー電源電圧によってパルス幅変調信号を増幅して出力するD級ドライビング回路と、
前記増幅されたパルス幅変調信号をアナログ信号に変換して前記出力ノードに出力する低域通過フィルタと、
前記ハイ電源電圧と前記ロー電源電圧の中間値に該当する基準電圧を前記基準ノードに出力する基準電圧発生器と、
電源の印加及び遮断情報を有するスイッチ制御信号に応答して前記出力ノードと前記基準ノードとの間に導電経路を形成することにより前記出力負荷に流れる電流を制御するポップアップノイズ防止回路と、を含むことを特徴とするデジタルアンプ。 - 前記出力ノードの電圧は、
ミュート状態で動作する場合に前記基準ノードの電圧と同じであり、
正常動作する場合に前記ハイ電源電圧と前記ロー電源電圧の間でスウィングすることを特徴とする請求項16記載のデジタルアンプ。 - 前記ポップアップノイズ防止回路は、
前記出力ノードと前記基準ノードとの間に前記出力負荷と並列に連結され、N(Nは、自然数)個のスイッチ信号に応答して前記出力ノードと前記基準ノードとの間にN個の導電経路を形成することにより、前記出力負荷に流れる電流を制御するスイッチ部と、
前記スイッチ制御信号に応答して前記N個のスイッチ信号を発生するスイッチ信号発生部と、を含むことを特徴とする請求項16記載のデジタルアンプ。 - 前記スイッチ部は、
前記出力ノードと前記基準ノードとの間に並列に連結され、ゲートに前記N個のスイッチ信号がそれぞれ印加されるN個のMOSトランジスタを含むことを特徴とする請求項18記載のデジタルアンプ。 - 前記N個のMOSトランジスタは、NMOSトランジスタであることを特徴とする請求項19記載のデジタルアンプ。
- 前記ポップアップノイズ防止回路は、
前記スイッチ信号発生部及び前記スイッチ部の間に連結され、前記N個のスイッチ信号の電圧レベルの遷移を緩和して出力する緩和部を更に含むことを特徴とする請求項19記載のデジタルアンプ。 - 前記緩和部は、
前記N個のMOSトランジスタのゲートにそれぞれ連結され、抵抗及びキャパシタで構成されたN個のRC回路を含むことを特徴とする請求項21記載のデジタルアンプ。 - 前記スイッチ信号発生部は、
前記スイッチ制御信号に応答して順次にハイレベルに遷移する前記N個のスイッチ信号を発生し、発生された前記N個のスイッチ信号を前記N個のNMOSトランジスタのゲートにそれぞれ出力することを特徴とする請求項20記載のデジタルアンプ。 - 前記スイッチ信号発生部は、
前記スイッチ制御信号及びクロック信号に応答して、前記クロック信号の1周期間隔に順次にハイレベルに遷移する前記複数のスイッチ信号を出力する複数のD−フリップフロップを含むことを特徴とする請求項23記載のデジタルアンプ。 - 前記N個のMOSトランジスタは、
順次に増加するターンオン抵抗を有することを特徴とする請求項19記載のデジタルアンプ。 - 前記N個のMOSトランジスタは、
ターンオン抵抗の大きいトランジスタであるほど、先にターンオンされることを特徴とする請求項25記載のデジタルアンプ。 - 出力ノードと基準ノードとの間に連結された出力負荷を駆動するためのデジタルアンプのポップアップノイズ防止方法において、
電源の印加及び遮断情報を有するスイッチ制御信号に応答して前記出力ノードと前記基準ノードとの間に導電経路を形成する段階と、
ハイ電源電圧とロー電源電圧とによってパルス幅変調信号を増幅して出力する段階と、
前記増幅されたパルス幅変調信号をアナログ信号に変換して前記出力ノードに出力する段階と、
前記ハイ電源電圧と前記ロー電源電圧の中間値に該当する基準電圧を前記基準ノードに出力する段階と、を含むデジタルアンプのポップアップノイズ防止方法。 - 前記出力ノードと前記基準ノードとの間に導電経路を形成する段階は、
少なくとも1つ以上のスイッチング素子を出力ノードと基準ノードとの間に並列に連結する段階と、
前記スイッチ制御信号に応答して前記スイッチング素子をターンオンさせる段階と、
前記出力ノードと前記基準ノードの電圧が安定化された後、前記スイッチング素子をターンオフさせる段階と、を含むことを特徴とする請求項27記載のデジタルアンプのポップアップノイズ防止方法。 - 前記少なくとも1つ以上のスイッチング素子は、複数のNMOSトランジスタを含むことを特徴とする請求項28記載のデジタルアンプのポップアップノイズ防止方法。
- 前記スイッチング素子をターンオンさせる段階は、
前記複数のNMOSトランジスタを順次にターンオンさせる段階であることを特徴とする請求項29記載のデジタルアンプのポップアップノイズ防止方法。 - 前記複数のNMOSトランジスタは順次に増加するターンオン抵抗を有し、ターンオン抵抗の大きいトランジスタであるほど、先にターンオンされることを特徴とする請求項30記載のデジタルアンプのポップアップノイズ防止方法。
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