JP2008017605A - 直列セルの電圧バランス補正回路 - Google Patents
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Abstract
【解決手段】インダクタL1の一端を、直列接続順で前後する2つのセルB1,B2の中間接続点に接続し、その他端をセルB1,B2の一方の直列接続端と他方の直列端にそれぞれスイッチング素子を介して接続し、両スイッチング素子S1,S2を交互にオン・オフ動作させることにより、一方のセルから上記インダクタにインダクタ電流iLを充電させ、そのインダクタ電流iLを他方のセルを充電する経路で放電させことを交互に切換設定させるとともに、少なくとも上記2つのセル間の電圧差Vxが縮小した場合に、両スイッチング素子S1,S2を共にオフにさせる休止期間tdを置くようにする。
【選択図】図1
Description
すなわち、上述した電圧バランス補正回路では、たとえば図12の(b)に示すように、2つのセルB1,B2の電圧がほぼ等しくなるバランス状態になった場合でも、インダクタ電流iLの充電と放電が、そのバランス状態になる前と同じように行われている。つまり、電圧バランス補正回路は、バランス補正の必要性の有無あるいは程度にかかわらず、常にフル稼動状態にある。
第1と第2のスイッチング素子を交互にオン・オフ動作させることにより、一方のセルから上記インダクタにインダクタ電流を充電させる充電期間と、そのインダクタ電流を、他方のセルを充電する経路で放電させる放電期間とを交互に切換設定するようにした直列セルの電圧バランス補正回路であって、
少なくとも上記2つのセル間の電圧差が縮小した場合に、第1および第2のスイッチング素子が共にオフとなる休止期間を置くようにしたことを特徴とする直列セルの電圧バランス補正回路。
第2の変動基準電圧:上記第1の変動基準電圧に対して半周期の位相差で出現し、電圧が上記第1の中間レベル電圧から上記高レベル基準電圧に向けて線形増加することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも低レベルの場合は上記第2のスイッチング素子がオンとなる。
第3の変動基準電圧:上記第2の変動基準電圧に対して同相で出現し、電圧が所定の低レベル基準電圧から第2の中間レベル電圧に向けて線形増加することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも高レベルの場合は上記第2のスイッチング素子がオンとなる。
第4の変動基準電圧:上記第3の変動基準電圧に対して半周期の位相差で出現し、電圧が上記第2の中間レベル電圧から上記低レベル基準電圧に向けて線形減少することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも高レベルの場合は上記第1のスイッチング素子がオンとなる。
図3は、本発明による電圧バランス補正回路の第2実施形態を示す。同図において、(a)はバランス補正回路の要部を示す回路図、(b)はその一部の動作波形チャートを示す。
第2の変動基準電圧f2:上記第1の変動基準電圧f1に対して半周期の位相差で出現し、電圧が上記第1の中間レベル電圧VMHから上記高レベル基準電圧VHに向けて線形増加することを周期的に繰り返す鋸波状の非正弦波電圧。
第3の変動基準電圧f3:上記第2の変動基準電圧f2に対して同相で出現し、電圧が所定の低レベル基準電圧VLから第2の中間レベル電圧VMLに向けて線形増加することを周期的に繰り返す鋸波状の非正弦波電圧。
第4の変動基準電圧f4:上記第3の変動基準電圧f3に対して半周期の位相差で出現し、電圧が上記第2の中間レベル電圧VMLから上記低レベル基準電圧VLに向けて線形減少することを周期的に繰り返す鋸波状の非正弦波電圧。
21 差動増幅回路 22 増幅回路
23 電圧制限回路 25 電流検出回路
27 差動増幅回路 31 波形発生回路
32 三角波発生回路 33 アナログゲート
34 位相反転およびレベルシフト回路 35 クロック発生回路
41〜44 電圧比較回路 45,46 論理ゲート(OR論理)
B1〜B6 セル CK 基準クロック信号
Ct キャパシタCt(時定数) D1,D2 ダイオード
f1〜f4 第1〜第4の変動基準電圧 iL インダクタ電流
L1 インダクタ N1 中間接続点
p1〜p4 2値論理信号(比較出力) R1,R2 抵抗(分圧回路)
R11,R12 抵抗(時定数) S1,S2 スイッチング素子
ta インダクタ電流iLの充電期間 tb インダクタ電流iLの放電期間
Vx セルの電圧差 VH 高レベル基準電圧
VL 低高レベル基準電圧 VMH 第1の中間レベル電圧
VML 第2の中間レベル電圧 Vh 電圧差幅(オフセット)
VHL 高レベル制限電圧 VLL 低レベル制限電圧
Vi インダクタ電圧Vi Φ1,Φ2 パルス信号
Claims (15)
- 直列接続された複数の蓄電セルの各電圧を均等化させるために、直列接続順で前後する第1のセルと第2のセルの中間接続点に一端が接続するインダクタと、上記2直列セルの一方の直列端と上記インダクタの他端との間に介在して開閉回路を形成する第1のスイッチング素子と、上記2直列セルの他方の直列端と上記インダクタの他端との間に介在して開閉回路を形成する第2のスイッチング素子とを備え、
第1と第2のスイッチング素子を交互にオン・オフ動作させることにより、一方のセルから上記インダクタにインダクタ電流を充電させる充電期間と、そのインダクタ電流を、他方のセルを充電する経路で放電させる放電期間とを交互に切換設定するようにした直列セルの電圧バランス補正回路であって、
少なくとも上記2つのセル間の電圧差が縮小した場合に、第1および第2のスイッチング素子が共にオフとなる休止期間を置くようにしたことを特徴とする直列セルの電圧バランス補正回路。 - 請求項1において、前記休止期間を前記2つのセル間の電圧差に応じて可変設定する制御手段を備えたことを特徴とする直列セルの電圧バランス補正回路。
- 請求項1または2において、前記充電期間と前記放電期間は一定周期で切換設定され、前記休止期間はその充電期間および/または放電期間のデューティ幅の伸縮によって可変設定されることを特徴とする直列セルの電圧バランス補正回路。
- 請求項1〜3のいずれかにおいて、前記2つのセルの直列電圧を等分割する分圧回路と、この分圧回路の分圧電圧と上記2つのセルの中間接続点に現れる電圧の電圧差を検出し、この電圧差に基づいて前記休止期間を可変設定する補正制御回路を備えたことを特徴とする直列セルの電圧バランス補正回路。
- 請求項1〜4のいずれかにおいて、下記第1〜第4の変動基準電圧を生成する波形発生手段と、前記2つのセル間の電圧差を下記第1〜第4の変動基準電圧とそれぞれにレベル比較する比較回路とを有し、この比較回路の比較結果に基づいて前記第1および第2のスイッチング素子のオン・オフ期間を可変設定するようにしたことを特徴とする直列セルの電圧バランス補正回路。
第1の変動基準電圧:電圧が所定の高レベル基準電圧から第1の中間レベル電圧に向けて線形減少することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも低レベルの場合は第1のスイッチング素子がオンとなる。
第2の変動基準電圧:上記第1の変動基準電圧に対して半周期の位相差で出現し、電圧が上記第1の中間レベル電圧から上記高レベル基準電圧に向けて線形増加することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも低レベルの場合は上記第2のスイッチング素子がオンとなる。
第3の変動基準電圧:上記第2の変動基準電圧に対して同相で出現し、電圧が所定の低レベル基準電圧から第2の中間レベル電圧に向けて線形増加することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも高レベルの場合は上記第2のスイッチング素子がオンとなる。
第4の変動基準電圧:上記第3の変動基準電圧に対して半周期の位相差で出現し、電圧が上記第2の中間レベル電圧から上記低レベル基準電圧に向けて線形減少することを周期的に繰り返す鋸波状の非正弦波電圧であり、この電圧が上記電圧差よりも高レベルの場合は上記第1のスイッチング素子がオンとなる。 - 請求項5において、前記第1の中間レベル電圧が前記第2の中間レベル電圧よりも高く、両電圧間に所定の電圧差幅が設定されていることを特徴とする直列セルの電圧バランス補正回路。
- 請求項5または6において、前記第2および第4の変動基準電圧の波形傾斜が前記第1および第3の変動基準電圧のそれよりも急であることを特徴とする直列セルの電圧バランス補正回路。
- 請求項5〜7のいずれかにおいて、前記2つのセル間の電圧差を前記比較回路に入力させるまでの信号伝達経路に、直流利得を選択的に増大させる増幅回路を設けたことを特徴とする直列セルの電圧バランス補正回路。
- 請求項5〜8のいずれかにおいて、前記2つのセル間の電圧差を前記比較回路に入力させる際に、その入力電圧を、前記高レベル基準電圧よりも低い高レベル制限電圧と前記低レベル基準電圧よりも高い低レベル制限電圧の範囲内に抑える電圧制限回路を設けたことを特徴とする直列セルの電圧バランス補正回路。
- 請求項1〜3のいずれかにおいて、前記休止期間を可変設定するための制御パラメータとして、前記インダクタ電流を用いることを特徴とする直列セルの電圧バランス補正回路。
- 請求項10において、前記インダクタ電流は、前記スイッチング素子に直列に介在させられた電流検出回路によって検出することを特徴とする直列セルの電圧バランス補正回路。
- 請求項11において、前記第1および第2のスイッチング素子はそれぞれ、半導体基板上に集積形成されたMOS−FET群によって形成され、前記電流検出手段は上記MOS−FETセル群の一部を用いて形成されていることを特徴とする直列セルの電圧バランス補正回路。
- 請求項1〜3のいずれかにおいて、前記休止期間を可変設定するための制御パラメータとして、前記インダクタの両端に現れるインダクタ電圧を用いることを特徴とする直列セルの電圧バランス補正回路。
- 請求項1〜13のいずれかにおいて、前記スイッチング素子にはそれぞれ、電流方向に応じてスイッチング動作するダイオードが並列接続されていることを特徴とする直列セルの電圧バランス補正回路。
- 請求項14において、前記スイッチング素子としてMOS−FETを用いるとともに、このMOS−FETのソース・ドレイン間に等価的に形成される寄生ダイオードを前記ダイオードとして用いたことを特徴とする直列セルの電圧バランス補正回路。
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