JP2005292436A - 電気回路、その駆動方法、表示装置の画素回路、表示装置及びその駆動方法 - Google Patents
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Abstract
【解決手段】 保持容量11のスイッチトランジスタTr11側の端子にはVrefが入力される。また、同時に信号線2駆動回路13からは基準電流Irefが信号線S2に出力されているので、電源電圧VDD、駆動トランジスタTr15、スイッチトランジスタTr14、信号線S2の経路で電流が流れる。スイッチトランジスタTr13によって駆動トランジスタTr15のゲート・ドレイン間は短絡されているので、保持容量C11の駆動トランジスタTr15側の端子の電圧、すなわち駆動トランジスタTr15のゲート電圧は基準電流Irefに相当する電圧であるVg(Iref)になる。
【選択図】 図2
Description
11:表示部
12:信号線1駆動回路
13:信号線2駆動回路
14:制御線駆動回路
100:有機EL素子
C11,C12,C21,C22,C31,C32,C41,C42,C51,C52,C61,C62,C71,C72,C81,C82,C101,C102,C201:保持容量
Tr11,Tr12,Tr13,Tr14,Tr21,Tr22,Tr23,Tr24,Tr31,Tr33,Tr34,Tr41,Tr43,Tr44,Tr51,Tr52,Tr53,Tr54,Tr101,Tr102,Tr103,Tr201:スイッチトランジスタ
Tr15,Tr25,Tr35,Tr45,Tr55,Tr65,Tr75,Tr85,Tr104,Tr202:駆動トランジスタ
VDD:電源電圧
VSS:接地電圧
Vref:基準電圧
Iref:基準電流
Vdata,Vdata’:映像信号に基づき画素回路に入力される電圧
ΔVdata:VrefとVdataとの差
S1_1,S1−2,・・・,S1_x:信号線1
S2_1,S2−2,・・・,S2_x:信号線2
G1_1,G1_2,・・・,G1_y:制御線1
G2_1,G2_2,・・・,G2_y:制御線2
S1:信号線1
S2:信号線2
G1:制御線1
G2:制御線2
P1:電源制御線
P2:負電源制御線
101,201:信号線
102,103,104,202:制御線
Claims (20)
- 電流により制御されて動作する電流制御素子と、この電流制御素子を駆動する駆動トランジスタと、前記駆動トランジスタのゲートとドレインとの間に接続されたスイッチ素子と、基準電流を与える第2の信号線と前記駆動トランジスタとの間に接続されてオン時に前記駆動トランジスタに電流を流す他のスイッチ素子と、電圧を与える第1の信号線と前記駆動トランジスタのゲートとの間に接続されて前記ゲート電圧を保持する第1の保持容量と、を有することを特徴とする電気回路。
- マトリクス状に複数個配置されて表示部を構成する画素回路において、電流により制御されて発光する電流制御素子と、この電流制御素子を駆動する駆動トランジスタと、信号電圧を与える第1の信号線と前記駆動トランジスタのゲートとの間に接続された第1のスイッチ素子と、前記駆動トランジスタのゲートとドレインとの間に接続された第2のスイッチ素子と、基準電流を与える第2の信号線と前記駆動トランジスタとの間に接続されてオン時に前記駆動トランジスタに電流を流す第3のスイッチ素子と、前記駆動トランジスタのゲートと前記第1のスイッチ素子との間に接続されて前記ゲート電圧を保持する第1の保持容量と、を有することを特徴とする表示装置の画素回路。
- 前記駆動トランジスタのソースとゲートとの間に接続されて前記ゲートの電位を保持する第2の保持容量を有することを特徴とする請求項2に記載の表示装置の画素回路。
- 前記第1のスイッチ素子と前記第1の保持容量との接続点と前記駆動トランジスタのソースとの間に接続されて前記ゲートの電位を保持する第2の保持容量を有することを特徴とする請求項2に記載の表示装置の画素回路。
- 前記駆動トランジスタと前記電流制御素子との間に接続された第4のスイッチ素子を有することを特徴とする請求項2乃至4のいずれか1項に記載の表示装置の画素回路。
- 前記駆動トランジスタは、電源制御線又は負電源制御線に接続されていることを特徴とする請求項2乃至4のいずれか1項に記載の表示装置の画素回路。
- 前記電流制御素子は、電源制御線又は負電源制御線に接続されていることを特徴とする請求項2乃至4のいずれか1項に記載の表示装置の画素回路。
- 前記各スイッチ素子は、薄膜トランジスタであることを特徴とする請求項2乃至7のいずれか1項に記載の表示装置の画素回路。
- 前記薄膜トランジスタは、そのチャネル部がポリシリコンからなることを特徴とする請求項8に記載の表示装置の画素回路。
- 前記電流制御素子は、有機EL発光素子であることを特徴とする請求項2乃至9のいずれか1項に記載の表示装置の画素回路。
- 請求項5に記載の画素回路と、前記第1及び第2の信号線を駆動する信号線駆動回路と、前記第1乃至第4のスイッチ素子のオンオフを制御する第1及び第2の制御線を駆動する制御線駆動回路とを有し、1の前記第1及び第2の信号線はマトリックス状に配置された前記画素回路のうち列方向に配列された1群の画素回路に共通接続されており、1の前記第1及び第2の制御線は行方向に配列された1群の画素回路に共通接続されていることを特徴とする表示装置。
- 前記制御線駆動回路は、第1の期間に、前記第2のスイッチ素子をオフ、前記第1、第3,及び第4のスイッチ素子をオンにする信号を前記第1及び第2の制御線に出力し、第2の期間に、前記第1のスイッチ素子をオン、前記第2乃至第4のスイッチ素子をオフにする信号を前記第1及び第2の制御線に出力し、前記信号線駆動回路は、前記第1の信号線に対し、前記第1の期間に基準電圧を出力し、前記第2の期間に前記基準電圧又は前記基準電圧に対し電位差を有する電圧を出力し、前記第2の信号線に対し、前記第1の期間に基準電流を出力することを特徴とする請求項11に記載の表示装置。
- 請求項6に記載の画素回路と、前記第1及び第2の信号線を駆動する信号線駆動回路と、前記第1乃至第3のスイッチ素子のオンオフを制御する第1及び第2の制御線を駆動する制御線駆動回路とを有し、1の前記第1及び第2の信号線はマトリックス状に配置された前記画素回路のうち列方向に配列された1群の画素回路に共通接続されており、1の前記第1及び第2の制御線は行方向に配列された1群の画素回路に共通接続されていることを特徴とする表示装置。
- 前記駆動トランジスタは、電源制御線に接続されており、前記制御線駆動回路は、第1の期間に、前記第1乃至第3のスイッチ素子をオンにする信号を前記第1及び第2の制御線に出力し、第2の期間に、前記第1のスイッチ素子をオン、前記第2及び第3のスイッチ素子をオフにする信号を前記第1及び第2の制御線に出力し、前記信号線駆動回路は、前記第1の信号線に対し、前記第1の期間に基準電圧を出力し、前記第2の期間に前記基準電圧又は前記基準電圧に対し電位差を有する電圧を出力し、前記第2の信号線に対し、前記第1の期間に基準電流を出力し、前記電源制御線は前記第1及び第2の期間において前記電流制御素子に逆バイアスが印加されるように駆動されることを特徴とする請求項13に記載の表示装置。
- 請求項7に記載の画素回路と、前記第1及び第2の信号線を駆動する信号線駆動回路と、前記第1乃至第3のスイッチ素子のオンオフを制御する第1及び第2の制御線を駆動する制御線駆動回路とを有し、1の前記第1及び第2の信号線はマトリックス状に配置された前記画素回路のうち列方向に配列された1群の画素回路に共通接続されており、1の前記第1及び第2の制御線は行方向に配列された1群の画素回路に共通接続されていることを特徴とする表示装置。
- 前記制御線駆動回路は、第1の期間に、前記第1乃至第3のスイッチ素子をオンにする信号を前記第1及び第2の制御線に出力し、第2の期間に、前記第1のスイッチ素子をオン、前記第2及び第3のスイッチ素子をオフにする信号を前記第1及び第2の制御線に出力し、前記信号線駆動回路は、前記第1の信号線に対し、前記第1の期間に基準電圧を出力し、前記第2の期間に前記基準電圧又は前記基準電圧に対し電位差を有する電圧を出力し、前記第2の信号線に対し、前記第1の期間に基準電流を出力し、前記負電源制御線は前記第1及び第2の期間において前記電流制御素子に逆バイアスが印加されるように駆動されることを特徴とする請求項15に記載の表示装置。
- 前記第2の期間が前記第1の期間に続く期間であり、前記第1及び第2の期間により1水平走査期間が構成されることを特徴とする請求項12、14及び16のいずれか1項に記載の表示装置。
- 電流により制御されて動作する電流制御素子と、この電流制御素子を駆動する駆動トランジスタと、前記駆動トランジスタのゲートとドレインとの間に接続されたスイッチ素子と、基準電流を与える第2の信号線と前記駆動トランジスタとの間に接続されてオン時に前記駆動トランジスタに電流を流す他のスイッチ素子と、電圧を与える第1の信号線と前記駆動トランジスタのゲートとの間に接続されて前記ゲート電圧を保持する第1の保持容量と、を有する電気回路を駆動する駆動方法において、前記第1及び第2のスイッチ素子を制御して、前記第1の信号線から基準電圧の書き込みと前記第2の信号線から基準電流の書き込みを前記電気回路に行う第1の期間と、前記第1の信号線から前記基準電圧又は基準電圧に対し電位差のある電圧を前記書き込むことにより、前記電流制御素子を制御する第2の期間と、を有することを特徴とする電気回路の駆動方法。
- 画素回路がマトリクス状に複数個配置されて表示部を構成する表示装置であって、前記画素回路が、電流により制御されて発光する電流制御素子と、この電流制御素子を駆動する駆動トランジスタと、信号電圧を与える第1の信号線と前記駆動トランジスタのゲートとの間に接続された第1のスイッチ素子と、前記駆動トランジスタのゲートとドレインとの間に接続された第2のスイッチ素子と、基準電流を与える第2の信号線と前記駆動トランジスタとの間に接続されてオン時に前記駆動トランジスタに電流を流す第3のスイッチ素子と、前記駆動トランジスタのゲートと前記第1のスイッチ素子との間に接続されて前記ゲート電圧を保持する第1の保持容量と、を有する表示装置を駆動する駆動方法において、前記第1乃至第3のスイッチ素子を制御して、前記第1の信号線から基準電圧の書き込みと前記第2の信号線から基準電流の書き込みを前記画素回路に行う第1の期間と、前記第1の信号線から前記基準電圧又は基準電圧に対し電位差のある電圧を前記書き込むことにより、階調表示を行う第2の期間と、を有することを特徴とする表示装置の駆動方法。
- 前記第2の期間が前記第1の期間に続く期間であり、前記第1及び第2の期間により1水平走査期間が構成されることを特徴とする請求項18又は19に記載の表示装置の駆動方法。
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