JP2005260607A - 二重絶縁ゲート電界効果トランジスタを用いたcmos回路 - Google Patents
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Abstract
【解決手段】 P形の四端子二重絶縁ゲート電界効果トランジスタの二つのゲート電極を電気的に接続し、更にN形の四端子二重ゲート絶縁ゲート電界効果トランジスタの一方のゲート電極に電気的に接続してCMOSインバータ回路の入力端子とし、該N形の四端子二重絶縁ゲート電界効果トランジスタの他方のゲート電極の電位を制御することにより該N形の四端子二重絶縁ゲート電界効果トランジスタのしきい値電圧を制御する。
【選択図】 図1
Description
一般に四端子二重絶縁ゲート電界効果トランジスタにおいては、それぞれのゲート電極の電位により、それぞれのチャネル表面を導通状態か非導通状態かを制御できる。従って、図1の回路において、VTCの電位をTN1のゲート電極GN2側のチャネル表面が常に非導通となるような値とすればTN1は、ゲート電極GN1側のチャネルのみが導通あるいは非導通となるようゲート電極GN1の電位で制御が可能である。一方TP1の様に両ゲート電極GP1およびGP2を電気的に接続して同電位を与える場合は両チャネルとも同時に導通か非導通になる動作となる。
Claims (8)
- N形及びP型の四端子二重絶縁ゲート電界効果トランジスタを用い、該P形の四端子二重絶縁ゲート電界効果トランジスタの二つのゲート電極を電気的に接続し、更に該N形の四端子二重ゲート絶縁ゲート電界効果トランジスタの一方のゲート電極に電気的に接続してCMOSインバータ回路の入力端子とし、該N形の四端子二重絶縁ゲート電界効果トランジスタの他方のゲート電極の電位を制御することにより該N形の四端子二重絶縁ゲート電界効果トランジスタのしきい値電圧を制御することを特徴としたインバータ作用を行うCMOS回路。
- P型の四端子二重絶縁ゲート電界効果トランジスタが複数個並列に接続され、N型の四端子二重絶縁ゲート電界効果トランジスタが同数個直列に接続され、該複数個のP形の四端子二重絶縁ゲート電界効果トランジスタの各々二つのゲート電極は、それぞれ電気的に接続されると共に、更に該複数個のN形の四端子二重ゲート絶縁ゲート電界効果トランジスタの対応する各一個の一方のゲート電極に各々電気的に接続されて同数個の入力端子とし、該複数個のN形の四端子二重絶縁ゲート電界効果トランジスタの各々他方のゲート電極はそれぞれしきい値電圧制御用電源に接続されたことを特徴とする多入力NAND作用を行うCMOS回路。
- P型の四端子二重絶縁ゲート電界効果トランジスタが複数個直列に接続され、N型の四端子二重絶縁ゲート電界効果トランジスタが同数個並列に接続され、該複数個のP形の四端子二重絶縁ゲート電界効果トランジスタの各々二つのゲート電極は、それぞれ電気的に接続されると共に、更に該複数個のN形の四端子二重ゲート絶縁ゲート電界効果トランジスタの対応する各一個の一方のゲート電極に各々電気的に接続されて同数個の入力端子とし、該複数個のN形の四端子二重絶縁ゲート電界効果トランジスタの各々他方のゲート電極はそれぞれのしきい値電圧制御用電源に接続されたことを特徴とする多入力NOR作用を行うCMOS回路。
- 請求項1に記載のCMOSインバータ回路2個をクロスカップルさせてフリップフロップ回路を構成し、各入力端子にN型の四端子二重絶縁ゲート電界効果トランジスタ2個をパストランジスタとしてそれぞれ接続し、各他端をデータ線に接続し、該パストランジスタの各一方及び各他方のゲート電極を行選択線に接続してなることを特徴とするSRAM作用を行うCMOS回路。
- 上記パストランジスタの各他方のゲート電極をそれぞれそのしきい値電圧制御用電源に接続することを特徴とする請求項4に記載のCMOS回路。
- 上記N形の四端子二重絶縁ゲート電界効果トランジスタの他方のゲート電極の電位をダイナミックに制御することを特徴とした請求項1乃至5に記載されたCMOS回路。
- P型の四端子二重絶縁ゲート電界効果トランジスタと同じゲート電極材料をN型の四端子二重絶縁ゲート電界効果トランジスタのゲート電極として用いることを特徴とした請求項1乃至6に記載されたCMOS回路。
- 請求項1乃至7に記載されたCMOS回路のうち少なくとも一つの回路を含むことを特徴とした集積回路。
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