JP2004348108A - 液晶ディスプレイ装置の駆動回路 - Google Patents
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Abstract
【解決手段】タイミングコントローラーとソースドライバを更に含んだ低階調度用駆動回路を駆動回路で実施する。タイミングコントローラーはイメージデータを受信し、デジタルイメージ信号、デジタル信号と極性反転信号を出力する。ソースドライバはデジタルイメージ信号を受信し、アナログイメージ信号を生成する。低階調度用駆動回路は、タイミングコントローラーから出力された信号に基づいて、第1アナログ信号、第2アナログ信号、第3アナログ信号と第4アナログ信号を出力する。
【選択図】図2
Description
したがって、携帯用電子機器に用いるのに適した低電力消費のディスプレイ装置が必要である。
第3デジタル信号304A3を受信する。第4バッファ131B4の第2入力端子は、第4デジタル信号304A4を受信する。
110 タイミングコントローラー
120 ソースドライバ
121 第1レジスタ
122 第2レジスタ
123 デジタル/アナログ(D/A)変換器
124 出力回路
130 低階調度用駆動回路
131B1、131B2、131B3、131B4 バッファ
132〜135P,132〜135N トランジスタのセット
136A〜K レジスタ
200 液晶ディスプレイパネル
301 極性反転信号
302 デジタルイメージ信号
303 アナログ信号
304A1〜304A4 第1〜第4デジタル信号
305 アナログ信号
401 入力信号
402 出力信号
403 信号
404 アナログ信号
405 コントロール信号
406 第1調整電圧
407 第2調整電圧
GV1〜GV4 第1アナログ信号〜第4アナログ信号
VDD 電圧
VSS グランド電圧
Claims (10)
- 極性反転信号と少なくとも一つのデジタル信号を生成するタイミングコントローラー、および
前記極性反転信号と前記デジタル信号に対応して少なくとも1つのアナログ信号を生成する低階調度用駆動回路を含む液晶ディスプレイ装置の駆動回路。 - 前記低色度駆動回路が前記極性反転信号と前記タイミングコントローラーから生成された前記デジタル信号を受信する少なくとも1つのバッファ、および、
前記バッファの出力端子に接続され、前記アナログ信号を出力する少なくとも1セットのトランジスタを含む請求項1に記載の液晶ディスプレイ装置の駆動回路。 - 極性反転信号と少なくとも1つのデジタル信号を出力するタイミングコントローラー、ソースドライバおよび低階調度用駆動回路を含み、前記低階調度用駆動回路は少なくとも1つのアナログ信号を生成する液晶ディスプレイ装置の駆動回路であって、
前記極性反転信号と前記タイミングコントローラーから出力された前記デジタル信号を受信する少なくとも1つのバッファ、および、
前記バッファの出力端子に接続され、前記アナログ信号を出力する少なくとも1セットのトランジスタを含む液晶ディスプレイ装置の駆動回路。 - 前記第1セットのトランジスタは、PMOSトランジスタとNMOSトランジスタからなり、前記PMOSトランジスタのゲートと前記NMOSトランジスタのゲートは、前記バッファの出力端子に接続され、前記PMOSトランジスタのソースは、前記NMOSトランジスタのドレインに接続され、前記PMOSトランジスタのドレインは電圧に接続され、前記NMOSトランジスタのソースは、グランド電圧に接続され、前記PMOSトランジスタのソースと前記NMOSトランジスタのドレインにより前記アナログ信号が出力される請求項3に記載の液晶ディスプレイ装置の駆動回路。
- タイミングコントローラー、ソースドライバと低階調度用駆動回路を含み、前記タイミングコントローラーは、極性反転信号、第1デジタル信号、第2デジタル信号、第3デジタル信号、第4デジタル信号を出力し、第前記低階調度用駆動回路は、1アナログ信号、第2アナログ信号、第3アナログ信号、第4アナログ信号を生成する液晶ディスプレイ装置の駆動回路であって、
前記極性反転信号、前記第1デジタル信号、前記第2デジタル信号、前記第3デジタル信号、前記第4デジタル信号を受信する複数のバッファ、および
第1セットのトランジスタ、第2セットのトランジスタ、第3セットのトランジスタ、第4セットのトランジスタからなり、前記バッファの出力端子にそれぞれ接続されて、前記第1、第2、第3と第4アナログ信号をそれぞれ出力する複数セットのトランジスタを含む液晶ディスプレイ装置の駆動回路。 - 複数のバッファは、第1バッファ、第2バッファ、第3バッファと第4バッファを含み、前記各バッファは第1入力端子、第2入力端子および前記出力端子をそれぞれ有し、前記各バッファの前記第1入力端子は前記極性反転信号を受信し、前記第1バッファの前記第2入力端子は前記第1デジタル信号を受信し、前記第2バッファの前記第2入力端子は前記第2デジタル信号を受信し、前記第3バッファの前記第2入力端子は前記第3デジタル信号を受信し、前記第4バッファの前記第2入力端子は、前記第4デジタル信号を受信する請求項5に記載の液晶ディスプレイ装置の駆動回路。
- 前記第1セットのトランジスタは、第1PMOSトランジスタと第1NMOSトランジスタからなり、前記第1PMOSトランジスタのゲートと前記第1NMOSトランジスタのゲートは、前記第1バッファの出力端子に接続され、前記第1PMOSトランジスタのソースは、前記第1NMOSトランジスタのドレインに接続され、前記第1PMOSトランジスタのドレインは電圧に接続され、前記第1NMOSトランジスタのソースはグランド電圧に接続され、前記第1PMOSトランジスタのソースと前記第1NMOSトランジスタのドレインにより前記アナログ信号が出力され、
前記第1PMOSトランジスタのドレインと前記第1NMOSトランジスタのソースの間に直列接続される3つのレジスタを更に含む請求項6に記載の液晶ディスプレイ装置の駆動回路。 - 前記第2セットのトランジスタは、第2PMOSトランジスタと第2NMOSトランジスタからなり、前記第1PMOSトランジスタのゲートと前記第2NMOSトランジスタのゲートは、前記第2バッファの出力端子に接続され、前記第2PMOSトランジスタのソースは、前記第2NMOSトランジスタのドレインに接続され、前記第2PMOSトランジスタのドレインは電圧に接続され、前記第2NMOSトランジスタのドレインはグランド電圧に接続され、前記第2PMOSトランジスタのソースと前記第2NMOSトランジスタのドレインにより前記第2アナログ信号が出力され、
前記第1PMOSトランジスタのドレインと前記第2PMOSトランジスタのドレインの間に接続するレジスタと、前記第1NMOSトランジスタのソースと前記第2NMOSトランジスタのソースの間に接続されるレジスタを更に含む請求項7に記載の液晶ディスプレイ装置の駆動回路。 - 前記第3セットのトランジスタは、第3PMOSトランジスタと第3NMOSトランジスタからなり、前記第3PMOSトランジスタのゲートと前記第3NMOSトランジスタのゲートは、前記第3バッファの出力端子に接続され、前記第3PMOSトランジスタのソースは、前記第3NMOSトランジスタのドレインに接続され、前記第3PMOSトランジスタのドレインは電圧に接続され、前記第3NMOSトランジスタのソースはグランド電圧に接続され、前記第3PMOSトランジスタのソースと前記第3NMOSトランジスタのドレインにより前記第3アナログ信号が出力され、
前記第2PMOSトランジスタのドレインと前記第3PMOSトランジスタのドレインの間に接続するレジスタと、前記第2NMOSトランジスタのソースと前記第3NMOSトランジスタのソースの間に接続されるレジスタを更に含む請求項8に記載の液晶ディスプレイ装置の駆動回路。 - 前記第4セットのトランジスタは、第4PMOSトランジスタと第4NMOSトランジスタからなり、前記第4PMOSトランジスタのゲートと前記第4NMOSトランジスタのゲートは、前記第4バッファの出力端子に接続され、前記第4PMOSトランジスタのソースは、前記第4NMOSトランジスタのドレインに接続され、前記第4PMOSトランジスタのドレインは電圧に接続され、前記第4NMOSトランジスタのソースはグランド電圧に接続され、前記第4PMOSトランジスタのソースと前記第4NMOSトランジスタのドレインにより前記アナログ信号が出力され、
前記第3PMOSトランジスタのドレインと前記第4PMOSトランジスタのドレインの間を接続するレジスタと、前記第3NMOSトランジスタのソースと前記第4NMOSトランジスタのソースの間に接続されるレジスタ、前記第4PMOSトランジスタと前記電圧の間を接続するレジスタ、および前記第4トランジスタのソースと前記グランド電圧の間を接続するレジスタを更に含む請求項9に記載の液晶ディスプレイ装置の駆動回路。
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