JP2002050963A - デジタル情報送受信装置の電気消費量を減少させるプロセスおよび装置 - Google Patents
デジタル情報送受信装置の電気消費量を減少させるプロセスおよび装置Info
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Abstract
電気消費量を減少させる。 【解決手段】精度の低い発振器から基底信号(SBA)
を受け取る分数分割位相同期ループを使用し、送受信段
階が活動状態の時は精度の高いクロック信号(SH)を
出力し、送受信段階が非活動状態の時は発振器の出力を
処理段階の入力部に切り替えて接続することによって電
気消費量の減少を達成するプロセスおよび装置。
Description
線伝送に関するもので、特に、UMTS(Universal Mo
bile Terrestrial Standard)規格の下で動作するよう
に設計されたセルラ移動電話に関するものである。
およびアイドル・モードという2つの動作モードを持
つ。活動モードは、基地局と移動電話の間で確立される
通信の過程における対話に対応し、このモードにおいて
は、電話の送信経路および受信経路の両方が基地局と電
話の間で音声またはデジタル・データを伝送するために
使用される。
時、そのアイドル・モードで待機する。このアイドル・
モードにおいては、送信経路および受信経路は、基地局
との規則的接続を維持するように、規則的間隔で起動さ
れ停止される。
経路を含む送信/受信段階とは別に、移動電話は、送信
/受信段階に接続された処理段階、および、信号プロセ
ッサ内で部分的に回路化された論理としてまた部分的に
ソフトウェア形態で一般的に実施されるデジタル変調/
復調手段を含む。従って、この信号プロセッサは、特
に、受信された信号の復調および送信されるべき信号の
変調を実行する。
準信号およびクロック信号が、生成され、送信経路、受
信経路および変調/復調プロセッサそれぞれへ供給され
なければならない。基準信号の周波数は、送信周波数お
よび受信周波数を固定する。種々の基準信号およびクロ
ック信号が、自動周波数制御手段によって制御される周
波数シンセサイザ段階によって供給される。送信周波数
に関して必要とされる精度は、典型的には、2GHz範
囲の公称周波数に関して±0.1ppmである。
の周波数シンセサイザ段階の内部アーキテクチャは、従
来技術の位相同期ループから構成されている。位相同期
ループは、ループの発振器の出力部において、送信/受
信段階に向かう基準信号および変調/復調段階に向かう
クロック信号を生成する。
基準を形成する基底信号が、例えば必要精度(±0.1p
pm)を持つ安定温度電圧制御発振器(すなわちVTCX
O発振器)のような制御発振器から発信される。従っ
て、特に伝送周波数に関して要求精度を条件づけるのは
基本的にこの発振器である。
ロック信号を生成し、送信経路のために基準信号を生成
する際、制御された発振器がこのアーキテクチャに基づ
いて常に動作している。
る。すなわち、このような種類の制御された発振器は高
価であるだけでなく、その電気消費量も電話の自律性を
そこなう。本発明は、この問題に対する解決策を与える
ことを課題とする。
移動電話の動作モードの1機能として周波数シンセサイ
ザ段階の電気消費量を最適化することによって送信器/
受信器(電話)の電気消費量を最適化することである。
させるという観点から、送信器/受信器の種々の動作モ
ードにおいて種々のクロック信号および同期信号を生成
することである。
器特にセルラ移動電話の電気消費量を減らすプロセスを
提案する。この送信器/受信器は自動周波数制御アルゴ
リズムによって制御される周波数シンセサイザ段階を含
み、この周波数シンセサイザ段階は、選択された周波数
の少なくとも1つの基準信号を送信器/受信器の送信/
受信段階へ供給し、選択された周波数のマスタ・クロッ
ク信号を送信器/受信器の変調/復調手段へ供給するこ
とができる。
号は、自動周波数制御アルゴリズムによって制御される
少なくとも1つの第1の分数分割位相同期ループに基づ
いて、典型的には±0.1ppmという(伝送精度と呼ば
れる)あらかじめ定められた精度で生成される。この場
合、このループは、あらかじめ定められた基底周波数お
よび前記伝送精度より低い(典型的には±10ppmと
いうオーダーの)基底精度を持つ基底信号を(例えば水晶
発振器から)受け取る。
ズムによって制御される第2の分数分割位相同期ループ
に基づいて、(伝送精度と呼ばれる)あらかじめ定められ
た精度で生成される。この第2のループも前記基底信号
を受け取る。
えばアイドル・モードにある時)、第2の分数分割位相
同期ループは非活動状態にされ、前記基底信号がマスタ
・クロック信号となり、送信/受信段階が活動状態の
時、第2のループが起動され、この第2のループによっ
て生成される前記クロック信号がマスタ・クロック信号
となる。換言すれば、かなり精度の低い水晶発振器から
周波数基準を受け取る分数分割位相同期ループを使用
し、送信/受信段階が非活動状態である時発振器の出力
部を処理段階の入力部へ切り換えることによって、電話
の電気消費が低減される。それらループは次に非活動状
態にされる。
えば送信経路)が起動させられなければならない時(すな
わち電話通信の間活動状態にあるかさもなければ規則的
間隔のアイドル・モードにある時)、電話の変調/復調
手段が、自動周波数制御アルゴリズムという手段によっ
て(基地局によって伝送されるパイロット信号を復調す
ることによって)第2の位相同期ループ(および当然のこ
とながら第1のループ)を制御して、送信経路向けの、
典型的には±0.1ppmという非常に精度の高い基準
周波数を生成すると共に信号プロセッサのマスタ・クロ
ック信号を生成できるようにする。
時、すなわちアイドル・モードの間規則的間隔で非活動
状態にある時、送信経路のための基準信号を生成するこ
とは絶対に不必要である。信号プロセッサだけが起動さ
れればよい。また、この場合、第2の位相同期ループを
起動させることも絶対に不必要であることが認められ
る。特に、例えば±10ppmのような比較的低い精度
のマスタ・クロック信号でも処理段階を動作させるため
には全く十分であることが認められる。また、このかな
り精度の低いクロック信号は、例えば水晶基準発振器に
よって直接供給されることができる。
経路が非活動状態にあり、従って、非常に精度の高い基
準信号およびクロック信号を形成することが絶対必要と
されない場合が存在し、そのような場合には処理段階を
動作させるのには比較的低い精度のクロック信号で十分
であるという認識に基づいている。
る必要がある時、種々の分数分割位相同期ループが、パ
イロット信号に対する同期化に続いて±0.1ppmと
いうオーダーの精度の正確な周波数へ固定されるまで、
変調/復調手段および自動周波数制御アルゴリズムがか
なり精度の低いクロック信号で動作を開始することがで
きるという認識に基づいている。
分数分割位相同期ループを使用して、その出力部にVT
CXO発振器より低い精度の水晶発振器などによって供
給される基底基準信号に基づいて、例えば数Hzという
オーダーの非常に高い精度ではあるが、VTCXO発振
器より少ない電気消費量で該ループの出力部に信号を供
給することができる。
信/受信段階に接続され、変調/復調手段および自動周
波数制御手段を含む処理段階と、該自動周波数制御手段
によって制御され、選択された周波数の少なくとも1つ
の基準信号を該送信/受信段階に供給し、選択された周
波数のマスタ・クロック信号を該変調/復調手段に供給
することができる周波数シンセサイザ段階とを含む送受
信器特にセルラ移動電話を提案する。
シンセサイザ段階は、あらかじめ定められた精度で前記
基準信号を供給できるようにその出力部が前記送信/受
信段階に接続された少なくとも1つの第1の分数分割位
相同期ループと、その出力部があらかじめ定められた精
度で前記クロック信号を供給できる第2の分数分割位相
同期ループと、を含む。
非活動状態を選定することができ、また、前記自動周波
数制御手段に接続された制御入力部および発振器から発
信されあらかじめ定められた基底周波数および前記伝送
精度より低い基底精度を持つ基底信号を受け取る入力部
を備える。
記変調/復調手段に前記発振器の出力を連結させる第1
の状態および前記変調/復調手段に前記第2のループの
出力を連結させる第2の状態を保有する制御可能な切り
替え手段を備える。また、該送信器/受信器は、前記第
2のループを非活動状態に置くと共に前記切り替え手段
をその第1の状態に置き、前記第2のループを活動状態
に置くと共に前記切り替え手段をその第2の状態に置く
ことができる制御手段を更に備える。
プは、デルタ−シグマ変調分数分割位相同期ループであ
って、これによって、電源の位相ノイズの減少および数
Hzというオーダーのクロック精度が可能とされる。
が、例えばUMTS規格に従って動作するように設計さ
れるセルラ移動電話の分野に特に適用されることを仮定
する。UMTSは、"Universal Mobile Terrestrial St
andard"の略称である。
(基地局)は、典型的には、当業者に周知のように、例え
ば音声のような伝送されるべき有効なデータを受け取
り、いわゆる"チャネル符号化"処理演算を実行する符号
化ブロックを備える。この符号化ブロックの出力部はバ
イナリ情報ブロックから成る。従来技術に従って、符号
化ブロックに続いて、変調器が具備される。変調器は、
当業者に周知の用語に従えば、例えばQPSKタイプの
直角変調を実行し、バイナリ信号をアナログ信号に変換
する。次に、このアナログ信号が伝送フィルタでフィル
タされ、ラジオ周波数(RF)に変換された後アンテナ経
由で電話の方向へ送信される。
よび送信経路TXCを本質的に含むアナログ送信/受信
段階に接続したアンテナANTをその先端に備える。U
MTS規格において、受信周波数は2110と2170
MHzの間とされ、一方、送信周波数は、受信周波数と
は区別され、1920と1980MHzの間とされてい
る。
つは、伝送周波数の高い精度に関する。具体的には、こ
の伝送周波数は、公称伝送周波数のいずれの側において
も0.1ppm以上変化してはならない。
ナログ/デジタル変換CANおよびデジタル/アナログ
変換CNA段階を経由して、デジタル処理段階に接続さ
れている。デジタル処理段階は、部分的に回路化され、
部分的に例えば信号プロセッサDSPで構成され、その
種々の機能がソフトウェア形態で実行される。
ルス応答を推定する手段、符号間干渉を抑制するイコラ
イザ手段および経路復号ブロックとは別に)、受け取っ
た信号の復調および送信されるべき信号の変調を実行す
る能力を持つ変調/復調手段MDMを備える。
よび送信周波数をそれぞれ有する基準信号を生成して受
信経路RXCおよび送信経路TXCに供給するように構
成される少なくとも1つの分数分割位相同期ループ(fra
ctional-division phase-locked loop)EPLLを備え
る。基準信号を送信経路および受信経路のうちの一方に
直接供給する単一のループEPLLだけを含むケースに
おいては、該ループEPLLによって直接供給される基
準信号に基づいて基準信号を送信経路および受信経路の
他方の経路に供給する周波数偏移手段が具備される。そ
のような場合、当該電話に関して使用されるアーキテク
チャに依存するが、2つの基準信号を送信経路および受
信経路にそれぞれ供給して送信周波数および受信周波数
を直接固定する2つの独立したループEPLLを備える
ことも可能である。
のループEPLLだけが存在すると仮定するが、当然の
ことながら、以下の記述のすべては複数のループEPL
Lが存在するケースにおいても有効であることは理解さ
れるべき点である。
号の精度は、制御信号SC1によって制御される。制御
信号SC1は、実際には、自動周波数制御AFCのソフ
トウェア手段によって提供されるデジタル・ワードであ
る。
じめ定められた周波数を持ちあらかじめ定められた符号
を含むパイロットチャネル上を基地局によって伝送され
るパイロット信号の復調を実行する。
相同期ループMCPLLによって生成される(詳細は後
述)マスタ・クロック信号を使用する。このマスタ・ク
ロック信号の周波数は、理論的には、パイロットチャネ
ルのデータ伝送レート("チップ・レート")の倍数であ
る。そうでないケースでは、復調の間、理論上の伝送速
度("チップ・レート")とマスタ・クロック信号の差に対
応する周波数において変調配列の回転(rotation of th
e modulation constellation)が観察される。この場
合、自動周波数制御アルゴリズムがこの配列の回転を停
止させるように制御ワードの値を調整する。このケース
においては、電話のすべての位相同期ループがラッチさ
れていると見なされ、種々のクロックが必要とされる精
度を持つことになる。
業者に周知である。自動周波数制御アルゴリズムは、Al
do N. D'Andrea著"Design of Quadricorrelators for A
utomatic Frequency Control Systems"(IEEE Transact
ions on Communications Vol. 41, No 6, June 1993)、
Wen-YiKuo著"Frequency Offset Compensation of Pilot
Symbol Assisted Modulation in Frequency Flat Fadi
ng"(IEEE Transactions on Communications, Vol. 45,
No 11, November 1997)またはBelllni著"Digital Frequ
ency Estimation in Burst Mode QPSK Transmission"(I
EEE Transactions on Communications, Vol. 38, No 7,
July 1990)などの文献に記述されている。
た、別の1つの分数分割位相同期ループMCPLLを含
む。このループMCPLLの出力部は、(例えば2つの
入力部および1つの出力部を持つマルチプレクサのよう
な)二段階を有する切り替え手段MCMの第2の入力部
E2に接続されている。切り替え手段MCMの出力部S
は、マスタ・クロック信号SHMを供給するため変調/
復調手段MDMに接続されている。
0MHzのような)あらかじめ定められた基底周波数お
よび送信周波数に必要とされる精度より非常に低い精度
を持つ水晶発振器QTの出力部に接続された第1の入力
部E1を含む。水晶発振器の精度は、例えば、±10p
pmのオーダーである。
よって供給される制御信号SCAIによって制御され
る。制御手段MCDもまたソフトウェア手段である。制
御手段MCDはもう1つの制御信号SCACを用いてル
ープEPLLおよびMCPLLの起動および停止を行
う。
同期ループEPLLおよびMCPLLのための基準信号
の役目を果たす。また、ループMCPLLによって供給
されるクロック信号SHの精度を制御する制御信号SC
2が自動周波数制御手段AFCによって供給され、これ
もまたデジタル・ワードである。SC1に対するSC2
の比率は固定されている。
に周知のものであるが、文献"Technique enhances the
performance of PLL Synthetisers"(Microwaves & RF,
January 1993, pages 59-65)で参照することができる。
レメントを示している。すなわち、分数分割位相同期ル
ープPLLFは、その先頭に、当業者に周知の従来技術
構成の位相および周波数検出器PFDを備えている。こ
の検波器PFDの出力は、その出力部が電圧制御型ルー
プ発振器VCOの入力部に接続されたループ・フィルタ
FTを駆動する。ループ発振器VCOの周波数は、実質
的に、(発振器VCOの出力部である)ループの出力部S
Oに供給される出力信号に関して要求される出力周波数
である。発振器VCOの出力は、自動周波数制御手段A
FCから発信される制御ワードSCによって制御される
分数分割器DVを経由して、検波器PFDの入力部の一
方へ還流される。検波器PFDの他の入力部は、発振器
QTから発信される基底信号SBAを受け取る。
する信号SBAの周波数の比率を超えない最も近い整数
である。更に、要求精度に対する信号SBAの周波数の
比率が、制御ワードSCのビット数を定める。例えば、
ループの出力周波数が±0.1ppmの2GHzと等し
いことが必要とされるとすれば、これは200Hzの精
度に対応し、信号SBAの周波数が20MHzであれ
ば、前述の比率は、20MHz/200Hz、すなわち
100,000であり、この値は216と217の間に
ある。従って、制御ワードSCは、17ビットのワード
であり、信号SBAと出力信号SOの間の正確な比率を
±0.1ppmの範囲内へ到達させることができるよう
に、分割器DVがNによる分割を実行する回数を定め、
分割器DVがN+1による分割を実行する回数を定め
る。
な長さのデジタル・ワードを含む分割器の制御を通し
て、非常に低い精度を持つ発振器から発信される基底信
号を使用することによって、出力周波数における非常に
良好な精度を取得することを可能にする。
れているように、分割器の制御を、やはり当業者に周知
のデルタ−シグマ変調器から行うこともできる。手段A
FCから供給される制御ワードSCが積分器を駆動す
る。次に、積分器の出力がフィルタFT1を経由して量
子化手段QTの入力部に供給される。量子化手段QTの
出力は、一方で積分器の入力部へ還流され、他方で位相
同期ループの分割器DVを制御する。
対値の量子化ではなく、サンプルごとの信号の修正の量
子化に基づくものである。"シグマ"積分器が存在するの
で、"デルタ−シグマ"という名称がこの変調器に与えら
れる。デルタ−シグマ変調器は、基底帯域からの量子化
ノイズを削除するように設計されている。デルタ−シグ
マ変調による分割器の制御は、総体的ノイズの低減を可
能にする。
は、Perrott著"A27-mW CMOS Fractional-N Synthesizer
Using Digital Compensation for 2.5-Mb/s GFSK Modu
lation"(IEEE Journal of Solid-State Circuits, Vol.
32, No 12, December 1997)および"Technique enhance
s the performance of PLL Synthetisers"(Microwaves
& RF, January 1993, pages 59-65)で参照することがで
きる。
の周波数シンセサイザ段階の動作の詳細を以下に記述す
る。
Sと電話の間の通信の間において、制御手段MCDが、
位相同期ループEPLLおよびMCPLLを起動し、切
り替え手段MCMをその第2の出力部E2と出力部Sと
連結させる第2の状態に置く。従って、変調/復調手段
に供給される主クロック信号SHMは、ループMCPL
Lによって供給されるクロック信号SH(すなわちパイ
ロット信号伝送レート("チップ・レート")の倍数)であ
る。これは、例えば、UMTS規格の場合の3.84M
cpsに等しい伝送レート("チップ・レート")に関して
15.36MHzである。
れる基準信号の精度は、±0.1ppmと等しく、この
精度は自動周波数アルゴリズムを介する制御ワードSC
1およびSC2によって制御されている。
れているように、基地局BSは規則的間隔で携帯電話T
Pと通信し、パイロット信号SPは信号の一部としてす
べての時間に伝送されている。
では、制御手段MCDはループEPLLおよびMCPL
Lを非活動状態にさせ、切り替え手段MCMをその第1
の入力部E1を出力部Sに連結させる第1の状態に置
く。このケースでは、処理段階に供給される主クロック
信号SHMは、発振器QTによって供給される基底信号
SBAである。従って、処理段階、特に変調/復調手段
は、精度が±10ppmという発振器QTの精度に等し
い精度のクロック信号を受け取る。しかしながら、非対
話期間の過程においてはこの精度で全く十分である。
各期間の直前に、制御手段MCDは、ループEPLLお
よびMCPLLを活動状態にさせ、切り替え手段を再び
その第2の状態に置く。ループMCPLLの起動時に
は、±10ppmという精度の信号SHM(信号SH)が
供給される。しかしながら、この精度は、自動周波数制
御手段AFCが、周波数制御を実行し制御ワードSC1
とSC2を供給して、基地局との対話が実際に開始する
時間ΔT (使用するアーキテクチャによるが数マイクロ
秒というオーダーの時間)の終了時に、精度を±0.1p
pmへ引き上げることを可能にするには十分なものであ
る。
再びループEPLLおよびMCPLLを非活動状態にさ
せ、切り替え手段MCMをその第1の状態へ戻す。
周波数シンセサイザ段階の内部アーキテクチャを示すブ
ロック図である。
ープを示すブロック図である。
めデルタ−シグマ変調方式を使用する1つの実施形態の
ブロック図である。
示すブロック図である。
Claims (4)
- 【請求項1】デジタル情報の送受信器特にセルラ移動電
話の電気消費量を減少させるため、自動周波数制御アル
ゴリズムによって制御され、選択された周波数の少なく
とも1つの基準信号を該移動電話の送信/受信段階へ供
給し、選択された周波数のマスタ・クロック信号を該移
動電話の変調/復調手段へ供給することができる周波数
シンセサイザ段階を含むプロセスであって、自動周波数
制御アルゴリズムによって制御され、あらかじめ定めら
れた基底周波数および伝送精度より低い基底精度を持つ
基底信号を受け取る少なくとも1つの第1の分数分割位
相同期ループに基づいて、前記基準信号があらかじめ定
められた前記伝送精度で生成され、前記自動周波数制御
アルゴリズムによって制御され、前記基底信号を受け取
る第2の分数分割位相同期ループに基づいて、前記クロ
ック信号があらかじめ定められた精度で生成され、前記
送信/受信段階が非活動状態の時、前記第2の分数分割
位相同期ループが非活動状態にされ、前記基底信号が前
記マスタ・クロック信号となり、前記送信/受信段階が
活動状態の時、前記第2の分数分割位相同期ループが起
動され、該第2の分数分割位相同期ループによって供給
される前記クロック信号が前記マスタ・クロック信号と
なることを特徴とするプロセス。 - 【請求項2】送信/受信段階と、該送信/受信段階に接
続され、変調/復調手段および自動周波数制御手段を含
む処理段階と、該自動周波数制御手段によって制御さ
れ、選択された周波数の少なくとも1つの基準信号を該
送信/受信段階に供給し、選択された周波数のマスタ・
クロック信号を該変調/復調手段に供給することができ
る周波数シンセサイザ段階とを備えるデジタル情報送受
信装置特にセルラ移動電話であって、 前記周波数シンセサイザ段階が、あらかじめ定められた
伝送精度で前記基準信号を供給できるようにその出力部
が前記送信/受信段階に接続された少なくとも1つの第
1の分数分割位相同期ループおよびその出力部があらか
じめ定められた精度でクロック信号を供給できる第2の
分数分割位相同期ループを含み、前記ループの各々が、
コマンドに応じて活動状態と非活動状態を選定すること
ができ、また、前記自動周波数制御手段に接続された制
御入力部および発振器から発信されあらかじめ定められ
た基底周波数および前記伝送精度より低い基底精度を持
つ基底信号を受け取る入力部を備え、 前記周波数シンセサイザ段階が、前記変調/復調手段に
前記発振器の出力を連結させる第1の状態および前記変
調/復調手段に前記第2のループの出力を連結させる第
2の状態を保有する制御可能な切り替え手段を更に含
み、 前記第2の分数分割位相同期ループを非活動状態に置く
と共に前記切り替え手段をその第1の状態に置き、前記
第2の分数分割位相同期ループを活動状態に置くと共に
前記切り替え手段をその第2の状態に置くことができる
制御手段を更に備える装置。 - 【請求項3】前記ループの各々がデルタ−シグマ変調分
数分割位相同期ループである、請求項1に記載の方法。 - 【請求項4】前記ループの各々がデルタ−シグマ変調分
数分割位相同期ループである、請求項2に記載の装置。
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