JP2001287393A - 自己走査型発光素子アレイの駆動方法 - Google Patents
自己走査型発光素子アレイの駆動方法Info
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- JP2001287393A JP2001287393A JP2000104431A JP2000104431A JP2001287393A JP 2001287393 A JP2001287393 A JP 2001287393A JP 2000104431 A JP2000104431 A JP 2000104431A JP 2000104431 A JP2000104431 A JP 2000104431A JP 2001287393 A JP2001287393 A JP 2001287393A
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Abstract
(57)【要約】
【課題】 書込み電流制限用の外付け抵抗による電力損
失を減らし、光書込みヘッドの昇温を小さくできる自己
走査型発光素子アレイを提供する。 【解決手段】 自己走査型発光素子アレイの発光部のφ
I 端子２５に外付け抵抗３５を介して接続されるＣＭＯ
Ｓインバータ５０のＨレベルは、＋５Ｖの電源とは独立
の＋２Ｖ電源に接続される。＋２Ｖの電源を使うと、抵
抗３５の電圧降下は０．５Ｖ程度となり、抵抗３５での
電力損失は、電力１０ｍＡで３５ｍＷから５ｍＷに、す
なわち１／７に減る。
失を減らし、光書込みヘッドの昇温を小さくできる自己
走査型発光素子アレイを提供する。 【解決手段】 自己走査型発光素子アレイの発光部のφ
I 端子２５に外付け抵抗３５を介して接続されるＣＭＯ
Ｓインバータ５０のＨレベルは、＋５Ｖの電源とは独立
の＋２Ｖ電源に接続される。＋２Ｖの電源を使うと、抵
抗３５の電圧降下は０．５Ｖ程度となり、抵抗３５での
電力損失は、電力１０ｍＡで３５ｍＷから５ｍＷに、す
なわち１／７に減る。
Description
【０００１】
【発明の属する技術分野】本発明は、３端子発光サイリ
スタを用いた自己走査型発光素子アレイの駆動方法、特
に、外付け抵抗による電力損失を減らし、光書込みヘッ
ドの昇温を小さくできる自己走査型発光素子アレイの駆
動方法に関する。
スタを用いた自己走査型発光素子アレイの駆動方法、特
に、外付け抵抗による電力損失を減らし、光書込みヘッ
ドの昇温を小さくできる自己走査型発光素子アレイの駆
動方法に関する。
【０００２】
【従来の技術】多数個の発光素子を同一基板上に集積し
た発光素子アレイは、その駆動用ＩＣと組み合わせて光
プリンタ等の書込み用光源として利用されている。本発
明者らは発光素子アレイの構成要素としてｐｎｐｎ構造
を持つ３端子発光サイリスタに注目し、発光点の自己走
査が実現できることを既に特許出願（特開平１−２３８
９６２号公報、特開平２−１４５８４号公報、特開平２
−９２６５０号公報、特開平２−９２６５１号公報）
し、光プリンタ用光源として実装上簡便となること、発
光素子ピッチを細かくできること、コンパクトな発光素
子アレイを作製できること等を示した。
た発光素子アレイは、その駆動用ＩＣと組み合わせて光
プリンタ等の書込み用光源として利用されている。本発
明者らは発光素子アレイの構成要素としてｐｎｐｎ構造
を持つ３端子発光サイリスタに注目し、発光点の自己走
査が実現できることを既に特許出願（特開平１−２３８
９６２号公報、特開平２−１４５８４号公報、特開平２
−９２６５０号公報、特開平２−９２６５１号公報）
し、光プリンタ用光源として実装上簡便となること、発
光素子ピッチを細かくできること、コンパクトな発光素
子アレイを作製できること等を示した。
【０００３】さらに本発明者らは、スイッチ素子（３端
子発光サイリスタ）アレイをシフト部として、発光素子
（３端子発光サイリスタ）アレイよりなる発光部と分離
した構造の自己走査型発光素子アレイを提案している
（特開平２−２６３６６８号）。
子発光サイリスタ）アレイをシフト部として、発光素子
（３端子発光サイリスタ）アレイよりなる発光部と分離
した構造の自己走査型発光素子アレイを提案している
（特開平２−２６３６６８号）。
【０００４】図１は、シフト部と発光部とが分離された
タイプの２相駆動ダイオード結合の自己走査型発光素子
アレイと、そのドライバ回路とを示している。図中、１
０は自己走査型発光素子アレイチップであり、シフト部
は、スイッチ素子Ｔ1 ，Ｔ2，Ｔ3 …とダイオードＤと
負荷抵抗Ｒ1 ，Ｒ2 ，Ｒ3 …とで構成され、発光部は発
光素子Ｌ1 ，Ｌ2 ，Ｌ3 …で構成されている。１１は、
シフト部φ１ラインを、１２はシフト部φ２ラインを、
１５は発光部φI ラインをそれぞれ示している。また、
２１はφ１（クロックパルス）端子、２２はφ２（クロ
ックパルス）端子、２３はφS （スタートパルス）端
子、２４はＶGK（電源）端子、２５はφI（書込み信
号）端子である。
タイプの２相駆動ダイオード結合の自己走査型発光素子
アレイと、そのドライバ回路とを示している。図中、１
０は自己走査型発光素子アレイチップであり、シフト部
は、スイッチ素子Ｔ1 ，Ｔ2，Ｔ3 …とダイオードＤと
負荷抵抗Ｒ1 ，Ｒ2 ，Ｒ3 …とで構成され、発光部は発
光素子Ｌ1 ，Ｌ2 ，Ｌ3 …で構成されている。１１は、
シフト部φ１ラインを、１２はシフト部φ２ラインを、
１５は発光部φI ラインをそれぞれ示している。また、
２１はφ１（クロックパルス）端子、２２はφ２（クロ
ックパルス）端子、２３はφS （スタートパルス）端
子、２４はＶGK（電源）端子、２５はφI（書込み信
号）端子である。
【０００５】シフト部φ１ライン１１は、チップ内に内
蔵された電流制限用抵抗３１を介して、φ１端子２１に
接続され、シフト部φ２ライン１２は、チップ内に内蔵
された電流制限用抵抗３２を介して、φ２端子２２に接
続され、スイッチ素子Ｔ1 のゲートは、電流制限用抵抗
３３を介してφS 端子２３に接続されている。
蔵された電流制限用抵抗３１を介して、φ１端子２１に
接続され、シフト部φ２ライン１２は、チップ内に内蔵
された電流制限用抵抗３２を介して、φ２端子２２に接
続され、スイッチ素子Ｔ1 のゲートは、電流制限用抵抗
３３を介してφS 端子２３に接続されている。
【０００６】ドライバ回路は、ＰＭＯＳトランジスタ
（ノーマリー・オン）５１とＮＭＯＳトランジスタ（ノ
ーマリー・オフ）５２とでそれぞれ構成された４個のＣ
ＭＯＳインバータ５０を備えている。これらＣＭＯＳイ
ンバータのＨレベルは、すべて共通の＋５Ｖ電源に接続
されている。
（ノーマリー・オン）５１とＮＭＯＳトランジスタ（ノ
ーマリー・オフ）５２とでそれぞれ構成された４個のＣ
ＭＯＳインバータ５０を備えている。これらＣＭＯＳイ
ンバータのＨレベルは、すべて共通の＋５Ｖ電源に接続
されている。
【０００７】図中、４１はφ１ドライバの入力、４２は
φ２ドライバの入力、４３はφS ドライバの入力、４５
はφI ドライバの入力をそれぞれ示している。また、３
５は書込み電流制限用の外付けの抵抗である。
φ２ドライバの入力、４３はφS ドライバの入力、４５
はφI ドライバの入力をそれぞれ示している。また、３
５は書込み電流制限用の外付けの抵抗である。
【０００８】図１に示した、２相駆動ダイオード結合の
自己走査型発光素子アレイの動作電圧は、最低２ＶD
（ＶD は自己走査型発光素子アレイ内ｐｎ接合の順方向
電圧）以上必要である。ｐｎｐｎ構造の材料がＧａＡｓ
の場合、ＶD はおよそ１．５Ｖであるので、最小動作電
圧は３Ｖということになる。実際には、寄生抵抗の影響
や、ノイズに対して不安定にならないように、５Ｖ程度
の単一電源で動作させている。
自己走査型発光素子アレイの動作電圧は、最低２ＶD
（ＶD は自己走査型発光素子アレイ内ｐｎ接合の順方向
電圧）以上必要である。ｐｎｐｎ構造の材料がＧａＡｓ
の場合、ＶD はおよそ１．５Ｖであるので、最小動作電
圧は３Ｖということになる。実際には、寄生抵抗の影響
や、ノイズに対して不安定にならないように、５Ｖ程度
の単一電源で動作させている。
【０００９】
【発明が解決しようとする課題】図１に示した従来の自
己走査型発光素子アレイでは、電源電圧５Ｖで使用する
と、発光部のオン時の電圧はおよそｐｎ接合の順方向電
圧ＶD （１．５Ｖ）であるので、外付けの抵抗３５で５
−１．５＝３．５Ｖの電圧降下を起こさせていることに
なる。いま、発光部に流れる電流が１０ｍＡ（時間平均
値）であったときに、抵抗３５で消費される電力は３５
ｍＷとなる。一方、発光部での消費電力は、１５ｍＷと
なる。さて、自己走査型発光素子アレイを複数個並べて
光書込みヘッドを作ったとき、例えば、６０個のチップ
をならべてヘッドを作ったとき、各チップ上で１個ずつ
の発光点が点灯しているときの消費電力は、５０ｍＷ×
６０個＝３Ｗとなる。この電力消費による発熱で、自己
走査型発光素子アレイチップの温度が上昇し、発光効率
が低下してしまうという問題点があった。併せて、光書
込みヘッドの置かれている場所は、狭く、排熱の悪い環
境であるため、機内の温度が上がりやすく、電子写真方
式の現像条件などに影響する。
己走査型発光素子アレイでは、電源電圧５Ｖで使用する
と、発光部のオン時の電圧はおよそｐｎ接合の順方向電
圧ＶD （１．５Ｖ）であるので、外付けの抵抗３５で５
−１．５＝３．５Ｖの電圧降下を起こさせていることに
なる。いま、発光部に流れる電流が１０ｍＡ（時間平均
値）であったときに、抵抗３５で消費される電力は３５
ｍＷとなる。一方、発光部での消費電力は、１５ｍＷと
なる。さて、自己走査型発光素子アレイを複数個並べて
光書込みヘッドを作ったとき、例えば、６０個のチップ
をならべてヘッドを作ったとき、各チップ上で１個ずつ
の発光点が点灯しているときの消費電力は、５０ｍＷ×
６０個＝３Ｗとなる。この電力消費による発熱で、自己
走査型発光素子アレイチップの温度が上昇し、発光効率
が低下してしまうという問題点があった。併せて、光書
込みヘッドの置かれている場所は、狭く、排熱の悪い環
境であるため、機内の温度が上がりやすく、電子写真方
式の現像条件などに影響する。
【００１０】本発明の目的は、書込み電流制限用の外付
け抵抗による電力損失を減らし、光書込みヘッドの昇温
を小さくできる自己走査型発光素子アレイを提供するこ
とにある。
け抵抗による電力損失を減らし、光書込みヘッドの昇温
を小さくできる自己走査型発光素子アレイを提供するこ
とにある。
【００１１】
【課題を解決するための手段】自己走査型発光素子アレ
イのシフト部を安定して動作させるためには、最低電圧
の２ＶD に比べて十分なマージンを取らなければならな
い。しかし、発光部は、シフト部がオンした状態でオン
するように使われるため、最低電圧のＶD ＋α程度の電
圧で安定に点灯できる。
イのシフト部を安定して動作させるためには、最低電圧
の２ＶD に比べて十分なマージンを取らなければならな
い。しかし、発光部は、シフト部がオンした状態でオン
するように使われるため、最低電圧のＶD ＋α程度の電
圧で安定に点灯できる。
【００１２】そこで、ドライバ回路内の、シフト部をコ
ントロールする回路のＨ−Ｌレベル差よりも、発光部を
コントロールする回路のＨ−Ｌレベル差を低く設定する
ことにより、書込み電流制限用の外付け抵抗の損失を減
らし、ヘッドの温度上昇を抑えることができる。
ントロールする回路のＨ−Ｌレベル差よりも、発光部を
コントロールする回路のＨ−Ｌレベル差を低く設定する
ことにより、書込み電流制限用の外付け抵抗の損失を減
らし、ヘッドの温度上昇を抑えることができる。
【００１３】本発明の第１の態様は、しきい電圧もしく
はしきい電流が外部から制御可能な制御電極を有する３
端子スイッチ素子多数個を配列した３端子スイッチ素子
アレイの各スイッチ素子の制御電極を互いに第１の電気
的手段にて接続すると共に、各スイッチ素子の制御電極
に電源ラインを第２の電気的手段を用いて接続し、かつ
各スイッチ素子の残りの２端子の一方にクロックライン
を接続して形成したスイッチ素子アレイと、しきい電圧
もしくはしきい電流が外部から制御可能な制御電極を有
する３端子発光素子多数個を配列した発光素子アレイと
からなり、前記発光素子アレイの制御電極と前記スイッ
チ素子の制御電極とを接続し、各発光素子の残りの２端
子の一方に発光のための電流を印加する書込み信号ライ
ンを設けた自己走査型発光素子アレイの駆動方法におい
て、前記書込み信号ラインに外付け抵抗を介して与えら
れる発光用パルス電圧のＬ−Ｈレベル差を、前記クロッ
クラインに与えられるシフト用パルス電圧のＬ−Ｈレベ
ル差よりも小さくすることにより、前記外付け抵抗の電
力損失を減らすようにしたことを特徴とする。
はしきい電流が外部から制御可能な制御電極を有する３
端子スイッチ素子多数個を配列した３端子スイッチ素子
アレイの各スイッチ素子の制御電極を互いに第１の電気
的手段にて接続すると共に、各スイッチ素子の制御電極
に電源ラインを第２の電気的手段を用いて接続し、かつ
各スイッチ素子の残りの２端子の一方にクロックライン
を接続して形成したスイッチ素子アレイと、しきい電圧
もしくはしきい電流が外部から制御可能な制御電極を有
する３端子発光素子多数個を配列した発光素子アレイと
からなり、前記発光素子アレイの制御電極と前記スイッ
チ素子の制御電極とを接続し、各発光素子の残りの２端
子の一方に発光のための電流を印加する書込み信号ライ
ンを設けた自己走査型発光素子アレイの駆動方法におい
て、前記書込み信号ラインに外付け抵抗を介して与えら
れる発光用パルス電圧のＬ−Ｈレベル差を、前記クロッ
クラインに与えられるシフト用パルス電圧のＬ−Ｈレベ
ル差よりも小さくすることにより、前記外付け抵抗の電
力損失を減らすようにしたことを特徴とする。
【００１４】本発明の第２の態様は、しきい電圧もしく
はしきい電流が外部から制御可能な制御電極を有する３
端子発光素子多数個を配列した３端子発光素子アレイの
各発光素子の制御電極を互いに第１の電気的手段にて接
続すると共に、各発光素子の制御電極に電源ラインを第
２の電気的手段を用いて接続し、かつ各発光素子の残り
の２端子の一方にクロックラインを接続して形成した発
光素子アレイよりなる自己走査型発光素子アレイの駆動
方法において、前記クロックラインに外付け抵抗を介し
て与えられる発光用パルス電圧のＬ−Ｈレベル差を、前
記クロックラインに与えられるシフト用パルス電圧のＬ
−Ｈレベル差よりも小さくすることにより、前記外付け
抵抗の電力損失を減らすようにしたことを特徴とする。
はしきい電流が外部から制御可能な制御電極を有する３
端子発光素子多数個を配列した３端子発光素子アレイの
各発光素子の制御電極を互いに第１の電気的手段にて接
続すると共に、各発光素子の制御電極に電源ラインを第
２の電気的手段を用いて接続し、かつ各発光素子の残り
の２端子の一方にクロックラインを接続して形成した発
光素子アレイよりなる自己走査型発光素子アレイの駆動
方法において、前記クロックラインに外付け抵抗を介し
て与えられる発光用パルス電圧のＬ−Ｈレベル差を、前
記クロックラインに与えられるシフト用パルス電圧のＬ
−Ｈレベル差よりも小さくすることにより、前記外付け
抵抗の電力損失を減らすようにしたことを特徴とする。
【００１５】
【発明の実施の形態】以下、本発明の実施の形態を実施
例に基づいて説明する。
例に基づいて説明する。
【００１６】
【実施例１】図２は、本発明の実施例１の自己走査型発
光素子アレイの等価回路図である。発光部のφI 端子２
５に外付け抵抗３５を介して接続されるＣＭＯＳインバ
ータ５０のＨレベルは、＋５Ｖの電源とは独立の＋２Ｖ
電源に接続される。その他の構造は、図１と同じである
ので、同一の構成要素には同一の参照番号を付して示
す。
光素子アレイの等価回路図である。発光部のφI 端子２
５に外付け抵抗３５を介して接続されるＣＭＯＳインバ
ータ５０のＨレベルは、＋５Ｖの電源とは独立の＋２Ｖ
電源に接続される。その他の構造は、図１と同じである
ので、同一の構成要素には同一の参照番号を付して示
す。
【００１７】＋２Ｖの電源を使うと、抵抗３５の電圧降
下は０．５Ｖ程度となり、抵抗３５での電力損失は、電
力１０ｍＡで３５ｍＷから５ｍＷに、すなわち１／７に
減った。したがって、ヘッドの消費電力は、抵抗での消
費電力と発光部での消費電力との合計は５ｍＷ＋１５ｍ
Ｗ＝２０ｍＷとなり、ヘッドの消費電力をおおよそ２／
５に減らすことができる。２つの電源を用意するため
に、例えば、３端子レギュレータを使うと、レギュレー
タの損失により発熱するが、電源回路は放熱の良いとこ
ろに置けば少々の発熱は処理できる。
下は０．５Ｖ程度となり、抵抗３５での電力損失は、電
力１０ｍＡで３５ｍＷから５ｍＷに、すなわち１／７に
減った。したがって、ヘッドの消費電力は、抵抗での消
費電力と発光部での消費電力との合計は５ｍＷ＋１５ｍ
Ｗ＝２０ｍＷとなり、ヘッドの消費電力をおおよそ２／
５に減らすことができる。２つの電源を用意するため
に、例えば、３端子レギュレータを使うと、レギュレー
タの損失により発熱するが、電源回路は放熱の良いとこ
ろに置けば少々の発熱は処理できる。
【００１８】
【実施例２】実施例１では、抵抗３５によって抵抗の両
端の電位差を電流に変換することによって、発光素子に
流れる電流値を決めていた。本実施例では、定電流回路
で電流値を決める回路について考える。回路例を図３に
示す。
端の電位差を電流に変換することによって、発光素子に
流れる電流値を決めていた。本実施例では、定電流回路
で電流値を決める回路について考える。回路例を図３に
示す。
【００１９】ここでは、ｐｎｐトランジスタ７０を使っ
た定電流回路を示す。このトランジスタのゲートは抵抗
７１に接続され、エミッタは＋２Ｖ電源に接続され、コ
レクタはφI 端子２５に接続される。
た定電流回路を示す。このトランジスタのゲートは抵抗
７１に接続され、エミッタは＋２Ｖ電源に接続され、コ
レクタはφI 端子２５に接続される。
【００２０】トランジスタ７０のエミッタの電圧ＶE ＝
＋２Ｖとして、抵抗７１の抵抗値をＲB 、トランジスタ
７０のベース・エミッタ間の立ち上がり電圧をＶBEとす
ると、トランジスタ７０のベース電流は、（ＶE −
ＶBE）／ＲB となる。これは、Ｉ E をエミッタ電流とす
れば、（１−α）ＩE に等しい。ここで、αは電流増幅
率であり、通常０．９５〜０．９９程度である。一方、
コレクタ電流ＩC は、ＩC＝αＩE であり、これが発光
に寄与する。例えば、α＝０．９５に選ぶと、ＲB＝２
０ｋΩで、ＩC ＝（α／（１−α））・（ＶE −ＶBE）
／ＲB ＝１９×（２−０．６）／２×１０4 ≒１３ｍＡ
のコレクタ電流が流れる。
＋２Ｖとして、抵抗７１の抵抗値をＲB 、トランジスタ
７０のベース・エミッタ間の立ち上がり電圧をＶBEとす
ると、トランジスタ７０のベース電流は、（ＶE −
ＶBE）／ＲB となる。これは、Ｉ E をエミッタ電流とす
れば、（１−α）ＩE に等しい。ここで、αは電流増幅
率であり、通常０．９５〜０．９９程度である。一方、
コレクタ電流ＩC は、ＩC＝αＩE であり、これが発光
に寄与する。例えば、α＝０．９５に選ぶと、ＲB＝２
０ｋΩで、ＩC ＝（α／（１−α））・（ＶE −ＶBE）
／ＲB ＝１９×（２−０．６）／２×１０4 ≒１３ｍＡ
のコレクタ電流が流れる。
【００２１】トランジスタのエミッタ・コレクタ間の電
位差×コレクタ電流（≒エミッタ電流）がトランジスタ
によって消費されるため、エミッタ電圧を小さくした方
がトランジスタの消費電力を下げることができる。
位差×コレクタ電流（≒エミッタ電流）がトランジスタ
によって消費されるため、エミッタ電圧を小さくした方
がトランジスタの消費電力を下げることができる。
【００２２】本実施例では、簡単な例としてトランジス
タを用いたが、どのような定電流回路を用いても、「電
源電圧と端子２５との間の電位差」×「電流」なる電力
を消費する点では同じであり、同様の効果が期待でき
る。
タを用いたが、どのような定電流回路を用いても、「電
源電圧と端子２５との間の電位差」×「電流」なる電力
を消費する点では同じであり、同様の効果が期待でき
る。
【００２３】
【実施例３】実施例１および２では、シフト部と発光部
が分かれた構成となっているが、シフト部と発光部が分
かれていない構成での例を図４に示す。図４は、シフト
部と発光部とが分離されないタイプの２相駆動ダイオー
ド結合の自己走査型発光素子アレイと、そのドライバ回
路とを示している。図中、６０は自己走査型発光素子ア
レイチップであり、発光素子Ｌ1 ，Ｌ2 ，Ｌ3 …とダイ
オードＤと負荷抵抗Ｒ 1 ，Ｒ2 ，Ｒ3 …で構成されてい
る。チップ６０内には、φS 端子２３に接続される抵抗
３３のみが内蔵されている。
が分かれた構成となっているが、シフト部と発光部が分
かれていない構成での例を図４に示す。図４は、シフト
部と発光部とが分離されないタイプの２相駆動ダイオー
ド結合の自己走査型発光素子アレイと、そのドライバ回
路とを示している。図中、６０は自己走査型発光素子ア
レイチップであり、発光素子Ｌ1 ，Ｌ2 ，Ｌ3 …とダイ
オードＤと負荷抵抗Ｒ 1 ，Ｒ2 ，Ｒ3 …で構成されてい
る。チップ６０内には、φS 端子２３に接続される抵抗
３３のみが内蔵されている。
【００２４】ドライバ回路は、φ１端子２１，φ２端子
２２へ２相クロック（シフト用パルス電圧）を、φS 端
子２３へスタート用パルス電圧を、与えるためのＣＭＯ
Ｓインバータをそれぞれ備えている。この場合、図２の
電流制限用抵抗３１，３２（チップ内蔵）に相当する抵
抗３８，３９が、ドライバ回路（ドライバＩＣ）内に内
蔵されている。
２２へ２相クロック（シフト用パルス電圧）を、φS 端
子２３へスタート用パルス電圧を、与えるためのＣＭＯ
Ｓインバータをそれぞれ備えている。この場合、図２の
電流制限用抵抗３１，３２（チップ内蔵）に相当する抵
抗３８，３９が、ドライバ回路（ドライバＩＣ）内に内
蔵されている。
【００２５】さらに、このドライバ回路は、発光用パル
ス電圧（書込み信号）を、φ１端子２１およびφ２端子
２２に与えるために、ＰＭＯＳトランジスタ５３，５４
と、電流制限用抵抗３６，３７との直列回路が設けられ
ている。そして、これらＰＭＯＳトランジスタ５３，５
４のＨレベルは＋２Ｖ電源に接続されている。抵抗３
６，３７は、ドライバ回路に内蔵されており、これら抵
抗は、図２の外付け抵抗３５に相当している。図中、４
６，４７は、それぞれ書込み信号ドライバの入力であ
る。
ス電圧（書込み信号）を、φ１端子２１およびφ２端子
２２に与えるために、ＰＭＯＳトランジスタ５３，５４
と、電流制限用抵抗３６，３７との直列回路が設けられ
ている。そして、これらＰＭＯＳトランジスタ５３，５
４のＨレベルは＋２Ｖ電源に接続されている。抵抗３
６，３７は、ドライバ回路に内蔵されており、これら抵
抗は、図２の外付け抵抗３５に相当している。図中、４
６，４７は、それぞれ書込み信号ドライバの入力であ
る。
【００２６】本実施例によれば、２相クロックφ１，φ
２により発光素子がオンしているときに、対応するＰＭ
ＯＳトランジスタ５３または５４がオンして、抵抗３６
または３７を介して、書込み信号を供給するが、＋２Ｖ
の電源を用いているので、実施例１と同様に抵抗３６，
３７での電力損失を軽減し、したがって発熱を抑えるこ
とができる。
２により発光素子がオンしているときに、対応するＰＭ
ＯＳトランジスタ５３または５４がオンして、抵抗３６
または３７を介して、書込み信号を供給するが、＋２Ｖ
の電源を用いているので、実施例１と同様に抵抗３６，
３７での電力損失を軽減し、したがって発熱を抑えるこ
とができる。
【００２７】なお、以上の３つの実施例では、スイッチ
素子および発光素子は、カソードコモンの例について説
明したが、電圧の極性を変えることにより、アノードコ
モンの自己走査型発光素子アレイにも適用できることは
明らかである。
素子および発光素子は、カソードコモンの例について説
明したが、電圧の極性を変えることにより、アノードコ
モンの自己走査型発光素子アレイにも適用できることは
明らかである。
【００２８】さらに本発明では、熱的問題を解決する手
段として、２つの電源電圧を用いているが、ドライバＩ
Ｃにとっても、電源電圧が低下することは、高速化，低
消費電力化などのメリットが生まれる。この目的のため
に、自己走査型発光素子アレイの発光部の電源電圧を下
げて使う場合は、３端子レギュレータをヘッドの内部に
設けても良い。
段として、２つの電源電圧を用いているが、ドライバＩ
Ｃにとっても、電源電圧が低下することは、高速化，低
消費電力化などのメリットが生まれる。この目的のため
に、自己走査型発光素子アレイの発光部の電源電圧を下
げて使う場合は、３端子レギュレータをヘッドの内部に
設けても良い。
【００２９】
【発明の効果】以上説明したように、本発明によれば、
自己走査型発光素子アレイにおいて、書込み信号用の外
付け抵抗による電力損失を減らし、光書込みヘッドの昇
温を小さくできる。
自己走査型発光素子アレイにおいて、書込み信号用の外
付け抵抗による電力損失を減らし、光書込みヘッドの昇
温を小さくできる。
【図１】シフト部と発光部とが分離されたタイプの２相
駆動ダイオード結合の自己走査型発光素子アレイと、そ
の駆動回路とを示す図である。
駆動ダイオード結合の自己走査型発光素子アレイと、そ
の駆動回路とを示す図である。
【図２】本発明の実施例１の自己走査型発光素子アレイ
の等価回路図である。
の等価回路図である。
【図３】本発明の実施例２の自己走査型発光素子アレイ
の等価回路図である。
の等価回路図である。
【図４】本発明の実施例３の自己走査型発光素子アレイ
の等価回路図である。
の等価回路図である。
１０，６０ 自己走査型発光素子アレイチップ １１ シフト部φ１ライン １２ シフト部φ２ライン １５ 発光部φI ライン ２１ φ１端子 ２２ φ２端子 ２３ φS 端子 ２４ ＶGK端子 ２５ φI 端子 ３１，３２，３３ 抵抗（チップに内蔵） ３５，３６，３７ 抵抗（外付け） ３８，３９ 抵抗器（ドライバＩＣに内蔵） ４１ φ１ドライバの入力 ４２ φ２ドライバの入力 ４３ φS ドライバの入力 ４５ φI ドライバの入力 ５０ ＣＭＯＳインバータ ５１ ＰＭＯＳトランジスタ（ノーマリー・オン） ５２ ＮＭＯＳトランジスタ（ノーマリー・オフ） ７０ トランジスタ
Claims (2)
- 【請求項１】しきい電圧もしくはしきい電流が外部から
制御可能な制御電極を有する３端子スイッチ素子多数個
を配列した３端子スイッチ素子アレイの各スイッチ素子
の制御電極を互いに第１の電気的手段にて接続すると共
に、各スイッチ素子の制御電極に電源ラインを第２の電
気的手段を用いて接続し、かつ各スイッチ素子の残りの
２端子の一方にクロックラインを接続して形成したスイ
ッチ素子アレイと、 しきい電圧もしくはしきい電流が外部から制御可能な制
御電極を有する３端子発光素子多数個を配列した発光素
子アレイとからなり、 前記発光素子アレイの制御電極と前記スイッチ素子の制
御電極とを接続し、各発光素子の残りの２端子の一方に
発光のための電流を印加する書込み信号ラインを設けた
自己走査型発光素子アレイの駆動方法において、 前記書込み信号ラインに外付け抵抗を介して与えられる
発光用パルス電圧のＬ−Ｈレベル差を、前記クロックラ
インに与えられるシフト用パルス電圧のＬ−Ｈレベル差
よりも小さくすることにより、前記外付け抵抗の電力損
失を減らすようにしたことを特徴とする自己走査型発光
素子アレイの駆動方法。 - 【請求項２】しきい電圧もしくはしきい電流が外部から
制御可能な制御電極を有する３端子発光素子多数個を配
列した３端子発光素子アレイの各発光素子の制御電極を
互いに第１の電気的手段にて接続すると共に、各発光素
子の制御電極に電源ラインを第２の電気的手段を用いて
接続し、かつ各発光素子の残りの２端子の一方にクロッ
クラインを接続して形成した発光素子アレイよりなる自
己走査型発光素子アレイの駆動方法において、 前記クロックラインに外付け抵抗を介して与えられる発
光用パルス電圧のＬ−Ｈレベル差を、前記クロックライ
ンに与えられるシフト用パルス電圧のＬ−Ｈレベル差よ
りも小さくすることにより、前記外付け抵抗の電力損失
を減らすようにしたことを特徴とする自己走査型発光素
子アレイの駆動方法。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000104431A JP4438174B2 (ja) | 2000-04-06 | 2000-04-06 | 自己走査型発光素子アレイの駆動方法 |
| CA002372341A CA2372341A1 (en) | 2000-04-06 | 2001-04-06 | Method for driving self-scanning light-emitting device array |
| US09/980,324 US6703790B2 (en) | 2000-04-06 | 2001-04-06 | Method for driving a self-scanning light-emitting array |
| CNB018003672A CN1166517C (zh) | 2000-04-06 | 2001-04-06 | 自扫描型发光元件阵列的驱动方法 |
| TW090108263A TW506116B (en) | 2000-04-06 | 2001-04-06 | Method of driving self-scanning type light emitting device array |
| PCT/JP2001/002983 WO2001076883A1 (fr) | 2000-04-06 | 2001-04-06 | Procede pour actionner un reseau de dispositifs d'autobalayage emettant de la lumiere |
| KR1020017015397A KR100760173B1 (ko) | 2000-04-06 | 2001-04-06 | 자기 주사형 발광 소자 어레이의 구동 방법 |
| EP01921794A EP1201443A1 (en) | 2000-04-06 | 2001-04-06 | Method for driving self-scanning light-emitting device array |
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| Application Number | Priority Date | Filing Date | Title |
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| JP2000104431A JP4438174B2 (ja) | 2000-04-06 | 2000-04-06 | 自己走査型発光素子アレイの駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2001287393A true JP2001287393A (ja) | 2001-10-16 |
| JP4438174B2 JP4438174B2 (ja) | 2010-03-24 |
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| Country | Link |
|---|---|
| JP (1) | JP4438174B2 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP2347909A1 (en) | 2010-01-22 | 2011-07-27 | Oki Data Corporation | Driver circuit, driver apparatus, and image forming apparatus |
| US8836743B2 (en) | 2010-03-24 | 2014-09-16 | Oki Data Corporation | Drive device, print head and image forming apparatus |
| US8848012B2 (en) | 2010-03-23 | 2014-09-30 | Oki Data Corporation | Drive device, print head and image forming apparatus |
Citations (5)
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| JPH02263668A (ja) * | 1988-11-10 | 1990-10-26 | Nippon Sheet Glass Co Ltd | 発光装置およびその駆動方法 |
| JPH08153890A (ja) * | 1994-09-28 | 1996-06-11 | Nippon Sheet Glass Co Ltd | 発光サイリスタおよび自己走査型発光装置 |
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| JPH10235936A (ja) * | 1997-02-28 | 1998-09-08 | Canon Inc | 電子写真式画像形成装置 |
| JPH11170596A (ja) * | 1997-12-10 | 1999-06-29 | Canon Inc | Ｌｅｄアレー駆動装置 |
-
2000
- 2000-04-06 JP JP2000104431A patent/JP4438174B2/ja not_active Expired - Fee Related
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| EP2347909A1 (en) | 2010-01-22 | 2011-07-27 | Oki Data Corporation | Driver circuit, driver apparatus, and image forming apparatus |
| US8742824B2 (en) | 2010-01-22 | 2014-06-03 | Oki Data Corporation | Driver circuit for driving a row of switch elements such as light emitting thyristors, drive apparatus incorporating the driver circuit, and image forming apparatus |
| US8848012B2 (en) | 2010-03-23 | 2014-09-30 | Oki Data Corporation | Drive device, print head and image forming apparatus |
| US8836743B2 (en) | 2010-03-24 | 2014-09-16 | Oki Data Corporation | Drive device, print head and image forming apparatus |
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| JP4438174B2 (ja) | 2010-03-24 |
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