JP2000284745A - プラズマディスプレイパネルの駆動方法及び駆動回路 - Google Patents
プラズマディスプレイパネルの駆動方法及び駆動回路Info
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Abstract
つ、予備放電期間による時間損失を低減したプラズマデ
ィスプレイパネルの駆動方法及びその駆動回路を提供す
る。 【解決手段】 走査維持混合型のプラズマディスプレイ
パネルの駆動方法であって、主に走査書き込みを行う第
1のパルス印加期間で、順次選択走査される走査ライン
の走査電極にそれぞれ走査パルスを印加すると共に、所
定のデータ電極にデータパルスを印加することにより選
択的に表示セルに書き込み放電を起こさせ、同時に、次
に走査される走査ラインにおいては、その走査電極に走
査パルスと逆極性でかつ緩やかに立ち上がる第1の予備
放電パルスを印加し、その維持電極に走査パルスと同極
性でかつそれよりも低電圧の矩形状または緩やかに立ち
上がる第2の予備放電パルスを印加する。
Description
イパネルの駆動方法に関し、特に交流放電型のプラズマ
ディスプレイパネルの駆動方法に関する。
(以下、PDPと称する)は、薄型構造でちらつきがな
く、表示コントラスト比が大きいこと、また、比較的大
画面にすることが可能であり、応答速度が速く、自発光
型で蛍光体の利用により多色発光も可能であること等、
数多くの特徴を有している。このため、近年コンピュー
タ関連の表示装置やカラー画像表示の分野で広く利用さ
れるようになりつつある。
誘電体で被覆されて間接的に交流放電の状態で動作させ
る交流放電型と、電極が放電空間に露出して直流放電の
状態で動作させる直流放電型とがある。
表示セルのメモリ作用を利用するメモリ動作型と、メモ
リ作用を利用しないリフレッシュ動作型とがある。
間(例えば、1フレーム)内における印加パルスの繰り
返し数に比例し、上記リフレッシュ動作型は、表示容量
が大きくなると輝度が低下するため、小表示容量のPD
Pで主に使用される。
スプレイパネルの一構成例を示す表示セルの斜視断面図
である。
PDPの表示セルは、パネルの背面及び前面にそれぞれ
設けられた、ガラスからなる第1の絶縁基板1及び第2
の絶縁基板2と、第2の絶縁基板2上に所定の間隔を有
して形成された透明な走査電極3及び維持電極4と、走
査電極3及び維持電極4の電極抵抗値を小さくするため
に走査電極3及び維持電極4上にそれぞれ重なるように
積層された第1のトレース電極5及び第2のトレース電
極6と、走査電極3、維持電極4、第1のトレース電極
5、及び第2のトレース電極6をそれぞれ覆うように形
成された第1の誘電体12と、第1の誘電体12上に積
層され、第1の誘電体12を放電から保護する酸化マグ
ネシウム等からなる保護層13と、第1の絶縁基板1上
に配置され、走査電極3及び維持電極4と直交する方向
に形成されたデータ電極7と、データ電極7を覆うよう
に形成された第2の誘電体14と、第1の絶縁基板1と
第2の絶縁基板2の間に形成され、ヘリウム、ネオン、
キセノン等の希ガス類、またはそれらの混合ガスからな
る放電ガスが充填される放電ガス空間8と、第2の誘電
体14上に設けられ、放電ガス空間8を形成すると共に
表示セルを区切るための隔壁9と、第2の誘電体14上
及び隔壁9の側面に塗布され、放電ガス空間8中で起こ
す放電によって発生する紫外線を可視光10に変換する
蛍光体11とによって構成されている。
示パネルでは、縦方向に480個、横方向に1920個
の上記のような表示セルが格子状に配置され、走査電極
3及び維持電極4はそれぞれ480本、データ電極7は
1920本で構成される。
ける放電動作について説明する。
3とデータ電極7との間に放電しきい値を越えるパルス
電圧が印加されると、放電が開始され、このパルス電圧
の極性に対応して正負の電荷(壁電荷)が第1の誘電体
12及び第2の誘電体14の表面にそれぞれ吸引され、
堆積する。この電荷の堆積に起因して発生する等価的な
内部電圧、すなわち壁電圧は印加されたパルス電圧とは
逆極性となるため、放電の成長とともにセル内部の実効
電圧が低下し、上記パルス電圧を一定値に保持していて
も放電を維持することができずに、ついには放電が停止
してしまう。
に、壁電圧と同じ極性のパルス電圧である維持パルスを
印加すると、壁電圧が実効電圧として重畳され、それに
より外部から印加する維持パルスの電圧振幅が小さくて
も放電しきい値を越えて放電を起こすことができる。し
たがって、走査電極3と維持電極4との間に維持パルス
を印加し続けることで放電が維持される。
圧を中和するような幅の広い低電圧のパルスまたは幅の
狭い維持パルス電圧程度のパルスである維持消去パルス
を印加することにより、上述した維持放電を停止させる
ことができる。
クス状に配置して形成したプラズマディスプレイパネル
の概略の構成を示す平面図である。
の行、列に表示セル20が配列されたドットマトリクス
表示可能のディスプレイパネルであり、行電極として、
互いに平行に配列された走査電極Sc1、Sc2、…、
Scm、及び維持電極Su1、Su2、…、Sumを備
え、列電極として、これら走査電極及び維持電極と直交
するように配列されたデータ電極D1、D2、…、Dn
を備えている。
極Sc1、Sc2、…、Scmに走査パルスを順次印加
すると共に、走査パルスに同期して表示を行うべき表示
セルのデータ電極Di(1≦i≦n)にデータパルスを
選択的に印加し、所望の表示セル20に放電しきい値を
越える電圧を印加する(以下、「表示データを書き込
む」とも称する)ことで発光させる。また、その後は走
査電極Sc1、Sc2、…、Scmと維持電極Su1、
Su2、…、Sum間に放電を維持するための維持パル
スを印加することで発光を持続させる。
レイパネルを駆動するための駆動回路の構成を示すブロ
ック図である。
査電極Sc1、Sc2、…、Scmにそれぞれパルス電
圧を印加するための走査電極駆動回路21と、維持電極
Su1、Su2、…、Sumにそれぞれパルス電圧を印
加するための維持電極駆動回路22と、データ電極D
1、D2、…、Dnにそれぞれ映像信号に応じた電圧を
印加するためのデータ電極駆動回路23と、基本信号
(垂直同期信号Vsync、水平同期信号Hsync、
表示データ信号DATA、及びクロックClock)に
基づいて、各電極の駆動回路に対する制御信号をそれぞ
れ出力する制御回路24とによって構成されている。
期を規定する信号であり、水平同期信号HsyncはC
RTの制御信号である水平同期信号と同様に水平方向の
同期を取るための信号である。また、表示データ信号D
ATAは映像信号に応じて各表示セル20を発光、非発
光のいずれか一方に規定する信号であり、クロックCl
ockは表示データ信号DATAを制御回路24に採り
込むための表示データ信号DATAに同期した信号であ
る。
を一時的に格納するフレームメモリ25と、PDPの書
き込みタイミングに合わせて表示データ信号DATAを
フレームメモリ25から読み出し、データ電極駆動回路
23に転送するメモリ制御部26と、PDPの駆動シー
ケンスに対応した駆動波形を生成し、走査電極駆動回路
21及び維持電極駆動回路22にそれぞれ転送するドラ
イバ制御部28と、メモリ制御部26及びドライバ制御
部28の動作を整合し、各電極の駆動回路の動作タイミ
ングを同期させる信号処理部27とによって構成されて
いる。
の駆動方法について図19を用いて説明する。
1フレーム(あるいは、後述する1つのサブフィール
ド)分の表示データを各走査ライン毎に順次書き込んだ
後、各表示セルに対して同時に維持パルスの印加を開始
する走査維持分離駆動方式と、各表示セルに対して常に
維持パルスを印加しつつ、走査ライン毎に順次表示デー
タを書き込んで行く走査維持混合駆動方式とがある。以
下では、走査維持混合駆動方式を例にして従来のPDP
の駆動方法について説明する。
ルの駆動方法を示す図であり、各電極に印加するパルス
波形の様子を示す波形図である。なお、図19に示した
PDPの駆動波形は特開平5−241528号公報に記
載されている。
Sc1、Sc2、Sc3に印加するパルス波形であり、
Wuは維持電極Su1、Su2、…、Sumに共通に印
加するパルス波形である。また、Wdはデータ電極D
1、D2、…、Dnに印加するパルス波形であり、Id
1は発光波形である。
駆動方式では、維持電極Su1、Su2、…、Sumに
負極性の維持パルスがそれぞれ共通に印加される。
mには、維持電極と共通の負極性の維持パルスがそれぞ
れ印加されると共に、各走査電極毎に順次走査パルス
(SP)及び維持消去パルス(EP)が印加される。ま
た、データ電極D1、D2、…、Dnには、表示データ
に応じて正のデータパルスが印加される。
の交点のセルを発光させるためには、走査電極Sc1に
印加する走査パルスに同期してデータ電極D1に正のデ
ータパルスを印加する。このようにすることで走査電極
Sc1とデータ電極D1の交点の表示セルで放電が発生
し、波形(f)で示すように発光が生じる。この放電発
光は走査電極Sc1と維持電極Su1にそれぞれ維持パ
ルスを印加し続けることで維持され、走査電極Sc1に
幅の狭い低電圧の維持消去パルスを印加することで放電
発光を停止する。
スと異なり印加電圧を変更することにより階調表示を行
うことが困難であるため、一般的に発光回数を制御する
ことで階調表示を行う。特に、高輝度の階調表示を行う
ためには、以下に記載するサブフィールド法が用いられ
る。
ルの駆動方法を示す図であり、階調表示を行うためのサ
ブフィールド法を説明するタイムチャートである。な
お、図20は、26=64階調の表示を行う場合の例を
示している。
は、1フレームを複数個(図20では6個)のサブフィ
ールド(SF1〜SF6)と予備放電期間に分割し、そ
れぞれのサブフィールドに図20に示すように発光時間
に重みづけを付与している。なお、図20では、各サブ
フィールドの発光時間の重みづけは、SF1から順に、
25、24、23、22、21、20である。
光/非発光を選択することにより行う。
き込む前に各表示セルで一度放電及び消去(放電停止)
を行い、表示セルを活性状態にして走査パルス及びデー
タパルスによる書き込み放電を発生しやすくしている。
プラズマディスプレイパネルの駆動方法では、予備放電
期間中は他の駆動シーケンスを休止しなければならない
ため、時間利用率が低いという問題がある。特に、予備
放電から離れたサブフィールドで書き込み放電を安定し
て発生させるために1フレーム内で複数回の予備放電を
行う場合、サブフィールドに用いることのできる時間が
減少するため、維持パルス、走査パルス、及びデータパ
ルスのパルス幅が短くなり、動作が不安定になってしま
う。
1フレーム内に複数回の予備放電を行う場合に、予備放
電期間の直前のサブフィールドを、輝度の重みづけが小
さいサブフィールドにし、さらにサブフィールドの順序
を変更することで(重みづけの順序を変える)、予備放
電期間による時間損失を最小限にする手法が記載されて
いる。
に低減する手法として、特許第2702725号公報
に、任意の走査ラインで書き込み放電を行いつつ、他の
走査ラインで予備放電を同時に行う技術が記載されてい
る。
技術では、図21に示すように走査電極Sc1、Sc
2、…、Scmだけでなく、維持電極Su1、Su2、
…、Sumに対しても各走査ライン毎に異なるパルス電
圧を印加し、各表示セルに対して、予備放電パルス、予
備放電消去パルス、走査パルス、維持パルス、維持消去
パルスの順にそれぞれパルス電圧を印加すると共に、走
査ライン毎に走査パルスの印加タイミングを順次ずら
し、対応するデータパルスをデータ電極にそれぞれ印加
している。
報に記載された技術では、予備放電パルスと走査パルス
がそれぞれ負極性で、データパルスが正極性であり、い
ずれのパルスも矩形波であるため、走査パルスが印加さ
れている走査電極とデータパルスが印加されているデー
タ電極の交点の表示セルだけでなく、予備放電パルスが
印加されている維持電極とそれに同期してデータパルス
が印加されているデータ電極の交点の表示セルでも強い
放電が発生する。したがって、予備放電によってPDP
全体の背景輝度が増大し、さらには背景輝度が映像の表
示パターンによって変わってしまう問題が発生する。
の増大を防止するため、予備放電パルスを緩やかに立ち
上げて印加する手法がUSP5745086に記載され
ている。しかしながら、USP5745086に記載さ
れたPDPの駆動方法は、予備放電期間、書き込み放電
期間、及び維持放電期間がそれぞれ完全に分離されてい
る、いわゆる走査維持分離駆動方式に関する発明であ
り、特許第2702725号公報に記載されているよう
な走査維持混合駆動方式に関しては記載されていない。
る問題点を解決するためになされたものであり、予備放
電による背景輝度の増大を抑制しつつ、予備放電期間に
よる時間損失を低減したプラズマディスプレイパネルの
駆動方法及び駆動回路を提供することを目的とする。
本発明のプラズマディスプレイパネルの駆動方法は、格
子状に配置された複数の表示セルからなる交流放電型の
プラズマディスプレイパネルに対して、主に走査書き込
みを行う第1のパルス印加期間と主に1以上の維持発光
を行う第2のパルス印加期間とが巡回配置され、各走査
ライン毎に予備放電、予備放電消去、書き込み放電、維
持放電、及び維持放電消去の順に逐次駆動することによ
り所望の画像を表示させるための走査維持混合型のプラ
ズマディスプレイパネルの駆動方法であって、前記第1
のパルス印加期間で、順次選択走査される前記走査ライ
ンの走査電極にそれぞれ走査パルスを印加すると共に、
所定のデータ電極にデータパルスを印加することにより
選択的に前記表示セルに対する書き込み放電を行い、同
時に、次に走査される走査ラインにおいては、その走査
電極に前記走査パルスと逆極性でかつ緩やかに立ち上が
る第1の予備放電パルスを印加し、その維持電極に前記
走査パルスと同極性でかつそれよりも低電圧で矩形状ま
たは緩やかに立ち上がる第2の予備放電パルスを印加す
る方法である。
消去すべき走査ライン及び直前に予備放電を行った走査
ラインを除く他の走査ラインにおいては、その走査電極
及び維持電極にそれぞれ維持パルスを印加することで、
交互に逆方向の維持放電を行わせると共に、前記第2の
パルス印加期間の1つで、直前に予備放電を行った走査
ラインの走査電極に、他の走査ラインの走査電極に印加
される維持パルスと同極性でかつ緩やかに立ち上がる予
備放電消去パルスまたは維持消去パルスを印加すること
により各々の消去を行う方法であり、前記第2のパルス
印加期間に、維持消去すべき走査ライン及び直前に予備
放電を行った走査ラインを除く他の走査ラインにおいて
は、その走査電極及び維持電極にそれぞれ維持パルスを
印加することで、交互に逆方向の維持放電を行わせると
共に、前記第2のパルス印加期間の1つで、直前に予備
放電を行った走査ラインの維持電極に、走査電極に印加
される維持パルスと同極性でかつ走査電極と維持電極の
間の電位差が緩やかに増加する予備放電消去パルスまた
は維持消去パルスを印加することにより予備放電消去を
行う方法である。
記維持消去パルスを同じ形状で印加してもよい。
に分割し、前記複数のサブフィールドの全てを1フレー
ム分の時間内で表示すると共に、前記サブフィールドの
選択組み合わせによって階調表示をおこなってもよく、
1フレームを複数のサブフィールドに分割し、前記サブ
フィールドをそれぞれ前記1フレーム分の時間で表示す
ると共に、前記サブフィールドの選択組み合わせによっ
て階調表示をおこなってもよく、各サブフィールドにお
ける発光時間にそれぞれ異なった重み付けがなされてい
てもよい。
フィールドの数で分割し、該分割された期間にそれぞれ
各サブフィールドの書き込みタイミングを割り当てても
よい。
ルの駆動回路は、上述した駆動方法を実現する走査電極
駆動回路及び維持電極駆動回路を有する構成であり、そ
れに加えて、前記走査電極に電力を供給するための電源
ラインと前記維持電極に電力を供給するための電源ライ
ン間に接続される、直列に接続された第1のダイオー
ド、第1のスイッチ、及び第1のインダクタ、並びに直
列に接続された第2のダイオード、第2のスイッチ、及
び第2のインダクタと、前記走査電極に電力を供給する
ための電源ラインにスイッチを介して一端が接続され、
前記維持電極に電力を供給するための電源ラインに他端
が接続された第3のインダクタと、を備えた電荷回収回
路を有する構成である。
から戻される電荷を蓄積する第1の電荷蓄積コンデン
サ、前記走査電極に電力を供給するための一方の電源ラ
インに一端が接続され、前記第1の電荷蓄積コンデンサ
に他端が接続される、直列に接続された第1のダイオー
ド、第1のスイッチ、及び第1のインダクタ、前記走査
電極に電力を供給するための他方の電源ラインに一端が
接続され、前記第1の電荷蓄積コンデンサに他端が接続
される、直列に接続された第2のダイオード、第2のス
イッチ、及び第2のインダクタ、並びに前記走査電極に
電力を供給するための電源ラインにスイッチを介して一
端が接続され、前記第1の電荷蓄積コンデンサに他端が
接続された第3のインダクタを備えた第1の電荷回収回
路と、前記維持電極を介して前記表示セルから戻される
電荷を蓄積する第2の電荷蓄積コンデンサ、前記維持電
極に電力を供給するための一方の電源ラインに一端が接
続され、前記第2の電荷蓄積コンデンサに他端が接続さ
れる、直列に接続された第3のダイオード、第3のスイ
ッチ、及び第4のインダクタ、前記維持電極に電力を供
給するための他方の電源ラインに一端が接続され、前記
第2の電荷蓄積コンデンサに他端が接続される、直列に
接続された第4のダイオード、第4のスイッチ、及び第
5のインダクタ、並びに前記維持電極に電力を供給する
ための電源ラインにスイッチを介して一端が接続され、
前記第2の電荷蓄積コンデンサに他端が接続された第6
のインダクタを備えた第2の電荷回収回路と、を有する
構成である。
の駆動方法は、走査電極に走査パルスと逆極性でかつ緩
やかに立ち上がる第1の予備放電パルスを印加し、維持
電極に走査パルスと同極性でかつそれよりも低電圧の矩
形状または緩やかに立ち上がる第2の予備放電パルスを
印加することで、予備放電パルスとデータ電極に印加さ
れるデータパルスとによる放電が防止される。
消去パルス及び維持放電消去を行うための維持消去パル
スを、立ち下がりが緩やかな同じパルス形状で印加する
ことで、予備放電消去パルス及び維持消去パルスを出力
するための回路を共通にすることができる。
ドに分割し、複数のサブフィールドの全てを1フレーム
分の時間内で表示し、サブフィールドの組み合わせによ
って階調表示を行うことで、予備放電専用の期間を設け
る必要がなくなり、各サブフィールド間の発光休止時間
を短くすることができる。
に分割し、各サブフィールドをそれぞれ1フレームの時
間で表示し、サブフィールドの組み合わせによって階調
表示を行うことで、各サブフィールド間の発光休止時間
をさらに短くすることができる。
て詳細に説明する。
ズマディスプレイパネルの駆動方法の第1の実施の形態
の動作の様子を示す波形図であり、図2は図1に示した
パルス波形によって表示セル内に壁電荷が形成される様
子を示す模式図である。
mは、走査電極Sc1、Sc2、…、Scmに印加する
パルス波形であり、Wu1、Wu2、…、Wumは、維
持電極Su1、Su2、…、Sumに印加するパルス波
形である。また、Wdはデータ電極D1、D2、…、D
nに印加するパルス波形であり、Id1、Id2、…、
Idnは、走査電極Sc1,Sc2、…、Scmに流れ
る放電電流波形である。なお、PDPは交流放電メモリ
型であり、従来と同様の構成であるため、その説明は省
略する。
動方法は、走査維持混合駆動方法による駆動方法であ
り、駆動シーケンスの1周期は、予備放電期間、予備放
電消去期間、書き込み期間、維持放電期間、及び維持消
去期間から構成され、これらを各走査ライン毎に繰り返
すことで所望の映像を得ている。
査ラインが書き込み期間にあるとき(図1では第1の走
査ライン)、次に走査すべき走査ライン(図1では第2
の走査ライン)で予備放電を行わせる。このとき、予備
放電パルスとデータ電極に印加されるデータパルスとに
よる放電を防止するため、図1に示すように走査電極に
緩やかに立ち上がる第1の予備放電パルスを印加すると
共に、維持電極に第1の予備放電パルスと極性が異なる
第2の予備放電パルスを印加する。
立ち上がりの緩やかな(5V/μs以下の傾き)正電圧
のパルスを印加し、第2の予備放電パルスとして、式
(1)、(2)の条件を満たすパルスを印加する。
第2の予備放電パルスの電圧、Vfsuは走査電極と維
持電極間の放電開始電圧、Vdはデータ電極に印加する
データパルスの電圧、Vfudは維持電極とデータ電極
間の放電開始電圧である。なお、図1では第2の予備放
電パルスとして矩形状のパルスが印加されているが、第
2の予備放電パルスは矩形状のパルスである必要はな
く、第1の予備放電パルスと同様に電圧が緩やかに変化
する波形であってもよい。
備放電期間及び予備放電消去期間にあるとき、直前に予
備放電を行った走査ラインを除いた他の走査ラインが維
持放電期間となるようにする(但し、発光数2回)。
期間にあるとき、次に走査すべき走査ラインの維持消去
期間を該予備放電消去期間に一致させ、予備放電消去パ
ルス及び維持消去パルスの形状を立ち下がりが緩やかな
同じ形状で印加する。このようにすることで駆動回路を
共用することができるため、回路規模の増大を防止する
ことができる。
あるとき、走査パルスは走査ベースパルス(電圧が−V
bwのパルス)に重畳して印加する。このとき、予備放
電期間または書き込み期間の走査ラインを除いた他の走
査ラインでは維持放電を行わない休止期間となるが、本
形態では、維持電極を走査電極より高電位の接地電位
(0[V])で保持しているため、維持放電によって生
成された壁電荷の消滅が抑制される。このことによって
維持放電に必要な最小維持電圧の上昇が抑制される。
に対する走査パルスの印加に同期して、書き込みを行う
表示セルに対応するデータ電極に印加する。また、維持
放電は、走査電極と維持電極の電位を、接地電位から−
Vs、または−Vsから接地電位に逆転させる度に発生
し、維持消去パルスを印加するまで継続させる。
する走査パルスの電圧を下げるために印加するものであ
り、走査パルスを発生する駆動用ICの最高使用電圧を
引き下げることが可能になり、駆動用ICの低コスト化
を図ることができる。また、走査パルスの電圧値が大き
い場合、走査パルスの立ち上がりにおいて、書き込み放
電で生成された壁電荷と放電空間の多量の活性粒子によ
って放電が発生するが、この放電は走査パルスとデータ
パルスとによって生じた書き込み放電を消滅させる有害
な放電である。そこで、走査ベースパルスを印加するこ
とにより、走査パルスの値を小さくして、この有害な放
電を防止する。
セル内の放電及び壁電荷の変化の様子を図2を用いて説
明する。なお、図2の(a)〜(f)で示した壁電荷の
変化の様子は、図1の期間(a)〜(f)にそれぞれ一
致している。なお、以下では第1の走査ライン、第2の
走査ライン、及び第mの走査ライン上の任意の表示セル
における壁電荷の様子を示している。
走査電極Sc1に走査パルスが印加され、任意のデータ
電極にデータパルスが印加されると、走査電極Sc1と
データ電極との間で放電が発生し、その放電に誘発され
て走査電極Sc1と維持電極Su1の間でも放電が発生
する。このとき、走査電極Sc1には正の壁電荷が堆積
され、データ電極及び維持電極Su1には負の壁電荷が
それぞれ堆積される。
c2に第1の予備放電パルスが印加され、維持電極Su
2に第2の予備放電パルスが印加される。このとき走査
電極Sc2と維持電極Su2の間で弱い放電が発生し、
走査電極Sc2には比較的少ない負の壁電荷が堆積さ
れ、維持電極Su2には比較的少ない正の壁電荷が堆積
される。
インの走査電極Sc1及び維持電極Su1に印加される
電圧が逆転すると、走査電極Sc1と維持電極Su1間
で維持放電が発生し、走査電極Sc1に負の壁電荷が堆
積され、維持電極Su1に正の壁電荷が堆積される。
c2が接地電位になり、維持電極Su2に−Vsが印加
されるが、互いの電位関係が変化しないため、図2
(a)と同じ状態で維持される。
インの走査電極Sc1及び維持電極Su1に印加される
電圧が逆転すると、走査電極Sc1と維持電極Su1間
で維持放電が発生し、走査電極Sc1に正の壁電荷が堆
積され、維持電極Su1に負の壁電荷が堆積される。
c2に予備放電消去パルスが印加され、走査電極Sc2
及び維持電極Su2に堆積されていた壁電荷が消滅す
る。
インでは、走査電極Sc1及び維持電極Su1が共に接
地電位になるが、互いの電位関係が逆転しないため、図
2(c)と同じ状態で維持される。
に走査パルスが印加され、任意のデータ電極にデータパ
ルスが印加されると、走査電極Sc2とデータ電極との
間で放電が発生し、その放電に誘発されて走査電極Sc
2と維持電極Su2の間でも放電が発生する。このと
き、走査電極Sc2には正の壁電荷が堆積され、データ
電極及び維持電極Su2には負の壁電荷が堆積される。
インでは、走査電極Sc1が接地電位になり、維持電極
Su1に−Vsが印加されるため、走査電極Sc1及び
維持電極Su1に印加される電圧が図2(c)の状態か
ら逆転し、走査電極Sc1と維持電極Su1間で維持放
電が発生して、走査電極Sc1に負の壁電荷が堆積さ
れ、維持電極Su1に正の壁電荷が堆積される。
c2が接地電位になり、維持電極Su2に−Vsが印加
され、走査電極Sc2と維持電極Su2間で維持放電が
発生して、走査電極Sc2に負の壁電荷が堆積され、維
持電極Su2に正の壁電荷が堆積される。
備放電が行われ、走査電極Scmが接地電位になり、維
持電極Sumに−Vsが印加される。しかしながら、予
備放電時と互いの電位関係が変化しないため、走査電極
Scmに負の壁電荷が堆積し、維持電極Sumに正の壁
電荷が堆積している。
インでは、走査電極Sc1に維持放電消去パルスが印加
され、弱放電形態の消去放電が発生し、走査電極Sc1
と維持電極Su1に堆積されていた壁電荷が消滅する。
但し、データ電極には負の壁電荷が残留する。
c2に−Vsが印加され、維持電極Su2が接地電位に
なり、走査電極Sc2と維持電極Su2間で維持放電が
発生して、走査電極Sc2に正の壁電荷が堆積され、維
持電極Su2に負の壁電荷が堆積される。
Scmに予備放電消去パルスが印加され、走査電極Sc
m及び維持電極Sumに堆積されていた壁電荷が消滅す
る。
で説明したサブフィールド法とを組み合わせればPDP
の階調表示が可能になる。本実施例の駆動方法によれ
ば、図3に示すように、予備放電のための専用の期間
(図20参照)が不要になるため、1フレーム時間内の
発光休止時間を大幅に短縮することができる。したがっ
て、維持発光回数を増やすことが可能になり、PDPの
輝度を増大させることができる。なお、図3では各サブ
フィールドにそれぞれ発光時間にそれぞれ異なった重み
付けがなされているが、同じ重み付けがなされたサブフ
ィールドが複数あってもよい。
ネルの駆動回路について図4を参照して説明する。
ルの駆動回路の第1実施例の構成を示すブロック図であ
る。なお、図4では走査ラインが480本のPDPを例
示している。
路は、従来と同様に、走査電極Sc1、Sc2、…、S
c480にそれぞれパルス電圧を印加するための走査電
極駆動回路31と、維持電極Su1、Su2、…、Su
480にそれぞれパルス電圧を印加するための維持電極
駆動回路32と、データ電極にそれぞれ映像信号に応じ
た電圧を印加するためのデータ電極駆動回路33と、垂
直同期信号、水平同期信号、表示データ信号、及びクロ
ックに基づいて各電極の駆動回路に対する制御信号をそ
れぞれ出力する制御回路34とによって構成されてい
る。
選択的に走査パルスを印加するためのドライバとして、
例えば、並列に接続された12個の40ビット出力の走
査電極ドライバ351〜3512と、各走査電極ドライバ
に共通に接続される走査電極共通ドライバ36とを有し
ている。
イン毎に選択的に維持パルスを印加するためのドライバ
として、例えば、並列に接続された12個の40ビット
出力の維持電極ドライバ371〜3712と、各維持電極
ドライバに共通に接続される維持電極共通ドライバ38
とを有している。
電極ドライバ371〜3712は、走査電極または維持電
極をそれぞれ駆動するための駆動部401〜4012と、
駆動部401〜4012に各種電源電圧を供給し、図1に
示したパルス波形を出力させるためのスイッチ部411
〜4112とをそれぞれ有している。駆動部401〜40
12はプッシュプル接続されたPチャネルFET及びNチ
ャネルFETからなる40組のドライバ用FETによっ
て構成され、スイッチ部411〜4112は各種電源電圧
(第1の予備放電パルス電圧:Vp1、第2の予備放電
パルス電圧:−Vp2、走査ベースパルス電圧:−Vb
w、維持パルス電圧:−Vs、接地電位)に接続された
複数のスイッチ用FETによって構成されている。各ス
イッチ用FETは、ドライバ用FETから図1に示した
駆動シーケンスでパルス波形が出力されるように、制御
回路34によってそれぞれON/OFFが制御される。
なお、定電流素子391〜3912は立ち上がりが緩やか
な予備放電消去パルス及び維持消去パルスを印加するた
めの回路であり、定電流素子451〜4512は立ち上が
りが緩やかな予備放電パルスを印加するための回路であ
る。
電極共通ドライバ38は、駆動部401〜4012の各P
チャネルFETのソースにそれぞれ−Vsを供給し、各
NチェネルFETのソースをそれぞれ接地電位にするた
めの回路である。
実施の形態について図面を参照して説明する。
ためには、図20に示したように、1フレームを時間的
な重みづけがなされた複数のサブフィールドに分割し、
複数のサブフィールドの全てを1フレーム分の時間内で
表示する方法と、図5に示すように、1つのサブフィー
ルドを1フレーム分の時間で表示する方法とがある。
ィールド間の発光休止時間を図20に示した駆動方法よ
りもさらに短くすることができるため、維持発光回数を
より増やすことが可能になり、PDPの輝度をより増大
させることができる。
では、書き込み放電が各サブフィールド毎に線順次に行
われず、各サブフィールドを行き来するため、書き込み
期間をサブフィード数で時間分割し、各サブフィールド
に対応する書き込みタイミングを確保する。
ルの駆動方法の第2の実施の形態の動作の様子を示す波
形図である。
間を6分割し、分割した書き込み期間の先頭からサブフ
ィールド1(SF1)、2(SF2)、3(SF3)、
4(SF4)、5(SF5)、6(SF6)用の書き込
みタイミングにそれぞれ割り当てている。
持パルスを挿入することで、維持発光回数を増大させて
いる。このようにすることでPDPの輝度をより増大さ
せることができる。
び維持消去パルスの幅を第1の実施の形態に比べて広く
している。例えば、一つの走査パルスの幅を第1の実施
の形態と同一にすると、本形態の予備放電パルスの幅は
第1の実施の形態の6倍になる。したがって、予備放電
パルスの立ち上がりをより緩やかにすることができるた
め、予備放電強度をさらに安定して弱くすることができ
る。よって、壁電荷の制御性が向上し、予備放電による
輝度も安定して抑えられるため、PDPのコントラスト
が向上する。
持消去パルスは第1の実施の形態と同様に同一の形状と
し、立ち上がりが緩やかなパルスとする。また、本形態
の駆動回路は、制御回路による各スイッチ用FETのO
N/OFFタイミングが第1の実施の形態と異なるだけ
であり、回路構成については第1の実施の形態と同様で
あるため、その説明は省略する。
実施の形態について図面を参照して説明する。
ルの駆動方法の第3の実施の形態の動作の様子を示す波
形図である。
2つの電極の相対的な電位関係が第1の実施の形態ある
いは第2の実施の形態と同様であればよく、例えば、予
備放電消去パルスあるいは維持消去パルスは、必ずしも
走査電極に印加する必要はない。
方法は、予備放電消去パルス及び維持消去パルスをそれ
ぞれ維持電極に印加する方法である。なお、図7に示し
たパルス波形は図6に示した第2の実施の形態のパルス
波形と同様の駆動シーケンスである。図1に示した第1
の実施の形態の駆動シーケンスにおいても、予備放電消
去パルス及び維持消去パルスを維持電極に印加してもよ
い。
ルスは、第1の実施の形態と同様に同一の形状とし、立
ち上がりが緩やかなパルスとする。
放電消去パルス及び維持消去パルスをそれぞれ印加する
本形態の駆動方法でも、第1の実施の形態あるいは第2
の実施の形態と同様の効果を得ることができる。
ルの駆動回路の第3の実施の形態の構成を示すブロック
図である。なお、図8では走査ラインが480本のPD
Pを例示している。
走査電極ドライバが有する予備放電消去パルス及び維持
消去パルスを印加するための回路を維持電極ドライバに
移した構成である。すなわち、維持電極ドライバのスイ
ッチ部に、予備放電消去パルス及び維持消去パルスを印
加するための定電流回路421〜4212と、そのON/
OFFを制御するためのスイッチ用FET431〜43
12、及びダイオード441〜4412とをそれぞれ追加し
た構成である。その他の構成は第1の実施の形態と同様
であるため、その説明は省略する。
実施の形態について図面を参照して説明する。
回路に、消費電力を低減するための電荷(電力)回収回
路を追加する。
積された電荷を回収して再利用するための回路であり、
一般に、外付けされた電荷蓄積コンデンサによって各表
示セルの電荷を回収する電荷蓄積型電荷回収回路と、P
DPの各表示セルが有する容量自身で電荷を回収する自
己回収型電荷回収回路と知られている。
単に説明する。
が有する電荷蓄積型電荷回収回路の動作原理を説明する
ための図であり、同図(a)はプッシュプル接続された
ドライバ回路の構成を示す回路図、同図(b)はその等
価回路図である。
(a)に示した各スイッチQ1、Q2を、オン抵抗R
1、R2とスイッチS1、S2と出力容量C1、C2と
で表わしている。この駆動回路では、負荷容量Cpに電
圧Vのパルスが印加される度に(C1+C2+Cp)V
2のエネルギーが消費される。このエネルギーは素子の
オン抵抗R1、R2または電圧Vを供給する電源部の内
部抵抗で消費される。
ネルの駆動回路が有する電荷蓄積型電荷回収回路の構成
を示す回路図であり、図11は負荷容量Cpの電圧波形
と図10に示したスイッチ素子Q1〜Q4のON/OF
Fタイミングを示したものである。図10及び図11に
示すように、電荷回収回路は、L−Cの共振を利用し、
負荷容量Cpに印加する電位を上げるときは外部の電荷
蓄積コンデンサCs(Cs≫Cp)から電荷を供給し、
電位を下げるときは電荷を電荷蓄積コンデンサCsに戻
している。
路が有する自己回収型電荷回収回路の構成を示す回路図
であり、図13は図12に示した自己回収型電荷回収回
路の動作の様子を示すシーケンス図である。
収回路は、スイッチS11、S12及びダイオードD1
1、D12と直列に接続されたインダクタLが、負荷容
量Cpに並列に接続される構成であり、電荷蓄積型と同
様に電荷回収時にL−Cの共振を利用する方式である。
て、駆動回路から負荷容量Cpに対してB点からA点の
方向に電流Iが供給され、ステップ2において駆動回路
からの電力の供給が停止すると、負荷容量Cpに蓄積さ
れた電荷がスイッチS12、ダイオードD12、及びイ
ンダクタLを通して自身に回収される。
ら負荷容量Cpに対してA点からB点の方向に電流Iが
供給され、ステップ4において駆動回路からの電力の供
給が停止すると、負荷容量Cpに蓄積された電荷がスイ
ッチS11、ダイオードD11、及びインダクタLを通
して自身に回収される。
の駆動回路に組み込んだ構成について図14及び図15
を参照して説明する。
ネルの駆動回路の第4の実施の形態の構成を示す図であ
り、自己回収型の電荷回収回路を含む構成を示す回路図
である。
に示した第1の実施の形態の駆動回路に自己回収型の電
荷回収回路を追加した構成である。
収回路を備えた本形態の駆動回路は、電荷回収回路51
が、走査電極に電力を供給するための電源ラインと維持
電極に電力を供給するための電源ライン間に接続された
構成である。
列に接続されたダイオードD21、NチャネルFETQ
er1と、インダクタL2に直列に接続されたダイオー
ドD22、NチャネルFETQer2と、インダクタン
ス値が変更可能なインダクタL3とによって構成されて
いる。インダクタL3の一端はダイオードD22のカソ
ードに接続され、インダクタL3の他端は走査電極ドラ
イバの各スイッチ部が有するNチャネルFETQr1〜
Qr12のソースにそれぞれ接続されている。
走査電極ドライバ及び維持電極ドライバの駆動部を構成
するPチャネルFETをそれぞれP1〜P40とし、N
チャネルFETをそれぞれN1〜N40とする。また、
走査電極ドライバの定電流素子と直列に接続されるスイ
ッチ用FETをQe1〜Qe12とし、第1の予備放電
パルス用電源Vp1と直列に接続されるスイッチ用FE
TをQpr1〜Qpr12、走査ベースパルス用電源−
Vbwと直列に接続されるスイッチ用FETをQb1〜
Qb12、各走査電極ドライバのPチャネルFETP1
〜P40のソースを接地電位にするためのスイッチ用F
ETをQgs1〜Qgs12、各走査電極ドライバのN
チャネルFETN1〜N40のソースを接地電位にする
ためのスイッチ用FETをQw1〜Qw12、維持パル
ス用の電源電圧−Vsと直列に接続されるスイッチ用F
ETをQs1〜Qs12とする。
TP1〜P40のソースと走査電極共通ドライバを接続
するダイオードをDns1〜Dns12とし、Nチャネ
ルFETN1〜N40のソースと走査電極共通ドライバ
を接続するダイオードをDps1〜Dps12とする。
ETN1〜N40のソースを接地電位にするための走査
電極共通ドライバのPチャネルFETをQgs、走査電
極ドライバのNチャネルFETN1〜N40のソースを
−Vsにするための走査電極共通ドライバのNチャネル
FETをQssとする。
電パルス用電源−Vp2と直列に接続されるスイッチ用
FETをQpe1〜Qpe12とし、維持電極ドライバ
のPチャネルFETP1〜P40のソースを接地電位に
するためのスイッチ用FETをQgc1〜Qgc12と
する。
TP1〜P40のソースと維持電極共通ドライバを接続
するダイオードをDnc1〜Dnc12とし、Nチャネ
ルFETN1〜N40のソースと走査電極共通ドライバ
を接続するダイオードをDpc1〜Dpc12とする。
ETN1〜N40のソースを接地電位にするための維持
電極共通ドライバのPチャネルFETをQgc、維持電
極ドライバのNチャネルFETN1〜N40のソースを
−Vsにするための維持電極共通ドライバのNチャネル
FETをQscとする。
収回路を含む駆動回路の動作について説明する。
時、及び維持パルス印加時に行う。
スを印加する場合、定電流素子に接続されたスイッチ用
FETQe1をONにし、走査電極Sc1の電位を走査
電極ドライバのPチャネルFETP1に並列に接続され
たダイオードを通して一定の電位勾配で徐々に−Vsま
で低下させる。
スイッチ用FETQe1をOFF、電荷回収回路51の
NチャネルFETQer1をONにして、表示セルに蓄
積された電荷を、インダクタL1、ダイオードDps
1、走査電極ドライバのNチャネルFETN1を通して
自身に回収させる。このとき、走査電極Sc1の電位は
接地電位になるように動作するが、回路及び配線のイン
ピーダンスによって損失が発生するため接地電位に到達
しない。
が終了した後、または終了直前に、走査電極共通ドライ
バのPチャネルFETQgsをONにし、ダイオードD
ps1、及び走査電極ドライバのNチャネルFETN1
を通して走査電極Sc1の電位を接地電位に固定する。
は−Vsに固定され、維持電極共通ドライバのNチャネ
ルFETQscはON状態にある。したがって、維持消
去直前でNチャネルFETQscをOFF、電荷回収回
路51のNチャネルFETQer2をONにすること
で、表示セルに蓄積された電荷を、インダクタL2、ダ
イオードDpc1、及び維持電極ドライバのNチャネル
FETN1を通して自身に回収させる。このとき、維持
電極Su1の電位は接地電位になるように動作するが、
回路及び配線のインピーダンスによって損失が発生すた
め接地電位に到達しない。
が終了した後、または終了直前に、維持電極共通ドライ
バのPチャネルFETQgcをONにし、ダイオードD
pc1、及び維持電極ドライバのNチャネルFETN1
を通して維持電極Su1を接地電位に固定する。
極共通ドライバのPチャネルFETQgcをOFFにす
る。また、その直後に維持電極ドライバのスイッチ用F
ETQpe1、Qgc1をそれぞれONにする。
スが印加される走査電極Sck(k=1〜40)と対に
なる維持電極Sukには、第2の予備放電パルスが出力
されるため、対応する維持電極ドライバのNチャネルF
ETをONにすることで維持電極Sukの電位を−Vp
2に固定する。
Tに対応する維持電極を除いた他の維持電極では、対と
なるPチャンルFETがONしているため、該維持電極
の電位は接地電位に固定される。
電極、すなわち選択的に維持パルスが印加されている走
査電極Scj(j=1〜40)には、L−C共振を利用
した電荷回収動作によって維持パルスを印加する。
Sc40とした場合、走査電極Sc40に接続されたN
チャネルFETN40と、対応する走査電極ドライバの
スイッチ用FETQr1をそれぞれONにすることで、
表示セルに蓄積された電荷を、NチャンネルFETN4
0、スイッチ用FETQr1、及びインダクタL3を通
して自身に回収させる。
Sc40へ維持消去パルスを出力しようとするが、強制
的にπ(L3・Cp)1/2(Cpは負荷容量)の傾きで
−Vsに変位する。なお、維持パルスが印加される走査
電極の数は時刻によって変わるため、維持パルスの立ち
上がり勾配が一定に保たれるようにインダクタL3の値
を可変、または切り替えることができるようにする。維
持パルスが印加される走査電極数の変化による維持パル
ス立ち上がり勾配の変化が特性上許容できる範囲であれ
ばインダクタL3は固定値であってもよい。
sに固定するように動作するが、回路及び配線のインピ
ーダンスによって損失が発生するため−Vsに到達しな
い。
終了した後、または終了直前に、スイッチ部のNチャン
ルFETQs1をONにして、走査電極Sc40の電位
を−Vsに固定する。
れて所定時間が経過した後、走査電極Sc40に接続さ
れたNチャネルFETN40とスイッチ部のNチャネル
FETQr1をOFFにし、電荷回収回路51のNチャ
ンルFETQer1をONにして、表示セルに蓄積され
た電荷をインダクタL1、ダイオードDps1、走査電
極ドライバのNチャネルFRTN40を通して自身に回
収させる。このとき、走査電極Sc40の電位は接地電
位に固定するように動作するが、回路及び配線のインピ
ーダンスによって損失が発生するため接地電位に到達し
ない。
終了した後、または終了直前に走査電極共通ドライバの
PチャネルFETQgsをONさせ、ダイオードDps
1、走査電極ドライバのNチャネルFETN40を通し
て走査電極Sc40を接地電位に固定する。
ネルの駆動回路の第4の実施の形態の構成を示す図であ
り、電荷蓄積型の電荷回収回路を含む構成を示す回路図
である。
に示した第1の実施の形態の駆動回路に電荷蓄積型の電
荷回収回路を追加した構成である。
収回路を備えた本形態の駆動回路は、走査電極に電力を
供給するための電源ラインに第1の電荷回収回路61が
接続され、維持電極に電力を供給するための電源ライン
に第2の電荷回収回路62が接続された構成である。
11に直列に接続されたダイオードD31、Nチャネル
FETQnsと、インダクタL12に直列に接続された
ダイオードD32、PチャネルFETQpsと、インダ
クタンス値が変更可能なインダクタL13と、表示セル
から走査電極を介して回収される電荷を蓄積する第1の
電荷蓄積コンデンサCsとによって構成されている。イ
ンダクタL13の一端はNチャネルFETQnsのソー
ス及びPチャネルFETQpsのドレインに共通に接続
され、インダクタL13の他端は各走査電極ドライバの
スイッチ部が有するNチャネルFETQr1〜Qr12
のソースにそれぞれ接続されている。
14に直列に接続されたダイオードD33、Pチャネル
FETQpcと、インダクタL15に直列に接続された
ダイオードD34、NチャネルFETQncと、表示セ
ルから維持電極を介して回収される電荷を蓄積する第2
の電荷蓄積コンデンサCcとによって構成されている。
走査電極ドライバ及び維持電極ドライバの駆動部を構成
するPチャネルFETをそれぞれP1〜P40とし、N
チャネルFETをそれぞれN1〜N40とする。また、
走査電極ドライバの定電流素子と直列に接続されるスイ
ッチ用FETをQe1〜Qe12とし、第1の予備放電
パルス用電源Vp1と直列に接続されるスイッチ用FE
TをQpr1〜Qpr12、走査ベースパルス用電源−
Vbwと直列に接続されるスイッチ用FETをQb1〜
Qb12、各走査電極ドライバのPチャネルFETP1
〜P40のソースを接地電位にするためのスイッチ用F
ETをQgs1〜Qgs12、各走査電極ドライバのN
チャネルFETN1〜N40のソースを接地電位にする
ためのスイッチ用FETをQw1〜Qw12、維持パル
ス用の電源電圧−Vsと直列に接続されるスイッチ用F
ETをQs1〜Qs12とする。
TP1〜P40のソースと走査電極共通ドライバを接続
するダイオードをDns1〜Dns12とし、Nチャネ
ルFETN1〜N40のソースと走査電極共通ドライバ
を接続するダイオードをDps1〜Dps12とする。
ETN1〜N40のソースを接地電位にするための走査
電極共通ドライバのPチャネルFETをQgs、走査電
極ドライバのPチャネルFETP1〜P40のソースを
−Vsにするための走査電極共通ドライバのNチャネル
FETをQssとする。
電パルス用電源−Vp2と直列に接続されるスイッチ用
FETをQpe1〜Qpe12とし、維持電極ドライバ
のPチャネルFETP1〜P40のソースを接地電位に
するためのスイッチ用FETをQgc1〜Qgc12と
する。
TP1〜P40のソースと維持電極共通ドライバを接続
するダイオードをDnc1〜Dnc12とし、Nチャネ
ルFETN1〜N40のソースと走査電極共通ドライバ
を接続するダイオードをDpc1〜Dpc12とする。
ETN1〜N40のソースを接地電位にするための維持
電極共通ドライバのPチャネルFETをQgc、維持電
極ドライバのPチャネルFETP1〜P40のソースを
−Vsにするための維持電極共通ドライバのNチャネル
FETをQscとする。
収回路を備えた駆動回路の動作について説明する。
と同様に維持消去パルス印加時、及び維持パルス印加時
に行う。
スを印加する場合、定電流素子に接続されたスイッチ用
FETQe1をONし、走査電極ドライバのPチャネル
FETP1に並列に接続されたダイオードを通して走査
電極Sc1を一定の電位勾配で徐々に−Vsまで低下さ
せる。
スイッチ用FETQe1をOFF、第1の電荷回収回路
61のPチャネルFETQpsをONにする。このと
き、第1の電荷蓄積コンデンサCsには直前の維持放電
によって回収された電荷が蓄積されているため、第1の
電荷蓄積コンデンサCsに蓄積された電荷は、インダク
タL12、ダイオードDps1、走査電極ドライバのN
チャネルFETN1を通して表示セルに供給され、走査
電極Sc1が接地電位で固定するように動作する。しか
しながら、回路及び配線のインピーダンスによって損失
が発生するため、その損失分だけ走査電極Sc1の電位
は接地電位に到達しない。
収の終了後、または終了直前に、走査電極共通ドライバ
のPチャネルFETQgsをONにし、ダイオードDp
s1、走査電極ドライバのNチャネルFETN1を通し
て走査電極Sc1を接地電位に固定する。
は−Vsに固定され、維持電極共通ドライバのNチャネ
ルFETQscはON状態にある。したがって、維持消
去直前でNチャネルFETQscをOFF、第2の電荷
回収回路62のPチャネルFETQpcをONにする
と、第2の電荷蓄積コンデンサCcには直前の維持放電
によって回収された電荷が蓄積されているため、第1の
電荷蓄積コンデンサCsに蓄積された電荷は、インダク
タL14、ダイオードDpc1、及び維持電極ドライバ
のNチャネルFETN1を通して表示セルに供給され、
維持電極Su1を接地電位に固定するように動作する。
しかしながら、回路及び配線のインピーダンスによって
損失が発生し、維持電極Su1の電位は接地電位に到達
しない。
収の終了後、または終了直前に、維持電極共通ドライバ
のPチャネルFETQgcをONにし、ダイオードDp
c1、及び維持電極ドライバのNチャネルFETN1を
通して維持電極Su1を接地電位に固定する。
極共通ドライバのPチャネルFETQgcをOFFにす
る。また、その直後に維持電極ドライバのスイッチ用F
ETQpe1、Qgc1をそれぞれONにする。
スが印加される走査電極Sck(k=1〜40)と対に
なる維持電極Sukには、第2の予備放電パルスが出力
されるため、対応する維持電極ドライバのNチャネルF
ETをONにすることで維持電極Sukの電位を−Vp
2に固定する。
Tに対応する維持電極を除いた他の維持電極では、対と
なるPチャネルFETがONしているため、該維持電極
の電位は接地電位に固定される。
電極、すなわち選択的に維持パルスが印加されている走
査電極Scj(j=1〜40)には、L−C共振を利用
した電荷回収動作によって維持パルスを印加する。
Sc40とした場合、走査電極Sc40に接続されたN
チャネルFETN40と対応する走査電極ドライバのス
イッチ用FETQr1をONにすることで、表示セルに
蓄積された電荷を、NチャネルFETN40、スイッチ
用FETQr1、インダクタL13を通して第1の電荷
蓄積コンデンサCsで回収する。
0へ維持消去パルスを出力しようとするが、強制的にπ
(L13・Cp)1/2(Cpは負荷容量)の傾きで−V
sに変位する。なお、維持パルスが印加される走査電極
の数は時刻によって変わるため、維持パルスの立ち上が
り勾配が一定に保たれるようにインダクタL13の値を
可変、または切り替えることができるようにする。
による維持パルスの立ち上がり勾配の変化が特性上許容
できる範囲内であれば、インダクタL13は固定値であ
ってもよい。
sに固定されるように動作するが、回路及び配線のイン
ピーダンスによって損失が発生するため−Vsに到達し
ない。
が終了した後、または終了直前に、スイッチ部のNチャ
ネルFETQs1をONにして、走査電極Sc40の電
位を−Vsに固定する。
れて所定時間が経過した後、走査電極Sc40に接続さ
れたNチャネルFETN40とスイッチ部のNチャネル
FETQr1をOFFにし、第1の電荷回収回路61の
NチャンルFETQpsをONにする。このとき、第1
の電荷蓄積コンデンサCsには直前の維持放電によって
回収された電荷が蓄積されているため、第1の電荷蓄積
コンデンサCsに蓄積された電荷はインダクタL12、
ダイオードDps1、走査電極ドライバのNチャネルF
ETN40を通して表示セルに供給され、走査電極Sc
40を接地電位に固定するように動作する。しかしなが
ら、回路及び配線のインピーダンスによって損失が発生
するため、走査電極Sc40の電位は接地電位に到達し
ない。
が終了した後、または終了直前に走査電極共通ドライバ
のPチャネルFETQgsをONさせ、ダイオードDp
s1、走査電極ドライバのNチャネルFETN40を通
して走査電極Sc40を接地電位に固定する。
いるので、以下に記載する効果を奏する。
かに立ち上がる第1の予備放電パルスを印加し、維持電
極に走査パルスと同極性でかつそれよりも低電圧の矩形
状または緩やかに立ち上がる第2の予備放電パルスを印
加することで、予備放電パルスとデータ電極に印加され
るデータパルスとによる放電が防止され、プラズマディ
スプレイパネルの背景輝度の増大が防止される。
消去パルス及び維持放電消去を行うための維持消去パル
スを、立ち下がりが緩やかな同じパルス形状で印加する
ことで、予備放電消去パルス及び維持消去パルスを出力
するための回路を共通にすることができるため、回路規
模の増大が抑制される。
ドに分割し、複数のサブフィールドの全てを1フレーム
分の時間内で表示し、サブフィールドの組み合わせによ
って階調表示を行うことで、予備放電専用の期間を設け
る必要がなくなり、各サブフィールド間の発光休止時間
を短くすることができるため、プラズマディスプレイパ
ネルの輝度が増大する。
に分割し、各サブフィールドをそれぞれ1フレームの時
間で表示し、サブフィールドの組み合わせによって階調
表示を行うことで、各サブフィールド間の発光休止時間
をさらに短くすることができるため、プラズマディスプ
レイパネルの輝度をより増大させることができる。
法の第1の実施の形態の動作の様子を示す波形図であ
る。
壁電荷が形成される様子を示す模式図である。
法の第1の実施の形態を示す図であり、階調表示を行う
ためのサブフィールド法を説明するタイムチャートであ
る。
路の第1実施例の構成を示すブロック図である。
法の第2の実施の形態を示す図であり、階調表示を行う
ためのサブフィールド法を説明するタイムチャートであ
る。
法の第2の実施の形態の動作の様子を示す波形図であ
る。
法の第3の実施の形態の動作の様子を示す波形図であ
る。
路の第3の実施の形態の構成を示すブロック図である。
路が有する電荷蓄積型電荷回収回路の動作原理を説明す
るための図であり、同図(a)はプッシュプル接続され
たドライバ回路の構成を示す回路図、同図(b)はその
等価回路図である。
回路が有する電荷蓄積型電荷回収回路の構成を示す回路
図である。
タイミングに対する負荷容量の電圧波形を示した図であ
る。
回路が有する自己回収型電荷回収回路の構成を示す回路
図である。
作の様子を示すシーケンス図である。
回路の第4の実施の形態の構成を示す図であり、自己回
収型の電荷回収回路を含む構成を示す回路図である。
回路の第4の実施の形態の構成を示す図であり、電荷蓄
積型の電荷回収回路を含む構成を示す回路図である。
ルの駆動方法を適用する交流放電メモリ型のプラズマデ
ィスプレイパネルの一構成例を示す表示セルの斜視断面
図である。
置して形成したプラズマディスプレイパネルの概略の構
成を示す平面図である。
を駆動するための駆動回路の構成を示すブロック図であ
る。
法を示す図であり、各電極に印加するパルス波形の様子
を示す波形図である。
法を示す図であり、階調表示を行うためのサブフィール
ド法を説明するタイムチャートである。
動方法を示す図であり、各電極に印加するパルス波形の
様子を示す波形図である。
電流素子 401〜4012 駆動部 411〜4112 スイッチ部 431〜4312 スイッチ用FET 441〜4412 ダイオード 51 電荷回収回路 61 第1の電荷回収回路 62 第2の電荷回収回路
Claims (34)
- 【請求項1】 格子状に配置された複数の表示セルから
なる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電、及び維持放電消去の順に
逐次駆動することにより所望の画像を表示させるための
走査維持混合型のプラズマディスプレイパネルの駆動方
法であって、 前記第1のパルス印加期間で、順次選択走査される前記
走査ラインの走査電極にそれぞれ走査パルスを印加する
と共に、所定のデータ電極にデータパルスを印加するこ
とにより選択的に前記表示セルに対する書き込み放電を
行い、 同時に、次に走査される走査ラインにおいては、その走
査電極に前記走査パルスと逆極性でかつ緩やかに立ち上
がるパルスである第1の予備放電パルスを印加し、その
維持電極に前記走査パルスと同極性でかつそれよりも低
電圧で矩形状の第2の予備放電パルスを印加するプラズ
マディスプレイパネルの駆動方法。 - 【請求項2】 格子状に配置された複数の表示セルから
なる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電、及び維持放電消去の順に
逐次駆動することにより所望の画像を表示させるための
走査維持混合型のプラズマディスプレイパネルの駆動方
法であって、 前記第1のパルス印加期間で、順次選択走査される前記
走査ラインの走査電極にそれぞれ走査パルスを印加する
と共に、所定のデータ電極にデータパルスを印加するこ
とにより選択的に前記表示セルに対する書き込み放電を
行い、 同時に、次に走査される走査ラインにおいては、その走
査電極に前記走査パルスと逆極性でかつ緩やかに立ち上
がる第1の予備放電パルスを印加し、その維持電極に前
記走査パルスと同極性でかつそれよりも低電圧で緩やか
に立ち上がるパルスである第2の予備放電パルスを印加
するプラズマディスプレイパネルの駆動方法。 - 【請求項3】 格子状に配置された複数の表示セルから
なる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を表示させるための走
査維持混合型のプラズマディスプレイパネルの駆動方法
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極及び維持電極にそれ
ぞれ維持パルスを印加することで、交互に逆方向の維持
放電を行わせると共に、 前記第2のパルス印加期間の1つで、直前に予備放電を
行った走査ラインの走査電極に、前記他の走査ラインの
走査電極に印加される維持パルスと同極性でかつ緩やか
に立ち上がるパルスである予備放電消去パルスを印加す
ることにより予備放電消去を行うプラズマディスプレイ
パネルの駆動方法。 - 【請求項4】 格子状に配置された複数の表示セルから
なる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と、
主に1以上の維持発光を行う第2のパルス印加期間とが
巡回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を表示させるための走
査維持混合型のプラズマディスプレイパネルの駆動方法
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極及び維持電極にそれ
ぞれ維持パルスを印加することで、交互に逆方向の維持
放電を行わせると共に、 前記第2のパルス印加期間の1つで、維持消去すべき走
査ラインの走査電極に、前記他の走査ラインの走査電極
に印加される維持パルスと同極性でかつ緩やかに立ち上
がるパルスである維持消去パルスを印加することにより
維持消去を行うプラズマディスプレイパネルの駆動方
法。 - 【請求項5】 前記第2のパルス印加期間の1つで、直
前に予備放電を行った走査ラインの走査電極に、他の走
査ラインの走査電極に印加される維持パルスと同極性で
かつ緩やかに立ち上がるパルスである予備放電消去パル
スを印加することにより予備放電消去を行う請求項4記
載のプラズマディスプレイパネルの駆動方法。 - 【請求項6】 前記予備放電消去パルス及び前記維持消
去パルスを同じ形状で印加する請求項5記載のプラズマ
ディスプレイパネルの駆動方法。 - 【請求項7】 格子状に配置された複数の表示セルから
なる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を表示させるための走
査維持混合型のプラズマディスプレイパネルの駆動方法
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極及び維持電極にそれ
ぞれ維持パルスを印加することで、交互に逆方向の維持
放電を行わせると共に、 前記第2のパルス印加期間の1つで、直前に予備放電を
行った走査ラインの維持電極に、該走査ラインの走査電
極に印加される維持パルスと同極性でかつ緩やかに立ち
上がるパルスである予備放電消去パルスを印加すること
により予備放電消去を行うプラズマディスプレイパネル
の駆動方法。 - 【請求項8】 格子状に配置された複数の表示セルから
なる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と、
主に1以上の維持発光を行う第2のパルス印加期間とが
巡回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を表示させるための走
査維持混合型のプラズマディスプレイパネルの駆動方法
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極及び維持電極にそれ
ぞれ維持パルスを印加することで、交互に逆方向の維持
放電を行わせると共に、 前記第2のパルス印加期間の1つで、維持消去すべき走
査ラインの維持電極に、該走査ラインの走査電極に印加
される維持パルスと同極性でかつ緩やかに立ち上がるパ
ルスである維持消去パルスを印加することにより維持消
去を行うプラズマディスプレイパネルの駆動方法。 - 【請求項9】 前記第2のパルス印加期間の1つで、直
前に予備放電を行った走査ラインの維持電極に、該走査
ラインの走査電極に印加される維持パルスと同極性でか
つ緩やかに立ち上がるパルスである予備放電消去パルス
を印加することにより予備放電消去を行う請求項8記載
のプラズマディスプレイパネルの駆動方法。 - 【請求項10】 前記予備放電消去パルス及び前記維持
消去パルスを同じ形状で印加する請求項9記載のプラズ
マディスプレイパネルの駆動方法。 - 【請求項11】 1フレームを複数のサブフィールドに
分割し、 前記複数のサブフィールドの全てを1フレーム分の時間
内で表示すると共に、前記サブフィールドの選択組み合
わせによって階調表示を行う請求項1乃至10のいずれ
か1項記載のプラズマディスプレイパネルの駆動方法。 - 【請求項12】 1フレームを複数のサブフィールドに
分割し、 前記サブフィールドをそれぞれ前記1フレーム分の時間
で表示すると共に、前記サブフィールドの選択組み合わ
せによって階調表示を行う請求項1乃至10のいずれか
1項記載のプラズマディスプレイパネルの駆動方法。 - 【請求項13】 各サブフィールドにおける発光時間に
それぞれ異なった重み付けがなされている請求項11ま
たは12記載のプラズマディスプレイの駆動方法。 - 【請求項14】 前記書き込み放電期間を前記サブフィ
ールドの数で分割し、 該分割された期間にそれぞれ各サブフィールドの書き込
みタイミングを割り当てる請求項12記載のプラズマデ
ィスプレイパネルの駆動方法。 - 【請求項15】 前記緩やかに立ち上がるパルスを、電
圧源に直列に接続された定電流素子及びスイッチを介し
て出力する請求項1乃至14のいずれか1項記載のプラ
ズマディスプレイパネルの駆動方法。 - 【請求項16】 格子状に配置された複数の表示セルか
らなる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電、及び維持放電消去の順に
逐次駆動することにより所望の画像を走査維持混合型で
表示させるためのプラズマディスプレイパネルの駆動回
路であって、 前記第1のパルス印加期間で、順次選択走査される前記
走査ラインの走査電極にそれぞれ走査パルスを印加する
と共に、所定のデータ電極にデータパルスを印加するこ
とにより選択的に前記表示セルに対する書き込み放電を
行い、同時に、次に走査される走査ラインにおいては、
その走査電極に前記走査パルスと逆極性でかつ緩やかに
立ち上がるパルスである第1の予備放電パルスを印加す
る走査電極駆動回路と、 該走査ラインの維持電極に、前記第1の予備放電パルス
と同時に、前記走査パルスと同極性でかつそれよりも低
電圧で矩形状の第2の予備放電パルスを印加する維持電
極駆動回路と、を有するプラズマディスプレイパネルの
駆動回路。 - 【請求項17】 格子状に配置された複数の表示セルか
らなる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電、及び維持放電消去の順に
逐次駆動することにより所望の画像を走査維持混合型で
表示させるためのプラズマディスプレイパネルの駆動回
路であって、 前記第1のパルス印加期間で、順次選択走査される前記
走査ラインの走査電極にそれぞれ走査パルスを印加する
と共に、所定のデータ電極にデータパルスを印加するこ
とにより選択的に前記表示セルに対する書き込み放電を
行い、同時に、次に走査される走査ラインにおいては、
その走査電極に前記走査パルスと逆極性でかつ緩やかに
立ち上がるパルスである第1の予備放電パルスを印加す
る走査電極駆動回路と、 該走査ラインの維持電極に、前記第1の予備放電パルス
と同時に、前記走査パルスと同極性でかつそれよりも低
電圧で緩やかに立ち上がるパルスである第2の予備放電
パルスを印加する維持電極駆動回路と、を有するプラズ
マディスプレイパネルの駆動回路。 - 【請求項18】 格子状に配置された複数の表示セルか
らなる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を走査維持混合型で表
示させるためのプラズマディスプレイパネルの駆動回路
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極に維持パルスを印加
することで維持放電を行わせると共に、前記第2のパル
ス印加期間の1つで、直前に予備放電を行った走査ライ
ンの走査電極に、前記他の走査ラインの走査電極に印加
される維持パルスと同極性でかつ緩やかに立ち上がるパ
ルスである予備放電消去パルスを印加することにより予
備放電消去を行う走査電極駆動回路と、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その維持電極に維持パルスを印加
することで維持放電を行わせる維持電極駆動回路と、を
有するプラズマディスプレイパネルの駆動回路。 - 【請求項19】 格子状に配置された複数の表示セルか
らなる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と、
主に1以上の維持発光を行う第2のパルス印加期間とが
巡回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を走査維持混合型で表
示させるためのプラズマディスプレイパネルの駆動回路
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極にそれぞれ維持パル
スを印加することで維持放電を行わせる走査電極駆動回
路と、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その維持電極にそれぞれ維持パル
スを印加することで、交互に逆方向の維持放電を行わせ
ると共に、前記第2のパルス印加期間の1つで、維持消
去すべき走査ラインの走査電極に、前記他の走査ライン
の走査電極に印加される維持パルスと同極性でかつ緩や
かに立ち上がるパルスである維持消去パルスを印加する
ことにより維持消去を行う維持電極駆動回路と、を有す
るプラズマディスプレイパネルの駆動回路。 - 【請求項20】 前記走査電極駆動回路は、 前記第2のパルス印加期間の1つで、直前に予備放電を
行った走査ラインの走査電極に、他の走査ラインの走査
電極に印加される維持パルスと同極性でかつ緩やかに立
ち上がるパルスである予備放電消去パルスを印加するこ
とにより予備放電消去を行う請求項19記載のプラズマ
ディスプレイパネルの駆動回路。 - 【請求項21】 前記走査電極駆動回路は、 前記予備放電消去パルス及び前記維持消去パルスを同じ
形状で出力する請求項20記載のプラズマディスプレイ
パネルの駆動回路。 - 【請求項22】 格子状に配置された複数の表示セルか
らなる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と主
に1以上の維持発光を行う第2のパルス印加期間とが巡
回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を走査維持混合型で表
示させるためのプラズマディスプレイパネルの駆動回路
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極に維持パルスを印加
することで、交互に逆方向の維持放電を行わせる走査電
極駆動回路と、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その維持電極に維持パルスを印加
することで維持放電を行わせると共に、前記第2のパル
ス印加期間の1つで、直前に予備放電を行った走査ライ
ンの維持電極に、該走査ラインの走査電極に印加される
維持パルスと同極性でかつ緩やかに立ち上がるパルスで
ある予備放電消去パルスを印加することにより予備放電
消去を行う維持電極駆動回路と、を有するプラズマディ
スプレイパネルの駆動回路。 - 【請求項23】 格子状に配置された複数の表示セルか
らなる交流放電型のプラズマディスプレイパネルに対し
て、主に走査書き込みを行う第1のパルス印加期間と、
主に1以上の維持発光を行う第2のパルス印加期間とが
巡回配置され、各走査ライン毎に予備放電、予備放電消
去、書き込み放電、維持放電及び維持放電消去の順に逐
次駆動することにより所望の画像を走査維持混合型で表
示させるためのプラズマディスプレイパネルの駆動回路
であって、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その走査電極にそれぞれ維持パル
スを印加することで維持放電を行わせる走査電極駆動回
路と、 前記第2のパルス印加期間に、維持消去すべき走査ライ
ン及び直前に予備放電を行った走査ラインを除く他の走
査ラインにおいては、その維持電極にそれぞれ維持パル
スを印加することで維持放電を行わせると共に、前記第
2のパルス印加期間の1つで、維持消去すべき走査ライ
ンの維持電極に、該走査ラインの走査電極に印加される
維持パルスと同極性でかつ緩やかに立ち上がるパルスで
ある維持消去パルスを印加することにより維持消去を行
う維持電極駆動回路と、を有するプラズマディスプレイ
パネルの駆動回路。 - 【請求項24】 前記維持電極駆動回路は、 前記第2のパルス印加期間の1つで、直前に予備放電を
行った走査ラインの維持電極に、走査電極に印加される
維持パルスと同極性でかつ緩やかに立ち上がるパルスで
ある予備放電消去パルスを印加することにより予備放電
消去を行う請求項23記載のプラズマディスプレイパネ
ルの駆動回路。 - 【請求項25】 前記維持電極駆動回路は、 前記予備放電消去パルス及び前記維持消去パルスを同じ
形状で出力する請求項24記載のプラズマディスプレイ
パネルの駆動回路。 - 【請求項26】 前記走査電極駆動回路及び維持電極駆
動回路は、 1フレームを複数のサブフィールドに分割し、 前記複数のサブフィールドの全てを1フレーム分の時間
内で表示すると共に、前記サブフィールドの選択組み合
わせによって階調表示を行う請求項16乃至25のいず
れか1項記載のプラズマディスプレイパネルの駆動回
路。 - 【請求項27】 前記走査電極駆動回路及び維持電極駆
動回路は、 1フレームを複数のサブフィールドに分割し、 前記サブフィールドをそれぞれ前記1フレーム分の時間
で表示すると共に、前記サブフィールドの選択組み合わ
せによって階調表示を行う請求項16乃至25のいずれ
か1項記載のプラズマディスプレイパネルの駆動回路。 - 【請求項28】 前記走査電極駆動回路及び維持電極駆
動回路は、 各サブフィールドにおける発光時間にそれぞれ異なった
重み付けを行う請求項26または27記載のプラズマデ
ィスプレイの駆動回路。 - 【請求項29】 前記書き込み放電期間を前記サブフィ
ールドの数で分割し、 該分割された期間にそれぞれ各サブフィールドの書き込
みタイミングを割り当てる請求項27記載のプラズマデ
ィスプレイパネルの駆動回路。 - 【請求項30】 前記緩やかに立ち上がるパルスを出力
するための手段として、電圧源に直列に接続された定電
流素子及びスイッチを有する請求項16乃至29のいず
れか1項記載のプラズマディスプレイパネルの駆動回
路。 - 【請求項31】 前記走査電極に電力を供給するための
電源ラインと前記維持電極に電力を供給するための電源
ライン間に接続される、直列に接続された第1のダイオ
ード、第1のスイッチ、及び第1のインダクタ、並びに
直列に接続された第2のダイオード、第2のスイッチ、
及び第2のインダクタと、 前記走査電極に電力を供給するための電源ラインにスイ
ッチを介して一端が接続され、前記維持電極に電力を供
給するための電源ラインに他端が接続された第3のイン
ダクタと、を備えた電荷回収回路を有する請求項16乃
至30のいずれか1項記載のプラズマディスプレイパネ
ルの駆動回路。 - 【請求項32】 前記第3のインダクタは、 インダクタンス値が変更可能である請求項31記載のプ
ラズマディスプレイパネルの駆動回路。 - 【請求項33】 前記走査電極を介して前記表示セルか
ら戻される電荷を蓄積する第1の電荷蓄積コンデンサ、 前記走査電極に電力を供給するための一方の電源ライン
に一端が接続され、前記第1の電荷蓄積コンデンサに他
端が接続される、直列に接続された第1のダイオード、
第1のスイッチ、及び第1のインダクタ、 前記走査電極に電力を供給するための他方の電源ライン
に一端が接続され、前記第1の電荷蓄積コンデンサに他
端が接続される、直列に接続された第2のダイオード、
第2のスイッチ、及び第2のインダクタ、並びに前記走
査電極に電力を供給するための電源ラインにスイッチを
介して一端が接続され、前記第1の電荷蓄積コンデンサ
に他端が接続された第3のインダクタを備えた第1の電
荷回収回路と、 前記維持電極を介して前記表示セルから戻される電荷を
蓄積する第2の電荷蓄積コンデンサ、 前記維持電極に電力を供給するための一方の電源ライン
に一端が接続され、前記第2の電荷蓄積コンデンサに他
端が接続される、直列に接続された第3のダイオード、
第3のスイッチ、及び第4のインダクタ、 前記維持電極に電力を供給するための他方の電源ライン
に一端が接続され、前記第2の電荷蓄積コンデンサに他
端が接続される、直列に接続された第4のダイオード、
第4のスイッチ、及び第5のインダクタ、並びに前記維
持電極に電力を供給するための電源ラインにスイッチを
介して一端が接続され、前記第2の電荷蓄積コンデンサ
に他端が接続された第6のインダクタを備えた第2の電
荷回収回路と、を有する請求項16乃至30のいずれか
1項記載のプラズマディスプレイパネルの駆動回路。 - 【請求項34】 前記第3のインダクタ及び第6のイン
ダクタは、 それぞれインダクタンス値が変更可能である請求項33
記載のプラズマディスプレイパネルの駆動回路。
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