DE19800578A1 - Von Schwellenspannungsänderung unabhängiger Pegelschieber - Google Patents
Von Schwellenspannungsänderung unabhängiger PegelschieberInfo
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Description
Die vorliegende Erfindung bezieht sich auf einen von einer Schwel
lenspannungsänderung unabhängigen Pegelschieber, und insbesondere
auf einen von einer Schwellenspannungsänderung unabhängigen Pegel
schieber, der in der Lage ist, Eingangssignale von 0 Volt und
5 Volt in Signale von -10 Volt bzw. 10 Volt zu ändern, ohne eine
zusätzliche Spannung und ein invertiertes Signal zu verwenden,
selbst wenn eine Schwellenspannung eines NMOS-Transistor 4 Volt
beträgt.
Wie in Fig. 1 dargestellt ist, umfaßt der herkömmliche Pegel
schieber einen PMOS-Transistor 1 und einen NMOS-Transistor 2, die
in Reihe zwischen einer Versorgungsspannung VDD und einer Masse
spannung VSS liegen, sowie einen PMOS-Transistor 3 und einen
NMOS-Transistor 4, die mit dem PMOS-Transistor 1 und dem NMOS-
Transistor 2 in einer Verriegelungsform verbunden sind und in
Reihe zwischen der Versorgungsspannung VDD und der Massespannung
VSS liegen.
Gate des PMOS-Transistors 1 ist mit einem Ausgangsanschluß Vout
verbunden, und Gate des PMOS-Transistors 3 ist mit Drain des
NMOS-Transistors 2 verbunden. Zusätzlich ist Gate des NMOS-
Transistors 2 angeschlossen, um ein Eingangssignal Vin zu emp
fangen, und Gate des NMOS-Transistors 4 ist verbunden, um ein
durch einen Inverter IN invertiertes Eingangssignal/Vin auf zu
nehmen.
Der Betrieb des herkömmlichen Pegelschiebers wird im folgenden
anhand der begleitenden Zeichnungen beschrieben.
Wenn zunächst ein 5-Volt-Signal eingespeist wird, so werden der
NMOS-Transistor 2 und der PMOS-Transistor 3 eingeschaltet, und
der PMOS-Transistor 1 und der NMOS-Transistor 4 werden
ausgeschaltet, wodurch ein Hochpegelsignal Vout über den
Ausgangsanschluß ausgegeben wird.
Wenn zusätzlich ein 0-Volt-Signal Vin eingespeist wird, so werden
der NMOS-Transistor 4 und der PMOS-Transistor 1 eingeschaltet,
und der NMOS-Transistor 2 und der PMOS-Transistor 3 werden aus
geschaltet, wodurch ein Niederpegelsignal Vout durch den Aus
gangsanschluß abgegeben wird.
In dem herkömmlichen Pegelschieber wird das Eingangssignal durch
den Inverter IN invertiert, und sodann wird das invertierte
Signal mit einem Eingangssignal Vin verglichen.
Wenn der oben beschriebene Pegelschieber mittels eines polykri
stallinen Silicium-Dünnfilmtransistors (Poly-Si-TFT) hergestellt
wird, werden, um das invertierte Signal zu erzeugen, zusätzliche
Spannungen von 0 Volt und 5 Volt in eine Schaltungstafel einge
geben, und wenn die Schwellenspannung des NMOS-Transistors etwa
4 Volt überschreitet, so wird der NMOS-Transistor 2 nicht ein
geschaltet, so daß der Pegelschieber nicht arbeitet.
Zusätzlich sollte in einem Zustand, in welchem die Schwellenspan
nung stark schwankt, eine Spannung außerdem in Ergänzung zu der
Spannung vorgesehen sein, die 0 Volt und 5 Volt anlegt. Daher ist
die Anzahl der Eingangskissen der Schaltungstafel erhöht, und es
sollte zusätzlich eine Spannungsversorgungsschaltung vorgesehen
werden.
Es ist demgemäß eine Aufgabe der vorliegenden Erfindung, einen
von einer Schwellenspannungsänderung unabhängigen Pegelschieber
vorzusehen, der die oben erwähnten, beim Stand der Technik auf
tretenden Probleme überwindet; außerdem soll ein von einer
Änderung einer Schwellenspannung unabhängiger Pegelschieber ange
geben werden, der Eingangssignale von etwa 0 Volt und 5 Volt in
Signale von -10 Volt bzw. 10 Volt zu ändern vermag, ohne eine
zusätzliche Spannung und ein invertiertes Signal zu verwenden,
selbst wenn eine Schwellenspannung eines NMOS-Transistors 4 Volt
beträgt.
Zur Lösung dieser Aufgabe schafft die vorliegende Erfindung einen
Pegelschieber mit den Merkmalen des Patentanspruches 1.
Vorteilhafte Weiterbildungen der Erfindung ergeben sich aus den
Unteransprüchen.
Die Erfindung sieht also einen von einer Schwellenspannungsände
rung unabhängigen Pegelschieber vor, der aufweist: einen 2-Pegel-
Ausgangsinverter zum Erzeugen eines Ansteuersignales für einen
NMOS-Transistor und einen PMOS-Transistor unabhängig von einer
Schwellenspannungsänderung bezüglich Eingangsspannungen von
0 Volt und 5 Volt, einen 2-Pegel-Eingangsinverter zum Ansteuern
des PMOS-Transistors und des NMOS-Transistors abhängig von einem
Ansteuersignal von dem 2-Pegel-Ausgangsinverter und zum Ausgeben
eines Signales, dessen Pegel so weit wie eine Schwellenspannung
bei Spannungen von -10 Volt und 10 Volt reduziert ist, und einen
Inverter zum Ausgeben der Ausgangssignale von dem 2-Pegel-Ein
gangsinverter als Spannungssignale von -10 Volt und 10 Volt.
Nachfolgend wird die Erfindung anhand der Zeichnungen näher
erläutert. Es zeigen:
Fig. 1 ein Schaltungsdiagramm, das einen herkömmlichen Pegel
schieber veranschaulicht,
Fig. 2 ein Schaltungsdiagramm, das einen Pegelschieber gemäß der
vorliegenden Erfindung veranschaulicht,
Fig. 3 ein Schaltungsdiagramm, das einen 2-Pegel-Ausgangsinver
ter von Fig. 2 veranschaulicht,
Fig. 4 Wellenformdiagramme von Signalen von Bauelementen der
Fig. 3,
Fig. 5 ein Schaltungsdiagramm, das einen 2-Pegel-Eingangsinver
ter von Fig. 2 veranschaulicht,
Fig. 6 Wellenformdiagramme von Signalen von Bauelementen, wenn
der Absolutwert einer Schwellenspannung 7 Volt in der Schaltung
von Fig. 5 überschreitet, und
Fig. 7 Wellenformdiagramme von Signalen von Bauelementen der
Schaltung von Fig. 2.
Wie in Fig. 2 gezeigt ist, umfaßt der erfindungsgemäße, von
einer Schwellenspannungsänderung unabhängige Pegelschieber einen
2-Pegel-Ausgangsinverter 10 zum Erzeugen von 2-Pegel-Ausgangs
signalen abhängig von Eingangssignalen Vin von 0 Volt und 5 Volt,
einen 2-Pegel-Eingangsinverter 20 zum getrennten Ansteuern des
PMOS-Transistors und des NMOS-Transistors abhängig von Ausgangs
signalen out_H und out_L von dem 2-Pegel-Ausgangsinverter 10 und
zum Ausgeben von Signalen out1 von -8 Volt und 8 Volt, wenn der
Absolutwert der Schwellenspannung 7 Volt überschreitet, einen
Inverter 30 zum Ändern des Ausgangssignales out1 von dem 2-Pegel-
Eingangsinverter 20 in Ausgangssignale out2 von -10 Volt und
10 Volt und einen Inverter 40 zum Invertieren des Ausgangssigna
les out2 von dem Inverter 30.
Wie in Fig. 3 gezeigt ist, umfaßt der 2-Pegel-Ausgangsinverter
10 einen PMOS-Transistor P1, der in Reihe zwischen einem Versor
gungsanschluß von 10 Volt und einem Versorgungsanschluß von
-10 Volt liegt, ein Übertragungsgatter TG, das aus einem NMOS-
Transistor N1 und einem PMOS-Transistor P2 besteht, und einen
NMOS-Transistor N2.
Zusätzlich ist ein Ausgangsanschluß 21 zwischen dem PMOS-Tran
sistor P1 und dem Übertragungsgatter TG angeschlossen, und ein
Ausgangsanschluß 22 ist zwischen dem Übertragungsgatter TG und
dem NMOS-Transistor N2 angeschlossen, und die Gates des PMOS-
Transistors P1 und des NMOS-Transistors N1 sind gemeinsam mit dem
Eingangsanschluß verbunden, während die Gates des PMOS-Transi
stors P2 und des NMOS-Transistors N2 gemeinsam mit dem Ausgangs
anschluß 22 verbunden sind.
Wie in Fig. 5 gezeigt ist, liegt der 2-Pegel-Eingangsinverter 20
in Reihe zwischen dem Versorgungsanschluß von 10 Volt und dem
Versorgungsanschluß von -10 Volt und umfaßt einen PMOS-Transistor
P3 und einen NMOS-Transistor N3, deren Gates jeweils mit dem
Ausgangssignal out_H bzw. out_L von dem 2-Pegel-Ausgangsinverter
10 beaufschlagt sind.
Wie in Fig. 2 gezeigt ist, liegt der Inverter 30 in Reihe zwi
schen dem Versorgungsanschluß von 10 Volt und dem Versorgungs
anschluß von -10 Volt und umfaßt einen PMOS-Transistor P4 und
einen NMOS-Transistor N4, deren Gates jeweils mit dem Ausgangs
signal out1 von dem 2-Pegel-Eingangsinverter 20 beaufschlagt
sind, und ein Inverter 40 liegt in Reihe zwischen dem Versorgungs
anschluß von 10 Volt und dem Versorgungsanschluß von -10 Volt und
umfaßt einen PMOS-Transistor P5 und einen NMOS-Transistor N5,
deren Gates gemeinsam mit einem Ausgangssignal out2 von dem
Inverter 30 beaufschlagt sind.
Der Betrieb des von einer Schwellenspannungsänderung unabhängigen
Pegelschiebers gemäß der vorliegenden Erfindung wird im folgenden
erläutert.
Wenn zunächst ein 0-Volt-Signal Vin angelegt wird, wird der PMOS-
Transistor P1 des 2-Pegel-Ausgangsinverters 10 eingeschaltet, und
der NMOS-Transistor N1 wird ausgeschaltet, wodurch der PMOS-Tran
sistor P2 und der NMOS-Transistor N2 die Spannung verteilen.
Wenn zusätzlich ein 5-Volt-Signal Vin eingespeist wird, so wird
der NMOS-Transistor N1 eingeschaltet, und der PMOS-Transistor P1
wird ausgeschaltet, wodurch die elektrischen Ladungen out_H und
out_L, die in den Ausgangsanschlüssen 21 und 22 gespeichert sind,
durch den NMOS-Transistor N1 und den NMOS-Transistor N2 entladen
werden, bis die Spannung out_L des Ausgangsanschlusses eine
Schwellenspannung Vtn des NMOS-Transistors N2 annimmt.
Daher bewirkt der NMOS-Transistor N2 ein Messen der Schwellen
spannung Vtn des NMOS-Transistors und ein Verteilen der Spannung,
und das Ausgangssignal out_H bzw. out_L haben jeweils eine inver
tierte Signalform, wie dies in Fig. 4 gezeigt ist.
Der Pegelschieber wird betrieben, selbst wenn sich die Schwellen
spannung Vtn verändert, wenn insbesondere, wie in Fig. 4 gezeigt
ist, ein Eingangssignal von 5 Volt vorliegt, da die Spannung
out_L des Ausgangsanschlusses 22 die Schwellenspannung Vtn des
NMOS-Transistors N2 annimmt, und wenn ein Eingangssignal einen
Wert von 0 Volt besitzt, da die Spannung out_L hiervon höher als
die Schwellenspannung Vtn des NMOS-Transistors N2 wird, selbst
wenn die Schwellenspannung Vtn des NMOS-Transistors N2 verändert
wird.
Wenn ein 0-Volt-Signal Vin in den 2-Pegel-Ausgangsinverter 10
eingegeben wird, wird das Ausgangssignal out_H niedriger als die
Schwellenspannung des PMOS-Transistors P3, und wenn ein 5-Volt-
Eingangssignal Vin eingegeben wird, so wird das Ausgangssignal
out_H höher als die Schwellenspannung des PMOS-Transistors P3.
Zusätzlich wird ein 0-Volt-Eingangssignal Vin in den 2-Pegel-
Ausgangsinverter eingegeben, das Ausgangssignal out_L wird höher
als die Schwellenspannung des NMOS-Transistors N3, und wenn ein
5-Volt-Eingangssignal Vin eingegeben wird, so wird das Ausgangs
signal out_H zur Schwellenspannung des NMOS-Transistors N3.
Wenn daher ein 0-Volt-Signal Vin in den 2-Pegel-Ausgangsinverter
10 eingegeben wird und die Ausgangssignale out_H und out_L abge
geben werden, so wird der PMOS-Transistor P3 des 2-Pegel-Eingangs
inverters 20 ausgeschaltet, und der NMOS-Transistor N3 wird ein
geschaltet, und wenn ein 5-Volt-Signal Vin in den 2-Pegel-Aus
gangsinverter 10 eingespeist wird und die Ausgangssignale out_H
und out_L abgegeben werden, so wird der PMOS-Transistor P3 einge
schaltet, und der NMOS-Transistor N3 wird ausgeschaltet, wodurch
Spannungen von -10 Volt und 10 Volt abgegeben werden, wie dies in
Fig. 6 gezeigt ist.
Fig. 6 veranschaulicht insbesondere, daß das Ausgangssignal out1
auf -10 Volt bzw. 10 Volt abhängig von den Ausgangssignalen out_H
und out_L von dem 2-Pegel-Ausgangsinverter verschoben ist.
Wenn der Absolutwert der Schwellenspannung 7 Volt überschreitet,
wird, da das Ausgangssignal out1 von dem 2-Pegel-Eingangsinverter
20 von -10 Volt nach -8 Volt bezüglich des 0-Volt-Eingangssigna
les Vin und das Ausgangssignal out1 hiervon von 10 Volt nach
8 Volt bezüglich des 5-Volt-Eingangssignales Vin verschoben ist,
wie dies in Fig. 6 gezeigt ist, das Signal jeweils nach 10 Volt
und -10 Volt mittels des Inverters 30 invertiert und dann durch
den Inverter 40 invertiert, wodurch es möglich ist, eine große
Lastvorrichtung anzusteuern.
Wie oben erläutert ist, ist in dem erfindungsgemäßen, von einer
Schwellenspannungsänderung unabhängigen Pegelschieber ein MOS-
Transistor vorgesehen, der zum Messen einer Schwellenspannung Vtn
des NMOS-Transistors angeordnet ist und als ein Spannungsvertei
ler dient, wobei der Pegelschieber in normaler Weise betrieben
ist, selbst wenn die Pegelspannung von 2 Volt bis maximal 7 Volt
reicht, und zusätzlich ist es möglich, Ausgangsspannungen von
-10 Volt und 10 Volt mittels Spannungen von 0 Volt und 5 Volt zu
erhalten, ohne eine zusätzliche Spannung oder ein invertiertes
Signal zu verwenden.
Claims (6)
1. Von Schwellenspannungsänderung unabhängiger Pegelschieber,
umfassend:
einen 2-Pegel-Ausgangsinverter (10) zum Erzeugen eines Ansteuer signales für einen NMOS-Transistor (N1) und einen PMOS-Transistor (P1) unabhängig von einer Schwellenspannungsänderung bezüglich Eingangsspannungen von 0 Volt und 5 Volt,
einen 2-Pegel-Eingangsinverter (20) zum Ansteuern des PMOS-Tran sistors (P1) und des NMOS-Transistors (N1) abhängig von einem Ansteuersignal von dem 2-Pegel-Ausgangsinverter (10) und zum Ausgeben eines Signales, dessen Pegel so stark wie eine Schwel lenspannung bei Spannungen von -10 Volt und 10 Volt reduziert ist, und
einen Inverter (40) zum Ausgeben der Ausgangssignale von dem 2-Pegel-Eingangsinverter (20) als Spannungssignale von -10 Volt und 10 Volt.
einen 2-Pegel-Ausgangsinverter (10) zum Erzeugen eines Ansteuer signales für einen NMOS-Transistor (N1) und einen PMOS-Transistor (P1) unabhängig von einer Schwellenspannungsänderung bezüglich Eingangsspannungen von 0 Volt und 5 Volt,
einen 2-Pegel-Eingangsinverter (20) zum Ansteuern des PMOS-Tran sistors (P1) und des NMOS-Transistors (N1) abhängig von einem Ansteuersignal von dem 2-Pegel-Ausgangsinverter (10) und zum Ausgeben eines Signales, dessen Pegel so stark wie eine Schwel lenspannung bei Spannungen von -10 Volt und 10 Volt reduziert ist, und
einen Inverter (40) zum Ausgeben der Ausgangssignale von dem 2-Pegel-Eingangsinverter (20) als Spannungssignale von -10 Volt und 10 Volt.
2. Pegelschieber nach Anspruch 1, dadurch gekennzeichnet, daß
der 2-Pegel-Ausgangsinverter (10) aufweist:
einen PMOS-Transistor (P1), der in Reihe zwischen einem Versor gungsanschluß von 10 Volt und einem Versorgungsanschluß von -10 Volt liegt, und
ein Übertragungsgatter (TG) mit einem NMOS-Transistor (N1) und einem PMOS-Transistor (P2) sowie einen NMOS-Transistor (N2), wobei die Gates des PMOS-Transistors (P1) und des NMOS-Transi stors (N1) jeweils gemeinsam mit einem ersten Eingangsanschluß und die Gates des NMOS-Transistors (N2) und des PMOS-Transistors (P2) jeweils gemeinsam mit einem zweiten Eingangsanschluß ver bunden sind.
einen PMOS-Transistor (P1), der in Reihe zwischen einem Versor gungsanschluß von 10 Volt und einem Versorgungsanschluß von -10 Volt liegt, und
ein Übertragungsgatter (TG) mit einem NMOS-Transistor (N1) und einem PMOS-Transistor (P2) sowie einen NMOS-Transistor (N2), wobei die Gates des PMOS-Transistors (P1) und des NMOS-Transi stors (N1) jeweils gemeinsam mit einem ersten Eingangsanschluß und die Gates des NMOS-Transistors (N2) und des PMOS-Transistors (P2) jeweils gemeinsam mit einem zweiten Eingangsanschluß ver bunden sind.
3. Pegelschieber nach Anspruch 2, dadurch gekennzeichnet, daß
der NMOS-Transistor (N2) als ein Spannungsverteiler wirkt, wenn
ein 0-Volt-Eingangssignal (Vin) eingespeist ist, und zum Messen
einer Schwellenspannung (Vtn) vorgesehen ist, wenn ein 5-Volt-
Eingangssigal (Vin) anliegt.
4. Pegelschieber nach einem der Ansprüche 1 bis 3, dadurch ge
kennzeichnet, daß der 2-Pegel-Eingangsinverter (20) in Reihe zwi
schen dem Versorgungsanschluß von 10 Volt und dem Versorgungsan
schluß von -10 Volt liegt und einen PMOS-Transistor (P3) sowie
einen NMOS-Transistor (N3) aufweist, deren Gates durch Ausgangs
signale (out_H und out_L) von dem 2-Pegel-Ausgangsinverter (10)
angesteuert sind.
5. Pegelschieber nach Anspruch 4, dadurch gekennzeichnet, daß
der PMOS-Transistor (P3) durch ein Ausgangssignal (out_H), das
niedriger ist als eine Schwellenspannung des PMOS-Transistors
(P3) bezüglich eines 0-Volt-Eingangssignales (Vin) eingeschaltet
wird, und daß der PMOS-Transistor (P3) durch ein Ausgangssignal
(out_H), das höher als eine Schwellenspannung des PMOS-Transi
stors (P3) ist, bezüglich eines 5-Volt-Eingangssignales einge
schaltet wird.
6. Pegelschieber nach Anspruch 4, dadurch gekennzeichnet, daß
der NMOS-Transistor (N3) durch ein Ausgangssignal (out_L), das
höher als eine Schwellenspannung des NMOS-Transistors (N3) ist,
bezüglich eines 0-Volt-Eingangssignales (Vin) eingeschaltet wird,
und daß der NMOS-Transistor (N3) durch ein Ausgangssignal
(out_H), das niedriger als eine Schwellenspannung des NMOS-Tran
sistors (N3) ist, bezüglich eines 5-Volt-Eingangssignales (Vin)
ausgeschaltet wird.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019970000565A KR100273206B1 (ko) | 1997-01-11 | 1997-01-11 | 문턱전압 변화에 둔감한 레벨쉬프터 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE19800578A1 true DE19800578A1 (de) | 1998-07-23 |
DE19800578C2 DE19800578C2 (de) | 2003-03-20 |
Family
ID=19494469
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19800578A Expired - Fee Related DE19800578C2 (de) | 1997-01-11 | 1998-01-09 | Pegelschieber |
Country Status (6)
Country | Link |
---|---|
US (1) | US6043679A (de) |
JP (1) | JP3089552B2 (de) |
KR (1) | KR100273206B1 (de) |
DE (1) | DE19800578C2 (de) |
GB (1) | GB2321145B (de) |
TW (1) | TW359028B (de) |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2000223586A (ja) | 1999-02-02 | 2000-08-11 | Oki Micro Design Co Ltd | 半導体集積回路 |
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GB2349997A (en) * | 1999-05-12 | 2000-11-15 | Sharp Kk | Voltage level converter for an active matrix LCD |
JP2002370348A (ja) * | 2001-06-15 | 2002-12-24 | Canon Inc | 記録ヘッド用基板、記録ヘッド並びに記録装置 |
KR100476453B1 (ko) * | 2002-11-19 | 2005-03-17 | 삼성전자주식회사 | 레벨 쉬프터 |
KR100518558B1 (ko) * | 2003-02-18 | 2005-10-04 | 삼성전자주식회사 | 피크전류가 적은 레벨 쉬프터 |
KR101039027B1 (ko) * | 2004-12-13 | 2011-06-07 | 삼성전자주식회사 | 레벨 시프터 및 이를 포함하는 표시 장치 |
KR101230313B1 (ko) * | 2006-07-05 | 2013-02-06 | 재단법인서울대학교산학협력재단 | 레벨 시프터 및 그의 구동 방법 |
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US10802566B1 (en) * | 2017-07-06 | 2020-10-13 | Synopsys, Inc. | Two-part interface PHY for system-on-chip devices |
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JPH01305616A (ja) * | 1988-06-02 | 1989-12-08 | Toshiba Corp | 半導体集積回路の出力回路 |
KR100236876B1 (ko) * | 1990-03-28 | 2000-01-15 | 가나이 쓰도무 | 신호의 스윙을 저감하는 cmos 회로 |
JPH06152341A (ja) * | 1992-10-30 | 1994-05-31 | Nec Corp | バッファリング回路 |
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-
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-
1998
- 1998-01-08 US US09/004,333 patent/US6043679A/en not_active Expired - Lifetime
- 1998-01-08 GB GB9800395A patent/GB2321145B/en not_active Expired - Fee Related
- 1998-01-09 DE DE19800578A patent/DE19800578C2/de not_active Expired - Fee Related
- 1998-01-09 JP JP10003094A patent/JP3089552B2/ja not_active Expired - Fee Related
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---|---|
GB9800395D0 (en) | 1998-03-04 |
DE19800578C2 (de) | 2003-03-20 |
US6043679A (en) | 2000-03-28 |
GB2321145A (en) | 1998-07-15 |
KR19980065534A (ko) | 1998-10-15 |
JP3089552B2 (ja) | 2000-09-18 |
JPH10209852A (ja) | 1998-08-07 |
KR100273206B1 (ko) | 2000-12-15 |
GB2321145B (en) | 1999-02-17 |
TW359028B (en) | 1999-05-21 |
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8304 | Grant after examination procedure | ||
8364 | No opposition during term of opposition | ||
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee | ||
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Effective date: 20140801 |