DE102016115006B4 - Middle-end-of-line streifen für standardzelle - Google Patents
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- 229910052751 metal Inorganic materials 0.000 claims abstract description 209
- 239000002184 metal Substances 0.000 claims abstract description 209
- 239000004065 semiconductor Substances 0.000 claims abstract description 71
- 239000004020 conductor Substances 0.000 claims abstract description 67
- 238000000034 method Methods 0.000 claims description 21
- 238000009413 insulation Methods 0.000 claims description 4
- 238000002955 isolation Methods 0.000 description 12
- 230000015572 biosynthetic process Effects 0.000 description 6
- 230000003071 parasitic effect Effects 0.000 description 4
- 239000000758 substrate Substances 0.000 description 4
- 230000003247 decreasing effect Effects 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 230000005611 electricity Effects 0.000 description 2
- 229910021332 silicide Inorganic materials 0.000 description 2
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
- 239000012777 electrically insulating material Substances 0.000 description 1
- 238000005538 encapsulation Methods 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 229910001092 metal group alloy Inorganic materials 0.000 description 1
- 238000001465 metallisation Methods 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 230000036651 mood Effects 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 230000008054 signal transmission Effects 0.000 description 1
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 229910052814 silicon oxide Inorganic materials 0.000 description 1
- 125000006850 spacer group Chemical group 0.000 description 1
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- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
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- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
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Abstract
Halbleiterstruktur, umfassend:einen ersten aktiven Bereich (161);eine erste Leiterbahn (111);eine erste leitende Durchkontaktierung (121);eine zweite leitende Durchkontaktierung (122);ein erstes leitendes Metallsegment (131), das mit der ersten Leiterbahn (111) über die erste leitende Durchkontaktierung (121) verbunden ist;ein zweites leitendes Metallsegment (132), das über dem ersten aktiven Bereich (161) angeordnet und mit der ersten Leiterbahn (111) über die zweite leitende Durchkontaktierung (122) verbunden ist; undein erstes lokales leitendes Segment (141), das so konfiguriert ist, dass es das erste leitende Metallsegment (131) und das zweite leitende Metallsegment (132) verbindet;und ferner umfassend:einen zweiten aktiven Bereich (162);eine zweite Leiterbahn (114);eine dritte leitende Durchkontaktierung (123);eine vierte leitende Durchkontaktierung (124);ein drittes leitendes Metallsegment (134), das mit der zweiten Leiterbahn (114) über die dritte leitende Durchkontaktierung (123) verbunden ist;ein viertes leitendes Metallsegment (135), das über dem zweiten aktiven Bereich (163) angeordnet und mit der zweiten Leiterbahn (114) über die vierte leitende Durchkontaktierung (124) verbunden ist; undein zweites lokales leitendes Segment (142), das so konfiguriert ist, dass es das dritte leitende Metallsegment (134) und das vierte leitende Metallsegment (135) verbindet.
Description
- HINTERGRUND
- Die Herstellung von integrierten Halbleiter-Schaltungen (ICs) umfasst zum Beispiel Front-End-of-Line-(FEOL)-, Middle-End-of-Line-(MEOL)- und Back-End-of-Line-(BEOL)-Prozesse. Üblicherweise werden während FEOL-Prozesse Halbleiterstrukturen auf einem Halbleiterwafer ausgebildet. Die Halbleiterstrukturen werden dann lokal während der MEOL-Verfahren miteinander verbunden, um die integrierten Schaltungen auszubilden.
- Die
US 6 404 023 B1 beschreibt ein Halbleiterbauteil mit Source/Drain-Bereichen, die über Durchkontaktierungen mit einer Verbindungsschicht gekoppelt sind. DieDE 10 2014 111 829 A1 beschreibt ein Halbleitermodul, mit mehreren Chips auf einem Träger, die verkapselt sind. Durchkontaktierungen erstrecken sich durch die Verkapselung und verbinden die Chips mit einer Metallisierungsschicht. - Die Erfindung sieht eine Halbleiterstruktur gemäß Anspruch 1, eine Halbleiterstruktur gemäß Anspruch 8 und ein Verfahren gemäß Anspruch 16 vor. Ausgestaltungen sind in den abhängigen Ansprüchen angegeben.
- Figurenliste
- Aspekte der vorliegenden Offenbarung werden am besten aus der folgenden detaillierten Beschreibung verstanden, wenn sie mit den beigefügten Zeichnungen gelesen wird. Man beachte, dass in Übereinstimmung mit dem üblichen Vorgehen in der Branche verschiedene Elemente nicht maßstabsgetreu gezeichnet sind. Tatsächlich können die Abmessungen der verschiedenen Elemente zur Klarheit der Diskussion beliebig vergrößert oder verkleinert werden.
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1 ist eine Draufsicht eines schematischen Layouts einer Halbleiterstruktur in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
2 ist eine Schnittansicht, die entlang einer Linie2-2 in1 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
3 ist eine Schnittansicht, die entlang einer Linie3-3 in1 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
4 ist eine Perspektivansicht eines Teils der Halbleiterstruktur von1 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
5 ist eine Draufsicht eines schematischen Layouts einer Halbleiterstruktur in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
6 ist eine Perspektivansicht eines Teils der Halbleiterstruktur von5 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
7 ist eine Draufsicht eines schematischen Layouts einer Halbleiterstruktur in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; -
8 ist eine Schnittansicht, die entlang einer Linie8-8 in7 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung; und -
9 ist eine Schnittansicht, die entlang einer Linie9-9 in7 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. - DETAILLIERTE BESCHREIBUNG
- Die folgende Offenbarung sieht viele verschiedene Ausführungsformen oder Beispiele vor, um verschiedene Einrichtungen des vorgesehenen Gegenstands zu implementieren. Spezielle Beispiele von Komponenten und Anordnungen sind unten beschrieben, um die vorliegende Offenbarung zu vereinfachen. Das Ausbilden einer ersten Einrichtung über oder auf einer zweiten Einrichtung in der folgenden Beschreibung kann beispielsweise Ausführungsformen umfassen, in denen die erste und die zweite Einrichtung in direktem Kontakt ausgebildet sind, und kann auch Ausführungsformen umfassen, in denen zusätzliche Einrichtungen zwischen der ersten Einrichtung und der zweiten Einrichtung ausgebildet sein können, so dass die erste und die zweite Einrichtung nicht in direktem Kontakt sein müssen. Zusätzlich kann die vorliegende Offenbarung Bezugszeichen und/oder Buchstaben in den verschiedenen Beispielen wiederholen. Diese Wiederholung dient dem Zweck der Einfachheit und Klarheit und erzwingt an sich keine Beziehung zwischen den verschiedenen beschriebenen Ausführungsformen und/oder Konfigurationen.
- Die in dieser Beschreibung verwendeten Begriffe haben in der Regel ihre gewöhnlichen Bedeutungen in der Technik und im spezifischen Kontext, in dem die Begriffe verwendet werden. Zudem ist die vorliegende Offenbarung nicht auf die verschiedenen Ausführungsformen beschränkt, die in dieser Beschreibung angegeben sind.
- Obwohl die Begriffe „erster“, „zweiter“ etc. hierin verwendet werden können, um verschiedene Elemente zu beschreiben, sollen diese Elemente nicht durch diese Ausdrücke eingeschränkt sein. Diese Begriffe werden verwendet, um ein Element von einem anderen zu unterscheiden. Ein erstes Element könnte beispielsweise als zweites Element bezeichnet werden, und analog könnte ein zweites Element als erstes Element bezeichnet werden. Wie hier verwendet, umfasst der Ausdruck „und/oder“ alle Kombinationen von einem oder mehreren der zugehörigen aufgeführten Gegenstände.
- Die Herstellung von integrierten Halbleiter-Schaltungen (ICs) umfasst zum Beispiel Front-End-of-Line-(FEOL)-, Middle-End-of-Line-(MEOL)- und Back-End-of-Line-(BEOL)-Prozesse. Der FEOL-Prozess umfasst beispielsweise Wafer-Herstellung, Isolierung, Wannen-Ausbildung, Gatestrukturierung, Abstandshalter, Erweiterungs- und Source/Drain-Implantation, Silizid-Ausbildung und das Ausbilden von Dual Stress Linern. Der MEOL-Prozess umfasst beispielsweise das Ausbilden von Gatekontakten. Der BEOL-Prozess umfasst beispielsweise eine Reihe von Waferverarbeitungsschritten zum Verbinden der Halbleiterstrukturen unter einander, die während der FEOL- und MEOL-Prozesse ausgebildet wurden. Einige Teile von Layouts von Halbleiterstrukturen in den folgenden Ausführungsformen der vorliegenden Offenbarung gehören beispielsweise zu dem MEOL-Prozess und/oder werden darin ausgebildet.
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1 ist eine Draufsicht eines schematischen Layouts einer Halbleiterstruktur100 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. In einigen Ausführungsformen stellt die Halbleiterstruktur100 eine Standardzelle dar. „Standardzelle“ steht in einigen Ausführungsformen für eine vorher entworfene Zelle, die schon entworfen und in einer Schaltungsbibliothek gespeichert wurde, die in Form einer Datenbank vorliegt. Weiter wird in einigen Ausführungsformen die Standardzelle in einem physischen Speichermedium gespeichert, das beispielsweise eine Festplatte umfasst. Beim Entwurf der integrierten Schaltungen wird die Standardzelle von der Schaltungsbibliothek abgerufen und in einem Anordnungsvorgang angeordnet. Der Anordnungsvorgang wird beispielsweise unter Verwendung eines Computers durchgeführt, der die Software zum Entwerfen von integrierten Schaltungen ausführt. Die Software umfasst ein Schaltungs-Layoutwerkzeug, das Aufgaben des Anordnens und Routings hat. - In einigen Ausführungsformen wird die Halbleiterstruktur
100 von1 verwendet, die unten detailliert beschrieben ist, um Transistoren auszubilden, die beispielsweise Fin-Feldeffekttransistoren (FinFETs), planare Transistoren oder dergleichen umfassen. In weiteren Ausführungsformen bilden die Transistoren, die mit der Halbleiterstruktur100 ausgebildet sind, eine komplementäre Metall-Oxid-Halbleiter-(CMOS)-Vorrichtung. Als Beispiel umfasst die Halbleiterstruktur100 einen n-Typ-Metall-Oxid-Halbleiter-(NMOS)-Transistor und/oder einen p-Typ-Metall-Oxid-Halbleiter-(PMOS)-Transistor. - Die Komponenten der Halbleiterstruktur
100 , wie unten beschrieben ist, sind in einigen Ausführungsformen über einem Halbleitersubstrat angeordnet, das zur Vereinfachung der Darstellung nicht in1 gezeigt ist. Das Halbleitersubstrat ist ein Siliziumsubstrat oder ein anderes geeignetes Halbleitersubstrat. - Als Beispiel umfasst in
1 die Halbleiterstruktur100 aktive Bereiche161 und162 . In einigen Ausführungsformen ist der aktive Bereich161 ein aktiver p-Typ-Bereich und der aktive Bereich162 ein aktiver n-Typ-Bereich. Der aktive p-Typ-Bereich ist so angeordnet, dass er PMOS-Transistoren bildet, und der aktive n-Typ-Bereich ist so angeordnet, dass er NMOS-Transistoren bildet. - Die aktiven Bereiche
161 und162 sind zum Zweck der Beschreibung angegeben. In einigen Ausführungsformen wird der in der vorliegenden Offenbarung verwendete Ausdruck „aktiver Bereich“ auch als „OD“ (Oxid-begrenzter Bereich) bezeichnet. - Wie in
1 gezeigt ist, umfasst die Halbleiterstruktur100 auch Gates151 bis154 . Das Gate151 ist über dem aktiven Bereich161 angeordnet, das Gate152 ist über dem aktiven Bereich162 angeordnet und die beiden Gates153 und154 sind über den aktiven Bereichen161 und162 angeordnet. Als Beispiel sind die Gates151 bis154 parallel zueinander angeordnet und haben einen gleichen Abstand. - In einigen Ausführungsformen sind die Gates
151 bis154 aus Polysilizium ausgebildet. Daher wird der in der vorliegenden Offenbarung verwendete Begriff „Gate“ in einigen Ausführungsformen auch als „PO“ bezeichnet. Zum Ausbilden der Gates151 bis154 können verschiedene leitende Materialien verwendet werden. Als Beispiel sind in verschiedenen Ausführungsformen die Gates151 bis154 aus Metallen, Metalllegierungen, Metallsiliziden oder Ähnlichem ausgebildet. - Als Beispiel sind in
1 die Gates151 und154 über gegenüberliegenden Rändern des aktiven Bereichs161 angeordnet und bedecken sie. Die Gates152 und154 sind über gegenüberliegenden Rändern des aktiven Bereichs162 angeordnet und bedecken sie. Daher werden die Gates151 ,152 und154 in einigen Ausführungsformen auch als „PODE“ („Poly auf OD-Rand“) bezeichnet. - In einigen Ausführungsformen sind in den aktiven Bereichen
161 und162 Bereiche an gegenüberliegenden Seiten des Gates153 jeweils Source/Drain-Bereiche. Der Begriff „Source/Drain-Bereich“ wird in der vorliegenden Offenbarung für einen Bereich verwendet, der ein Source-Bereich oder ein Drain-Bereich ist. - In einigen Ausführungsformen ist mindestens eines der Gates
151 ,152 und154 als Dummy-Gate angeordnet. Das Dummy-Gate dient nicht als Gate für einen Transistor. - Wie in
1 gezeigt ist, umfasst die Halbleiterstruktur100 auch leitende Metallsegmente131 bis136 . Die leitenden Metallsegmente132 und133 sind über dem aktiven Bereich161 angeordnet. Die leitenden Metallsegmente135 und136 sind über dem aktiven Bereich162 angeordnet. Das leitende Metallsegment132 ist zwischen den leitenden Metallsegmenten131 und133 angeordnet. Das leitende Metallsegment135 ist zwischen den leitenden Metallsegmenten134 und136 angeordnet. In einigen Ausführungsformen wird der in der vorliegenden Offenbarung verwendete Ausdruck „leitendes Metallsegment“ auch als „MOOD“ oder „MD“ bezeichnet. - In einigen Ausführungsformen ist die Höhe von mindestens einem der leitenden Metallsegmente
131 und134 größer als die Höhe von mindestens einem der leitenden Metallsegmente132 ,133 ,135 ,136 . In weiteren Ausführungsformen ist die Höhe aller leitenden Metallsegmente131 und134 größer als die Höhe aller leitenden Metallsegmente132 ,133 ,135 ,136 . - In einigen Ausführungsformen sind die leitenden Metallsegmente
131 und134 auf flachen Grabenisolations-(STI)-Strukturen (nicht gezeigt) ausgebildet. Die STI-Strukturen werden in einigen Ausführungsformen ausgebildet, indem Siliziumoxid verwendet wird, um flache Gräben zur Isolation zu füllen. Das Ausbilden der leitenden Metallsegmente131 und134 , wie oben beschrieben, wird zum Zweck der Beschreibung angegeben. - Wie in
1 gezeigt ist, umfasst die Halbleiterstruktur100 auch Leiterbahnen111 bis114 . In einigen Ausführungsformen sind die Leiterbahnen111 bis114 aus Metall ausgebildet. - Als Beispiel sind die Leiterbahnen
111 bis114 parallel zueinander angeordnet. Die Leiterbahn111 ist über Teilen der Gates151 ,153 ,154 und der leitenden Metallsegmente131 ,132 angeordnet. Die Leiterbahn114 ist über Teilen der Gates152 ,153 ,154 und der leitenden Metallsegmente134 ,135 angeordnet. Die Leiterbahn113 ist über Teilen des aktiven Bereichs162 , der Gates152 ,153 ,154 und der leitenden Metallsegmente134 ,135 ,136 angeordnet. Die Leiterbahn112 überquert das Gate153 . - In einigen Ausführungsformen ist die Leiterbahn
112 über eine leitende Durchkontaktierung125 mit dem Gate153 verbunden. Im Endeffekt ist die Leiterbahn112 so konfiguriert, dass sie ein Signal empfängt und das Signal über die leitende Durchkontaktierung125 an das Gate153 überträgt. - In einigen Ausführungsformen ist die Leiterbahn
111 eine Stromversorgungsleitung. Die Stromversorgungsleitung ist so konfiguriert, dass sie als Beispiel mit einer Stromquelle VDD gekoppelt ist. In einigen Ausführungsformen ist die Leiterbahn114 eine Erdleitung. Die Erdleitung ist so konfiguriert, dass sie als Beispiel mit einer Erde VSS gekoppelt ist. - Die Leiterbahn
111 ist über eine leitende Durchkontaktierung122 und das leitende Metallsegment132 mit dem Source/Drain-Bereich in dem aktiven Bereich161 verbunden. Daher gibt es einen Strompfad (in4 mit410 gekennzeichnet) zwischen der Leiterbahn111 und dem leitenden Metallsegment132 . Die Leiterbahn111 ist auch über eine leitende Durchkontaktierung121 mit dem leitenden Metallsegment131 verbunden. - Die Leiterbahn
114 ist über eine leitende Durchkontaktierung124 und das leitende Metallsegment135 mit dem Source/Drain-Bereich in dem aktiven Bereich162 verbunden. Daher gibt es einen Strompfad zwischen der Leiterbahn114 und dem leitenden Metallsegment135 . Die Leiterbahn114 ist auch über eine leitende Durchkontaktierung123 mit dem leitenden Metallsegment134 verbunden. - Wie in
1 gezeigt ist, umfasst die Halbleiterstruktur100 weiter lokale leitende Segmente141 und142 . Als Beispiel überquert das lokale leitende Segment141 das Gate151 und ist zwischen den leitenden Metallsegmenten131 und132 angeordnet, um die leitenden Metallsegmente131 und132 zu verbinden. Das lokale leitende Segment142 überquert das Gate152 und ist zwischen den leitenden Metallsegmenten134 und135 angeordnet, um die leitenden Metallsegmente134 und135 zu verbinden. In einigen Ausführungsformen wird der in der vorliegenden Offenbarung verwendete Ausdruck „lokales leitendes Segment“ auch als „MP“ bezeichnet. - In einigen Ausführungsformen ist das lokale leitende Segment
141 mit dem Gate151 und/oder das lokale leitende Segment142 mit dem Gate152 verbunden. - In einigen Ausführungsformen ist die Höhe des lokalen leitenden Segments
141 plus der Höhe des Gates151 im Wesentlichen gleich der Höhe des leitenden Metallsegments132 , wie in3 gezeigt ist. Analog ist in einigen Ausführungsformen die Höhe des lokalen leitenden Segments142 plus der Höhe des Gates152 im Wesentlichen gleich der Höhe des leitenden Metallsegments135 , wie in3 gezeigt ist. - Das lokale leitende Segment
141 ist so konfiguriert, dass es die leitenden Metallsegmente131 und132 elektrisch verbindet. In einigen Ausführungsformen steht ein Ende des lokalen leitenden Segments141 in Kontakt mit dem leitenden Metallsegment131 und ein gegenüberliegendes Ende des lokalen leitenden Segments141 in Kontakt mit dem leitenden Metallsegment132 . In einigen weiteren Ausführungsformen weist das lokale leitende Segment141 gegenüberliegende Enden auf, die in den leitenden Metallsegmenten131 und132 angeordnet sind. Daher sind die leitenden Metallsegmente131 und132 miteinander durch das lokale leitende Segment141 elektrisch verbunden. Im Ergebnis gibt es einen zusätzlichen Strompfad (in4 mit 420 gekennzeichnet) zwischen den leitenden Metallsegmenten131 und132 . - Das lokale leitende Segment
142 ist so konfiguriert, dass es die leitenden Metallsegmente134 und135 elektrisch verbindet. In einigen Ausführungsformen steht ein Ende des lokalen leitenden Segments142 in Kontakt mit dem leitenden Metallsegment134 und ein gegenüberliegendes Ende des lokalen leitenden Segments142 in Kontakt mit dem leitenden Metallsegment135 . In einigen weiteren Ausführungsformen weist das lokale leitende Segment142 gegenüberliegende Enden auf, die in den leitenden Metallsegmenten134 und135 angeordnet sind. Daher sind die leitenden Metallsegmente134 und135 miteinander durch das lokale leitende Segment142 elektrisch verbunden. Im Ergebnis gibt es einen weiteren zusätzlichen Strompfad zwischen den leitenden Metallsegmenten134 und135 . - In einigen Ausführungsformen gehört mindestens eine der Leiterbahnen
111 bis114 , der leitenden Durchkontaktierungen121 bis125 , der leitenden Metallsegmente131 bis136 und der lokalen leitenden Segmente141 und142 der Halbleiterstruktur100 zu dem MEOL-Prozess und/oder wird in ihm ausgebildet. Daher umfasst in einigen Ausführungsformen ein MEOL-Stromstreifen die Leiterbahn111 , die leitenden Durchkontaktierungen121 ,122 , die leitenden Metallsegmente131 ,132 und das lokale leitende Segment141 , wodurch die vorgenannten zwei Strompfade für den Stromtransport bereitgestellt werden. -
2 ist eine Schnittansicht, die entlang einer Linie2-2 in1 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung.3 ist eine Schnittansicht, die entlang einer Linie3-3 in1 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. Mit Bezug auf die Ausführungsformen von1 sind gleiche Elemente in2 und3 zur Erleichterung des Verständnisses mit den gleichen Bezugszeichen bezeichnet. - Als Beispiel ist in
1 und2 in einer Abfolge von oben nach unten die Leiterbahn111 durch die leitende Durchkontaktierung121 mit dem leitenden Metallsegment131 verbunden. Ein Teil des lokalen leitenden Segments141 ist innerhalb des leitenden Metallsegments131 angeordnet. - Als Beispiel sind in
1 und3 die gegenüberliegenden Enden des lokalen leitenden Segments141 innerhalb der leitenden Metallsegmente131 bzw.132 angeordnet. Die Höhe des leitenden Metallsegments131 ist größer als die Höhe des leitenden Metallsegments132 . Die Höhe des lokalen leitenden Segments141 plus der Höhe des Gates151 ist im Wesentlichen gleich der Höhe des leitenden Metallsegments132 , wie in3 gezeigt ist. - In einigen Ausführungsformen entsprechen die Beziehungen und/oder Konfigurationen der Leiterbahn
114 , der leitenden Durchkontaktierung123 , der leitenden Metallsegmente134 und135 , des Gates152 und des aktiven Bereichs162 denen, die in2 und3 gezeigt sind, und werden hier der Einfachheit der Beschreibung willen nicht weiter ausgeführt. - In einigen Ausführungsformen ist die obere Fläche des lokalen leitenden Segments
141 im Wesentlichen an der oberen Fläche der leitenden Metallsegmente131 und132 ausgerichtet, wie in3 gezeigt ist. -
4 ist eine Perspektivansicht eines Teils der Halbleiterstruktur100 von1 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. Zum besseren Verständnis ist4 mit Bezugnahme auf2 und3 beschrieben. - Wie oben beschrieben, gibt es als Beispiel in
4 einen Strompfad410 zwischen der Leiterbahn111 und dem leitenden Metallsegment132 . In dem Strompfad410 fließt der Strom von der Leiterbahn111 durch die leitende Durchkontaktierung122 und das leitende Metallsegment132 zu dem aktiven Bereich161 . - Weiter gibt es einen zusätzlichen Strompfad
420 zwischen der Leiterbahn111 und dem leitenden Metallsegment132 . In dem zusätzlichen Strompfad420 fließt der Strom von der Leiterbahn111 durch die leitende Durchkontaktierung141 , das leitende Metallsegment131 , das lokale leitende Segment141 und das leitende Metallsegment132 zu dem aktiven Bereich161 . - Durch den zusätzlichen Strompfad
420 erhöht sich der Stromfluss in der Halbleiterstruktur100 . Durch den höheren Stromfluss hat ein erhöhter Ersatzwiderstand zwischen dem aktiven Bereich161 und der Leiterbahn111 weniger Auswirkungen auf die Leistungsfähigkeit der Halbleiterstruktur100 . Daher kann die Betriebsgeschwindigkeit der Vorrichtungen erhöht werden, die durch die Halbleiterstruktur100 implementiert werden. - Analog gibt es einen zusätzlichen Strompfad, der zu der Leiterbahn
114 , der leitenden Durchkontaktierung123 , den leitenden Metallsegmenten134 und135 , dem lokalen leitenden Segment142 und dem aktiven Bereich162 gehört, und dies wird hier der Einfachheit der Beschreibung willen nicht weiter ausgeführt. Entsprechend hat ein erhöhter Ersatzwiderstand zwischen dem aktiven Bereich162 und der Leiterbahn114 weniger Auswirkungen auf die Leistungsfähigkeit der Halbleiterstruktur100 . Daher kann die Betriebsgeschwindigkeit der Vorrichtungen auch erhöht werden, die durch die Halbleiterstruktur100 implementiert werden. -
5 ist eine Draufsicht eines schematischen Layouts einer Halbleiterstruktur500 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. Mit Bezug auf die Ausführungsformen von1 sind gleiche Elemente in5 mit den gleichen Bezugszeichen bezeichnet und werden hier der Einfachheit der Beschreibung halber nicht weiter ausgeführt. Verglichen mit der Halbleiterstruktur100 in1 sind in einigen Ausführungsformen die leitenden Durchkontaktierungen122 und124 in1 in der Halbleiterstruktur500 in5 nicht vorgesehen und die leitenden Metallsegmente132 und135 in1 durch leitende Metallsegmente532 und535 ersetzt. - Verglichen mit dem leitenden Metallsegment
132 in1 ist das leitende Metallsegment532 , wie in5 gezeigt, über dem aktiven Bereich161 angeordnet, ohne sich in Längsrichtung so zu erstrecken, dass es mit der Leiterbahn111 verbunden werden kann. Tatsächlich ist die Länge des leitenden Metallsegments532 in5 kleiner als die Länge des leitenden Metallsegments132 in1 . Im Ergebnis wird die parasitäre Kapazität (in6 als630 gekennzeichnet) zwischen dem leitenden Metallsegment532 und dem Gate153 verringert. - In einigen Ausführungsformen ist die Länge des leitenden Metallsegments
532 im Wesentlichen gleich der Länge des leitenden Metallsegments133 . In verschiedenen Ausführungsformen ist die Höhe des leitenden Metallsegments532 im Wesentlichen gleich der Höhe des leitenden Metallsegments133 . - Verglichen mit dem leitenden Metallsegment
135 in1 ist das leitende Metallsegment535 , wie in5 gezeigt, über dem aktiven Bereich162 angeordnet, ohne sich in Längsrichtung so zu erstrecken, dass es mit der Leiterbahn114 verbunden werden kann. So ist die Länge des leitenden Metallsegments535 in5 kleiner als die Länge des leitenden Metallsegments135 in1 . Im Ergebnis wird die parasitäre Kapazität zwischen dem leitenden Metallsegment535 und dem Gate153 verringert. - In einigen Ausführungsformen ist die Länge des leitenden Metallsegments
535 im Wesentlichen gleich der Länge des leitenden Metallsegments136 . In verschiedenen Ausführungsformen ist die Höhe des leitenden Metallsegments535 im Wesentlichen gleich der Höhe des leitenden Metallsegments136 . - In einigen Ausführungsformen gehört mindestens eine der Leiterbahnen
111 bis114 , der leitenden Durchkontaktierungen121 ,123 ,125 , der leitenden Metallsegmente131 ,133 ,134 ,136 ,532 ,535 und der lokalen leitenden Segmente141 ,142 der Halbleiterstruktur500 zu dem MEOL-Prozesse und/oder wird in ihm ausgebildet. Daher umfasst in einigen Ausführungsformen ein MEOL-Stromstreifen die Leiterbahn111 , die leitenden Durchkontaktierung121 , die leitenden Metallsegmente131 ,532 und das lokale leitende Segment141 , wodurch ein Strompfad für den Stromtransport (in6 als 610 gekennzeichnet) bereitgestellt wird. -
6 ist eine Perspektivansicht eines Teils der Halbleiterstruktur500 von5 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. Als Beispiel gibt es in6 einen Strompfad610 zwischen der Leiterbahn111 und dem leitenden Metallsegment532 . In dem Strompfad610 fließt der Strom von der Leiterbahn111 durch die leitende Durchkontaktierung121 , das leitende Metallsegment131 , das lokale leitende Segment141 und das leitende Metallsegment532 zu dem aktiven Bereich161 , wie in5 gezeigt ist. - Wie oben beschrieben, hat das leitende Metallsegment
532 , verglichen mit dem leitenden Metallsegment132 in4 , eine relativ kurze Länge, um die parasitäre Kapazität630 zwischen dem leitenden Metallsegment532 und dem Gate153 zu verringern. Daher kann die Leistungsfähigkeit der Vorrichtungen erhöht werden, die durch die Halbleiterstruktur500 implementiert werden. - Analog gibt es einen Strompfad, der zu der Leiterbahn
114 , der leitenden Durchkontaktierung123 , den leitenden Metallsegmenten134 und535 , dem lokalen leitenden Segment142 und dem aktiven Bereich162 gehört, und dies wird hier der Einfachheit der Beschreibung willen nicht weiter ausgeführt. Entsprechend hat das leitende Metallsegment535 eine relativ kurze Länge, um die parasitäre Kapazität zwischen dem leitenden Metallsegment535 und dem Gate153 zu verringern. Daher kann die Leistungsfähigkeit der Vorrichtungen auch erhöht werden, die durch die Halbleiterstruktur500 implementiert werden. -
7 ist eine Draufsicht eines schematischen Layouts einer Halbleiterstruktur700 in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. Mit Bezug auf die Ausführungsformen von1 und5 sind gleiche Elemente in7 mit den gleichen Bezugszeichen bezeichnet und werden hier der Einfachheit der Beschreibung halber nicht weiter ausgeführt. Verglichen mit den in1 und5 gezeigten Ausführungsformen weist die Halbleiterstruktur700 in7 ein anderes Layout auf, das unten beschrieben wird. - Wie in
7 gezeigt, umfasst die Halbleiterstruktur700 leitende Metallsegmente731 ,734 ,737 und738 . Der aktive Bereich161 ist zwischen den leitenden Metallsegmenten731 und737 angeordnet. Der aktive Bereich162 ist zwischen den leitenden Metallsegmenten734 und738 angeordnet. In einigen Ausführungsformen ist, verglichen mit den Ausführungsformen in5 , die Länge der leitenden Metallsegmente131 und/oder134 größer als die Länge der leitenden Metallsegmente731 und/oder734 und die leitenden Metallsegmente737 und738 sind zusätzlich angeordnet. - In einigen Ausführungsformen ist die Höhe von mindestens einem der leitenden Metallsegmente
731 ,734 ,737 und738 größer als die Höhe von mindestens einem der leitenden Metallsegmente133 ,136 ,532 und535 in5 . In weiteren Ausführungsformen ist die Höhe aller leitenden Metallsegmente731 ,734 ,737 und738 größer als die Höhe aller leitenden Metallsegmente133 ,136 ,532 ,535 . - In einigen Ausführungsformen sind die leitenden Metallsegmente
731 ,734 ,737 und738 auf flachen Grabenisolations-(STI)-Strukturen (nicht gezeigt) ausgebildet. Das Ausbilden der leitenden Metallsegmente731 ,734 ,737 und738 , wie oben beschrieben, wird zum Zweck der Beschreibung angegeben. - Als Beispiel ist in
7 das lokale leitende Segment141 zwischen den leitenden Metallsegmenten731 und532 angeordnet, um die leitenden Metallsegmente731 und532 zu verbinden. Das lokale leitende Segment142 ist zwischen den leitenden Metallsegmenten734 und535 angeordnet, um die leitenden Metallsegmente734 und535 zu verbinden. - In einigen Ausführungsformen ist die Höhe des lokalen leitenden Segments
141 plus der Höhe des Gates151 im Wesentlichen gleich der Höhe des leitenden Metallsegments532 , wie in9 gezeigt ist. Analog ist in einigen Ausführungsformen die Höhe des lokalen leitenden Segments142 plus der Höhe des Gates152 im Wesentlichen gleich der Höhe des leitenden Metallsegments535 . - Das lokale leitende Segment
141 ist so konfiguriert, dass es die leitenden Metallsegmente731 und532 elektrisch verbindet. In einigen Ausführungsformen steht ein Ende des lokalen leitenden Segments141 in Kontakt mit dem leitenden Metallsegment731 und ein gegenüberliegendes Ende des lokalen leitenden Segments141 in Kontakt mit dem leitenden Metallsegment532 . In einigen weiteren Ausführungsformen weist das lokale leitende Segment141 gegenüberliegende Enden auf, die in den leitenden Metallsegmenten731 und532 angeordnet sind, wie in9 gezeigt ist. - Entsprechend ist das lokale leitende Segment
142 so konfiguriert, dass es die leitenden Metallsegmente734 und535 elektrisch verbindet. In einigen Ausführungsformen steht ein Ende des lokalen leitenden Segments142 in Kontakt mit dem leitenden Metallsegment734 und ein gegenüberliegendes Ende des lokalen leitenden Segments142 in Kontakt mit dem leitenden Metallsegment535 . In einigen weiteren Ausführungsformen weist das lokale leitende Segment142 gegenüberliegende Enden auf, die in den leitenden Metallsegmenten734 und535 angeordnet sind. - Wie in
7 gezeigt, umfasst, verglichen mit den Ausführungsformen in5 , die Halbleiterstruktur700 Leiterbahnen711 bis716 . Als Beispiel sind die Leiterbahnen711 bis716 parallel zu der Leiterbahn112 angeordnet. In einigen Ausführungsformen sind die Leiterbahnen711 bis716 aus Metall ausgebildet. - Als Beispiel sind die Leiterbahnen
711 bis716 parallel zu der Leiterbahn112 angeordnet. Die Leiterbahn711 ist über Teilen der Gates151 ,153 und154 angeordnet. Die Leiterbahn714 ist über Teilen der Gates152 ,153 und154 angeordnet. Die Leiterbahn712 ist in einer Linie mit der Leiterbahn713 angeordnet. Die Leiterbahn712 ist über Teilen des leitenden Metallsegments731 , des Gates151 und des aktiven Bereichs161 angeordnet. Die Leiterbahn713 ist über Teilen des aktiven Bereichs161 , der leitenden Metallsegmente133 und737 und der Gates153 und154 angeordnet. Die Leiterbahn715 ist in einer Linie mit der Leiterbahn716 angeordnet. Die Leiterbahn715 ist über Teilen des leitenden Metallsegments734 , des Gates152 und des aktiven Bereichs162 angeordnet. Die Leiterbahn716 ist über Teilen des aktiven Bereichs162 , der leitenden Metallsegmente136 und738 und der Gates153 und154 angeordnet. - In einigen Ausführungsformen ist die Leiterbahn
713 über eine leitende Durchkontaktierung722 mit dem leitenden Metallsegment133 verbunden. So ist die Leiterbahn713 so konfiguriert, dass sie ein von den leitenden Metallsegmenten133 ausgegebenes Signal überträgt. In einigen Ausführungsformen ist die Leiterbahn716 über eine leitende Durchkontaktierung724 mit den leitenden Metallsegmenten136 verbunden. So ist die Leiterbahn716 so konfiguriert, dass sie ein von den leitenden Metallsegmenten136 ausgegebenes Signal überträgt. - In einigen Ausführungsformen ist die Leiterbahn
712 eine Stromversorgungsleitung. Die Stromversorgungsleitung ist so konfiguriert, dass sie als Beispiel mit einer Stromquelle VDD verbunden ist. In einigen Ausführungsformen ist die Leiterbahn715 eine Erdleitung. Die Erdleitung ist so konfiguriert, dass sie als Beispiel mit einer Erde VSS verbunden ist. - Als Beispiel ist die Leiterbahn
712 über eine leitende Durchkontaktierung721 , das lokale leitende Segment141 und das leitende Metallsegment532 mit dem Source/Drain-Bereich in dem aktiven Bereich161 verbunden. Daher gibt es einen Strompfad zwischen der Leiterbahn712 und dem leitenden Metallsegment532 . - Als Beispiel ist die Leiterbahn
715 über eine leitende Durchkontaktierung723 , das lokale leitende Segment142 und das leitende Metallsegment535 mit dem Source/Drain-Bereich in dem aktiven Bereich162 verbunden. Daher gibt es einen Strompfad zwischen der Leiterbahn715 und dem leitenden Metallsegment535 . - In einigen Ausführungsformen gehört mindestens eine der Leiterbahnen
711 bis716 , der leitenden Durchkontaktierungen721 bis724 , der leitenden Metallsegmente133 ,136 ,532 ,535 ,731 ,734 ,737 ,738 und der lokalen leitenden Segmente141 ,142 der Halbleiterstruktur700 zu dem MEOL-Verfahren und/oder wird in ihm ausgebildet. Daher umfasst in einigen Ausführungsformen ein MEOL-Stromstreifen die Leiterbahn712 , die leitende Durchkontaktierung721 , die leitenden Metallsegmente731 ,532 und das lokale leitende Segment141 , wodurch der vorgenannte Strompfad für Strom- und/oder Signalübertragung bereitgestellt wird. - Wie in
7 gezeigt ist, umfasst die Halbleiterstruktur700 in einigen Ausführungsformen auch Isolationssegmente771 und772 . Als Beispiel ist das Isolationssegment771 zwischen der Leiterbahn712 und der Leiterbahn713 angeordnet. Daher sind in einigen Ausführungsformen die Leiterbahn712 und die Leiterbahn713 durch das Isolationssegment771 elektrisch voneinander isoliert. Das Isolationssegment772 ist zwischen der Leiterbahn715 und der Leiterbahn716 angeordnet. Daher sind in einigen Ausführungsformen die Leiterbahn715 und die Leiterbahn716 durch das Isolationssegment772 elektrisch voneinander isoliert. - In einigen Ausführungsformen sind die Isolationssegmente
771 und772 aus elektrisch isolierenden Materialien ausgebildet, während die Leiterbahnen712 ,713 ,715 und716 aus Metall ausgebildet sind. Daher wird in einigen Ausführungsformen der in der vorliegenden Offenbarung verwendete Ausdruck „Isolationssegment“ auch als „CutMetal“ bezeichnet. - In einigen Ausführungsformen ist die leitende Durchkontaktierung
721 direkt über dem leitenden Metallsegment731 angeordnet. Daher gibt es genügend Platz für das Ausbilden des Isolationssegments771 , um die Leiterbahn712 und die Leiterbahn713 zu trennen. - In einigen Ausführungsformen ist das Isolationssegment
771 direkt über dem leitenden Metallsegment532 angeordnet, wie in9 gezeigt ist. Entsprechend ist in einigen Ausführungsformen das Isolationssegment772 direkt über dem leitenden Metallsegment535 angeordnet. -
8 ist eine Schnittansicht, die entlang einer Linie8-8 in7 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung.9 ist eine Schnittansicht, die entlang einer Linie9-9 in7 genommen ist, in Übereinstimmung mit einigen Ausführungsformen der vorliegenden Offenbarung. Mit Bezug auf die Ausführungsformen von7 sind gleiche Elemente in8 und9 zur Erleichterung des Verständnisses mit den gleichen Bezugszeichen bezeichnet. - Als Beispiel ist in
7 und8 in einer Abfolge von oben nach unten die Leiterbahn712 durch die leitende Durchkontaktierung721 mit dem lokalen leitenden Segment141 verbunden. Ein Teil des lokalen leitenden Segments141 ist innerhalb des leitenden Metallsegments731 angeordnet. - Als Beispiel sind in
7 und9 die gegenüberliegenden Enden des lokalen leitenden Segments141 innerhalb der leitenden Metallsegmente731 bzw.532 angeordnet. Das untere Ende der leitenden Durchkontaktierung721 steht in Kontakt mit dem leitenden Metallsegment731 und dem lokalen leitenden Segment141 . Die Höhe des leitenden Metallsegments731 ist größer als die Höhe des leitenden Metallsegments532 . Die Höhe des lokalen leitenden Segments141 plus der Höhe des Gates151 ist im Wesentlichen gleich der Höhe des leitenden Metallsegments532 , wie in9 gezeigt ist. - In einigen Ausführungsformen ist die obere Fläche des lokalen leitenden Segments
141 im Wesentlichen an der oberen Fläche der leitenden Metallsegmente731 und532 ausgerichtet, wie in9 gezeigt ist. - In einigen Ausführungsformen ist die obere Fläche der Leiterbahnen
712 und713 im Wesentlichen an der oberen Fläche des leitenden Metallsegments771 ausgerichtet, wie in9 gezeigt ist. - In einigen Ausführungsformen entsprechen die Beziehungen und/oder Konfigurationen der Leiterbahn
715 , der leitenden Durchkontaktierung723 , der leitenden Metallsegmente734 und535 , des Gates152 und des aktiven Bereichs162 denen, die in8 und9 gezeigt sind, und werden hier der Einfachheit der Beschreibung willen nicht weiter ausgeführt. - In einigen Ausführungsformen ist eine Halbleiterstruktur offenbart, die einen ersten aktiven Bereich, eine erste Leiterbahn, eine erste leitende Durchkontaktierung, eine zweite leitende Durchkontaktierung, ein erstes leitendes Metallsegment, das mit der ersten Leiterbahn über die erste leitende Durchkontaktierung verbunden ist, ein zweites leitendes Metallsegment, das über dem ersten aktiven Bereich angeordnet und mit der ersten Leiterbahn über die zweite leitende Durchkontaktierung verbunden ist, und ein erstes lokales leitendes Segment umfasst, das so konfiguriert ist, dass es das erste leitende Metallsegment und das zweite leitende Metallsegment verbindet.
- Weiter ist eine Halbleiterstruktur offenbart, die einen aktiven Bereich, eine erste Leiterbahn, eine leitende Durchkontaktierung, ein erstes leitendes Metallsegment, das mit der Leiterbahn über die leitende Durchkontaktierung verbunden ist, ein zweites leitendes Metallsegment, das über dem aktiven Bereich angeordnet ist, und ein lokales leitendes Segment umfasst, das so konfiguriert ist, dass es das erste leitende Metallsegment und das zweite leitende Metallsegment verbindet.
- Weiter ist ein Prozess offenbart, der das Anordnen eines ersten leitenden Metallsegments; das Anordnen eines zweiten leitenden Metallsegments über einem aktiven Bereich; das Anordnen eines lokalen leitenden Segments zum Verbinden des ersten leitenden Metallsegments und des zweiten leitenden Metallsegments; das Anordnen einer ersten leitenden Durchkontaktierung auf dem ersten leitenden Metallsegment; und das Anordnen einer ersten Leiterbahn umfasst, die mit dem ersten leitenden Metallsegment über die erste leitende Durchkontaktierung verbunden ist.
Claims (20)
- Halbleiterstruktur, umfassend: einen ersten aktiven Bereich (161); eine erste Leiterbahn (111); eine erste leitende Durchkontaktierung (121); eine zweite leitende Durchkontaktierung (122); ein erstes leitendes Metallsegment (131), das mit der ersten Leiterbahn (111) über die erste leitende Durchkontaktierung (121) verbunden ist; ein zweites leitendes Metallsegment (132), das über dem ersten aktiven Bereich (161) angeordnet und mit der ersten Leiterbahn (111) über die zweite leitende Durchkontaktierung (122) verbunden ist; und ein erstes lokales leitendes Segment (141), das so konfiguriert ist, dass es das erste leitende Metallsegment (131) und das zweite leitende Metallsegment (132) verbindet; und ferner umfassend: einen zweiten aktiven Bereich (162); eine zweite Leiterbahn (114); eine dritte leitende Durchkontaktierung (123); eine vierte leitende Durchkontaktierung (124); ein drittes leitendes Metallsegment (134), das mit der zweiten Leiterbahn (114) über die dritte leitende Durchkontaktierung (123) verbunden ist; ein viertes leitendes Metallsegment (135), das über dem zweiten aktiven Bereich (163) angeordnet und mit der zweiten Leiterbahn (114) über die vierte leitende Durchkontaktierung (124) verbunden ist; und ein zweites lokales leitendes Segment (142), das so konfiguriert ist, dass es das dritte leitende Metallsegment (134) und das vierte leitende Metallsegment (135) verbindet.
- Halbleiterstruktur nach
Anspruch 1 , weiter umfassend: ein Gate (151), das über dem aktiven Bereich (161) und unter dem ersten lokalen leitenden Segment (141) angeordnet ist. - Halbleiterstruktur nach
Anspruch 2 , wobei das Gate (151) zwischen dem ersten leitenden Metallsegment (131) und dem zweiten leitenden Metallsegment (132) angeordnet ist. - Halbleiterstruktur nach
Anspruch 2 oder3 , wobei die Summe der Höhe des ersten lokalen leitenden Segments (141) und der Höhe des Gates (151) im Wesentlichen gleich der Höhe des zweiten leitenden Metallsegments (132) ist. - Halbleiterstruktur nach einem der vorhergehenden Ansprüche, wobei die Höhe des ersten leitenden Metallsegments (131) größer als die Höhe des zweiten leitenden Metallsegments (132) ist.
- Halbleiterstruktur nach einem der vorhergehenden Ansprüche, wobei ein Strompfad (410, 420) von der ersten Leiterbahn (111) durch die zweite leitende Durchkontaktierung (122) zu dem zweiten Metallsegment gebildet wird und ein weiterer Strompfad (410, 420, 610) von der ersten Leiterbahn (111) durch die erste leitende Durchkontaktierung (121), das erste leitende Metallsegment (131) und das lokale leitende Segment (141) zu dem zweiten leitenden Metallsegment (132) gebildet wird.
- Halbleiterstruktur nach einem der vorhergehenden Ansprüche, wobei: die erste Leiterbahn (111) und das erste lokale leitende Segment (141) an gegenüberliegenden Enden der ersten leitenden Durchkontaktierung (121) angeordnet sind.
- Halbleiterstruktur, umfassend: einen aktiven Bereich (161); eine erste Leiterbahn (111); eine leitende Durchkontaktierung (121); ein erstes leitendes Metallsegment (131), das mit der ersten Leiterbahn (111) über die leitende Durchkontaktierung (121) verbunden ist; ein zweites leitendes Metallsegment (132), das über dem aktiven Bereich (161) angeordnet ist; und ein lokales leitendes Segment (141), das so konfiguriert ist, dass es das erste leitende Metallsegment (131) und das zweite leitende Metallsegment (132) verbindet wobei die erste Leiterbahn (111) und das lokale leitende Segment (141) an gegenüberliegenden Enden der ersten leitenden Durchkontaktierung (121) angeordnet werden.
- Halbleiterstruktur nach
Anspruch 8 , weiter umfassend: ein Gate (151), das über dem aktiven Bereich (161) und unter dem lokalen leitenden Segment (141) angeordnet ist. - Halbleiterstruktur nach
Anspruch 9 , wobei das Gate (151) zwischen dem ersten leitenden Metallsegment (131) und dem zweiten leitenden Metallsegment (132) angeordnet ist. - Halbleiterstruktur nach einem der
Ansprüche 8 bis10 , wobei die Höhe des ersten leitenden Metallsegments (131) größer als die Höhe des zweiten leitenden Metallsegments (132) ist. - Halbleiterstruktur nach einem der
Ansprüche 8 bis11 , wobei die Länge des zweiten leitenden Metallsegments (132) kleiner als die Länge des ersten leitenden Metallsegments (131) ist. - Halbleiterstruktur nach einem der
Ansprüche 8 bis12 , wobei ein Strompfad (410, 420, 610) von der ersten Leiterbahn (111) durch die erste leitende Durchkontaktierung (121), das erste leitende Metallsegment (131) und das lokale leitende Segment (141) zu dem zweiten leitenden Metallsegment (132) gebildet ist. - Halbleiterstruktur nach einem der
Ansprüche 8 bis13 , wobei ein Ende der leitenden Durchkontaktierung (121) in Kontakt mit der ersten Leiterbahn (111) steht und ein anderes Ende der leitenden Durchkontaktierung (121) in Kontakt mit einem Teil des ersten leitenden Metallsegments (131) und einem Ende des lokalen leitenden Segments steht. - Halbleiterstruktur nach einem der
Ansprüche 8 bis14 , weiter umfassend: ein Isolationssegment (771), das über dem zweiten leitenden Metallsegment (132) angeordnet ist, um die erste Leiterbahn (111) von einer zweiten Leiterbahn zu isolieren. - Verfahren, umfassend: Anordnen eines ersten leitenden Metallsegments (131); Anordnen eines zweiten leitenden Metallsegments (132) über einem aktiven Bereich (161); Anordnen eines lokalen leitenden Segments (141) zum Verbinden des ersten leitenden Metallsegments (131) und des zweiten leitenden Metallsegments (132); Anordnen einer ersten leitenden Durchkontaktierung (121) auf dem ersten leitenden Metallsegment (131); Anordnen einer ersten Leiterbahn (111), die mit dem ersten leitenden Metallsegment über die erste leitende Durchkontaktierung (121) verbunden ist; und Anordnen eines Gates (151) über dem aktiven Bereich (161), unter dem lokalen leitenden Segment und zwischen dem ersten leitenden Metallsegment (131) und dem zweiten leitenden Metallsegment (132).
- Verfahren nach
Anspruch 16 , weiter umfassend: Anordnen einer zweiten leitenden Durchkontaktierung (122) auf dem zweiten leitenden Metallsegment (132), wobei die erste Leiterbahn (111) mit der zweiten leitenden Durchkontaktierung (122) verbunden ist. - Verfahren nach
Anspruch 16 oder17 , wobei die erste Leiterbahn (111) und das lokale leitende Segment (141) an gegenüberliegenden Enden der ersten leitenden Durchkontaktierung (121) angeordnet werden. - Verfahren nach einem der
Ansprüche 16 bis18 , wobei die Höhe des ersten leitenden Metallsegments (131) größer als die Höhe des zweiten leitenden Metallsegments (132) ist. - Verfahren nach einem der
Ansprüche 16 bis19 , weiter umfassend: Anordnen eines Isolationssegments (771) über dem zweiten leitenden Metallsegment (132), um die erste Leiterbahn (111) von einer zweiten Leiterbahn zu isolieren.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US15/058,077 US9837353B2 (en) | 2016-03-01 | 2016-03-01 | Middle end-of-line strap for standard cell |
US15/058,077 | 2016-03-01 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102016115006A1 DE102016115006A1 (de) | 2017-09-07 |
DE102016115006B4 true DE102016115006B4 (de) | 2021-07-01 |
Family
ID=59650568
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102016115006.1A Active DE102016115006B4 (de) | 2016-03-01 | 2016-08-12 | Middle-end-of-line streifen für standardzelle |
Country Status (5)
Country | Link |
---|---|
US (6) | US9837353B2 (de) |
KR (1) | KR101931415B1 (de) |
CN (1) | CN107146782B (de) |
DE (1) | DE102016115006B4 (de) |
TW (1) | TWI640076B (de) |
Families Citing this family (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10325845B2 (en) * | 2017-06-21 | 2019-06-18 | Qualcomm Incorporated | Layout technique for middle-end-of-line |
EP3723127A1 (de) | 2019-04-10 | 2020-10-14 | IMEC vzw | Standardzellenvorrichtung und verfahren zum bilden einer verbindungsstruktur für eine standardzellenvorrichtung |
US11735592B2 (en) * | 2019-12-20 | 2023-08-22 | Samsung Electronics Co., Ltd. | Integrated circuit including integrated standard cell structure |
US11854786B2 (en) | 2021-02-12 | 2023-12-26 | Taiwan Semiconductor Manufacturing Company, Ltd. | Deep lines and shallow lines in signal conducting paths |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6404023B1 (en) * | 2000-01-14 | 2002-06-11 | Seiko Epson Corporation | Semiconductor device having gate-gate, drain-drain, and drain-gate connecting layers and method of fabricating the same |
DE102014111829A1 (de) * | 2013-08-23 | 2015-02-26 | Infineon Technologies Ag | Ein Halbleitermodul und ein Verfahren zu dessen Fabrikation durch erweiterte Einbettungstechnologien |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100215887B1 (ko) | 1996-12-06 | 1999-08-16 | 구본준 | 에스램 셀 및 그 제조방법 |
US20020125027A1 (en) * | 2000-05-12 | 2002-09-12 | Thomas & Betts International, Inc. | Ground expansion joint coupling |
JP3467699B2 (ja) * | 2001-03-26 | 2003-11-17 | セイコーエプソン株式会社 | 半導体装置、メモリシステムおよび電子機器 |
JP3656592B2 (ja) * | 2001-03-26 | 2005-06-08 | セイコーエプソン株式会社 | 半導体装置、メモリシステムおよび電子機器 |
JP2002359299A (ja) * | 2001-03-26 | 2002-12-13 | Seiko Epson Corp | 半導体装置、メモリシステムおよび電子機器 |
JP2006228954A (ja) * | 2005-02-17 | 2006-08-31 | Matsushita Electric Ind Co Ltd | 半導体装置とそのレイアウト設計方法 |
US7414275B2 (en) * | 2005-06-24 | 2008-08-19 | International Business Machines Corporation | Multi-level interconnections for an integrated circuit chip |
JP5703105B2 (ja) | 2011-04-15 | 2015-04-15 | 株式会社東芝 | 半導体装置及びその製造方法 |
US8987831B2 (en) | 2012-01-12 | 2015-03-24 | Taiwan Semiconductor Manufacturing Company, Ltd. | SRAM cells and arrays |
JP5830400B2 (ja) * | 2012-02-02 | 2015-12-09 | ルネサスエレクトロニクス株式会社 | 半導体装置、および半導体装置の製造方法 |
-
2016
- 2016-03-01 US US15/058,077 patent/US9837353B2/en active Active
- 2016-07-26 TW TW105123610A patent/TWI640076B/zh active
- 2016-08-12 DE DE102016115006.1A patent/DE102016115006B4/de active Active
- 2016-10-13 KR KR1020160132829A patent/KR101931415B1/ko active IP Right Grant
-
2017
- 2017-02-28 CN CN201710114441.8A patent/CN107146782B/zh active Active
- 2017-11-17 US US15/817,119 patent/US10204857B2/en active Active
-
2019
- 2019-01-31 US US16/264,622 patent/US10879173B2/en active Active
-
2020
- 2020-12-23 US US17/133,264 patent/US11532553B2/en active Active
-
2022
- 2022-12-12 US US18/064,910 patent/US20230113294A1/en active Pending
- 2022-12-12 US US18/064,907 patent/US20230103578A1/en active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6404023B1 (en) * | 2000-01-14 | 2002-06-11 | Seiko Epson Corporation | Semiconductor device having gate-gate, drain-drain, and drain-gate connecting layers and method of fabricating the same |
DE102014111829A1 (de) * | 2013-08-23 | 2015-02-26 | Infineon Technologies Ag | Ein Halbleitermodul und ein Verfahren zu dessen Fabrikation durch erweiterte Einbettungstechnologien |
Also Published As
Publication number | Publication date |
---|---|
US10204857B2 (en) | 2019-02-12 |
TW201742228A (zh) | 2017-12-01 |
TWI640076B (zh) | 2018-11-01 |
KR101931415B1 (ko) | 2018-12-20 |
US20170256484A1 (en) | 2017-09-07 |
DE102016115006A1 (de) | 2017-09-07 |
KR20170102410A (ko) | 2017-09-11 |
US20230113294A1 (en) | 2023-04-13 |
US20190164883A1 (en) | 2019-05-30 |
US10879173B2 (en) | 2020-12-29 |
US20180096930A1 (en) | 2018-04-05 |
CN107146782A (zh) | 2017-09-08 |
US9837353B2 (en) | 2017-12-05 |
CN107146782B (zh) | 2020-03-31 |
US20210118793A1 (en) | 2021-04-22 |
US11532553B2 (en) | 2022-12-20 |
US20230103578A1 (en) | 2023-04-06 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final |