DE102015119345B4 - Halbleiterfeldplatte für verbindungshalbleiterbauelemente - Google Patents
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Abstract
Transistor, der aufweist:eine Source (108);ein Drain (110), das von der Source (108) beabstandet ist;einen Heterostrukturkörper (102) mit einem zweidimensionalen Ladungsträgergaskanal (118) zum Verbinden der Source (108) und des Drain (110); undeine Halbleiterfeldplatte (100, 200), die zwischen der Source (108) und dem Drain (110) angeordnet ist, wobei die Halbleiterfeldplatte (100, 200) dazu ausgebildet ist, Ladungen in dem Drain (110) wenigstens teilweise zu kompensieren, wenn sich der Transistor in einem Aus-Zustand befindet, in dem der Kanal (118) unterbrochen ist und eine Sperrspannung an den Drain (110) angelegt ist, wobeidie durch die Halbleiterfeldplatte (100, 200) bereitgestellte Kompensationsladung über eine Ebene oder ein Volumen der Halbleiterfeldplatte (100, 200) gleichmäßig verteilt ist;der Heterostrukturkörper (102) einen ersten III-Nitrid-Halbleiter (120) und einen zweiten III-Nitrid-Halbleiter (122) auf dem ersten III-Nitrid-Halbleiter (120) aufweist, wobei der zweite III-Nitrid-Halbleiter (122) einen anderen Bandabstand besitzt als der erste III-Nitrid-Halbleiter (120), so dass der zweidimensionale Ladungsträgergaskanal (118) entlang einer Grenzfläche zwischen dem ersten und zweiten III-Nitrid-Halbleiter (120, 122) entsteht;die Halbleiterfeldplatte (100) ein dotiertes Gebiet (116) des ersten III-Nitrid-Halbleiters (120) aufweist, das p-dotiert ist;der Heterostrukturkörper (102) einen dritten III-Nitrid-Halbleiter (202) auf dem zweiten III-Nitrid-Halbleiter (122) aufweist und die Halbleiterfeldplatte (200) ein dotiertes Gebiet (204) des dritten III-Nitrid-Halbleiters (202) aufweist, das p-dotiert ist.
Description
- TECHNISCHES GEBIET
- Die vorliegende Anmeldung betrifft Verbindungshalbleiterbauelemente, insbesondere Feldplatten für Verbindungshalbleiterbauelemente.
- HINTERGRUND
- Mit Gateelektroden, die aus hochleitenden Materialien wie etwa Metallen, Siliziden oder stark dotiertem Polysilizium bestehen, die zwischen der Source- und Drainelektrode positioniert sind, wird der zweidimensionale Ladungsträgergaskanal in Halbleiterbauelementen mit großem Bandabstand auf der Basis von GaN- oder GaAs-Schichten gesteuert. Die Gateelektroden bilden typischerweise eine Schottky-Diode auf dem zweidimensionalen Ladungsträgergaskanal oder sind von dem zweidimensionalen Ladungsträgergaskanal durch ein Isoliermaterial wie etwa SiO2 und/oder eine dünne GaN- oder AlGaN-Schicht getrennt. Durch Anlegen einer negativen Spannung an das Gate wird der darunterliegende zweidimensionale Ladungsträgergaskanal unterbrochen und folglich befindet sich der Transistor in einem Blockierzustand.
- Bei GaN-HEMTs (High-Electron-Mobility-Transistoren) hängt die Nettoladung der Gate- oder Feldelektrode nur von der Kapazität der Elektrode bezüglich ihrer Umgebung und der angelegten Spannung ab. Falls eine Sperrspannung an die Drainelektrode angelegt wird, wird fast die ganze Spiegelladung in Form freier Elektronen auf der Feldelektrode bereitgestellt. Die Spiegelladung kompensiert die entgegengesetzte Ladung, die sich innerhalb des Drains im Transistorblockierzustand aufbaut, um innerhalb des Bauelements ein elektrisches Gleichgewicht herbeizuführen. Falls keine Feldelektrode vorliegt, wird die gesamte Spiegelladung auf der Gateelektrode bereitgestellt. Wegen der stark mobilen Natur von freien Elektronen in Metallen ist die Spiegelladung fast vollständig auf der der Drainelektrode zugewandten Seite der Elektrode (Feld- oder Gateelektrode) positioniert. Die Spiegelladungen konzentrieren sich fast auf einen Punkt an dem Drainrand der Elektrode und verursachen sehr hohe elektrische Feldspitzen insbesondere zum Drainrand der Elektrode hin. Diese hohen elektrischen Feldspitzen bewirken die Injektion von Ladungsträgern in benachbarte Isolierschichten beziehungsweise Grenzflächen zwischen Schichten aus verschiedenen Materialien, wodurch das statische und dynamische elektrische Verhalten des Transistors geändert wird. Solche Einfangeffekte sind dem Bauelementbetrieb abträglich.
- Die
DE 10 2012 224 047 A1 offenbart ein Verbindungshalbleiterbauelement mit vergrabener Feldplatte. - ÜBERBLICK
- Gemäß einer Ausführungsform eines Transistors umfasst der Transistor eine Source, einen von der Source beabstandeten Drain, einen Heterostrukturkörper und eine Halbleiterfeldplatte. Der Heterostrukturkörper umfasst einen zweidimensionalen Ladungsträgergaskanal zum Verbinden der Source und des Drains. Die Halbleiterfeldplatte ist zwischen der Source und dem Drain angeordnet. Die Halbleiterfeldplatte ist dazu ausgebildet, Ladungen in dem Drain mindestens teilweise zu kompensieren, wenn sich der Transistor in einem Aus-Zustand befindet, in dem der Kanal unterbrochen ist und eine Sperrspannung an den Drain angelegt ist. Die durch die Halbleiterfeldplatte bereitgestellte Kompensation ist über eine Ebene oder ein Volumen der Halbleiterfeldplatte gleichmäßig verteilt. Der Heterostrukturkörper umfasst einen ersten III-Nitrid-Halbleiter und einen zweiten III-Nitrid-Halbleiter auf dem ersten III-Nitrid-Halbleiter, wobei der zweite III-Nitrid-Halbleiter einen anderen Bandabstand besitzt als der erste III-Nitrid-Halbleiter, so dass der zweidimensionale Ladungsträgergaskanal entlang einer Grenzfläche zwischen dem ersten und zweiten III-Nitrid-Halbleiter entsteht. Die Halbleiterfeldplatte weist ein dotiertes Gebiet des ersten III-Nitrid-Halbleiters auf, das p-dotiert ist. Der Heterostrukturkörper weist einen dritten III-Nitrid-Halbleiter auf dem zweiten III-Nitrid-Halbleiter auf, und die Halbleiterfeldplatte weist ein dotiertes Gebiet des dritten III-Nitrid-Halbleiters auf, das p-dotiert ist.
- Der Fachmann erkennt bei der Lektüre der folgenden ausführlichen Beschreibung und bei der Betrachtung der beiliegenden Zeichnungen zusätzliche Merkmale und Vorteile.
- Figurenliste
- Die Elemente der Zeichnungen sind relativ zueinander nicht notwendigerweise maßstabsgetreu. Gleiche Bezugszahlen bezeichnen entsprechende ähnliche Teile. Die Merkmale der verschiedenen dargestellten Ausführungsformen können kombiniert werden, sofern sie einander nicht ausschließen. Ausführungsformen sind in den Zeichnungen dargestellt und in der Beschreibung, die folgt, detailliert, wobei die
1 ,2 und5 bis7 keine Ausgestaltungen der Erfindung darstellen, allerdings dazu dienen, bestimmte Aspekte der Erfindung zu erläutern. -
1 veranschaulicht eine Draufsicht auf eine nicht erfindungsgemäße Ausführungsform eines Verbindungshalbleitertransistors mit einer Halbleiterfeldplatte mit gleichmäßig verteilten Spiegelladungen. -
2 veranschaulicht eine Schnittansicht des in1 gezeigten Verbindungshalbleitertransistors entlang der mitA-A' bezeichneten Linie. -
3 veranschaulicht eine Schnittansicht einer Ausführungsform eines Verbindungshalbleitertransistors mit zwei Halbleiterfeldplatten mit gleichmäßig verteilten Spiegelladungen. -
4 , die die4A bis4C beinhaltet, veranschaulicht eine Ausführungsform eines Verfahrens zum Herstellen eines Verbindungshalbleitertransistors mit einer Halbleiterfeldplatte mit gleichmäßig verteilten Spiegelladungen. -
5 veranschaulicht eine Draufsicht auf eine nicht erfindungsgemäße Ausführungsform eines Verbindungshalbleitertransistors mit einer Halbleiterfeldplatte mit gleichmäßig verteilten Spiegelladungen. -
6 veranschaulicht eine Schnittansicht des in5 gezeigten Verbindungshalbleitertransistors entlang der mitA-A' bezeichneten Linie. -
7 veranschaulicht eine Schnittansicht des in5 gezeigten Verbindungshalbleitertransistors entlang der mitB-B ' bezeichneten Linie. - AUSFÜHRLICHE BESCHREIBUNG
- Die hierin beschriebenen Ausführungsformen stellen eine Halbleiterfeldplatte bereit, die den Aufbau eines elektrischen Felds in einem Verbindungshalbleitertransistor reduziert, wenn der Transistor ausgeschaltet ist und sich in einem Blockierzustand befindet. Die Feldplatte liefert unbewegliche (feste) Spiegelladungen, die Ladungen von der entgegengesetzten Polarität kompensieren, die sich innerhalb des Drains im Blockierzustand aufbauen. Die Spiegelladungen sind im Fall der hierin beschriebenen Ausführungsform einer dotierten Halbleiterfeldplatte über das Volumen der Feldplatte gleichmäßig verteilt oder über eine Ebene der Feldplatte im Fall der hierin beschriebenen Ausführungsform einer zweidimensionalen Ladungsträgergasfeldplatte.
- In jedem Fall werden bewegliche freie Ladungsträger derart im Blockierzustand aus der Feldplatte herausgezwungen, dass die durch die Feldplatte bereitgestellten übrigen Spiegelladungen im Raum unbeweglich und fest sind. Auf diese Weise wandern die Spiegelladungen nicht zu der dem Drain zugewandten Seiten der Feldplatte, sondern sind vielmehr innerhalb der Feldplatte gleichmäßiger verteilt. Der Ausdruck „Spiegelladungen“, wie er hierin verwendet wird, bezieht sich auf unbewegliche Ladungen, die in der Feldplatte zum Kompensieren von Ladungen der entgegengesetzten Polarität verfügbar sind, die sich im Drain aufbauen, wenn der Transistor ausgeschaltet ist und sich im Blockierzustand befindet. Im Fall eines n-Kanal-Transistors wird der Drain im Blockierzustand positiv geladen und die Spiegelladungen besitzen eine negative Polarität. Im Fall eines p-Kanal-Transistors wird der Drain im Blockierzustand negativ geladen und die Spiegelladungen besitzen eine positive Polarität. In jedem Fall wird eine signifikante Reduktion beim Aufbau eines elektrischen Felds unter Verwendung einer Halbleiterfeldplatte mit gleichmäßig verteilten Spiegelladungen realisiert, die sich im Rand der Feldplatte zum Drain nicht anhäufen.
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1 veranschaulicht eine Draufsicht auf eine nicht erfindungsgemäße Ausführungsform eines Verbindungshalbleitertransistors mit einer Halbleiterfeldplatte100 mit gleichmäßig verteilten Spiegelladungen. Gemäß dieser nicht erfindungsgemäßen Ausführungsform umfasst der Transistor einen Heterostrukturkörper102 , der eine Source104/108 , einen Drain106/110 von der Source104/108 beabstandet, und einen (nicht gezeigten) zweidimensionalen Ladungsträgergaskanal zum (elektrischen) Verbinden der Source104/108 und des Drains106/110 aufweist. Beispielsweise im Fall eines n-Kanal-HEMT sind die Source104/108 und der Drain106/110 über einem zweidimensionalen Kanal für Elektronengas (2DEG) verbunden. Im Fall eines p-Kanal HEMT sind die Source104/108 und der Drain106/110 über einen zweidimensionalen Kanal für Lochgas (2DHG) verbunden. Die Ausdrücke „Source“ und „Drain“, wie hierin verwendet, beziehen sich auf jeweilige dotierte Gebiete104 ,106 des Bauelements und/oder auf jeweilige Source-/Drainelektroden (Kontakte)108 ,110 , falls zum Beispiel keine dotierten Gebiete vorgesehen sind. Beispielsweise besitzen typische HEMTs ohmsche Source- und Drainkontakte (Elektroden)108 ,110 , die auf einer Metalllegierung basieren, die keine zusätzliche Dotierung erfordert. Es besteht auch die Option, das Source- und Draingebiet des Bauelements zum Beispiel mit Si zu dotieren, um ein n+-Gebiet104 ,106 unter dem entsprechenden ohmschen Kontakt108 ,110 zu haben und deshalb den Gesamtkontaktwiderstand zum Beispiel im Fall von Hochspannungstransistoren zu senken. Als solches können sich die Ausdrücke „Source“ und „Drain“ wie sie hierin verwendet werden, genau auf die entsprechende Source-/Drainelektrode (ohmschen Kontakt)108 ,110 , das entsprechende dotierte Source-/Draingebiet104 ,106 , falls vorgesehen, oder beide beziehen. Das Gate114 kann ein planares oder Grabengate in direktem Kontakt mit dem Heterostrukturkörper102 oder von dem Heterostrukturkörper102 elektrisch isoliert sein. - Die Halbleiterfeldplatte
100 ist zwischen der Source104/108 und dem Drain106/110 angeordnet. Die Feldplatte100 besteht aus einem Halbleitermaterial anstatt aus Metall. Die Halbleiterfeldplatte100 kann zum Beispiel über die Sourceelektrode108 elektrisch mit der Source102 verbunden sein und ist dazu ausgebildet, Ladungen im Drain106/110 mindestens teilweisen zu kompensieren, wenn sich der Transistor im Aus-Zustand befindet, d.h. der Kanal unterbrochen ist und eine Sperrspannung an dem Drain106/110 angelegt ist. Im Fall eines n-Kanal-HEMT wird im Blockierzustand eine große positive Spannung (z.B.600 Volt) an den Drain106/110 angelegt. Unter diesen Bedingungen werden mobile freie Ladungsträger aus dem Drain106/110 zur Source104/108 herausgezwungen. Beispielsweise im Fall eines n-Kanal-transistors werden freie Elektronen aus dem Drain106/110 zur Source104/108 herausgezwungen und die festen (unbeweglichen) Atome im Drain106/110 liefern eine positive Nettoladung. Im Fall eines p-Kanaltransistors werden freie Löcher aus dem Drain106/110 zur Source104/108 herausgezwungen und die festen Atome im Drain106/110 ergeben eine negative Nettoladung. - Gleichmäßig verteilte Spiegelladungen in der Halbleiterfeldplatte
100 kompensieren im Blockierzustand die entgegengesetzten Ladungen im Drain106/110 . Diese Spiegelladungen sind im Raum unbeweglich und fest, weil die meisten, wenn nicht alle, der mobilen freien Ladungsträger im Blockierzustand aus der Feldplatte100 herausgezwungen werden, so dass die Feldplatte100 entgegengesetzt zum Drain106/110 geladen wird. Beispielsweise werden im Fall einer p-dotierten Feldplatte100 freie Löcher im Blockierzustand aus der Feldplatte100 herausgezwungen, so dass die Feldplatte negativ geladen wird. Im Fall einer n-dotierten Feldplatte100 werden freie Elektronen im Blockierzustand aus der Feldplatte100 herausgezwungen, so dass die Feldplatte100 positiv geladen wird. Die durch die Halbleiterfeldplatte100 bereitgestellte Ladungskompensation ist je nach der spezifischen Implementierung der Feldplatte100 über eine Ebene oder ein Volumen der Halbleiterfeldplatte100 gleichmäßig verteilt. -
2 ist eine Schnittansicht des Transistors entlang der in1 mitA -A' bezeichneten Linie und veranschaulicht eine Halbleiterfeldplatte100 . Diese umfasst ein dotiertes Gebiet116 des Heterostrukturkörpers102 . Im Fall eines n-Kanal-Bauelements wie gezeigt umfasst die Halbleiterfeldplatte100 ein p-dotiertes Gebiet116 im Heterostrukturkörper102 . Im Fall eines p-Kanal-Bauelements umfasst die Halbleiterfeldplatte100 ein n-dotiertes Gebiet116 im Heterostrukturkörper102 . In beiden Fällen können die Dotierkonzentration und die Größe dieses dotierten Gebiets116 oder mit anderen Worten die Gesamtanzahl aktivierter Donatoratome (Akzeptoratome für ein n-Kanal-Bauelement; Donatoratome für ein p-Kanal-Bauelement) im dotierten Gebiet116 so gewählt werden, dass das dotierte Gebiet116 nicht vollständig verarmt, wenn die größte Sperrspannung an den Drain106/110 angelegt wird. - Im Blockierzustand stammen die durch die Feldplatte
100 bereitgestellten unbeweglichen Spiegelladungen von den Dotierungsatomen im dotierten Gebiet116 des Heterostrukturkörpers102 , die aktiviert wurden, um die Feldplatte100 auszubilden. Weil sich die Dotierungsatome auf Kristallgitterpositionen innerhalb des Heterostrukturkörpers102 befinden, sind sie im Raum fest und deshalb unbeweglich. Wenn mobile freie Ladungsträger im Blockierzustand aus der Feldplatte100 herausgezwungen werden, sind als solches die Spiegelladungen, die übrig bleiben, die Dotierungsatome, die im Raum unbeweglich und fest sind. Diese unbeweglichen Spiegelladungen kompensieren die Ladungen des Drain106 /110 und sind über das Volumen des dotierten Gebiets116 gleichmäßig verteilt. Infolgedessen entstehen signifikant reduzierte größte elektrische Felder im Heterostrukturkörper102 im Blockierzustand im Vergleich zu herkömmlichen Metallelektroden. Das dotierte Gebiet116 der Halbleiterfeldplatte100 kann zum Beispiel über ein anderes dotiertes Gebiet mit der Sourceelektrode108 verbunden sein. Alternativ kann das dotierte Gebiet116 der Halbleiterfeldplatte100 über eine separate metallische Elektrode zur Source104/108 kontaktiert werden. - Das dotierte Gebiet
116 der Halbleiterfeldplatte100 kann in dem Heterostrukturkörper102 unter dem zweidimensionalen Ladungsträgergaskanal118 angeordnet sein, wie in2 gezeigt, wobei der Heterostrukturkörper102 einen ersten III-Nitrid-Halbleiter120 (hier austauschbar auch als eine Pufferschicht bezeichnet) und einen zweiten III-Nitrid-Halbleiter122 (hier auch austauschbar als eine Barriereschicht bezeichnet) auf dem ersten III-Nitrid-Halbleiter120 aufweisen kann. Die Barriereschicht122 kann unter Verwendung eines beliebigen standardmäßigen Epitaxie-Prozesses auf der Pufferschicht120 aufgewachsen werden. Die Barriereschicht122 besitzt einen anderen Bandabstand (bandgap)als die Pufferschicht120 , so dass sich ein zweidimensionales Ladungsträgergas118 entlang der Grenzfläche zwischen der Puffer- und Barriereschicht120 ,122 erstreckt. Das zweidimensionale Ladungsträgergas118 entsteht nahe dem Übergang zwischen den beiden III-Nitrid-Halbleitern120 ,122 und bildet den Kanal118 des Bauelements. Beim Ausdruck „III-Nitrid“ bezieht sich „III“ auf die Gruppe III des Periodensystems der Elemente. „III-Nitrid“ oder „Gruppe-III-Nitrid“ bezieht sich auf einen Verbindungshalbleiter, der Stickstoff (N) und mindestens ein Element der Gruppe III umfasst, einschließlich Aluminium (Al), Gallium (Ga), Indium (In) und Bor (B) und einschließlich unter anderem beliebige ihrer Legierungen wie etwa Aluminiumgalliumnitrid (AlxGa(1-x)N), Indiumgalliumnitrid (InyGa(1-y)N), Aluminiumindiumgalliumnitrid (AlxInyGA(i-x-y)N), Galliumarsenidphosphidnitrid (GaAsaPbN(1-a-b)) und Aluminiumindiumgalliumarsenidphosphidnitrid (AlxInyGA(1-x-y)AsaPbN(1-a-b)), als Beispiel. Aluminiumgalliumnitrid und AlGaN beziehen sich auf eine durch die Formel AlxGa(1-x)N beschriebene Legierung, wobei 0 < x < 1. - Insbesondere bezüglich GaN-Technologie ergeben die Anwesenheit von Polarisationsladungen und Spannungseffekten in einem GaN-basierten Heterostrukturkörper aufgrund einer spontanen und piezoelektrischen Polarisation ein zweidimensionales Ladungsträgergas in dem Heterostrukturkörper, durch eine sehr hohe Trägerdichte und Trägermobilität gekennzeichnet. Dieses zweidimensionale Ladungsträgergas, wie etwa 2DEG oder 2DHG, bildet den leitenden Kanal
118 des Bauelements nahe der Grenzfläche zum Beispiel zwischen einer GaN-Legierungsbarriereschicht122 wie etwa AlGaN oder InAlGaN und einer GaN-Pufferschicht120 . Eine dünne AlN-Schicht von z.B. 1-2 nm kann zwischen der GaN-Pufferschicht120 und der GaN-Legierungsbarriereschicht122 vorgesehen werden, um eine Legierungsstreuung zu minimieren und die 2DEG-Mobiltät zu erhöhen. In einem breiten Sinne kann der hierin beschriebene Verbindungshalbleitertransistor aus einem beliebigen binären, ternären oder quaternären III-Nitrid-Verbindungshalbleitermaterial ausgebildet werden, wobei piezoelektrische Effekte für das Bauelementkonzept verantwortlich sind. Die GaN-Pufferschicht120 kann auf einem Halbleitersubstrat124 wie etwa einem Si- oder SiC-Substrat hergestellt werden, auf dem eine Keimbildungsschicht (Keimschicht)126 wie etwa eine AlN-Schicht ausgebildet werden kann, um eine thermische und Gitteranpassung an die GaN-Pufferschicht120 bereitzustellen. Der Verbindungshalbleitertransistor kann auch AlInN/AlN/GaN-Barrieren-/Abstandshalter-/Pufferschichtstrukturen besitzen. Im Allgemeinen kann der Verbindungshalbleitertransistor unter Verwendung einer beliebigen geeigneten III-Nitrid-Technologie wie etwa GaN realisiert werden, die die Ausbildung von Umkehrungsgebieten entgegengesetzter Polarität aufgrund piezoelektrischer Effekte gestattet. Das Gate114 steuert den leitenden oder nichtleitenden Zustand des zweidimensionalen Ladungsträgergaskanals118 . Der Kanal118 eines normalerweise ausgeschalteten HEMT wird bei Abwesenheit einer an das Gate114 angelegten Spannung unterbrochen und in Anwesenheit einer geeigneten Gatespannung für ein normalerweise eingeschaltetes Bauelement unterbrochen. Der erste III-Nitrid-Halbleiter (Pufferschicht)120 kann GaN umfassen, der zweite III-Nitrid-Halbleiter (Barriereschicht)122 kann AlGaN umfassen und das dotierte Gebiet116 der Halbleiterfeldplatte100 kann p-dotiertes GaN umfassen. - Die Halbleiterfeldplatte
100 kann weiterhin ein intrinsisches (d.h. unbeabsichtigt dotiertes) Gebiet128 des Heterostrukturkörpers102 bei dem dotierten Gebiet116 der Halbleiterfeldplatte100 umfassen, wie in2 gezeigt. Das intrinsische Gebiet128 kann das dotierte Gebiet116 der Halbleiterfeldplatte100 mit dem Drain106/110 verbinden. Allgemein kann das dotierte Gebiet116 der Halbleiterfeldplatte100 über und/oder unter dem zweidimensionalen Ladungsträgergaskanal118 positioniert sein. -
3 veranschaulicht eine Ausführungsform eines Verbindungshalbleitertransistors mit zwei Halbleiterfeldplatten100 ,200 jeweils mit gleichmäßig verteilten Spiegelladungen. Die in3 gezeigte Ausführungsform ist der in2 gezeigten ähnlich, doch umfasst der Heterostrukturkörper102 weiterhin einen dritten III-Nitrid-Halbleiter202 (z.B. GaN) auf dem zweiten III-Nitrid-Halbleiter122 . Eine zusätzliche Halbleiterfeldplatte200 ist im dritten III-Nitrid-Halbleiter202 ausgebildet. Die zusätzliche Halbleiterfeldplatte200 umfasst ein dotiertes Gebiet204 aus dem dritten III-Nitrid-Halbleiter202 . Die zusätzliche Halbleiterfeldplatte200 kann auch ein intrinsisches (d.h. unbeabsichtigt dotiertes) Gebiet206 aus dem dritten III-Nitrid-Halbleiter202 umfassen, das sich bei dem dotierten Gebiet204 des dritten III-Nitrid-Halbleiters202 befindet. Das intrinsische Gebiet206 kann das dotierte Gebiet204 der zusätzlichen Feldplatte200 mit dem Drain verbinden. - Im Blockierzustand werden mobile freie Ladungsträger aus dem Drain
106/110 zur Source104/108 hinausgezwungen und die Atome im Drain106/110 liefern einen positiv geladenen Drain106/110 , wie zuvor hierin beschrieben. Gleichmäßig verteilte Spiegelladungen in der Form fester Dotierungsatome im dotierten Gebiet204 der zusätzlichen Feldplatte200 kompensieren zumindest teilweise die Träger im Drain106/110 im Blockierzustand. Diese Spiegelladungen sind im Raum unbeweglich und fest, weil mobile freie Ladungsträger gleichermaßen im Blockierzustand aus der zusätzlichen Feldplatte100 hinausgezwungen werden, so dass die zusätzliche Feldplatte200 entgegengesetzt zum Drain106/110 geladen wird. Die durch beide Halbleiterfeldplatten100 ,200 bereitgestellte Kompensation ist aufgrund der Verwendung von jeweiligen dotierten Gebieten116 ,204 in dem Heterostrukturkörper102 über das Volumen der jeweiligen Feldplatten100 ,200 gleichmäßig verteilt, um den gewünschten Ladungskompensationseffekt bereitzustellen. Die untere Halbleiterfeldplatte100 unter dem zweidimensionalen Ladungsträgergaskanal118 kann vorgesehen werden, wie in3 gezeigt, oder entfallen. Das Gate114 kann auch einen Teil der Ladungskompensation für den Drain106/110 im Blockierzustand bereitstellen, doch liefern die Halbleiterfeldplatte(n)100 ,200 den größten Teil der Ladungskompensation, so dass der Aufbau eines elektrischen Felds nahe der Seite des Gates114 zum Drain106/110 minimiert wird. -
4 , die die4A bis4C beinhaltet, veranschaulicht eine Ausführungsform zum Herstellen eines Verbindungshalbleitertransistors mit einer Halbleiterfeldplatte mit gleichmäßig verteilten Spiegelladungen. - In
4A ist eine Keimbildungsschicht (Keimschicht)126 wie etwa eine AlN-Schicht auf einem Halbleitersubstrat124 wie etwa einem Si- oder SiC-Substrat ausgebildet. Die Keimbildungsschicht (Keimschicht)126 liefert eine thermische und Gitteranpassung für die III-Nitrid-Pufferschicht120 wie etwa GaN, die auf dem Substrat124 ausgebildet ist. eine Barriereschicht122 wie etwa eine GaN-Legierungsbarriereschicht wie AlGaN oder InAlGaN ist auf der darunterliegenden Pufferschicht120 ausgebildet. Die Anwesenheit von Polarisationsladungen und Spannungseffekten in dem resultierenden III-Nitrid-Heterostrukturkörper liefert ein zweidimensionales Ladungsträgergas118 nahe der Grenzfläche zwischen der Puffer- und Barriereschicht120 ,122 . Das zweidimensionale Ladungsträgergas118 kann je nach der Art des Transistors ein 2DEG oder ein 2DHG sein und liefert den Kanal des Transistors. - In
4B ist eine Maske300 wie etwa eine Photoresistmaske mit einer Öffnung302 derart auf dem Heterostrukturkörper ausgebildet, dass ein Teil des Heterostrukturkörpers nicht durch die Maske300 geschützt ist. - In
4C werden Dotierungsatome304 in ein Gebiet des Heterostrukturkörpers eingeführt durch Implantieren der Dotierungsatome304 in den Teil des Heterostrukturkörpers, der nicht durch die Maske300 geschützt ist. Im Fall des Ausbildens eines p-dotierten Gebiets beispielsweise können Mg-Atome in den nicht durch die Maske300 geschützten Teil des Heterostrukturkörpers implantiert werden. Im Fall des Ausbildens eines n-dotierten Gebiets können Si-Atome in den nicht durch die Maske300 geschützten Teil des Heterostrukturkörpers implantiert werden. In jedem Fall werden die Dotierungsatome304 thermisch aktiviert z.B. durch Ausheizen des Heterostrukturkörpers derart, dass die Dotierungsatome304 Kristallgitterpositionen innerhalb des Heterostrukturkörpers belegen und zwischen der Source und dem Drain eine Halbleiterfeldplatte ausbilden. Die Dotierungsatome der Halbleiterfeldplatte sind dazu ausgebildet, entgegengesetzte Ladungen im Drain mindestens teilweise zu kompensieren, wenn sich der Transistor in einem Aus-Zustand befindet und eine Sperrspannung an den Drain angelegt ist, wie hier zuvor beschrieben. Die Feldplatte, die Source und der Drain sind zur Erleichterung der Darstellung in4A bis4C nicht gezeigt. Ein intrinsisches Gebiet der Feldplatte ist nicht spezifisch hergestellt. Das intrinsische Gebiet kann von der gleichen Art sein wie das die Feldplatte umgebende andere III-Nitrid-Material. -
5 veranschaulicht einen nicht erfindungsgemäßen Verbindungshalbleitertransistor mit einer Halbleiterfeldplatte400 mit gleichmäßig verteilten Spiegelladungen.6 ist eine Schnittansicht des Transistors entlang der in5 mit A-A' bezeichneten Linie, und7 ist eine Schnittansicht des Transistors entlang der in5 mit B-B' bezeichneten Linie. Die in5-7 gezeigte Anordnung ist ähnlich der in den1-2 gezeigten, doch umfasst die Halbleiterfeldplatte400 ein zweidimensionales Ladungsträgergas402 (je nach Bauelementart 2DEG oder 2DHG). Dabei wird die Halbleiterfeldplatte400 aus einem dritten III-Nitrid-Halbleiter408 auf einem zweiten III-Nitrid-Halbleiter (Barriereschicht)410 und einem vierten III-Nitrid-Halbleiter412 auf dem dritten III-Nitrid-Halbleiter408 ausgebildet. Der vierte III-Nitrid-Halbleiter412 besitzt einen anderen Bandabstand als der dritte III-Nitrid-Halbleiter408 , so dass ein zweidimensionales Ladungsträgergas402 ,414 entlang einer Grenzfläche zwischen dem dritten und vierten III-Nitrid-Halbleiter408 ,412 entsteht. Beispielsweise kann GaN auf der Barriereschicht410 und AlGaN auf dem GaN ausgebildet werden. Das zweidimensionale Ladungsträgergas414 , das entlang der Grenzfläche zwischen dem dritten und vierten III-Nitrid-Halbleiter408 ,412 entsteht, besitzt die gleiche Ladungsart wie der zweidimensionale Ladungsträgergaskanal416 , der entlang der Grenzfläche zwischen der Barrieren- und Pufferschicht410 ,418 entsteht. - Im Blockierzustand des Transistors liefert das zweidimensionale Ladungsträgergas
402 der Feldplatte400 unbewegliche Spiegelladungen, die die Ladungen des Drains406 kompensieren und über eine Ebene der Feldplatte400 verteilt sind. Im Fall eines n-Kanal-Bauelements ist das zweidimensionale Ladungsträgergas402 der Feldplatte400 ein 2DEG. Im Fall eines p-Kanal-Bauelements ist das zweidimensionale Ladungsträgergas402 der Feldplatte400 ein 2DHG. Im Blockierzustand des Bauelements kompensieren die durch das 2DEG/2DHG402 gelieferten unbeweglichen Spiegelladungen die Ladungen des Drains406 . Infolgedessen entstehen signifikant reduzierte größte elektrische Felder im Vergleich zu herkömmlichen metallischen Feldelektroden. - Das zweidimensionale Ladungsträgergas
402 der Feldplatte400 kann über (nicht gezeigte) stark dotierte Zonen des Heterostrukturkörpers, z.B. n+-dotierte Zonen im Fall eines n-Kanal-Bauelements, mit einem (ebenfalls nicht gezeigten) Metallkontakt verbunden werden. Die stark dotierten Zonen und der Metallkontakt der Elektrode sollten nicht über der Kanalzone beziehungsweise der Driftzone positioniert werden. Stattdessen sollten die stark dotierten Zonen und der Metallkontakt der Elektrode z.B. neben der Sourceelektrode420 positioniert werden. Ansonsten wäre die gesamte Maximalladung auf der Feldplatte400 nicht von der angelegten Spannung unabhängig und würde deshalb nicht durch die maximale Schichtdichte des zweidimensionalen Ladungsträgergases402 begrenzt. Im Gegensatz zu Metallgates oder Metallfeldplattenelektroden ist die maximale Schichtdichte eines 2DEG auf ~1013 cm-2 begrenzt. Die größte Gesamtladung einer derartigen Feldplatte400 sollte deshalb von einer angelegten Spannung unabhängig sein. Die größte Gesamtladung könnte z.B. durch Variieren der Breite der Feldplatte400 , der Dicke des vierten III-Nitrid-Halbleiters412 , der Al-Konzentration des vierten III-Nitrid-Halbleiters412 z.B. im Fall von AlGaN usw. eingestellt werden. - Eine Schätzung zeigt, dass es möglich ist, die vollständige Spiegelladung zu berücksichtigen, die zum Kompensieren der Ladung auf der Drainelektrode
422 im Blockierzustand benötigt wird, und mit einer an den Drain406 angelegten Spannung von +600 V zu kompensieren, indem eine Feldplatte400 verwendet wird, die ein 2DEG402 umfasst (n=1013 cm-2; Länge des Driftgebiets=20 µm, Feldplattenbreite=1 µm; εr=10). Da die Spiegelladung auf der zweidimensionalen Ladungsträgergasfeldplatte400 in eine Ebene verteilt ist anstatt an einem einzelnen Punkt im Raum lokalisiert ist, wie dies der Fall für Metallelektroden ist, wird das größte elektrische Feld auf der dem Drain406 zugewandten Seite der Feldplatte400 drastisch reduziert. können zwei oder mehr Feldplatten auf der Basis eines zweidimensionalen Ladungsträgergases verwendet werden, um das elektrische Feld auf stufenartige Weise zu reduzieren. Zusätzlich oder alternativ kann die größte Schichtträgerdichte beliebiger hier beschriebener Feldplattenanordnungen derart konstruiert sein, dass ein Teil der Spiegelladung durch die Gateelektrode424 oder Source- und Gateelektroden420 ,424 berücksichtigt wird. Zudem kann eine Halbleiterfeldplatte sowohl über als auch unter dem Kanal positioniert werden, wie hier zuvor beschrieben (beispielsweise siehe3 ). - Zusätzlich zu dem Vorliegen eines reduzierten größten elektrischen Felds auf der dem Drain
406 zugewandten Seite einer zweidimensionalen Ladungsträgergasfeldplatte400 verwandelt die Verwendung eines 2DEG-Gates414 , wie in6 und7 gezeigt, einen normalerweise eingeschalteten HEMT in einen normalerweise ausgeschalteten HEMT. Das Anlegen einer Spannung von 0 Volt an das Gate414 bewirkt, dass die negativen Ladungen im 2DEG414 verarmt werden und der Transistor ausgeschaltet wird. Vorteilhafterweise können Parameter wie Schichtdicke, Al-Gehalt von AlGaN-Schichten usw. auf eine Weise eingestellt werden, dass die Schichtträgerdichte des 2DEG-Gates414 größer ist als die Schichtträgerdichte innerhalb des Kanalgebiets416 des HEMTs. Falls eine positive Spannung an das 2DEG-Gate414 angelegt wird, werden die negativen Ladungen von der Gateelektrode entfernt und der Transistor wird eingeschaltet. - Räumlich relative Ausdrücke wie etwa „unter“, „darunter“, „unterer“, „über“, „oberer“ und dergleichen werden zur Erleichterung der Beschreibung verwendet, um die Positionierung eines Elements relativ zu einem zweiten Element zu erläutern. Diese Ausdrücke sollen verschiedene Orientierungen des Packages zusätzlich zu verschiedenen Orientierungen als jenen in den Figuren beschriebenen einschließen. Weiterhin werden Ausdrücke wie etwa „erster“, „zweiter“ und dergleichen ebenfalls verwendet, um verschiedene Elemente, Gebiete, Sektionen usw. zu beschreiben, und sollen ebenfalls nicht beschränkend sein. In der Beschreibung beziehen sich gleiche Ausdrücke auf gleiche Elemente.
- Wie hierin verwendet, sind die Ausdrücke „mit“, „enthaltend“, „einschließlich“, „umfassend“ und dergleichen offene Ausdrücke, die die Anwesenheit erwähnter Elemente oder Merkmale anzeigen, zusätzliche Elemente oder Merkmale aber nicht ausschließen. Die Artikel „ein/eine/einer“ und „der/die/das“ sollen den Plural sowie den Singular beinhalten, sofern nicht der Kontext deutlich etwas anderes angibt.
- Unter Berücksichtigung des obigen Bereichs an Varianten und Anwendungen versteht sich, dass die vorliegende Erfindung nicht durch die vorausgegangene Beschreibung beschränkt wird noch durch die beiliegenden Zeichnungen beschränkt wird. Stattdessen wird die vorliegende Erfindung nur durch die folgenden Ansprüche und ihre rechtlichen Äquivalente beschränkt.
Claims (3)
- Transistor, der aufweist: eine Source (108); ein Drain (110), das von der Source (108) beabstandet ist; einen Heterostrukturkörper (102) mit einem zweidimensionalen Ladungsträgergaskanal (118) zum Verbinden der Source (108) und des Drain (110); und eine Halbleiterfeldplatte (100, 200), die zwischen der Source (108) und dem Drain (110) angeordnet ist, wobei die Halbleiterfeldplatte (100, 200) dazu ausgebildet ist, Ladungen in dem Drain (110) wenigstens teilweise zu kompensieren, wenn sich der Transistor in einem Aus-Zustand befindet, in dem der Kanal (118) unterbrochen ist und eine Sperrspannung an den Drain (110) angelegt ist, wobei die durch die Halbleiterfeldplatte (100, 200) bereitgestellte Kompensationsladung über eine Ebene oder ein Volumen der Halbleiterfeldplatte (100, 200) gleichmäßig verteilt ist; der Heterostrukturkörper (102) einen ersten III-Nitrid-Halbleiter (120) und einen zweiten III-Nitrid-Halbleiter (122) auf dem ersten III-Nitrid-Halbleiter (120) aufweist, wobei der zweite III-Nitrid-Halbleiter (122) einen anderen Bandabstand besitzt als der erste III-Nitrid-Halbleiter (120), so dass der zweidimensionale Ladungsträgergaskanal (118) entlang einer Grenzfläche zwischen dem ersten und zweiten III-Nitrid-Halbleiter (120, 122) entsteht; die Halbleiterfeldplatte (100) ein dotiertes Gebiet (116) des ersten III-Nitrid-Halbleiters (120) aufweist, das p-dotiert ist; der Heterostrukturkörper (102) einen dritten III-Nitrid-Halbleiter (202) auf dem zweiten III-Nitrid-Halbleiter (122) aufweist und die Halbleiterfeldplatte (200) ein dotiertes Gebiet (204) des dritten III-Nitrid-Halbleiters (202) aufweist, das p-dotiert ist.
- Transistor nach
Anspruch 1 , bei dem die Halbleiterfeldplatte (100) außerdem ein intrinsisches Gebiet (128) des ersten III-Nitrid-Halbleiters (120) aufweist, das sich bei dem dotierten Gebiet (116) des ersten III-Nitrid-Halbleiters (120) befindet. - Transistor nach
Anspruch 1 oder2 , bei dem die Halbleiterfeldplatte (200) außerdem ein intrinsisches Gebiet (206) des dritten III-Nitrid-Halbleiters (202) aufweist, das sich neben dem dotierten Gebiet (204) des dritten III-Nitrid-Halbleiters (202) befindet.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
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US14/540,535 | 2014-11-13 | ||
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