CN1427391A - 液晶显示器 - Google Patents

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Abstract

本发明涉及能够降低能耗并能提高图像质量的液晶显示器，包括液晶显示板，所述液晶显示板上设有多个液晶显示盒，所述液晶显示盒形成在相互交叉的选通线和数据线之间，而且多个液晶显示盒借助于i(i是正数)条水平线并通过薄膜晶体管交替地连接到与之相邻的不同数据线上；栅极驱动器，其用于驱动选通线；数据驱动器，其用于驱动数据线而且包括多路复用器阵列和数模转换器阵列，所述多路复用器阵列用于确定输入象素数据的输出通道和根据控制信号添加一个空白数据，所述控制信号的极性由“i”条水平线反转，所述数模转换器阵列用于把象素数据和空白数据转换成象素信号和空白信号，这些信号的极性通过数据线和帧进行反转。

Description

液晶显示器
技术领域
本发明涉及一种液晶显示装置，尤其涉及一种能够降低功耗且又能改善画质的液晶显示器。
背景技术
通常，液晶显示器(LCD)用一电场控制具有介电各向异性(dielectricanisotropy)的液晶的透光率以显示图像。为此，LCD包括一液晶显示板和一驱动电路，液晶显示板具有以矩阵形式排列的液晶盒，而驱动电路用来驱动该液晶显示板。
在液晶显示板中，液晶盒根据象素信号控制透光率来显示图像。驱动电路包括：一栅极驱动器(gate driver)，它用来驱动选通线(gate lines)；一数据驱动器，它用来驱动数据线；一定时控制器，它把一定时控制信号和一象素数据提供给栅极驱动器和数据驱动器；一供电电源。
例如，如图1所示，液晶显示器包括：一液晶显示板2，它具有以矩阵形式排列的液晶盒Clc；一栅极驱动器4，它用来驱动液晶显示板2的选通线GL1至GLn；一数据驱动器6，它用来驱动液晶显示板2的数据线DL1至DLm。
在图1中，液晶显示板2包括一液晶盒Clc和薄膜晶体管(TFT’s)，每一个薄膜晶体管设置在n条选通线GL1至GLn与m条数据线DL1至DLm之间的交叉部分上。响应于来自选通线GL1至GLn的一个扫描信号，TFT把来自数据线DL1至DLm的视频信号加到液晶盒Clc上。液晶盒Clc能够等效表达为含一相对的公共电极和一接至TFT的象素电极的液晶电容Clc，该公共电极与象素电极之间有液晶。
栅极驱动器4按将一扫描信号依次加到选通线GL1至GLn上，以驱动接至相应选通线的TFT。
当把一选通信号加到选通线GL上时，在一个水平(horizontal)处理期内，数据驱动器6把象素数据转换为模拟象素信号，用以把一水平线的视频信号加到数据线DL1至DLm上。这种情况下，数据驱动器借助来自伽马电压发生器(图中未示)的伽马电压把象素数据转换为象素信号以提供它们。
为了防止液晶变质并且提高图像显示画质，以一反向驱动方法(inversiondriving method)如一帧反转系统(frame inversion system)、一行(或列)反转系统或一点反转系统来驱动这样一种液晶显示器。
在帧反转系统中，液晶盒的极性在一帧内是相同的，而在帧改变时反向。这种帧反转系统的问题在于各帧会产生闪烁。
在行反转系统中，通过分别如图2A和图2B所示的水平线和各帧使液晶盒的极性反向。这样一种行反转系统的问题在于，水平方向上的液晶盒之间存在串扰，使得水平带状图案(horizontal stripe pattern)中出现闪烁。
在列反转系统中，通过分别如图3A和图3B所示的垂直线和各帧使液晶盒的极性反向。这样一种列反向驱动系统的问题在于，垂直方向上的液晶盒之间存在串扰，使得垂直带状图案(vertical strip pattern)中出现闪烁。
在点反转系统中，如图4A和图4B所示，液晶盒的极性与水平会垂直相邻的液晶盒极性相反，并且在各帧反向。
换句话说，在点反转系统中，把一些象素信号供给每一个液晶盒，如图4A所示，其正(+)极性和负(-)极性随着从左上液晶盒到右液晶盒和到下液晶盒的顺序在奇数帧处交替出现；把另一些象素信号供给每一个液晶盒，如图4B所示，其负(-)极性和正(+)极性随着从左上液晶盒到右液晶盒和到下液晶盒的顺序在偶数帧处交替出现。
这样一种点反向驱动系统令其弥补了垂直方向上和水平方向上相邻液晶盒之间出现的闪烁，由此与其他反转系统相比，能够产生更优质的画质。
但是，这种点反向驱动系统的缺点在于，由于从数据驱动器供给数据线的象素信号极性应当在水平方向上和垂直方向上反向，所以象素信号的变化量，即象素信号的频率高于其他反转系统，从而导致功耗增大。
发明内容
因此，本发明的目的在于提供一种液晶显示器，它能够在N个(这里，N为一个正数)点(dots)反转系统中驱动液晶显示板时显著降低功耗，又改善其画质。
为了实现本发明的这些和其他目的，一种根据本发明一个方面的液晶显示器包括：一液晶显示板，它具有液晶盒，这些液晶盒限定在相交选通线和数据线之间，并且经与数据线相邻的相互不同的薄膜晶体管通过i(i是正数)条水平线交替连接；一栅极驱动器，它用来驱动选通线；一数据驱动器，它用来驱动数据线，并且包括一多路复用器阵列和一数模转换器阵列，该多路复用器阵列用来响应于其极性依’i’条水平线反向的控制信号来确定一输入象素数据的输出通道(channel)和增加一个空白数据，该数模转换器阵列用来将象素数据和空白数据转换为一象素信号和一空白信号，其极性在本数据线和本帧反向。
在这种液晶显示器中，液晶显示板包括：第一水平线，它由接至其左侧相邻数据线的液晶盒组成；第二水平线，它由接至其右侧相邻数据线的液晶盒组成。
在这种液晶显示器中，第一水平线和第二水平线逐条水平线交替排列。
在这种液晶显示器中，第一水平线和第二水平线每两条水平线交替排列。
在这种液晶显示器中，当驱动第一水平线时，在第一水平处理期内，多路复用器MUX阵列把象素数据的输出通道保持得与一输入通道相同，把空白数据提供给最后一个输出通道，并且当驱动第一水平线时，在第二水平处理期内，将象素数据转移一个通道以将其送至该输出通道，把空白数据提供给第一输出通道。
在这种液晶显示器中，数据驱动器还包括：一移位寄存器阵列，它提供一连续的采样信号；一锁存器阵列，它根据该采样信号，用一特定的通道数连续锁存该象素数据，从而将它们同时输出和送至多路复用器阵列；一缓冲器阵列，它对来自数模转换器的象素信号和空白信号进行缓存，从而将它们分别送至数据线。
根据本发明的另一种液晶显示器，包括：一液晶显示板，它具有液晶盒，这些液晶盒限定在相交选通线和数据线之间，并且通过与数据线相邻的相互不同的薄膜晶体管，经i(i是正数)条水平线交替连接；一栅极驱动器，它用来驱动选通线；一数据驱动器，它用来把一输入的象素数据和一空白数据转换为象素信号和空白信号，其极性由在本数据线和本帧反向，由此将它们送至数据线；一定时控制器，它用来控制栅极驱动器和数据驱动器，并且同时响应于在i水平处理期后反向的控制信号，将空白数据连同象素数据一起加到第一通道中任意一个通道上，或者加到最后一个通道上，用以送至数据驱动器。
这种液晶显示器中，液晶显示板包括：第一水平线，它由接至其左侧相邻数据线的液晶盒组成；第二水平线，它由接至其右侧相邻数据线的液晶盒组成。
在这种液晶显示器中，第一水平线和第二水平线逐条水平线交替排列。
在这种液晶显示器中，第一水平线和第二水平线每两条水平线交替排列。
在这种液晶显示器中，在第一水平处理期内，定时控制器把随着最后一个通道增加的象素数据和空白数据送至数据驱动器，用以驱动第一水平线；而在第二水平处理期内，把加到第一通道上的延迟一个通道的象素数据和空白数据送至数据驱动器，用以驱动第二水平线。
这种液晶显示器中，定时控制器包括：一控制信号发生器，它产生控制栅极驱动器和数据驱动器的控制信号，并且产生其极性在i水平周期后反向的控制信号；一象素数据排列器(arranger)，它排列输入的象素数据，以在一允许数据传送周期内通过多条第一总线输出这些数据，并且通过第一总线传送空白数据；一延迟器，它用来借助一个通道，延迟通过第一总线中最后一条总线所传送的象素数据和空白数据；一多路复用器，它响应于该控制信号，借助多条第二总线，实际传送空白数据和通过第一总线输入的数据，或者把通过第一总线输入的象素数据和延迟一个通道的空白数据结合起来，通过第二总线传送它们。
在这种液晶显示器中，经第二总线，在第一水平处理周期内，多路复用器实际传送通过第一总线输入的空白数据和象素数据，用以驱动第一水平线，而在第二水平处理周期内，为了驱动第二水平线，用一个通道转移通过除最后第一总线之外的第一总线输入的象素数据，从而通过除第一条、第二总线之外的第二总线传送，并且通过第一条第二总线传送延迟一个通道的象素数据和空白数据。
附图说明
根据参照附图对本发明各实施例的以下详细描述，本发明的这些和其他目的将很明显，在这些附图中：
图1是一示意图，它示出一传统液晶显示器的结构；
图2A和图2B是用来解释液晶显示器的行反向驱动系统的图；
图3A和图3B是用来解释液晶显示器的列反向驱动系统的图；
图4A和图4B是用来解释液晶显示器的点反向驱动系统的图；
图5是一示意图，它示出根据本发明一个实施例的液晶显示器结构；
图6是一示意图，它示出用于本发明的另一种液晶显示板的结构；
图7是一详细的方框图，它示出图5所示数据驱动器的结构；
图8是一示意图，它示出根据本发明另一个实施例的液晶显示器结构；
图9A和9B是图8所示定时控制器三总线系统的数据输出波形图；
图10A和10B是图8所示定时控制器六总线系统的数据输出波形图；
图11是一示意图，它示出根据本发明又一实施例的垂直2点反向驱动的液晶显示器结构；
图12是一示意图，它示出用于本发明的液晶显示板另一种结构；
图13A和13B是示出用于图11所示液晶板的象素信号和空白信号的图；
图14是一示意图，它示出根据本发明再一实施例的垂直2点反向驱动的液晶显示器结构。
具体实施方式
参见图5至14，其中详细解释了本发明的优选实施例。
参见图5，其中示出了根据本发明一个实施例的液晶显示器。
图5所示的液晶显示器包括：液晶显示板12，它具有以矩阵形式排列的液晶盒；栅极驱动器14，它用来驱动液晶显示板12的选通线GL1至GLn；数据驱动器16，它用来驱动液晶显示板12的数据线DL1至DLm+1；定时控制器18，它用来控制栅极驱动器14和数据驱动器16。
液晶显示板12包括N条选通线GL1至GL和M+1条数据线DL1至DLm+1，数据线与选通线GL1至GLn交叉并彼此绝缘隔离。液晶板12还包括一液晶盒PXL和一薄膜晶体管，它们设置在选通线GL1至GLn与数据线DL1至DLm+1交叉部分所限定的每一个区域上。响应于来自选通线GL1至GLn的扫描信号，该TFT把象素信号从数据线DL1至DLm+1送至液晶盒PXL。响应于该象素信号，液晶盒PXL通过驱动位于公共电极(图中未示)之间的液晶来控制透光率。
特别是，薄膜晶体管和液晶盒PXL沿数据线DL方向以Z字形依次排列设置。换句话说，包括在同一列中的液晶盒PXL和TFT’s通过水平线接至另外相邻的数据线。
例如，在图5所示液晶显示板12的情况下，接至奇数选通线GL1，GL3，GL5......的奇数水平线上的TFT’s和液晶盒PXL分别接至其左侧相邻的第1至第m数据线DL1至DLm。因此，通过TFT，把来自其左侧相邻数据线DL的象素信号加到奇数水平线上的液晶盒PXL上。
另一方面，接至偶数选通线GL2，GL4，GL6......的偶数水平线上的TFT’s和液晶盒PXL分别接至其右侧相邻的第2至第(m+1)数据线DL2至DLm+1。因此，通过TFT，把来自其右侧相邻数据线DL的象素信号加到偶数水平线上的液晶盒PXL上。
另外，在图6所示的液晶显示板15中，接至奇数选通线GL1，GL3，GL5......的奇数水平线上的TFT’s和液晶盒PXL分别接至其右侧相邻的第2至第(m+1)数据线DL2至DLm+1。因此，通过TFT，把来自其右侧相邻数据线DL的象素信号加到奇数水平线上的液晶盒PXL上。
另一方面，接至偶数选通线GL2，GL4，GL6......的偶数水平线上的TFT’s和液晶盒PXL分别接至其左侧相邻的第1至第m数据线DL1至DLm。因此，通过TFT，把来自其左侧相邻数据线DL的象素信号加到偶数水平线上的液晶盒PXL上。
定时控制器18产生控制栅极驱动器14和数据驱动器16的定时控制信号，并且把象素数据信号送至数据驱动器16。定时控制器18产生的选通定时控制信号包括：一栅极起始脉冲GSP；一栅极移位时钟信号GSC；一选通输出使能(enable)信号SOE等。定时控制器18产生的数据定时控制信号包括：一源极起始脉冲SSP；一源极移位时钟信号SSC；一源极输出使能(enable)信号SOE；极性控制信号POC等。
利用定时控制信号，栅极驱动器14把扫描信号顺序加至选通线GL1至GLn。因此，响应于扫描信号，栅极驱动器14通过水平线驱动薄膜晶体管。
当一扫描信号加至选通线GL时，数据驱动器16将象素数据转换为模拟象素信号，将一条水平线的象素信号通过水平处理周期加至数据线DL1至DLm+1。这种情况下，借助来自伽马电压发生器(图中未示)的伽马电压，数据驱动器16将象素数据转换为象素信号以传送它们。
另外，数据驱动器16以其中象素信号的极性逐条数据线DL反向的列反向驱动系统的方式施加象素信号。换句话说，数据驱动器16以奇数数据线DL1，、DL3、......与偶数数据线DL2，、DL4、......上极性相反的方式施加象素信号，送至数据线DL的象素信号极性逐幀反向。
这种情况下，由于液晶盒PXL在加有列反转系统提供的象素信号的数据线DL1至DLm+1周围以Z字形排列，随意用点反转系统驱动液晶盒PXL。
特别是，数据驱动器16在各水平处理周期内交替改变象素信号的输出通道，把正确的象素信号供给以Z字形沿数据线DL1至DLm+1排列的液晶盒PXL。
在把象素信号供给接至右侧数据线DL1至DLm+1的液晶盒PXL的情况下，数据驱动器16把m个有效象素信号供给m条数据线DL1至DLM，把空白信号供给m+1条数据线DLm+1。与此不同的是，在把象素信号供给接至左侧数据线DL1至DLm+1的液晶盒PXL的情况下，数据驱动器16通过把m个有效象素信号向右侧转移一个通道，将它们供给2至m+1条数据线DL2至DLm+1，把空白信号供给第1条数据线DL1。
例如，如图5所示，当液晶盒PXL驱动接至右侧数据线DL1至DLm+1的奇数水平线时，数据驱动器16把m个有效信号供给第1至第m数据线DL1至DLm，另外将空白信号供给第(m+1)数据线DLm+1。而当液晶盒PXL驱动接至左侧数据线DL1至DLm+1的偶数水平线时，数据驱动器16把m个有效信号供给第2至第(m+1)数据线DL2至DLm+1，并且将空白信号供给第1数据线。
与此不同的是，如图6所示，当液晶盒PXL驱动接至左侧数据线DL1至DLm+1的奇数水平线时，数据驱动器16通过把m个有效信号向右侧转移一个通道，把它们供给第2至第(m+1)数据线DL2至DLm+1，并且将空白信号供给第1数据线。而当液晶盒PXL驱动接至左侧数据线DL1至DLm+1的偶数水平线时，数据驱动器16把m个有效信号供给第1至第m数据线DL1至DLm，另外将空白信号供给第(m+1)数据线DLm+1。
因此，画质通过以点反转系统驱动的液晶盒PXL得以改善，而由于数据驱动器16通过列反转系统提供象素信号，所以其功耗比用点反转系统提供象素信号时有显著降低。
图7是一方框图，它示出图5所示数据驱动器16的一种详细结构。
参见图7，数据驱动器16包括：移位寄存器阵列20，它用来按序施加采样信号；锁存器阵列22，它响应于采样信号，锁存和输出象素数据；多路复用器(MUX)阵列24，它确定从锁存器阵列22中输入的象素数据路径；数模转换器(DAC)阵列26，它用来把来自MUX阵列24的象素数据转换为模拟象素信号；缓冲器阵列28，它用来缓存和输出来自DAC阵列26的象素信号。
包括在移位寄存器阵列20中的多个移位寄存器，响应于一源极采样时钟信号SSC，对来自定时控制器18的源极起始脉冲SSP作按序移位，将其作为一采样信号输出。
包括在锁存器阵列22中的多个锁存器，响应于来自移位寄存器阵列20的采样信号，通过某一单元借助来自定时控制器1 8的采样象素数据按序进行锁存，然后响应于来自定时控制器18的源极输出使能(enable)信号(SOE)，锁存器阵列22同时输出锁存的象素阵列。
MUX阵列24响应于来自定时控制器18的控制信号，在各水平处理周期内选择来自锁存器阵列22的象素数据路径。特别是，在奇数(或偶数)水平处理周期内，当驱动接至右侧数据线DL1至DLm+1的液晶盒PXL时，MUX阵列24输出通道没有变化的所输入的象素数据，并且将空白数据供给最后一个通道。与此不同的是，在偶数(或奇数)水平处理周期内，当驱动接至左侧数据线DL1至DLm+1的液晶盒PXL时，MUX阵列24通过向右转移一个通道来输出所输入的象素数据，并且将空白数据供给第一通道。
为此，MUX阵列24包括m个MUX，每一个MUX接收两个相邻锁存器的输出信号，以根据来自定时控制器18的控制信号有选择地输出。这里，除了一种极性锁存器中的第一和第m锁存器之外，其他锁存器的输出由两个相邻的MUX共用。在各水平处理周期内，供给MUX阵列24的控制信号极性反向。
借助于来自伽马电压发生器(图中未示)的正负伽马电压，包括在DAC阵列26中的多个DAC把来自MUX阵列24的象素数据和空白数据转换成象素信号和空白信号，以输出它们。特别是，响应于来自定时控制器18的极性控制信号POL，DAC阵列26把奇数象素数据和偶数象素数据转换为极性相反的象素信号，为列反向驱动而输出它们。
缓冲器阵列28缓存来自DAC阵列26的象素信号和空白信号，然后将它们输出至数据线DL1至DLm+1。
因此，将其极性逐数据线和逐幀反向的象素信号送至数据线DL1至DLm+1。在奇数(或偶数)水平处理周期内，把有效的象素信号送至第一至第m数据线DL1至DLm，并且把空白信号送至第m+1数据线DLm+1，而在偶数或奇数水平处理周期内，把空白信号送至第1数据线DL1，并且把有效的象素信号送至第2至第m+1数据线DL2至DLm+1。随后，可以用点反转系统驱动沿数据线DL1至DLm+1以Z字形排列的液晶盒。因此，由于数据驱动器16受列反转系统的驱动而液晶盒受点反转系统的驱动，所以可以显著降低功耗。
图8表示根据本发明另一个实施例的液晶显示器。
图8所示的液晶显示器具有与图7所示液晶显示器相同的部件，不过定时控制器40和数据驱动器50的功能不同。
这种液晶显示器12使设置在选通线GL1至GLn与数据线DL1至DLm+1之间交叉部分所限定的每一个区域上的液晶盒PXL和TFT以一矩阵图案方式排列。
TFT和液晶盒PXL沿数据线DL1至DLm+1以一Z字形排列，它们的位置依次从右到左或者从左到右。换句话说，包括在同一列中的液晶盒和TFT通过水平线交替接至另一条相邻的数据线。
例如，液晶显示板12接至奇数或偶数水平线的TFT，而液晶盒PXL分别接至第1至其左侧相邻的第m数据线DL1至DLm。另一方面，偶数水平线的液晶盒PXL和TFT分别接至其右侧相邻的第2至第(m+1)数据线DL2至DLm+2。
利用来自定时控制器40的选通定时控制信号，栅极驱动器14按序将扫描信号加至选通线GL1至GLn。因此，响应于这些扫描信号，栅极驱动器14通过水平线驱动各TFT。
在各水平处理周期内，当将扫描信号加至选通线GL时，数据驱动器50把所输入的象素数据转换为模拟象素信号，以将一条水平线的象素信号加到数据线DL1至DLm+1上。这种情况下，借助来自伽马(gamma)电压发生器(图中未示)的伽马电压，数据驱动器50把象素数据转换为象素信号，从而输出它们。
另外，数据驱动器50通过列反向驱动系统施加象素信号，在该系统中，数据线DL1至DLm+1使象素信号反向。换句话说，数据驱动器50把具有相反极性的象素信号加至奇数数据线DL1、DL3、......和偶数数据线DL2、DL4、......，供给数进行DL1至DLm+1的象素信号继续逐幀反向。这种情况下，由于液晶盒PXL基于在列反向驱动系统中供有象素信号的数据线DL1至DLm+1而以Z字形排列，所以液晶盒受点反转系统的驱动。
尤其是，为了将正确的象素信号供给沿数据线DL1至DLm+1以Z字形排列的液晶盒PXL，在奇数(或偶数)水平处理周期内，数据驱动器50把空白信号供给第1数据线DL1，把有效象素信号供给第2至第(m+1)数据线DL2至DLm+1。而在偶数(或奇数)水平处理周期内，将有效象素信号供给第1至第m数据线DL1至DLm，把空白信号供给第(m+1)数据线DLm+1。
定时控制器40产生用来控制栅极驱动器14和数据驱动器40驱动的控制信号，并且将一象素数据加至数据驱动器50。定时控制器40所产生的选通定时控制信号包括：栅极起始脉冲GSP；栅极移位时钟信号GSC；选通输出使能(enable)信号GOE等。定时控制器40所产生的数据定时控制信号包括：源极起始脉冲SSP；源极移位时钟信号SSC；源极输出使能(enable)信号SOE；极性(polarity)控制信号POL等。
特别是，在奇数(或偶数)水平处理周期内，定时控制器40通过某一单元依次提供一条水平线的m个象素数据，另外把空白数据作为第(m+1)个象素数据提供。响应于来自移位寄存器阵列20的采样信号，包括在锁存器阵列22中的多个锁存器通过某一单元借助来自定时控制器18的采样象素数据按序进行锁存，然后响应于来自定时控制器18的源极输出使能(enable)信号(SOE)，锁存器阵列22同时输出锁存的象素阵列。而在偶数(或奇数)水平周期内，提供由一个通道延迟的m个象素数据，另外把空白信号作为第一象素数据提供。
为了进行这种驱动，定时控制器40包括：一控制信号发生器42，它用来产生控制信号；一象素数据排列器44，它排列和输出输入的象素数据；一寄存器46，它用来延迟从象素数据排列器44输出的象素数据中最后一个象素数据；一MUX48，它用来有选择地结合来自象素数据排列器44的象素数据和来自寄存器46延迟后的象素数据。
利用水平同步信号H、垂直同步信号V、主时钟信号MCLK等，控制信号发生器42产生控制栅极驱动器14的选通定时控制信号和控制数据驱动器50的数据定时控制信号。另外，控制信号发生器42产生一MUX48控制信号。这种情况下，利用水平同步信号H，控制信号发生器42产生表示奇数水平周期和偶数水平周期的控制信号，也就是说，其极性在水平处理周期内反向以便将其供给MUX48。
象素数据排列器44根据一数据传输总线层级排列输入的象素数据并且输出它们。例如，象素数据排列器44通过三条总线同时输出R、G、B象素数据，或者通过六条总线同时输出奇数R、G、B象素数据和偶数R、G、B象素数据。把通过这些总线中最后一条总线之外的其他总线输出的象素数据送至MUX48，把通过该最后一条总线输出的象素数据一般送至MUX48和寄存器46。而且，象素数据排列器44在允许数据输出时间段之间存在的空白时间段内对空白数据BK采样，用以在允许数据输出时间段内输出。
寄存器46暂时存储通过从选告诉数据排列器44中输出的象素数据最后一条总线传输的象素数据，并且用将它们延迟一个通道。
MUX 48在奇数(或偶数)水平处理周期内，响应于该控制信号，从象素数据排列器44中输入，经三条总线或者六条总线输出n个象素数据和空白数据、第(m+1)数据。
而且，MUX 48在偶数(或奇数)水平处理周期内，响应于该控制信号，把通过第一或第二总线从象素数据排列器44输入的象素数据移位输出给第二或第三总线。或者，它将通过第一至第五总线输入的象素数据进行移位处理，以输出给第二至第六总线。
经过寄存器46一个通道延迟的最后一条总线即第三或第六总线的象素数据输出至第一总线。这种情况下，在偶数(或奇数)水平处理时间段内，把在空白时。间段内存储在寄存器46中的空白数据作为第一总线的第一数据传送。
图9A和9B是在奇数(或偶数)水平处理周期和偶数(或奇数)水平处理周期内经三条总线从定时控制器40供给数据驱动器50的空白数据和象素数据的时序图。
参见图9A，在奇数(或偶数)水平处理周期内，定时控制器40把一个空白数据BK和m/3个红色象素数据R1、R2、R3、......、Rm/3经第一总线DB1、m/3个绿色象素数据G1、G2、G3、......、Gm/3经第二总线DB2和m/3个蓝色象素数据B1、B2、B3、......、Bm/3经第三总线DB3送至数据驱动器50，在这种方式下，在允许数据信号DE的允许输出时间段内，定时控制器40通过第一至第三总线DB1至DB3，把m个有效象素数据R、G和B供给数据驱动器50。在该允许输出时间段之后，定时控制器40继续提供空白数据BK。
因此，数据驱动器50输入来自定时控制器40的一个空白数据BK和m个有效象素数据R、G、B。数据驱动器50把所输入的m个有效象素数据R、G、B转换成模拟象素信号，以将其送至第一之第m数据线DL1至DLm，并且同时把一个空白数据BK转换成模拟空白信号以将其送至第(m+1)数据线DLm+1。
参见图9B，在偶数(或奇数)水平处理周期内，定时控制器40通过把m/3个红色象素数据R1、R2、R3、......、Rm/3转移到第二总线DB2、把m/3个绿色象素数据G1、G2、G3、......、Gm/3转移到第三总线DB3，将它们送至数据驱动器50。而且定时控制器40通过第一总线DB1，把延迟一个通道的m/3个蓝色象素数据B1、B2、B3、......、Bm/3和一个空白数据送至数据驱动器50。这种方式下，在允许数据信号DE的允许输出时间段内，定时控制器40通过第一至第三总线DB1至DB3，把移动了一个通道的一个空白数据BK和m-1个有效象素数据R、G、B供给数据驱动器50，并且在该允许输出时间段之后，定时控制器40还提供移动了一个通道的最后一个有效象素数据Dm/3。
因此，数据驱动器50输入来自定时控制器40的一个空白数据BK和m个有效象素数据R、G、B。而且，数据驱动器50把移动了一个通道的所输入的m个有效象素数据R、G、B转换为模拟象素信号，以将其供给第二至第(m+1)条数据线DL2至DLm+2，同时将一个空白数据BK转换为模拟空白信号，以将其供给第一数据线DL1。
图10A和10B是在奇数(或偶数)水平处理周期和偶数(或奇数)水平处理周期内经六条总线从定时控制器40供给数据驱动器50的空白数据和象素数据的时序图。
参见图10A，在奇数(或偶数)水平处理周期内，定时控制器40把一个空白数据BK和m/6个奇数红色象素数据OR1、OR2、OR3、......、ORm/6经第一总线DB1 m/6个奇数绿色象素数据OG1、OG2、OG3、......、OGm/6经第二总线DB2送至数据驱动器50，m/6个奇数蓝色象素数据OB1、OB2、OB3、......、OBm/6经第三总线DB3送至数据驱动器50，m/6个偶数红色象素数据ER1、ER2、ER3、......、ERm/6经第四总线DB4送至数据驱动器50，m/6个偶数绿色象素数据EG1、EG2、EG3、......、EGm/6经第五总线DB5送至数据驱动器50，m/6个偶数蓝色象素数据EB1、EB2、EB3、......、EBm/6经第六总线DB6送至数据驱动器50。
这种方式下，在允许数据信号DE的允许输出时间段内，定时控制器40通过第一至第六总线DB1至DB6把m个有效象素数据R、G、B送至数据驱动器50。在该允许输出时间段之后，定时控制器40继续(sequentially)传送空白数据BK。
因此，数据驱动器50输入一个空白数据BK和m个有效象素数据R、G、B。而且，数据驱动器50把m个有效象素数据R、G、B转换为模拟象素信号，以将其供给第一至第m条数据线DL1至DLm，同时将一个空白数据BK转换为模拟空白信号，以将其供给第(m+1)数据线DLm+1。
参见图10B，在偶数(或奇数)水平处理周期内，定时控制器40通过把m/6个奇数红色象素数据OR1、OR2、OR3、......、ORm/6移位到第二总线DB2、把m/6个奇数绿色象素数据OG1、OG2、OG3、......、OGm/6移到第三总线DB3、把m/6个奇数蓝色象素数据OB1、OB2、OB3、......、OBm/6移位到第四总线DB4、把m/6个偶数红色象素数据ER1、ER2、ER3、......、ERm/6移位到第五总线DB5、把m/6个偶数绿色象素数据EG1、EG2、EG3、......、EGm/6移位到第六总线DB6，将它们送至数据驱动器50。
而且，定时控制器40还把m/6个偶数蓝色象素数据EB1、EB2、EB3、......、EBm/6和延迟了一个通道的一个空白数据BK经第一总线DB1送至数据驱动器50。这种方式下，在允许数据输出时间段内，定时控制器40通过第一至第六总线DB1至DB6把移位一通道的一个空白数据BK和m-1个有效象素数据R、G、B送至数据驱动器50。在该允许输出时间段之后，定时控制器40继续传送移位一通道的最后一个有效象素数据Dm/6。
因此，数据驱动器50输入一个空白(blank)数据BK和m个有效象素数据R、G和B。而且数据驱动器50将所输入的经过一个通道移位的m个有效象素数据R、G和B转换成向第2条数据线DL2至第(m+1)条数据线DLm+1传送的模拟象素信号，同时将一个空白数据BK转换成向第一条数据线DL1传送的模拟空白信号。
同样，在借助定时控制器40的水平周期传送m个有效象素数据的同时，传送第一或最后一个象素数据的空白数据。而且数据驱动器50把m个有效象素数据和一个空白数据转换成列反转系统的象素信号和空白信号，并将它们送到液晶板12和15。因此，可以用点反转系统驱动液晶板12和15。
另一方面，当在点反转系统中驱动液晶板12和15时，若在Window ShutDown(视窗关机)时显示一个特定的点图案，那么会出现闪烁。这是因为其他图案的频率为60Hz的垂直驱动频率，而相反地，该特定点图案的频率为30Hz，从而发生30Hz频率的闪烁。
为了防止这种闪烁，通过采用垂直双点反转系统使闪烁的频率达到60Hz。在这种情况下，闪烁的频率变得与垂直驱动频率相一致，从而使人感觉不出闪烁。
参见图11，该图表示按照本发明另一个实施例所述采用垂直双点反转系统驱动的液晶显示器。
图11中所示的液晶显示器包括：液晶显示板52、栅极驱动器54、数据驱动器56和定时控制器58，其中液晶显示板52带有设置成矩阵形式的液晶盒，栅极驱动器54用于驱动液晶显示板52上的选通线GL1-GLn，数据驱动器56用于驱动液晶显示板52上的数据线DL1-DLm+1，而定时控制器58用于控制栅极驱动器54和数据驱动器56。
液晶显示板52包括N条选通线GL1-GLn，和M+1条与选通线GL1-GLn交叉并彼此绝缘的数据线DL1-DLm+1。而且液晶板52还包括液晶盒PXL和薄膜晶体管，所述液晶盒PXL和薄膜晶体管设置在由选通线GL1-GLn和数据线DL1-DLm+1交叉形成的每个区上。TFT响应来自选通线GL1-GLn的扫描信号并通过数据线DL1-DLm+1把象素信号送到液晶盒PXL上。液晶盒PXL响应象素信号并通过驱动位于共用电极(未示出)之间的液晶来控制透光率。
特别是，薄膜晶体管和液晶盒PXL沿数据线DL方向以Z字形每隔两条水平线依次排列设置。换句话说，包括在同一列中的液晶盒PXL和TFT’s通过两条水平线交替接至另外相邻的数据线。
例如，如图11所示，把与第(4K-3)和第(4K-2)条选通线GL1、GL2、GL5、GL6…相连的第(4K-3)(在此，K是正数)和第(4K-2)条水平线上的TFT和液晶盒PXL在靠近其左侧的位置分别连接到第1到第m条数据线DL1-DLm上。因此，第(4K-3)和第(4K-2)条水平线上的液晶盒PXL将通过TFT由来自靠近左侧数据线DL的象素信号充电。
另一方面，把与第(4K-1)和第(4K)条选通线GL3、GL4、GL7、GL8…相连的第(4K-1)和(4K)条水平线上的TFT和液晶盒PXL在靠近其右侧的位置分别连接到第2至第(m+1)条数据线DL2-DLm+1上。因此，第(4K-1)和第(4K)条水平线上的液晶盒PXL将通过TFT由来自靠近右侧数据线DL的象素信号充电。
此外，在图12所示的液晶显示板15中，把与第(4K-3)和第(4K-2)条选通线GL1、GL2、GL5、GL6…相连的第(4K-3)和第(4K-2)条水平线上的TFT和液晶盒PXL在靠近其右侧的位置分别连接到第2到第m+1条数据线DL2-DLm+1上。因此，第(4K-3)和第(4K-2)条水平线上的液晶盒PXL将通过TFT由来自靠近右侧数据线DL的象素信号充电。
另一方面，把与第(4K-1)和第(4K)条选通线GL3、GL4、GL7、GL8…相连的第(4K-1)和(4K)条水平线上的TFT和液晶盒PXL在靠近其左侧的位置分别连接到第1至第m条数据线DL1-DLm上。因此，第(4K-1)和第(4K)条水平线上的液晶盒PXL将通过TFT由来自靠近左侧数据线DL的象素信号充电。
定时控制器58产生控制选通线54和数据驱动器56的定时控制信号，并将象素数据信号送到数据驱动器56。在定时控制器58中产生的栅极定时控制信号包括栅极起动脉冲GSP、栅极移位时钟信号GSC、栅极输出使能(enable)信号GOE等。在定时控制器58中产生的数据定时控制信号包括源极起动脉冲SSP、源极移位时钟信号SSC、源极输出使能(enable)信号SOE、极性(polarity)控制信号POC等。
栅极驱动器54利用栅极定时控制信号，按序向选通线GL1-GLn传送扫描信号。所以，栅极驱动器54可响应扫描信号并通过水平线来驱动薄膜晶体管。
数据驱动器56把象素数据转换成模拟象素信号，并且在扫描信号送到选通线GL中时，通过水平周期把一条水平线的象素信号送到数据线DL1-DLm+1中。在这种情况下，数据驱动器56借助于来自伽马电压发生器(图中未示)的伽马电压把象素数据转换成象素信号并传输这些信号。
此外，数据驱动器56以列反转驱动系统的方式提供象素信号，即通过数据线DL使象素信号的极性反向。换句话说，数据驱动器56向奇数数据线DL1、DL3、…，和偶数数据线DL2、DL4、…传送具有相反极性的象素信号，而且传送到数据线DL中的象素信号的极性是通过帧频反向的。
在这种情况下，由于液晶盒PXL交替地连接到与之相邻的不同数据线上，所以，在用列反转系统向数据线DL1-DLm+1传送象素信号的基础上，可用垂直双点反转系统驱动液晶盒PXL。
特别是，数据驱动器56通过两个水平周期交替地改变象素信号的输出通道，从而可通过两条水平线向沿数据线DL1-DLm+1交替改变其位置的液晶盒PXL传送正确的象素信号。
在将象素信号传送到与右侧数据线DL1-DLm+1相连接的液晶盒PXL的情况下，数据驱动器56向m条数据线DL1-DLm传送m个有效象素信号，并且向第m+1条数据线DLm+1传送空白信号。与此不同的是，在向与左侧数据线DL1-DLm+1相连接的液晶盒PXL传送象素信号的情况下，数据驱动器56通过使信号右移一个通道来向2到m+1条数据线DL2-DLm+1传送m个有效象素信号，和向第1条数据线DL1传送空白信号。
例如，如图11所示，当液晶盒PXL驱动与右侧数据线DL1-DLm+1相连的第(4K-3)和第(4K-2)条水平线时，数据驱动器56向第1到第m条数据线DL1-DLm传送m个有效象素信号，此外还向第(m+1)条数据线DLm+1传送空白信号。而且当液晶盒PXL驱动与左侧数据线DL1-DLm+1相连的第(4K-1)和第(4K)条水平线时，数据驱动器56通过使信号右移一个通道而向第2到第(m+1)条数据线DL2-DLm+1传送m个有效象素信号并向第1条数据线传送空白信号。
与此不同的是，如图12所示，当液晶盒PXL驱动与左侧数据线DL1-DLm+1相连的(4K-3)和第(4K-2)条水平线时，数据驱动器56通过使信号右移一个通道而向第2到第(m+1)条数据线DL2-DLm+1传送m个有效象素信号，此外还向第1条数据线传送空白信号。而且当液晶盒PXL驱动与左侧数据线DL1-DLm+1相连的第(4K-1)和第(4K)条水平线时，数据驱动器56向第1到第m条数据线DL1-DLm传送m个有效象素信号并向第(m+1)数据线DLm+1传送空白信号。
这种数据驱动器56的实物(materialized)结构与图7中所示相同。然而，唯一不同的是，MUX阵列24通过两个水平周期改变了象素数据的通道。在此省略了对与上述结构和工作情况一致的更详细的说明。
参见图7，锁存器阵列22根据移位寄存器阵列20的采样信号锁存并输出来自定时控制器58的象素数据。
MUX阵列24根据来自定时控制器58的控制信号，通过两个水平周期改变来自锁存器阵列22的象素数据路线。特别是，当驱动与右侧数据线DL1-DLm+1连接的液晶盒PXL时，和在第(4K-3)和(4K-2){或是第(4K-1)和(4K)}水平周期期间没有改变通道的情况下，MUX阵列24将输出已输入的象素数据，并且向最后一个通道传送空白数据。与此不同的是，当驱动与左侧数据线DL1-DLm+1连接的液晶盒PXL时，和在第(4K-1)和(4K){或是第(4K-3)和(4K-2)}水平周期内，MUX阵列24通过使数据右移一个通道而输出已输入的象素数据，并且向第一通道传送空白数据。
为此，输入到MUX阵列24的控制信号通过两个水平周期形成极性反转。
DAC阵列26响应列反转极性控制信号POL，把来自MUX阵列24的象素数据和空白数据转换成使相邻通道的信号极性相反的象素信号和空白信号，并输出这些信号。
缓冲器阵列28把象素信号和空白信号从DAC阵列26分别送到数据线DL1-DLm+1。
因此，如图13A和13B所示，向数据线DL1-DLm+1传送的象素信号和空白信号的极性是经数据线和帧频转换的信号。
图13A和13B表示的是在奇数帧和偶数帧中施加到图11所示液晶板的数据线DL1-DLm+1中的象素信号和空白信号。
参照图13A，在第(4K-3)和(4K-2)水平周期内，把奇数帧中红、绿和蓝色的象素信号R、G和B传送到第1到第m条数据线DL1-DLm上，同时将空白信号BK送到第(m+1)条数据线DLm+1上。而且，将m/3个红、绿、和蓝色象素信号(R、G和B)中的每一个传送到第2到第(m+1)条数据线DL2-DLm+1中，而且同时在第(4K-1)和第(4K)水平周期2H、3H、…n-1H、nH内将空白信号BK送到的第一条数据线DL1上。
在这种奇数帧间隔(interval)内，总是将具有正极性的象素信号送到奇数数据线DL1、DL3、…、DLm+1上，而将具有负极性的象素信号送到偶数数据线上。因此，可以用垂直双点反转系统驱动在两条水平线上位置交替的液晶盒PXL。
参照图13B，在第(4K-3)和(4K-2)水平周期(period)内，将偶数帧中红、绿和蓝色象素信号(R、G和B)传送到第2至第(m+1)条数据线DL2-DLm+1上，同时，将空白信号BK送到第1条数据线DL1上。而且，将m/3个红、绿和蓝色象素信号(R、G和B)中的每一个传送到第1到第m条数据线DL1-DLm，而且同时在第(4K-1)和第(4K)水平周期2H、3H、…n-1H、nH内将空白信号BK送到的第(m+1)条数据线DLm+1上。
在这种偶数帧间隔内，与上述奇数帧相反，总是把具有负极性的象素信号送到奇数数据线DL1、DL3、…、DLm+1上，而把具有正极性的象素信号送到偶数数据线上。因此，可以用垂直双点反转系统驱动在两条水平线上位置交替的液晶盒PXL。
图14表示根据本发明另一个实施例所述垂直双点反转的液晶显示器。
除了定时控制器70和数据驱动器80的功能不同之外，图14中所示的液晶显示器具有与图11所示的液晶显示器相同的元件。
液晶显示板52上的液晶盒PXL和TFT设置在选通线GL1-GLn和数据线DL1-DLm+1之间的交叉区上，并布置成矩阵图形。
TFT和液晶盒PXL设置成Z字形，它们的位置采用由两条水平线沿着数据线DL1-DLm+1从右向左转的形式或是从左向右转的形式。换句话说，包含在同一列中的液晶盒和TFT每隔两条水平线交替地连接到与之相邻的不同数据线上。
例如，把与第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)条选通线相连接的第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}条水平线上的液晶盒PXL和TFT分别连接到靠近其左侧的第1到第m条数据线DL1-DLm上。因此，第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}条水平线上的液晶盒PXL通过TFT由来自靠近其左侧的数据线DL的象素信号充电。
另一方面，把与第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}条选通线相连接的第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}条水平线上的液晶盒PXL和TFT分别连接到靠近其右侧的第2条数据线DL2到第m+1条数据线DLm+1上。因此，第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}条水平线上的液晶盒PXL通过TFT由来自靠近其右侧的数据线DL的象素信号充电。
栅极驱动器54利用来自定时控制器70的栅极定时控制信号按序向选通线GL1-GLn传送扫描信号。
数据驱动器80把输入的象素数据转换成模拟象素信号，以便在向选通线GL传送扫描信号时，通过水平周期向数据线DL1-DLm+1传送一条水平线的象素信号。在这种情况下，数据驱动器80借助于来自伽马电压发生器(图中未示)的伽马电压把象素数据转换成象素信号并传送该信号。
此外，数据驱动器80通过列反转驱动系统传送象素信号，在所述列反转驱动系统中通过数据线DL1-DLm+1使象素信号反转。换句话说，数据驱动器80向奇数数据线DL1、DL3、…和偶数数据线DL2、DL4、…传送极性相反的象素信号，而送到数据线DL1-DLm+1上的象素信号的极性通过帧频反转。在这种情况下，由于是以用列反转驱动系统向数据线DL1-DLm+1传送象素信号为基础，通过两条水平线交替地把液晶盒PXL连接到与之相邻的不同数据线上，所以可以通过垂直双点反转系统驱动液晶盒。
特别是，为了向沿数据线DL1-DLm+1设置成Z字形的液晶盒PXL传送准确的象素信号，数据驱动器80在第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)水平周期内，向第1条数据线DL1传送空白信号，而向第2到第(m+1)条数据线DL2-DLm+1发送有效象素信号。而且在(4K-1)和(4K){或是(4K-3)和(4K-2)}水平周期内，向第1到第m条数据线DL1-DLm传送有效象素信号，和向第(m+1)条数据线DLm+1传送空白信号。
定时控制器70产生用于控制栅极驱动器54和数据驱动器80驱动的控制信号，并且向数据驱动器80提供象素数据。在定时控制器70中产生的栅极定时控制信号包括栅极起动脉冲GSP、栅极移位时钟信号GSC、栅极输出使能(enable)信号GOE等。在定时控制器70中产生的数据定时控制信号包括源极起动脉冲SSP、源极移位时钟信号SSC、源极输出使能(enable)信号SOE、极性控制信号POL等。
特别是，定时控制器70通过第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}水平周期内的特定单元按顺序传送一条水平线的m个象素数据，此外，把空白数据作为第(m+1)个象素数据发送。而且，在第(4K-1)和(4K){或是(4K-3)和(4K-2)}水平周期内，使传送的m个象素数据具有一个通道的滞后，而另外把空白信号作为第一个象素数据发送。
对于这种驱动而言，定时控制器70包括用于产生控制信号的控制信号发生器72，用于传送和输出所输入的象素数据的象素数据传送器74，用于使从象素数据传送器74输出的象素数据的最后一个象素数据延迟的寄存器76，和用于选择性地把来自象素数据传送器74的象素数据和来自寄存器76的延迟象素数据相结合的MUX78。
在使用水平同步信号H、垂直同步信号V和主时钟信号MCLK等信号时，控制信号发生器72产生控制栅极驱动器54的栅极定时控制信号和控制数据驱动器80的数据定时控制信号。此外，控制信号发生器72产生MUX78控制信号。在这种情况下，控制信号发生器72在使用水平同步信号H时，产生表示第(4K-3)和第(4K-2)水平周期和第(4K-1)和(4K)水平周期的控制信号(也就是说，信号极性通过两个水平周期而反转)，并将该信号送到MUX78中。
象素数据传送器74传送输入的象素数据并根据数据传输总线的层级(hierarchy)输出这些数据。例如，象素数据传送器74通过三条总线同步输出R、G和B象素数据，或者是通过六条总线同步输出奇数R、G、B象素数据和偶数R、G、B象素数据。把通过不包括最后一条总线的其他总线输出的象素数据(这些总线接到MUX78)和通过最后一条总线输出的象素数据，同时送到MUX78和寄存器76中。而且，象素数据传送器74对存在于数据使能(enable)间隔之间空白间隔内的空白数据BK进行采样并以数据使能间隔的形式输出。
寄存器76临时存储从象素数据传送器74输出的象素数据中通过最后一条总线传输的象素数据，并使这部分数据延迟一个通道。
在第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}水平周期内，MUX78响应控制信号并通过三条总线或六条总线把从象素数据传送器输入的m个象素数据和空白数据、第(m+1)个数据输出。
而且，在第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}水平周期内，MUX78响应控制信号，把通过第一或第二总线输入的象素数据从象素数据传送器74移位并输出到第二或第三总线中。或者，把通过第一至第五总线输入的象素数据移位并输出到第二至第六总线上。而且，最后一条总线的象素数据由寄存器76延迟一个通道，即，把第三或是第六总线输出到第一总线。在这种情况下，在第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}水平周期内，在空白间隔内存储到寄存器76中的空白数据将作为第一条总线中的第一数据发送。
在具有这种结构的定时控制器70中，在(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}水平周期以及第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}水平周期内，通过第三或第六总线传送到数据驱动器80上的象素数据和空白数据与上述图9A-图10B中所述相同。
参照图9A，在第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}水平周期内，定时控制器70通过第一总线DB1向数据驱动器80传送一个空白数据BK和m/3个红色象素数据R1、R2、R3…、Rm/3，通过第二总线DB2传送m/3个绿色象素数据G1、G2、G3、…Gm/3，和通过第三总线DB3传送m/3个蓝色象素数据B1、B2、B3…、Bm/3。通过这种方式，定时控制器70在数据使能(enable)信号DE的使能间隔内通过第一到第三总线DB1-DB3向数据驱动器80传送m个有效象素数据R、G和B。而且，定时控制器70按照后面的使能(enable)周期顺序传送空白数据BK。
因此，数据驱动器输入一个空白数据BK和m个有效象素数据R、G、B。而且，数据驱动器80把m个有效象素数据R、G、B转换成向第一到第m条数据线DL1-DLm发送的模拟象素信号，同时把一个空白数据BK转换成向第(m+1)条数据线DLm+1发送的模拟空白信号。
参照图9B，在第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}水平周期内，定时控制器70通过把m/3个红色象素数据R1、R2、R3…Rm/3移位到第二总线DB2，把m/3个绿色象素数据G1、G2、G3…、Gm/3移位到第三总线DB3而把这些信号发送到数据驱动器80中。而且，定时控制器70通过第一总线向数据驱动器80发送延迟一个通道的m/3个蓝色象素数据B1、B2、B3…、Bm/3和一个空白数据BK。通过这种方式，定时控制器70在数据使能(enable)信号DE的使能间隔内，通过第一到第三总线DB1-DB3向数据驱动器80发送移位一个通道的一个空白数据BK和m-1个有效象素数据R、G、B。而且，定时控制器70进一步包括按照后序的使能周期顺序发送移位一个通道的最后一个有效象素数据Dm/3。
因此，数据驱动器80输入一个空白数据BK和m个有效象素数据R、G、B。而且，数据驱动器80把输入的移位一个通道的m个有效象素数据R、G、B转换成向第2到第(m+1)数据线DL2-DLm+2发送的模拟象素信号，同时把一个空白数据BK转换成向第一条数据线DL1发送的模拟空白信号。
参照图10A，在第(4K-3)和第(4K-2){或是第(4K-1)和第(4K)}水平周期内，定时控制器70通过第一总线DB1向数据驱动器80传送一个空白数据BK和m/6个奇数红色象素数据OR1、OR2、OR3、…、ORm/6，通过第二总线DB2传送m/6个奇数绿色象素数据OG1、OG2、OG3、…、OGm/6，通过第三总线DB3传送m/6个奇数蓝色象素数据OB1、OB2、OB3、…、OBm/6，通过第四总线DB4传送m/6个偶数红色象素数据ER1、ER2、ER3、…、Erm/6，通过第五总线传送m/6个偶数绿色象素数据EG1、EG2、EG3、…、Egm/6，通过第六总线DB6传送m/6个偶数蓝色象素数据EB1、EB2、EB3、…、Ebm/6。
通过这种方式，定时控制器70在数据使能(enable)信号DE的使能间隔内通过第一到第六总线DB1-DB6向数据驱动器80传送m个有效象素数据R、G和B。而且，定时控制器70按照后面的使能周期继续(sequentially)传送空白数据BK。
因此，数据驱动器80输入一个空白数据BK和m个有效象素数据R、G、B。而且，数据驱动器80把m个有效象素数据R、G、B转换成向第一到第m条数据线DL1-DLm发送的模拟象素信号，同时把一个空白数据BK转换成向第(m+1)条数据线DLm+1发送的模拟空白信号。
参照图10B，在第(4K-1)和第(4K){或是第(4K-3)和第(4K-2)}水平周期内，定时控制器70通过把m/6个奇数红色象素数据OR1、OR2、OR3…ORm/6移位到第二总线DB2，把m/6个奇数绿色象素数据OG1、OG2、OG3…、OGm/6(原文有错)移位到第三总线DB3，把m/6个奇数蓝色象素数据OB1、OB2、OB3、…OBm/6移位到第四总线DB4，把m/6个偶数红色象素数据ER1、ER2、ER3…ERm/6移位到第五总线DB5，把m/6个偶数绿色象素数据EG1、EG2、EG3…EGm/6移位到第六总线DB6而把这些信号发送到数据驱动器80中。
而且，定时控制器70通过第一总线向数据驱动器80发送延迟(delay)一个通道的m/6个偶数蓝色象素数据EB1、EB2、EB3…、EBm/6和一个空白数据BK。通过这种方式，定时控制器70在数据使能(enable)周期内，通过第一到第六总线DB1-DB6向数据驱动器80发送移位一个通道的一个空白数据BK和m-1个有效象素数据R、G、B。而且，定时控制器70进一步按照后序的使能周期继续发送移位一个通道的最后一个有效象素数据Dm/6。
因此，数据驱动器80输入经移位一个通道的一个空白数据BK和m个有效象素数据R、G、B。而且，数据驱动器80把输入的移位一个通道的m个有效象素数据R、G、B转换成向第2到第(m+1)数据线DL2-DLm+2发送的模拟象素信号，同时把一个空白数据BK转换成向第一条数据线DL1发送的模拟空白信号。
同样，通过定时控制器70中的两个水平周期可以把第一或最后一个象素数据的空白数据与m个有效象素数据一起发送。而且数据驱动器80把m个有效象素数据和一个空白数据转换成列反转系统的象素信号和空白信号，并将这些信号发送到液晶板52中。因此，可用垂直双点反转系统来驱动液晶板52。
另一方面，在本发明的实施例中，所解释的仅仅是通过水平线或是通过两条水平线把液晶显示盒交替地连接到彼此不同的相邻数据线上的情况，然而，也可以通过三条水平线或多条水平线把液晶盒交替地相互连接。
如上所述，按照本发明所述的液晶显示器具有通过i(i为正数)条水平线交替连接到与之相邻的不同数据线上的液晶盒，所述液晶盒沿数据线设置成曲折形。此外，按照本发明所述的液晶显示器，其所提供的象素信号的极性由列反转系统确定，所以可以用i点反转系统来驱动液晶盒。而且，按照本发明所述的液晶显示器，其在每i个水平周期内同时发出m个有效象素信号和作为第一或最后一个象素数据的空白信号，从而可将正确的象素信号传送到沿曲折线布置的液晶盒中。
最后，按照本发明的液晶显示器，与i点反转系统相比，不仅明显地降低了能耗而且提高了图象质量，这是因为它可在列反转系统的能耗下，用i点反转系统驱动。
尽管以上通过附图中所示的实施例对本发明进行了说明，但是很显然，对于熟悉本领域的技术人员来说，本发明并不限于这些实施例，而是可以在不脱离本发明构思的情况下做出各种改进和变型。因此，本发明的范围将由所附权利要求及其等同物确定。

Claims (13)

1.液晶显示器，包括：
液晶显示板，所述液晶显示板上设有多个液晶显示盒，所述液晶显示盒形成在相互交叉的选通线和数据线之间，而且所述多个液晶盒借助于i(i是正数)条水平线并通过薄膜晶体管交替地连接到与之相邻的不同数据线上；
栅极驱动器，其用于驱动选通线；
数据驱动器，其用于驱动数据线而且包括多路复用器阵列和数模转换器阵列，所述多路复用器阵列用于确定输入象素数据的输出通道和根据控制信号添加一个空白数据，所述控制信号的极性由“i”条水平线反转，所述数模转换器阵列用于把象素数据和空白数据转换成象素信号和空白信号，这些信号的极性通过数据线和帧频反转。
2.根据权利要求1所述的液晶显示器，其中液晶显示板包括：
由连接到靠近其左侧数据线上的液晶盒构成的第一水平线；和
由连接到靠近其右侧数据线上的液晶盒构成的第二水平线。
3.根据权利要求2所述的液晶显示器，其中第一水平线和第二水平线借助水平线交替设置。
4.根据权利要求2所述的液晶显示器，其中第一水平线和第二水平线借助两条水平线交替设置。
5.根据权利要求3所述的液晶显示器，其中多路复用器阵列在驱动第一水平线的第一水平周期内，使输出通道保持与输入通道不同的象素数据，并向最后一个输出通道发送空白数据，而在驱动第一水平线的第二水平周期内，使象素数据产生一个通道的移位并将该数据发送给输出通道而且把空白数据发送给第一输出通道。
6.根据权利要求1所述的液晶显示器，其中数据驱动器进一步包括：
移位寄存器阵列，其发送连续的采样信号；
锁存器阵列，其根据采样信号通过特定数量的通道锁存象素数据，并且同时把这些数据输出和发送到多路复用器阵列；和
缓冲器阵列，其缓冲来自数模转换器阵列的象素信号和空白信号，并把这些信号分别送到数据线中。
7.液晶显示器，包括：
液晶显示板，所述液晶显示板上设有多个液晶显示盒，所述液晶显示盒形成在相互交叉的选通线和数据线之间，而且多个液晶显示盒借助于i(i是正数)条水平线并通过薄膜晶体管交替地连接到与之相邻的不同数据线上；
栅极驱动器，其用于驱动选通线；
数据驱动器，其用于把输入的象素数据和空白数据转换成象素信号和空白信号，并把这些信号传送到数据线，所述信号的极性通过数据线和帧频反转；和
定时控制器，其用于控制栅极驱动器和数据驱动器，并且同时向带有象素数据的第一通道或最后一个通道中的任一通道添加空白数据，并根据在i水平周期转向的控制信号向数据驱动器发送数据。
8.根据权利要求7所述的液晶显示器，其中液晶显示板包括：
由连接到靠近其左侧数据线上的液晶盒构成的第一水平线；和
由连接到靠近其右侧数据线上的液晶盒构成的第二水平线。
9.根据权利要求8所述的液晶显示器，其中第一水平线和第二水平线借助水平线交替设置。
10.根据权利要求8所述的液晶显示器，其中第一水平线和第二水平线借助两条水平线交替设置。
11.根据权利要求8所述的液晶显示器，其中定时控制器在驱动第一水平线的第一水平周期内，向数据驱动器发送作为最后一个通道添加的象素数据和空白数据，并在驱动第二水平线的第二水平周期内向数据驱动器发送延迟一个通道的象素数据和添加到第一通道中的空白数据。
12.根据权利要求8所述的液晶显示器，其中定时控制器包括：
控制信号发生器，其产生控制栅极驱动器和数据驱动器的控制信号，并在i水平周期内产生极性反向的控制信号；
象素数据传送器，其在数据使能(enable)周期，通过多条第一总线把输入的象素数据传送到输出端，并通过第一总线发送空白数据；
延迟器，其把通过第一总线中最后一条总线传输的象素数据和空白数据延迟一个通道；和
多路复用器，其事实上响应控制信号并通过多条第二总线发送空白数据以及通过第一总线输入的数据或是把通过第一总线输入的象素数据与延迟一个通道的空白数据结合起来通过第二总线发送。
13.根据权利要求12所述的液晶显示器，其中在驱动第一水平线的第一水平周期内，多路复用器通过第二总线发送空白数据和经第一总线输入的象素数据，而同样，在驱动第二水平线的第二水平周期内，多路复用器使得通过除了最后一条第一总线之外的其他第一总线输入的象素数据产生一个通道的移位，并通过除第一条第二总线之外的其他第二总线发送这些象素数据，和通过第一条第二总线发送有一个通道延迟的象素数据和空白数据。
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