CN1375808A - 帧速率控制器 - Google Patents

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Abstract

提供一种用于控制有源阵列显示器的帧刷新速率的帧速率控制器20。控制器20包括第一电路,比如可预加载的同步计数器21,它对垂直同步信号VSYNC计数并对数据的每个第N帧提供启动信号FE,其中N是大于0的整数并且可选择。选通装置26由启动信号FE控制,以便有源阵列显示器对数据的每个第N帧刷新,从而允许显示器在功率消耗上的降低。

Description

帧速率控制器
发明的背景
1.发明的领域:
本发明涉及一种用于控制有源阵列显示器的帧刷新速率的控制器。本发明也涉及一种包括这样的帧速率控制器的显示控制器和包括这样的控制器的有源阵列显示器。这样的显示器可以用在这样的便携式设备中,在该设备中数据可以以各种格式提供给显示器并且希望该设备将显示功率消耗最小化。
2.关技术的描述
附图的图1示出了典型的已知类型的有源阵列液晶显示器。该显示器包括图像元素(像素)的N行和M列的有源阵列1。每个像素包括与反电极(未示出)相对的像素电极2,它们之间具有液晶材料层(未示出)。像素电极连接到像素薄膜晶体管(TFT)3的漏极,TFT的源极连接到数据线4,该数据线对一列的所有像素共用,并且TFT的栅极连接到扫描线5,该扫描线对一行的所有像素共用。
数据线4连接到数据线驱动器6,该数据线驱动器从数据控制器(未示出)接收计时、控制和数据信号并提供用于控制数据线4的模拟电压。扫描线5连接到扫描线驱动器7,该扫描线驱动器由计时信号控制并且一次一个以循环重复的顺序向扫描线5提供扫描线脉冲。
图像数据逐帧被发送到数据驱动器。在每一帧中,图象数据用对应于显示像素的水平行的要求的显示状态的数据的每条线一条线接一条线地被发送。数据线一次一个地加载到数据线驱动器6中,数据线驱动器6控制数据线4到需要的电压。扫描线驱动器7则向将被更新的像素的行提供扫描脉冲。行的像素晶体管3在它们的栅极接收扫描脉冲并转换到传导状态,从而在数据线4上的电压控制被刷新的线的像素电极2。这种过程被一行一行地重复直到整个显示屏已经用刷新的数据帧刷新为止。接着这样的过程对每个数据帧重复。
附图的图2以集成电路形式描述了典型的液晶显示控制器10,该电路通常与显示屏物理上分离。控制器10包括接收时钟信号(CKS)、水平同步信号(HS)和垂直同步信号(VS)的计时信号发生器。计时信号发生器11把这些计时信号传送到显示屏并产生用于控制显示控制器10的操作的计时信号。
控制器10能够以亮度和色度格式(Y,Cr,Cb)或以RGB(红,绿,蓝)格式接收视频数据。阵列12把色度格式数据转换为RGB格式数据。屏上显示混合器13从阵列12或直接从RGB输入端接收RGB数据并混合上述信号和来自外部静态随机存取存储器14(SRAM)的屏上显示数据,从而任意屏上显示数据覆盖视频数据。混合器13的RGB输出连接到伽马校正电路15,它补偿像素对电压的非线性响应并允许例如对显示图象的颜色、亮度和色调作出图像调整。
伽马校正电路15的RGB输出以并列的数字格式提供到数字输出16以为要求数字输入视频数据的显示器所使用。对要求模拟输入数据的显示器,伽马校正电路15的输出被提供给数字/模拟转换器(DAC)17,它把红、绿和蓝的图像数据转换为对应的模拟电压电平。这些电压电平被放大器18放大并提供给模拟输出19。
在典型的液晶显示控制器集成电路中,数据的频率能够被调整到显示的特殊要求。例如,控制器10可以用SVGA格式或XVGA格式输出数据,这两种格式对给定的帧速率具有不同的数据传输速率。帧速率本身典型地是固定于为显示屏的液晶材料所要求的刷新率特性的频率。
在用在便携式或电池驱动设备中的显示器中,希望尽可能地减少功率消耗从而延长电池寿命并减少更换电池的频率。US5926173公开了用于这样的显示器中的功率节省技术,在该技术中当检测到新的图像数据提供给液晶显示器(LCD)时,供给LCD的电源被终止。US5757365公开了另一种用于显示驱动器的功率节省技术,其中也检测到缺少图像数据,在这种情况下,包含帧存储器的驱动器操作在低功率自刷新模式。
US5712652公开了具有LCD的便携式计算机。该专利说明书公开了降低视频图形控制器的刷新率从而降低功率但没有描述用于实现该目的的任何技术。
US6054980公开了用于提供在以一个帧速率提供显示数据的计算机和不能在这样高的帧速率下操作的显示设备之间的帧速率转换,但是其中提供和显示帧速率彼此之间具有很大差别。这通过帧缓冲器的使用获得,在帧缓冲器中图象数据以提供速率被写入并以显示速率被读出,从而图象数据的每个第(N+1)帧被有效地转储,其中N是大于0的整数。
US5991883公开了一种在便携式电脑等中用于管理功率消耗的技术。显示刷新速率适合于将被显示的图像的类型。降低了的刷新率通过降低图像数据的处理速度实现,例如通过减少视频图形控制器的像素时钟速率来实现。
US544840公开了降低视频数据被提供的速率从而使一些处理脱离运行图形用户界面的计算机系统的CPU。新的图像数据被写入到相对快速的RAM中并接着刷新或更新显示设备,其以相对低的速率发生,该速率刚好足够快以避免不希望的可察觉的视觉赝象。
发明的简述
根据本发明的第一方面,提供一种用于控制有源阵列显示器的帧刷新率的控制器,其特征在于包括:第一电路,响应于来自显示控制器的显示信号用于为每个第N帧提供启动信号,其中N是大于0的整数并可从多个数值中选择;和第二电路,用于响应于启动信号用提供给显示控制器的每个第N帧启动显示的刷新并在启动信号不存在时用于用提供给显示控制器的每个其他帧阻止显示的刷新。
显示信号可以包括帧同步信号并且第一电路可以响应于每个第N帧同步信号。
第一电路可以用于为每个第N帧的持续时间提供启动信号。
第二电路可以用于响应于启动信号连接显示器与电源并在启动信号不存在时断开显示器与电源。
第二电路可以用于选通至少一个影响显示器的功率消耗的信号。第二电路可以包括至少一个用于连接显示控制器和显示器之间的门电路。该至少一个门电路可以包括至少一个逻辑门,例如在该门中显示信号时数字格式。该至少一个门电路可以包括至少一个传输门电路,它可以例如被用于模拟或数字显示信号。第二电路可以用于选通显示控制器的存储器读出控制信号。
该至少一个信号可以包括来自显示控制器的帧同步信号。
该至少一个信号可以包括来自显示控制器的线同步信号。
该至少一个信号可以包括来自显示控制器的至少一个图像确定信号。
第一电路可以包括用于固定N为大于1的值的装置。作为替换,N可以从多个预订或固定的值中选择。作为另一个替换,第一电路可以具有一个输入,用于选择N值。
第一电路可以包括可预加载的同步计数器。计数器可以具有用于提供启动信号的终端计数输出。计数器可以具有连接到终端计数输出的可加载启动输入端。计数器可以具有用于从显示控制器接收帧同步信号的时钟输入。
控制器可以具有帧速率降低启动输入。计数器可以具有计数启动输入,用于在启动输入由速率降低启动信号启动。计数启动输入可以连接到启动输入,作为一个替换,计数启动输入可以经D型锁存器和一个连接设置/复位触发器连接到启动输入。
根据本发明的第二方面,提供一种包括根据本发明的第一方面的帧刷新率控制器的显示控制器。
启动输入可以被连接以接收显示控制器的存储器写入控制信号。
根据本发明的第三方面,提供一种包括根据本发明的第一方面的控制器的有源阵列显示器。
控制器的第二电路可以邻近用于接收显示信号的显示器的输入放置并可以用于选通所有的显示信号。
显示器可以包括多个数据和扫描驱动器集成电路,每个显示器包括根据本发明的第一方面的控制器。
显示器可以包括液晶显示器。
对用于移动产品的显示器,将被显示的图像数据可以有重要的改变,例如从固定的低彩色图文改变到全彩色全运动的视频图像。本帧速率控制器允许帧速率和功率消耗根据理想的图像显示要求被设置。这允许显示器消耗基本上更低的功率。
例如,对于运动画面图像,帧速率控制器能够被禁用或设置与来自帧控制器的帧速率相同的显示帧速率。从而,显示在普通帧速率下的操作,比如在每秒60和80帧之间的图像速率。
用已知的压缩标准发送的数字图像通常以低于标准视频速率提供,例如以每秒15帧的速率。因此当显示这样的图像时显示器能够以每秒15帧的速率被刷新并且能够基本上实现功率损耗的降低。
对比如图文的相对静止的图像,控制器能够降低显示器的帧速率到最小的等级,在该等级上观察不到可视的闪烁。这可以例如是每秒4帧的等级。因此,当显示这样的图像时,即使更大的功率消耗降低也能够实现。
本控制器实现相对简单并需要相对小数量的电子元件。因此控制器可以具有很少或没有附加成本,并可以例如在多晶硅集成电路驱动器中实现。
附图的简要说明
本发明将通过例子参照附图进一步说明,其中:
图1是已知类型的有源阵列显示器的示意性框图;
图2是已知类型的集成电路显示控制器的电路框图;
图3是构成本发明的实施例的帧速率控制器的电路框图;
图4是描述产生在图3的控制器中的波形的时序图;
图5(包括图5a和5b)是描述用在图3中的两种类型的选通装置的电路图;
图6是描述用于有源阵列液晶显示器的极性反转控制装置的电路图;
图7是构成本发明的另一个实施例的有源阵列液晶显示器的示意性框图;
图8是构成本发明的进一步的实施例的有源阵列液晶显示器的示意性框图;
图9是构成本发明的进一步实施例的有源阵列显示器和显示控制器的示意性框图;
图10(包括图10a和图10b)是图3的抑制计数器的电路图;
图11是图10的触发器逻辑块的电路图;
图12是构成本发明的另一个实施例的帧速率控制器的框图;
图13是构成本发明的另一个实施例的帧速率控制器的框图。
在全部附图中同样的附图标记表示同样的部件。
最佳实施例的描述
图3所示的帧速率控制器20是用于连接在例如图2所示类型的显示控制器的输出和例如图1所示类型的液晶或其它类型有源阵列显示器的输入之间的任何一个适当的点。控制器20包括以N比特二进制计数器形式的可预加载同步或“抑制”计数器21。控制器20具有用于从显示控制器接收标准计时、控制和数据信号并向显示器发送帧速率控制的计时、控制和数据信号的并行的多个输入22和输出23。计数器21具有时钟输入CP,它连接到传输垂直同步信号VSYNC的计时线。这样的信号典型地用于启动平板阵列显示器中的门电路或行驱动器,并且这些信号通常被作为门电路驱动器起始脉冲GSP。计数器21的计数器启动输入CEP被连接从而接收用于启动和禁用帧刷新率降低的帧速率控制信号FRC。计数器21具有数据输入D(1:N),它包括启动并行表示将被预加载到计数器21中的数字值的并行加载输入。数据输入连接到用于控制帧降低率的帧计数输入F(1:N),帧降低率等于输入信号帧速率除以输出信号帧速率。信号FRC和FC(1:N)例如从与显示器和控制器20结合的设备中的电路提供。这样的电路表明何时要求帧速率降低以及根据将被显示的图像信号要求多大的帧速率降低率。
计数器21具有终端计数输出TC,它只有当计数器21达到所有它的输入Q(1:N)提供一个二进制高电平或“一个”信号这样的终端计数时才产生逻辑高电平信号。终端计数输出TC连接到平行加载启动输入PE和一个或门24的第一输入,该或门的输出提供帧启动信号FE。门电路24的第二输入连接到倒相器25,倒相器的输出被连接以接收帧速率控制信号FRC。门电路24的输出连接到选通装置26的控制输入,选通装置响应于帧启动信号FE从输入22向输出23传送所有的计时、控制和数据信号并在没有帧启动信号FE时阻碍所有信号。
帧速率控制器20能够通过提供逻辑低电平信号作为帧速率控制信号FRC而被禁用。控制器21被禁用并且反相器25经门电路24向选通装置26提供逻辑高电平,从而从输入22向输出23传送所有的计时、控制和数据信号。因此,不发生帧速率降低并且显示刷新率通过由显示控制器提供的信号控制。
当要求帧速率降低时,帧速率控制信号FRC是逻辑高电平从而计数器21被启动。从而计数器21对垂直同步信号计数并且当它达到最大或最终计数时,终端计数输出TC到达逻辑高电平。并行加载启动输入PE从而被启动并且提供给输入FC(1:N)的二进制数加载到计数器21中从而预置它为用于控制帧降低率的二进制数。只要计数器由控制信号FRC启动,反相器25的输出就保持在逻辑低电平。下一帧或垂直同步信号启动计数器的预加载从而终端计数输出TC成为逻辑低电平,门电路24向选通装置26提供逻辑低电平,并且选通装置阻碍从输入22向输出23传递的计时、控制和数据信号的传输。显示器的刷新因此停止。
计数器21计数每个垂直同步脉冲直到计数器达到它的最终计数值。输出TC成为逻辑高电平并且选通装置26由帧启动信号FE启动开始从输入22向输出23传送信号。全部的数据帧被传送给显示器,显示器从而由图像数据的新一帧再次刷新。当下一个垂直同步脉冲到达时,计数器21被复位到输入FC(1:N)的二进制值,选通装置26被禁用以防止显示的刷新,并且程序被重复直到计数器21再次达到它的最终计数。
帧速率以等于1加上计数器的最大二进制计数减去帧计数输入FC(1:N)的二进制值的因数降低。该比率等于2N-FC,其中N是计数器21的级数并且FC是输出FC(1:N)的二进制值。
图4描述了发生在控制器20的特殊例子中的波形,其中计数器21包括4比特二进制计数器(N=4)和帧计数输入FC(1:4)接收表示13的预加载的二进制数1101。所述波形是门电路线起始脉冲GSP,它的反码GSPB,源驱动器起始脉冲(线同步脉冲)SSP和它的反码SSPB,计数器21的二进制级输出Q0至Q3,帧启动信号FE,和对应的输出脉冲GSP*、GSBP*、SSP*和SSPB*出现在控制器20的输出23。
在时刻T1,计数器21已经用表示13的二进制数值1101预加载,从而最终计数器输出TC和帧启动信号FE是逻辑低电平。当下一个脉冲GSP在输入22被接收时,计数器21加1以获得值14。然而,最终计数输出TC保持低逻辑电平从而选通装置26保持禁用。
在时刻T2,下一个脉冲GSP被接收并且计数器21加1使它的最终计数为15。启动信号FE从而升到高逻辑电平并且选通装置26被启动从而向输出23并因此向有源阵列显示器传送所有的显示信号。
一接收到表示下一个帧刷新循环开始的下一个信号GSP,二进制值1101被加载到计数器21。输出TC和启动信号FE转换到低逻辑电平从而选通装置26被禁用直到计数器21下一次达到它的最终计数。
这一过程的循环被重复从而只有对每个第三帧的起始信号、线同步信号和图像数据信号被提供给显示器。
显示器根据它的特定类型可以要求模拟或数字信号。在显示要求数字信号的情况下,选通装置26可以包括多个如图5(a)所示的与门30。将被控制的每个信号线包含这样的门电路,即具有提供给一个门输入的标准输入和提供给每个门的另一个输入的帧启动信号FE的门电路。
图5(b)示出了可以被用于模拟(或数字)信号的另一个装置。图5(b)所示装置同样被提供将被控制的每个信号线并包括由场效应晶体管M1和M2形成的传输门、反相器31和断开场效应晶体管M3。对图5所述的两个选通装置,当装置被禁用时,选通装置的输出在低逻辑电平。但是,对当没有被刷新时需要一些其他电平的显示器,可以提供其他装置,例如从而显示输入保持在逻辑高电平或在高阻抗状态。
尽管图3的控制器已经用从显示控制器向显示器选通所有信号线来描述,但是这并不总是必要的。尤其是,对控制或选通影响显示器的功率消耗的那些信号线来说就足够了。例如,只选通垂直同步信号或垂直和水平同步信号都选通可能是足够的。而且,取代选通向显示输入提供的信号,对一些显示器控制向显示器提供的功率是有可能的或适当的,在这些显示器中只有当接收将被用于刷新显示的那些帧时才被驱动。
通常对将被AC驱动的有源阵列液晶显示器来说提供给每一像素的电压的极性一帧接一帧地变换。根据控制器20的实际实施,有必要确保在降低帧速率操作期间发送给显示器的连续视频数据反极性。例如,这可以通过只在奇数时应用帧速率降低比率来获得。但是,在图6中描述了允许使用任意帧速率比的另外的结构。该结构包括具有时钟输入CK的触发器32,该时钟输入被连接用来接收由帧速率控制器20提供的垂直同步脉冲VSYNC*。触发器32具有与反向输出QB连接的一数据输入D和一直接输出Q,该输出向显示器提供极性控制信号从而控制提供给阵列像素的电压的极性。
通常,图2的显示控制器10与显示器物理分离,并且例如用集成电路或集成电路的一部分来完成。帧速率控制器也可以用物理上分离的装置来完成,例如用连接在显示控制器和显示器之间的集成电路来完成。通过选通所有的信号线,该装置确保在对显示器的信号和计时通路的电容充电和放电时没有功率消耗。
图7描述了另一个结构,其中帧控制器20与数据和扫描驱动器6和7单片集成在同一个衬底上,例如在相同的衬底35上使用基本上相同的薄膜晶体管(TFT)处理。从而帧速率控制器控制从显示器的输入提供给驱动器6和7的信号,该显示器与显示控制器物理分离。
图8描述了数据和扫描驱动器用几个集成电路36、37完成的有源阵列显示器的类型,例如在单晶硅上制作并通过任何适当的装置比如直接芯片焊接或柔性连接器连接到有源阵列衬底上。在该实施例中,每个驱动器36、37包括形成在各个集成电路内的帧速率控制器20。
图9描述了另一个结构,其中帧速率控制器20放置在内部并且形成显示控制器集成电路10的部分。驱动器36和37用与图8相同的形式示出,但是可以另外集成在图7所述的有源阵列衬底上。
尽管帧速率控制器20具有通过适当地对预加载到计数器21中的值编程来以任意理想的数量(在有计数器21的最大容量确定的范围内)来降低帧速率的功能,但是某些应用可能要求单个预定帧速率降低率。在这种情况下,不需要帧速率控制输入FC(1:N)并且计数器21的数据输入D(1:N)能够硬线连接到适当的电压级以获得理想的降低率。帧速率降低则可以以帧速率控制输入FRC的形式通过启动或禁止计数器21来获得
当不要求完全灵活的帧速率降低比的设计时,可以提供这样的转换结构,比如帧速率降低比能够从几个预置的或固定比的任一个中选择。
图10以六比特可预加载同步二进制计数器的形式(N=6)示出了计数器21的例子。计数器的每一级包括D-型触发器41-46和相关联的双稳逻辑块47-52。计数器21的输入和输出在图10中用与图3中相同的方式标记从而互相对应。计数器进一步包括反相器53-57、两输入与门58、两输入或非门59-61和两输入与非门62和63。
每个双稳逻辑块47-52如图11所示并且包括四个传输门,这四个传输门包括多对CMOS晶体管65、66;67、68;69、70;和70,72和反相器73和74。每个双稳逻辑块具有连接到反相器21的输入PE和双稳输入T的预加载启动输入PE。每个双稳逻辑块也具有信号输入DL、QB和Q以及输出D。
当输入PE在逻辑高电平时,每个双稳逻辑块的输出D在输入DL接收信号。当输入PE在逻辑低电平时,如果双稳输入T的信号在逻辑高电平则输出D从输入QB接收信号,而如果双稳T的信号在逻辑低电平则从输入Q接收信号。
图10和11所述的反相器的结构和操作本领域技术人员很容易理解并将不再描述。
图12示出了另一种与图3所示的帧速率控制器类似的帧速率控制器,其中它也包括计数器21、门电路24和反相器25,它以上述方式产生帧启动信号FE。但是,选通装置26与显示控制器10的修改类型相配合,显示控制器包括随机存取存储器(RAM)80和用于控制控制器10的操作并尤其是存储器80的操作的计时电路81。
存储器80形成帧缓冲器存储器并具有显示图像数据的至少一帧的功能。存储器具有用于例如从与控制器10连接的或控制器10是它的一部分的计算机接收将被显示的数据的数据输入D。存储器80具有连接到控制器20的输入22的并行的数据输出。
显示控制器10也从计算机接收写信号W和时钟信号CK。写信号W连接到存储器80的写控制输入并且时钟信号CK施加到计时电路81,该计时电路产生用于控制控制器10的操作并尤其控制存储器80的读和写操作的计时信号。计时电路81产生施加到帧速率控制器的输入22并包括读信号R′的控制信号。在已知类型的控制器中,读信号R′将直接连接到存储器80的读输入。但是,在图12所示的结构中,来自计时电路81的传统的读信号R′施加到形成选通装置26的与门的第一输入,并且该与门具有连接到或门24的输出以接收帧启动信号FE的第二输入。选通装置26在它的输出提供选通的读信号R,该读信号被返回到显示控制器10并被连接到存储器80的读输入。
如上文所述,当帧速率降低被禁用时,帧启动信号FE保持在逻辑高电平,从而选通装置26把传统的读信号R′作为读信号R从计时电路81传送到存储器80的读输入。从而,计时由计时电路81有效地控制并且不产生帧速率降低。
当需要帧速率降低时,门电路24对(N-1)帧期间提供逻辑低电平信号并对每个第N帧的持续时间提供逻辑低电平信号。显示数据以通常的方式被读入到存储器80,但提供到存储器80的读信号R只允许每个第N帧期间读出图像数据。因此,存储器的数据输出被有效地禁止,直到帧启动信号FE启动读信号R。
尽管示出了控制信号不经过选通从显示控制器10通过帧速率控制器20传输到显示器,控制信号也可以用与上文所述并在图3中描述的相同的方式被选通。因此显示器只被图像数据的每个第N帧刷新,从而它的功率消耗被相当大程度地降低了。
在上述的实施例中,帧速率控制信号FRC由任意适当的技术产生以选择帧速率降低是否被执行。例如,信号FRC可以如上文所述根据将被显示的图像数据的类型产生。图13描述了与图12所示装置不同的实施例,其中帧速率控制信号FRC自动地从写控制信号W产生。
图13所示的帧速率控制器20与图12所示的实施例的不同之处在于反相器25被省略并且信号FRC提供给串联连接的触发器82和83。信号FRC包括提供给显示控制器的存储器80的写控制信号W。该信号提供给设置/复位触发器的设置输入S,该触发器的复位输入R接收提供给控制器20的垂直同步信号并且它的反相输出IQ连接到D型触发器83的数据输入D。触发器83具有被连接以接收垂直同步信号的时钟输入、连接到计数器21的计数器启动输入CEP的输出Q和连接到或门24的一个输入的反相输出IQ。
当新的数据被连续提供到存储器80从而写控制信号W在连续的垂直同步脉冲之间被启动时,计数器21被禁用并且在触发器82中设定的写启动信号W的值由每个垂直同步信号记录到D型触发器83中。写启动信号W是“低活性”型从而触发器83的反相输出!Q保持在高电平。从而读控制信号R′不被修改作为信号R传送并且计时电路81控制存储器80的读出。因此,不发生帧速率降低。
如果在帧周期期间没有数据写入到存储器80中,触发器83启动计数器21并且如上文所述选通装置26由计数器21的最终计数输出TC控制。因此如上文所述按照理想的帧速率降低执行帧速率降低,并且这将连续进行除非并直到另外的数据写入到存储器80中。
因此有可能提供一种装置,其中有源阵列显示器的帧刷新率能够被控制从而降低或最小化显示器的功率消耗。降低的功率消耗通过防止显示器被刷新并以降低的速率启动刷新来获得,例如按照将被显示的数据类型由显示数据发生装置选择。静止图像将被显示时,例如用于显示图文时,帧刷新率可以降低到与避免显示器的可视闪烁一致的最小值。显示器可以以它全部的刷新率,例如全彩色全运动视频图像操作。当图像信号以中间速率改变时,帧刷新速率可以降低到与实际图像速率相匹配。因此,降低的功率消耗能够由相对简单的装置实现,该装置包含很少或不含有制造期间的制造、复杂性和收益率的浪费这类缺点。因此在电池供电设备的情况下,电池寿命被延长。

Claims (29)

1.一种用于控制有源阵列显示器的帧刷新率的控制器,其特征在于包括:第一电路,响应来自显示控制器的显示信号为每个第N帧提供启动信号(FE),其中N是大于0的整数并可从多个数值中选择;和第二电路,用于通过提供给显示控制器的每个第N帧启动显示的刷新以响应启动信号(FE),并在启动信号(FE)不存在时用于通过提供给显示控制器的每个其他帧阻止显示的刷新。
2.权利要求1所要求的控制器,其特征在于显示信号可以包括帧同步信号(VSYNC)并且第一电路可以响应于每个第N帧同步信号(VSYNC)。
3.权利要求1所要求的控制器,其特征在于第一电路用于为每个第N帧的持续时间提供启动信号(FE)。
4.权利要求3所要求的控制器,其特征在于第二电路可以用于连接显示器与电源以响应启动信号(FE)并在启动信号(FE)不存在时断开显示器与电源。
5.权利要求3所要求的控制器,其特征在于第二电路用于选通至少一个影响显示器的功率消耗的信号。
6.权利要求5所要求的控制器,其特征在于第二电路包括至少一个用于显示控制器和显示器之间连接的门电路。
7.权利要求6所要求的控制器,其特征在于至少一个门电路包括至少一个逻辑门。
8.权利要求6所要求的控制器,其特征在于至少一个门电路可以包括至少一个传输门电路。
9.权利要求5所要求的控制器,其特征在于第二电路用于选通显示控制器的存储器读出控制信号(R′)。
10.权利要求5所要求的控制器,其特征在于至少一个信号包括来自显示控制器的帧同步信号。
11.权利要求5所要求的控制器,其特征在于至少一个信号包括来自显示控制器的线同步信号。
12.权利要求5所要求的控制器,其特征在于至少一个信号包括来自显示控制器的至少一个图像确定信号。
13.权利要求1所要求的控制器,其特征在于第一电路包括用于固定N为大于1的值的装置。
14.权利要求1所要求的控制器,其特征在于N从多个预定值中选择
15.权利要求1所要求的控制器,其特征在于第一电路具有用于选择N值的输入(FC(1:N))。
16.权利要求1所要求的控制器,其特征在于第一电路包括可预加载的同步计数器。
17.权利要求16所要求的控制器,其特征在于计数器具有用于提供启动信号(FE)的终端计数输出(TC)。
18.权利要求17所要求的控制器,其特征在于计数器具有连接到终端计数输出(TC)的加载启动输入(PE)。
19.权利要求16所要求的控制器,其特征在于计数器可以具有用于从显示控制器接收帧同步信号(VSYNC)的时钟输入(CP)。
20.权利要求1所要求的控制器,其特征在于具有帧速率降低启动输入。
21.权利要求1所要求的控制器,其特征在于,第一电路包括可预加载的同步计数器并且计数器具有计数启动输入,配置用于通过帧速率降低启动输入(FRC)的速率降低启动信号进行启动。
22.权利要求21所要求的控制器,其特征在于计数启动输入(CEP)连接到启动输入(FRC)。
23.权利要求21所要求的控制器,其特征在于计数启动输入(CEP)通过D型锁存器(83)和设置/复位触发器连接到启动输入(FRC)。
24.一种显示控制器,其特征在于包括如权利要求1所要求的帧刷新率控制器。
25.如权利要求24所要求的显示控制器,其特征在于,计数启动输入通过D型锁存器和设置/复位触发器连接到启动输入(FRC)并且连接启动输入(FRC)以接收显示控制器的存储器写入控制信号,并且第一电路包括可预加载的同步计数器,并且计数器具有计数启动输入,该计数启动输入通过在帧速率降低启动输入(FRC)的速率降低启动信号进行启动。
26.一种有源阵列显示器,其特征在于包括如权利要求1所要求的控制器。
27.如权利要求26所要求的显示器,其特征在于控制器的第二电路可以邻近用于接收显示信号的显示器的输入放置并可以用于选通所有的显示信号。
28.如权利要求26所要求的显示器,其特征在于包括多个数据和扫描驱动器集成电路,每个显示器包括用于控制有源阵列显示器的帧刷新率的控制器,其表征为包括:第一电路,为每个第N帧提供启动信号(FE)以响应来自显示控制器的显示信号,其中N是大于0的整数并可从多个数值中选择;和第二电路,用于通过提供给显示控制器的每个第N帧启动显示的刷新以响应启动信号(FE)并在启动信号(FE)不存在时用于通过提供给显示控制器的每个其他帧阻止显示的刷新。
29.如权利要求26所要求的显示器,其特征在于包括液晶显示器。
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