CN1173734A - 用于制造半导体器件的接触掩模 - Google Patents
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Abstract
本发明的目的是防止由于过腐蚀构成接触孔内表面的绝缘层所致的保护环区的光刻胶膜剥落,所述过腐蚀发生于利用其中形成有保护环图形的接触掩模形成接触孔的工艺期间。腐蚀工艺期间,通过在任何一个保护环小孔图形侧边不形成保护环小孔图形,在任何一个保护环小孔侧边不形成保护环小孔。因此,保护环小孔区中的光刻胶膜和绝缘层之间具有足够的接触面积,因而,可以防止由于过腐蚀接触孔中的光刻胶膜造成的光刻胶膜剥落。
Description
本发明涉及一种制造半导体器件的接触掩模,特别涉及一种能防止由于过腐蚀接触孔中的绝缘层所致的保护环区的光刻胶膜剥落的接触掩模。
通常,半导体器件的制造工艺中,结和导电层之间或导电层之间的连接靠形成于绝缘层中的接触孔实现。另外,在形成接触孔时,保护环沿管芯的边缘形成于绝缘层上。形成保护环为的是防止晶片测试时相邻管芯之间的电作用所致的缺陷。下面将结合图1说明用于形成接触孔的常规接触掩模。
在如图1所示的制造半导体器件的常规接触掩模中,第一保护环图形2形成于如石英等材料制的透明基片1上,掩模9的第一保护环图形2对应于晶片管芯(未示出)的边缘部分。另外,第二保护环图形3形成于第一保护环图形2内,第二保护环图形3与第一保护环图形2之间存在一定间距。数个设置于第二保护环图形3内的接触图形4形成于基片1上。
下面将结合图2和3说明利用有上述结构的接触掩模形成接触孔的工艺。
图2是说明利用图1所示的接触掩模9进行光刻工艺的情况的一个管芯的局部平面图,图3是沿图2中3-3线所取的剖面图。在形成于硅衬底8上的绝缘层7上形成光刻胶膜5,然后通过利用图1所示接触掩模9的曝光和显影工艺,对光刻胶膜5构图。湿法腐蚀绝缘层7一定深度,然后用已构图的光刻胶膜5作掩模干法腐蚀其余的绝缘层7,在绝缘层7上形成数个接触孔6。同时,在腐蚀期间,腐蚀对应于接触掩模9的第一和第二保护环图形2和3的绝缘层7的外部,于是形成第一保护环g1和第二保护环g2。
在制造高集成度器件时,由于用含大量杂质离子的BPSG膜作绝缘层7,以改善表面的平整度,所以在湿法腐蚀时BPSG制的绝缘层7的腐蚀速率增大。而且,由于湿法腐蚀的各向异性腐蚀特性,构成接触孔6内表面的绝缘层7被过腐蚀,如图3所示。另外,如图1所示,由于与第二保护环图形3相邻的第一保护环图形2穿越整个结构,所以,湿法腐蚀工艺后,形成于第一保护环g1和第二保护环g2之间的绝缘层7上的光刻胶膜5剥落。由于过腐蚀接触孔6中的绝缘层7而剥落的光刻胶膜5埋入邻近的接触孔6中,因而,无法通过以后的干法腐蚀工艺形成结构完整的接触孔,由此导致器件不合格。结果降低了器件的成品率。
因此,本发明的目的是提供一种制造半导体器件的接触掩模,能够通过增大保护环区中的光刻胶膜和绝缘层之间的接触面积解决上述问题。
为了实现上述目的,根据本发明的接触掩模包括:透明基片;形成于基片上的数个保护环小孔图形;形成于保护环小孔图形以内的保护环图形;及形成于保护环图形以内的数个接触图形。保护环小孔图形对应于晶片中管芯的边缘,保护环图形设置成与保护环小孔图形间隔一定间距。
根据本发明的另一接触掩模包括:透明基片;形成于基片上的数个第一保护环小孔图形;形成于第一保护环小孔图形以内的第二保护环小孔图形;及形成于第二保护环小孔图形以内的数个接触图形。第一保护环小孔图形对应于晶片中管芯的边缘,第二保护环小孔图形与第一保护环小孔图形交错排列。因此,第一保护环小孔图形之间的那部分基片相当于一个第二保护环小孔图形,一个第一保护环小孔图形相当于第二保护环小孔图形之间的那部分基片。
在阅读了结合各附图对实施例的详细说明后,可以理解本发明的其它目的和优点。
图1是常规接触掩模的局部平面图。
图2是说明利用图1所示的接触掩模进行光刻工艺的情况的一个管芯的局部平面图。
图3是沿图2中3-3线所取的剖面图。
图4是根据本发明一个实施例的接触掩模的局部平面图。
图5是说明利用图4所示的接触掩模进行光刻工艺的情况的一个管芯的局部平面图。
图6A是沿图5中6A-6A线所取的剖面图。
图6B是沿图5中6B-6B线所取的剖面图。
图7是根据本发明另一实施例的接触掩模的局部平面图。
图8是说明利用图7所示的接触掩模进行光刻工艺的情况的一个管芯的局部平面图。
图9A是沿图8中9A-9A线所取的剖面图。
图9B是沿图8中9B-9B线所取的剖面图。
下面结合各附图详细说明本发明。
图4是根据本发明一个实施例的接触掩模的局部平面图。根据一个实施例的接触掩模10中,数个保护环小孔图形12形成于如石英等透明基片11上。数个保护环小孔图形12对应于晶片(未示出)管芯的边缘部分,相邻的保护环小孔图形12之间有一定间隔。每个第一保护环小孔图形12皆为矩形。隔离环图形13形成于保护环小孔图形12以内,保护环图形13与每个保护环小孔图形12之间有一间距。同时,数个接触图形14形成于保护环图形13以内,即,基片11的中心部分。
下面结合图5、6A和6B说明用如上所述的接触掩模形成接触孔的工艺。
图5是说明利用图4所示的接触掩模进行光刻工艺的情况的一个管芯的局部平面图,6A是沿图5中6A-6A线所取的剖面图,图6B是沿图5中6B-6B线所取的剖面图。在硅衬底18上依次形成绝缘层17和光刻胶膜15,然后利用如图4所示的接触掩模10进行曝光和显影,对光刻胶膜15构图。湿法腐蚀绝缘层17一定深度,然后用已构图的光刻胶膜15作掩模干法腐蚀其余绝缘层17,以在绝缘层17中形成数个接触孔16。同时,如图5所示,利用掩模10的保护环小孔图形12和保护环图形13在绝缘层17上形成数个保护环小孔GH和保护环G。
这里,湿法腐蚀工艺期间,BPSG制的绝缘层17的腐蚀速率增大。而且,由于湿法腐蚀的各向异性腐蚀特性,构成每个接触孔16内表面的绝缘层17被过腐蚀,这样位于保护环G和每个保护环小孔GH之间的那部分光刻胶膜15处于不稳定状态,如图6A所示。然而,如图6B所示,位于保护环G和其上未形成保护环小孔GH的绝缘层17之间的那部分光刻胶15保持稳定。因此,尽管每个保护环小孔GH和保护环G之间的那部分光刻胶膜15发生局部剥落(图6A),但在保护环G和其上未形成保护环小孔GH的那部分绝缘层17之间的那部分上,绝缘层17与光刻膜15之间仍有足够的接触面积,使得光刻胶膜15仍能整体上保持稳定状态。
图7是根据本发明另一实施例的接触掩模的局部平面图。在该实施例中,数个第一保护环小孔图形22形成于如石英等材料制的透明基片21上,它们对应于晶片(未示出)管芯的边缘部分。每个第一保护环小孔图形22形成为矩形,且相邻第一保护环小孔图形22之间有一间距。数个第二保护环小孔图形23形成于第一保护环小孔图形22以内。每个第一保护环小孔图形22和每个第二保护环小孔图形23之间存在间距。每个第二保护环小孔图形23形成为矩形,且相邻第二保护环小孔图形之间存在间距。
如图7所示,第一保护环小孔图形22和第二保护环小孔图形23交错形成,即,相邻第一保护环小孔图形22之间的间距(基片)相当于一个第二保护环小孔图形23,一个第一保护环小孔图形22相当于相邻第二保护环小孔图形23之间的间距(基片)。
同时,在基片21的中心部分形成数个接触图形24。
下面结合图8、9A、9B说明利用上述掩模形成接触孔的工艺。
图8是说明利用图7所示的接触掩模进行光刻工艺的情况的一个管芯的局部平面图,图9A是沿图8中9A-9A线所取的剖面图,图9B是沿图8中9B-9B线所取的剖面图。
在硅衬底28上依次形成绝缘层27和光刻胶膜25,然后利用如图7所示的掩模进行曝光和显影,对光刻胶膜25构图。湿法腐蚀绝缘层27一定深度,然后用已构图的光刻胶膜25作掩模干法腐蚀其余绝缘层27,在绝缘层27上形成数个接触孔26。同时,如图8所示,利用掩模20的第一保护环小孔图形22和第二保护环小孔图形23,在绝缘层27上分别形成数个第一保护环小孔GH1和第二保护环小孔GH2。
如上所述,在湿法腐蚀工艺期间,BPSG制的绝缘层27的腐蚀速率增大。而且,由于湿法腐蚀的各向异性腐蚀特性,形成每个接触孔26内表面的绝缘层27被过腐蚀。然而,如图9A和9B所示,在每个保护环小孔GH1和GH2两侧不存在导致光刻胶膜25剥落的保护环小孔。所以,由于光刻胶膜25与绝缘层27之间有足够的接触面积,可以整体上保持光刻胶膜25的稳定状态。
如上所述,根据本发明,在任何一个保护环(或保护环小孔)附近不形成另一保护环小孔,增大了光刻胶膜和绝缘层之间的接触面积,从而防止了光刻胶膜剥落。所以可以形成完整的接触孔,以提高器件的成品率。
尽管上面某种程度上具体说明了优选实施例,但上述说明只是对本发明原理的说明。应该明白,本发明并不限于这里所公开和解释的这些优选实施例。因此,在不脱离本发明的范围和精神的情况下,可以做出各种变化,但所有变化皆被包含于本发明的其它实施例中。
Claims (4)
1.一种用于制造半导体器件的接触掩模,该掩模包括:
透明基片;
形成于所述基片上的数个保护环小孔图形,所述数个保护环小孔图形对应于晶片中管芯的边缘部分;
形成于所述保护环小孔图形以内的保护环图形,所述保护环图形设置成与所述保护环小孔图形间隔一定间距;及
形成于所述保护环图形以内的数个接触图形。
2.根据权利要求1的接触掩模,其特征在于,所述每个保护环小孔图形形成为矩形。
3.一种用于制造半导体器件的接触掩模,该掩模包括:
透明基片;
形成于所述基片上的数个第一保护环小孔图形,所述第一保护环小孔图形对应于管芯的边缘;
形成于所述第一保护环小孔图形以内的第二保护环小孔图形,所述第二保护环小孔图形与所述第一保护环小孔图形交错排列;及
形成于所述第二保护环小孔图形以内的数个接触图形,由此,所述第一保护环小孔图形之间的那部分所述基片相当于一个所述第二保护环小孔图形,一个所述第一保护环小孔图形相当于所述第二保护环小孔图形之间的那部分所述基片。
4.根据权利要求3的接触掩模,其特征在于,所述每个保护环小孔图形形成为矩形。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR22780/96 | 1996-06-21 | ||
KR1019960022780A KR100199368B1 (ko) | 1996-06-21 | 1996-06-21 | 반도체 소자 제조용 콘택 마스크 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN1173734A true CN1173734A (zh) | 1998-02-18 |
CN1087494C CN1087494C (zh) | 2002-07-10 |
Family
ID=19462788
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN97111834A Expired - Fee Related CN1087494C (zh) | 1996-06-21 | 1997-06-20 | 用于制造半导体器件的接触掩模 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5879838A (zh) |
JP (1) | JP2855115B2 (zh) |
KR (1) | KR100199368B1 (zh) |
CN (1) | CN1087494C (zh) |
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KR100650626B1 (ko) | 2005-11-15 | 2006-11-27 | 삼성전자주식회사 | 반도체 장치 및 반도체 장치의 제조 방법 |
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1996
- 1996-06-21 KR KR1019960022780A patent/KR100199368B1/ko not_active IP Right Cessation
-
1997
- 1997-06-16 US US08/876,713 patent/US5879838A/en not_active Expired - Lifetime
- 1997-06-18 JP JP9160916A patent/JP2855115B2/ja not_active Expired - Fee Related
- 1997-06-20 CN CN97111834A patent/CN1087494C/zh not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JPH1074694A (ja) | 1998-03-17 |
US5879838A (en) | 1999-03-09 |
JP2855115B2 (ja) | 1999-02-10 |
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KR980005302A (ko) | 1998-03-30 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C06 | Publication | ||
PB01 | Publication | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant | ||
C17 | Cessation of patent right | ||
CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20020710 Termination date: 20130620 |