CN105720067B9 - 固态图像拾取设备 - Google Patents

固态图像拾取设备 Download PDF

Info

Publication number
CN105720067B9
CN105720067B9 CN201610164142.0A CN201610164142A CN105720067B9 CN 105720067 B9 CN105720067 B9 CN 105720067B9 CN 201610164142 A CN201610164142 A CN 201610164142A CN 105720067 B9 CN105720067 B9 CN 105720067B9
Authority
CN
China
Prior art keywords
film
substrate
insulating film
conductive material
wiring layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201610164142.0A
Other languages
English (en)
Other versions
CN105720067A (zh
CN105720067B (zh
Inventor
下津佐峰生
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kato Corp
Original Assignee
Kato Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Kato Corp filed Critical Kato Corp
Publication of CN105720067A publication Critical patent/CN105720067A/zh
Publication of CN105720067B publication Critical patent/CN105720067B/zh
Application granted granted Critical
Publication of CN105720067B9 publication Critical patent/CN105720067B9/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14601—Structural or functional details thereof
    • H01L27/14634—Assemblies, i.e. Hybrid structures
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14601—Structural or functional details thereof
    • H01L27/14636—Interconnect structures
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02—Bonding areas ; Manufacturing methods related thereto
    • H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/02—Bonding areas ; Manufacturing methods related thereto
    • H01L24/07—Structure, shape, material or disposition of the bonding areas after the connecting process
    • H01L24/08—Structure, shape, material or disposition of the bonding areas after the connecting process of an individual bonding area
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14601—Structural or functional details thereof
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14601—Structural or functional details thereof
    • H01L27/1464—Back illuminated imager structures
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14643—Photodiode arrays; MOS imagers
    • H01L27/14645—Colour imagers
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14683—Processes or apparatus peculiar to the manufacture or treatment of these devices or parts thereof
    • H01L27/14685—Process for coatings or optical elements
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14683—Processes or apparatus peculiar to the manufacture or treatment of these devices or parts thereof
    • H01L27/14687—Wafer level processing
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14683—Processes or apparatus peculiar to the manufacture or treatment of these devices or parts thereof
    • H01L27/1469—Assemblies, i.e. hybrid integration
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L31/00—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L31/08—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof in which radiation controls flow of current through the device, e.g. photoresistors
    • H01L31/09—Devices sensitive to infrared, visible or ultraviolet radiation
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/03—Manufacturing methods
    • H01L2224/036—Manufacturing methods by patterning a pre-deposited material
    • H01L2224/03602—Mechanical treatment, e.g. polishing, grinding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/03—Manufacturing methods
    • H01L2224/039—Methods of manufacturing bonding areas involving a specific sequence of method steps
    • H01L2224/0391—Forming a passivation layer after forming the bonding area
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/0502—Disposition
    • H01L2224/05022—Disposition the internal layer being at least partially embedded in the surface
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/05099—Material
    • H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/05124—Aluminium [Al] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/05099—Material
    • H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05149—Manganese [Mn] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/05099—Material
    • H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05171—Chromium [Cr] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/05099—Material
    • H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05179—Niobium [Nb] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/05099—Material
    • H01L2224/051—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/05181—Tantalum [Ta] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/05001—Internal layers
    • H01L2224/05099—Material
    • H01L2224/05186—Material with a principal constituent of the material being a non metallic, non metalloid inorganic material
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554—External layer
    • H01L2224/05541—Structure
    • H01L2224/05546—Dual damascene structure
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554—External layer
    • H01L2224/05541—Structure
    • H01L2224/05547—Structure comprising a core and a coating
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554—External layer
    • H01L2224/0555—Shape
    • H01L2224/05552—Shape in top view
    • H01L2224/05554—Shape in top view being square
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554—External layer
    • H01L2224/0555—Shape
    • H01L2224/05556—Shape in side view
    • H01L2224/05557—Shape in side view comprising protrusions or indentations
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554—External layer
    • H01L2224/05599—Material
    • H01L2224/056—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05638—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05644—Gold [Au] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
    • H01L2224/0554—External layer
    • H01L2224/05599—Material
    • H01L2224/056—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/05638—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/05647—Copper [Cu] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/07—Structure, shape, material or disposition of the bonding areas after the connecting process
    • H01L2224/08—Structure, shape, material or disposition of the bonding areas after the connecting process of an individual bonding area
    • H01L2224/081—Disposition
    • H01L2224/0812—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/08121—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the connected bonding areas being not aligned with respect to each other
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02—Bonding areas; Manufacturing methods related thereto
    • H01L2224/07—Structure, shape, material or disposition of the bonding areas after the connecting process
    • H01L2224/08—Structure, shape, material or disposition of the bonding areas after the connecting process of an individual bonding area
    • H01L2224/081—Disposition
    • H01L2224/0812—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/08135—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the bonding area connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/08145—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the bonding area connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/80001—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by connecting a bonding area directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/8034—Bonding interfaces of the bonding area
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/80001—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by connecting a bonding area directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/8034—Bonding interfaces of the bonding area
    • H01L2224/80357—Bonding interfaces of the bonding area being flush with the surface
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/80001—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by connecting a bonding area directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/808—Bonding techniques
    • H01L2224/80894—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces
    • H01L2224/80895—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces between electrically conductive surfaces, e.g. copper-copper direct bonding, surface activated bonding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/80001—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by connecting a bonding area directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/808—Bonding techniques
    • H01L2224/80894—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces
    • H01L2224/80896—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces between electrically insulating surfaces, e.g. oxide or nitride layers
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/80001—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected by connecting a bonding area directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding
    • H01L2224/80986—Specific sequence of steps, e.g. repetition of manufacturing steps, time sequence
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144—Devices controlled by radiation
    • H01L27/146—Imager structures
    • H01L27/14601—Structural or functional details thereof
    • H01L27/1462—Coatings
    • H01L27/14621—Colour filter arrangements

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Electromagnetism (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Solid State Image Pick-Up Elements (AREA)
  • Transforming Light Signals Into Electric Signals (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

提供了一种固态图像拾取设备。该固态图像拾取设备具有：第一基板，具有设置在第一基板的主面上的光电转换器；第一布线结构，具有包含导电材料的第一接合部分；第二基板，在第二基板的主面上具有外围电路的一部分；以及第二布线结构，具有包含导电材料的第二接合部分。此外，第一接合部分和第二接合部分被接合为使得第一基板、第一布线结构、第二布线结构以及第二基板依次设置。此外，第一接合部分的导电材料和第二接合部分的导电材料被扩散防止膜包围。

Description

固态图像拾取设备
本申请是申请日为2011年7月4日的、申请号为201180033415.3(国际申请号为PCT/JP2011/003796)以及发明名称为“固态图像拾取设备”的发明专利申请的分案申请。
技术领域
本发明涉及一种固态图像拾取设备的接合部分。
背景技术
在用于数字静物照相机、便携式摄像机等的CCD型和放大型固态图像拾取设备中，为了获得高清晰度图像，需要减小像素的尺寸。然而，随着像素的尺寸越来越减小，光电转换器的在像素中的检测光的光接收面积减小，并且灵敏度降低。
在PTL 1中，已经公开了一种固态图像拾取设备，其中，在作为放大型固态图像拾取设备的CMOS型固态图像拾取设备中，为了确保光电转换器的光接收区域，具有光电转换器和转移晶体管的第一基板和具有其它电路的第二基板彼此接合。在PTL 1中，对于该接合，针对每个像素使用铜接合焊盘。
[引文列表]
[专利文献]
[PTL1]日本专利公开No.2006-191081
发明内容
[技术问题]
然而，根据PTL 1中公开的接合方法，在一些情况下，铜可能从铜接合焊盘扩散到第一基板和/或第二基板。当该金属杂质在半导体区 域中混合时，由此可能生成暗电流和/或泄漏电流，结果，在待获得的图像数据上生成白斑等。此外，当该金属杂质在形成晶体管的半导体区域中混合时，易于发生泄漏电流的生成和/或阈值的变化，结果，在一些情况下可能出现操作故障。具体地说，在具有好几万或更多像素(即好几万或更多接合部分)的固体图像拾取设备中，可能从这些接合部分产生严重污染。当具有高扩散系数的导电材料(如铜)用于接合部分时，以上描述的现象易于发生。
相应地，本发明提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
[问题的解决方案]
本发明的固态图像拾取设备包括：第一基板，具有设置在第一基板的主面上的光电转换器；第一布线结构，设置在第一基板的主面上并且具有包含导电材料的第一接合部分；第二基板，在第二基板的主面上具有包括控制电路和基于光电转换器的电荷而读出信号的读出电路的外围电路的一部分；以及第二布线结构，设置在第二基板的主面上并且具有包含导电材料的第二接合部分，其中，第一接合部分和第二接合部分被彼此接合为使得第一基板、第一布线结构、第二布线结构以及第二基板依次设置，以及第一接合部分的导电材料和第二接合部分的导电材料被扩散防止膜包围。
[本发明的有益效果]
相应地，本发明可以提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
附图说明
[图1]图1是根据实施例1的固态图像拾取设备的示意性截面图。
[图2A]图2A是根据实施例1的固态图像拾取设备的示意性平面图。
[图2B]图2B是根据实施例1的固态图像拾取设备的示意性平面 图。
[图3]图3是根据实施例1的固态图像拾取设备的电路图。
[图4A]图4A是示出用于制造根据实施例1的固态图像拾取设备的方法的步骤的示意性截面图。
[图4B]图4B是示出用于制造根据实施例1的固态图像拾取设备的方法的步骤的示意性截面图。
[图5A]图5A是示出用于制造根据实施例1的固态图像拾取设备的方法的步骤的示意性截面图。
[图5B]图5B是示出用于制造根据实施例1的固态图像拾取设备的方法的步骤的示意性截面图。
[图6A]图6A是示出用于制造根据实施例1的固态图像拾取设备的方法的步骤的示意性截面图。
[图6B]图6B是示出用于制造根据实施例1的固态图像拾取设备的方法的步骤的示意性截面图。
[图7A]图7A是根据实施例1的固态图像拾取设备的接合部分的示意性截面图。
[图7B]图7B是根据实施例1的固态图像拾取设备的接合部分的示意性截面图。
[图7C]图7C是根据实施例1的固态图像拾取设备的接合部分的示意性截面图。
[图7D]图7D是根据实施例1的固态图像拾取设备的接合部分的示意性截面图。
[图8A]图8A是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图8B]图8B是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图8C]图8C是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图8D]图8D是根据实施例2的固态图像拾取设备的接合部分的 示意性截面图。
[图8E]图8E是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图8F]图8F是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图8G]图8G是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图8H]图8H是根据实施例2的固态图像拾取设备的接合部分的示意性截面图。
[图9A]图9A是示出用于制造根据实施例2的接合部分的方法的步骤的示意性截面图。
[图9B]图9B是示出用于制造根据实施例2的接合部分的方法的步骤的示意性截面图。
[图9C]图9C是示出用于制造根据实施例2的接合部分的方法的步骤的示意性截面图。
[图10A]图10A是根据实施例3的固态图像拾取设备的接合部分的示意性截面图。
[图10B]图10B是根据实施例3的固态图像拾取设备的接合部分的示意性截面图。
[图10C]图10C是根据实施例3的固态图像拾取设备的接合部分的示意性截面图。
[图11A]图11A是示出根据实施例3的固态图像拾取设备的接合部分的示意性平面图。
[图11B]图11B是示出根据实施例3的固态图像拾取设备的接合部分的示意性平面图。
[图11C]图11C是示出根据实施例3的固态图像拾取设备的接合部分的示意性平面图。
具体实施方式
本发明的固态图像拾取设备具有：第一基板，在其主面上具有光电转换器；第一布线结构，具有第一接合部分，其中的每一个第一接合部分包含导电材料；第二基板，在其主面上具有外围电路的一部分；以及第二布线结构，具有第二接合部分，其中的每一个第二接合部分包含导电材料。此外，第一接合部分和第二接合部分彼此接合，以使得第一基板、第一布线结构、第二布线结构以及第二基板被依次设置。在该固态图像拾取设备中，第一接合部分的导电材料和第二接合部分的导电材料被用于相应导电材料的扩散防止膜围绕。通过上述结构，导电材料甚至在接合之后被相应的扩散防止膜围绕，因此可以提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
下文中，将参照附图详细描述本发明。在该实施例中，第一基板的主面和第二基板的主面是在其上形成晶体管的基板表面。面对相应主面(主表面)的相反侧的面(相反侧的表面)是第一基板的背面(后表面)和第二基板的背面(后表面)。此外，向上方向表示从基板的背面朝向主面的方向，向下方向和深度方向均表示从基板的主面朝向背面的方向。在以下描述中，当第一基板和第二基板彼此接合时，第二基板的背面处于底面并且第一基板的背面处于顶面。
此外，通过单镶嵌方法(single damascene method)来形成具有单镶嵌结构(single damascene structure)的布线，在单镶嵌方法中，在层间绝缘膜中形成要被用于布线的槽，在槽中填充导电材料(如势垒金属或铜)，以使得获得埋在层间绝缘膜中的布线。形成具有双镶嵌结构的布线以使得布线和通孔整体地形成以便被埋在层间绝缘膜中。也就是说，通过双镶嵌方法来形成具有双镶嵌结构的布线，在双镶嵌方法中，在层间绝缘膜中形成要用于布线和通孔的槽，在槽中填充导电材料(如势垒金属或铜)。
将参照图1至图6B描述本发明的实施例1。首先，将参照图3描述根据实施例1的固态图像拾取设备的电路。在该实施例中，举例描述其中信号电荷是电子的情况。图3所示的固态图像拾取设备具有：像素部分301，其中布置有多个光电转换器；以及外围电路部分302， 具有包括驱动从像素部分301读出信号的控制电路和处理读出信号的信号处理电路的外围电路。
在像素部分301中，布置光电转换器303、转移晶体管304、放大晶体管306和重置晶体管307。包括至少一个光电转换器303的结构被定义为像素。该实施例的一个像素包括一个光电转换器303、一个转移晶体管304、一个放大晶体管306和一个重置晶体管307。转移晶体管304的源级连接到光电转换器303，转移晶体管304的漏极区域连接到放大晶体管306的栅极电极。与该放大晶体管306的栅极电极相同的节点被定义为节点305。重置晶体管307连接到节点305，并且将其电势设置为任意电势(例如重置电势)。在该结构中，放大晶体管306是源级跟随器电路的一部分，并且将与节点305的电势对应的信号输出到信号线RL。在一些情况下，节点305也可以被称为浮置扩散区。
外围电路部分302表示除了像素部分301之外的区域。在外围电路部分302中，设置有包括读出电路和控制电路的外围电路。外围电路具有垂直扫描电路VSR，其为将控制信号提供给像素部分301的晶体管的栅极电极的控制电路。此外，外围电路具有读出电路RC，其保持从像素部分301输出的信号并且执行信号处理(如放大、相加和AD转换)。此外，外围电路具有水平扫描电路HSR，其为控制用于从读出电路RC依次输出信号的时序的控制电路。
此外，通过将两个构件彼此接合来形成根据实施例1的固态图像拾取设备。这两个构件是具有第一基板101的第一构件308和具有第二基板121的第二构件309。像素部分301的光电转换器303和转移晶体管304布置在第一基板上，像素部分301的放大晶体管306和重置晶体管307以及外围电路的至少一部分布置在第二基板上。经由接合部分310提供从第二构件309的外围电路到第一构件308的转移晶体管304的栅极电极的控制信号。稍后将描述接合部分310的结构。在转移晶体管304的漏极区域处(即在节点305处)读出第一构件308的光电转换器303中生成的信号。节点305包括第一构件308中形成 的结构和第二构件309中形成的结构。
根据上述结构，与其中所有像素部分都设置在一个构件上(即在一个大基板上)的相关情况相比，可以增加光电转换器303的面积，因此可以改进灵敏度。此外，与其中所有像素部分都设置在一个构件上(即在一个大基板上)的相关情况相比，当不改变光电转换器的面积时，可以增加光电转换器303的数量，因此可以增加像素的数量。此外，与其中所有像素部分和所有外围电路部分都设置在一个构件上(即在一个大基板上)的相关情况相比，变得容易分离地形成像素部分和外围电路部分。
将使用图2A和图2B中所示的固态图像拾取设备的示意性平面图来描述如上述的固态图像拾取设备的具体平面布局。图2A示出第一构件308(即第一基板101)的平面布局，图2B示出第二构件309(即第二基板121)的平面布局。
在图2A中，在第一构件308中，设置其中布置有光电转换器的像素部分301A以及在其中的每一个中布置有焊盘313的焊盘部分312A。在像素部分301A中，设置图3所示的光电转换器303、转移晶体管304、接合部分310和接合部分311。此外，在当沿着与基板101的主面垂直的方向观看时与这些焊盘313相同的位置处设置用于连接到第二构件309的接合部分314A。外部端子连接到焊盘313。焊盘313设置在固态图像拾取设备中，并且包括：其中的每一个基于光电转换器中生成的电荷而输出信号(图像信号)的焊盘，以及其中的每一个被输入有从外部提供用于驱动外围电路的电压等的焊盘。
接下来，在图2B中，在第二构件309中设置像素部分301B、外围电路部分302和焊盘部分312B。像素电路的一部分设置在像素部分301B中，即图3中所示的放大晶体管306、重置晶体管307以及接合部分310和311设置在其中。外围电路的一部分设置在外围电路部分302中，即水平扫描电路HSR、垂直扫描电路VSR和读出电路RC设置在其中。用于连接到第一构件的接合部分314B和保护二极管电路315设置在焊盘部分312B中。
此外，分别具有图2A和图2B所示的平面布局的第一构件308和第二构件309彼此接合，以形成该实施例的固态图像拾取设备。特别地，像素部分301A和像素部分301B被设置为彼此交叠。此外，接合部分314A和接合部分314B彼此接合，第一构件的接合部分310和接合部分311分别接合到第二构件的接合部分310和接合部分311。此外，在图2A和图2B中，外围电路部分302A表示与第二构件309的外围电路部分302B对应的第一构件308的区域。扫描电路的一部分(即外围电路的一部分)可以设置在外围电路部分302A中。稍后将详细描述该接合部分的结构。
接下来，将参照图1所示的示意性截面图描述图2A、图2B和图3所示的固态图像拾取设备。在图1中，与图2A、图2B和图3相同的构成元件由与以上描述的相同附图标记指定，并且省略描述。
第一构件308具有第一布线结构149和第一基板101。第一基板101是例如硅半导体基板，并且具有主面102和背面103。晶体管布置在第一基板的主面102上。第一布线结构149具有层间绝缘膜104和105、包含栅极电极和布线的栅极电极层107、包含布线的布线层109和110以及包含触点和/或通孔的接触层108。此外，第一布线结构149具有第一扩散防止膜111。在该实施例中，可以任意确定第一布线结构149中包括的层间绝缘膜、布线层和接触层的数量。此外，第一布线结构149的布线层110包含接合部分311和314A，并且与接触层集成。下文中，接合部分表示联合地形成电连接的第一构件的导电材料和第二构件的导电材料彼此间接合的部分，并且还表示在接合之前的导电材料。
在第一构件308的像素部分301中，在第一基板101中设置有形成光电转换器的n型半导体区域112、用作转移晶体管的漏极的n型半导体区域114以及元件隔离结构119。转移晶体管由n型半导体区域112、n型半导体区域114以及栅极电极层107中包含的栅极电极113形成。栅极电极113将n型半导体区域112中存储的电荷转移到n型半导体区域114。基于转移到n型半导体区域114的电荷的电势经 由接触层108的触点、布线层109的布线以及包含接触层的布线层110而发送到第二构件309。该布线层110中包含的布线形成接合部分311。此外，光电转换器可以是还具有p型半导体区域的掩埋光电二极管或光电门(photogate)，并且可以适当地改变。
平面化层115、包含多个滤色器的滤色器层116、平面化层117以及包含多个微透镜的微透镜层118在第一基板101的背面103一侧被依次设置在像素部分301中。在图1中，虽然对于一个光电转换器提供(也就是说，在每个像素中提供)滤色器中的每一个和微透镜中的每一个，但可以对于多个像素提供一个滤色器和一个微透镜。该实施例的固态图像拾取设备是所谓的背照式(back-side illumination-type)固态图像拾取设备，其中，光从微透镜层118侧入射并且由光电转换器接收。
在第一构件308的焊盘部分312A中，提供焊盘313和使焊盘313暴露用于连接到外部端子的开孔100。此外，设置其中的每一个把从焊盘313输入的电压发送到第二构件309的接合部分314A。接合部分314A包含在布线层110中，如像素部分的接合部分那样。此外，在第一构件308中，如图1所示，在与第二构件309的外围电路部分302B对应的区域中提供可选的电路元件120。
第二构件309具有第二布线结构150和第二基板121。第二基板121是例如硅半导体基板，并且具有主面122和背面123。晶体管布置在第二基板的主面102上。第二布线结构150具有：层间绝缘膜124至127，包含栅极电极和布线的栅极电极层128，包含布线的布线层130、131和132，以及包含触点和/或通孔的接触层129。此外，第二布线结构150具有第二扩散防止膜133。在该实施例中，可以任意确定第二布线结构150中包括的层间绝缘膜、布线层和接触层的数量。此外，第二布线结构150的布线层131和132分别与接触层集成。此外，布线层132包含接合部分311和314B。
在第二构件309的像素部分301中，在第二基板121中设置有：形成放大晶体管(其形成像素电路)的阱135，形成放大晶体管的源 级/漏极区域的n型半导体区域138，以及元件隔离结构136。放大晶体管设置在阱135中，并且由栅极电极层128中包含的栅极电极137以及形成源级/漏极区域的n型半导体区域138形成。在该实施例中，第一构件308通过接合部分311连接到放大晶体管的栅极电极137。放大晶体管的接合部分311和栅极电极137通过布线层132的布线和通孔、布线层131的布线和通孔、布线层130的布线以及接触层129的触点而彼此连接。在此情况下，图3所示的节点305由图1所示的以下部分形成：n型半导体区域114，布线层109、110、132、131和130的布线和通孔，接触层108和129的触点，以及栅极电极137。在图中未示出像素部分301的其它电路(如重置晶体管)。
接下来，在第二构件309的外围电路部分302B中设置包括控制电路(如水平扫描电路和垂直扫描电路)和读出电路的外围电路的至少一部分。图1示出外围电路中包括的可选电路中的n型晶体管和p型晶体管。在p型阱139中设置有由栅极电极层128中包含的栅极电极140和n型源级/漏极区域141形成的n型晶体管。此外，在n型阱142中设置有具有在栅极电极层128中包含的栅极电极143和形成p型源级/漏极区域的p型半导体区域144的p型晶体管。
此外，在第二构件309的焊盘部分312B中，设置有输入来自第一构件308的焊盘313的信号的保护二极管电路315以及用于连接到第一构件308的接合部分314B。接合部分314B被包含在布线层132中，如像素部分的接合部分那样。在该实施例的保护二极管电路315中包含分别从半导体区域形成的两个二极管145和146以及从栅极电极层128形成的两个电阻器147和148。通用保护二极管电路可以用于该保护二极管电路315。
此外，在根据该实施例的固态图像拾取设备中，第一基板101的主面102和第二基板121的主面122被设置为彼此面对(面对布置)，其间提供有第一布线结构和第二布线结构。也就是说，第一基板、第一布线结构、第二布线结构和第二基板依次被设置。此外，也可以说，第一布线结构149的上面和第二布线结构150的上面在接合平面X处 彼此接合。也就是说，第一构件308和第二构件309在接合平面X处彼此接合。从第一布线结构149的上面和第二布线结构150的上面形成接合平面X。各个构件中设置的接合部分在接合平面X处彼此接合，并且确保构件之间的导通。此外，用于与外部交换信号的固态图像拾取设备的焊盘313设置在第二构件309的主面122之上，在第一构件308一侧提供开孔100。
在该实施例中，在第一布线结构149中，布线层109由主要包括铝的布线(铝线)形成，布线层110由主要包括铜的布线(铜线)形成，并且具有双镶嵌结构。此外，在第二布线结构150中，布线层130由铜线形成，并且具有单镶嵌结构。布线层131和132由铜线形成，并且分别具有双镶嵌结构。由布线层110中包含的布线形成的接合部分311和接合部分314A通过金属接合在接合平面X处分别接合到由布线层132中包含的布线形成的接合部分311和接合部分314B。此外，在焊盘部分中，用于连接到外部端子的焊盘313被设置在与布线层109相同(即与其高度相同)的层中，并且是主要包括铝的导电材料。该布线层109的高度和焊盘313的高度分别是距第一基板101的主面102的高度。
接下来，将参照图4A至图6B描述制造该实施例的固态图像拾取设备的方法。图4A和图4B分别是示出制造第一构件308的步骤的示意性截面图，图5A和图5B分别是示出制造第二构件309的步骤的示意性截面图，图6A和图6B分别是示出在第一构件308和第二构件309彼此接合之后执行的制造步骤的示意性截面图。
将参照图4A和图4B描述制造图1所示的第一构件308的步骤。在图4A和图4B中，待稍后形成为图1所示的第一构件308的结构由308’表示，待形成为图1所示的像素部分301、外围电路部分302、焊盘部分312和作为外围电路的一部分的电路元件120的部分分别由301’、302’、312’和120’表示。
首先，提供半导体基板，在半导体基板中形成元件。提供了具有主面402和背面403的厚度D3的半导体基板401。半导体基板401 是例如硅半导体基板。在半导体基板401中形成元件隔离结构119。元件隔离结构119包含绝缘金属(如硅氧化物膜)，并且具有例如LOCOS或STI结构。此外，在半导体基板401中形成具有任意导通类型的阱(未示出)。随后，形成n型半导体区域112和114以及p型半导体区域(未示出)，这些半导体区域形成光电转换器和晶体管。此外，形成包含转移晶体管的栅极电极113的栅极电极层107。栅极电极层例如通过多晶硅层的沉积和图案化而形成，并且可以包含布线以及栅极电极。可以根据一般的半导体工艺来执行用于形成栅极电极、元件隔离和半导体区域的方法，并且将省略详细描述。通过上述步骤获得图4A所示的结构。
接下来，在半导体基板401的主面402上形成布线结构。特别地，首先，形成待形成为层间绝缘膜104’的膜，以便覆盖栅极电极层107。在待形成为层间绝缘膜104’的膜中形成接触孔之后，形成势垒金属和钨的膜，并且移除其膜的过剩部分，由此形成层间绝缘膜104’和接触层108。此外，在层间绝缘膜104’上形成势垒金属和铝的膜，随后图案化，以便形成布线层109。接下来，形成待形成为层间绝缘膜105的膜，以便覆盖布线层109，并且形成待形成为第一扩散防止膜111的膜。接下来，通过双镶嵌方法来形成布线层110。在待形成为层间绝缘膜105的膜和待形成为第一扩散防止膜111的膜的叠层中形成用于布线的槽和用于通孔的槽(孔)。形成具有扩散防止功能的势垒金属的膜和铜的膜，以便填充槽。通过移除过剩的势垒金属和铜来形成布线层110，并且形成层间绝缘膜105和第一扩散防止膜111。在此情况下，第一扩散防止膜111具有开孔，以使布线暴露。此外，可以通过在移除势垒金属和铜时执行的蚀刻或化学机械抛光(CMP)来同时使第一扩散防止膜111平面化。如此平面化的第一平面化扩散防止膜111的上面具有用于后续接合的足够平坦度。布线结构的上面由第一扩散防止膜111的上面和布线层110的上面形成。层间绝缘膜104’稍后形成为图1所示的层间绝缘膜104。
在该实施例中，层间绝缘膜104’和105每个都是硅氧化物膜。 然而，层间绝缘膜104’和105也可以例如由硅氮化物膜或有机树脂来形成。触点108例如从钨形成。布线层110包含接合部分314A和接合部分311A，布线层109包含焊盘313。势垒金属具有用于防止作为导电材料的铜的扩散的功能并且由例如钽或钽氮化物形成。第一扩散防止膜111由具有针对包含接合部分的布线层110的导电材料的扩散防止功能的膜形成，并且是高密度无机绝缘膜。例如，扩散防止膜是硅氮化物膜或硅碳化物膜。可以根据一般半导体工艺来执行用于制造这些布线层、接触层和层间绝缘膜的方法，并且将省略详细描述。通过上述步骤获得图4B所示的结构。在图4B中，附图标记104’、105、106、108、109和110表示的部分随后用于形成图1所示的第一布线结构149。此外，接合部分311A随后形成接合部分311。在该图4B中，随后形成图1所示的接合平面X的第一布线结构149的上面由第一扩散防止膜111的上面和布线层110的每个布线的上面形成。稍后将详细描述该上面的结构。
接下来，将参照图5A和图5B描述制造图1所示的第二构件309的步骤。在图5A和图5B中，待稍后形成为图1所示的第二构件309的结构由标号309’表示，待形成为图1所示的像素部分301、外围电路部分302、焊盘部分312和保护二极管电路315的部分分别由标号301’、302’、312’和315’表示。
接下来，在半导体基板404的主面405上形成布线结构。特别地，首先，形成待形成为层间绝缘膜124的膜，以便覆盖栅极电极128。在待形成为层间绝缘膜124的膜中形成接触孔之后，形成势垒金属的膜和钨的膜，并且通过移除势垒金属和钨的膜的过剩部分来形成层间绝缘膜124和接触层129。此外，在层间绝缘膜124上形成待形成为层间绝缘膜125的膜。接下来，通过单镶嵌方法来形成布线层130。在待形成为层间绝缘膜125的膜中形成用于布线的槽，并且形成具有扩散防止功能的势垒金属的膜和铜的膜以便填充槽。通过移除过剩势垒金属和铜来形成布线层130，并且形成层间绝缘膜125。接下来，形成待形成为层间绝缘膜126的膜以便覆盖层间绝缘膜125和布线层 130。此外，通过双镶嵌方法来形成布线层131。特别地，在待形成为层间绝缘膜126的膜中形成用于布线和通孔的槽。形成具有扩散防止功能的势垒金属的膜和铜的膜，以便填充槽。通过移除过剩势垒金属和铜来形成布线层131，并且形成层间绝缘膜126。此外，形成待形成为层间绝缘膜127的膜和待形成为第二扩散防止膜133的膜，以便覆盖层间绝缘膜126和布线层131。接下来，通过双镶嵌方法来形成布线层132。也就是说，在待形成为层间绝缘膜127和第二扩散防止膜133的膜中形成用于布线和通孔的槽，并且形成具有扩散防止功能的势垒金属的膜和铜的膜以便填充槽。通过移除铜的膜和具有扩散防止功能的势垒金属的膜的过剩部分来形成布线层132。在此情况下，势垒金属具有针对作为导电材料的铜的扩散防止功能并由例如钽或钽氮化物形成。此外，形成层间绝缘膜127和第二扩散防止膜133。在该实施例中，第二扩散防止膜133具有开孔以便使布线暴露。此外，可以通过在移除势垒金属和铜时执行的蚀刻或CMP来同时使第二扩散防止膜133平面化。布线结构的上面由第二扩散防止膜133的上面和布线层132的上面形成。
在此情况下，虽然由硅氧化物形成，但层间绝缘膜124至127中的每个也可以例如由硅氮化物膜或有机树脂形成。触点129例如以钨形成。布线层130以主要包括铜的布线形成，并且具有单镶嵌结构。布线层131和132分别由主要包括铜的布线形成，并且分别具有双镶嵌结构。布线层132包含接合部分314B和接合部分311B。可以根据一般的半导体工艺来执行用于制造这些布线层、接触层和层间绝缘膜的方法，并且省略更详细的描述。通过上述步骤获得图5B所示的结构。在图5B中，例如由附图标记124至127和129至133表示的部分随后用于形成图1所示的第二布线结构150。此外，接合部分311B随后形成接合部分311。
在该图5B中，随后形成图1所示的接合平面X的第二布线结构150的上面由层间绝缘膜127的上面和布线层132的每个布线的上面形成。布线层132还是用作接合部分的导电材料。也就是说，第二布 线结构150的上面包含导电材料的上面。稍后将详细描述该上面的结构。
图4B和图5B分别所示的第一构件308’和第二构件309’接合在一起，以使得相应半导体基板的主面402和主面405彼此面对。也就是说，第一构件308’的布线结构的最上面和第二构件309’的布线结构的最上面彼此接合。在该实施例中，由于接合部分311A和311B以及接合部分314A和314B由主要包括铜的布线形成，所以当在其之间执行接合时，可以执行铜的金属接合。此外，优选地在真空或惰性气体气氛中执行接合。此外，在执行接合之前，优选地对每个布线结构的上面执行等离子体照射。通过执行这种等离子体照射，与其中不执行等离子体照射的情况相比，可以更好地加强层间绝缘膜(如硅氧化物膜和/或硅氮化物膜)之间的接合。此外，替代使用等离子体照射，也可以使用通过化学处理的活化方法。通过这种接合，两个布线结构联合为一个布线结构，其包括被扩散防止膜包围的铜接合部分。
此外，在第一构件308’和第二构件309’接合在一起之后，第一构件308’的半导体基板401的厚度在背面403一侧减小。可以通过CMP或蚀刻来执行厚度的减小。相应地，半导体基板401形成为半导体基板407，厚度从D3改变为D1(D1<D3)(图6A)。如上所述，由于半导体基板401的厚度减小以形成半导体基板407，因此随后入射光能够高效地进入光电转换器。此外，在该阶段，半导体基板407的厚度D1小于半导体基板404的厚度D4。
接下来，由树脂形成的平面化层409、滤色器层410、由树脂形成的平面化层411以及微透镜层412依次在半导体基板407的背面408上形成。可以根据一般半导体工艺来执行用于制造这些平面化层、滤色器层和微透镜层的方法，并且将省略详细描述。在此情况下，微透镜层可以形成到待形成为焊盘部分的区域312’。通过上述步骤获得图6B所示的结构。
此外，形成开孔100以暴露焊盘313。在该步骤中，使用光刻技术在微透镜层412上形成具有任意开孔的光致抗蚀掩模。此外，使用 干法蚀刻技术，部分地移除微透镜层412、平面化层411、滤色器层410、平面化层409、半导体基板407和层间绝缘膜104’，由此形成开孔100以暴露焊盘313。
相应地，形成微透镜层118、平面化层117和115、滤色器层116、第一基板101以及层间绝缘膜104。结果，获得图1所示的结构。图6B所示的半导体基板404、主面405、背面406和厚度D4分别与图1所示的第二基板121、主面122、背面123和厚度D2对应。虽然在此情况下厚度D4不相对于厚度D2改变，但半导体基板404的厚度可以减小，以使得厚度D2小于厚度D4。虽然步骤的数量因厚度的减小而增加，但可以使固态图像拾取设备小型化。
下文中，将参照图7A至图7D描述接合部分的细节。图7A至图7D分别是图1所示的接合部分311的放大示意性截面图。在图7A至图7D中，相同附图标记指定与图1至图6B所示的相同构成元件，并且将省略描述。
首先，图7A示出在第一构件和第二构件彼此接合之前的状态，图7B示出这两个构件彼此接合(图6A)的状态。第一构件308’具有布线层109、布线层110和第一扩散防止膜111。布线层109包含铝109a和势垒金属109b，布线层110包含铜110a和势垒金属110b。此外，第二构件309’具有布线层131、布线层132和第二扩散防止膜133。布线层131包含铜131a和势垒金属131b，布线层132包含铜132a和势垒金属132b。也就是说，接合部分包含具有比铝更高的扩散系数的铜作为导电材料。在此情况下，导电材料不限于铜，并且可以选自主要由铜组成的合金、其它金属(如Au)及其合金。此外，用于铜的势垒金属充当具有防止铜扩散的能力的扩散防止膜。作为该势垒金属，例如，可以提及金属(如钽、锰、铌和铬)及其合金，钽氮化物膜也具有势垒功能。此外，作为第一扩散防止膜和第二扩散防止膜，例如，可以提及硅氮化物膜、硅碳化物膜、硅碳氮化物膜或硅氧氮化物膜。此外，除了暴露于平面X1的部分之外，铜110a被势垒金属110b包围。此外，除了暴露于平面X2的部分之外，铜132a被势垒金属132b 包围。在该实施例中，平面X1是第一布线结构149的上面，平面X2是第二布线结构150的上面。
如图7B所示，平面X1和平面X2形成接合平面X，第一构件308’和第二构件309’彼此接合。铜110a和铜132a金属接合在一起。在此情况下，铜110a和铜132a分别被势垒金属110b和势垒金属132b(其中的每一个是具有针对铜的扩散防止功能的扩散防止膜)包围。根据上述结构，由于导电材料在接合部分处被扩散防止膜包围，因此可以提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
图7C是示出在图7A所示的结构中，形成接合部分的布线层110和布线层132的位置偏移的情况的示意性截面图。在图7C所示的情况下，由于提供第一扩散防止膜111和第二扩散防止膜133，因此导电材料也可以在接合部分处被扩散防止膜包围。特别地，如图7D所示，铜110a和铜132a被势垒金属110b和势垒金属132b(其中的每一个是扩散防止膜)和第一扩散防止膜111以及第二扩散防止膜133共同包围。通过上述结构，即使位置例如因工艺条件的变化而偏移，导电材料也在接合部分处被扩散防止膜包围；因此，可以提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
本发明不限于在根据该实施例的制造方法中描述的步骤，并且步骤的顺序也可以改变。此外，可以适当地确定制造第一构件308和第二构件309的顺序。SOI基板也可以应用于半导体基板401和404中的每一个。此外，第一构件308和第二构件309也可以分别购买作为用于固态图像拾取设备的基板，然后接合在一起。
接下来，将参照图8A至图9C描述本发明的实施例2。在该实施例中，将描述接合部分的结构的若干修改。图8A至图8H分别是针对与图7A至图7D所示的接合部分对应的接合部分的示意性截面图。在图8A至图8H中，与上述相同的标号指定与图1至图7D所示的相似的构成元件，并且将省略描述。
首先，将描述图8A和图8B所示的接合部分的修改。图8A是与 图7A所示的对应的示意性截面图，图8B是与图7B所示的对应的示意性截面图。在图8A中，与图7A的差异是，布线层110具有比布线层132更小的暴露面积，第二构件309’没有第二扩散防止膜133。虽然图8A所示的结构仅是其部分截面，但在平面X1处的布线层110的面积小于在平面X2处的布线层132的面积。在上述结构中，如示出在接合之后的状态的图8B所示，铜110a和铜132a还被势垒金属110b和132b(其中的每一个是扩散防止膜)以及第一扩散防止膜111包围。
接下来，将描述图8C和图8D所示的接合部分的修改。图8C是与图8A所示的对应的示意性截面图，图8D是与图8B所示的对应的示意性截面图。在图8C中，与图8A的差异是，布线层110具有在平面X1处的凹部分801。特别地，第一扩散防止膜111设置在层间绝缘膜105和布线层110上，并且具有与布线层110对应的开孔。在上述结构中，如示出在接合之后的状态的图8D所示，铜110a和铜132a也被势垒金属110b和132b(其中的每一个是扩散防止膜)以及第一扩散防止膜111包围。在该修改中，虽然凹部分801具有与第一扩散防止膜111的厚度对应的台阶，但该台阶可以例如通过部分移除铜110a而增大。此外，即使布线层110具有凹部分801，但由于导电材料(如铜)的热膨胀系数大于形成扩散防止膜和层间绝缘膜的介电材料的热膨胀系数，因此接合的接合平面X可以具有如图8D所示的平坦面。
接下来，将描述图8E和图8F所示的接合部分的修改。图8E是与图8C所示的对应的示意性截面图，图8F是与图8D所示的对应的示意性截面图。在图8E中，与图8C的差异是，布线层110具有在平面X1处的凸部分802。特别地，铜110a具有从由第一扩散防止膜111等形成的平面X1突出厚度D的凸部分。在上述结构中，如示出在接合之后的状态的图8F所示，铜110a和铜132a也被势垒金属110b和132b(其中的每一个是扩散防止膜)以及第一扩散防止膜111包围。在上述情况下，虽然具有平滑形状，但凸部分802可以具有矩形形状。此外，由于针对接合施加压力，所以即使布线层110具有凸部分802， 在接合之后的接合平面X也可以具有如图8F所示的平坦面。
接下来，将描述图8G和图8H所示的接合部分的修改。图8G是与图8E所示的对应的示意性截面图，图8H是与图8F所示的对应的示意性截面图。在图8G中，与图8E的差异是以下三点。也就是说，这三点是：布线层132在平面X2处也具有凸部分803，在平面X1处的布线层110的面积和在平面X2处的布线层132的面积彼此相等，第二构件309’具有第二扩散防止膜133。铜110a具有从平面X1突出厚度D1的凸部分，铜132a具有从平面X2突出厚度D2的凸部分。在上述结构中，如示出在接合之后的状态的图8H所示，铜110a和铜132a还被势垒金属110b和132b(其中的每一个是扩散防止膜)、第一扩散防止膜111和第二扩散防止膜133包围。在此情况下，在第一构件308’与第二构件309’之间形成带隙804。由于铜110a和铜132a与带隙804接触，因此在一些情况下，铜可以在与该带隙804的接口处扩散。然而，由于提供第一扩散防止膜111和第二扩散防止膜133，所以可以抑制铜到第一构件308’和第二构件309’的基板侧的扩散。当然，在图8G所示的第一构件308’和第二构件309’接合在一起之后，在一些情况下可以不形成带隙804。
如上所述，还在图8A至图8H所示的结构中，铜可以在接合部分处被扩散防止膜包围。因此，可以提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
下文中，将针对图8G所示的接合部分311B描述具有图8E和图8G中的每一个所示的凸部分的接合部分的形成方法。首先，形成层间绝缘膜126、布线层131和层间绝缘膜127。随后，通过双镶嵌方法在层间绝缘膜127中形成布线层132。在此情况下，当移除铜和势垒金属的过剩膜时，可以通过在使用CMP方法的情况下调整抛光速度和浆料或在使用蚀刻的情况下通过调整蚀刻气体等来形成具有凸部分(突出部分)的铜132a(图9A)。接下来，覆盖凸部分并且待形成为第二扩散防止膜的膜133’形成(图9B)，然后被通过蚀刻方法或CMP方法部分地移除，以使得可以形成第二扩散防止膜133和凸部分 803(图9C)。
此外，在图9A至图9C中，层间绝缘膜126和层间绝缘膜127分别由多个绝缘膜形成，并且覆盖布线层131的上面的扩散防止膜701被形成了。如上所述，可以适当地确定层间绝缘膜的结构。
前文中，在该实施例中，描述了接合部分的结构的修改。上述修改可以适当地组合使用，并且可以适当地应用于第一构件和第二构件中的至少一个。
接下来，将参照图10A至图11C描述本发明的实施例3。在该实施例中，将描述接合部分的结构的若干修改。图10A至图10C是参照图8A至图8H描述的接合部分的示意性截面图。在图10A至图10C中，由与上述相同的附图标记指示与图1至图7D所示的相似构成元件，并且将省略描述。
图10A和图10B彼此对应，并且分别是其中布置多个在图8B或图8D中所示的接合部分的示意性截面图。图10C示出图10B所示的结构的修改。
首先，在图10A中，对于多个接合部分311共同形成第一扩散防止膜111。在图10B中，通过图案化形成第一扩散防止膜111P，以便包围对应接合部分的周边部分，并且移除接合部分311之间的第一扩散防止膜111。此外，与图10B所示的结构相比，在图10C中，还提供第二扩散防止膜133P，并且通过图案化形成第二扩散防止膜133P以便包围对应接合部分的周边部分，如第一扩散防止膜111P的情况那样。
在此情况下，由于第一扩散防止膜由硅氮化物膜形成并且层间绝缘膜由硅氧化物形成，所以第一扩散防止膜具有比层间绝缘膜更高的介电常数。当沿着布线的周边部分设置具有如上所述的高介电常数的膜时，其寄生电容增大。因此，与图10A所示的结构相比，可以通过图10B所示的结构来减少布线之间的寄生电容。此外，还在如图10C所示那样提供第二扩散防止膜133P的情况下，可以减小寄生电容。扩散防止膜701也可以如图10B和图10C所示那样图案化。
图11A至图11C分别是用于示出在接合部分311处的布线层110、布线层132、第一扩散防止膜和第二扩散防止膜的位置关系的每个结构的外边缘的示意性平面图。换句话说，这些图示出在接合平面X处的每个结构的布置。在图11A至图11C中，与上述相同的附图标记指示与图1至图10C中所示的相似构成元件，并且将省略描述。
图11A是与图10B对应的示意性平面图。图11A所示的线XB-XB与沿着图10B的接合平面X取得的截面对应。如图11A所示，第一扩散防止膜111P具有最大面积，并且覆盖布线层132。也就是说，布线层132的铜被暴露出的面与第一扩散防止膜111P和布线层110对应。通过如上所述的图案之间的大小关系，可以容易地用扩散防止膜覆盖铜。
图11B和图11C是与图10C对应的示意性平面图。图11B和图11C所示的直线XC-XC与沿着图10C所示的接合平面X取得的截面对应。在图11B中，图案的大小从布线层110、布线层132、第一扩散防止膜111P和第二扩散防止膜133P依次增大。通过如上所述的图案之间的大小关系，布线层132的铜被暴露出的面与第一扩散防止膜111P和布线层110对应，并且可以容易地用扩散防止膜覆盖铜。
图11C具有与图11B所示的布线层110和布线层132的不同图案。布线层110和布线层132的图案在第一方向和与其不同的第二方向上分别具有长边。通过如上所述的图案，可以增加在接合处的位置偏移的可接受范围。
如在该实施例中描述的那样，第一扩散防止膜、第二扩散防止膜和接合部分分别可以具有任意形状，并且可以适当地选择其形状。
下文中，作为以上实施例中的每一个的固态图像拾取设备的应用示例，将举例描述包括固态图像拾取设备的图像拾取系统。在图像拾取系统中，除了主要用于拾取图像的设备(如相机)之外，还包括具有图像拾取功能的辅助设备(如个人计算机和个人数字助理)。例如，相机包括本发明的固态图像拾取设备和处理从固态图像拾取设备输出的信号的处理部分。该处理部分可以包括例如A-D转换器和处理从其 输出的数字信号的处理器。
如所描述的那样，根据本发明的固态图像拾取设备，可以提供一种能够抑制暗电流和/或泄漏电流的生成的固态图像拾取设备。
此外，本发明不限于说明书中描述的结构，并且也可以应用于其中像素电路改变并且对于第一构件仅布置光电转换器的情况。此外，本发明可以适当地应用于例如：其中导电和/或电路类型改变为相反类型的结构，其中还提供布线层和层间绝缘膜的结构，以及其中单镶嵌结构改变为双镶嵌结构的情况。此外，也可组合使用实施例的结构。
此外，本发明不限于固态图像拾取设备，并且也可以应用于普通半导体设备(如DRAM)。
虽然已经参照示例性实施例描述了本发明，但应理解，本发明不限于公开的示例性实施例。所附权利要求的范围将要被赋予最宽泛的解释，从而包括所有这些修改以及等效结构和功能。
本发明要求于2010年7月9日提交的日本专利申请No.2010-156926的权益，由此其全部内容通过引用而结合于此。
[附图标记列表]
301 像素部分
302 外围电路部分
308 第一构件
309 第二构件
149 第一布线结构
150 第二布线结构
311 接合部分
314 接合部分
101 第一基板
121 第二基板
X 接合平面
111 第一扩散防止膜
133 第二扩散防止膜。

Claims (20)

1.一种用于制造设备的方法，包括：
准备包括第一基板并且包括设置在第一基板上的第一结构的第 一构件，第一基板具有第一晶体管，第一结构包括介电材料膜、包括 包含导电材料的第一部分并包括与第一部分相连接的第一布线层，所 述第一结构的第一面包括所述第一部分以及第一结构的所述介电材料 膜；
准备包括第二基板并且包括设置在第二基板上的第二结构的第 二构件，第二基板具有第二晶体管，第二结构包括介电材料膜、包括 包含导电材料的第二部分并包括与第二部分相连接的第二布线层，所 述第二结构的第二面包括所述第二部分以及第二结构的所述介电材料 膜；以及
将第一结构的第一面和第二结构的第二面接合使得第一结构和 第二结构被布置在第一基板和第二基板之间，第一结构的介电材料膜 和第二结构的介电材料膜彼此接合，并且第一部分和第二部分被彼此 连接，
其中，第一结构的介电材料膜包括第一绝缘膜和第二绝缘膜，第 二绝缘膜被设置在第一绝缘膜和第一基板之间，第一绝缘膜的介电材 料与第二绝缘膜的介电材料不同，第一布线层被布置在第二绝缘膜和 第一基板之间，
其中，第一部分被布置在至少由第二绝缘膜形成的槽中，以使得 第二绝缘膜的一部分被布置在第一部分和第一布线层之间，第一部分 中的导电材料和第一基板之间的距离不小于第一布线层和第一基板之 间的距离，并且在沿着第一面的方向上不在第一部分的导电材料和第 二绝缘膜之间布置任何介电材料膜，
其中，第一部分包含在沿着第一面的方向上被布置在第一部分的 导电材料和第二绝缘膜之间的势垒金属膜，并且第一部分的势垒金属 膜和第一基板之间的距离不小于第一布线层和第一基板之间的该距 离，
其中，在接合之后，在与第二基板的主面垂直的方向上第一绝缘 膜被布置在第二部分的导电材料和第二绝缘膜之间，以及
其中第一绝缘膜防止导电材料扩散。
2.一种用于制造设备的方法，包括：
准备包括第一基板并包括设置在第一基板上的第一结构的第一 构件，第一基板具有第一晶体管，第一结构包括介电材料膜、包括包 含导电材料的第一部分并包括与第一部分相连接的第一布线层，所述 第一结构的第一面包括所述第一部分和第一结构的所述介电材料膜；
准备包括第二基板并且包括设置在第二基板上的第二结构的第 二构件，第二基板具有第二晶体管，第二结构包括介电材料膜、包括 包含导电材料的第二部分并包括与第二部分相连接的第二布线层，所 述第二结构的第二面包括所述第二部分和第二结构的所述介电材料 膜；以及
将第一结构的第一面和第二结构的第二面接合使得第一结构和 第二结构被布置在第一基板和第二基板之间，第一结构的介电材料膜 和第二结构的介电材料膜彼此接合，并且第一部分和第二部分被彼此 连接，
其中，第一结构的介电材料膜包括第一绝缘膜和第二绝缘膜，第 二绝缘膜被设置在第一绝缘膜和第一基板之间，第一绝缘膜的材料与 第二绝缘膜的材料不同，并且第一布线层被布置在第二绝缘膜和第一 基板之间，
其中，第一部分被布置在由至少第二绝缘膜形成的槽中，以使得 第二绝缘膜的一部分被布置在第一部分和第一布线层之间，第一部分 中的导电材料和第一基板之间的距离不小于第一布线层和第一基板之 间的距离，并且在沿着第一面的方向上不在第一部分的导电材料和第 二绝缘膜之间布置任何介电材料膜，
其中，第一部分包含势垒金属膜，该势垒金属膜在沿第一面的方 向被布置在第一部分的导电材料和第二绝缘膜之间，并且第一部分的 势垒金属膜按沿着第一面的方向被布置在第一部分的导电材料和第一 绝缘膜之间，并且第一部分的势垒金属膜被布置在第一部分的导电材 料和第一布线层之间，并且第一部分的势垒金属膜和第一基板之间的 距离不小于第一布线层和第一基板之间的该距离，
其中第二结构的介电材料膜包括第三绝缘膜和第四绝缘膜，第四 绝缘膜被布置在第三绝缘膜和第二基板之间，第三绝缘膜的材料与第 四绝缘膜的材料不同，并且第二布线层被布置在第四绝缘膜和第二基 板之间，
其中第二部分被布置在至少由第四绝缘膜形成的槽中，以使得第 四绝缘膜的一部分被布置在第二部分和第二布线层之间，第二部分中 的导电材料和第二基板之间的距离不小于第二布线层和第二基板之间 的距离，并且在沿着第二面的方向上不在第二部分的导电材料和第四 绝缘膜之间布置任何介电材料膜，
其中第二部分包含势垒金属膜，该势垒金属膜在沿第二面的方向 被布置在第二部分的导电材料和第四绝缘膜之间，该势垒金属膜在沿 第二面的方向被布置在第二部分的导电材料和第三绝缘膜之间，并且 第二部分的该势垒金属膜被布置在第二部分的导电材料和第二布线层 之间，并且第二部分的势垒金属膜和第二基板之间的距离不小于第二 布线层和第二基板之间的该距离，以及
其中第一部分的导电材料是铜，第一绝缘膜包含硅氮化物、硅碳 化物、硅碳氮化物或硅氧氮化物，第二部分的导电材料是铜，并且第 三绝缘膜包含硅氮化物、硅碳化物、硅碳氮化物或硅氧氮化物。
3.根据权利要求1或2所述的方法，其中第一绝缘膜防止第二 部分的导电材料扩散到第二绝缘膜中。
4.根据权利要求1所述的方法，其中第二部分的导电材料是铜， 第一绝缘膜包含硅氮化物、硅碳化物、硅碳氮化物或硅氧氮化物，并 且第一绝缘膜包含硅氧化物。
5.根据权利要求1所述的方法，其中第一绝缘膜的材料是硅材 料或无机材料，并且第一绝缘膜比第二绝缘膜薄。
6.根据权利要求1或2所述的方法，其中第二绝缘膜包含硅氧 化物或树脂，第四绝缘膜包含硅氧化物或树脂，并且第一绝缘膜和第 三绝缘膜被布置在第二绝缘膜和第四绝缘膜之间。
7.根据权利要求1所述的方法，其中第一部分的势垒金属膜在 沿着第一面的方向被布置在第一部分的导电材料和第一绝缘膜之间， 以及第一部分的势垒金属膜被布置在第一部分的导电材料和第一布线 层之间。
8.根据权利要求1、2、4、5或7所述的方法，其中第一绝缘膜 比第二绝缘膜薄。
9.根据权利要求1、2、4、5或7所述的方法，其中第一布线层 包含铝，并且第二布线层包含铜。
10.根据权利要求2所述的方法，其中在接合之后，第一绝缘膜 在与第二基板的主面垂直的方向上被布置在第二部分的导电材料和第 二绝缘膜之间。
11.根据权利要求1、4、5、7或10所述的方法，其中在接合之 前，第一面具有凹部分，并且凹部分的底部由第一部分的导电材料形 成。
12.根据权利要求1、2、4、5、7或10所述的方法，其中第一 结构包括布置在第二布线层和第一基板之间的层间绝缘膜(104)，其 中布置有第一部分的槽不由层间绝缘膜形成。
13.根据权利要求10所述的方法，其中在接合之后第三绝缘膜 在与第一基板的主面垂直的方向上被布置在第一部分的导电材料和第 四绝缘膜之间。
14.根据权利要求1所述的方法，其中第二结构的介电材料膜包 括硅氧化物膜(127)，和
其中第二部分被布置在由硅氧化物膜形成的槽中，并且硅氧化物 膜接合第一结构的介电材料膜。
15.根据权利要求2所述的方法，其中第二结构包括扩散防止膜 (701)和层间绝缘膜(126)，扩散防止膜(701)被布置在第二布线 层和第四绝缘膜(127)之间，并在层间绝缘膜和第四绝缘膜之间。
16.根据权利要求14所述的方法，其中第二部分包含按沿着第 二面的方向被布置在第二部分的导电材料和硅氧化物膜之间的势垒金 属膜。
17.根据权利要求1、2、4、5、7、10、13、14、15或16所述的 方法，其中第二结构包括包含导电材料的第三部分，第三部分被布置 在由第二结构的介电材料膜形成的槽中，并且在第一面内第三部分仅 面对第一结构的介电材料膜。
18.根据权利要求1、2、4、5、7、10、13、14、15或16所述的 方法，进一步包括：
在接合之后使第一基板变薄；和
在使第一基板变薄之后在第一基板中形成开孔。
19.根据权利要求18所述的方法，进一步包括：
在使第一基板变薄和形成开孔之间，在第一基板上形成平面化层 (409，411)；
其中形成开口包括部分地移除第一基板，以及
其中部分地移除第一基板跟随在部分地移除平面化层之后。
20.根据权利要求1、2、4、5、10、13、14、15或16所述的方 法，其中第一基板具有光电转换器，并且第二基板具有执行AD转换 的电路。
CN201610164142.0A 2010-07-09 2011-07-04 固态图像拾取设备 Active CN105720067B9 (zh)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP2010-156926 2010-07-09
JP2010156926A JP5451547B2 (ja) 2010-07-09 2010-07-09 固体撮像装置
CN201180033415.3A CN102971851B (zh) 2010-07-09 2011-07-04 固态图像拾取设备

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
CN201180033415.3A Division CN102971851B (zh) 2010-07-09 2011-07-04 固态图像拾取设备

Publications (3)

Publication Number Publication Date
CN105720067A CN105720067A (zh) 2016-06-29
CN105720067B CN105720067B (zh) 2019-10-01
CN105720067B9 true CN105720067B9 (zh) 2019-11-19

Family

ID=45440958

Family Applications (2)

Application Number Title Priority Date Filing Date
CN201180033415.3A Active CN102971851B (zh) 2010-07-09 2011-07-04 固态图像拾取设备
CN201610164142.0A Active CN105720067B9 (zh) 2010-07-09 2011-07-04 固态图像拾取设备

Family Applications Before (1)

Application Number Title Priority Date Filing Date
CN201180033415.3A Active CN102971851B (zh) 2010-07-09 2011-07-04 固态图像拾取设备

Country Status (6)

Country Link
US (9) US9166090B2 (zh)
EP (3) EP4428912A2 (zh)
JP (1) JP5451547B2 (zh)
CN (2) CN102971851B (zh)
RU (1) RU2521224C1 (zh)
WO (1) WO2012004965A1 (zh)

Families Citing this family (51)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP3514831B1 (en) 2009-12-26 2021-10-13 Canon Kabushiki Kaisha Solid-state image pickup apparatus and image pickup system
JP5451547B2 (ja) * 2010-07-09 2014-03-26 キヤノン株式会社 固体撮像装置
JP5517800B2 (ja) * 2010-07-09 2014-06-11 キヤノン株式会社 固体撮像装置用の部材および固体撮像装置の製造方法
US8896125B2 (en) 2011-07-05 2014-11-25 Sony Corporation Semiconductor device, fabrication method for a semiconductor device and electronic apparatus
TWI495041B (zh) * 2011-07-05 2015-08-01 Sony Corp 半導體裝置、用於半導體裝置之製造方法及電子設備
JP5994274B2 (ja) * 2012-02-14 2016-09-21 ソニー株式会社 半導体装置、半導体装置の製造方法、及び、電子機器
US9153565B2 (en) 2012-06-01 2015-10-06 Taiwan Semiconductor Manufacturing Company, Ltd. Image sensors with a high fill-factor
US10090349B2 (en) 2012-08-09 2018-10-02 Taiwan Semiconductor Manufacturing Company, Ltd. CMOS image sensor chips with stacked scheme and methods for forming the same
KR101240537B1 (ko) * 2012-05-07 2013-03-11 (주)실리콘화일 이종접합 구조의 칩 적층 이미지센서 및 그 제조방법
JP6012262B2 (ja) 2012-05-31 2016-10-25 キヤノン株式会社 半導体装置の製造方法
US8866250B2 (en) * 2012-09-05 2014-10-21 Taiwan Semiconductor Manufacturing Company, Ltd. Multiple metal film stack in BSI chips
US8796805B2 (en) * 2012-09-05 2014-08-05 Taiwan Semiconductor Manufacturing Company, Ltd. Multiple metal film stack in BSI chips
TWI595637B (zh) * 2012-09-28 2017-08-11 Sony Corp 半導體裝置及電子機器
JP6128787B2 (ja) * 2012-09-28 2017-05-17 キヤノン株式会社 半導体装置
JP6017297B2 (ja) * 2012-12-14 2016-10-26 オリンパス株式会社 半導体装置の製造方法
KR102136845B1 (ko) 2013-09-16 2020-07-23 삼성전자 주식회사 적층형 이미지 센서 및 그 제조방법
JP6212720B2 (ja) * 2013-09-20 2017-10-18 パナソニックＩｐマネジメント株式会社 半導体装置及びその製造方法
TWI676279B (zh) * 2013-10-04 2019-11-01 新力股份有限公司 半導體裝置及固體攝像元件
CN104810366B (zh) * 2014-01-26 2018-09-11 中芯国际集成电路制造(上海)有限公司 一种集成电路及其制造方法
CN104241200B (zh) * 2014-08-28 2017-03-08 武汉新芯集成电路制造有限公司 一种功率器件与控制器件的集成方法
CN104241201B (zh) * 2014-08-28 2017-05-31 武汉新芯集成电路制造有限公司 一种集成功率器件与控制器件的方法
WO2016046606A1 (en) * 2014-09-26 2016-03-31 Nokia Technologies Oy Methods and apparatus for minimization of drive testing
CN104599988B (zh) * 2015-01-05 2017-08-04 武汉新芯集成电路制造有限公司 集成功率器件与控制器件的方法
US10354975B2 (en) * 2016-05-16 2019-07-16 Raytheon Company Barrier layer for interconnects in 3D integrated device
US10431614B2 (en) * 2017-02-01 2019-10-01 Semiconductor Components Industries, Llc Edge seals for semiconductor packages
WO2018186198A1 (ja) * 2017-04-04 2018-10-11 ソニーセミコンダクタソリューションズ株式会社 固体撮像装置、及び電子機器
JP2018195656A (ja) 2017-05-16 2018-12-06 ソニーセミコンダクタソリューションズ株式会社 半導体装置の製造方法及び半導体装置
CN110870071B (zh) * 2017-07-18 2024-03-22 索尼半导体解决方案公司 成像装置以及成像装置的制造方法
FR3069371B1 (fr) 2017-07-19 2019-08-30 Stmicroelectronics (Crolles 2) Sas Dispositif electronique capteur d'images
US10727217B2 (en) * 2017-09-29 2020-07-28 Taiwan Semiconductor Manufacturing Company, Ltd. Method of manufacturing semiconductor device that uses bonding layer to join semiconductor substrates together
US10879115B2 (en) * 2017-11-21 2020-12-29 Taiwan Semiconductor Manufacturing Co., Ltd. Semiconductor device and forming method thereof
KR102491881B1 (ko) * 2018-01-16 2023-01-27 삼성디스플레이 주식회사 디스플레이 장치
EP3748956B1 (en) * 2018-02-01 2023-09-27 Sony Semiconductor Solutions Corporation Solid-state imaging device and method for manufacturing same, and electronic apparatus
JP2019140178A (ja) * 2018-02-07 2019-08-22 東芝メモリ株式会社 半導体装置
JP7353729B2 (ja) * 2018-02-09 2023-10-02 キヤノン株式会社 半導体装置、半導体装置の製造方法
JP6952629B2 (ja) * 2018-03-20 2021-10-20 株式会社東芝 半導体装置
KR102524998B1 (ko) * 2018-09-13 2023-04-24 주식회사 디비하이텍 후면 조사형 이미지 센서 및 그 제조 방법
JP2020043298A (ja) * 2018-09-13 2020-03-19 キヤノン株式会社 半導体装置、その製造方法および電子機器
WO2020116040A1 (ja) * 2018-12-04 2020-06-11 ソニーセミコンダクタソリューションズ株式会社 半導体装置及び電子機器
JP7551277B2 (ja) * 2019-01-31 2024-09-17 キヤノン株式会社 半導体装置、機器
US10840185B2 (en) * 2019-03-05 2020-11-17 Texas Instruments Incorporated Semiconductor device with vias having a zinc-second metal-copper composite layer
JP7321724B2 (ja) * 2019-03-05 2023-08-07 キヤノン株式会社 半導体装置および機器
JP7297516B2 (ja) * 2019-04-25 2023-06-26 キヤノン株式会社 半導体装置および機器
JP2021027277A (ja) * 2019-08-08 2021-02-22 キヤノン株式会社 光電変換装置、光電変換システム
JP2021034560A (ja) * 2019-08-23 2021-03-01 キオクシア株式会社 半導体装置およびその製造方法
KR20210025156A (ko) 2019-08-26 2021-03-09 삼성전자주식회사 반도체 장치 및 그 제조방법
JP7417393B2 (ja) * 2019-09-27 2024-01-18 キヤノン株式会社 半導体装置及び半導体ウエハ
JP7353121B2 (ja) 2019-10-08 2023-09-29 キヤノン株式会社 半導体装置および機器
JP2021082803A (ja) * 2019-11-18 2021-05-27 ソニーセミコンダクタソリューションズ株式会社 撮像素子および撮像素子の製造方法
JP2022018705A (ja) 2020-07-16 2022-01-27 キヤノン株式会社 半導体装置
KR20220010947A (ko) * 2020-07-20 2022-01-27 에스케이하이닉스 주식회사 보호 소자를 갖는 이미지 센싱 장치

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN100530667C (zh) * 2004-12-30 2009-08-19 科洛司科技有限公司 具有放大的光检测区域的图像传感器及其制造方法

Family Cites Families (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6168965B1 (en) * 1999-08-12 2001-01-02 Tower Semiconductor Ltd. Method for making backside illuminated image sensor
US6455425B1 (en) * 2000-01-18 2002-09-24 Advanced Micro Devices, Inc. Selective deposition process for passivating top interface of damascene-type Cu interconnect lines
US6642081B1 (en) * 2002-04-11 2003-11-04 Robert Patti Interlocking conductor method for bonding wafers to produce stacked integrated circuits
JP4432502B2 (ja) 2004-01-20 2010-03-17 ソニー株式会社 半導体装置
DE202004005607U1 (de) 2004-04-06 2004-06-09 Ulamo Holding B.V. Befestigungsvorrichtung für eine Frontplatte
KR100782463B1 (ko) 2005-04-13 2007-12-05 (주)실리콘화일 3차원 구조를 갖는 이미지 센서의 분리형 단위화소 및 그제조방법
JP4533367B2 (ja) * 2005-11-18 2010-09-01 キヤノン株式会社 固体撮像装置
JP5162869B2 (ja) * 2006-09-20 2013-03-13 富士通セミコンダクター株式会社 半導体装置およびその製造方法
JP2008277511A (ja) * 2007-04-27 2008-11-13 Fujifilm Corp 撮像素子及び撮像装置
US7960768B2 (en) * 2008-01-17 2011-06-14 Aptina Imaging Corporation 3D backside illuminated image sensor with multiplexed pixel structure
JP2010067844A (ja) * 2008-09-11 2010-03-25 Omron Corp 固体撮像素子の製造方法
JP2010156926A (ja) 2009-01-05 2010-07-15 Sharp Corp 表示装置、及びテレビ受信装置
JP5187284B2 (ja) 2009-06-26 2013-04-24 ソニー株式会社 半導体装置の製造方法
EP3514831B1 (en) * 2009-12-26 2021-10-13 Canon Kabushiki Kaisha Solid-state image pickup apparatus and image pickup system
JP5451547B2 (ja) * 2010-07-09 2014-03-26 キヤノン株式会社 固体撮像装置
CN106449676A (zh) * 2011-07-19 2017-02-22 索尼公司 半导体装置和电子设备
TWI577001B (zh) * 2011-10-04 2017-04-01 Sony Corp 固體攝像裝置、固體攝像裝置之製造方法及電子機器
JP2014203961A (ja) * 2013-04-04 2014-10-27 ソニー株式会社 固体撮像装置およびその製造方法、ならびに電子機器
JP2022018705A (ja) * 2020-07-16 2022-01-27 キヤノン株式会社 半導体装置

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN100530667C (zh) * 2004-12-30 2009-08-19 科洛司科技有限公司 具有放大的光检测区域的图像传感器及其制造方法

Also Published As

Publication number Publication date
US20130112849A1 (en) 2013-05-09
CN102971851A (zh) 2013-03-13
CN105720067A (zh) 2016-06-29
US10217786B2 (en) 2019-02-26
CN102971851B (zh) 2016-04-06
US20170186803A1 (en) 2017-06-29
US20190148446A1 (en) 2019-05-16
US11177310B2 (en) 2021-11-16
US9640581B2 (en) 2017-05-02
US20160005776A1 (en) 2016-01-07
RU2521224C1 (ru) 2014-06-27
JP5451547B2 (ja) 2014-03-26
US20220037390A1 (en) 2022-02-03
CN105720067B (zh) 2019-10-01
EP3706172B1 (en) 2024-09-11
US10573680B2 (en) 2020-02-25
EP2591505A4 (en) 2014-04-16
US9166090B2 (en) 2015-10-20
WO2012004965A1 (en) 2012-01-12
EP4428912A2 (en) 2024-09-11
US20180166494A1 (en) 2018-06-14
US20230299112A1 (en) 2023-09-21
US12068351B2 (en) 2024-08-20
EP3706172A1 (en) 2020-09-09
US9419030B2 (en) 2016-08-16
US9929202B2 (en) 2018-03-27
US20160322415A1 (en) 2016-11-03
JP2012019147A (ja) 2012-01-26
EP2591505A1 (en) 2013-05-15
US20200168654A1 (en) 2020-05-28

Similar Documents

Publication Publication Date Title
CN105720067B9 (zh) 固态图像拾取设备
US11843023B2 (en) Member for solid-state image pickup device and method for manufacturing solid-state image pickup device
US11942501B2 (en) Solid-state image pickup apparatus and image pickup system
US10367022B2 (en) Solid-state imaging device, members for the same, and imaging system

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant
CI03 Correction of invention patent
CI03 Correction of invention patent

Correction item: Claims

Correct: Correct

False: error

Number: 40-01

Page: full text

Volume: 35