WO2013084579A1 - 電子血圧計 - Google Patents

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WO2013084579A1
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祐輝 山下
小林 達矢
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オムロンヘルスケア株式会社
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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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    • H02H9/002Emergency protective circuit arrangements for limiting excess current or voltage without disconnection limiting speed of change of electric quantities, e.g. soft switching on or off limiting inrush current on switching on of inductive loads subjected to remanence, e.g. transformers

Definitions

  • This invention relates to an electronic sphygmomanometer, and more particularly to an electronic sphygmomanometer that measures blood pressure by pressurizing an air bag with a piezoelectric pump.
  • Blood pressure is one of the indicators for analyzing cardiovascular diseases. Analyzing the risk of cardiovascular disease based on blood pressure is effective in preventing cardiovascular diseases such as stroke, heart failure and myocardial infarction.
  • cardiovascular diseases such as stroke, heart failure and myocardial infarction.
  • early morning hypertension in which blood pressure rises in the early morning, is related to heart disease and stroke.
  • morning surge a symptom of a sudden rise in blood pressure between 1 hour and 1.5 hours after waking up, called morning surge, has a causal relationship with stroke.
  • grasping the correlation between time (lifestyle) and blood pressure change is useful for risk analysis of cardiovascular diseases. Therefore, it is necessary to continuously measure blood pressure over a long period of time.
  • a typical electronic sphygmomanometer wraps an armband with a bladder in it evenly around a part of a living body, and pressurizes and depressurizes the bladder with air, thereby reducing the volume change of the compressed arterial blood vessel.
  • An electronic sphygmomanometer that uses an oscillometric method to capture blood pressure as a change in amplitude of cuff pressure) and uses a piezoelectric pump such as that disclosed in Japanese Patent Application Laid-Open No. 2009-74418 can be used. It is.
  • a pulse that matches the characteristics of the piezoelectric pump may be output from the CPU, and the design is easy. And the system which applies the pulse to a piezoelectric pump by H bridge circuit etc. is adopted. In this case, since the signal is inverted at the time of switching of the H bridge circuit or the like, it is known that a large inrush current flows due to the charge accumulated in the piezoelectric pump and the inverted signal input.
  • the inrush current will cause a drop in battery voltage and may affect the accuracy of blood pressure measurement. There is also a problem that the battery life of the sphygmomanometer is shortened.
  • the present invention has been made to solve the above-described problems, and an object thereof is to provide an electronic sphygmomanometer capable of suppressing an inrush current by a simple method.
  • An electronic sphygmomanometer includes a cuff attached to a measurement site, a piezoelectric pump that adjusts pressure applied to the cuff, a drive circuit that drives the piezoelectric pump, and a pulse signal that defines drive timing of the piezoelectric pump.
  • a controller for outputting to the drive circuit.
  • the drive circuit is responsive to the first and second drive signals to switch the connection relationship of the voltages applied to both ends of the piezoelectric pump, respectively, and the first and second based on the pulse signal output from the controller.
  • a signal generation circuit that outputs two drive signals.
  • the signal generation circuit includes a signal adjustment circuit that adjusts timing so that the phases of the first and second drive signals do not overlap.
  • the signal generation circuit further includes an inverting circuit that outputs an inverted pulse signal obtained by inverting the pulse signal, and the signal adjustment circuit adjusts a duty ratio of at least one of the pulse signal and the inverted pulse signal.
  • the signal adjustment circuit includes a delay circuit that delays the phase of the signal and a waveform shaping circuit.
  • the delay circuit includes a resistance element and a capacitance element.
  • the resistance element is a variable resistance element whose resistance value changes according to an instruction from the outside.
  • the capacitive element is a variable capacitive element whose capacitance component changes according to an instruction from the outside.
  • Inrush current can be suppressed with a simple method.
  • FIG. 6 is a diagram illustrating specific configurations of inversion circuit 60 and signal adjustment circuit 62 according to the embodiment of the present invention. It is a diagram illustrating input and output signal waveforms of inversion circuit 60 and signal adjustment circuit 62 according to the embodiment of the present invention. It is another figure explaining the input and output signal waveforms of inversion circuit 60 and signal adjustment circuit 62 according to the embodiment of the present invention.
  • an electronic sphygmomanometer will be described in which the blood pressure is calculated by the oscillometric method with the measurement site as the upper arm and one pressure sensor is mounted as an example.
  • the method applied for blood pressure calculation is not limited to the oscillometric method.
  • the number of pressure sensors may be plural.
  • FIG. 1 is a diagram illustrating an external appearance of an electronic sphygmomanometer 1 according to the embodiment of the present invention.
  • FIG. 2 is a block diagram showing a hardware configuration of the electronic blood pressure monitor according to the embodiment of the present invention.
  • the electronic sphygmomanometer 1 includes a main body 10, a surface cover 11, and a cuff 20 that can be wound around the upper arm of the measurement subject.
  • the cuff 20 includes an air bag 21.
  • the front cover 11 is provided with a display unit 40 composed of, for example, liquid crystal, and an operation unit 41 including a plurality of switches for receiving instructions from a user (a person to be measured).
  • the main body unit 10 includes a CPU (Central Processing Unit) 100 for centrally controlling each unit and performing various arithmetic processes, and for causing the CPU 100 to perform predetermined operations.
  • a processing memory 42 for storing programs and data; a data storage memory 43 for storing measured blood pressure data; a battery 44 for supplying power to each part of the main body 10; And a timer 45 for measuring time and outputting time-measured data to the CPU 100.
  • the operation unit 41 includes a measurement / stop switch 41 ⁇ / b> A that receives an instruction to turn on or off the power supply and a measurement start / end instruction, a timer set switch 41 ⁇ / b> B that is operated to set the timer 45, and a memory 43.
  • the memory switch 41C for receiving information such as blood pressure data stored in the memory 43 and displaying it on the display unit 40, and instructions for raising / lowering the number when the timer is set and the memory number when calling the memory It has arrow switches 41D and 41E for receiving.
  • the main body 10 further has a cuff pressure adjusting mechanism including a piezoelectric pump 51 and an exhaust valve (hereinafter referred to as a valve) 52.
  • the air system including the piezoelectric pump 51, the valve 52, and the pressure sensor 321 for detecting the pressure (cuff pressure) in the air bag 21 is connected to the air bag 21 contained in the cuff 20 via the cuff air tube 31. Connected.
  • the main body 10 further includes the air system, the cuff pressure adjusting mechanism, and the oscillation circuit 331 described above.
  • the cuff pressure adjusting mechanism includes a pump drive circuit 53 and a valve drive circuit 54 in addition to the piezoelectric pump 51 and the valve 52.
  • the piezoelectric pump 51 supplies air to the air bladder 21 in order to increase the cuff pressure.
  • the valve 52 is opened and closed to exhaust or seal the air in the air bladder 21.
  • the pump drive circuit 53 controls the drive of the piezoelectric pump 51 based on a control signal (pulse signal) given from the CPU 100.
  • the valve drive circuit 54 performs opening / closing control of the valve 52 based on a control signal given from the CPU 100.
  • a capacitance type pressure sensor is used as an example.
  • the capacitance type pressure sensor the capacitance value changes according to the cuff pressure to be detected.
  • the oscillation circuit 331 is connected to the pressure sensor 321 and oscillates based on the capacitance value of the pressure sensor.
  • the oscillation circuit 331 operates in response to an instruction from the CPU 100, and the CPU 100 outputs an activation signal to the oscillation circuit 331.
  • the pressure sensor is not limited to a capacitance type, and other methods may be employed. For example, it is possible to employ a piezoresistive pressure sensor using a piezoresistive element.
  • the oscillation circuit 331 that has received the activation signal from the CPU 100 outputs a signal having a frequency corresponding to the capacitance value of the pressure sensor 321 (hereinafter referred to as a frequency signal).
  • the output frequency signal is given to the CPU 100.
  • CPU100 detects a pressure by converting the frequency signal input from the oscillation circuit 331 into a pressure.
  • FIG. 3 is a diagram illustrating a configuration of pump drive circuit 53 according to the embodiment of the present invention.
  • pump drive circuit 53 includes an inverting circuit 60, a signal adjustment circuit 62, an H bridge circuit 64, and a booster circuit 66.
  • the inverting circuit 60 receives a control signal (pulse signal) input from the CPU 100.
  • the control signal (pulse signal) is a timing signal for defining the driving of the piezoelectric pump 51. Then, the inverting circuit 60 outputs two control signals in response to the input of the control signal (pulse signal). Specifically, one outputs a signal having the same phase as the input pulse signal, and the other outputs an inverted pulse signal obtained by inverting the phase of the pulse signal.
  • the signal adjustment circuit 62 receives the pulse signal and the inverted pulse signal input from the inverting circuit 60, respectively, and outputs them as first and second driving signals for driving the H bridge circuit 64, respectively. Specifically, the signal adjustment circuit 62 adjusts and outputs the duty ratio of at least one of the input pulse signal and inverted pulse signal.
  • the H bridge circuit 64 is a switching circuit that supplies a predetermined current to the piezoelectric pump 51, and supplies the predetermined current to the piezoelectric pump 51 according to the first and second drive signals.
  • a voltage is applied to both ends of the piezoelectric pump 51 so that a current is supplied to the piezoelectric pump 51 in a first direction (positive direction) according to the first drive signal. Further, a voltage is applied to both ends of the piezoelectric pump 51 so as to supply current to the piezoelectric pump 51 in a second direction (negative direction) opposite to the first direction in accordance with the second drive signal.
  • switching control is performed to switch the connection relationship of the voltages to be applied to both ends of the piezoelectric pump 51 according to the first and second drive signals (switch the logic). Specifically, one side of the voltage applied to the piezoelectric pump 51 is set to a high voltage and the other side is set to a low voltage, and the connection relation of the voltage is switched according to the first and second drive signals.
  • the booster circuit 66 adjusts the level of the applied voltage supplied to the H bridge circuit 64 in accordance with an instruction from the CPU 100. It is possible to adjust the amount of current flowing through the piezoelectric pump 51 by adjusting the level of the applied voltage. When the amount of current flowing through the piezoelectric pump 51 is constant, no instruction for voltage adjustment from the CPU 100 is required, and the voltage may be fixedly boosted to a desired voltage and supplied to the H bridge circuit 64. Note that if it is not necessary to boost the voltage, a configuration in which the booster circuit 66 is not particularly provided is also possible. The configurations of the H bridge circuit 64 and the booster circuit 66 are well-known techniques and will not be described in detail.
  • FIG. 4 is a diagram illustrating a specific configuration of inverting circuit 60 and signal adjustment circuit 62 according to the embodiment of the present invention.
  • inversion circuit 60 includes an inverter IV0.
  • the pulse signal input to the inverting circuit 60 is branched and one is output to the signal adjusting circuit 62 as it is, and the other is output to the signal adjusting circuit 62 as an inverted pulse signal via the inverter IV0.
  • the signal adjustment circuit 62 includes inverters IV1 and IV2, NAND circuits ND0 and ND1, resistance elements R0 and R1, and capacitance elements C0 and C1.
  • One input node of the NAND circuit ND0 receives an input of a pulse signal, and the other input node receives an input of a pulse signal that has passed through a low-pass filter.
  • the low-pass filter includes a resistance element R0 and a capacitance element C0.
  • the pulse signal that has passed through the low-pass filter has a slow rise and fall of the signal according to the resistance and capacitance components of the resistance element R0 and the capacitance element C0.
  • NAND circuit ND0 outputs an “L” level when one and the other input nodes both attain “H” level, and an “H” level signal is output from signal adjustment circuit 62 via inverter IV1. .
  • the phase of the internal signal of the NAND circuit ND0 is delayed.
  • the rise and fall timings of the output signal of the NAND circuit ND0 change. That is, the duty ratio of the output signal of the NAND circuit ND0 can be adjusted, and as a result, the duty ratio of the output signal from the signal adjustment circuit 62 is adjusted.
  • one input node of the NAND circuit ND1 receives the input of the inverted pulse signal
  • the other input node receives the input of the inverted pulse signal that has passed through the low-pass filter.
  • the low-pass filter includes a resistance element R1 and a capacitance element C1. The rising and falling edges of the inverted pulse signal that has passed through the low-pass filter become dull according to the resistance and capacitance components of the resistance element R1 and the capacitance element C1.
  • NAND circuit ND1 outputs an “L” level when one and the other input nodes both attain “H” level, and an “H” level signal is output from signal adjustment circuit 62 via inverter IV2. .
  • the phase of the internal signal of the NAND circuit ND1 is delayed.
  • the rise and fall timings of the output signal of the NAND circuit ND1 change. That is, it becomes possible to adjust the duty ratio of the output signal of the NAND circuit ND1, and as a result, the duty ratio of the output signal from the signal adjustment circuit 62 is adjusted.
  • FIG. 5 is a diagram illustrating input and output signal waveforms of inversion circuit 60 and signal adjustment circuit 62 according to the embodiment of the present invention.
  • FIG. 5 shows a case where a control signal (pulse signal) with a constant period is output from the CPU 100. Specifically, there is shown a case where a transition is made to “H” level at time t0, “L” level at time t2, “H” level at time t4, and “L” level at time t6.
  • the waveform of the input signal input to the NAND circuit ND0 according to the control signal is shown.
  • the amplitude of the input signal waveform is 0 to Vcc, 30% or less of the maximum amplitude is “L” level, and 70% or more is “H”.
  • the case where a waveform is shaped as a level is shown.
  • a signal having the same phase as the pulse signal is input to one input node of the NAND circuit ND0 because no delay occurs. That is, the rise and fall of the internal signal A1 according to the signal from one input node of the NAND circuit ND0 has no delay, so that it is at the “H” level at the time t0 in phase with the control signal, and at the “L” level at the time t2. It transitions to the “H” level at time t4 and to the “L” level at time t6.
  • the signal through the low-pass filter is input to the other input node of the NAND circuit ND0, a signal whose waveform signal rises and falls slowly is input. That is, the rising and falling edges of the internal signal B1 according to the signal from the other input node of the NAND circuit ND0 are “H” level at the time t1 when the phase is delayed from the control signal due to the delay, “L” level at the time t3, It transitions to the “H” level at t5 and to the “L” level at time t7.
  • the output signal of the NAND circuit ND0 is output based on the combination of the internal signals A1 and B1. Specifically, when either one of the internal signals A1 and B1 is at the “L” level, an “H” level signal is output, and when both are at the “H” level, an “L” level signal is output. Is done.
  • the drive signal FIN input to the H bridge circuit in which the duty ratio of the control signal (pulse signal) is adjusted is output from the signal adjustment circuit 62.
  • FIG. 6 is another diagram illustrating the input and output signal waveforms of inversion circuit 60 and signal adjustment circuit 62 according to the embodiment of the present invention.
  • FIG. 6 shows a case where a control signal (pulse signal) with a constant period is output from the CPU 100.
  • an inverted pulse signal inverted by the inverter IV0 is shown. Specifically, there is shown a case where a transition is made to “L” level at time t10, “H” level at time t12, “L” level at time t14, and “H” level at time t16.
  • the waveform of the input signal input to the NAND circuit ND1 in accordance with the inverted pulse signal is shown.
  • the amplitude of an input signal waveform is 0 to Vcc, 30% or less of the maximum amplitude is “L” level, and 70% or more is “H”.
  • the case where a waveform is shaped as a level is shown.
  • a signal having the same phase as the inverted pulse signal is input to one input node of the NAND circuit ND1 because no delay occurs. That is, the rise and fall of the internal signal A2 according to the signal from one input node of the NAND circuit ND1 has no delay, so that it is at the “L” level at the time t10 and at the “H” level at the time t12 in phase with the inverted pulse signal. At time t14, the level changes to the “L” level, and at time t16, the level changes to the “H” level.
  • the signal through the low-pass filter is input to the other input node of the NAND circuit ND1
  • a signal whose waveform signal rises and falls slowly is input. That is, the rising and falling edges of the internal signal B2 according to the signal from the other input node of the NAND circuit ND0 are “L” level at time t11 when the phase is delayed from the control signal due to delay, “H” level at time t13, It transitions to the “L” level at t15 and to the “H” level at time t17.
  • the output signal of the NAND circuit ND1 is output based on the combination of the internal signals A2 and B2. Specifically, when either one of internal signals A2 and B2 is at “L” level, an “H” level signal is output, and when both are at “H” level, an “L” level signal is output. Is done.
  • the drive signal RIN input to the H bridge circuit in which the duty ratio of the control signal (pulse signal) is adjusted is output from the signal adjustment circuit 62.
  • FIG. 7 is a diagram for explaining the inrush current when the drive signals FIN and RIN are input to the H-bridge circuit.
  • FIG. 7A here, as a comparative example, a waveform of a drive signal input to a conventional H-bridge circuit is shown.
  • the drive signals FIN and RIN have a complementary logical relationship with each other, the falling of the drive signal FIN from the “H” level to the “L” level, and the drive signal RIN “L”.
  • the rising timing from the “H” level to the “H” level was almost simultaneous.
  • the timing at which the inrush current caused by the fall of the drive signal FIN from the “H” level to the “L” level and the inrush current caused by the rise of the drive signal RIN from the “L” level to the “H” level flow.
  • the inrush current increases as a whole.
  • an excessive voltage drop was caused by the inrush current.
  • FIG. 7B here, the waveform of the drive signal input to the H-bridge circuit in this example is shown.
  • the case where the duty ratio is adjusted so that the rise and fall timings of the drive signals FIN and RIN do not overlap is shown.
  • the falling of the drive signal FIN from the “H” level at the time t20 to the “L” level and the rising timing of the drive signal RIN from the “L” level to the “H” level at the time t21 are shifted.
  • the timing at which the inrush current caused by the fall of the signal FIN from the “H” level to the “L” level and the inrush current caused by the rise of the drive signal RIN from the “L” level to the “H” level are shifted.
  • the inrush current can be suppressed as a whole.
  • size of an inrush current is suppressed and it suppresses that an excessive voltage drop arises.
  • the drive signal RIN falls from the “H” level to the “L” level at the time t22 and the drive signal FIN rises from the “L” level to the “H” level at the time t23.
  • the timing at which the inrush current due to the falling of the signal RIN from the “H” level to the “L” level and the inrush current due to the rising of the drive signal FIN from the “L” level to the “H” level flow is shifted.
  • the inrush current can be suppressed as a whole.
  • the signal is shaped using the NAND circuit.
  • the signal is not limited to the NAND circuit, and the signal is shaped using another logic circuit such as an AND circuit or a NOR circuit.
  • a configuration using a Schmitt trigger is also possible.
  • FIG. 8 is a diagram illustrating a configuration of pump drive circuit 53 # according to a modification of the embodiment of the present invention.
  • FIG. 9 is a diagram illustrating a specific configuration of inverting circuit 60 and signal adjustment circuit 63 according to the modification of the embodiment of the present invention.
  • signal adjustment circuit 63 differs from signal adjustment circuit 62 in that resistance elements R0 and R1 are replaced with resistance elements R0 # and R1 #. Since the configuration of the other parts is the same, detailed description thereof will not be repeated.
  • Resistance elements R0 # and R1 # are variable resistance elements, and their resistance values change according to a phase delay control signal from the CPU 100.
  • the resistance value of each of the resistance elements R0 # and R1 # is changed according to the phase delay control signal.
  • only one of the resistance values may be adjusted independently. It shall be adjustable. The selection of the variable resistance or variable capacity is changed according to the arm circumference, wrist circumference, remaining battery level, loose winding, and the like.
  • the resistance value By adjusting the resistance value, it is possible to adjust the rise to the “H” level and the fall to the “L” level of the signal that has passed through the low-pass filter described above. That is, the duty ratio of the drive signal FINDIN output from the signal adjustment circuit 63 can be finely adjusted, and a drive signal that matches the characteristics of the piezoelectric pump can be input to the H bridge circuit 64.
  • the present invention is not limited to resistance elements, and the capacitance elements C0 and C1 are variable capacitance elements and the capacitance component is changed. It is also possible to finely adjust the rise to the “H” level and the fall to the “L” level of the signal that has passed through the low-pass filter. Moreover, it is naturally possible to adopt a configuration in which both are combined.
  • a method of shifting and outputting the pulse signal from the CPU with respect to the drive signal FINDIN is also conceivable, but it is necessary to control a time of 1 ⁇ sec or less from the drive frequency of the piezoelectric pump, and for this purpose, a high clock CPU is required. Thus, the power consumption is large and the battery life is shortened.
  • the pulse signal can be shifted by a simple method, which is advantageous in terms of cost and power consumption.

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Abstract

 電子血圧計(1)は、測定部位に装着するカフ(20)と、カフに加える圧力を調整する圧電ポンプ(51)と、圧電ポンプを駆動する駆動回路(53)と、圧電ポンプの駆動タイミングを規定するパルス信号を駆動回路に出力するコントローラ(100)とを備える。駆動回路は、第1および第2駆動信号にそれぞれ応答して圧電ポンプの両端にそれぞれ印加する電圧の接続関係を切り替えるためのスイッチング回路(64)と、コントローラから出力されたパルス信号に基づいて第1および第2駆動信号を出力する信号生成回路(60)とを含む。信号生成回路は、第1および第2駆動信号の位相が重ならないようにタイミングを調整する信号調整回路(62)を有する。

Description

電子血圧計
 この発明は、電子血圧計に関し、特に圧電ポンプで空気袋を加圧等することで血圧を測定する電子血圧計に関する。
 血圧は循環器疾患を解析する指標の一つである。血圧に基づいて循環器疾患のリスク解析を行なうことは、たとえば脳卒中や心不全や心筋梗塞などの心血管系の疾患の予防に有効である。特に、早朝に血圧が上昇する早朝高血圧は心臓病や脳卒中などに関係している。さらに、早朝高血圧の中でも、モーニングサージと呼ばれる起床後1時間から1時間半ぐらいの間に急激に血圧が上昇する症状は、脳卒中との因果関係があることが判明している。そこで、時間(生活習慣)と血圧変化の相互関係を把握することが、心血管系の疾患のリスク解析に有用である。したがって、長期間にわたり、連続的に血圧測定することが必要となってきている。
 また、近年の研究成果により、病院や健康診断時に測定する血圧(随時血圧)よりも、家庭で測定した家庭血圧が、より心血管系疾患の予防・診断・治療に有効であることが判明してきている。これにともない、家庭向け血圧計が広く普及し、家庭血圧値を診断に使用する動きも始まっており、種々の家庭向け血圧計がある。
 一般的な電子血圧計は、空気袋を内蔵した腕帯を生体の一部に均等に巻き付け、その空気袋を空気により加減圧することにより、圧迫された動脈血管の容積変化を空気袋圧力(カフ圧)変動の振幅変化として捕らえ、血圧算出するオシロメトリック法を用いた電子血圧計が用いられており、例えば、特開2009-74418号公報のような圧電ポンプを用いて加圧することが可能である。
特開2009-74418号公報
 一方で、当該圧電ポンプを駆動する方式として、他励振方式と自励振方式があるが、自励振方式の場合、回路の設計誤差等に起因してパルスの出力特性を微調整する必要があり、当該微調整のための回路を設ける場合、回路のレイアウト等が大きくなるという問題がある。
 他励振方式の場合、例えばCPUから圧電ポンプの特性に合わせたパルスを出力すれば良く設計が容易である。そして、そのパルスをHブリッジ回路等により、圧電ポンプに印加する方式が採用されている。この場合、Hブリッジ回路等のスイッチング時に信号を反転させるため、圧電ポンプに蓄積された電荷と反転した信号入力によって、大きな突入電流が流れることが知られている。
 当該突入電流は、電池電圧の降下を引き起こすことになり、血圧測定の精度に影響を及ぼす可能性がある。また、血圧計の電池寿命が短くなるという問題もある。
 本発明は、上記のような問題を解決するためになされたものであって、突入電流を簡易な方式で抑制することが可能な電子血圧計を提供することを目的とする。
 本発明のある局面に従う電子血圧計は、測定部位に装着するカフと、カフに加える圧力を調整する圧電ポンプと、圧電ポンプを駆動する駆動回路と、圧電ポンプの駆動タイミングを規定するパルス信号を駆動回路に出力するコントローラとを備える。駆動回路は、第1および第2駆動信号にそれぞれ応答して圧電ポンプの両端にそれぞれ印加する電圧の接続関係を切り替えるためのスイッチング回路と、コントローラから出力されたパルス信号に基づいて第1および第2駆動信号を出力する信号生成回路とを含む。信号生成回路は、第1および第2駆動信号の位相が重ならないようにタイミングを調整する信号調整回路を有する。
 好ましくは、信号生成回路は、パルス信号を反転させた反転パルス信号を出力する反転回路をさらに含み、信号調整回路は、パルス信号および反転パルス信号の少なくとも一方のデューティ比を調整する。
 特に、信号調整回路は、信号の位相を遅延させる遅延回路と、波形整形回路とを有する。
 特に、遅延回路は、抵抗素子と、容量素子とで構成される。
 特に、抵抗素子は、外部からの指示に従って抵抗値が変化する可変抵抗素子である。
 特に、容量素子は、外部からの指示に従って容量成分が変化する可変容量素子である。
 突入電流を簡易な方式で抑制することが可能である。
本発明の実施の形態に従う電子血圧計1の外観について説明する図である。 本発明の実施の形態に従う電子血圧計のハードウェア構成を表わすブロック図である。 本発明の実施の形態に従うポンプ駆動回路53の構成を説明する図である。 本発明の実施の形態に従う反転回路60および信号調整回路62の具体的構成について説明する図である。 本発明の実施の形態に従う反転回路60および信号調整回路62の入力および出力信号波形を説明する図である。 本発明の実施の形態に従う反転回路60および信号調整回路62の入力および出力信号波形を説明する別の図である。 Hブリッジ回路に駆動信号FINおよびRINが入力される場合の突入電流について説明する図である。 本発明の実施の形態の変形例に従うポンプ駆動回路53#の構成を説明する図である。 本発明の実施の形態の変形例に従う反転回路60および信号調整回路63の具体的構成について説明する図である。
 以下、この発明に基づいた実施の形態における電子血圧計について図面を参照して詳細に説明する。なお、以下に説明する実施の形態において、個数、量などに言及する場合、特に記載がある場合を除き、本発明の範囲は必ずしもその個数、量などに限定されない。また、以下に複数の実施の形態が存在する場合、特に記載がある場合を除き、各々の実施の形態の構成を適宜組み合わせることは、当初から予定されている。各図中、同一符号は同一または相当部分を指し、重複する説明は繰返さない場合がある。
 本実施の形態では、測定部位を上腕とし、オシロメトリック法で血圧を算出し、一例として圧力センサが1個搭載されている電子血圧計について説明する。なお、血圧算出のために適用される方法は、オシロメトリック法に限定されない。なお、圧力センサの個数は複数個としても良い。
 (電子血圧計1の外観)
 図1は、本発明の実施の形態に従う電子血圧計1の外観について説明する図である。
 図2は、本発明の実施の形態に従う電子血圧計のハードウェア構成を表わすブロック図である。
 図1および図2を参照して、電子血圧計1は、本体部10と、表面カバー11と、被測定者の上腕に巻付け可能なカフ20とを備える。カフ20は、空気袋21を含む。表面カバー11には、たとえば液晶などにより構成される表示部40と、ユーザ(被測定者)からの指示を受付けるための複数のスイッチからなる操作部41とが配置されている。
 本体部10は、上述の表示部40および操作部41に加え、各部を集中的に制御し各種の演算処理を行なうためのCPU(Central Processing Unit)100と、CPU100に所定の動作をさせるためのプログラムやデータを記憶するための処理用のメモリ42と、測定した血圧データなどを格納するためのデータ格納用のメモリ43と、本体部10の各部に電力を供給するための電池44と、現在時間を計時して計時データをCPU100に出力するタイマ45とを含む。
 操作部41は、電源をONまたはOFFするための指示の入力と測定開始および終了の指示を受付ける測定/停止スイッチ41Aと、タイマ45をセットするために操作されるタイマセットスイッチ41Bと、メモリ43に格納された血圧データなどの情報をメモリ43から読出し、表示部40に表示する指示を受付けるためのメモリスイッチ41Cと、タイマセットの際の数字とメモリ呼び出しの際のメモリ番号の上げ下げの指示を受付けるための矢印スイッチ41D,41Eとを有する。
 本体部10は、さらに、圧電ポンプ51および排気弁(以下、弁という)52を含むカフ圧の調整機構を有する。圧電ポンプ51、弁52および空気袋21内の圧力(カフ圧)を検出するための圧力センサ321からなるエア系は、カフ用エアチューブ31を介して、カフ20に内包される空気袋21と接続される。
 本体部10は、さらに、上述したエア系と、カフ圧の調整機構と、発振回路331とを含む。カフ圧の調整機構は、圧電ポンプ51および弁52のほか、ポンプ駆動回路53と弁駆動回路54とを有する。
 圧電ポンプ51は、カフ圧を加圧するために、空気袋21に空気を供給する。弁52は、空気袋21の空気を排出しまたは封入するために開閉される。
 ポンプ駆動回路53は、圧電ポンプ51の駆動をCPU100から与えられる制御信号(パルス信号)に基づいて制御する。弁駆動回路54は弁52の開閉制御をCPU100から与えられる制御信号に基づいて行なう。
 圧力センサ321には、一例として静電容量型の圧力センサを用いる。静電容量型の圧力センサは、検出するカフ圧に応じて容量値が変化する。発振回路331は圧力センサ321に接続されて、圧力センサの容量値に基づき発振する。本例においては、発振回路331は、CPU100からの指示に応答して動作し、CPU100は、発振回路331に対して活性化信号を出力する。なお、圧力センサは、静電容量型に限られず、他の方式を採用することも可能である。例えば、ピエゾ抵抗素子を用いたピエゾ抵抗型の圧力センサを採用するようにすることも可能である。
 CPU100からの活性化信号を受けた発振回路331は、圧力センサ321の容量値に応じた周波数を有する信号(以下、周波数信号という)を出力する。出力した周波数信号はCPU100に与えられる。
 CPU100は、発振回路331から入力される周波数信号を圧力に変換することによって、圧力を検知する。
 図3は、本発明の実施の形態に従うポンプ駆動回路53の構成を説明する図である。
 図3を参照して、ポンプ駆動回路53は、反転回路60と、信号調整回路62と、Hブリッジ回路64と、昇圧回路66とを含む。
 反転回路60は、CPU100から与えられる制御信号(パルス信号)の入力を受ける。当該制御信号(パルス信号)は、圧電ポンプ51の駆動を規定するためのタイミング信号である。そして、反転回路60は、当該制御信号(パルス信号)の入力に応答して2つの制御信号を出力する。具体的には、一方は、入力されたパルス信号と同位相の信号をそのまま出力し、他方は、パルス信号の位相を反転させた反転パルス信号として出力する。
 信号調整回路62は、反転回路60から入力されたパルス信号および反転パルス信号をそれぞれ受けて、Hブリッジ回路64を駆動する第1および第2駆動信号としてそれぞれ出力する。具体的には、信号調整回路62は、入力されたパルス信号および反転パルス信号の少なくとも一方のデューティ比を調整して出力する。
 Hブリッジ回路64は、圧電ポンプ51に所定の電流を供給するスイッチング回路であり、第1および第2駆動信号に従って所定の電流を圧電ポンプ51に供給する。第1の駆動信号に従って圧電ポンプ51に第1の方向(正方向)に電流を供給するように圧電ポンプ51の両端に電圧を印加する。また、第2の駆動信号に従って圧電ポンプ51に第1の方向と反対の第2の方向(負方向)に電流を供給するように圧電ポンプ51の両端に電圧を印加する。すなわち、第1および第2の駆動信号に従って圧電ポンプ51の両端にそれぞれ印加する電圧の接続関係を切り替える(論理を入れ替える)スイッチング制御を実行する。具体的には、圧電ポンプ51に印加する電圧の一方の側を高電圧として他方の側を低電圧とし、当該電圧の接続関係を第1および第2の駆動信号に従って切り替える。
 昇圧回路66は、CPU100からの指示に従ってHブリッジ回路64に供給する印加電圧のレベルを調整する。印加電圧のレベルを調整することにより圧電ポンプ51に流れる電流量を調整することが可能である。なお、圧電ポンプ51に流れる電流量が一定の場合には、CPU100からの電圧調整の指示は必要ではなく、固定的に所望の電圧に昇圧してHブリッジ回路64に供給すれば良い。なお、電圧を昇圧する必要がなければ特に昇圧回路66を設けない構成とすることも可能である。なお、Hブリッジ回路64および昇圧回路66の構成については、公知の技術であるのでその詳細な説明はしない。
 図4は、本発明の実施の形態に従う反転回路60および信号調整回路62の具体的構成について説明する図である。
 図4を参照して、反転回路60は、インバータIV0を含む。反転回路60に入力されたパルス信号は、分岐して一方は、そのまま信号調整回路62に出力され、他方は、インバータIV0を介する反転パルス信号として信号調整回路62に出力される。
 信号調整回路62は、インバータIV1,IV2と、NAND回路ND0,ND1と、抵抗素子R0,R1と、容量素子C0,C1とを含む。
 NAND回路ND0の一方の入力ノードは、パルス信号の入力を受け、他方の入力ノードは、ローパスフィルタを通過したパルス信号の入力を受ける。ローパスフィルタは、抵抗素子R0と、容量素子C0とで構成される。当該ローパスフィルタを通過したパルス信号は、抵抗素子R0および容量素子C0の抵抗および容量成分に従い信号の立ち上がりおよび立ち下りが鈍る。
 NAND回路ND0は、一方および他方の入力ノードがともに「H」レベルとなった場合に「L」レベルを出力し、インバータIV1を介して「H」レベルの信号が信号調整回路62から出力される。
 ここで、当該ローパスフィルタを通過した信号は「H」レベルへの立ち上がりおよび「L」レベルへの立ち下がりが鈍るためNAND回路ND0の内部信号において位相が遅延した状態となる。これによりNAND回路ND0の出力信号の立ち上がりおよび立ち下がりのタイミングが変化する。すなわち、NAND回路ND0の出力信号のデューティ比を調整することが可能となり、結果として信号調整回路62からの出力信号のデューティ比が調整される。
 同様に、NAND回路ND1の一方の入力ノードは、反転パルス信号の入力を受け、他方の入力ノードは、ローパスフィルタを通過した反転パルス信号の入力を受ける。ローパスフィルタは、抵抗素子R1と、容量素子C1とで構成される。当該ローパスフィルタを通過した反転パルス信号は、抵抗素子R1および容量素子C1の抵抗および容量成分に従い信号の立ち上がりおよび立ち下りが鈍る。
 NAND回路ND1は、一方および他方の入力ノードがともに「H」レベルとなった場合に「L」レベルを出力し、インバータIV2を介して「H」レベルの信号が信号調整回路62から出力される。
 ここで、当該ローパスフィルタを通過した信号は「H」レベルへの立ち上がりおよび「L」レベルへの立ち下がりが鈍るためNAND回路ND1の内部信号において位相が遅延した状態となる。これによりNAND回路ND1の出力信号の立ち上がりおよび立ち下がりのタイミングが変化する。すなわち、NAND回路ND1の出力信号のデューティ比を調整することが可能となり、結果として信号調整回路62からの出力信号のデューティ比が調整される。
 図5は、本発明の実施の形態に従う反転回路60および信号調整回路62の入力および出力信号波形を説明する図である。
 図5を参照して、CPU100からの一定周期の制御信号(パルス信号)が出力されている場合が示されている。具体的には、時刻t0で「H」レベル、時刻t2で「L」レベル、時刻t4で「H」レベル、時刻t6で「L」レベルに遷移する場合が示されている。
 そして、当該制御信号に従ってNAND回路ND0に入力される入力信号の波形が示されている。NAND回路ND0の内部において、本例においては、一例として、入力される信号波形の振幅が0~Vccであるものとし、最大振幅の30%以下を「L」レベル、70%以上を「H」レベルとして波形を整形する場合が示されている。
 ここで、NAND回路ND0の一方の入力ノードに対しては、遅延は生じないためパルス信号と同位相の信号が入力される。すなわち、NAND回路ND0の一方の入力ノードからの信号に従う内部信号A1の立ち上がりおよび立ち下がりは、遅延がないため制御信号と同位相の時刻t0で「H」レベル、時刻t2で「L」レベル、時刻t4で「H」レベル、時刻t6で「L」レベルに遷移する。
 一方、NAND回路ND0の他方の入力ノードに対しては、ローパスフィルタを介した信号が入力されるため波形の信号の立ち上がりおよび立ち下がりが鈍る信号が入力される。すなわち、NAND回路ND0の他方の入力ノードからの信号に従う内部信号B1の立ち上がりおよび立ち下がりは、遅延により制御信号から位相が遅れた時刻t1で「H」レベル、時刻t3で「L」レベル、時刻t5で「H」レベル、時刻t7で「L」レベルに遷移する。
 NAND回路ND0の出力信号は、内部信号A1およびB1の組み合わせに基づいて出力される。具体的には、内部信号A1およびB1のいずれか一方が「L」レベルである場合に「H」レベルの信号が出力され、ともに「H」レベルである場合に「L」レベルの信号が出力される。
 本例においては、インバータIV1に従う反転信号(Hブリッジ回路の入力信号(駆動信号FIN))として、時刻t1で「H」レベル、時刻t2で「L」レベル、時刻t5で「H」レベル、時刻t6で「L」レベルに遷移する。
 これにより、信号調整回路62から制御信号(パルス信号)のデューティ比が調整されたHブリッジ回路に入力される駆動信号FINが出力される。
 図6は、本発明の実施の形態に従う反転回路60および信号調整回路62の入力および出力信号波形を説明する別の図である。
 図6を参照して、CPU100からの一定周期の制御信号(パルス信号)が出力されている場合が示されている。
 具体的には、時刻t10で「H」レベル、時刻t12で「L」レベル、時刻t14で「H」レベル、時刻t16で「L」レベルに遷移する場合が示されている。
 また、インバータIV0で反転された反転パルス信号が示されている。
 具体的には、時刻t10で「L」レベル、時刻t12で「H」レベル、時刻t14で「L」レベル、時刻t16で「H」レベルに遷移する場合が示されている。
 そして、当該反転パルス信号に従ってNAND回路ND1に入力される入力信号の波形が示されている。NAND回路ND1の内部において、本例においては、一例として、入力される信号波形の振幅が0~Vccであるものとし、最大振幅の30%以下を「L」レベル、70%以上を「H」レベルとして波形を整形する場合が示されている。
 ここで、NAND回路ND1の一方の入力ノードに対しては、遅延は生じないため反転パルス信号と同位相の信号が入力される。すなわち、NAND回路ND1の一方の入力ノードからの信号に従う内部信号A2の立ち上がりおよび立ち下がりは、遅延がないため反転パルス信号と同位相の時刻t10で「L」レベル、時刻t12で「H」レベル、時刻t14で「L」レベル、時刻t16で「H」レベルに遷移する。 
 一方、NAND回路ND1の他方の入力ノードに対しては、ローパスフィルタを介した信号が入力されるため波形の信号の立ち上がりおよび立ち下がりが鈍る信号が入力される。すなわち、NAND回路ND0の他方の入力ノードからの信号に従う内部信号B2の立ち上がりおよび立ち下がりは、遅延により制御信号から位相が遅れた時刻t11で「L」レベル、時刻t13で「H」レベル、時刻t15で「L」レベル、時刻t17で「H」レベルに遷移する。
 NAND回路ND1の出力信号は、内部信号A2およびB2の組み合わせに基づいて出力される。具体的には、内部信号A2およびB2のいずれか一方が「L」レベルである場合に「H」レベルの信号が出力され、ともに「H」レベルである場合に「L」レベルの信号が出力される。
 本例においては、インバータIV2に従う反転信号(Hブリッジ回路の入力信号(駆動信号RIN))として、時刻t10で「L」レベル、時刻t13で「H」レベル、時刻t14で「L」レベル、時刻t17で「H」レベルに遷移する。
 これにより、信号調整回路62から制御信号(パルス信号)のデューティ比が調整されたHブリッジ回路に入力される駆動信号RINが出力される。
 図7は、Hブリッジ回路に駆動信号FINおよびRINが入力される場合の突入電流について説明する図である。
 図7(A)を参照して、ここでは、比較例として従来のHブリッジ回路に入力されていた駆動信号の波形が示されている。
 当該図に示されるように、駆動信号FINおよびRINは互いに相補的な論理関係を有しており、駆動信号FINの「H」レベルから「L」レベルの立ち下がりと、駆動信号RINの「L」レベルから「H」レベルの立ち上がりのタイミングがほぼ同時であった。これにより駆動信号FINの「H」レベルから「L」レベルの立下りに起因する突入電流と、駆動信号RINの「L」レベルから「H」レベルの立ち上がりに起因する突入電流とが流れるタイミングが同時になり、全体として突入電流が大きくなるという問題があった。当該突入電流により過大な電圧降下が生じるという問題があった。
 図7(B)を参照して、ここでは、本例におけるHブリッジ回路に入力される駆動信号の波形が示されている。
 当該図に示されるように、駆動信号FINおよびRINの立ち上がりおよび立ち下がりのタイミングが重ならないように、デューティ比を調整した場合が示されている。これにより、時刻t20における駆動信号FINの「H」レベルから「L」レベルの立ち下がりと、時刻t21における駆動信号RINの「L」レベルから「H」レベルの立ち上がりのタイミングとがずれるため、駆動信号FINの「H」レベルから「L」レベルの立下りに起因する突入電流と、駆動信号RINの「L」レベルから「H」レベルの立ち上がりに起因する突入電流とが流れるタイミングがずれることになり、全体として突入電流を抑制することが可能となる。これにより、突入電流の大きさを抑制して過大な電圧降下が生じることを抑制する。
 同様に、時刻t22における駆動信号RINの「H」レベルから「L」レベルの立ち下がりと、時刻t23における駆動信号FINの「L」レベルから「H」レベルの立ち上がりのタイミングとがずれるため、駆動信号RINの「H」レベルから「L」レベルの立下りに起因する突入電流と、駆動信号FINの「L」レベルから「H」レベルの立ち上がりに起因する突入電流とが流れるタイミングがずれることになり、全体として突入電流を抑制することが可能となる。
 これにより、電池電圧の降下を抑制して、血圧測定の精度を高めた状態を維持することができるとともに、血圧計の電池寿命を延ばすことが可能となる。
 本例においては、信号調整回路63において、CPU100から出力される制御信号(パルス信号)および反転パルス信号のデューティ比をそれぞれ調整して駆動信号FINおよびRINを出力する方式について説明したが、いずれか一方のデューティ比を調整する方式とすることも可能である。
 また、本例においては、NAND回路を用いて信号を整形する場合について説明したが、特にNAND回路に限られず、他の論理回路例えば、AND回路、NOR回路等を用いて信号を整形するようにしても良いし、あるいは、シュミットトリガを用いた構成とすることも可能である。
 図8は、本発明の実施の形態の変形例に従うポンプ駆動回路53#の構成を説明する図である。
 図8を参照して、図3のポンプ駆動回路53の構成と比較して、信号調整回路62を信号調整回路63に置換した点が異なる。その他の部分の構成については同様であるのでその詳細な説明は繰り返さない。
 図9は、本発明の実施の形態の変形例に従う反転回路60および信号調整回路63の具体的構成について説明する図である。
 図9を参照して、信号調整回路63は、信号調整回路62と比較して、抵抗素子R0,R1を抵抗素子R0#,R1#に置換した点が異なる。その他の部分の構成については同様であるのでその詳細な説明は繰り返さない。
 抵抗素子R0#,R1#は、可変抵抗素子であり、CPU100からの位相遅延制御信号に従ってその抵抗値が変化する。なお、本例においては、抵抗素子R0#,R1#のいずれも位相遅延制御信号に従って抵抗値が変化する構成が示されているが、一方のみを調整する場合であってもよく、それぞれ独立に調整可能であるものとする。可変抵抗または可変容量の選択は腕周、手首周、電池残量、ゆる巻き等により変化させる。
 当該抵抗値を調整することにより上述したローパスフィルタを通過した信号の「H」レベルへの立ち上がりおよび「L」レベルへの立ち下がりを調整することが可能となる。すなわち、信号調整回路63から出力される駆動信号FINDINのデューティ比の微調整が可能となり、圧電ポンプの特性に合わせた駆動信号をHブリッジ回路64に入力することが可能である。
 なお、本例においては、抵抗素子R0#,R1#を可変抵抗素子とする場合について説明したが、抵抗素子に限られず、容量素子C0,C1を可変容量素子として容量成分を変化させた構成としてローパスフィルタを通過した信号の「H」レベルへの立ち上がりおよび「L」レベルへの立ち下がりの微調整をすることも可能である。また、両者を組み合わせた構成とすることも当然に可能である。
 また、駆動信号FINDINについて、CPUからのパルス信号をずらして出力する方式も考えられるが、圧電ポンプの駆動周波数から1μ秒以下の時間を制御する必要があり、そのためには高クロックのCPUが必要となり、消費電力が大きく、電池寿命が短くなるが、本方式を採用することにより簡易な方式でパルス信号をずらすことが可能であるためコスト的にもまた、消費電力の面でも有利である。
 以上、本発明の実施の形態について説明したが、今回開示された実施の形態は全ての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は請求の範囲によって示され、請求の範囲と均等の意味および範囲内での全ての変更が含まれることが意図される。
 1 電子血圧計、10 本体部、11 表面カバー、20 カフ、21 空気袋、31 カフ用エアチューブ、40 表示部、41 操作部、41A 測定/停止スイッチ、41B タイマセットスイッチ、41C メモリスイッチ、41D,41E 矢印スイッチ、42,43 メモリ、44 電池、45 タイマ、51 圧電ポンプ、52 弁、53 ポンプ駆動回路、54 弁駆動回路、100 CPU(Central Processing Unit)、321 圧力センサ、331 発振回路、335 調整回路、1122 センサ異常検出部。 

Claims (6)

  1.  測定部位に装着するカフと、
     前記カフに加える圧力を調整する圧電ポンプと、
     前記圧電ポンプを駆動する駆動回路と、
     前記圧電ポンプの駆動タイミングを規定するパルス信号を前記駆動回路に出力するコントローラとを備え、
     前記駆動回路は、
     第1および第2駆動信号にそれぞれ応答して前記圧電ポンプの両端にそれぞれ印加する電圧の接続関係を切り替えるためのスイッチング回路と、
     前記コントローラから出力されたパルス信号に基づいて前記第1および第2駆動信号を出力する信号生成回路とを含み、
     前記信号生成回路は、前記第1および第2駆動信号の位相が重ならないようにタイミングを調整する信号調整回路を有する、電子血圧計。
  2.  前記信号生成回路は、前記パルス信号を反転させた反転パルス信号を出力する反転回路をさらに含み、
     前記信号調整回路は、前記パルス信号および前記反転パルス信号の少なくとも一方のデューティ比を調整する、請求項1記載の電子血圧計。
  3.  前記信号調整回路は、信号の位相を遅延させる遅延回路と、波形整形回路とを有する、請求項2記載の電子血圧計。
  4.  前記遅延回路は、抵抗素子と、容量素子とで構成される、請求項3記載の電子血圧計。
  5.  前記抵抗素子は、外部からの指示に従って抵抗値が変化する可変抵抗素子である、請求項4記載の電子血圧計。
  6.  前記容量素子は、外部からの指示に従って容量成分が変化する可変容量素子である、請求項4記載の電子血圧計。 
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