WO2013058291A1 - 半導体素子の接合方法および接合構造 - Google Patents

半導体素子の接合方法および接合構造 Download PDF

Info

Publication number
WO2013058291A1
WO2013058291A1 PCT/JP2012/076867 JP2012076867W WO2013058291A1 WO 2013058291 A1 WO2013058291 A1 WO 2013058291A1 JP 2012076867 W JP2012076867 W JP 2012076867W WO 2013058291 A1 WO2013058291 A1 WO 2013058291A1
Authority
WO
WIPO (PCT)
Prior art keywords
semiconductor element
bonding
solar cell
semiconductor
conductive nanoparticles
Prior art date
Application number
PCT/JP2012/076867
Other languages
English (en)
French (fr)
Inventor
英範 水野
紀久夫 牧田
Original Assignee
独立行政法人産業技術総合研究所
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 独立行政法人産業技術総合研究所 filed Critical 独立行政法人産業技術総合研究所
Priority to EP12841246.7A priority Critical patent/EP2770540A4/en
Priority to CN201280050852.0A priority patent/CN103890976B/zh
Priority to JP2013539671A priority patent/JP5875124B2/ja
Priority to US14/351,935 priority patent/US10608136B2/en
Publication of WO2013058291A1 publication Critical patent/WO2013058291A1/ja

Links

Images

Classifications

    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L31/00—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L31/18—Processes or apparatus specially adapted for the manufacture or treatment of these devices or of parts thereof
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/041—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L31/00
    • H01L25/043—Stacked arrangements of devices
    • C—CHEMISTRY; METALLURGY
    • C09—DYES; PAINTS; POLISHES; NATURAL RESINS; ADHESIVES; COMPOSITIONS NOT OTHERWISE PROVIDED FOR; APPLICATIONS OF MATERIALS NOT OTHERWISE PROVIDED FOR
    • C09J—ADHESIVES; NON-MECHANICAL ASPECTS OF ADHESIVE PROCESSES IN GENERAL; ADHESIVE PROCESSES NOT PROVIDED FOR ELSEWHERE; USE OF MATERIALS AS ADHESIVES
    • C09J5/00—Adhesive processes in general; Adhesive processes not provided for elsewhere, e.g. relating to primers
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L31/00—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L31/04—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof adapted as photovoltaic [PV] conversion devices
    • H01L31/042—PV modules or arrays of single PV cells
    • H01L31/043—Mechanically stacked PV cells
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L31/00—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L31/04—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof adapted as photovoltaic [PV] conversion devices
    • H01L31/06—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof adapted as photovoltaic [PV] conversion devices characterised by potential barriers
    • H01L31/075—Semiconductor devices sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof adapted as photovoltaic [PV] conversion devices characterised by potential barriers the potential barriers being only of the PIN type, e.g. amorphous silicon PIN solar cells
    • H01L31/076—Multiple junction or tandem solar cells
    • C—CHEMISTRY; METALLURGY
    • C09—DYES; PAINTS; POLISHES; NATURAL RESINS; ADHESIVES; COMPOSITIONS NOT OTHERWISE PROVIDED FOR; APPLICATIONS OF MATERIALS NOT OTHERWISE PROVIDED FOR
    • C09J—ADHESIVES; NON-MECHANICAL ASPECTS OF ADHESIVE PROCESSES IN GENERAL; ADHESIVE PROCESSES NOT PROVIDED FOR ELSEWHERE; USE OF MATERIALS AS ADHESIVES
    • C09J2203/00—Applications of adhesives in processes or use of adhesives in the form of films or foils
    • C09J2203/326—Applications of adhesives in processes or use of adhesives in the form of films or foils for bonding electronic components such as wafers, chips or semiconductors
    • C—CHEMISTRY; METALLURGY
    • C09—DYES; PAINTS; POLISHES; NATURAL RESINS; ADHESIVES; COMPOSITIONS NOT OTHERWISE PROVIDED FOR; APPLICATIONS OF MATERIALS NOT OTHERWISE PROVIDED FOR
    • C09J—ADHESIVES; NON-MECHANICAL ASPECTS OF ADHESIVE PROCESSES IN GENERAL; ADHESIVE PROCESSES NOT PROVIDED FOR ELSEWHERE; USE OF MATERIALS AS ADHESIVES
    • C09J2453/00—Presence of block copolymer
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/27—Manufacturing methods
    • H01L2224/273—Manufacturing methods by local deposition of the material of the layer connector
    • H01L2224/2731—Manufacturing methods by local deposition of the material of the layer connector in liquid form
    • H01L2224/2732—Screen printing, i.e. using a stencil
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
    • H01L2224/29109—Indium [In] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/29118—Zinc [Zn] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29117—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 400°C and less than 950°C
    • H01L2224/29124—Aluminium [Al] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/29139—Silver [Ag] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/29144—Gold [Au] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/29155—Nickel [Ni] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/29164—Palladium [Pd] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/29163—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than 1550°C
    • H01L2224/29166—Titanium [Ti] as principal constituent
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • H01L2224/29001—Core members of the layer connector
    • H01L2224/29099—Material
    • H01L2224/29193—Material with a principal constituent of the material being a solid not provided for in groups H01L2224/291 - H01L2224/29191, e.g. allotropes of carbon, fullerene, graphite, carbon-nanotubes, diamond
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321—Disposition
    • H01L2224/32135—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/32145—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/832—Applying energy for connecting
    • H01L2224/83201—Compression bonding
    • H01L2224/83203—Thermocompression bonding, e.g. diffusion bonding, pressure joining, thermocompression welding or solid-state welding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838—Bonding techniques
    • H01L2224/83801—Soldering or alloying
    • H01L2224/8382—Diffusion bonding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838—Bonding techniques
    • H01L2224/83894—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/838—Bonding techniques
    • H01L2224/83894—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces
    • H01L2224/83895—Direct bonding, i.e. joining surfaces by means of intermolecular attracting interactions at their interfaces, e.g. covalent bonds, van der Waals forces between electrically conductive surfaces, e.g. copper-copper direct bonding, surface activated bonding
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503—Stacked arrangements of devices
    • H01L2225/06513—Bump or bump-like direct electrical connections between devices, e.g. flip-chip connection, solder bumps
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/50—Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/102—Material of the semiconductor or solid state bodies
    • H01L2924/1025—Semiconducting materials
    • H01L2924/10251—Elemental semiconductors, i.e. Group IV
    • H01L2924/10252—Germanium [Ge]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/102—Material of the semiconductor or solid state bodies
    • H01L2924/1025—Semiconducting materials
    • H01L2924/10251—Elemental semiconductors, i.e. Group IV
    • H01L2924/10253—Silicon [Si]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/102—Material of the semiconductor or solid state bodies
    • H01L2924/1025—Semiconducting materials
    • H01L2924/1026—Compound semiconductors
    • H01L2924/1032—III-V
    • H01L2924/10328—Gallium antimonide [GaSb]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/102—Material of the semiconductor or solid state bodies
    • H01L2924/1025—Semiconducting materials
    • H01L2924/1026—Compound semiconductors
    • H01L2924/1032—III-V
    • H01L2924/10329—Gallium arsenide [GaAs]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10—Details of semiconductor or other solid state devices to be connected
    • H01L2924/102—Material of the semiconductor or solid state bodies
    • H01L2924/1025—Semiconducting materials
    • H01L2924/1026—Compound semiconductors
    • H01L2924/1032—III-V
    • H01L2924/10335—Indium phosphide [InP]
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151—Die mounting substrate
    • H01L2924/156—Material
    • H01L2924/15786—Material with a principal constituent of the material being a non metallic, non metalloid inorganic material
    • H01L2924/15788—Glasses, e.g. amorphous oxides, nitrides or fluorides
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02E—REDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
    • Y02E10/00—Energy generation through renewable energy sources
    • Y02E10/50—Photovoltaic [PV] energy
    • Y02E10/548—Amorphous silicon PV cells

Definitions

  • the present invention relates to a semiconductor element bonding method and a bonding structure.
  • High performance of the semiconductor device can be achieved by bonding individual semiconductor elements.
  • a solar cell that is a photoelectric conversion semiconductor element a solar cell having different band gaps is stacked to be multi-junction, thereby absorbing a wide sunlight spectrum and improving photoelectric conversion efficiency.
  • Such a multi-junction solar cell generally has a monolithic stack structure in which III-V group semiconductor cells (GaAs-based) are formed by batch growth on a GaAs substrate or Ge substrate.
  • GaAs-based III-V group semiconductor cells
  • the bottom cell is sensitive to a long wavelength band.
  • the performance exceeding 40% is obtained by applying Ge or InGaAs system.
  • these material combinations are lattice-mismatched systems, so that the growth technique is complicated and increases costs.
  • the smart stack structure that has recently attracted attention is a structure that allows multiple cells to be mechanically joined together, and can easily combine various cells. It is a key technology for next-generation solar cells from the viewpoint of high performance and low cost. is there.
  • the smart stack structure it is important to realize a junction structure that ensures transparency as well as conductivity at the junction interface of each solar cell. It is also important to realize optical characteristics that are advantageous for solar cell characteristics, equivalent to or more than ensuring transparency.
  • conductive nanoparticles covered with organic molecules having a diameter size of 100 nanometers or less are used, and between conductive nanoparticles using melting point reduction based on nano-sizing.
  • a method for joining semiconductor elements based on low-temperature sintering has been reported.
  • Patent Documents 1 and 2 non-contact of a particulate metal compound or metal nanowire is caused by thermal expansion of an organic polymer resin induced by heat generated from the element itself or a change in ambient temperature during operation of the device after bonding. May occur, leading to a decrease in conductivity or deactivation. Moreover, in order to maintain the light transmittance, it is necessary to reduce the concentration of the particulate metal compound or the metal nanowire, which adversely affects the conductivity.
  • the conductive nanoparticles having a diameter of 100 nanometers or less that are used are usually covered with a protective film made of organic molecules for the purpose of improving handleability.
  • a protective film made of organic molecules for the purpose of improving handleability.
  • the concentration of the conductive nanoparticles is lowered, and the conductive nanoparticles are uniformly present at the interface, thereby generating a large conductive nanoparticle sintered body.
  • the bonding itself can be difficult.
  • Non-Patent Document 1 Non-Patent Document 1
  • Non-Patent Document 2 Non-Patent Document 2
  • semiconductor elements can be conductively bonded to each other without using an adhesive such as an organic molecule or an adhesive material via metal (conductive) nanoparticles arranged on the surface. Has not been studied at all.
  • the present invention is a technique developed to compensate for the weaknesses of the existing techniques for bonding semiconductors as described above, and its purpose is to bond semiconductor elements while ensuring excellent conductivity and transparency at the interface. It is to provide a method and a joining structure by the joining method. Another object of the present invention is to provide a semiconductor element bonding method capable of ensuring excellent electrical conductivity at the interface and designing optical characteristics that favor the element characteristics, and a bonding structure by the bonding method. There is.
  • the present inventor has generally used organic molecules, etc., even when conductive nanoparticles not covered with organic molecules are arranged at the interface of the semiconductor element to be joined. It has been found that both semiconductor elements can be joined without using any adhesive or bonding material, and the semiconductor elements can be conductively connected.
  • the bonding method of the present invention is based on the above-mentioned knowledge based on the above-mentioned object.
  • a monolayer (single layer) of conductive nanoparticles not covered with organic molecules is arranged on the surface of a semiconductor element, The other semiconductor element is bonded to the substrate.
  • the present invention has the following characteristics.
  • a method for bonding semiconductor elements comprising arranging conductive nanoparticles not covered with organic molecules on the surface of one semiconductor element and pressing the other semiconductor element on the conductive nanoparticle.
  • the conductive nanoparticles are composed of Pd, Au, Ag, Pt, Ni, Al, In, In 2 O 3 , Zn, ZnO, or a composite thereof.
  • the semiconductor element is a single-junction solar cell using a crystalline Si, amorphous Si, microcrystalline Si, organic, or chalcopyrite material, or a GaAs, InP, GaSb, or Ge substrate.
  • (14) The semiconductor element laminate according to (13), wherein the semiconductor element having a photoelectric conversion function is a solar cell.
  • a semiconductor element bonding structure excellent in conductivity and transparency can be obtained.
  • a wide sunlight spectrum can be absorbed and the photoelectric conversion efficiency can be improved.
  • photoelectric conversion efficiency can be improved also by the optical confinement effect using the optical characteristic derived from a nanostructure.
  • the schematic diagram which shows the cross section of the junction structure of the semiconductor element in the embodiment using the joining method of this invention Illustration of hexagonal array shown by atomic force microscope image of block copolymer thin film used in Examples of the present invention Example of hexagonal array of metal nanostructures created by the shape pattern stamp used in the embodiment of the present invention Schematic diagram showing a cross section of a junction structure of a GaAs / CIGSe-based two-junction solar cell fabricated according to an embodiment of the present invention.
  • (a) is the IV characteristic of a GaAs / CIGSe two-junction solar cell fabricated according to an embodiment of the present invention
  • (b) is the IV characteristic of a GaAs / CIGSe two-junction solar cell not including palladium nanoparticles.
  • (a) is an IV characteristic of a GaAs / InP-based two-junction solar cell fabricated according to an embodiment of the present invention
  • (b) is an IV characteristic of a GaAs / InP-based two-junction solar cell not including gold nanoparticles.
  • Schematic diagram showing a cross section of the junction structure of an amorphous silicon / crystalline silicon-based two-junction solar cell fabricated according to an embodiment of the present invention Schematic diagram showing a cross section of a junction structure of a GaAs / InP-based two-junction solar cell fabricated according to an embodiment of the present invention.
  • FIG. 1 is a schematic view showing a cross section of a junction structure of a semiconductor element using the joining method of the present invention.
  • the junction structure 101 includes a bottom semiconductor element 102 and a top semiconductor element 103, and the junction structure 101 is joined in a state where conductive nanoparticles 104 exist.
  • the bottom semiconductor element 102 and the top semiconductor element 103 preferably have a semiconductor layer or a conductive layer on each bonding surface. In that case, the semiconductor layer on one bonding surface and / or the semiconductor layer on the other bonding surface And / or the conductive layer is conductively connected through the conductive nanoparticles 104.
  • the number of semiconductor elements bonded to each other is not limited to one pair, but it is desirable to set the number of the semiconductor elements in a range in which necessary translucency is ensured.
  • a light-transmitting element or a photoelectric conversion element is preferably used as the semiconductor element to be bonded.
  • the photoelectric conversion element is preferably one that converts light into electric energy like a solar cell, but conversely, one that converts electric energy into light may be used.
  • Solar cells include GaAs-based solar cells, CIS-based (chalcopyrite) solar cells, GaAs, InP, GaSb, or compound systems such as solar cells consisting of one or more junctions stacked on a Ge substrate.
  • Examples thereof include silicon solar cells such as solar cells, Si crystal solar cells, amorphous Si solar cells, and microcrystalline Si solar cells, organic solar cells, and dye-sensitized solar cells.
  • the conductive nanoparticles include metal nanoparticles such as Pd, Au, Ag, Pt, Ni, Al, Zn, and In, and metal oxide nanoparticles such as ZnO and In 2 O 3 .
  • the size of the conductive nanoparticles is preferably 10 nanometers or more, more preferably 20 nanometers or more, and even more preferably 30 nanometers or more.
  • the nanoparticles in order to suppress absorption and scattering of light by the nanoparticles, it is preferably 100 nanometers or less, more preferably 80 nanometers or less, further preferably 60 nanometers or less, but 200 nanometers or less (more If it is preferably 150 nanometers or less, more preferably 120 nanometers or less, light absorption / scattering can be suppressed more than that of 200 nanometers or more.
  • it in order to promote the light confinement effect by introducing nanoparticles, it is preferably 120 nanometers or more and 500 nanometers or less, more preferably 150 nanometers or more and 300 nanometers or less, and further preferably 180 nanometers or more and 250 nanometers or less. It is below nanometer.
  • the conductive nanoparticles are not covered with a protective film such as organic molecules, an adhesive or an adhesive material, and form a monolayer in which individual independent particles are uniformly arranged.
  • a protective film such as organic molecules, an adhesive or an adhesive material
  • it can be arranged in a (pseudo-positive) hexagonal array in which six particles form a hexagon around any one particle.
  • the arrangement interval of the conductive nanoparticles preferably has a distance of at least 2 times the size of the nanoparticles (more preferably 3 times or more) in order to transmit light well.
  • it is preferably 10 times or less (more preferably 7 times or less).
  • the arrangement interval is 80 nanometers or more and 400 nanometers or less.
  • the conductive nanoparticles are in ohmic contact with the upper and lower semiconductor elements and are uniformly arranged at the interface, excellent conductivity can be obtained.
  • excellent light transmittance can be obtained.
  • the arrangement interval is not less than 400 nanometers and not more than 2000 nanometers.
  • the conductive nanoparticles are in ohmic contact with the upper and lower semiconductor elements and are uniformly arranged at the interface, excellent conductivity can be obtained.
  • the optical properties of the nanoparticles and the nanoparticle arrangement also provide a light confinement effect that favors device properties.
  • the arrangement interval L of the conductive nanoparticles in the present invention is defined as follows.
  • the joining structure of the present invention can be formed as follows. First, a block copolymer thin film is formed on the surface of the bottom semiconductor element 102 to be bonded.
  • a block copolymer thin film is formed on the surface of the bottom semiconductor element 102 to be bonded.
  • a block copolymer consisting of polystyrene (hydrophobic moiety) and poly-2-vinylpyridine (hydrophilic moiety) dissolved in an organic solvent such as toluene or ortho-xylene is used to form thin films such as spin coating and dip coating. Apply by technique.
  • the surface of the bottom semiconductor element 102 obtained in this way has a poly-2-vinylpyridine block patterned like the white portion shown in FIG. 2 by phase separation of the block copolymer.
  • this semiconductor element is immersed in an aqueous solution in which a metal ion salt such as Na 2 PdCl 4 is dissolved.
  • a metal ion salt such as Na 2 PdCl 4
  • the resulting semiconductor element is subjected to block copolymer removal treatment and metal ion reduction treatment to produce an array of conductive nanoparticles that are not covered with organic molecules while retaining the pattern.
  • the top semiconductor element 101 is overlaid on the bottom semiconductor element 102 on which the conductive nanoparticles are arranged, and both are bonded under moderate pressure and heating.
  • This bonding does not use an organic or inorganic adhesive or bonding material, and may be based on van der Waals force alone, or a direct bonding method through surface activation or thermal solid phase diffusion. It may be by law.
  • a known surface activation treatment method such as plasma treatment, ozone treatment, treatment with an ion beam or the like can be used.
  • amphiphilic block copolymer used above is not particularly limited to those composed of polystyrene and poly-2-vinylpyridine, and known ones can be used.
  • poly-4-vinylpyridine polyethylene oxide, polypropylene oxide, polymethacrylic acid, polymethyl methacrylate, poly-N-isopropylacrylamide, polysiloxane, polyferrocenyldimethylsilane, polyvinylpyrrolidone, polyethylene, polybutadiene, polyisobutylene, polyvinyl
  • the metal ion salt is not particularly limited to Na 2 PdCl 4 , for example, H 2 PdCl 4 , H 2 PdCl 6 , Na 2 PdCl 6 , K 2 PdCl 4 , K 2 PdCl 6 , Na 2 PdBr 4 , K 2 PdBr 4 , K 2 Pd (CN) 4 , K 2 Pd (NO 3 ) 4 , (NH 4 ) 2 PdCl 4 , (NH 4 ) 2 PdCl 6 , Pd (OH) 2 , PdCl 2 , PdBr 2, PdI 2, Pd ( NO 3) 2, Pd (CN) 2, PdSO 4, Pd (OCOCH 3) 2, Pd (OCOCF 3) 2, Pd (C 5 H 7 O 2) 2, palladium etc.
  • ion salts HAuCl 4, NaAuCl 4, KAuCl 4, NH 4 AuCl 4, AuCN, KAuCN 2, AuCl, AuCl 3, AuBr, AuI 3, AuCl, AuI 3, Au (OCOCH 3) 3, a gold ion salts and the like, AgNO 3 , AgClO 4 , AgCN, AgSCN, KAg (CN) 2 , Ag 2 CO 3 , Ag 2 SO 4 , AgOCOCH 3 , and other silver ion salts, H 2 PtCl 6 , Na 2 PtCl 4 , Na 2 PtCl 6 , K 2 PtCl 4 , K 2 PtCl 6 , Na 2 PtBr 4 , K 2 PtBr 4 , K 2 Pt (CN) 4 , K 2 Pt (NO 3 ) 4 , (NH 4 ) 2 PtCl 4 , (NH 4 ) 2 PtCl 6, Pt (OH) 2 , P
  • the block copolymer removal treatment and metal ion reduction treatment described above are preferably carried out by one-stage treatment, but may be carried out by combining a plurality of stages of treatment.
  • Examples of such treatment include ultraviolet ray or electron beam irradiation, plasma treatment, chemical reduction method, or electrochemical reduction method.
  • plasma treatment and ultraviolet treatment are preferable.
  • the block copolymer thin film as a template is selectively etched by argon plasma and removed from the element surface, while metal ions are not etched by argon plasma, Reduced by the electrons present in
  • the gas for plasma treatment is not particularly limited to argon gas, and for example, a mixed gas in which argon and hydrogen are mixed at an arbitrary ratio can be used.
  • oxygen gas it is also possible to obtain conductive nanoparticles (ZnO, In 2 O 3, etc.) made of an oxide.
  • the junction structure of the present invention can also be formed as follows using a known microcontact printing method as a method for arranging conductive nanoparticles.
  • a stamp made of a polymer such as polydimethylsiloxane (PDMS) having minute convex portions formed in a predetermined distribution pattern on the stamp surface is prepared.
  • the stamp surface can be formed by a known method such as electron beam lithography after stamp molding, photolithography and etching, or can be formed by an uneven pattern on the mold surface during molding.
  • the top surfaces of the minute convex portions are formed in a size corresponding to the planar size of the conductive nanoparticles described above, and are formed in the same arrangement interval and distribution pattern as the conductive particles.
  • a conductive thin film such as Ag is deposited on the stamp surface having such a three-dimensional nanoscale structure by thermal evaporation, electron beam evaporation, sputtering, or the like.
  • the three-dimensional shape stamp with the conductive thin film thus obtained is pressed so that only the convex portion of the stamp is in contact with the surface of the semiconductor element surface-treated with the compound having a functional group terminal to which the conductive nanoparticles are selectively bonded.
  • the conductive thin film having only the contact portion can be transferred onto the semiconductor element by the interaction between the surface of the conductive thin film substance and the functional group terminal.
  • the compound having a functional group terminal is removed, and ultraviolet or electron beam irradiation, plasma treatment, or the like is performed so that the conductive thin film is directly bonded to the semiconductor element.
  • the top semiconductor element 101 is overlaid on the bottom semiconductor element 102 on which the conductive nanoparticles are arranged, and both are bonded under moderate pressure and heating.
  • This bonding does not use an organic or inorganic adhesive or bonding material, and may be based on van der Waals force alone, or a direct bonding method through surface activation or thermal solid phase diffusion. It may be by law.
  • a known surface activation treatment method such as plasma treatment, ozone treatment, treatment with an ion beam or the like can be used.
  • the conductive thin film is not particularly limited to Ag.
  • metals such as Au, Cu, Pt, Pd, and Al, or conductive oxides such as In 2 O 3 and ZnO can be used.
  • examples of the functional group to which the conductive nanoparticles of the above compound are bonded include an amino group and a thiol group.
  • the compound having a functional group terminal is preferably a compound that can form a self-assembled monolayer (SAM) (SAM-forming compound), but is not limited thereto.
  • SAM self-assembled monolayer
  • trialkoxysilanes having a terminal thiol group such as 3-mercaptopropyltrimethoxysilane-4-mercaptophenyltrimethoxysilane, and terminal amino groups such as 3-aminopropyltrimethoxysilane-4-aminophenyltrimethoxysilane
  • the trialkoxysilane which has is mentioned.
  • the microcontact printing method used for arranging the conductive nanoparticles is not limited to the above-described one, and any method that can be used for the semiconductor element bonding method of the present invention, Any thing is good.
  • a stamp surface SAM-forming compound formed in a predetermined distribution pattern may be transferred to the surface of a semiconductor element, and conductive nanoparticles may be deposited on the transferred SAM.
  • the planar shape and array pattern of the conductive nanoparticles depend on the uneven pattern on the stamp surface. Therefore, within the range of microfabrication performance when forming the stamp surface, the planar shape of the conductive nanoparticles, the arrangement pattern can be set arbitrarily, compared to the case of forming a block copolymer thin film as a template, The degree of freedom in designing the planar shape and arrangement pattern of the conductive nanoparticles is greatly improved. Therefore, it is possible to obtain a conductive nanoparticle planar shape and arrangement pattern that are desirable in terms of optical property design and the resulting light confinement effect.
  • Such desirable conductive nanoparticle planar shape is spherical, hemispherical, cylindrical, or ellipsoidal, and the arrangement pattern is hexagonal, regular hexagonal (or pseudo-regular hexagonal), tetragonal, Examples include a square shape (or pseudo-square shape) [In addition, “pseudo ... shape” in each shape means that the standard deviation of the side length in each shape is within 30% of the average side length (preferably within 20%) , More preferably within 10%). ].
  • FIG. 4 shows an example of a photoelectric conversion semiconductor element (solar cell) as one of the embodiments.
  • a case is shown in which two solar cells composed of a cell 301 having an Al 0.3 Ga 0.7 As light absorption layer as a top solar cell and a cell 302 having a CIGSe semiconductor layer as a bottom solar cell are joined.
  • the GaAs solar cell 301 includes a p-type GaAs buffer layer 303, a p-type Al 0.3 Ga 0.7 As light absorbing layer 304, an n-type GaAs emitter layer 305, an n-type GaAs contact layer 306, and an n-type electrode AuGeNi 307.
  • the n-type electrode has a comb shape to receive sunlight.
  • the CIGSe-based solar cell 302 includes a Mo electrode 309, a CIGSe semiconductor layer 310, a CdS emitter layer 311, and a ZnO transparent conductive layer 312 on a glass substrate 308.
  • the nanoparticles 313 are arranged on the surface of the CIGSe solar cell 302. In this example, Pd nanoparticles were used.
  • the Pd nanoparticles 313 were arranged on the CIGSe solar cell 302 by forming a thin film of polystyrene-poly-2-vinylpyridine as a block copolymer and using it as a template. That is, a 0.5 wt% ortho-xylene solution of polystyrene-poly-2-vinylpyridine (polystyrene molecular weight: 133000 g / mol, poly-2-vinylpyridine molecular weight: 132000 g / mol) having a total molecular weight of 265000 g / mol was applied to the surface of the CIGSe cell 302. A thin film was formed by spin coating.
  • the solar cell 302 was immersed in a 1 mM Na 2 PdCl 4 aqueous solution for 300 seconds. After washing with water, this cell was treated with argon plasma to arrange palladium nanoparticles 313 having an average size of 50 nanometers not covered with organic molecules. The average array spacing between palladium nanoparticles in this arrangement was 100 nanometers. After that, in this example, they were joined by pressure bonding. That is, water was dropped on the CIGSe cell 302, the GaAs cell 301 was set, and both elements were temporarily joined using surface tension. Thereafter, pressurization was performed for 30 minutes or more in a heated state at 150 ° C., and bonding was performed in a state where Pd nanoparticles 313 were present between the elements.
  • the solar cell is not particularly limited to GaAs-based and CIGSe-based solar cells.
  • a solar cell composed of one junction or two junctions or more laminated on an InP or GaSb substrate, or a Si crystal solar cell.
  • Examples include batteries, amorphous Si solar cells, microcrystalline Si solar cells, organic solar cells, sensitized solar cells, solar cells using chalcopyrite materials, and other solar cell combinations.
  • the bonding technique is not particularly limited to the pressure bonding, and can be applied to general direct bonding of elements by surface activation using, for example, plasma or ion beam.
  • the conductive nanoparticles are not particularly limited to Pd, and have conductivity such as metal nanoparticles such as Au, Ag, Pt, Ni, Al, Zn, In, or ZnO, In 2 O 3 Metal oxide nanoparticles and the like are possible.
  • the size of the conductive nanoparticles is not limited to 50 nanometers, and can be applied in the range of 10-200 nanometers.
  • the arrangement interval of the conductive nanoparticles is not limited to 100 nanometers, and may be any distance as long as the distance is 2 to 10 times the nanoparticle size.
  • FIG. 5 shows the IV characteristics of the solar cell.
  • (a) shows the characteristics of the solar cell manufactured according to the embodiment of the present invention
  • (b) shows the characteristics of the junction structure without interposing Pd nanoparticles.
  • an open-circuit voltage of 1.62 V and a fill factor of 0.53 are obtained, and characteristics that match the predicted characteristics (open-circuit voltage of 1.92 V) in a two-junction cell are obtained.
  • the IV characteristics are greatly degraded.
  • the open circuit voltage is 1.65V, but the fill factor has dropped to 0.23.
  • the junction resistance is estimated from each characteristic, it is 200 ⁇ cm 2 or more in the conventional structure and 10 ⁇ cm 2 in the structure of the present invention. That is, the difference in junction resistance leads to the improvement of IV characteristics.
  • FIG. 6 shows an example of a photoelectric conversion semiconductor element (solar cell) as one of the embodiments.
  • a case is shown in which two solar cells composed of a cell 501 having a GaAs light absorption layer as a top solar cell and a cell 502 having an InP semiconductor layer as a bottom solar cell are joined.
  • a GaAs solar cell 501 includes a p-type GaAs buffer layer 503, a p-type GaAs light absorption layer 504, an n-type GaAs emitter layer 505, an n-type Ga 0.51 In 0.49 P / p-type Ga 0.51 In 0.49 P (506/507) tunnel.
  • the n-type electrode has a comb shape to receive sunlight.
  • An InP-based solar cell 502 includes a p-type InP buffer layer 513, a p-type In 0.91 Ga 0.09 As 0.2 P 0.8 light absorption layer 514 (band gap energy 1.2 eV), an n-type In 0.91 Ga 0.09 As 0.2 on an InP substrate 512.
  • a P 0.8 emitter layer 515 and an n-type InP layer 516 are formed.
  • a nanoparticle array 517 is formed on the surface of the InP solar cell 502.
  • Au nanoparticles were used.
  • the InGaAsP composition is a design factor, and the composition can be freely adjusted according to the target characteristics.
  • the Au nanoparticles 517 were arranged on the InP solar cell 502 by making a polystyrene-poly-2-vinylpyridine film as a block copolymer and using it as a template. That is, a 0.3 wt% toluene solution of polystyrene-poly-2-vinylpyridine (polystyrene molecular weight: 125000 g / mol, poly-2-vinylpyridine molecular weight: 58500 g / mol) having a total molecular weight of 183500 g / mol was applied to the surface of InP solar cell 502. A thin film was formed by spin coating.
  • the solar cell 502 was immersed in a 1 mM KAuCl 4 aqueous solution for 600 seconds. After washing with water, this cell was treated with argon plasma to align and arrange Au nanoparticles 517 having an average size of 10 nanometers not covered with organic molecules. The average spacing between Au nanoparticles in this arrangement was 30 nanometers. After that, in this example, they were joined by pressure bonding. That is, water was dropped into the InP-based cell 502, the GaAs-based cell 501 was set, and both elements were temporarily joined using surface tension. Thereafter, pressurization was performed for 30 minutes or more in a heated state at 150 ° C., and bonding was performed in a state where Au nanoparticles 517 were present between the elements.
  • FIG. 7 shows the IV characteristics of the solar cell.
  • (a) shows the characteristics of the solar cell manufactured according to the present example
  • (b) shows the characteristics of the junction structure in which no Au nanoparticles are interposed.
  • an open circuit voltage of 2.90 V and a fill factor of 0.69 are obtained, and characteristics that match the predicted characteristics (open circuit voltage of 2.97 V) in a three-junction cell are obtained.
  • the IV characteristics are greatly degraded. In other words, the open circuit voltage is 2.56V, but the fill factor is reduced to 0.45.
  • the present invention structure When estimating the junction resistance than each characteristic, in the conventional structure is a 200Omucm 2 or more, in the present invention structure is 20 .OMEGA.cm 2 or less. That is, the difference in junction resistance leads to the improvement of IV characteristics.
  • the structure having the InGaAsP light absorption layer 514 on the InP substrate 512 is used as the bottom cell.
  • the present invention can also be applied to a structure in which an InGaAsP light absorption layer or an InGaAs strained light absorption layer is similarly formed on the Ge substrate. .
  • FIG. 8 shows an example of a photoelectric conversion semiconductor element (solar cell) as one of the embodiments.
  • a photoelectric conversion semiconductor element solar cell
  • FIG. 8 shows an example of a photoelectric conversion semiconductor element (solar cell) as one of the embodiments.
  • Amorphous Si solar cell 701 includes ZnO transparent conductive layer 703, n-type amorphous Si layer 704, i-type amorphous Si light absorption layer 705, p-type amorphous Si layer 706, fluorine-doped SnO 2 transparent conductive layer 707, and glass substrate 708.
  • a photoelectric conversion semiconductor element solar cell
  • the crystalline silicon solar cell 702 includes an n-type crystalline Si layer 710, a p-type crystalline Si layer 711, and an ITO transparent conductive layer 712 on an Al electrode 709.
  • a nanoparticle array 713 is formed on the surface of the crystalline Si solar cell 702. In this example, Pt nanoparticles were used.
  • Pt nanoparticles 713 were arranged on a crystalline silicon cell by forming a thin film of polystyrene-poly-4-vinylpyridine as a block copolymer and using it as a template. That is, a 0.6 wt% toluene solution of polystyrene-poly-4-vinylpyridine (polystyrene molecular weight: 20000 g / mol, poly-4-vinylpyridine molecular weight: 19000 g / mol) having a total molecular weight of 39000 g / mol was applied to the surface of the crystalline Si solar cell 702. A thin film was formed by spin coating.
  • the solar cell 702 was immersed in a 1 mM Na 2 PtCl 4 aqueous solution for 1800 seconds. After washing with water, this cell was treated with argon plasma to align and arrange Pt nanoparticles 712 having an average size of 20 nanometers that were not covered with organic molecules. The average spacing between Pt nanoparticles in this arrangement was 40 nanometers. After that, in this example, they were joined by pressure bonding. That is, water was dropped onto the crystalline silicon cell 702, the amorphous silicon cell 701 was set, and both elements were temporarily bonded using surface tension. Thereafter, pressure was applied for 30 minutes or more in a heated state at 150 ° C., and bonding was performed in a state where Pt nanoparticles 712 were present between the elements.
  • the solar cell operation according to this example will be described.
  • the former obtained an open-circuit voltage of 1.45 V and a fill factor of 0.63.
  • a characteristic that matches the predicted characteristic (open circuit voltage 1.5V) was obtained.
  • the open circuit voltage was 1.40V, but the fill factor decreased to 0.25.
  • the junction resistance is estimated from each characteristic, it is 100 ⁇ cm 2 or more in the conventional structure, and 10 ⁇ cm 2 or less in the example structure of the present invention. That is, the difference in junction resistance leads to the improvement of IV characteristics.
  • Example 1-3 in the structure of the present invention, by arranging the monolayers of conductive nanoparticles at various solar cell bonding interfaces and bonding them in that state, the light transmittance at the interfaces can be improved. By significantly improving the junction resistance without loss, good solar cell characteristics can be obtained.
  • the application of the present invention is not limited to solar cells, and can be widely applied to bonding of semiconductor elements that require electrical conductivity and light transmittance.
  • FIG. 9 shows an example of a photoelectric conversion semiconductor element (solar cell) as one of the embodiments.
  • a case is shown in which two solar cells composed of a cell 901 having a GaAs-based light absorption layer as a top solar cell and a cell 902 having an InP-based semiconductor layer as a bottom solar cell are joined.
  • a GaAs solar cell 901 includes a p-type GaAs buffer layer 903, a p-type GaAs light absorption layer 904, an n-type GaAs emitter layer 905, an n-type InGaP emitter layer 906, an n-type GaAs contact layer 907, and an n-type electrode AuGeNi 908. Become.
  • the n-type electrode has a comb shape to receive sunlight.
  • An InP-based solar cell 902 includes a p-type InP buffer layer 910, a p-type In 0.83 Ga 0.17 As 0.37 P 0.63 light absorbing layer 911 (band gap energy 1.15 eV), an n-type In 0.83 Ga 0.17 As 0.37 on an InP substrate 909. It consists of a P 0.63 emitter layer 912 and an n-type InP layer 913.
  • a nanoparticle array 914 is formed on the surface of the InP solar cell 902. In this example, Ag nanoparticles were used.
  • the InGaAsP composition is a design factor, and the composition can be freely adjusted according to the target characteristics.
  • the Ag nanoparticles 914 were arranged on the InP cell by a transfer method using a stamp made of polydimethylsiloxane (PDMS) on which minute protrusions were formed. That is, an Ag thin film having a thickness of 50 nanometers was formed by electron beam evaporation on a PDMS stamp in which a cylindrical structure having a diameter of 230 nanometers and a height of 200 nanometers was arranged in a hexagonal shape with a center distance of 460 nanometers.
  • PDMS polydimethylsiloxane
  • this Ag thin film stamp was transferred to an InP solar cell 902 having a 3-mercaptopropyltrimethoxysilane SAM film on the surface for 5 minutes at room temperature to transfer the Ag nanoparticle structure by contacting only the convex part, and then the cell As shown in FIG. 3, Ag nanoparticles (cylindrical shape) 914 having a diameter of 230 nanometers and a height of 50 nanometers, which are not covered with organic molecules, were aligned. The center-to-center distance of Ag nanoparticles in this arrangement was 460 nanometers. Thereafter, in this example, the GaAs cell 901 and the InP cell 902 were joined by pressure bonding.
  • the conductive nanoparticle monolayers are arranged at the solar cell bonding interface and bonded in that state, thereby realizing conductive connection between different solar cells.
  • the application of the present invention is not limited to solar cells, and can be widely applied to the joining of semiconductor elements that require electrical conductivity and optical property design at the interface.
  • the present invention relates to a bonding method and a bonding structure of semiconductor elements, and these can be used for multi-junction of semiconductor elements that require conductivity and transparency, or optical characteristic design at a bonding interface.

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Electromagnetism (AREA)
  • Manufacturing & Machinery (AREA)
  • Chemical & Material Sciences (AREA)
  • Organic Chemistry (AREA)
  • Life Sciences & Earth Sciences (AREA)
  • Sustainable Development (AREA)
  • Sustainable Energy (AREA)
  • Photovoltaic Devices (AREA)
  • Powder Metallurgy (AREA)

Abstract

【課題】界面において優れた導電性ならびに透明性を確保しながら半導体素子を接合する方法、およびその接合方法による接合構造を提供する。界面において優れた導電性を確保し、かつ素子特性に有利に働く光学特性の設計が可能な半導体素子の接合方法、およびその接合方法による接合構造を提供する。 【解決手段】有機分子で覆われていない導電性ナノ粒子を半導体素子の表面に光学的損失なく配置し、その上に他方の半導体素子を圧着させる。

Description

半導体素子の接合方法および接合構造
　本発明は、半導体素子の接合方法および接合構造に関する。
　個々の半導体素子を接合させることにより、半導体装置の高性能化を図ることができる。代表的には、光電変換半導体素子である太陽電池において、異なるバンドギャップを有する太陽電池を積層させ多接合化することにより、幅広い太陽光スペクトルを吸収させ光電変換効率を向上させることができる。
　このような多接合太陽電池は、一般にGaAs基板あるいはGe基板上にIII-Ｖ族半導体セル（GaAs系）を一括成長で形成するモノリシックスタック構造であり、この場合ボトムセルとしては長波長帯に感度を有するGeあるいはInGaAs系を適用して発電効率40%を超える性能が得られている。しかしながら、これらの材料組み合わせは格子不整合系であるために、成長技術が煩雑でありかつコスト増大の要因となる。
　一方、最近注目されているスマートスタック構造は、複数セルをメカニカルに自在接合する構造で、各種セルを容易に組み合わせることができ、高性能・低コスト化の観点より次世代太陽電池のキーテクノロジーである。スマートスタック構造においては、各太陽電池の接合界面において、導電性のみならず透明性も確保した接合構造を実現することが重要となる。また、透明性の確保と同等又はそれ以上に、太陽電池特性に有利に働く光学特性を実現することも重要となる。
　従来、太陽電池を含めた半導体素子の接合方法としては、例えば特許文献１、２に記載されているように、導電性接着剤、つまりミクロンサイズの粒子状金属化合物や金属ナノワイヤを含んだ有機高分子樹脂により接合させる手法が知られている。
　また、例えば特許文献３に記載されているように、直径サイズが100ナノメートル以下の有機分子で覆われた導電性ナノ粒子を用い、ナノサイズ化に基づく融点低下を利用した導電性ナノ粒子間の低温焼結に基づく半導体素子の接合方法が報告されている。
　しかしながら、上記の手法では以下の理由で半導体素子界面において導電性と透明性を確保した接合構造を実現することが困難である。また、太陽電池特性に有利に働く光学特性を実現することも困難である。
　まず、特許文献１、２においては、接合後の装置動作時に素子自体から発生する熱や外気温変化などで誘起される有機高分子樹脂の熱膨張により、粒子状金属化合物や金属ナノワイヤの非接触が起こり導電性の低下または失活を招く可能性がある。また、光の透過性を維持するためには、粒子状金属化合物や金属ナノワイヤの濃度を低くする必要があり、これは導電性に対しては不利に働く。
　次に、特許文献３においては、用いられている直径100ナノメートル以下の導電性ナノ粒子は、通常は取り扱い性を向上させる目的で有機分子からなる保護膜で覆われている。しかし、接合後良好な導電性を得るためには、焼結後にこれらの有機分子を残存させない工夫が必要である。
　また、上述のように、界面において透明性乃至光の透過性を維持するためには、導電性ナノ粒子濃度を低くし、界面に均一に存在させ、大きな導電性ナノ粒子焼結体の生成を防ぐ必要もある。しかしながら、粒子濃度の低下は、焼結頻度の低下につながるため、接合自体が困難となりうる。
　一方、上述のような太陽電池等の半導体素子同士を接合する技術ではないが、両親媒性ブロック共重合体をテンプレートとして用い、基板表面に金属ナノ粒子を二次元的に配列し、量子サイズ効果を期待する素子等への応用が検討されてきている（特許文献４、５参照）。しかしながら、表面に配列された金属（導電性）ナノ粒子を介して、有機分子等の接着剤や接着用材料を用いることなく半導体素子同士を導電的に接合することについては全く検討されてこなかった。
　また、上述のような太陽電池等の半導体素子同士を接合する技術ではないが、任意の3次元形状パターンを有するスタンプを用い、蒸着法等で堆積させた金属等の薄膜を他基板表面に転写することによりナノ構造を作成し（非特許文献１）、センサー素子等への応用が検討されてきている（非特許文献２）。しかしながら、このスタンプを用いる技術に関しても、表面に配列された金属（導電性）ナノ粒子を介して、有機分子等の接着剤や接着用材料を用いることなく半導体素子同士を導電的に接合することについては全く検討されてこなかった。
特開2003-309352号公報 特開2011-138711号公報 特開2004-107728号公報 特開2006-88310号公報 WO2007/122998号
Loo et al., Journal of the American Chemical Society, 124 (2002), 7654. Hatab et al., ACS Nano, 2 (2008), 377.
　本発明は、上述のような半導体同士を接合する既存手法の弱点を補うために開発された手法であり、その目的は、界面において優れた導電性ならびに透明性を確保しながら半導体素子を接合する方法、およびその接合方法による接合構造を提供することにある。
　また、本発明の別の目的は、界面において優れた導電性を確保し、かつ素子特性に有利に働く光学特性の設計が可能な半導体素子の接合方法、およびその接合方法による接合構造を提供することにある。
　前記目的を達成するための各種試験研究の過程において、本発明者は、有機分子で覆われていない導電性ナノ粒子を接合される半導体素子界面に配列した場合でも、通常使用される有機分子等の接着剤乃至接着用材料を用いることなく両半導体素子を接合でき、しかも、半導体素子間を導電的に接続できることを知見した。本発明の接合方法は、上記目的を前提とした前記知見に基づくものであり、有機分子で覆われていない導電性ナノ粒子のモノレイヤー（単一層）を半導体素子の表面に配列し、その上に他方の半導体素子を圧着させることを特徴とする。
　すなわち、本発明は、次のような特徴を有するものである。
（１）有機分子で覆われていない導電性ナノ粒子を一方の半導体素子表面に配列し、その上に他方の半導体素子を圧着させることを特徴とする半導体素子の接合方法。
（２）前記半導体素子表面への導電性ナノ粒子の配列が、ブロック共重合体薄膜をテンプレートとして形成されることを特徴とする上記(１)に記載の半導体素子の接合方法。
（３）前記半導体素子表面への導電性ナノ粒子の配列が、形状パターンが施されたスタンプを用いる転写手法で形成されることを特徴とする上記(１)に記載の半導体素子の接合方法。
（４）前記導電性ナノ粒子のサイズが、100ナノメートル以上500ナノメートル以下であることを特徴とする上記(１)～(３)のいずれか１項に記載の半導体素子の接合方法。
（５）前記導電性ナノ粒子のサイズが、10ナノメートル以上200ナノメートル以下であることを特徴とする上記(１)又は(２)に記載の半導体素子の接合方法。
（６）前記導電性ナノ粒子の配列間隔が、導電性ナノ粒子サイズの2倍以上10倍以下の距離であることを特徴とする上記(１)～(５)のいずれか１項に記載の半導体素子の接合方法。
（７）前記導電性ナノ粒子が、Pd、Au、Ag、Pt、Ni、Al、In、In2O3、Zn、ZnO、もしくはこれらの複合体からなることを特徴とする上記(１)～(６)のいずれか１項に記載の半導体素子の接合方法。
（８）前記半導体素子が、結晶Si系、アモルファスSi系、微結晶Si系、有機系、もしくは、カルコパイライト系材料を用いた単接合太陽電池、またはGaAs、InP、GaSb、もしくは、Ge基板上等に積層された２接合以上からなる太陽電池であることを特徴とする上記(１)～(７)のいずれか１項に記載の半導体素子の接合方法。
（９）一対の半導体素子の接合構造であって、両方の半導体素子の接合面に有機分子で覆われていない導電性ナノ粒子が介在している半導体素子の接合構造。
（１０）両方の半導体素子の接合面に介在する導電性ナノ粒子は、モノレイヤー（単一層）であることを特徴とする上記(９)に記載の半導体素子の接合構造。
（１１）一対の半導体素子は、接合面に半導体層又は導電層を有するものである上記(９)又は(１０)に記載の半導体素子の接合構造。
（１２）上記(９)～(１１)のいずれか1項に記載の接合構造を隣接する半導体素子間に備える半導体素子積層体であって、半導体素子積層体の積層方向の一方の端面から、接合面のうち少なくとも最も遠くに位置する接合面までは透光性を具備する半導体素子積層体。
（１３）半導体素子が光電変換機能を有するものである上記(１２)に記載の半導体素子積層体。
（１４）光電変換機能を有する半導体素子が太陽電池である上記(１３)に記載の半導体素子積層体。
　本発明の接合方法によれば、導電性ならびに透明性に優れた半導体素子接合構造を得ることができる。特に、異なるバンドギャップを有する複数の太陽電池の積層、多接合化に適用した場合、幅広い太陽光スペクトルを吸収でき、光電変換効率を向上させることができる。さらに、ナノ構造に由来する光学特性を利用し、その光閉じ込め効果によっても光電変換効率を向上させることができる。
本発明の接合方法を利用した実施態様における半導体素子の接合構造の断面を示す模式図 本発明の実施例で用いられたブロック共重合体薄膜の原子間力顕微鏡像が示す６角形状配列の例示図 本発明の実施例で用いられた形状パターンスタンプにより作成された金属ナノ構造の６角形状配列の例示図 本発明の実施例に従い製作されたGaAs/CIGSe系２接合太陽電池の接合構造の断面を示す模式図 (a)は本発明の実施例に従い製作されたGaAs/CIGSe系２接合太陽電池のIV特性、(b)はパラジウムナノ粒子が介在していないGaAs/CIGSe系２接合太陽電池のIV特性 本発明の実施例に従い製作されたGaAs/InP系２接合太陽電池の接合構造の断面を示す模式図 (a)は本発明の実施例に従い製作されたGaAs/InP系２接合太陽電池のIV特性、(b)は金ナノ粒子が介在していないGaAs/InP系２接合太陽電池のIV特性 本発明の実施例に従い製作されたアモルファスシリコン/結晶シリコン系２接合太陽電池の接合構造の断面を示す模式図 本発明の実施例に従い製作されたGaAs/InP系２接合太陽電池の接合構造の断面を示す模式図 本発明の実施例に従い製作されたGaAs/InP系２接合太陽電池のIV特性
　以下、本発明の詳細について図面を用いて説明する。
　図１は、本発明の接合方法を利用した半導体素子の接合構造の断面を示す模式図である。図１において、接合構造101はボトム半導体素子102とトップ半導体素子103からなり、これらの間は導電性ナノ粒子104が存在した状態で接合している。
　ボトム半導体素子102とトップ半導体素子103は、それぞれの接合面に半導体層又は導電層を有するものが好ましく、その場合、一方の接合面の半導体層及び／又は導電層と他方の接合面の半導体層及び／又は導電層が導電性ナノ粒子104を介して導電接続される。
　相互に接合される半導体素子の数は１対に限られないが、半導体素子積層体において、必要な透光性が確保される範囲の数に設定することが望ましい。接合される半導体素子としては、好ましくは透光性を有する素子や光電変換素子が挙げられる。光電変換素子としては、太陽電池のように光を電気エネルギーに変換するものであることが好ましいが、逆に、電気エネルギーを光に変換するものであっても良い。
　太陽電池としては、GaAs系太陽電池、CIS系（カルコパイライト系）太陽電池、GaAs、InP、GaSb、もしくは、Ge基板上等に積層された１接合や２接合以上からなる太陽電池等の化合物系太陽電池、Si結晶太陽電池、アモルファスSi太陽電池、微結晶Si太陽電池等のシリコン系太陽電池、有機系太陽電池、色素増感型太陽電池などが挙げられる。
　導電性ナノ粒子としては、Pd、Au、Ag、Pt、Ni、Al、Zn、In等の金属ナノ粒子、ZnO、In2O3等の金属酸化物ナノ粒子などが挙げられる。導電性ナノ粒子のサイズは、良好な導電性を得るために10ナノメートル以上であることが好ましく、より好ましくは20ナノメートル以上、さらに好ましくは30ナノメートル以上である。一方、ナノ粒子による光の吸収・散乱を抑制するために100ナノメートル以下であることが好ましく、より好ましくは80ナノメートル以下、さらに好ましくは60ナノメートル以下であるが、200ナノメートル以下（より好ましくは150ナノメートル以下、さらに好ましくは120ナノメートル以下）であれば、200ナノメートル超のものよりも光の吸収・散乱を抑制し得る。他方、ナノ粒子導入による光閉じ込め効果を促進するためには、120ナノメートル以上500ナノメートル以下であることが好ましく、より好ましくは150ナノメートル以上300ナノメートル以下、さらに好ましくは180ナノメートル以上250ナノメートル以下である。なお、本発明における「導電性ナノ粒子のサイズＤ」（以下では、このサイズＤを「平均サイズ」という場合がある。）は、次のように定義される。

　　Ｄ＝（ΣＤi）／ｎ

　［ここで、Ｄは導電性ナノ粒子のサイズ、Ｄiは所定の観察領域に存在する任意の粒子の粒子径〔＝（長径＋短径）／２〕、ｎは該観察領域に存在する粒子の個数（ｎは統計処理上十分に大きな数、通常２０以上）］
　導電性ナノ粒子は、有機分子等の保護膜や接着剤乃至接着用材料で覆われておらず、かつ個々の独立した粒子が均一に配列したモノレイヤーを形成している。例えば、図２、３に示されるように、任意の１つの粒子の周囲に６個の粒子が６角形をなすような（擬正）６角形状配列などに配列させることができる。導電性ナノ粒子の配列間隔は、光をよく透過させるためにナノ粒子のサイズの少なくとも２倍以上の距離を有していることが好ましい（より好ましくは３倍以上）。一方、必要な導電性を確保するためには、１０倍以下であることが好ましい(より好ましくは７倍以下)。例えば、導電性ナノ粒子のサイズが40ナノメートルであれば、配列間隔は80ナノメートル以上400ナノメートル以下となる。このとき、導電性ナノ粒子は上下の半導体素子とオーミック接合をなしており、かつ界面に均一に配列されているため、優れた導電性が得られる。また粒子間の凝集は抑制されているため、優れた光透過性も得られる。他方、例えば、導電性ナノ粒子のサイズが200ナノメートルであれば、配列間隔は400ナノメートル以上2000ナノメートル以下となる。このとき、導電性ナノ粒子は上下の半導体素子とオーミック接合をなしており、かつ界面に均一に配列されているため、優れた導電性が得られる。またナノ粒子とナノ粒子配列の光学特性により、素子特性に有利に働く光閉じ込め効果も得られる。なお、本発明における「導電性ナノ粒子の配列間隔Ｌ」は、次のように定義される。
Figure JPOXMLDOC01-appb-M000001
　　本発明の接合構造は、次のようにして形成することができる。まず、接合されるボトム半導体素子102の表面にブロック共重合体の薄膜を形成する。つまり、トルエンやオルトキシレンなどの有機溶媒に溶解させた疎水性部分であるポリスチレンと親水性部分であるポリ-2-ビニルピリジンからなるブロック共重合体をスピンコート法やディップコーティング法などの薄膜形成手法により塗布する。こうして得られたボトム半導体素子102表面は、ブロック共重合体の相分離によりポリ-2-ビニルピリジンブロックが図２に示した白色部分のようにパターンされている。次に、この半導体素子をNa2PdCl4などの金属イオン塩を溶解させた水溶液に浸す。こうして金属イオン（ここではPd2+）を先述のポリ-2-ビニルピリジンブロックからなるパターン中にピリジンとの化学的相互作用を介して取り込ませることができる。充分な水洗後、得られた半導体素子について、ブロック共重合体の除去処理と金属イオンの還元処理を行うことにより、パターンを保持したまま有機分子で覆われていない導電性ナノ粒子の配列が生成する。この後、トップ半導体素子101を導電性ナノ粒子が配置されたボトム半導体素子102上に重ね、適度な加圧・加温下で両者の接合を行う。この接合は、有機系や無機系の接着剤乃至接着用材料を用いないものであり、ファンデルワールス力のみによるものであっても良いし、表面活性化を経た直接接合法や熱固相拡散法によるものであっても良い。表面活性化には、プラズマ処理、オゾン処理、イオンビーム等による処理など、公知の表面活性化処理法を用いることができる。
　　なお、上記で用いた両親媒性ブロック共重合体に関しては、ポリスチレンとポリ-2-ビニルピリジンからなるものに特に制限されることなく、公知のものを使用することができる。例えばポリ-4-ビニルピリジン、ポリエチレンオキシド、ポリプロピレンオキシド、ポリメタクリル酸、ポリメタクリル酸メチル、ポリ-N-イソプロピルアクリルアミド、ポリシロキサン、ポリフェロセニルジメチルシラン、ポリビニルピロリドン、ポリエチレン、ポリブタジエン、ポリイソブチレン、ポリビニルナフタレン、ポリラクトン、ポリラクチド、等の2種類以上の組み合わせからなるブロック共重合体が挙げられる。
　　また、前記の金属イオン塩に関しては、Na2PdCl4に特に制限されることなく、例えばH2PdCl4、H2PdCl6、Na2PdCl6、K2PdCl4、K2PdCl6、Na2PdBr4、K2PdBr4、K2Pd(CN)4、K2Pd(NO3)4、(NH4)2PdCl4、(NH4)2PdCl6、Pd(OH)2、PdCl2、PdBr2、PdI2、Pd(NO3)2、Pd(CN)2、PdSO4、Pd(OCOCH3)2、Pd(OCOCF3)2、Pd(C5H7O2)2、等のパラジウムイオン塩、HAuCl4、NaAuCl4、KAuCl4、NH4AuCl4、AuCN、KAuCN2、AuCl、AuCl3、AuBr、AuI3、AuCl、AuI3、Au(OCOCH3)3、等の金イオン塩、AgNO3、AgClO4、AgCN、AgSCN、KAg(CN)2、Ag2CO3、Ag2SO4、AgOCOCH3、等の銀イオン塩、H2PtCl6、Na2PtCl4、Na2PtCl6、K2PtCl4、K2PtCl6、Na2PtBr4、K2PtBr4、K2Pt(CN)4、K2Pt(NO3)4、(NH4)2PtCl4、(NH4)2PtCl6、Pt(OH)2、PtCl2、PtBr2、PtI2、Pt(NO3)2、Pt(CN)2、PtSO4、Pt(OCOCH3)2、Pt(OCOCF3)2、Pt(C5H7O2)2、等の白金イオン塩、NiCl2、NiBr2、NiI2、NiF2、Ni(NO3)2、Ni(CN)2、NiCO3、NiSO4、Ni(ClO4)2、Ni(OCOCH3)2、Ni(OCOCF3)2、Ni(C5H7O2)2、等のニッケルイオン塩、InCl、InCl3、InBr、InBr3、InI、InI3、InF3、In(NO3)3、In2(SO4)3、In(OC3H7)3、In(OCOCH3)3、In(C5H7O2)3、等のインジウムイオン塩、ZnCl2、ZnBr2、ZnI2、ZnF2、Zn(NO3)2、Zn(CN)2、ZnCO3、ZnSO4、Zn(ClO4)2、Zn(OCOCH3)2、Zn(OCOCF3)2、Zn(C5H7O2)2、等の亜鉛イオン塩等も利用できる。さらに、複合金属からなる導電性ナノ粒子を作成するために、上記の金属イオン塩を複数同時に用いることも可能である。
　　上述のブロック共重合体の除去処理と金属イオンの還元処理は、一段階処理により行なうことが好ましいが、複数段階の処理を組みあわせて行なっても良い。このような処理としては、紫外線又は電子線照射、プラズマ処理、化学的還元法、又は電気化学的還元法が挙げられる。これらの中では、プラズマ処理や紫外線処理（特に真空紫外線処理）が好ましい。例えば、アルゴンガスを用いたプラズマ処理を行なうと、テンプレートであるブロック共重合体薄膜はアルゴンプラズマにより選択的にエッチングされ素子表面から除去される一方、金属イオンはアルゴンプラズマによりエッチングされず、プラズマ中に存在する電子により還元される。プラズマ処理用のガスは、アルゴンガスに特に制限されることなく、例えばアルゴンと水素が任意の割合で混ざった混合ガスを用いることもできる。さらに、酸素ガスを用いることにより、酸化物からなる導電性ナノ粒子（ZnO、In2O3など）を得ることも可能である。
　　本発明の接合構造は、公知のマイクロコンタクトプリント法を導電性ナノ粒子の配列手法として利用し、次のようにして形成することもできる。
　　まず、スタンプ面に微小凸部が所定の分布パターンに形成されたポリジメチルシロキサン(PDMS)等のポリマーからなるスタンプを準備する。該スタンプ面は、スタンプ成形後の電子ビームリソグラフィー、フォトリソグラフィーとエッチング等、公知の手法によって形成できるし、また、成形時に型面の凹凸パターンによっても形成することができる。微小凸部は、その上面が上述の導電性ナノ粒子の平面サイズに対応する大きさに形成され、導電性粒子と同様の配列間隔、分布パターンに形成される。このような３次元のナノスケール構造を有するスタンプ面に、熱蒸着、電子ビーム蒸着、またはスパッタリング等によりAg等の導電性薄膜を堆積させる。
　　こうして得られた導電性薄膜付き３次元形状スタンプを、導電性ナノ粒子が選択的に結合する官能基末端を有する化合物で表面処理した半導体素子表面にスタンプの凸部分のみが接触するように押し付ける。このとき、導電性薄膜物質表面と官能基末端の相互作用により、接触部のみの導電性薄膜を半導体素子上において転写することができる。転写後、官能基末端を有する化合物を除去し、導電性薄膜が半導体素子に直接的に接合するように、紫外線又は電子線照射、プラズマ処理等を行う。この後、トップ半導体素子101を導電性ナノ粒子が配置されたボトム半導体素子102上に重ね、適度な加圧・加温下で両者の接合を行う。この接合は、有機系や無機系の接着剤乃至接着用材料を用いないものであり、ファンデルワールス力のみによるものであっても良いし、表面活性化を経た直接接合法や熱固相拡散法によるものであっても良い。表面活性化には、プラズマ処理、オゾン処理、イオンビーム等による処理など、公知の表面活性化処理法を用いることができる。
　　なお、前記の導電性薄膜に関しては、Agに特に制限されることなく、例えばAu、Cu、Pt、 Pd、Al等の金属、またはIn2O3、ZnO等の導電性酸化物等も利用できる。さらに、複合金属からなる導電性ナノ粒子を作成するために、上記の物質を複数同時に用いることも可能である。
　　また、上記化合物の導電性ナノ粒子が結合する官能基としては、アミノ基、チオール基が挙げられる。該官能基末端を有する化合物としては、好ましくは、自己組織化単分子膜（self-assembled monolayer；SAM）を形成することができる化合物（SAM形成性化合物）であり、限定するものではないが、例えば、3-メルカプトプロピルトリメトキシシラン-4-メルカプトフェニルトリメトキシシラン等の末端チオール基を有するトリアルコキシシラン類、3-アミノプロピルトリメトキシシラン-4-アミノフェニルトリメトキシシラン等の末端アミノ基を有するトリアルコキシシランが挙げられる。
　　なお、本発明において、導電性ナノ粒子を配列するのに利用するマイクロコンタクトプリント法は、上述のものに限定されず、本発明の半導体素子の接合方法に利用することができるものであれば、どのようなものでも良い。例えば、所定の分布パターンに形成されたスタンプ面のSAM形成性化合物を半導体素子表面に転写し、転写されたSAM上に導電性ナノ粒子を析出するものでも良い。
　　上述のようなマイクロコンタクトプリント法を利用して半導体素子表面に導電性ナノ粒子の配列パターンを形成する場合、導電性ナノ粒子の平面形状、配列パターンは、スタンプ面の凹凸パターンに依存する。そのため、スタンプ面を形成する際の微小加工性能の範囲内において、導電性ナノ粒子の平面形状、配列パターンを任意に設定することができ、ブロック共重合体薄膜をテンプレートとして形成する場合に比べ、導電性ナノ粒子の平面形状、配列パターンに関する設計自由度が格段に向上する。それ故、光学特性設計ならびにそれによる光閉じ込め効果の点で望ましい導電性ナノ粒子平面形状、配列パターンとすることができる。そのような望ましい導電性ナノ粒子平面形状としては球状・半球状・円柱状・楕円体状、配列パターンとしては、６角形状、正６角形状（または擬正６角形状）、４角形状、正方形状（または擬正方形状）が挙げられる〔なお、各形状における「擬正・・・形状」とは、各形状における辺長の標準偏差が平均辺長の30％以内（好ましくは20％以内、より好ましくは10％以内）であるものをいう。〕。
　　以下、本発明を実施例に基づいてさらに詳細に説明するが、本発明はこれら実施例によって何ら制限されず、本発明の要旨を逸脱しない範囲で、各種の材料変更、設計変更、設定調整等が可能である。
　（実施例１）
　　図４に、本実施形態の一つとして光電変換半導体素子（太陽電池）の例を示す。本実施例においては、トップ太陽電池としてAl0.3Ga0.7As光吸収層を有するセル301、ボトム太陽電池としてCIGSe半導体層を有するセル302からなる2つの太陽電池を接合した場合を示す。GaAs系太陽電池301は、p型GaAsバッファ層303、p型Al0.3Ga0.7As光吸収層304、n型GaAsエミッタ層305、n型GaAsコンタクト層306、およびn型電極AuGeNi 307からなる。n型電極は、太陽光を受光するために、櫛型状の形態を有している。CIGSe系太陽電池302は、ガラス基板308上に、Mo電極309、CIGSe半導体層310、CdSエミッタ層311、ZnO透明伝導層312からなっている。ここで、CIGSe系太陽電池302表面には、ナノ粒子313の配列がなされている。本実施例では、Pdのナノ粒子を用いた。
　　Pdナノ粒子313は、ブロック共重合体としてポリスチレン－ポリ-2-ビニルピリジンを薄膜化し、それをテンプレートとして用いることによりCIGSe系太陽電池302上に配列させた。すなわち、総分子量265000g/molのポリスチレン－ポリ-2-ビニルピリジン（ポリスチレン分子量：133000g/mol、ポリ-2-ビニルピリジン分子量：132000g/mol）の0.5重量%オルトキシレン溶液をCIGSeセル302の表面にスピンコーティングし、薄膜形成した。次に、この太陽電池302を1mMのNa2PdCl4水溶液に300秒浸した。水洗後、このセルをアルゴンプラズマ処理することにより、有機分子で覆われていない平均サイズ50ナノメートルのパラジウムナノ粒子313を整列配置させた。本配置におけるパラジウムナノ粒子間の平均配列間隔は100ナノメートルであった。この後、本実施例では圧着により接合させた。すなわち、水をCIGSe系セル302上に滴下しGaAs系セル301をセットして、表面張力を用いて両素子を仮接合させた。この後に、150 ℃加温状態で30分以上加圧し、素子間にPdナノ粒子313を存在させた状態で接合させた。
　　前記太陽電池に関しては、GaAs系およびCIGSe系太陽電池に特に制限されることなく、たとえばInP、もしくは、GaSb基板上等に積層された１接合、または、２接合以上からなる太陽電池、Si結晶太陽電池、アモルファスSi太陽電池、微結晶Si太陽電池、有機太陽電池、増感型太陽電池、カルコパイライト系材料を用いた太陽電池、その他太陽電池の組み合わせが挙げられる。
　　また、前記接着手法に関しては、圧着に特に制限されることなく、例えばプラズマやイオンビームを用いた表面活性化による素子の直接接合全般に適用できる。
　　また、導電性ナノ粒子に関しては、Pdに特に制限されることなく、Au、Ag、Pt、Ni、Al、Zn、In等の金属ナノ粒子、またはZnO、In2O3等の導電性を有する金属酸化物ナノ粒子などが可能である。
　　また、導電性ナノ粒子のサイズに関しては、50ナノメートルに制限されることなく、10-200ナノメートルの範囲において適用できる。
　　また、導電性ナノ粒子の配置間隔に関しては、100ナノメートルに制限されることなく、ナノ粒子サイズの２倍以上１０倍以下の距離が離れていれば差し支えない。
　　つぎに、本実施例による、太陽電池動作について説明する。図５には、太陽電池のIV特性を示す。図５中（a）は、本発明実施例に従い製作された太陽電池の特性、（b）にはPdナノ粒子を介在させない接合構造での特性を示す。これより、（a）では、開放電圧1.62V、曲線因子0.53が得られており、2接合セルでの予測特性（開放電圧1.92V）に合致する特性が得られている。一方、（b）ではIV特性が大きく劣化している様子が伺える。つまり、開放電圧は1.65Vであるが、曲線因子が0.23にまで低下している。各特性より接合抵抗を見積もると、従来構造では200Ωcm2以上であり、本発明構造では10Ωcm2である。すなわち、接合抵抗の違いが、IV特性の改善につながっている。
　（実施例２）
　　図６に、本実施形態の一つとして光電変換半導体素子（太陽電池）の例を示す。本実施例においては、トップ太陽電池としてGaAs系光吸収層を有するセル501、ボトム太陽電池としてInP系半導体層を有するセル502からなる2つの太陽電池を接合した場合を示す。GaAs系太陽電池501は、p型GaAsバッファ層503、p型GaAs光吸収層504、n型GaAsエミッタ層505、n型Ga0.51In0.49P/p型Ga0.51In0.49P (506/507)トンネル層、p型Ga0.51In0.49P光吸収層508、n型Ga0.51In0.49Pエミッタ層509、n型GaAsコンタクト層510、およびn型電極AuGeNi 511からなる。n型電極は、太陽光を受光するために、櫛型状の形態を有している。InP系太陽電池502は、InP基板512上に、p型InPバッファ層513、p型In0.91Ga0.09As0.2P0.8光吸収層514（バンドギャップエネルギー1.2eV）、n型In0.91Ga0.09As0.2P0.8エミッタ層515、n型InP層516からなっている。ここで、InP系太陽電池502表面には、ナノ粒子配列517がなされている。本実施例では、Auのナノ粒子を用いた。なお、InGaAsP組成は設計的要素であり、目標特性に応じて自在に組成を調整できるものである。
　　Auナノ粒子517は、ブロック共重合体としてポリスチレン－ポリ-2-ビニルピリジンを薄膜化し、それをテンプレートとして用いることによりInP系太陽電池502上に配列させた。すなわち、総分子量183500g/molのポリスチレン－ポリ-2-ビニルピリジン（ポリスチレン分子量：125000g/mol、ポリ-2-ビニルピリジン分子量：58500g/mol）の0.3重量%トルエン溶液をInP系太陽電池502表面にスピンコーティングし、薄膜形成した。次に、この太陽電池502を1mMのKAuCl4水溶液に600秒浸した。水洗後、このセルをアルゴンプラズマ処理することにより、有機分子で覆われていない平均サイズ10ナノメートルのAuナノ粒子517を整列配置させた。本配置におけるAuナノ粒子間の平均間隔は30ナノメートルであった。この後に、本実施例では、圧着により接合させた。すなわち、水をInP系セル502に滴下しGaAs系セル501をセットして、表面張力を用いて両素子を仮接合させた。この後に、150℃加温状態で30分以上加圧し、素子間にAuナノ粒子517を存在させた状態で接合させた。
　　つぎに、本実施例による、太陽電池動作について説明する。図７には、太陽電池のIV特性を示す。図７中（a）は、本実施例に従い製作された太陽電池の特性、（b）にはAuナノ粒子を介在させない接合構造での特性を示す。これより、（a）では、開放電圧2.90V、曲線因子0.69が得られており、３接合セルでの予測特性（開放電圧2.97V）に合致する特性が得られている。一方、（b）ではIV特性が大きく劣化している様子が伺える。つまり、開放電圧は2.56Vであるが、曲線因子が0.45にまで低下している。各特性より接合抵抗を見積もると、従来構造では200Ωcm2以上であり、本発明構造では20Ωcm2以下である。すなわち、接合抵抗の違いが、IV特性の改善につながっている。
　　なお、本実施例ではInP基板512上にInGaAsP光吸収層514を有する構造をボトムセルとして用いたが、Ge基板上に同様にInGaAsP光吸収層あるいはInGaAs歪み光吸収層を形成した構造においても適用できる。
　（実施例３）
　　図８に、本実施形態の一つとして光電変換半導体素子（太陽電池）の例を示す。本実施例においては、トップ太陽電池としてアモルファスSi光吸収層を有する太陽電池701、ボトム太陽電池として結晶Si系半導体層を有する太陽電池702からなる2つの太陽電池を接合した場合を示す。アモルファスSi太陽電池701は、ZnO透明導電層703、n型アモルファスSi層704、i型アモルファスSi光吸収層705、p型アモルファスSi層706、フッ素ドープSnO2透明導電層707、およびガラス基板708からなる。結晶シリコン太陽電池702は、Al電極709上に、n型結晶Si層710、p型結晶Si層711、ITO透明導電層712からなる。ここで、結晶Si太陽電池702表面には、ナノ粒子配列713がなされている。本実施例では、Ptのナノ粒子を用いた。
　　Ptナノ粒子713は、ブロック共重合体としてポリスチレン－ポリ-4-ビニルピリジンを薄膜化し、それを鋳型として用いることにより結晶シリコン系セル上に配列させた。すなわち、総分子量39000g/molのポリスチレン－ポリ-4-ビニルピリジン（ポリスチレン分子量：20000g/mol、ポリ-4-ビニルピリジン分子量：19000g/mol）の0.6重量%トルエン溶液を結晶Si太陽電池702表面にスピンコーティングし、薄膜形成した。次に、この太陽電池702を1mMのNa2PtCl4水溶液に1800秒浸した。水洗後、このセルをアルゴンプラズマ処理することにより、有機分子で覆われていない平均サイズ20ナノメートルのPtナノ粒子712を整列配置させた。本配置におけるPtナノ粒子間の平均間隔は40ナノメートルであった。この後に、本実施例では、圧着により接合させた。すなわち、水を結晶シリコン系セル702に滴下しアモルファスシリコン系セル701をセットして、表面張力を用いて両素子を仮接合させた。この後に、150℃加温状態で30分以上加圧し、素子間にPtナノ粒子712を存在させた状態で接合させた。
　　つぎに、本実施例による、太陽電池動作について説明する。本実施例に従い製作された太陽電池の特性とPtナノ粒子を介在させない接合構造での特性を比較したところ、前者では、開放電圧1.45V、曲線因子0.63が得られており、2接合セルでの予測特性（開放電圧1.5V）に合致する特性が得られた。一方、後者ではIV特性が大きく劣化している様子が伺えた。つまり、開放電圧は1.40Vであるが、曲線因子が0.25にまで低下した。各特性より接合抵抗を見積もると、従来構造では100Ωcm2以上であり、本発明の実施例構造では10Ωcm2以下である。すなわち、接合抵抗の違いが、IV特性の改善につながっている。
　　以上の実施例１－３で示したとおり、本発明構造では、導電性ナノ粒子のモノレイヤーを各種太陽電池接合界面に配列し、かつその状態で接合させることにより、界面での光透過性を損なうことなく接合抵抗を大幅に改善したことにより、良好な太陽電池特性が得ることができる。ただし、本発明の用途は太陽電池に限定されず、導電性および光透過性を必要とする半導体素子の接合に関して幅広く適用可能である。
　（実施例４）
　　図９に、本実施形態の一つとして光電変換半導体素子（太陽電池）の例を示す。本実施例においては、トップ太陽電池としてGaAs系光吸収層を有するセル901、ボトム太陽電池としてInP系半導体層を有するセル902からなる2つの太陽電池を接合した場合を示す。GaAs系太陽電池901は、p型GaAsバッファ層903、p型GaAs光吸収層904、n型GaAsエミッタ層905、n型InGaPエミッタ層906、n型GaAsコンタクト層907、およびn型電極AuGeNi 908からなる。n型電極は、太陽光を受光するために、櫛型状の形態を有している。InP系太陽電池902は、InP基板909上に、p型InPバッファ層910、p型In0.83Ga0.17As0.37P0.63光吸収層911（バンドギャップエネルギー1.15eV）、n型In0.83Ga0.17As0.37P0.63エミッタ層912、n型InP層913からなっている。ここで、InP系太陽電池902表面には、ナノ粒子配列914がなされている。本実施例では、Agのナノ粒子を用いた。なお、InGaAsP組成は設計的要素であり、目標特性に応じて自在に組成を調整できるものである。
　　Agナノ粒子914は、微小凸部が形成されたポリジメチルシロキサン(PDMS)からなるスタンプを用いる転写手法によりInP系セル上に配列させた。すなわち、直径230ナノメートル、高さ200ナノメートルの円柱構造が中心間距離460ナノメートルで６角形状配列したPDMSスタンプ上に、電子ビーム蒸着により厚さ50ナノメートルのAg薄膜を形成した。次に、このAg薄膜付スタンプを3-メルカプトプロピルトリメトキシシランSAM膜を表面に有するInP系太陽電池902に室温にて5分間、凸部分のみを接触させAgナノ粒子構造を転写し、その後セルをアルゴンプラズマ処理することにより、図３に示したように有機分子で覆われていない直径230ナノメートル、高さ50ナノメートルのAgナノ粒子（円柱状）914を整列配置させた。本配置におけるAgナノ粒子の中心間距離は460ナノメートルであった。この後に、本実施例では、GaAs系セル901とInP系セル902を圧着により接合させた。すなわち、水をInP系セル902に滴下しGaAs系セル901をセットして、表面張力を用いて両素子を仮接合させた。この後に、150℃加温状態で30分以上加圧し、素子間にAgナノ粒子914を存在させた状態で接合させた。
　　つぎに、本実施例による、太陽電池動作について説明する。本実施例に従い製作された太陽電池の特性を計測したところ（図１０参照）、開放電圧1.3V、短絡電流14.8mA、発電効率11.8%が得られ、２接合セルでの予測特性（開放電圧1.5V、短絡電流11.7mA、発電効率11%）を上回る特性が得られた。つまり、先述の実施例１－３でみられたようにAgナノ粒子が２つのセルを導電接続させているのみならず、本例ではボトムInP系セルに対して有効な光閉じ込め効果をもたらしているため、予測特性を大きく上回る短絡電流値が得られ、結果としてセル全体の発電効率が向上している。
　　以上の実施例４で示したとおり、本発明構造では、導電性ナノ粒子のモノレイヤーを太陽電池接合界面に配列し、かつその状態で接合させることにより、異なる太陽電池間の導電接続を実現し、かつ接合界面で素子特性に有利に働く光学特性の設計が可能となり、良好な太陽電池特性が得ることができる。ただし、本発明の用途は太陽電池に限定されず、導電性および界面での光学特性設計を必要とする半導体素子の接合に関して幅広く適用可能である。
　　この発明は、半導体素子の接合方法および接合構造に関するものであり、これらは導電性ならびに透明性、または接合界面における光学特性設計を必要とする半導体素子の多接合化に利用することができる。
　101：半導体素子接合構造
　102：ボトム半導体素子
　103：トップ半導体素子
　104：導電性ナノ粒子
　301：GaAs系太陽電池（GaAs系セル）
　302：CIGSe系太陽電池（CIGSe系セル）
　303：p-GaAsバッファ層
　304：p-Al0.3Ga0.7As光吸収層
　305：-N-GaAsエミッタ層
　306：-N-GaAsコンタクト層
　307：-N-AuGeNi櫛型電極
　308：ガラス基板
　309：Mo電極
　310：CIGSe半導体層
　311：CdSエミッタ層
　312：ZnO透明電極
　313：Pdナノ粒子
　501：GaAs系太陽電池（GaAs系セル）
　502：InP系太陽電池（InP系セル）
　503：p-GaAsバッファ層
　504：p-GaAs光吸収層
　505：-N-GaAsエミッタ層
　506：-N-Ga0.51In0.49Pトンネル層
　507：p-Ga0.51In0.49Pトンネル層
　508：p-Ga0.51In0.49P光吸収層
　509：-N-Ga0.51In0.49Pエミッタ層
　510：-N-GaAsコンタクト層
　511：-N-AuGeNi櫛型電極
　512：InP基板
　513：p-InPバッファ層
　514：p-In0.91Ga0.09As0.2P0.8光吸収層
　515：-N-In0.91Ga0.09As0.2P0.8エミッタ層
　516：-N-InP層
　517：Auナノ粒子
　701：アモルファスSi太陽電池（アモルファスシリコン系セル）
　702：結晶Si太陽電池（結晶シリコン系セル）
　703：ZnO透明導電層
　704：-N-アモルファスSi層
　705：i-アモルファスSi光吸収層
　706：p-アモルファスSi層
　707：フッ素ドープSnO2透明導電層
　708：ガラス基板
　709：Al電極
　710：-N-結晶Si層
　711：p-結晶Si層
　712：ITO透明導電層
　713：Ptナノ粒子
　901：GaAs系太陽電池（GaAs系セル）
　902：InP系太陽電池（InP系セル）
　903：p-GaAsバッファ層
　904：p-GaAs光吸収層
　905：-N-GaAsエミッタ層
　906：-N-InGaPエミッタ層
　907：-N-GaAsコンタクト層
　908：-N-AuGeNi櫛型電極
　909：InP基板
　910：p-InPバッファ層
　911：p-In0.83Ga0.17As0.37P0.63光吸収層
　912：-N-In0.83Ga0.17As0.37P0.63エミッタ層
　913：-N-InP層
　914：Agナノ粒子
　
　

Claims (14)

  1. 有機分子で覆われていない導電性ナノ粒子を一方の半導体素子表面に配列し、その上に他方の半導体素子を圧着させることを特徴とする半導体素子の接合方法。
  2. 前記半導体素子表面への導電性ナノ粒子の配列が、ブロック共重合体薄膜をテンプレートとして形成されることを特徴とする請求項１に記載の半導体素子の接合方法。
  3. 前記半導体素子表面への導電性ナノ粒子の配列が、形状パターンが施されたスタンプを用いる転写手法で形成されることを特徴とする請求項１に記載の半導体素子の接合方法。
  4. 前記導電性ナノ粒子のサイズが、100ナノメートル以上500ナノメートル以下であることを特徴とする請求項１～３のいずれか１項に記載の半導体素子の接合方法。
  5. 前記導電性ナノ粒子のサイズが、10ナノメートル以上200ナノメートル以下であることを特徴とする請求項１又は２に記載の半導体素子の接合方法。
  6. 前記導電性ナノ粒子の配列間隔が、導電性ナノ粒子サイズの2倍以上10倍以下の距離であることを特徴とする請求項１～５のいずれか１項に記載の半導体素子の接合方法。
  7. 前記導電性ナノ粒子が、Pd、Au、Ag、Pt、Ni、Al、In、In2O3、Zn、ZnO、もしくはこれらの複合体からなることを特徴とする請求項１～６のいずれか１項に記載の半導体素子の接合方法。
  8. 前記半導体素子が、結晶Si系、アモルファスSi系、微結晶Si系、有機系、もしくは、カルコパイライト系材料を用いた単接合太陽電池、またはGaAs、InP、GaSb、もしくは、Ge基板上等に積層された２接合以上からなる太陽電池であることを特徴とする請求項１～７のいずれか１項に記載の半導体素子の接合方法。
  9. 一対の半導体素子の接合構造であって、両方の半導体素子の接合面に有機分子で覆われていない導電性ナノ粒子が介在している半導体素子の接合構造。
  10. 両方の半導体素子の接合面に介在する導電性ナノ粒子は、モノレイヤー（単一層）であることを特徴とする請求項９に記載の半導体素子の接合構造。
  11. 一対の半導体素子は、接合面に半導体層又は導電層を有するものである請求項９又は１０に記載の半導体素子の接合構造。
  12. 請求項９～１１のいずれか１項に記載の接合構造を隣接する半導体素子間に備える半導体素子積層体であって、半導体素子積層体の積層方向の一方の端面から、接合面のうち少なくとも最も遠くに位置する接合面までは透光性を具備する半導体素子積層体。
  13. 半導体素子が光電変換機能を有するものである請求項１２に記載の半導体素子積層体。
  14. 光電変換機能を有する半導体素子が太陽電池である請求項１３に記載の半導体素子積層体。
PCT/JP2012/076867 2011-10-17 2012-10-17 半導体素子の接合方法および接合構造 WO2013058291A1 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
EP12841246.7A EP2770540A4 (en) 2011-10-17 2012-10-17 METHOD FOR LINKING SEMICONDUCTOR ELEMENTS AND LINK STRUCTURE
CN201280050852.0A CN103890976B (zh) 2011-10-17 2012-10-17 半导体元件的接合方法及接合结构
JP2013539671A JP5875124B2 (ja) 2011-10-17 2012-10-17 半導体素子の接合方法および接合構造
US14/351,935 US10608136B2 (en) 2011-10-17 2012-10-17 Method of bonding semiconductor elements and junction structure

Applications Claiming Priority (4)

Application Number Priority Date Filing Date Title
JP2011-227787 2011-10-17
JP2011227787 2011-10-17
JP2012141032 2012-06-22
JP2012-141032 2012-06-22

Publications (1)

Publication Number Publication Date
WO2013058291A1 true WO2013058291A1 (ja) 2013-04-25

Family

ID=48140934

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2012/076867 WO2013058291A1 (ja) 2011-10-17 2012-10-17 半導体素子の接合方法および接合構造

Country Status (5)

Country Link
US (1) US10608136B2 (ja)
EP (1) EP2770540A4 (ja)
JP (1) JP5875124B2 (ja)
CN (1) CN103890976B (ja)
WO (1) WO2013058291A1 (ja)

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015009348A (ja) * 2013-07-02 2015-01-19 独立行政法人産業技術総合研究所 表面に多数のナノ金属体を転写した構造体の製造方法
JP2017529696A (ja) * 2014-08-29 2017-10-05 エーファウ・グループ・エー・タルナー・ゲーエムベーハー 導電性の多層基板スタックを製造するための方法
JP2019153747A (ja) * 2018-03-06 2019-09-12 株式会社東芝 太陽電池、多接合型太陽電池、太陽電池モジュール及び太陽光発電システム
WO2020004475A1 (ja) * 2018-06-29 2020-01-02 国立研究開発法人産業技術総合研究所 多接合光電変換素子及び多接合太陽電池
JP2020161546A (ja) * 2019-03-25 2020-10-01 国立研究開発法人産業技術総合研究所 太陽電池およびその製造方法
WO2021060126A1 (ja) * 2019-09-25 2021-04-01 Ｄｏｗａエレクトロニクス株式会社 接合材、接合材の製造方法、接合方法及び半導体装置
JP2021086977A (ja) * 2019-11-29 2021-06-03 国立研究開発法人産業技術総合研究所 半導体装置およびその製造方法

Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11171253B2 (en) 2016-09-21 2021-11-09 Kabushiki Kaisha Toshiba Solar cell, multi-junction solar cell, solar cell module, and photovoltaic system
JP6993784B2 (ja) 2017-03-17 2022-01-14 株式会社東芝 太陽電池、多接合型太陽電池、太陽電池モジュール及び太陽光発電システム
US11031364B2 (en) 2018-03-07 2021-06-08 Texas Instruments Incorporated Nanoparticle backside die adhesion layer
CN111916522A (zh) * 2020-06-09 2020-11-10 华南理工大学 一种钯连接的双结GaAs/Si肖特基结太阳电池及其制备方法
CN111916521A (zh) * 2020-06-09 2020-11-10 华南理工大学 一种具有界面等离激元效应的双结GaAs/Si肖特基结太阳电池及其制备方法
CN112349801B (zh) * 2020-10-16 2023-12-01 泰州隆基乐叶光伏科技有限公司 叠层电池的中间串联层及生产方法、叠层电池

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003309352A (ja) 2002-04-16 2003-10-31 Fujikura Ltd 導電性接着剤およびこれを用いた電子部品実装構造
JP2004107728A (ja) 2002-09-18 2004-04-08 Ebara Corp 接合材料及び接合方法
JP2006088310A (ja) 2004-08-26 2006-04-06 Japan Science & Technology Agency 金属微粒子配列シート
JP2007204778A (ja) * 2006-01-31 2007-08-16 Ebara Corp 接合材料
WO2007122998A1 (ja) 2006-04-19 2007-11-01 Japan Science And Technology Agency 表面に微小金属塊が整列した基板
JP2008208442A (ja) * 2007-02-28 2008-09-11 Hitachi Ltd 金属化合物粒子を用いた接合方法
JP2011138711A (ja) 2009-12-28 2011-07-14 Panasonic Electric Works Co Ltd 透明導電性接着剤及び透明導電性接着剤から形成される透明導電性接着層を備える光電変換素子

Family Cites Families (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09326416A (ja) * 1996-06-05 1997-12-16 Kokusai Electric Co Ltd 半導体素子の実装方法およびその製品
JPH09326414A (ja) 1996-06-06 1997-12-16 Nec Corp テープ・キャリア・パッケージ型半導体装置
US6657378B2 (en) * 2001-09-06 2003-12-02 The Trustees Of Princeton University Organic photovoltaic devices
US20040245648A1 (en) 2002-09-18 2004-12-09 Hiroshi Nagasawa Bonding material and bonding method
US7196366B2 (en) * 2004-08-05 2007-03-27 The Trustees Of Princeton University Stacked organic photosensitive devices
JP4959127B2 (ja) * 2004-10-29 2012-06-20 三菱重工業株式会社 光電変換装置及び光電変換装置用基板
EP1815544A2 (en) * 2004-11-24 2007-08-08 The Trustees of Princeton University Organic photosensitive optoelectronic device having a phenanthroline exciton blocking layer
WO2007095386A2 (en) * 2006-02-13 2007-08-23 Solexant Corporation Photovoltaic device with nanostructured layers
US20070227588A1 (en) * 2006-02-15 2007-10-04 The Regents Of The University Of California Enhanced tunnel junction for improved performance in cascaded solar cells
KR100880946B1 (ko) * 2006-07-03 2009-02-04 엘지전자 주식회사 태양전지 및 그 제조방법
JP4650456B2 (ja) 2006-08-25 2011-03-16 日立化成工業株式会社 回路接続材料、これを用いた回路部材の接続構造及びその製造方法
JP4361572B2 (ja) * 2007-02-28 2009-11-11 株式会社新川 ボンディング装置及び方法
EP2139045A4 (en) * 2008-04-09 2010-05-05 Ooo Novye Energet Tehnologii ELECTROMAGNETIC RADIATION CONVERTER
JP5399110B2 (ja) 2008-04-23 2014-01-29 トヨタ自動車株式会社 接合材料及び接合材料の成分算出方法
WO2011048774A1 (ja) * 2009-10-19 2011-04-28 住友ベークライト株式会社 電子装置の製造方法、電子装置および電子装置の製造装置
WO2011125101A1 (ja) * 2010-04-02 2011-10-13 株式会社 東芝 光電変換素子及びその製造方法

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003309352A (ja) 2002-04-16 2003-10-31 Fujikura Ltd 導電性接着剤およびこれを用いた電子部品実装構造
JP2004107728A (ja) 2002-09-18 2004-04-08 Ebara Corp 接合材料及び接合方法
JP2006088310A (ja) 2004-08-26 2006-04-06 Japan Science & Technology Agency 金属微粒子配列シート
JP2007204778A (ja) * 2006-01-31 2007-08-16 Ebara Corp 接合材料
WO2007122998A1 (ja) 2006-04-19 2007-11-01 Japan Science And Technology Agency 表面に微小金属塊が整列した基板
JP2008208442A (ja) * 2007-02-28 2008-09-11 Hitachi Ltd 金属化合物粒子を用いた接合方法
JP2011138711A (ja) 2009-12-28 2011-07-14 Panasonic Electric Works Co Ltd 透明導電性接着剤及び透明導電性接着剤から形成される透明導電性接着層を備える光電変換素子

Non-Patent Citations (3)

* Cited by examiner, † Cited by third party
Title
HATAB ET AL., ACS NANO, vol. 2, 2008, pages 377
LOO ET AL., JOURNAL OF THE AMERICAN CHEMICAL SOCIETY, vol. 124, 2002, pages 7654
See also references of EP2770540A4

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015009348A (ja) * 2013-07-02 2015-01-19 独立行政法人産業技術総合研究所 表面に多数のナノ金属体を転写した構造体の製造方法
JP2017529696A (ja) * 2014-08-29 2017-10-05 エーファウ・グループ・エー・タルナー・ゲーエムベーハー 導電性の多層基板スタックを製造するための方法
JP2019153747A (ja) * 2018-03-06 2019-09-12 株式会社東芝 太陽電池、多接合型太陽電池、太陽電池モジュール及び太陽光発電システム
WO2020004475A1 (ja) * 2018-06-29 2020-01-02 国立研究開発法人産業技術総合研究所 多接合光電変換素子及び多接合太陽電池
JP2020161546A (ja) * 2019-03-25 2020-10-01 国立研究開発法人産業技術総合研究所 太陽電池およびその製造方法
JP7272561B2 (ja) 2019-03-25 2023-05-12 国立研究開発法人産業技術総合研究所 太陽電池およびその製造方法
WO2021060126A1 (ja) * 2019-09-25 2021-04-01 Ｄｏｗａエレクトロニクス株式会社 接合材、接合材の製造方法、接合方法及び半導体装置
JP2021086977A (ja) * 2019-11-29 2021-06-03 国立研究開発法人産業技術総合研究所 半導体装置およびその製造方法
WO2021106339A1 (ja) * 2019-11-29 2021-06-03 国立研究開発法人産業技術総合研究所 半導体装置およびその製造方法
JP7416403B2 (ja) 2019-11-29 2024-01-17 国立研究開発法人産業技術総合研究所 半導体装置およびその製造方法

Also Published As

Publication number Publication date
EP2770540A4 (en) 2015-05-20
CN103890976A (zh) 2014-06-25
JPWO2013058291A1 (ja) 2015-04-02
JP5875124B2 (ja) 2016-03-02
US10608136B2 (en) 2020-03-31
US20140238485A1 (en) 2014-08-28
EP2770540A1 (en) 2014-08-27
CN103890976B (zh) 2016-11-02

Similar Documents

Publication Publication Date Title
JP5875124B2 (ja) 半導体素子の接合方法および接合構造
US9905714B2 (en) High efficiency photovoltaic cells
KR101234881B1 (ko) 나노입자로 형성된 투명한 전극을 갖는 광전지 소자
JP5586948B2 (ja) 半導体材料を用いた薄膜光電材料のための方法及び構造
US8314326B2 (en) Method and structure for thin film photovoltaic materials using bulk semiconductor materials
EP1703569A2 (en) High efficiency inorganic nanorod-enhanced photovoltaic devices
Sun et al. Compound semiconductor nanowire solar cells
KR20080095288A (ko) 나노구조의 층을 가진 광기전 장치
US20100276731A1 (en) Inorganic Nanocrystal Bulk Heterojunctions
US20190148574A1 (en) Superstrates Incorporating Effectively Transparent Contacts and Related Methods of Manufacturing
KR20090117881A (ko) 광전지 및 광전지를 제조하는 방법
JP2009532851A (ja) ナノ粒子増感ナノ構造太陽電池
JP2008503880A (ja) ナノ構造材料およびナノ構造材料を含む光起電力素子
JP2012507872A (ja) ハイブリッド透明導電性電極
JP2010532574A (ja) 分散型コアックス光起電装置
Goodnick et al. Solar cells
WO2021070169A1 (en) Improved superlattice structure for thin film solar cells
CN114667610A (zh) 半导体装置及其制造方法
Goodnick Nanotechnology pathways to next-generation photovoltaics
Asim et al. Perspective of Nanomaterials in Solar Cell

Legal Events

Date Code Title Description
121 Ep: the epo has been informed by wipo that ep was designated in this application

Ref document number: 12841246

Country of ref document: EP

Kind code of ref document: A1

ENP Entry into the national phase

Ref document number: 2013539671

Country of ref document: JP

Kind code of ref document: A

WWE Wipo information: entry into national phase

Ref document number: 2012841246

Country of ref document: EP

WWE Wipo information: entry into national phase

Ref document number: 14351935

Country of ref document: US

NENP Non-entry into the national phase

Ref country code: DE