WO1999065069A1 - Procede d'implantation d'ions - Google Patents

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WO1999065069A1
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Yasuhiko Matsunaga
Majeed Ali Foad
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Applied Materials Inc.
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    • H01L21/26513—Bombardment with radiation with high-energy radiation producing ion implantation in group IV semiconductors of electrically active species

Definitions

  • the present invention relates to an ion implantation technique used in a semiconductor device manufacturing process or the like, and more particularly to a low energy ion implantation technique for forming a shallow junction in a semiconductor substrate.
  • ion implantation processes require the formation of shallow source / drain and thin gate insulating films, that is, the formation of shallow junctions.
  • low-energy ion implantation technology in which ion implantation is performed with low implantation energy, has been adopted.In recent years, ion implantation at an extremely low energy of 0.2 keV is also possible. It is getting better.
  • ions are implanted deeply due to the channeling phenomenon.
  • ions that do not create electric carriers such as germanium, argon, silicon, xenon
  • pre-amorphous ion implantation techniques in which the surface of a semiconductor substrate is made to be in an amorphous state by implanting such ions in advance and then the desired ions are subsequently implanted.
  • the projected range of the ions is so shallow that the ions cannot reach the inside of the semiconductor substrate and are trapped in the natural oxide film formed on the substrate surface. is there.
  • the atoms trapped in the native oxide are removed together with the native oxide in a cleaning process following the ion implantation process.
  • an implanted ion dose remaining in the semiconductor substrate after cleaning is removed.
  • the dose (effective dose) will be less than the dose actually implanted or measured (calculated dose) in the ion implantation process.
  • the thickness of the native oxide film is affected by the process immediately before ion implantation and varies, so that the effective dose also varies.
  • the oxide film is removed by cleaning the surface of the semiconductor substrate immediately before carrying the semiconductor substrate into the ion implantation apparatus.
  • an object of the present invention is to provide an ion implantation method capable of accurately controlling an effective dose even in ion implantation at extremely low energy.
  • the present inventors have conducted intensive studies on the above-described conventional ion implantation process.
  • oxygen existing inside the ion implantation apparatus was ion beam-implanted into the semiconductor substrate. It was found that an oxide film was formed by implantation.
  • oxygen present in the ion implanter oxygen adsorbed on the surface of the semiconductor substrate during transport after cleaning, or oxygen adsorbed on the inner wall surface of the ion implanter, is generated by ion beam sputtering or beam scattering.
  • the oxygen film formed in the blaze-morphization implantation process like the native oxide film, also traps ions in the next process and is removed by the cleaning process after the ion implantation, thus affecting the effective dose. Was found to give.
  • the present invention has been made based on this finding, and has been described in which after performing pre-amorphization ion implantation to bring the surface of a semiconductor substrate into an amorphous state, Cleaning the surface of the semiconductor substrate on which the silicon ion implantation has been performed to remove an oxide film, and thereafter performing ion implantation under low implantation energy to form a shallow junction in the semiconductor substrate. .
  • This makes it possible to suppress the influence of the oxide film formed by the pre-amorphization ion implantation.
  • the semiconductor substrate is generally exposed to the air when ordinary equipment is used. Therefore, it is effective to make the time from cleaning to the start of low-energy ion implantation constant. In such a case, the amount of oxygen adhering to the semiconductor substrate becomes constant, and the thickness of the oxide film formed by low-energy ion implantation and, consequently, the amount of ions trapped therein become substantially constant. This is because the amount can be controlled more reliably.
  • the ion species used in the pre-amorphization ion implantation is preferably germanium, silicon, argon, or xenon.
  • the ion species used in the low energy ion implantation is preferably boron, and the implantation energy is preferably about 2 keV or less.
  • FIG. 1 is a schematic explanatory view showing equipment suitable for carrying out the ion implantation method according to the present invention.
  • FIG. 2 is a graph showing the sheet resistance values of the semiconductor substrates obtained in the example of the present invention and the comparative example.
  • FIG. 1 shows equipment of equipment capable of implementing the ion implantation method according to the present invention.
  • reference numeral 10 denotes an ion implantation apparatus
  • reference numeral 12 denotes a cleaning apparatus.
  • the ion implantation apparatus 10 according to the present embodiment is capable of performing ion implantation with an extremely low implantation energy of 5 keV or less, preferably I keV or less.
  • the ion implantation apparatus is manufactured by Applied Materials, Inc.
  • An ion implanter manufactured and sold under the trademark "mp lant xR LEAP" is preferred.
  • the “Implant xR LEAP” adopts a deceleration method in which the ion beam IB accelerated at the front stage of the beam line unit 14 is decelerated at the subsequent stage to lower the injection energy, and the 0.2 KeV pole is used. It has been confirmed that boron can be implanted with low energy.
  • the ion implantation section 16 in the illustrated ion implantation apparatus 10 includes a substrate holding wheel 18 disposed therein.
  • the substrate holding wheel 18 has a structure in which the semiconductor substrate W is held at the tips of a plurality of radially extending arms 20, and the ion beam IB from the beam line section 14 scans the surface of the semiconductor substrate W. It is driven to be able to do.
  • a loader section 24 is disposed adjacent to the ion implantation section 16 via a transfer tube 22.
  • An isolation valve 26 is interposed in the transfer tube 22 so that the ion implantation section 16 and the loader section 24 can be separated from each other. Therefore, only the loader section 24 is opened to the atmosphere while the vacuum of the ion implantation section 16 and the beam line section 14 is maintained, and the semiconductor substrate W can be carried into the loader section 24 from outside the ion implantation apparatus 10. .
  • the transfer of the semiconductor substrate W between the loader unit 24 and the ion injection unit 16 is performed by a robot (not shown).
  • the cleaning device 12 is installed near the ion implanter 10 in the same clean room as the ion implanter 10.
  • this cleaning device 1 2 is a loader section for transferring the semiconductor substrate W to / from the outside of the apparatus, a cleaning section for cleaning and removing an oxide film from the surface of the semiconductor substrate W, and a rinsing section for removing a cleaning chemical. And a drying unit.
  • the cleaning chemical used for removing the oxide film is generally hydrofluoric acid, and the rinsing liquid is ultrapure water.
  • the drying section is preferably one that performs drying by blowing nitrogen gas, for example, in order to prevent re-formation of a natural oxide film.
  • the cleaning device 12 is configured such that the semiconductor substrate W carried into the loader section does not come into contact with the atmosphere at all until returning to the loader section through a series of cleaning, rinsing and drying processes. Those are preferred.
  • a pre-amorphous ion implantation process using germanium is performed using the above-described ion implantation apparatus 10, and then a low-polarity energy-ion implantation process using boron is performed. It is to be formed.
  • the semiconductor substrate W to be processed is cleaned in the cleaning section of the cleaning device 12 to remove a natural oxide film formed on the substrate surface.
  • the washed semiconductor substrate W is rinsed with ultrapure water in a rinsing section, and then sufficiently dried in a drying section and returned to the loader section.
  • the semiconductor substrate W is transferred from the loader section of the cleaning apparatus 12 to the loader section 24 of the ion implantation apparatus 10. During this time, since the air contacts the surface of the semiconductor substrate W, a very small amount of oxygen is generated. Adsorbed on the substrate surface.
  • the pressure in the loader section 24 is reduced, and the isolation valve 26 of the transfer tube 22 is opened. Thereafter, the semiconductor substrate W is transferred from the transfer tube 22 to the ion injection section 16 by the robot, and is held at the tip of each arm 20 of the substrate holding wheel 18.
  • germanium ions are implanted to make the surface of the semiconductor substrate W amorphous.
  • the pre-amorphization implantation process is intended to prevent channeling in the subsequent boron ion implantation process, as described above.
  • oxygen on the surface of the semiconductor substrate is implanted into the semiconductor substrate W by irradiation with the germanium ion beam IB, and an oxide film is formed, although very little.
  • the present invention is characterized in that a cleaning process is performed again after the pre-amorphization implantation process is completed. That is, after returning the semiconductor substrate W to the loader section 24, the isolation valve 26 of the transfer tube 22 is closed to open only the loader section 24 to the atmosphere, and the semiconductor substrate W is cleaned by the cleaning device 1 2 Transfer to Then, the oxide film of the semiconductor substrate W is cleaned and removed in the same manner as in the above-described cleaning process, and rinsing and drying are performed.
  • Transport time is preferably constant.
  • the former is intended to significantly reduce or substantially eliminate the amount of oxygen adsorbed on the surface of the semiconductor substrate W.
  • the latter is intended to reduce the thickness of the oxide film formed in the next boron implantation process. This is to make the constant. If the drying section of the cleaning device 12 is in an environment where oxygen is present, the semiconductor substrate W is loaded into the loader portion 24 of the ion injection device 10 from the start of the drying process, and the pressure reduction of the loader portion 24 is completed. It is desirable to keep the time until 2 hours constant.
  • the semiconductor substrate W returned to the ion implanter 10 is held by the substrate holding wheel 18 of the ion implanter 16 through the same procedure as described above, and an extremely low-energy boron implantation step is performed.
  • the oral session begins.
  • This boron implantation process is performed in a state where the oxide film is not substantially formed on the substrate surface, so that the situation where the implanted boron is trapped by the oxygen film is almost eliminated.
  • oxygen adsorbed on the surface of the semiconductor substrate W forms an oxide film by ion implantation.
  • this process is performed with extremely low energy (for example, 2 keV or less).
  • the pre-amorphization implantation process performed at high energy eg, about 5 keV
  • a cleaning process is generally performed in the cleaning device 12, followed by an annealing process at a high temperature on the order of seconds to prevent accelerated diffusion due to point defects.
  • the oxide film formed during the boron implantation process and during the transport is removed. Accordingly, the boron trapped in the oxide film is also removed, so that the effective dose is slightly different from the amount actually implanted by the ion implanter (calculated dose).
  • the time for exposing the semiconductor substrate w to the atmosphere is constant, the thickness of the formed oxide film is also constant, so that even if the oxide film is removed, the effective dose and the calculated dose are reduced. Has a fixed relationship, and the effective dose can be more precisely controlled.
  • the ion implantation device and the cleaning device used in the method of the present invention are not limited to those shown in the drawings.
  • the ion species injected in the pre-amorphization implantation process is not limited to germanium, but may be ion species such as silicon, argon, and xenon that do not form an electric carrier. Not limited.
  • Example 1 the work was performed according to the procedure described in the above embodiment, and the implantation energy was set to drift from 2 keV to 0.2 keV in the boron implantation process. and, setting the calculated de one scan amount 1. 0 X 10 15 ions / cm 2.
  • the implantation energy was set to 5 keV and the calculated dose was set to 2.0 ⁇ 10 14 ions / cm 2 , and the pre-amorphization injection in Example 2 was performed. in the process, the injection Erunerugi scratch 5 ke V, set the calculation dose to 1. O xl O 1 5 ions / cm 2. Further.
  • Example 1 and Example 2 the time from the end of the cleaning process following the Blairmorphization injection process to the start of boron injection was fixed at 2 hours.
  • Comparative Example 1 and Comparative Example 2 were performed, in which the cleaning process after the preamorphization injection process was omitted and boron injection was continuously performed following the preamorphization injection process, as in the past.
  • the conditions of Comparative Examples 1 and 2 were the same as those of Examples 1 and 2, except that there was no cleaning process.
  • a comparative experiment (Comparative Example 3) was also performed in which the pre-amorphization implantation process using germanium ions was omitted and the boron implantation process was performed immediately after the pre-cleaning process.
  • FIG. 2 is a graph obtained by measuring the sheet resistance value Rs of each of the semiconductor substrates obtained in this manner and plotting the measured values. From FIG. 2, it can be seen that the sheet resistance values of the embodiment example 2 and the comparative example 3 are almost the same, and that the ratio of the cleaning process after the injection process for the formation of the amorphous phase is omitted. It can be seen that the sheet resistance values of Comparative Examples 1 and 2 are larger than those of Examples 1 and 2.
  • the sheet resistance increases as the dose of polon remaining on the surface of the semiconductor substrate decreases. Therefore, the reason why the sheet resistance values of Comparative Examples 1 and 2 are large is that part of the boron actually implanted is removed from the semiconductor substrate, which is presumed to be caused by the oxide film cleaning and removal. can do.
  • the reason why the sheet resistance value of the comparative example 2 is larger than that of the comparative example 1 is that the injection amount of germanium is larger in the comparative example 2 and a thicker oxide film is formed.
  • XPS X-ray-induced light spectroscopy
  • Comparative Example 3 no oxide film was formed by the pre-amorphization implantation, and therefore, the amount of boron removed by the post-treatment was extremely small. Therefore, since the sheet resistance value in Comparative Example 3 is substantially the same as the sheet resistance value in Examples 1 and 2, according to the method of the present invention, the oxide film formed by the pre-amorphization implantation is used. Has solved the problem of trapping boron and proved that a stable effective dose can always be obtained. Industrial applicability
  • the effective dose of boron or the like can be accurately controlled. This is to fully exploit the inherent controllability of the ion implanter, and to enable the high-precision profile control required for semiconductor devices manufactured through this ion implantation method, and to improve its characteristics. It contributes to stabilization and contributes to improvement of semiconductor manufacturing technology.

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Description

明糸田書
イオン注入方法
技術分野
本発明は、 半導体デバイスの製造プロセス等に用いられるイオン注入技術に関 し、 特に浅い接合を半導体基板内に形成するための低エネルギー ·イオン注入技 術に関するものである。
背景技術
近年の半導体デバイスの高集積化、 微細化の進展に伴い、 イオン注入プロセス においては、 浅いソースドレインの形成や薄いゲート絶縁膜の形成、 すなわち浅 い接合の形成が要請されている。 かかる要請に応えるため、 従来においては、 ィ オン注入を低注入エネルギーで行う低エネルギー ·イオン注入技術が採用されて おり、 近年では 0 . 2 k e Vという極低エネルギー下でのイオン注入も可能とな つてきている。
その一方で、 注入エネルギーを下げた場合には、 チャネリング現象によりィォ ンが深く注入されてしまうため、 これを防止するために、 電気キャリアを作らな いイオン、 例えばゲルマニウムやアルゴン、 シリコン、 キセノン等のイオンを予 め注入し、 半導体基板の表面をアモルファス状態にし、 その後、 続けて目的のィ オンを注入するといつたプレアモルファス化イオン注入技術も最近では行われる ようになっている。
しかし、 極低エネルギーのイオン注入においては、 イオンの投影飛程があまり に浅いためにイオンが半導体基板の中まで到達できずに、 基板表面に形成された 自然酸化膜内でトラップされることがある。 この自然酸化膜にトラップされた原 子は、 イオン注入プロセスに続く洗浄プロセスにおいて自然酸化膜と共に除去さ れる。 このメカニズムにより、 洗浄後に半導体基板中に残される注入イオンドー ズ量 （有効ドーズ量） は、 イオン注入プロセスにおいて実際に注入されたドーズ 量若しくは測定されたドーズ量 （計算ドーズ量） よりも少なくなつてしまう。 し かも、 自然酸化膜の厚さはイオン注入直前のプロセスにより影響を受けて変動す るため、 有効ドーズ量も変動してしまう。
このため、 従来においては、 半導体基板をイオン注入装置に搬入する直前に半 導体基板の表面を洗浄して酸化膜の除去を行うこととしている。
しかしながら、 上記プロセス、 すなわち半導体基板の洗浄 （酸化膜除去） を行 つた後にプレアモルファス化イオン注入と目的イオンの極低エネルギー ·イオン 注入を連続的に行うプロセスによっても、 実際には、 何らかの原因により有効ド —ズ量が変動することがある。 発明の開示
そこで、 本発明は、 極低エネルギーでのイオン注入においても有効ドーズ量を 正確に制御することのできるイオン注入方法を提供することを目的としている。 上記目的を達成するために、 本発明者は上記従来のイオン注入プロセスを鋭意 検討した結果、 プレアモルファス化イオン注入プロセスの際に、 イオン注入装置 の内部に存在する酸素がイオンビームにより半導体基板に打ち込まれて酸化膜が 形成されることを見いだした。 イオン注入装置内に存在する酸素としては、 洗浄 後の搬送中に半導体基板の表面に吸着したものや、 イオン注入装置の内壁面に吸 着していた酸素が、 イオンビームによるスパッ夕或はビームパヮ一等による加熱 により離脱或いは浮遊したもの等が考えられる。 そして、 このようにブレアモル ファス化注入プロセスにおいて形成された酸素膜も、 自然酸化膜と同様に次プロ セスでイオンをトラップし、 イオン注入後には洗浄プロセスによって除去される ため、 有効ドーズ量に影響を与えることを見いだした。
本発明は、 かかる知見に基づきなされたものであり、 半導体基板の表面をァモ ルファス状態とするプレアモルファス化イオン注入を行った後、 プレアモルファ ス化イオン注入が行われた前記半導体基板の表面を洗浄し酸化膜を除去し、 その 後に、 半導体基板に浅い接合を形成すベく低注入エネルギー下でイオン注入を行 うことを特徴としている。 これにより、 プレアモルファス化イオン注入により形 成された酸化膜の影響を抑制することが可能となる。
半導体基板の洗浄についてはフッ酸により行うことが有効である。
また、 半導体基板の洗浄後から低エネルギー ·イオン注入の開始までは、 通常 の設備を用いた場合、 半導体基板は大気に曝されるのが一般的である。 従って、 洗浄後から低エネルギー ·イオン注入開始までの時間を一定とすることが有効で ある。かかる場合、半導体基板に付着する酸素の量が一定となり、低エネルギー · イオン注入により形成される酸化膜の厚さ、 ひいてはそこにトラップされるィォ ンの量がほぼ一定となるため、 有効ドーズ量の制御をより確実に行うことができ るからである。
なお、 プレアモルファス化イオン注入で用いられるイオン種としては、 ゲルマ 二ゥム、 シリコン、 アルゴン又はキセノンが好ましい。 また、 低エネルギー 'ィ オン注入で用いられるイオン種はボロンとし、 注入エネルギーを約 2 k e V以下 とすることが好ましい。
本発明の上記及びその他の特徴や利点は、 添付図面を参照しての以下の詳細な 説明を読むことで、 当業者にとり明らかとなろう。 図面の簡単な説明
図 1は、 本発明によるイオン注入方法を実施するのに適した設備を示す概略説 明図である。
図 2は、 本発明の実施例と比較例で得られた半導体基板のシート抵抗値を示す グラフである。 発明を実施するための最良の形態 以下、 図面と共に本発明の好適な実施形態について詳細に説明する。
図 1は、 本発明によるイオン注入方法を実施することのできる設備の設備を示 し、 図中、 符号 10はイオン注入装置、 符号 1 2は洗浄装置を示すものである。 本実施形態におけるイオン注入装置 1 0は、 5 keV以下、 好ましくは I k eV 以下の極めて低い注入エネルギーでのイオン注入が可能なものであり、 例えばァ プライ ド ·マテリアルズ · インコーポレイテッドにより 「 I mp l ant xR LEAP」の商標で製造、 販売されているイオン注入装置が好ましい。 なお、 「I mp l ant xR L E A P」 は、 ビームライン部 14の前段で加速したィォ ンビーム I Bを後段で減速して注入エネルギーを下げるデセル方式を採用してお り、 0. 2 KeVの極低エネルギーでボロンの注入が可能であることが確認され ている。
図示のイオン注入装置 1 0におけるイオン注入部 1 6は、 その内部に配置され た基板保持ホイール 1 8を備えている。 基板保持ホイール 1 8は、 放射状に延び る複数本のアーム 20の先端に半導体基板 Wを保持する構造となっており、 ビ一 ムライン部 14からのイオンビーム I Bが半導体基板 Wの表面上をスキャンし得 るよう駆動される。
イオン注入部 1 6の隣接位置には搬送チューブ 2 2を介してローダ部 24が配 置されている。 搬送チューブ 22にはアイソレ一シヨンバルブ 26が介設されて おり、 イオン注入部 1 6とローダ部 24との間を分離することができるようにな つている。 従って、 イオン注入部 1 6及びビームライン部 14の真空を維持した まま、 ローダ部 24のみを大気に開放し、 イオン注入装置 1 0の外部から半導体 基板 Wをローダ部 24に搬入することができる。 なお、 ローダ部 24とイオン注 入部 1 6との間での半導体基板 Wの受け渡しはロボット （図示せず） により行わ れる。
洗浄装置 1 2はイオン注入装置 1 0の近傍に、 イオン注入装置 1 0と同じク リーンルーム内に設置されている。 図面では明示していないが、 この洗浄装置 1 2は、 装置外部との間で半導体基板 Wの受け渡しを行うためのローダ部と、 半導 体基板 Wの表面から酸化膜を洗浄除去するための洗浄部と、 洗浄薬液を除去する ためのリンス部と、 乾燥部とから構成された周知のものである。
酸化膜の除去を目的として用いられる洗浄薬液は一般にフッ酸であり、 リンス 液は超純水である。 また、 乾燥部は、 自然酸化膜の再形成を防止するために、 例 えば窒素ガスのブローにより乾燥を行うものが好ましい。 更に、 洗浄装置 1 2と しては、 ローダ部に搬入された半導体基板 Wが、 洗浄、 リンス及び乾燥の一連の プロセスを経て再度ローダ部に戻るまで、 大気に一切触れないよう構成されてい るものが好適である。
次に、 上述したような設備を用いた本発明によるイオン注入方法の一実施形態 について説明する。
本実施形態では、 上記のイオン注入装置 1 0を用いてゲルマニウムによるプレ アモルファス化イオン注入プロセスを行った後、 ボロンによる低極エネルギー - イオン注入プロセスを行い、 極浅い接合を半導体基板 （シリコンゥヱハ） Wに形 成することとする。
まず、 前処理として、 被処理対象である半導体基板 Wを洗浄装置 1 2の洗浄部 において洗浄し、 基板表面に形成されている自然酸化膜を除去する。 この洗浄さ れた半導体基板 Wはリンス部で超純水によりリンス処理された後、 乾燥部におい て十分に乾燥されてローダ部に戻される。 そして、 半導体基板 Wは洗浄装置 1 2 のローダ部からイオン注入装置 1 0のローダ部 2 4に移されるが、 この間に大気 が半導体基板 Wの表面に接触するため、 極微量ではあるが酸素が基板表面に吸着 される。
半導体基板 Wがイオン注入装置 1 0のローダ部 2 4に搬入されたならば、 ロー ダ部 2 4内が減圧され、 搬送チューブ 2 2のアイソレーションバルブ 2 6が開放 される。 この後、 ロボットにより半導体基板 Wは搬送チューブ 2 2からイオン注 入部 1 6に搬送されて、 基板保持ホイール 1 8の各アーム 2 0の先端に保持され る o
次に、 ゲルマニウムイオンを注入して、 半導体基板 Wの表面のアモルファス化 を図る。 プレアモルファス化注入プロセスは、 先に説明した通り、 続くボロンィ オン注入プロセスにおけるチヤネリング現象を防止するためのものである。 この プレアモルファス化注入プロセスにおいて、 半導体基板表面の酸素は、 ゲルマ二 ゥムイオンビーム I Bの照射により半導体基板 Wに打ち込まれ、 極僅かであるが 酸化膜を形成する。
以上の洗浄プロセス及びプレアモルファス化注入プロセスは従来と同様にして 行われる。
本発明においては、 プレアモルファス化注入プロセスの終了後、 再度、 洗浄プ 口セスを実施することを特徴としている。 すなわち、 半導体基板 Wをローダ部 2 4に戻した後、 搬送チューブ 2 2のアイソレーシヨンバルブ 2 6を閉じてローダ 部 2 4のみを大気に対して開放し、半導体基板 Wを洗浄装置 1 2に移す。そして、 上記の洗浄プロセスと同様にして半導体基板 Wの酸化膜を洗浄除去し、 リンス及 び乾燥を行う。
半導体基板 Wの乾燥が終了したならば、 再び半導体基板 Wをイオン注入装置 1 0に戻すのであるが、 この際、 半導体基板 Wを大気に露出する時間を可能な限り 短くすると共に、 その露出時間 （搬送時間） を一定にすることが好ましい。 前者 については、 半導体基板 Wの表面に吸着される酸素の量を大幅に低減ないしは実 質的にゼロとするためであり、 後者については、 次のボロン注入プロセスにおい て形成される酸化膜の厚さを一定にするためである。 洗浄装置 1 2の乾燥部が酸 素の存在する環境にあるならば、 乾燥プロセスの開始から半導体基板 Wをィォン 注入装置 1 0のローダ部 2 4に搬入しローダ部 2 4の減圧が完了するまでの時間 を、 2時間以内で一定とすることが望ましい。
イオン注入装置 1 0に戻された半導体基板 Wは、 上記と同じ手順を経てイオン 注入部 1 6の基板保持ホイール 1 8に保持され、 極低エネルギーのボロン注入プ 口セスが開始される。 このボロン注入プロセスは、 酸化膜が基板表面に実質的に 形成されていない状態で行われるため、 注入ボロンが酸素膜でトラップされると いう事態はほぼ解消される。 なお、 ボロン注入プロセス中にも、 半導体基板 Wの 表面に吸着された酸素がイオン注入によって酸化膜を形成するが、 このプロセス は極低エネルギー （例えば 2 k e V以下） で行われるため、 これよりも高工ネル ギ一 （例えば約 5 k e V ) で行われるプレアモルファス化注入プロセスの場合に 比して、 形成される酸化膜は無視することができる程度である。
ボロン注入プロセスの終了後、 一般的には、 洗浄装置 1 2において洗浄プロセ スが実施され、 続いて点欠陥による増速拡散を防止すべく、 高温で秒オーダーの ァニールプロセスが行われる。 洗浄プロセスにおいては、 ボロン注入プロセス中 及び搬送中に形成された酸化膜が除去される。 従って、 この酸化膜にトラップさ れたボロンも除去されるため、 有効ドーズ量はイオン注入装置で実際に注入され た量 （計算ドーズ量） と僅かに異なったものとなる。 しかしながら、 前述したよ うに半導体基板 wを大気に対して露出する時間を一定にすれば、 形成される酸化 膜の厚さも一定となるため、 酸化膜が除去されても有効ドーズ量と計算ドーズ量 とは一定の関係となり、 有効ドーズ量をより緻密に制御することが可能となる。 以上、 本発明の一実施形態について詳細に述べたが、 本発明は上記実施形態に 限定されることはない。 例えば、 本発明の方法に用いられるイオン注入装置や洗 浄装置は図示のものに限られない。 また、 プレアモルファス化注入プロセスで注 入されるイオン種もゲルマニウムに限られず、 シリコン、 アルゴン、 キセノン等 の電気キヤリアを作らないイオン種であってもよく、 浅い接合を形成するイオン についてもボロンに限定されない。 実施例
次に、 本発明の効果を検討するために行った実験の結果について図 2を参照し て説明する。 実験では、 アプライ ド 'マテリアルズ ·インコーポレイテッドにより 「Imp l ant xR LEAP」 の商標で製造、 販売されているイオン注入装置を用 いてイオン注入を行った。
本発明についての実験 （実施例 1及び実施例 2) では、 上記実施形態で説明し た手順に従って作業を行い、 ボロン注入プロセスでは注入エネルギーを 2 k eV から 0. 2 k e Vにドリフトするよう設定し、 計算ド一ス量を 1. 0 X 1015 ions/cm2に設定した。 また、 実施例 1におけるゲルマニウムイオンによるプレ アモルファス化注入プロセスでは、 注入エルネルギーを 5 k e V、 計算ドーズ量 を 2. 0 X 1014ions/cm2に設定し、 実施例 2におけるプレアモルファス化注 入プロセスでは、 注入エルネルギ一を 5 k e V、 計算ドーズ量を 1. O x l O 1 5 ions/cm 2に設定した。 更に。 実施例 1及び実施例 2において、 ブレアモルファ ス化注入プロセスに続く洗浄プロセスが終了した後、 ボロン注入が開始されるま での時間を 2時間一定とした。
また、 プレアモルファス化注入プロセス後の洗浄プロセスを省略し、 従来と同 様に、 プレアモルファス化注入プロセスに続けてボロン注入を連続的に実施する 比較実験 （比較例 1及び比較例 2) を行った。 なお、 比較例 1及び比較例 2は、 洗浄プロセスがない点を除き、 実施例 1及び実施例 2の条件と同じ条件とした。 ゲルマニウムイオンによるプレアモルファス化注入プロセスを省略し、 前処理の 洗浄プロセスの直後にボロン注入プロセスを実行する比較実験 （比較例 3) も行 つた。
更に、 実施例及び比較例のそれぞれにおいて、 ボロン注入プロセスが終了した 後、 半導体基板に対して後処理として洗浄プロセスを実行し、 950°Cで 10秒 間のァニールプロセスを実行した。 このようにして得られた各半導体基板につい てシート抵抗値 Rsを測定し、 その測定値をプロッ卜したグラフが図 2である。 図 2からは、 実施例 実施例 2及び比較例 3についてはシート抵抗値はほぼ 同じ値であり、 ブレアモルファス化注入プロセス後の洗浄プロセスを省略した比 較例 1及び比較例 2の場合には、 シート抵抗値が実施例 1， 2に比して大きくな つていることが分かる。
シート抵抗値は、 半導体基板表面に残っているポロンのドーズ量が少なければ 大きくなる。 従って、 比較例 1， 2のシート抵抗値が大きいのは、 実際に注入し たボロンの一部が半導体基板から除去されたためであり、 それは酸化膜の洗浄除 去に伴って生じたものと推定することができる。
なお、 比較例 2のシート抵抗値が比較例 1のものよりも大きいのは、 比較例 2 の場合の方がゲルマニウムの注入量が多く、 より厚い酸化膜が形成されたからと 考えられる。 実際に、 比較例 1， 2で得られた半導体基板に対して X線誘起光分 光分析 （X P S ) を行い、 表面の酸化膜の厚さを測定したところ、 比較例 1のも のは 1 7 ± 3オングストロームであり、 比較例 2のものは 2 1 ± 3オングスト口 —ムであった。
また、 比較例 3では、 プレアモルファス化注入による酸化膜の形成がなく、 従 つて後処理で除去されるボロンは極めて微量である。 よって、 この比較例 3にお けるシート抵抗値と実施例 1 , 2におけるシート抵抗値が実質的に同じであるこ とから、 本発明の方法によれば、 プレアモルファス化注入で形成された酸化膜が ボロンをトラップするという問題が解消され、 常に安定した有効ドーズ量が得ら れることが証明された。 産業上の利用可能性
以上述べたように、 本発明のイオン注入方法によれば、 半導体基板に浅い接合 を形成すべくボロン等を注入する場合、 ボロン等の有効ドーズ量を正確に制御す ることが可能となる。 これは、 イオン注入装置が本来有する制御能力を十分に発 揮させるものであり、 また、 このイオン注入方法を経て製造された半導体デバイ スで必要な高精度プロファイル制御を可能とし、 その特性の向上、 安定化に寄与 するものであり、 半導体製造技術の向上に貢献するものである。

Claims

言青求の範囲
1 . 半導体基板の表面をアモルファス状態とするプレアモルファス化イオン注 入を行う第 1ステップと、
ブレアモルファス化イオン注入が行われた前記半導体基板の表面を洗浄し酸化 膜を除去する第 2ステップと、
洗浄された前記半導体基板に浅い接合を形成すベく低注入エネルギー下でィォ ン注入を行う第 3ステップと
を含むことを特徴とするイオン注入方法。
2 . 前記第 2ステップにおける洗浄をフッ酸により行うことを特徴とする請求 項 1に記載のイオン注入方法。
3 . 前記第 2ステツプの終了時点から前記第 3ステツプの開始時点までの時間 を一定とすることを特徴とする請求項 1に記載のイオン注入方法。
4 . 前記第 1ステップにおけるプレアモルファス化イオン注入で用いられるィ オン種が、 ゲルマニウム、 シリコン、 アルゴン及びキセノンから成る群より選ば れた少なくとも 1つであることを特徴とする請求項 1に記載のイオン注入方法。
5 . 前記第 3ステップにおけるイオン注入で用いられるイオン種がボロンであ り、 注入エネルギーは約 2 k e V以下であることを特徴とする請求項 1に記載の イオン注入方法。
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Families Citing this family (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7135423B2 (en) 2002-05-09 2006-11-14 Varian Semiconductor Equipment Associates, Inc Methods for forming low resistivity, ultrashallow junctions with low damage
US20050260838A1 (en) * 2002-05-10 2005-11-24 Varian Semiconductor Equipment Associates, Inc. Methods and systems for dopant profiling
KR100739837B1 (ko) 2003-02-19 2007-07-13 마쯔시다덴기산교 가부시키가이샤 불순물 도입 방법 및 불순물 도입 장치
JP2005026442A (ja) * 2003-07-02 2005-01-27 Renesas Technology Corp 半導体装置の製造方法
US7566482B2 (en) 2003-09-30 2009-07-28 International Business Machines Corporation SOI by oxidation of porous silicon
US7981779B2 (en) 2003-10-09 2011-07-19 Panasonic Corporation Method for making junction and processed material formed using the same
JP2005223218A (ja) 2004-02-06 2005-08-18 Matsushita Electric Ind Co Ltd 不純物導入方法
CN1993806A (zh) * 2004-06-04 2007-07-04 松下电器产业株式会社 引入杂质的方法
DE102005063462B4 (de) * 2004-09-22 2017-10-12 Infineon Technologies Ag Verfahren zur Herstellung einer dotierten Zone in einem Halbleiterkörper
US7993465B2 (en) 2006-09-07 2011-08-09 Applied Materials, Inc. Electrostatic chuck cleaning during semiconductor substrate processing
US7642150B2 (en) * 2006-11-08 2010-01-05 Varian Semiconductor Equipment Associates, Inc. Techniques for forming shallow junctions
WO2009001592A1 (ja) 2007-06-25 2008-12-31 Ryobi Ltd. 電動工具
SG10201401425RA (en) 2009-04-13 2014-08-28 Applied Materials Inc Modification of magnetic properties of films using ion and neutral beam implantation
EP4102544A1 (de) * 2014-06-24 2022-12-14 EV Group E. Thallner GmbH Verfahren und vorrichtung zur oberflächenbehandlung von substraten
JP2018022715A (ja) * 2016-08-01 2018-02-08 株式会社Ｓｃｒｅｅｎホールディングス ドーパント導入方法
JP2019091923A (ja) * 2019-02-07 2019-06-13 エーファウ・グループ・エー・タルナー・ゲーエムベーハー 基板を表面処理するための方法及び装置

Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS632322A (ja) * 1986-06-23 1988-01-07 Shindengen Electric Mfg Co Ltd シリコン半導体における異方性エツチング面の突起物除去方法
JPH01212451A (ja) * 1988-02-20 1989-08-25 Sony Corp 半導体装置の製法
JPH02307277A (ja) * 1989-05-22 1990-12-20 Matsushita Electron Corp 不揮発性半導体装置の製造方法
JPH0396228A (ja) * 1989-09-08 1991-04-22 Fujitsu Ltd イオン注入方法
JPH03248419A (ja) * 1990-02-26 1991-11-06 Mitsubishi Electric Corp 半導体製造装置
JPH0536618A (ja) * 1991-08-02 1993-02-12 Mitsubishi Electric Corp 半導体製造装置
JPH06232390A (ja) * 1993-01-29 1994-08-19 Nippon Steel Corp 半導体装置のポリサイド配線の製造方法
JPH08115907A (ja) * 1994-10-14 1996-05-07 Nec Corp 半導体装置の製造方法
JPH08293465A (ja) * 1995-04-21 1996-11-05 Nec Corp 半導体装置の製造方法

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5266510A (en) * 1990-08-09 1993-11-30 Micron Technology, Inc. High performance sub-micron p-channel transistor with germanium implant
JPH07263358A (ja) * 1994-03-25 1995-10-13 Ulvac Japan Ltd ドープトアモルファスシリコン膜の形成方法およびその形成装置
US6037640A (en) * 1997-11-12 2000-03-14 International Business Machines Corporation Ultra-shallow semiconductor junction formation
US6313505B2 (en) * 1998-09-02 2001-11-06 Advanced Micro Devices, Inc. Method for forming shallow source/drain extension for MOS transistor

Patent Citations (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS632322A (ja) * 1986-06-23 1988-01-07 Shindengen Electric Mfg Co Ltd シリコン半導体における異方性エツチング面の突起物除去方法
JPH01212451A (ja) * 1988-02-20 1989-08-25 Sony Corp 半導体装置の製法
JPH02307277A (ja) * 1989-05-22 1990-12-20 Matsushita Electron Corp 不揮発性半導体装置の製造方法
JPH0396228A (ja) * 1989-09-08 1991-04-22 Fujitsu Ltd イオン注入方法
JPH03248419A (ja) * 1990-02-26 1991-11-06 Mitsubishi Electric Corp 半導体製造装置
JPH0536618A (ja) * 1991-08-02 1993-02-12 Mitsubishi Electric Corp 半導体製造装置
JPH06232390A (ja) * 1993-01-29 1994-08-19 Nippon Steel Corp 半導体装置のポリサイド配線の製造方法
JPH08115907A (ja) * 1994-10-14 1996-05-07 Nec Corp 半導体装置の製造方法
JPH08293465A (ja) * 1995-04-21 1996-11-05 Nec Corp 半導体装置の製造方法

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
See also references of EP1096552A4 *

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Publication number Publication date
JP2000012481A (ja) 2000-01-14
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EP1096552A4 (en) 2001-11-07

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