TWI658700B - 積體電路、多通道傳輸裝置及其信號傳輸方法 - Google Patents
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Abstract
一種積體電路、多通道傳輸裝置及其信號傳輸方法。多通道傳輸裝置包括前級電路、時脈信號產生器以及後級電路。前級電路接收多個第一時脈信號以及多個資料信號,選擇第一時脈信號的其中之一以作為基準時脈信號,依據基準時脈信號以傳送資料信號並分別產生多個中繼信號。時脈信號產生器依據第二時脈信號以產生第一時脈信號,其中,第二時脈信號的頻率高於第一時脈信號的頻率。後級電路依據第二時脈信號以傳送中繼信號以分別產生多個輸出信號。其中,前級電路為數位電路,後級電路為類比電路。
Description
本發明是有關於一種積體電路、多通道傳輸裝置以及其信號傳輸方法,且特別是有關於一種降低資料傳輸偏移(skew)的積體電路、多通道傳輸裝置以及其信號傳輸方法。
隨著電子科技的進步,電子設備成為人們生活中的重要工具。電子設備中的積體電路常藉由多通道傳輸裝置的設置,用以提供高頻寬的資料傳輸能力。
然而,在多通道傳輸裝置中,經常可能產生資料傳輸的偏移(skew)而造成資料傳輸的延遲。資料傳輸的偏移可能肇因於多通道間時脈信號傳輸導線的走線差異、多通道之間類比電路與高速(序列)時脈信號與除頻後慢速(並列)時脈信號的相位差異以及跨區的時脈信號(Clock Domain Crossing, CDC)的差異等因素。
特別是,當發生亞穩態(metastability)狀態時,多通道傳輸裝置可能產生的資料傳輸偏移會被擴大,造成更嚴重的資料傳輸延遲。
本發明提供一種積體電路、多通道傳輸裝置以及其信號傳輸方法,可有效減低資料傳輸時所產生的傳輸延遲。
本發明的多通道傳輸裝置包括前級電路、時脈信號產生器以及後級電路。前級電路接收多個第一時脈信號以及多個資料信號,選擇第一時脈信號的其中之一以作為基準時脈信號,依據基準時脈信號以傳送資料信號並分別產生多個中繼信號。時脈信號產生器接收第二時脈信號,依據第二時脈信號以產生一時脈信號,其中,第二時脈信號的頻率高於第一時脈信號的頻率。後級電路耦接前級電路以及時脈信號產生器,依據第二時脈信號以傳送中繼信號以分別產生多個輸出信號。其中,前級電路包括並列旗標信號同步電路。並列旗標信號同步電路接收旗標信號,並依據基準時脈信號同步旗標信號以產生第一同步旗標信號,其中,前級電路結合第一同步旗標信號至各中繼信號中,並傳送至後級電路。其中,前級電路為數位電路,後級電路為類比電路。
本發明的積體電路包括多通道傳輸裝置。多通道傳輸裝置包括如前所述的時脈信號產生器、至少一如前所述的前級電路以及至少一如前所述的後級電路。
本發明的多通道信號傳輸方法包括:提供前級電路以接收多個第一時脈信號以及多個資料信號,選擇第一時脈信號的其中之一以作為基準時脈信號,並依據基準時脈信號以傳送資料信號並分別產生多個中繼信號;提供時脈信號產生器以依據第二時脈信號以產生第一時脈信號,其中第二時脈信號的頻率高於第一時脈信號的頻率;提供後級電路以依據第二時脈信號以傳送中繼信號以分別產生多個輸出信號;以及,使前級電路接收旗標信號,並依據基準時脈信號同步旗標信號以產生第一同步旗標信號,其中,前級電路結合第一同步旗標信號至各中繼信號中,並傳送至後級電路。其中,該前級電路為數位電路,該後級電路為類比電路。
基於上述,本發明透過將多通道傳輸裝置區分為數位電路的前級電路以及類比電路的後級電路。並透過使為類比電路的後級電路基於相對高頻率的第二時脈信號來進行資料傳輸的動作。如此一來,即使發生亞穩態(metastability)狀態時,也可有效降低所可能產生的資料傳輸偏移(skew),並提升資料傳輸的速度。
為讓本發明的上述特徵和優點能更明顯易懂,下文特舉實施例,並配合所附圖式作詳細說明如下。
請參照圖1,圖1繪示本發明一實施例的多通道傳輸裝置的示意圖。多通道傳輸裝置100包括前級電路110、後級電路120以及時脈信號產生器130。前級電路110耦接至時脈信號產生器130。前級電路110接收一多通道時脈CKx(p)與一多通道資料DTx(p),其中多通道時脈CKx(p)包含多個第一時脈信號PMAD_CK0~PMAD_CKN,多通道資料DTx(p)包含多個並列的資料信號DT0~DTN。前級電路110選擇多通道時脈CKx(p)其中之一的第一時脈信號PMAD_CK0~PMAD_CKN作為基準時脈信號。前級電路110依據基準時脈信號用以接收多通道資料DTx(p)以及輸出一多通道中繼信號MSx(p),其中,多通道中繼信號MSx(p)包含多個並列的中繼信號MS0~MSN。
後級電路120耦接至前級電路110以及時脈信號產生器130。後級電路120依據第二時脈信號CK(s)用以接收多通道中繼信號MSx(p),以及輸出一多通道輸出信號TXPNx(s),其中多通道輸出信號TXPNx(s)包含多個序列的輸出信號TXPN0~TXPNN。而時脈信號產生器130用以接收第二時脈信號CK(s),並依據第二時脈信號CK(s)以產生多通道時脈CKx(p)。其中,多通道時脈CKx(p)的頻率皆低於第二時脈信號CK(s)的頻率。
在本實施例中,時脈信號產生器130依據多個不同的除數對第二時脈信號CK(s)進行除頻動作,以產生多通道時脈CKx(p),其中,多通道時脈CKx(p)具有多個頻率相同且相位相異的第一時脈信號PMAD_CK0~PMAD_CKN。上述的除數可以是大於1的任意實數,沒有特別的限制。
值得注意的,在本實施例中,前級電路110為數位電路,後級電路120則為類比電路。並且,前級電路110選擇多通道時脈CKx(p)其中之一的第一時脈信號PMAD_CK0~PMAD_CKN作為基準時脈信號,並依據具有相對低頻率的基準時脈信號來進行多通道資料DTx(p)的傳送動作。由於前級電路110為數位電路,因此,前級電路110所產生的資料偏移(skew)狀態可以透過靜態時序分析(Static Timing Analysis, STA)的技術來得到控制。
另一方面,在後級電路120中,多通道中繼信號MSx(p)的傳輸動作則依據具有相對高頻率的第二時脈信號CK(s)來進行。如此一來,類比電路形式的後級電路120可以基於單一時脈信號來進行設計,可降低在設計上,為克服資料偏移(skew)狀態所產生的設計複雜度。並且,透過基於相對高頻率的第二時脈信號CK(s)來進行資料傳輸動作,即使在發生亞穩態(metastability)狀態的現象時,也可以使所產生的資料偏移的程度降至最低。
以下請參照圖2,圖2繪示本發明另一實施例的多通道傳輸裝置的電路示意圖。多通道傳輸裝置200包括前級電路210、後級電路220以及時脈信號產生器230。前級電路210包括多個數位傳輸通道LANE[0]~LANE[3]、並列旗標信號同步電路SYNC1(p)以及選擇器SEL(p)。數位傳輸通道LANE[0]~LANE[3]分別接收並列的資料信號DT0~DT3,其中,各資料信號DT0~DT3為具有多個位元的並列信號。選擇器SEL(p)接收由時脈信號產生器230所產生的多通道時脈CKx(p),並選擇多通道時脈CKx(p)其中之一的時脈信號以產生基準時脈信號CK(p)。
數位傳輸通道LANE[0]~LANE[3]分別具有正反器組211~214,正反器組211~214的輸入端分別接收資料信號DT0~DT3。正反器組211~214的時脈端與選擇器SEL(p)之間可設置(或不設置)適當的傳輸延遲電路DE1~DE3以使正反器組211~214依據基準時脈信號CK(p)所產生的觸發動作的時間點實質上相同。
正反器組211~214依據基準時脈信號CK(p)來進行資料信號DT0~DT3的資料傳輸動作,並分別在正反器組211~214的輸出端產生並列的中繼信號MS0~MS3。
在另一方面,並列旗標信號同步電路SYNC1(p)接收一旗標信號TXFLAG(p),並依據基準時脈信號CK(p)進行旗標信號TXFLAG(p)的同步動作以產生同步旗標信號FLAG(p),前述中的旗標信號TXFLAG(p)來源可為重置信號或啟動信號。並且,前級電路210結合同步旗標信號FLAG(p)至各中繼信號MS0~MS3中,並將結合後的信號傳送至後級電路220。
值得一提的,各正反器組211~214皆可具有多個正反器,其中各正反器組211~214中的正反器的數量可以與各資料信號DT0~DT3的位元數相符。
後級電路220包括多個分別對應於數位傳輸通道LANE[0]~LANE[3]的類比傳輸通道ALANE[0]~ALANE[3]。類比傳輸通道ALANE[0]~ALANE[3]分別包括正反器組221~224、序列旗標信號同步電路SYNC2~SYNC5、並列序列信號轉換電路250~253以及輸出級正反器225~228。
正反器組221~224分別對應耦接於正反器組211~214與並列旗標信號同步電路SYNC1(p),並分別用以接收中繼信號MS0~MS3以及同步旗標信號FLAG(p)。正反器組221~224依據基準時脈信號CK(p)用以傳送中繼信號MS0~MS3以及同步旗標信號FLAG(p)至後級電路220的序列旗標信號同步電路SYNC2~SYNC5與並列序列信號轉換電路250~253。前述中,每一正反器組221~224中的正反器數量實質上大於每一正反器組211~214中的正反器數量。值得一提的,正反器組221~224的時脈端上可分別設置適當的傳輸延遲電路DE4~DE7,以調整正反器組221~224的被觸發時間點實質上相同。
在本實施例中,正反器組221~224分別對應產生第一資料信號DP0~DP3以及旗標DP_FLAG0 ~ DP_FLAG3,其中,各第一資料信號DP0~DP3為具有多個位元的並列信號。第一資料信號DP0~DP3分別被傳送至並列序列信號轉換電路250~253,旗標DP_FLAG0~DP_FLAG3則分別被傳送至序列旗標信號同步電路SYNC2~SYNC5。序列旗標信號同步電路SYNC2~SYNC5依據第二時脈信號CK(s)以分別針對旗標DP_FLAG0~DP_FLAG3進行同步,並分別產生多個同步旗標信號FLAG(s)。在此請注意,序列旗標信號同步電路SYNC2~SYNC5接收第二時脈信號CK(s)的路徑間,可透過設置(或不設置)適當的傳輸延遲電路DEA8~DEA10來使序列旗標信號同步電路SYNC2~SYNC5的被觸發時間點實質上相同。其中,在本實施例中,傳輸延遲電路DEA8~DAE10所提供的時間延遲的長短可以全相同、全不相同或部分相同,並可由設計者依據電路的布局、製程參數以及運作狀態來設定,沒有特別的限制。
承續上述的說明,並列序列信號轉換電路250~253分別接收第一資料信號DP0~DP3、同步旗標信號FLAG(s)以及第二時脈信號CK(s)。各並列序列轉換電路250~253依據所接收的同步旗標信號FLAG(s)來設定轉換動作的起始時間點,並依據第二時脈信號CK(s)以分別依序傳輸各第一資料信號DP0~DP3的各個位元以分別產生第二資料信號DS0~DS3。其中,第二資料信號DS0~DS3為序列信號。
第二資料信號DS0~DS3分別被傳輸至輸出級正反器225~228。輸出級正反器225~228並依據第二時脈信號CK(s)來分別傳輸第二資料信號DS0~DS3以產生輸出信號TXPN0~TXPN3。值得一提的,輸出級正反器225~228的時脈端接收第二時脈信號CK(s)的路徑間,可配置(或不配置)適當的傳輸延遲電路(例如傳輸延遲電路DE11~DE13),以調整輸出級正反器225~228的被觸發時間點實質上相同。
在另一方面,時脈信號產生器230可以由一個或多個除頻器來建構,其中時脈信號產生器230可以提供多個除數,以針對第二時脈信號CK(s)進行除頻並產生具有多個頻率相同且相位相異的第一時脈信號PMAD_CK0~PMAD_CKN的多通道時脈CKx(p)。關於除頻器的硬體架構,可依本領域具通常知識者所熟知的除頻器架構來實施,沒有特定的限制。
值得一提的,本發明實施例中,前級電路210並非單純透過傳輸導線將同步旗標信號FLAG(p)傳送至後級電路220,而是應用正反器組221~224以依據基準時脈信號CK(p)來傳送至後級電路220。如此一來,後級電路220所獲得的旗標DP_FLAG0~DP_FLAG3其時間延遲可以獲得很好的控制,降低可能產生的資料偏移。
請參照圖3繪示的時脈信號的波形示意圖。時脈信號產生器230接收相對高頻率的,並透過除頻產生相對低頻率的多通道時脈CKx(p)。在本實施例中,第二時脈信號CK(s)的頻率可以為多通道時脈CKx(p)的頻率的兩倍。當然,在本發明其他實施例中,第二時脈信號CK(s)的頻率可以為多通道時脈CKx(p)的頻率的A倍,A為大於1的任意實數。
另外,第二時脈信號CK(s)可以透過鎖相迴路電路來產生。其中,鎖相迴路電路可接收源時脈信號,並針對源時脈信號進行倍頻動作以產生第二時脈信號CK(s)。在此,本發明實施例中可應用本領域具通常知識者所熟知的鎖相迴路電路來實施,沒有特別的限制。
請重新參照圖2,附帶一提的,關於上述本實施例中的傳輸延遲電路,可以透過一個或多個串接的緩衝器或反向器,或其他任意可提供時間延遲的半導體元件來實施,沒有特定的限制。此外,並列旗標信號同步電路SYNC1可以利用數位形式的正反器來建構,序列旗標信號同步電路SYNC2~SYNC4則可以利用類比形式的正反器來建構。
依據上述的說明可以得知,在本發明實施例中,前級電路210可透過靜態時序分析的方式,在溫度、電壓以及製程漂移的影響下,使其產生的資料偏移不大於500皮秒(picosecond)。更值得一提的,在後級電路220基於第二時脈信號CK(s)以進行資料傳輸的前提下,後級電路220所可能產生的資料偏移,可不大於兩倍的UI(Unit Interval),其中UI等於第二時脈信號CK(s)的週期。
以下請參照圖4,圖4繪示本發明實施例的並列序列信號轉換電路的實施方式的示意圖。並列序列信號轉換電路400包括多個暫存器410、選擇器420以及移位計數器430。多個暫存器410分別接收第一資料信號DP0的多個位元。暫存器410的輸出端耦接至選擇器420。移位計數器430接收同步旗標FLAG(s)以及第二時脈信號CK(s)。移位計數器430依據同步旗標FLAG(s)以啟動計數動作,並依據第二時脈信號CK(s)執行計數動作以產生一計數結果。選擇器420依據移位計數器430的計數結果以依序選擇多個暫存器410的其中之一所儲存的資料以進行輸出,並藉以產生第二資料信號DS0。
接著請參照圖5,圖5繪示本發明一實施例的積體電路的示意圖。積體電路500包括核心電路501以及多通道傳輸裝置510。多通道傳輸裝置510耦接至核心電路501,用以傳輸核心電路501中所產生的資料信號。多通道傳輸裝置510包括時脈信號產生器513、前級電路511、521以及後級電路512、522。前級電路511耦接至後級電路512,前級電路521耦接至後級電路522。其中,積體電路500中可設置的前級電路、後級電路的數量可以為一組或多組,沒有特別的限制。
關於時脈信號產生器513、前級電路511、521以及後級電路512、522的實施細節,在前述的實施例中已有詳盡的說明,在此恕不多贅述。
請參照圖6,圖6繪示本發明實施例的多通道信號傳輸方法的流程圖。步驟S610提供一前級電路以接收多個第一時脈信號以及多個資料信號,選擇第一時脈信號的其中之一以作為基準時脈信號,並依據基準時脈信號以傳送資料信號並分別產生多個中繼信號;步驟S620提供時脈信號產生器以依據第二時脈信號以產生第一時脈信號,其中,第二時脈信號的頻率高於第一時脈信號的頻率;步驟S630提供後級電路以依據第二時脈信號以傳送中繼信號以分別產生多個輸出信號;以及,步驟S640提供前級電路以接收一旗標信號,並依據基準時脈信號同步旗標信號以產生第一同步旗標信號。其中,前級電路結合第一同步旗標信號至各中繼信號中,並傳送至後級電路。在本實施例中,前級電路為數位電路,後級電路為類比電路。
關於上述步驟的實施細節,在前述的實施例及實施方式已有詳細的說明,在此恕不多贅述。
綜上所述,本發明使多通道傳輸裝置中,類比電路形式的後級電路內部一致性的依據具有相對高頻率的第二時脈信號來進行資料信號傳輸的動作,可有效降低所可能發生的資料偏移的程度。並且,在發生亞穩態狀態的情況下,資料偏移的程度也可以有效的倍降低。
雖然本發明已以實施例揭露如上,然其並非用以限定本發明,任何所屬技術領域中具有通常知識者,在不脫離本發明的精神和範圍內,當可作些許的更動與潤飾,故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
100、200‧‧‧多通道傳輸裝置
110、210‧‧‧前級電路
120、220‧‧‧後級電路
130、230‧‧‧時脈信號產生器
CKx(p)‧‧‧多通道時脈
DTx(p)‧‧‧多通道資料
PMAD_CK0~PMAD_CKN‧‧‧第一時脈信號
DT0~DTN‧‧‧資料信號
MSx(p)‧‧‧多通道中繼信號
TXPNx(s)‧‧‧多通道輸出信號
MS0~MSN‧‧‧中繼信號
CK(s)‧‧‧第二時脈信號
TXPN0~TXPNN‧‧‧輸出信號
LANE[0]~LANE[3]‧‧‧數位傳輸通道
SYNC(p)‧‧‧並列旗標同步電路
SYNC2~SYNC5‧‧‧序列旗標信號同步電
SEL(p)‧‧‧選擇器
CK(p)‧‧‧基準時脈信號
211~214、221~224‧‧‧正反器組
DE1~DE7、DEA8~DEA11、DEA1‧‧‧傳輸延遲電路
ALANE[0]~ALANE[3]‧‧‧類比傳輸通道
251~254、400‧‧‧並列序列信號轉換電路
225~228‧‧‧輸出級正反器
TXFLAG(p)‧‧‧旗標信號
DP_FLAG0 ~ DP_FLAG3‧‧‧旗標
DS0~DS3‧‧‧第二資料信號
410‧‧‧暫存器
420‧‧‧選擇器
430‧‧‧移位計數器
FLAG(s)、FLAG(p)‧‧‧同步旗標信號
500‧‧‧積體電路
501‧‧‧核心電路
510‧‧‧多通道傳輸裝置
511、521‧‧‧前級電路
512、522‧‧‧後級電路
S610~S640‧‧‧多通道資料傳輸方法的步驟
圖1繪示本發明一實施例的多通道傳輸裝置的示意圖。 圖2繪示本發明另一實施例的多通道傳輸裝置的電路示意圖。 圖3繪示時脈信號的波形示意圖。 圖4繪示本發明實施例的並列序列信號轉換電路的實施方式的示意圖。 圖5繪示本發明一實施例的積體電路的示意圖。 圖6繪示本發明實施例的多通道信號傳輸方法的流程圖。
Claims (21)
- 一種多通道傳輸裝置,包括:一前級電路,接收多個第一時脈信號以及多個資料信號,選擇該些第一時脈信號的其中之一以作為一基準時脈信號,依據該基準時脈信號以傳送該些資料信號並分別產生多個中繼信號;一時脈信號產生器,接收一第二時脈信號,依據該第二時脈信號以產生該些第一時脈信號,其中該第二時脈信號的頻率高於該些第一時脈信號的頻率;以及一後級電路,耦接該前級電路以及該時脈信號產生器,依據該第二時脈信號以傳送該些中繼信號以分別產生多個輸出信號,其中,該前級電路包括:一並列旗標信號同步電路,接收一旗標信號,並依據該基準時脈信號同步該旗標信號以產生一第一同步旗標信號,其中,該前級電路結合該第一同步旗標信號至各該中繼信號中,並傳送至該後級電路,其中,該前級電路為數位電路,該後級電路為類比電路。
- 如申請專利範圍第1項所述的多通道傳輸裝置,其中該前級電路更包括:多個數位傳輸通道,分別接收該些資料信號,依據該基準時脈信號傳送該些資料信號以分別產生該些中繼信號,其中,各該資料信號以及各該中繼信號為具有多位元的並列信號。
- 如申請專利範圍第1項所述的多通道傳輸裝置,其中該後級電路包括:多個類比傳輸通道,分別接收該些中繼信號,依據該第二時脈信號傳送該些中繼信號以產生該些輸出信號,其中各該輸出信號為依據該第二時脈信號所產生的序列信號。
- 如申請專利範圍第3項所述的多通道傳輸裝置,其中各該類比傳輸通道包括:一正反器組,接收各該中繼信號以及該第一同步旗標信號,依據該基準時脈信號以產生多個第一資料信號以及一旗標;一序列旗標信號同步電路,依據該第二時脈信號同步該第一同步旗標信號以產生一第二同步旗標信號;一並列序列信號轉換電路,基於該第二同步旗標信號,並依據該第二時脈信號以依序傳輸各該第一資料信號以產生一第二資料信號,其中,該第二資料信號為序列信號;以及一輸出級正反器,依據該第二時脈信號以同步該第二資料信號並產生對應的輸出信號。
- 如申請專利範圍第4項所述的多通道傳輸裝置,其中對應該些類比傳輸通道的該些旗標信號同步電路的被觸發時間點相同。
- 如申請專利範圍第4項所述的多通道傳輸裝置,其中各該類比傳輸通道更包括:一傳輸延遲電路,串接在該序列旗標信號同步電路接收該第二時脈信號的路徑間,用以調整該序列旗標信號同步電路的被觸發時間點。
- 如申請專利範圍第4項所述的多通道傳輸裝置,其中該並列序列信號轉換電路包括:多個暫存器,分別接收並暫存該些第一資料信號;一移位計數器,依據該第二同步旗標信號以啟動一計數動作,並依據該第二時脈信號執行該計數動作以產生一計數結果;以及一選擇器,耦接至該些暫存器,依據該計數結果以依序選擇該些暫存器分別儲存的該些第一資料信號的其中之一以進行輸出,並藉以產生該第二資料信號。
- 如申請專利範圍第4項所述的多通道傳輸裝置,其中各該類比傳輸通道更包括:一傳輸延遲電路,串接在該輸出級正反器接收該第二時脈信號的路徑間,用以調整該輸出級正反器的被觸發時間點。
- 如申請專利範圍第4項所述的多通道傳輸裝置,其中該些類比傳輸通道對應的該些輸出級正反器的被觸發時間點相同。
- 如申請專利範圍第1項所述的多通道傳輸裝置,更包括:一鎖相迴路電路,依據一源時脈信號以產生該第二時脈信號。
- 一種積體電路,包括:一多通道傳輸裝置,包括:至少一前級電路,接收多個第一時脈信號以及多個資料信號,選擇該些第一時脈信號的其中之一以作為一基準時脈信號,依據該基準時脈信號以傳送該些資料信號並分別產生多個中繼信號;一時脈信號產生器,接收一第二時脈信號,依據該第二時脈信號以產生該些第一時脈信號,其中該第二時脈信號的頻率高於該些第一時脈信號的頻率;以及至少一後級電路,耦接該至少一前級電路以及該時脈信號產生器,依據該第二時脈信號以傳送該些中繼信號以分別產生多個輸出信號,其中,該至少一前級電路包括:一並列旗標信號同步電路,接收一旗標信號,並依據該基準時脈信號同步該旗標信號以產生一第一同步旗標信號,其中,該前級電路結合該第一同步旗標信號至各該中繼信號中,並傳送至該至少一後級電路,其中,該至少一前級電路為數位電路,該至少一後級電路為類比電路。
- 如申請專利範圍第11項所述的積體電路,其中該至少一前級電路更包括:多個數位傳輸通道,分別接收該些資料信號,依據該基準時脈信號傳送該些資料信號以分別產生該些中繼信號,其中,各該資料信號以及各該中繼信號為具有多位元的並列信號。
- 如申請專利範圍第11項所述的積體電路,其中該至少一後級電路包括:多個類比傳輸通道,分別接收該些中繼信號,依據該第二時脈信號傳送該些中繼信號以產生該些輸出信號,其中各該輸出信號為依據該第二時脈信號所產生的序列信號。
- 如申請專利範圍第13項所述的積體電路,其中各該類比傳輸通道包括:一正反器組,接收各該中繼信號以及該第一同步旗標信號,依據該基準時脈信號以產生多個第一資料信號以及一旗標;一序列旗標信號同步電路,依據該第二時脈信號同步該第一同步旗標信號以產生一第二同步旗標信號;一並列序列信號轉換電路,基於該第二同步旗標信號,並依據該第二時脈信號以依序傳輸各該第一資料信號以產生一第二資料信號,其中,該第二資料信號為序列信號;以及一輸出級正反器,依據該第二時脈信號以同步該第二資料信號並產生對應的輸出信號。
- 如申請專利範圍第14項所述的積體電路,其中對應該些類比傳輸通道的該些旗標信號同步電路的被觸發時間點相同。
- 如申請專利範圍第14項所述的積體電路,其中各該類比傳輸通道更包括:一傳輸延遲電路,串接在該序列旗標信號同步電路接收該第二時脈信號的路徑間,用以調整該序列旗標信號同步電路的被觸發時間點。
- 如申請專利範圍第14項所述的積體電路,其中該並列序列信號轉換電路包括:多個暫存器,分別接收並暫存該些第一資料信號;一移位計數器,依據該第二同步旗標信號以啟動一計數動作,並依據該第二時脈信號執行該計數動作以產生一計數結果;以及一選擇器,耦接至該些暫存器,依據該計數結果以依序選擇該些暫存器分別儲存的該些第一資料信號的其中之一以進行輸出,並藉以產生該第二資料信號。
- 如申請專利範圍第14項所述的積體電路,其中各該類比傳輸通道更包括:一傳輸延遲電路,串接在該輸出級正反器接收該第二時脈信號的路徑間,用以調整該輸出級正反器的被觸發時間點。
- 如申請專利範圍第14項所述的積體電路,其中該些類比傳輸通道對應的該些輸出級正反器的被觸發時間點相同。
- 如申請專利範圍第11項所述的積體電路,其中該多通道傳輸裝置更包括:一鎖相迴路電路,依據一源時脈信號以產生該第二時脈信號。
- 一種多通道信號傳輸方法,包括:提供一前級電路以接收多個第一時脈信號以及多個資料信號,選擇該些第一時脈信號的其中之一以作為一基準時脈信號,並依據該基準時脈信號以傳送該些資料信號並分別產生多個中繼信號;提供一時脈信號產生器以依據一第二時脈信號以產生該些第一時脈信號,其中該第二時脈信號的頻率高於該些第一時脈信號的頻率;提供一後級電路以依據該第二時脈信號以傳送該些中繼信號以分別產生多個輸出信號;以及使該前級電路接收一旗標信號,並依據該基準時脈信號同步該旗標信號以產生一第一同步旗標信號,其中,該前級電路結合該第一同步旗標信號至各該中繼信號中,並傳送至該後級電路,其中,該前級電路為數位電路,該後級電路為類比電路。
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