TW531815B - Chip-scale packages stacked on folded interconnector for vertical assembly on substrates - Google Patents
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Description
531815 A7
經濟部智慧財產局員工消費合作社印製 【發明領域】 本發明一般係關於半導體元件與製程之領域,尤其關 於堆疊於供於基板上直立組裝之互連薄膜之上的晶片級封 裝之結構與製程。 5【發明背景】 關於多數半導體元件之應用而言,有利的狀況係為將 所需要元件配置成猪接狀悲’甚至是配置成群集。當僅需 要兩個或一些半導體晶片時,已經有人提出各種配置方 式,以達成希望之密接,並促使所需空間得以最小化。一 10般而言,這些配置係為半導體晶片在基板上之組裝,其可 具有或不具有具體封裝。關於這些配置,通常使用的用語 為’’多晶片模組”。關於被密封之組裝,已經導入之用語為 夕曰曰片封裝。在其他組裝中,晶片或完成之封裝係堆^ 於彼此之頂端,以形成連接元件之層次。 15 多年來,關於多晶片模組與多晶片封裝或堆疊元件, 已經有相當有限度的市場,但是在積體電路應用之急速膨 脹擴張之普及化所驅使之下,這種市場在近來的規模已經 大幅成長。為了打入這市場,多晶片產品必須符合數個條 件。 2〇 *多晶片產品必須提供在單晶片產品中無法獲得之消 費者性能特徵。這表示多晶片產品必須避開單晶片產品之 發展。 *多晶片產品必須在簡短通知之後可由消費者獲得。 這表示多晶片產品應使用輕易可利用的元件與製造方法。 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297 -------*---.-----------訂---------線 (請先閱讀背面之注意事項再填寫本頁) 3 經濟部智慧財產局員工消費合作社印製 531815 A7 B7 五、發明說明(2 ) *多晶片產品必須為消費者提供成本優勢。這表示多 晶片產品之設計與製造已經避免非習用或額外製程步驟。 *多晶片產品必須提供低擁有成本。這表示其必須基 於内建可靠度而確實運作。 5 在許多公開公報與專利中,已經說明了許多的多晶片 封裝。例如,美國專利4,862,322號公告,於1989年8 月29日發證給Bickford等人,名稱為”具有在每個元件 上無焊料接合在接觸位置之間之樑式引線,並從其間向外 凸出之雙重電子元件結構(Double Electronic Device ίο Structure having Beam Leads Solderlessly Bonded between Contact Locations on each Device and Projecting Outwardly from Therebetween)”,說明兩個晶片彼此面對之結構,其 中輸入/輸出端子係藉由樑式引線而接合。然而,材料、 製程與控制之高成本並不允許樑式引線技術變成主流之製 15 造方法。 > 在美國專利5,331,235號公告中,於1994年7月19 曰發證給H.S. Chun,名稱為”多晶片半導體組裝(Multi-Chip Semiconductor Package)” , 捲帶式自動接合塑 性膠帶 係用以將具有相同型式且彼此面對之兩個晶片互連成對。 20 這些對其中之一個或更多個係接著被組合成為密封封裝, 於其中塑性膠帶係連接至到達封裝外部之金屬引線,以形 成供表面安裝與基板附著用之引線或接腳。由於塑性膠帶 之高成本與捲帶式自動接合之批量處理之缺乏,使得技術 保持於半導體生產之最低限度。 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公釐) (請先閱讀背面之注意事項再填寫本頁) ------- —訂---------線· 531815 經濟部智慧財產局員工消費合作社印製 A7 B7 五、發明說明(3) 數個提案已由多晶片元件所達成,其中兩個以上的晶 片係並列配置,裝設至支撐基板或至引線框焊墊。一個例 子係為美國專利5,3 52,632號公告,於1994年10月4曰 發證給H. Sawaya,名稱為”多晶片封裝之半導體元件與 5 其製造方法(Multichip Packaged Semiconductor Device and Method for Manufacturing the Same)”。通常具有不同型式 之晶片,係首先藉由撓性樹脂膠帶而交互連接,然後密封 至樹脂構件封裝中。膠帶係黏貼至金屬引線,這些金屬引 線亦從封裝凸出以供習知之表面安裝使用。另一例子係為 ίο 美國專利5,373,188號公告,於1994年12月13日發證 給Michii等人,名稱為”包含多重半導體晶片與交叉引線 之封裝半導體元件(Packaged Semiconductor Device including Multiple Semiconductor Chips and Cross-over Lead)”。通常具有不同型式之晶片,係裝設至引線框晶片 15 焊墊;它們的輸入/輸出端子係打線至引線框之内部引線。 此外,其他引線係使用於半導體晶片之上或下,以便將無 法藉由長跨越的引線接合而到達之接點予以互連。最後, 此組裝係被密封於塑膠封裝中。在這兩個例子中,因為晶 片係並列安置,所以最終產品體積大。相較之下,今日之 20 應用需要經常收縮之半導體產品,並希望使基板消耗最小 化。 美國專利5,438,224號公告,於1995年8月1曰發 證給Papageorqe等人,名稱為’’具有面對面之1C晶片配 置之積體電路封裝(Integrated Circuit Package having a 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公釐) -----U----Γ----------訂---------線 0^ (請先閱讀背面之注意事項再填寫本頁) 經濟部智慧財產局員工消費合作社印製 531815 A7 B7 五、發明說明(4 )
Face-to-Face IC Chip Arrangement)’’),揭露一種具有位於 電路基板之堆疊1C晶片配置之積體電路(1C)封裝。兩個 晶片係面對面地安置,憑藉著由捲帶式自動接合帶或介設 於晶片之間的彎曲電路所構成之基板,以提供倒裝晶片之 5 接點與外部電路之間的電氣連接,此組裝需要一種分離式 機械支撐。除了這種成本以外,製造困難度是由於缺少對 晶片之剛性支撐所造成。 美國專利5,770,480號公告,於1998年6月23曰發 證給Ma等人,名稱為’’晶片間之引線之組裝方法(Method ίο of Leads between Chips Assembly)”),係藉由教導引線框 手指之使用,以附著至採用焊料或導電凸塊之多重晶片之 6焊墊,而增加了 1C密度。而於較佳實施例中,一組的兩 片晶片之功能相同,此方法亦可延伸至具有不同焊墊配置 之晶片。然而,於此情況下,引線框需要引線手指之客製 15 化構造與非均勻長度,尤其因為除了焊接配線之使用以外 更是如此。這些所謂的晶片間之可變引線之製造,係具有 昂貴的引線框製造設備與技術。此外,需要鈍化層使其配 置於兩個晶片與客製化引線手指之間,以便避免電氣短 路,因而添加更多材料與製程成本。 2〇 與本發明相關之美國專利6,084,778號公告,於2000 年7月4日發證給Malhi,名稱為”使用撓性接線板之三 維組裝(Three-dimensional Assembly using Flexible Wiring Board)’’,說明了一種於其上具有互連圖案,並具有連接 至互連處之複數個電氣元件之撓性片。撓性印刷接線板係 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公釐) ------1 —. —4^衣--------訂---------線 (請先閱讀背面之注意事項再填寫本頁) 經濟部智慧財產局員工消費合作社印製 531815 五、發明說明(t ) 本身折疊回來,6提供三維電路。然而,此專利並沒有處 理將晶片級封裝之微間距焊墊圖案轉換成將焊球裝設至其 他部分所希望之典型的較大間距之需求,其亦沒有提供使 用撓性之連接器作為它們的封裝設計之一部份之積體電路 5 裝置。 在與本發明相關之兩個最近美國專利申請案中:(J) 申請案號60/172,186,申請日為12/17/1999,發明人為 Rolda等人,名稱為”多重倒裝晶片之半導體組裝(Multi_
Flip-Chip Semiconductor assembly)’’);以及(2)申請案號 ίο 6〇/249,385,申請曰為11/16/2000,發明人為c〇yle等人, 名稱為’’位於薄膜組裝上之倒裝晶片之球柵陣列封裝,,), 已說明關於使用焊球之典型間距至使用金凸塊之精細節距 的倒裝晶片組裝技術。然而,這些方法在產品組裝與擁有 成本仍然太昂貴。成本近來已經變成半導體市場之優勢驅 15動力量,特別對於使用晶片級元件之產品*更是如此。 因此,已經出現用以製造多晶片封裝之有條理的低成 本方法之迫切需求,而此方法乃是基於可利用且經過證明 的組裝與封裝技術。此方法應具有足夠之彈性,以便能應 用至不同半導體產品家族,而設計與製程變化之寬廣範 20圍’不應增加額外成本至既存的製造方法,並能完成高品 質與高可靠度之產品。較佳的情況是,這些改革應該在縮 短生產周期時間與增加產能的況下同時達成。 【發明之概述】 一種半導體元件之直立堆疊係藉由以下方式而形成·· --------^---------^ (請先閱讀背面之注咅?事項再填寫本頁) 531815 15 20 A7 五、發明說明(6 :【二 及,、封裝及/或被動元件組合之條 接时,及衣故可焊接的連接構件至其他部分。 本發月"兒明冑半導體組裝,其包含—個電氣絕緣材 料之條狀撓性之連接器,並具有第一與第二表面。連接器 5 =第—表面上具有複數條導電線1以將形成於第-表 彳:被此鄰接的複數個半導體元件連接。連接器更具有 J :攸其第一表面延伸至其第二表面之導電路徑,而於 弟:表面上形成複數個電氣蟑。這些電氣璋包含第一與第 =個’第-稷數個4之中心至中心所隔開的距離小於 °該複數個第二蟑之中心至中心所隔開距離。 連接器係折疊成能使該鄰近的半導體元件堆疊於彼此 二此組裝包含至少一額外半導體元件,其具有複 一…-電氣連接構件,而這些第一連接構件係裝設至第 :複數個埠。最後’複數個第二電氣連接構件係裝設至第 -硬數料’而這㈣接構件係適合連結1其他部分。 雖然:本發明係適合任何尺寸之元件,但是較佳實施例 包⑼如晶片級與晶片尺寸封裝之小幾何尺寸之元件。 在另-較佳實施例中’撓性之連接器促使了從所裝設 之分離式裝置之焊接塾之微間距到客戶希望的可焊接的連 接構件之間距之轉變。分離式裝置包含微間距、凸塊之晶 片級封裝與微間距倒裝晶片、凸塊晶片。 本發月之自實施樣悲係為提供低成本方法與系統, 用以在薄型整體輪廓中組裝高接腳數之晶片級元件。 本發明之另一個實施樣態係為藉由採用主動與被動元 8 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公楚) tr 線
經濟部智慧財產局員工消費合作社印製 件之多重印跡技坶而提供高產能。 本發明之另-實施樣態係為藉由使寄生電阻與 小化,而改善電氣產品性能。 本發明之另一實施樣態係為經由不需額外成本之製程 線上控制,以提供高品質控制與可靠度保證。 本發明之另一目的係為導入薄型輪廓與彈性可靠度之 組裝概念,俾能使他們可被應用至多數的族群之半導體產 品,而且上述概念是一般化,俾能使他們可被應用至未來 數個世代或產品。 本發明之另一目的係為使設備之零件與產品之資金投 資成本最小化。 藉由本發明關於適合大量生產之設計概念與處理流程 之教導,已可達成這些樣態。已將可成功地採用各種修改, 以滿足產品幾何尺寸與材料之不同選擇。 本發明之第一實施例結合兩個單晶片、或雙晶片封裝, 其具有複數個被動元件,或具有多重微間距之晶片級封 裝’或具有多重凸塊晶片與倒裝晶片。 本發明之第二實施例結合三個單晶片或雙晶片封装, 其具有個別地製造與測試之第三封裝。 本發明之第三實施例結合三個單晶片或雙晶片封裝, 其具有複數個被動元件,或具有多重微間距之晶片級封 裝’或多重凸塊晶片與倒裝晶片。 本發明之第四實施例結合三個單晶片或雙晶片封裝。 本發明更^供其他各種不同的組合。 9 本紙張尺度適用中國國家標準(CNs)A4規格(21〇 χ 297公釐) :-----------訂---------線 (請先閱讀背面之注意事項再填寫本頁) ^1815 五、 發明說明(S) 述,==明;技術增進以及其㈣,將從本發明之下 :又、◎之评細况明’並參照相關附圖與於以下申請 專利範圍所提出之㈣特徵,而得以更顯清楚。 【圖式之簡單說明】 接器=:據本發明之系統與流程1之局部組裝連 接器==據本發明之系統與流程1之局部组裝連 圖nc係為依據本發明之系統與流程 接器之概要底視圖。 勹。h且衣連 接二二t為依據本發明之系統與流程1之局部組裝連 接时在折豐過程之概要剖面圖。 15 20 圖I3A係為複數個為連結至圖12之折疊連接哭 而製備之微間距之晶片級封裝的概要剖面圖。 圖I3B係為複數個為連結至圖i2乏 而製備之積體電路晶片的概要剖面圖。 連l之上 入圖I4A係為包含圖Da之微間距之晶片級封裝之办 王組裝的直立堆疊震置之概要剖面冑。 疋 戍封二包含圖I3B之具有可選擇的底部填充及/ 剖面圖。電路晶片之完全組裝的直立堆疊裝置之概要 圖hia係為依據本發明之系統與流程η 連接器之概要俯視圖。 局邛,、且裝 圖ΙΙ1Β係為依據本發明之系統與流程η之局部組裝 I_______ ίο 本纸張尺度適用 ^15 ^15
連接器帅中;入口請實際上係描繪成 ^本發明而言,使入口蜂1〇5之中心至中心之間隔 。、口埠1〇6之中心至中心之間隔是重要的事項。雖麸 二將本發明應用至任何人口蟑或出4之間距,但這些; 距之入口琿105最好是中心至中心彼此間隔小於⑽“ m。相較之下’相對的廣間距之出口 4 106之中心至中心 間隔通常遠大於100㈣。因為出口蜂106提供連接構件 =他轉之連結區,所以出口埠廳之適當間距需滿足 由客戶所表不之需求’亦即,其設有方便半導體基板 組裝之焊球連結區n 1G6經常提供符合卫業標準之 共同印跡,以供晶片級封裝使用。 入口埠105 一般係由銅所構成,通常具有保護閃金 (flash of g〇id)。出口淳1〇6必須是可焊接的從而必須 確保可靠之潤濕。它們可能由耐火金屬(例如鉻、鉬、鈦、 鎢、或鈦/鎢合金)層與貴金屬(例如金、鈀、白金或富白 金合金,銀或銀合金)層所覆蓋。 關於使用系統與流程〗以及系統與流程n之某些羞 品,連接器亦具有複數條經由連接器而從一個表面延伸至 背面之導電路徑。這種連接器之機械撓性亦有助於避免轉 球在由於熱循環之機械應力之下產生龜裂。如上所述,缝 接器最好是由依從材料(例如膠帶、Kapt〇nTM膜、聚醯3 胺,或其他塑膠材料)所構成,並可能包含單層或多層戈 圖案化導體。於此方式中,基礎材料之撓性提供了熱失画
-------1---:------- (請先閱讀背面之注咅?事項再填寫本頁) tr---------線. n I- n ϋ 15 經濟部智慧財產局員工消費合作社印製 13 531815 A7
15 經濟部智慧財產局員工消費合作社印製 20 的半導體晶片與RC.基板之間的應力緩衝, 環期間顯現於晶片焊球之某些應變。戋 、查拉/至“、、# 四〆 Α省’連接器可能由 极氧基樹脂、FR-4、FR-5、或BT樹脂所構成。 具有導電通路之連接器係可從商業構得,例如 MN,Northfield 之 Sheldahl 公引々 χτ 4 ^ Novaclad⑧與 WGnd㊣。它們通常是藉由將電氣絕緣與導電材料之薄膜 交替疊層成黏著層而製造出。通過個別絕緣膜之連接係藉 由雷射鑽孔與金屬回填或電鍍而完成,而導電薄膜之圖‘ 化係藉由消蝕(ablation)或蝕刻而達成。連接器之許多設 計與變化是可獲得的。 ° ^ 在圖Ι1Β之概要剖面圖中,在連接器之第一表面 之出口埠係描繪成具有裝設作為連接構件以供連結至其他 (外部)部分之焊球107。這些焊球係從由純錫、包含錫/銅、 錫/氧化銦錫、錫/銀、錫/絲、錫/錯之錫合金,以及導電 黏著化合物所組成之群組選擇出。 > 如於此所使用的,用語,,焊球”並不表示焊料接點需要 疋球狀,它們可具有各種型式,例如半球形,半圓頂,截 頭圓錐體,或一般之凸塊,或具有筆直之凹狀或凸狀輪廓 之圓柱。正確形狀係為沈積技術(例如蒸鍍、電鍍或預製 單元)、回流技術(例如紅外線或輻射熱)、以及材料成分 之函數。藉由控制材料數量與回流溫度之均勻性,吾人可 利用數種方法以達成幾何形狀之一貫性。一般而言,焊球 直的範圍是從0.1至0.5 mm,但是可遠大於此範圍。 更進一步地顯示於圖I1A之俯視圖,係為被密封之 14 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公釐) --------訂--------- (請先閱讀背面之注音?事項再填寫本頁} 531815 A7
15 元件10 8 ’匕們為描繪於圖n b之剖面圖中。這些元件之
例子係為由美國德州,達拉斯之德州儀器有限公司所製造 之 MicroStarTM 之球形柵極陣列與 Micr〇StarJuni〇rTM 之封裝。這些元件包含積體電路(IC)晶片,其乃裝設至連 接器膜,引線接合與轉移成型封裝。 表示於圖I1A之導電線104可包含整合至導電線中 之至少一被動電氣元件(未顯示於圖I1A)。其例子包含電 阻為、電容器、電感器、分配組件、以及被動元件與互連 結構之網路。這些積體組件之製造方法已經說明於美國專 利申請案號60/244,673,申請日為2000年1〇月31曰, 發明人為Pntchett等人,名稱為,,具有積體被動元件之塑 膠晶片級封裝(Plastic Chip-Seale Package having
Integrated Passive Comp〇nents)”),其乃於此併入作參考。 如圖12所示,撓性之連接器條1〇1係在入口埠與出 口埠之鄰近區域之間的積體導電線之區咸12〇折疊。折疊 係以使入口埠面向一個方向,同時使出口埠面向相反方 向。由於此種折疊之故,封裝體1〇8彼此碰觸,導致具有 近似晶片級封裝之外形之直立堆疊組裝。如果希望的話, 可將每些封裝體黏著在一起,以便使其可永久緊密 20 一起。 且你 圖I3A與I3B顯示入口埠可如何隨著半導體元件而 增加。圖I3A以概要剖面圖說明多重晶片級元件1 乃封裝於封裝131中,並具有複數個微間距電氣連接構件 132。這些連接構件可包含㈣錫、上列之錫合金或導電 I 15 本紙張尺—度適用中國國家標準(CNS)A4規格㈤x 297公爱" --------訂---------線· (請先閱讀背面之注意事項再填寫本頁) 531815 A7
15 經濟部智慧財產局員工消費合作社印製 20 黏,化合物所構4之,,焊球"。連接構们32之圖案係與連 接裔入口埠之圖案呈鏡射關係。 如圖I4A所示,晶片級元件13〇之微間距連接構件 132’係藉由表面安裝至連接器⑻之人口璋而完成裝設 動作。所造成之結果是晶片級封裝之組裝(一般標示為 140) ’其乃直立堆疊並具有適合連結至其他外界部分之複 數個連接構件107。 或者,圖I3B係以概要剖面圖說明多重未密封之ic 晶片U3,其乃藉由具有複數個微間距電氣連接構件134 而製備倒裝晶片組裝。這些連接構件可包含”焊球"(由純 錫、如上列之錫合金,或導電黏著化合物所構成),或從 由金、銅、銅合金或疊層之銅/鎳/把所組成之群組所選擇 之金屬凸塊。另-種選擇係為z軸導電環氧樹脂。凸塊 具有各種形狀’譬如長方形、正方形、圓形或半圓頂形。 關於金屬凸塊,將連接構件134附著至遂接器之入口埠之 方法係為基於金屬交互擴散之熱壓焊接技術,而此技術係 早已在以前之捲帶式自動接合(TAB)製造方法實現。本發 明之較佳技術係為一種供陣列組裝用之集團接合化⑽卜 bondmg)技術。此種技術具有快速與低成本運作之優點, 同時導致高品質之可靠的連結。自動化設備在商業上係可 從日本之Shinkawa公司購得。 圖I4B顯示-種直立堆疊之倒裝晶片⑴與被密封之 元件108之組裝結果(―般標示成141);此組裝更具有複 數個連接構件1〇7,其乃適合至其他外界部分之連結。 16 ^紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公爱)_
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531815 五、發明說明($) 圖ΜΑ顯示孓件13〇之封裝1S1係與連接器1〇1以 間隙142隔開。焊球132延伸橫越過連接至連接器之間隙。 本發明之優點係為材料之選定,俾能使在IC晶片之半導 體材料與一般用來作連接器之材料之間的熱膨脹係數 5 (CTE)之顯著差異最小化。因此,在圖I4A之組裝中,通 常不需要藉由以密封凸塊並填滿任何在封裝與連接器間之 間隙的空間之聚合材料來填滿間隙142(”底部填充,,法), 而強化焊接點(在不影響電連接之情況下)。 然而,此種底部填充法可能適合於描繪於圖I4B之組 10裝。此種底部填充材料與某些密封材料,係一起由圖I4B 之概要輪廓142所表示。一般係在組裝完成之後塗敷密封 劑。一種聚合原始物(polymeric preeurs〇r),有時以,,底部 填充”表示,係分配至與晶片鄰接的基板之上,並被毛細 作用力下拉至間隙中。一般而言,聚合原始物包含填滿二 15氧化矽與脫水化合物之環氧基材料。然後;將原始物加熱、 聚合並”硬化”以形成密封劑。本發明所認定之較佳的底部 填充法’係說明於美國專利申請案號6〇/〇84,44〇,申請曰 為1998年5月6曰,發明人為Thomas,名稱為,,底部填 充倒裝晶片電子元件之低應力方法與設備”)。 扣關於系統與流程II,圖Π1Α顯示似長條形之連接器 201之概要俯視圖,圖ΙΙ1Β為其剖面圖,而圖II1C為底 視圖。關於材料、製程、導電線2〇4、出口埠2〇6、可選 擇的積體被動電氣元件、焊球207、與封裝元件2〇8之說 明,係類似於圖I1A、I1B與I1C之說明。顯著差異係萨 (請先閲讀背面之注意事項再填寫本頁) --------^--------- 經濟部智慧財產局員工消費合作社印製 17 531815 A7 B7 五、發明說明(β ) 【圖式之代號說日尽】 101〜連接器 103〜第二表面 105〜入口埠 5 107〜連接構件 120〜區域 131〜封裝 133〜積體電路晶片 140〜半導體元件 ίο 142〜間隙 202〜第一表面 2 0 6〜出口埠 208〜晶片級封裝 220〜區域 102〜第一表面 104〜導電線 106〜出口埠 108〜封裝體 130〜晶片級元件 132〜連接構件 134〜連接構件 141〜半導體元件 201〜連接器 204〜導電線 207〜連接構件 210〜被動元件 240〜直立堆疊組裝 --------------------訂---------線 (請先閱讀背面之注意事項再填寫本頁) 經濟部智慧財產局員工消費合作社印製 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公釐)
Claims (1)
- 531815申請專利範圍 15 經濟部智慧財產局員工消費合作社印製 1 · 一種半導體組裝,包含··1有i個==之撓性連接器,由電氣絕緣㈣所製成,並 具有弟一與第二表面; 人业 複數條導電線,與該連接器整合成一體,於誃 面上形成第一陣列之電入口埠以及第二 ^ 等陣列係聚集於該連接器之分離區中; μ 該等入口埠之中心至中心之間隔係小於該等出 中心至中心之間隔; 該連接器係被折疊成能使該等入口埠面向_ 而該等出口埠面向相反方向; 個半導體元件,具有複數個第—電氣連接構 6亥等苐一連接構件係裝設至該等入口埠;以及 複數個第二電氣連接構件,裝設至該等出口埠,該等 連接構件係適合連結至其他零件。 2.如申請專利範圍帛i項所述之組裝、其中該半導體 元件係為積體電路晶片’其具有活化表面與鈍化表面該 等第一連接構件係裝設至該活化表面。 3·如申請專利範圍第1項所述之組裝,其中該半導體 元件係為與外部接觸焊墊密封成封裝之積體電路晶片,該 等第一連接構件係裝設至該等接觸焊墊。 4·如申請專利範圍第丨項所述之組裝,更包含密封該 連接器上之該等導電線的至少一被動電氣元件。 5·如申請專利範圍第丨項所述之組裝,其中該等入口 埠之中心至中心之間隔少於100 " m,而該等出口埠之中 件 第 本紙張尺度適用㈣國家標準(CNS)A4規格⑽χ 297公^1 (請先閱讀背面之注音?事項再填寫本頁) 0 r % 如0> · I I ϋ I H I I I ·1 n n n ϋ I ϋ ϋ ϋ ϋ ϋ ϋ I ϋ I I n ϋ ϋ ϋ ϋ I 531815 A8 B8 C8 D8 六、申請專利範圍 15 經濟部智慧財產局員工消費合作社印製 20 心至中心之間隔;^於100"m。 6·如申請專利範圍第1項所述之組裝,其中該連接器 係為撓性聚醯亞胺膜。 7·如申請專利範圍第1項所述之組裝,其中該等導電 線係從選自由鋼、銅合金、或鍍錫之銅、錫合金、銀、或 金所組成之群組的材料所構成。 8·如申請專利範圍第1項所述之組裝,其中該第一與 第一連接構件係為選自由純錫、包含錫/銅、錫/氧化錮錫、 錫/銀、錫/鉍、錫/鉛之錫合金,以及導電黏著化合物所組 成之群組的焊球。 9·如申請專利範圍第1項所述之組裝,其中該等第一 連接構件係選自由金凸塊、銅凸塊、鋼/鎳/鈀凸塊、以及 Z軸導電環氧樹脂所組成之群組。 1 〇 ·如申請專利範圍第1項所述之組裝,更具有黏著 之非導電聚合物,其乃底部填充任何在該、等第一連接構件 之間的空間,該等第一連接構件係裝設至該半導體元件之 下的該等入口璋。 11·一種半導體組裝,包含: 一個條狀之撓性連接器,由電氣絕緣材料所製成,並 具有第一與第二表面; 該連接器具有位於該第一表面上之複數條導電線,用 以連接複數個形成於該第一表面上且彼此鄰接之半導體元 件; 該連接器又具有複數條經由該連接器而從該第一表面 22 < υ 1 乙 V ! (請先閱讀背面之注意事項再填寫本頁) - I I I I ϋ 1 I*^OJI I I ^ I I I I — I I — — I I I I I I I I I I I I I _ 531815 B8 , C8 -------— 六、申請專利範圍 延伸至該第二表母之導電路徑,於該第二表面上形成至少 一陣列之電氣埠; 該連接器係被折疊成能使該鄰近的半導體元件堆疊於 彼此之頂端上;以及 5 ^複數個電氣連接構件,裝設至該等埠,該等連接構件 係適合連結至其他零件。 12·如申請專利範圍第丨項所述之組裝,更包含裝設 至該等埠之至少一分離式被動電氣元件。 13·如申請專利範圍第丨項所述之組裝,更包含裝設 10至該等埠之至少一半導體元件。 I4·如申請專利範圍第1項所述之組裝,更包含併入 °亥連接裔上之該等導電線之至少一被動電氣元件。 15· —種半導體組裝,包含: 一個條狀之撓性連接器,由電氣絕緣材料所製成,並 15具有第一與第二表面; ^ 該連接器具有位於該第一表面上之複數條導電線,用 以連接複數個形成於該第一表面上且彼此鄰接之半導體元 件; 該連接器更具有複數條經由該連接器而從該第一表面 20延伸至該第二表面之導電路徑,於該第二表面形成複數個 電氣埠; 該等埠包含複數個第一與第二埠,該複數個第一埠之 中心至中心之間隔係小於該複數個第二埠之中心至 間隔; -----23 本紙張尺度適用中國國家標準(CNS)A4規格(21〇 χ 297公釐) —--- (請先閱讀背面之注意事項再填寫本頁) 訂---------_ 經濟部智慧財產局員工消費合作社印製 531815 A8B8C8D8此之器被拆疊成能使該鄰近的半導體元件堆疊於彼 電乳連接構件,裝設至該 該等連接構件係、適合連結至其他零件。 第阜 =一種積體電路裝置之組裝方法,包含以下步驟: 1 狀之撓性連接器上,形成複數條導電線,★亥連接 電氣絕緣材料所製成,並具有第-與第二表面. 於該第-表面上,形成第一陣列之電入口與第二陣 之出口埠,該等陣列係聚集於該連接器之分離了 :::::心至中心之間隔係小於該等出口一至十 15 線 連結第-電氣連接構件之至少-半導體元件 將複數個第二電氣連接構件連結至該等出口蟑·以及 經濟部智慧財產局員工消費合作社印製 折疊該連接器,俾能使該等入口璋面向一個方向,而 该等出口埠面向相反的方向。 17. 如申請專利範圍第16項所述之方法,更包含下述 20 步驟: 線。將至少-被動電氣元件整合至該連接器上之該等導電 18. 如申請專利範圍第16項所述之方法,更 步驟:本紙張尺度剌帽目家標準(CWSM4規格(21〇 X 297公髮)_ 53181515 經濟部智慧財產局員工消費合作社印製 將黏著之非導電聚合物進行底部填充進入任 第-連接構件之間的空間,該等第 至 1 半導體it件之下的㈣人口埠。 錄叹至该 19· -種積體電路裴置之組裝方法,包含以下步驟: 於條狀之連接器上,形成複數條導電線,該連接 裔係由電氣絕緣材料所製成,並具有 形成複數條經由該連接器而從該第弟一第 二表面之導電路徑’於該第二表面上形成至少之 氣埠; 於該第-表面上,形成複數個彼此鄰接並連接至該等 V笔線之半導體元件; 將複數個電氣連接構件連結至該等埠;以及 折疊該連接器,俾能使該鄰近的半導體元件堆疊於彼 此之頂端上。 20.如申請專利範圍第19項所述之方*法,更包含下述 步驟: 將至少一分離式被動電氣元件連結至該等埠。 21.如申請專利範圍第19項所述之方法,更包含下述 步驟: 將至少一半導體元件連結至該等埠。 22·如申請專利範圍第19項所述之方法,更包含下述 步驟: 將至少一被動電氣元件整合至該連接器上之該等導電 線0 本紙張尺度適用中關家標準(CNS)A4規格⑽χ撕公^ ) ---.-----^--------- (請先閲讀背面之注意事項再填寫本頁) ·# 531815 六、申請專利範圍 15 23. —種積體電路裝置之組裝方法,包含以下步驟: 於條狀之撓性連接器上,形成複數條導電線,該連接 器係由電氣絕緣材料所製A,並具有第一與第二表面; 形成複數條經由該連接器而從該第一表面延伸至該第 表面之V電路於該第二表面上形成複數個電氣璋, 以使該等埠包含第—與第二複數料,該複數㈣一璋之 中&'至中心之間隔係小於該複數個第二埠之中心 間隔; 於該第-表面上,形成複數個彼此鄰接並 導電線之半導體元件; 丧主及导 _將具有複數個第一電氣連接構件之至少一 元件連結至該複數個第一琿; 以及將複數個第二電氣連接構件連結至該複數個第二璋; 之頂ΙΓ連接11,俾能使㈣的半導體元件堆疊於彼此 _ —— 2 6 本紙張尺度適用中國國家標準(2W χ >---.-----^------ (請先閱讀背面之注意事項再填寫本頁) ϋ n I 線φ· ^31815發明說明 專利申請案第90132275號 ROC Patent Appln. No. 90132275 修正部分無劃線之中文說明書修正頁(第11,12,18,19頁)附件 Amended Pages of Specification in Chinese- Enel. II (92年2月v丨日送呈) (92年2月日送呈) (Submitted on February ? 2003) 經濟部智慧財產局員工消費合作社印製 連接器之概要剖面圖。 : 係為依據本發明之♦統與絲Η之 接器之概要底視圖。 接5^^係為依據本發明之祕餘程Π之局部組裝連 接裔在折輯程之概要剖面圖。 古士f jI3A #'為包含兩個封I與被動元件之完全組裝的 直立堆豐裝置之概要剖面圖。圖II3B係、為包含受到單獨製造與測試之第三封裝之 元王《的直立堆疊裝置之概要剖面圖。 圖田II3C係為包含三個封裝與被動元件之完全組裝的 直立堆疊之概要剖面圖。 ffl II3D係、為包含崎在連接器之背面上的三個封裝 之完全組裝的直立堆疊之概要剖面圖。圖II3E係為顯不由本發明所提供之組裝選擇之額外一 例之完全組裝的直立堆疊之概要剖面圖。 【發明之詳細說明】 本發明係相關於:(丨)美國專利6,〇84,778號公告,於 2000年7月4日發證給Malhi,名稱為,,使用撓性接線板 之二維組裝(Three Dimensional Assembly using Flexible Wiring Board)”);(2)美國專利申請案號6〇/i72,186,申請 日為1999年12月17日,發明人為Rolda等人,名稱為,, 夕倒衣日日片之半導體級裝(Multi-Flip-Chip Semiconductor assembly)’’);以及(3)申請案號 6〇/249,385,申請曰為 2〇〇〇 年11月16曰,發明人為c〇yle等人,名稱為”球柵陣列 -11 - 本紙張尺度適用中國國家標準(CNS)A4規格(210 X 297公董) 90576-發明說明-接 I 計 線 531815 A7 牛> 驂止/^^子補充 B7 *經濟部智慧財產局員工消費合作社印製封裝之薄膜組裝上之倒裝晶片⑽p_Chip⑽Film for Ball Grid Array Packages)"),這些係於此併入作參考。 '依據本發明之結構與方_說明於兩_子中:系統 與流程I係顯示於圖I1A至I4B中;系統與流程η係顯示 於圖IIIΑ至ΙΙ3Ε中。 關於系統錢程I,圖I1A顯示馳長條形之連接器 如之概要俯·。此連接器1G1係由具撓性之電氣絕緣 材料所構成。較佳的選擇乃是厚度範圍從大約⑼至卿m 之聚酿亞胺膜;而在某些實例中,亦可能較厚。為了提供 足夠之撓性,其他適當的材料包含pCB樹脂' fr_4(其係 為一種%氧樹脂)、或氰酸酯樹脂。這些材料在商業上可 從下述數個來源購得:(1)美國:包含3_M與Shddahi公 司,(2)日本· shinko、Shindo、Sumitomo、與 Mitsui 公 司;以及(3)香港,Compass公司。這種連接器具有兩個表 面·圖lie以底視圖說明第一表面1〇2,而圖I1A以俯視 圖s兒明弟二表面1 〇3。 與連接益ιοί成一體的是複數條導電線1〇4(於圖I1A 之俯視圖中描繪出這些導電線1〇4以作為例子)。這些導 電線104通常是藉由對一張薄的金屬箔(最好厚度是在大 約15與40μηι之間)刻以圖案而形成。適當的材料包含 銅、銅合金、金、銀、鈀、白金、以及鎳/金與鎳/鈀之堆 疊。這些導電線在第一表面1〇2上形成第一陣列之電入口 埠105與第二陣列之出口埠1〇6。如圖Ilc所示,這些陣列本紙張尺度適用中國國家標準(CNS)A4規格(210x297公釐)A7 B7 發明說明(I6) 由裝設至連接器201之第一表面202之分離式被動元件 210而描緣於圖II1B與IHC中。因此,相較於圖I1C之 圖案之下’在圖II1C之入口埠之圖案係大幅簡化。圖 II1C並不是最吸引人之部分;其在客製化連結中暗示被動 元件210。 同樣地,如ffl 112所示之在入口埠與出口淳之鄰近區 域間的積體導電線之區域220之撓性之連接器條2〇1之折 疊,係類似於圖12所示之連接器之折疊。由於此種 折疊之故,封裝體208彼此碰觸,而導致具有近似晶片級 封裝之輪廓之直立堆疊組裝。如果希望的話,可將封裝體 黏著在一起,以便使得封裝體可永久緊密堆疊在一起。 其結果係顯示於圖113A。其係為晶片級封裝208與分 離式被動電氣元件210之直立堆疊組裝(一般標示為 240),並具有適合連結至其他部分之複數個連接構件 2〇7(通常是焊球)。類似於圖I4A與I4B之組裝之圖Π3Α 之這種組裝,係表示本發明第一實施例之例子: 圖ΜΑ、I4B與Π3Α ··本發明之第一實施例結合了兩 個單晶片或雙晶片封裝(至多達總數四個晶片)與被動元 件’或與多重微間距之晶片級封裝,或與多重隆起晶片與 倒裝晶片。 圖II3B :本發明之第二實施例結合了三個單晶片的或 雙晶片封裝(至多達總數6個晶片)與已各別製造和測試之 第三封裝。 -18-»x297公釐) 531815 修正五、發明說明(17) 圖II3C :本發明之第三實施例結合三個單晶片或雙晶 片封裝(至多達總數6個晶片)與被動元件,或與多重微間 距之晶片級封裝,或與多重隆起晶片和倒裝晶片。 圖II3D:本發明之第四實施例結合了三個單晶片或雙 曰曰片封裝(至多達總數6個晶片)。本發明更提供了各種其 他的不同組合。 圖ΙΙ3Ε:本發明更提供各種其他之不同組合。本產品 係為近似晶片級印跡(chip_scale f00tprim)之直立堆疊,其 乃由複數個主動與被動電氣組件與元件所構成。 雖然本發明已於參考文獻中說明例示的實施例,但是 此種說明並未意圖解釋成為限制之目的。熟習本項技藝者 在參考到此說明書時,將可清楚理解關示的實施例之各 種修改型式與組合,以及本發明之其他實施例。舉例而 言’半導體晶片之材料可包含碎、魏、鎵坤化物、或任 何八他用於製k之半導體材料。因此,以下的申請專利 圍意圖包含任何這些修改或實施例。 範 經濟部智慧財產局員工消費合作社印製 本紙張尺度顏 t®aii^cNS)A4 ^Τ^Ιίο X 297 ^
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