TW201841471A - 負載之驅動電路、使用其之系統、驅動電路之控制方法 - Google Patents
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Abstract
本發明提供一種可在不增加引腳數下設為待機模式之驅動電路。 本發明之驅動電路之2個控制輸入引腳INA、INB接受來自外部之2個控制輸入信號。邏輯電路110根據2個控制輸入信號INA、INB產生指示H電橋電路130之狀態的內部信號SINT
。預驅動器120基於內部信號SINT
驅動H電橋電路130。當2個控制輸入信號INA、INB將特定之狀態持續特定之判定時間時,待機電路160使驅動電路100轉移至待機模式。
Description
本發明係關於一種驅動馬達等之負載之驅動電路。
圖1係DC馬達之驅動電路之方塊圖。驅動電路100R具備:邏輯電路110、預驅動器120、及H電橋電路130。於驅動電路100R之輸出端子(引腳)OUTA、OUTB連接有驅動對象之馬達202。驅動電路100R自外部之控制器204接受控制指令S1
,根據控制指令S1
驅動馬達202。 在該驅動電路100R中,控制指令S1
並非轉矩指令或速度指令、位置指令等,而是包含指示H電橋電路130之狀態之資料。 H電橋電路130可採取4種狀態ϕ1
~ϕ4
。H表示高電壓狀態、L表示低電壓狀態、Z表示高阻抗狀態。 ϕ1
OUTA=Z,OUTB=Z ϕ2
OUTA=H,OUTB=L ϕ3
OUTA=L,OUTB=H ϕ4
OUTA=L,OUTB=L ϕ4
亦可為短路制動狀態,OUTA=OUTB=H。 例如驅動電路100R除了2個輸出引腳OUTA、OUTB外,還具備:H電橋電路130之電源引腳VM、接地引腳PGND,及前段之電路(110、120)用之電源引腳VCC、接地引腳GND。在欲將驅動電路100R收容於8引腳之封裝體時,可分配2個控制引腳INA、INB來接受來自控制器204之控制指令SCNT
。在可以高、低2種狀態控制各控制引腳之情形下,可利用2個控制引腳INA、INB切換4個狀態ϕ1
~ϕ4
。 [先前技術文獻] [專利文獻] [專利文獻1] 日本特開2008-263733號公報
[發明所欲解決之問題] 多數之IC(Integrated Circuit,積體電路)為了其低耗電化而安裝有待機模式。一般的IC具備啟用引腳,且構成為藉由將啟用引腳設為特定之狀態而轉移至待機模式。 然而,在優先考量IC之小型化之應用中,不易增加封裝體之引腳數,而無法安裝待機模式。 本發明係鑒於如此之課題而完成者,其某態樣之例示性目的之一在於提供一種可在不增加引腳數下設為待機模式之驅動電路。 [解決問題之技術手段] 本發明之某一態樣係關於一種負載之驅動電路。驅動電路具備:H電橋電路;1個或2個控制輸入引腳,其自外部接受指示H電橋電路之狀態之1個或2個控制輸入信號;邏輯電路,其根據1個或2個控制輸入信號,產生指示構成H電橋電路之電晶體之狀態之內部信號;及預驅動器,其基於內部信號驅動H電橋電路。當1個或2個控制輸入信號將特定之狀態持續特定之判定時間時,驅動電路轉移至待機模式。 根據該態樣,可利用1個或2個控制輸入引腳切換H電橋電路之複數個狀態、及待機模式。 特定之狀態可與H電橋電路之高阻抗狀態相應。 特定之狀態亦可與H電橋電路之短路制動狀態相應。 判定時間可長於50 μs。在利用該驅動電路進行PWM驅動時,控制輸入引腳之狀態係以PWM週期進行變化。或者是,在驅動步進馬達之情形下,控制輸入引腳之狀態係以規定旋轉速度之控制脈衝之頻率(週期)進行變化。為了抑制可聽頻帶之雜訊,而將PWM頻率或控制脈衝之頻率(亦即控制輸入引腳之狀態變化之頻率)設為音訊頻帶之外,亦即20 kHz以上。因此,藉由將判定時間規定為長於50 μs,而可區別有意之朝待機狀態之轉變指示、及PWM驅動或步進馬達之控制中之特定之狀態。 本發明之又一態樣係關於一種驅動電路之控制方法,該驅動電路包含與馬達連接之H電橋電路。此控制方法具備:處理器為了使馬達旋轉而將指定H電橋電路之狀態之1個或2個控制輸入信號以短於特定之週期之時間進行變化之步驟;根據1個或2個控制輸入信號控制H電橋電路之步驟;處理器為了使驅動電路轉移至待機模式,而將1個或2個控制輸入信號固定為特定之狀態經過特定時間之步驟;及在驅動電路中,當檢測到1個或2個控制輸入信號已維持前述特定之狀態經過特定時間時,使驅動電路轉變為待機模式之步驟。 另外,將以上之構成要素之任意之組合、本發明之構成要素或表現在方法、裝置、系統等之間相互置換者亦作為本發明之態樣而屬有效。 [發明之效果] 根據本發明之某一態樣,可提供一種能夠在不增加引腳數下設為待機模式之驅動電路。
以下,基於較佳之實施形態一面參照圖式一面說明本發明。對於各圖式所示之同一或同等之構成要素、構件、處理賦予同一符號而適當省略重複之說明。又,實施形態係例示而非限定發明者,實施形態所記述之所有特徵及其組合未必一定為發明之本質性內容。 在本說明書中,「構件A與構件B連接之狀態」除了包含構件A與構件B實體性直接地連接之情形以外,亦包含構件A與構件B經由對該等之電性連接狀態不產生實質之影響、或無損由該等之結合發揮之功能及效果的其他構件間接地連接之情形。 同樣地,「構件C設置於構件A與構件B之間之狀態」除了包含構件A與構件C、或構件B與構件C直接地連接之情形以外,亦包含經由對該等之電性連接狀態不產生實質之影響、或無損由該等之結合發揮之功能及效果的其他構件間接地連接之情形。 <第1實施例> 圖2係具備第1實施例之驅動電路100之系統200之電路圖。驅動電路100具備2個控制輸入引腳INA、INB,於控制輸入引腳INA、INB自外部之控制器204被供給2個控制輸入信號。驅動電路100根據2個控制輸入信號INA、INB,驅動連接於2個輸出端子OUTA、OUTB之負載(例如馬達202)。 驅動電路100具備:邏輯電路110、預驅動器120、H電橋電路130、BGR(能隙參考)電路140、保護電路150、待機電路160,且收容於一個封裝體內。驅動電路100亦可為積體化於一塊半導體基板之功能IC。或者,H電橋電路130可積體化於與其他區塊(110、120、140、150、160)不同之晶片內。 H電橋電路130根據控制輸入引腳INA、INB可採取4種狀態ϕ1
~ϕ4
。 ϕ1
OUTA=Z、OUTB=Z ϕ2
OUTA=H、OUTB=L ϕ3
OUTA=L、OUTB=H ϕ4
OUTA=L、OUTB=L 邏輯電路110監視控制輸入引腳INA、INB之狀態(控制輸入信號),而判定是狀態ϕ1
~ϕ4
之哪一者。而後產生與所判定之狀態相應之內部信號SINT
。內部信號SINT
可為指示構成H電橋電路130之4個電晶體M1~M4各自之導通、關斷之信號。預驅動器120基於內部信號SINT
控制H電橋電路130之電晶體M1~M4之閘極電壓。 BGR電路140產生基準電壓。保護電路150包含:熱停機 (TSD)電路、及低電壓閉鎖(UVLO,欠壓閉鎖)電路等。保護電路150構成為包含電壓比較器。 當2個控制輸入信號INA、INB將特定之狀態ϕ持續特定之判定時間τ時,待機電路160使驅動電路100轉移至待機模式。在待機模式下,停止朝除了邏輯電路110以外之其他電路區塊之偏置電流或偏置電壓、電源電壓之供給,而驅動電路100之消耗電流降低至數μA之位準。又,在圖2中係將待機電路160顯示於邏輯電路110之外部,但待機電路160之功能實際上亦可作為邏輯電路110之一部分而安裝。 圖3係顯示控制輸入引腳INA、INB之狀態、與驅動電路100之內部及輸出狀態之對應之一例之圖。 在第1實施例中,特定之狀態ϕ係H電橋電路130之高阻抗狀態ϕ1
。返回至圖2。待機電路160測定邏輯電路110檢測高阻抗狀態ϕ1
之時間,當達到判定時間τ時,使驅動電路100轉移至待機模式。判定時間τ較佳的是規定為長於50 μs,例如設在50~500 μs之間。 以上係驅動電路100之構成。接著說明其動作。圖4係圖2之驅動電路100之動作波形圖。在時刻t0
電源電壓VCC
及VM
升起。啟動後緊接著係待機模式,動作電流ICC
非常小。 當在時刻t1
,控制輸入信號INA、INB發生變化時,轉變為通常模式。在通常模式中,依次轉變為與控制輸入信號INA、INB之位準相應之狀態ϕ3
、ϕ4
、ϕ2
。當在時刻t2
,轉變為狀態ϕ1
時,輸出變為高阻抗。在時刻t3
,當狀態ϕ4
持續判定時間τ時,轉移至待機模式,動作電流ICC
降低。 當在時刻t4
,控制輸入信號INA、INB發生變化時,轉變為通常模式。在通常模式中,依次轉變為與控制輸入信號INA、INB之位準相應之狀態ϕ2
、ϕ3
、ϕ2
、ϕ3
。當在時刻t5
,電源電壓VCC
低於UVLO電路之臨限值時,形成低電壓閉鎖狀態,H電橋電路130之輸出變為高阻抗。 當在時刻t6
,電源電壓VCC
超過UVLO電路之臨限值時,低電壓閉鎖狀態被解除,與控制輸入信號INA、INB相應而H電橋電路130之狀態展開轉變。 以上為驅動電路100之動作。根據該驅動電路100,在不追加啟用引腳下,僅利用2個控制輸入引腳INA、INB,自外部控制H電橋電路130之4種狀態,而且可使其轉移至待機模式。 在轉矩指令或速度指令為控制輸入之驅動電路中,存在控制輸入明確地指示馬達之停止之狀態。例如轉矩指令(速度指令)為0可理解為明確的馬達之停止之指示。因此,可在轉矩指令(速度指令)成為0後,等待馬達完全停止所需之時間之後轉變為待機模式。 另一方面,如本實施例之驅動電路100般,在接受指示H電橋電路130之狀態之控制輸入信號INA、INB之形式下,不存在明確之停止指示。此乃緣於在PWM驅動之應用中由於高阻抗狀態重複產生,因此高阻抗狀態之產生未必一定為停止指示之故。在步進馬達之控制上亦同。 一般而言在DC馬達之PWM驅動或步進馬達之驅動中,係使用可聽頻帶以外之頻率。因此,藉由將判定時間τ設為長於脈衝週期(最長為50 μs),而可區別在DC馬達之PWM驅動中或步進馬達之驅動中產生之高阻抗狀態、及朝待機之轉移指示。反過來而言,可謂驅動電路100對應於較判定時間τ短之週期之脈衝驅動。 進而,根據該系統200,藉由利用控制器204以短於判定時間τ之週期交互地切換ϕ1
與ϕ4
,還可使馬達202停止,且一面使驅動電路100持續維持通常模式而不轉移至待機模式。如此之控制在接受轉矩指令或速度指令之驅動電路中不可能實現。 由於在待機模式下偏置電路等停止,故復位至通常模式為止需要數μs之時間。另一方面,在PWM驅動中,有欲使H電橋電路之輸出電壓以數十ns之轉換率發生變化之情形。若採用當檢測到高阻抗之控制輸入時立即轉移至待機之控制,則PWM驅動中之H電橋電路之輸出電壓之波形和緩變大,而限定可使用之應用。在實施形態中,由於也不產生H電橋電路之輸出電壓之波形和緩,故可適用於廣泛之應用。 <第2實施例> 圖5係具備第2實施例之驅動電路100A之系統200A之電路圖。驅動電路100A具備用於在對馬達之通電區間之期間開關驅動信號之PWM(Pulse Width Modulation,脈衝寬度調變)電路170。在驅動電流之路徑上,具體而言在PGND引腳與外部之接地之間設置分流電阻器Rs,於分流電阻器Rs產生與馬達202中流動之驅動電流相應之壓降(電流檢測信號)Vs。分流電阻器Rs亦可內置於驅動電路100A。 PWM電路170係逐個脈衝之電流限制電路,基於電流檢測信號Vs產生PWM信號SPWM
。PWM電路170與振盪器172產生之時脈同步動作。例如PWM電路170應答於振盪器172產生之時脈CK之正邊緣,將PWM信號SPWM
轉變為第1位準(例如高位準)。又,PWM電路170將電流檢測信號Vs與規定驅動電流之上限之極限值VCL
進行比較,當檢測到VS
>VCL
時,亦即當驅動電流達到極限值時,使PWM信號SPWM
轉變為第2位準(例如低位準)。 PWM信號SPWM
被供給至預驅動器120。預驅動器120將PWM信號SPWM
與內部信號SINT
邏輯合成,而控制H電橋電路130。邏輯合成之功能可安裝於邏輯電路110。 待機電路160亦可在待機狀態下停止PWM電路170。具體而言,藉由遮斷PWM電路170所含之比較器之電流而可削減消耗電流。又,亦可在待機狀態下停止產生時脈CK之振盪器172。藉此可進一步削減消耗電流。 <第3實施例> 圖6係具備第3實施例之驅動電路100B之系統200B之電路圖。驅動電路100B具備1個控制引腳IN。於控制引腳IN被輸入高低2值之控制輸入信號IN。邏輯電路110應答於控制輸入引腳IN之狀態之轉變而轉變電橋電路130之狀態。又,當控制輸入引腳IN持續特定之狀態經過特定時間時,待機電路160將驅動電路100B轉變為待機狀態。 圖7(a)~(c)係顯示圖6之驅動電路100B之控制輸入引腳IN之狀態、與驅動電路之內部及輸出狀態之對應之若干例之圖。H電橋電路130根據控制輸入引腳IN可採取2種狀態ϕ1
、ϕ2
。 ϕ1
OUT1=L、OUT2=H ϕ2
OUT1=H、OUT2=L 邏輯電路110監視控制輸入引腳IN之狀態(控制輸入信號),而判定是狀態ϕ1
、ϕ2
之哪一者。而後產生與所判定之狀態相應之內部信號SINT
。 又,當第1狀態ϕ1
(亦即IN引腳之低位準)持續特定時間時,待機電路160使驅動電路100B轉移至待機模式。在待機模式下,邏輯電路110以H電橋電路130成為與第1狀態ϕ1
及第2狀態ϕ3
不同之狀態ϕs(短路制動狀態)之方式使內部信號SINT
變化。藉此,可在待機模式下固定馬達202。 在圖7(a)之例中,狀態ϕs係輸出低位準固定(OUT1=L、OUT2=L)之短路制動狀態,電晶體M2、M4為導通,M1、M3為關斷。 在圖7(b)之例中,狀態ϕs係輸出高位準固定(OUT1=H、OUT2=H)之短路制動狀態,電晶體M2、M4為關斷,M1、M3為導通。 在圖7(c)之例中,狀態ϕs係OUT1=Z、OUT2=Z之高阻抗狀態,電晶體M1~M4為關斷。 在圖7(a)~(c)中,可將第2狀態ϕ2
(IN=H)持續特定時間作為朝待機模式之轉移之條件。 亦可將待機模式下之輸出之狀態ϕs設為可選擇。亦即,可在第1狀態ϕ1
與第2狀態ϕ2
之一者持續特定時間時,將ϕs設為短路制動狀態,在第1狀態ϕ1
與第2狀態ϕ2
之另一者持續特定時間時,將ϕs設為高阻抗狀態。 <第4實施例> 圖6之驅動電路100B可用於步進馬達之驅動。圖8係第4實施例之系統200C之電路圖。系統200C具備2個圖6之驅動電路100B。一個驅動電路100B_A之輸出係連接於步進馬達202C之一個線圈,另一個驅動電路100B_B之輸出係連接於步進馬達202C之另一個線圈。控制器204對驅動電路100B_A供給控制輸入信號INA,對驅動電路100B_B供給控制輸入信號INB,而控制步進馬達202C。控制輸入信號INA、INB之波形係根據步進馬達之驅動方式(1相勵磁、1-2相勵磁、2相勵磁等)而被選擇。 <第5實施例> 圖9係具備第5實施例之驅動電路100D之系統200D之電路圖。驅動電路100D可被理解為統合圖8之驅動電路100B_A、100B_B之電路。輸出OUTA、OUTB根據INA、INB之組合可採取4種狀態ϕ11
~ϕ14
。 ・ϕ11
INA=L、INB=L OUTA1=L、OUTA2=H、OUTB1=L、OUTB2=H ・ϕ12
INA=H、INB=L OUTA1=H、OUTA2=L、OUTB1=L、OUTB2=H ・ϕ13
INA=L、INB=H OUTA1=L、OUTA2=H、OUTB1=H、OUTB2=L ・ϕ14
INA=H、INB=H OUTA1=H、OUTA2=L、OUTB1=H、OUTB2=L 圖10係顯示圖9之系統200D之動作之一例之時序圖。此處以1-2相勵磁為例進行說明。驅動電路100D之待機電路160監視2個控制輸入信號INA、INB之全邊緣。而且當邊緣之間隔超過特定之判定時間τ時,轉移至待機模式。換言之,在將4個狀態ϕ11
~ϕ14
之任一者持續特定時間時,轉移至待機模式。待機模式之期間,電橋電路130A、130B被固定為特定之狀態ϕs(例如高阻抗狀態或短路制動狀態)。或者,特定狀態ϕs亦可為緊接在前之狀態(在該圖10之例中為ϕ13
)。 在待機模式下,當檢測到下一邊緣時,待機模式被解除,其後,展開轉變為與2個控制輸入INA、INB相應之狀態ϕ11
、ϕ12
。 以上,針對本發明基於實施形態進行了說明。該實施形態為例示,在該等之各構成要素或各處理製程、其等之組合中,可存在各種變化例。以下,針對如此之變化例進行說明。 (變化例1) 在實施形態中,待機電路160係高阻抗狀態ϕ1
朝待機模式之轉移之觸發,但並不限定於此,亦可將短路制動狀態ϕ4
設為朝待機模式之轉移之觸發。亦即,可在指示短路制動狀態ϕ4
之控制輸入信號(INA=INB=H)持續判定時間τ時,轉移至待機模式。 (變化例2) 在實施形態中係以單相之DC馬達為負載,但並不限定於此。本發明亦可適用於三相換流器、或步進馬達之驅動電路。 (變化例3) 進而言之,負載並不限定於馬達,驅動電路100亦可為返馳式轉換器或順向式轉換器、DC/DC轉換器等之一部分。 (變化例4) 在實施形態中,說明了H電橋電路130之電源/接地與邏輯電路110及預驅動器120之電源/接地分離之構成,但其等亦可為共通。圖11係變化例4之驅動電路100E之電路圖。該驅動電路100E係將圖2之驅動電路100之2個電源引腳共通化且將2個接地引腳共通化者。 圖12係變化例4之驅動電路100F之電路圖。該驅動電路100F係將圖6之驅動電路100B之2個電源引腳共通化且將2個接地引腳共通化者。 (變化例5) 圖13係具備變化例5之驅動電路100G之系統200G之電路圖。驅動電路100G在其輸出段具備半橋電路130G取代H電橋電路130。又,控制輸入引腳IN為1個。半橋電路130G之輸出引腳係連接於馬達202G(線圈)之一端,於馬達202G之另一端被施加特定電壓(電源電壓或接地電壓)。 最後,顯示驅動電路100之封裝體之例。圖14(a)~(h)係顯示驅動電路100之封裝體之外觀之圖。圖14(a)顯示8引腳之封裝體。例如圖2之驅動電路100可收容於此封裝體。圖2之驅動電路100之各引腳可如下所述般配置。 名稱 引腳編號 VM 2 PGND 8 VCC 4 GND 5 INA 3 INB 6 OUTA 1 OUTB 7 圖14(b)顯示6引腳之封裝體。例如圖11之驅動電路100E可收容於此封裝體。圖11之驅動電路100E之各引腳可如下所述般配置。 名稱 引腳編號 VCC 2 GND 5 INA 3 INB 4 OUTA 1 OUTB 6 圖14(c)顯示5引腳之封裝體。例如圖12之驅動電路100F可收容於此封裝體。驅動電路100F之各引腳可如下所述般配置。 名稱 引腳編號 VM 5 PGND 2 IN 4 OUTA 1 OUTB 3 圖14(d)顯示4引腳之封裝體。例如圖13之驅動電路100G可收容於此封裝體。驅動電路100G之各引腳可如下所述般配置。 名稱 引腳編號 VCC 1 GND 2 IN 3 OUT 4 圖14(e)~(f)顯示8引腳、6引腳、5引腳、4引腳之CSP(Chip Size Package,晶片尺寸封裝)。 基於實施形態使用具體之用語說明了本發明,但應理解的是實施形態僅顯示本發明之原理、應用 ,在實施形態中,在不脫離申請專利之範圍所規定之本發明之思想之範圍內,可有諸多之變化例及配置之變更。
1~8‧‧‧引腳
100‧‧‧驅動電路
100A‧‧‧驅動電路
100B‧‧‧驅動電路
100B_A‧‧‧驅動電路
100B_B‧‧‧驅動電路
100D‧‧‧驅動電路
100E‧‧‧驅動電路
100F‧‧‧驅動電路
100G‧‧‧驅動電路
100R‧‧‧驅動電路
110‧‧‧邏輯電路/電路/區塊
120‧‧‧預驅動器/電路/區塊
120A‧‧‧預驅動器
120B‧‧‧預驅動器
130‧‧‧H電橋電路/電橋電路
130A‧‧‧H電橋電路
130B‧‧‧H電橋電路
130G‧‧‧半橋電路
140‧‧‧BGR(能隙參考)電路/區塊
150‧‧‧保護電路/區塊
160‧‧‧待機電路/區塊
170‧‧‧PWM(脈衝寬度調變)電路
172‧‧‧振盪器
200‧‧‧系統
200A‧‧‧系統
200B‧‧‧系統
200C‧‧‧系統
200D‧‧‧系統
200F‧‧‧系統
200G‧‧‧系統
202‧‧‧馬達
202C‧‧‧步進馬達
202G‧‧‧馬達
204‧‧‧控制器
CK‧‧‧時脈
GND‧‧‧接地引腳
Icc‧‧‧動作電流
IN‧‧‧控制引腳/控制輸入信號/引腳
INA‧‧‧控制輸入引腳/控制輸入信號/控制引腳/控制輸入
INB‧‧‧控制輸入引腳/控制輸入信號/控制引腳/控制輸入
M1‧‧‧電晶體
M2‧‧‧電晶體
M3‧‧‧電晶體
M4‧‧‧電晶體
OUT‧‧‧輸出端子(引腳)/輸出引腳/輸出
OUT1‧‧‧輸出端子(引腳)/輸出引腳/輸出
OUT2‧‧‧輸出端子(引腳)/輸出引腳/輸出
OUTA‧‧‧輸出端子(引腳)/輸出引腳/輸出
OUTB‧‧‧輸出端子(引腳)/輸出引腳/輸出
PGND‧‧‧接地引腳
Rs‧‧‧分流電阻器
S1‧‧‧控制指令
SINT‧‧‧內部信號
SPWM‧‧‧PWM信號
t0~t6‧‧‧時刻
VCC‧‧‧電源電壓
VCC‧‧‧電源引腳
VM‧‧‧電源電壓
VM‧‧‧電源引腳
ϕ1~ϕ4‧‧‧狀態
ϕ11~ϕ14‧‧‧狀態
ϕS‧‧‧狀態
τ‧‧‧判定時間
圖1係DC馬達之驅動電路之方塊圖。 圖2係具備第1實施例之驅動電路之系統之電路圖。 圖3係顯示圖2之驅動電路之控制輸入引腳INA、INB之狀態、與驅動電路之內部及輸出狀態的對應之一例之圖。 圖4係圖2之驅動電路之動作波形圖。 圖5係具備第2實施例之驅動電路之系統之電路圖。 圖6係具備第3實施例之驅動電路之系統之電路圖。 圖7(a)~(c)係顯示圖6之驅動電路之控制輸入引腳IN之狀態、與驅動電路之內部及輸出狀態之對應之若干例之圖。 圖8係第4實施例之系統之電路圖。 圖9係具備第5實施例之驅動電路之系統之電路圖。 圖10係顯示圖9之系統之動作之一例之時序圖。 圖11係變化例4之驅動電路之電路圖。 圖12係變化例4之驅動電路之電路圖。 圖13係具備變化例5之驅動電路之系統之電路圖。 圖14(a)~(h)係顯示驅動電路之封裝體之外觀之圖。
Claims (8)
- 一種驅動電路,其特徵在於其係負載之驅動電路,且具備: 電橋電路; 1個控制輸入引腳,其自外部接受指示前述電橋電路之狀態之1個控制輸入信號; 邏輯電路,其根據前述1個控制輸入信號,產生指示構成前述電橋電路之電晶體之狀態之內部信號;及 預驅動器,其基於前述內部信號驅動前述電橋電路;且 構成為當前述1個控制輸入信號將特定之狀態持續特定之判定時間時,轉移至待機模式。
- 一種驅動電路,其特徵在於其係負載之驅動電路,且具備: 電橋電路; 2個控制輸入引腳,其自外部接受指示前述電橋電路之狀態之2個控制輸入信號; 邏輯電路,其根據前述2個控制輸入信號,產生指示構成前述電橋電路之電晶體之狀態之內部信號;及 預驅動器,其基於前述內部信號驅動前述電橋電路;且 構成為當前述2個控制輸入信號將特定之狀態持續特定之判定時間時,轉移至待機模式。
- 如請求項1或2之驅動電路,其中前述特定之狀態係與前述電橋電路之高阻抗狀態對應。
- 如請求項1或2之驅動電路,其中前述特定之狀態係與前述電橋電路之短路制動狀態對應。
- 如請求項1或2之驅動電路,其中前述判定時間長於50 μs。
- 如請求項1或2之驅動電路,其中前述負載為馬達。
- 一種系統,其特徵在於具備: 處理器; 馬達;及 根據來自前述處理器之1個或2個控制輸入信號驅動前述馬達之如請求項1或2之驅動電路;且 前述處理器在將前述驅動電路轉移至待機模式時,將前述1個或2個控制輸入信號固定為特定之狀態特定時間以上。
- 一種控制方法,其特徵在於其係驅動電路之控制方法,該驅動電路包含與馬達連接之電橋電路,且該控制方法具備: 處理器為了使前述馬達旋轉而將指定前述電橋電路之狀態之1個或2個控制輸入信號以短於特定之週期之時間進行變化之步驟; 根據前述1個或2個控制輸入信號控制前述電橋電路之步驟; 前述處理器為了使驅動電路轉移至待機模式,而將前述1個或2個控制輸入信號固定為特定之狀態經過特定時間之步驟;及 在前述驅動電路中,當檢測到前述1個或2個控制輸入信號已維持前述特定之狀態經過前述特定時間時,使前述驅動電路轉變為待機模式之步驟。
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