KR970077492A - 반도체 소자의 필드 산화막 형성 방법 - Google Patents
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Abstract
본 발명은 반도체 소장의 필드 산화막 형성 방법에 관한 것으로, 버즈 빅(Bird's bask)의 발생을 방지하며, 표면의 평탄도를 향상시키기 위하여 실리콘 기판의 소자 분리 영역에 양측벽이 경사진 트렌치를 형성한 후 산화 바지막을 이용하여 상기 트렌치내의 노출된 실리콘 기판을 산화시켜 필드 산화막을 형성하므로써 버즈 빅의 발생이 방지되어 활성 영역의 크기 감소가 방지된다. 또한 표면의 평탄도가 향상되어 후속 공정을 용이하게 실시할 수 있는 반도체 소자의 필드 산화막 형성 방법에 관한 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1A 내지 제1F도는 본 발명에 따른 반도체 소자의 필드 산화막 형성 방법을 설명하기 위한 소자의 단면도.
Claims (14)
- 반도체 소자의 필드 산화막 형성 방법에 있어서, 실리콘 기판상에 산화막 및 제1감광막을 순차적으로 형성한 후 패터닝된 양측벽이 경사도를 갖도록 상기 제1감광막을 패터닝하는 제1단계와, 상기 제1단계로부터 상기 패터닝된 제1감광막을 마스크로 이용한 식각 공정으로 노출된 부분의 상기 산화막 및 실리콘 기판을 순차적으로 식각하여 양측벽이 경사진 트렌치를 형성하는 제2단계와, 상기 제2단계로부터 상기 제1감광막을 제거한 후 전체 상부면에 산화 방지막 및 제2감광막을 순차적으로 형성하는 제3단계와, 상기 제3단계로부터 상기 트렌치 상부의 산화 방지막이 노출되도록 상기 제2감광막을 패터닝하는 제4단계와, 상기 제4단계로부터 상기 패터닝된 제2감광막을 마스크로 이용하여 노출된 부분의 상기 산화 방지막을 식각한 후 상기 제2감광막을 제거하는 제5단계와 , 상기 제5단계로부터 상기 실리콘 기판의 노출된 부분을 사놔시켜 상기 트렌치내에 필드 산화막을 형성한 후 상기 산화 방지막 및 산화막을 순차적으로 제거하는 제6단계로 이루어지는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 산화막은 150 내지 300A의 두께로 형성되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 제1감광막은 양측벽이 60 내지 80°의 경사각을 갖도록 패터닝되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 트렌치는 양측벽이 45 내지 60°의 경사각을 갖도록 형성되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 제2단계의 식각공정은 건식으로 실시되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제5항에 있어서, 상기 건식 식각 공정시 NF3및 O2프라즈마가 이용되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 산화 방지막은 1000내지 2000A의 두께로 형성되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1 또는 제7항에 있어서, 상기 산화 방지막은 질화막인 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1 또는 제7항에 있어서, 상기 산화 방지막은 옥시 나이트라이드막인 것을 특징으로 하는 반도체소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 제5단계의 식각 공정은 건식으로 실시되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 제6단계의 산화 공정은 습식으로 실시되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제11항에 있어서, 상기 산화 공정시 수증기가 이용되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 산화 방지막은 140내지 180℃온도의 인산(H3PO4)용액으로 제거되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.
- 제1항에 있어서, 상기 산화막은 50:1의 BOE 용액으로 제거되는 것을 특징으로 하는 반도체 소자의 필드 산화막 형성 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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