KR970013367A - 반도체 장치 및 그 제조방법 - Google Patents
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Abstract
반도체 장치용 제조방법에 의해, 에칭 스톱퍼로서 역할하는 폴리실리콘이 셀 판을 형성함과 동시에 리던던트 퓨즈위에 형성되고 : 리던던트 퓨즈상의 실리콘질화막, 산화막 및 다른 산화막이 폴리실리콘을 에칭 스톱퍼로서 사용해서 연속적으로 에칭하고 : 그후 폴리실리콘이 에치된다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따라 실시예의 DRAM 구성의 필수적인 부분을 도시하는 단면도.
Claims (4)
- 반도체 장치에 있어서, 반도체기판과 : 상기 반도체 기판상에 형성된 메모리셀과 : 상기 반도체기판상에 형성된 제1절연막과 : 불량의 메모리셀을 감소시키기 위해 상기 제1 절연막상에 형성된 리던던트 퓨즈와 : 상기 리던던트 퓨즈를 커버하기 위해 성형된 제2 절연막과 : 상기 제2 절연막상에 형성되고 상기 리던던트 퓨즈위의 오른쪽에 있으며 상기 리던던트 퓨즈보다 넓고 상기 제2 절연막 표면과 같은 높이로 있는 캐비티를 갖는 제3 절연막과 : 상기 제3 절연막의 캐비티 하부의 내부 주변을 따라 환형으로 남겨진 도체를 구비하는 것을 특징으로 하는 반도체장치.
- 제1항에 있어서, 상기 도체가 폴리실리콘으로 구성되는 것을 특징으로 하는 반도체장치.
- 반도체장치용 제조방법에 있어서, 메모리셀을 반도체기판상에 형성되는 단계와 : 제1 절연막을 상기 반도체 기판상에 형성하는 단계와 : 상기 제1 절연막을 불량의 메모리셀을 동일한 과정 단계에서 감소시키는 리던던트 퓨즈를 형성하고 상기 메모리셀에서 트랜지스터 소스상의 비트라인의 그것과 같은 재료를 사용하는 단계와 : 상기 리던던트 퓨즈를 커버하기 위해 제2 절연막을 형성하는 단계와 : 상기 제2 절연막상의 상기 리던던트 퓨즈 위의 오른쪽에 있으며 상기 리던던트 퓨즈보다 넓은 도체를 동일한 과정 단계에서 형성하고 상기 메모리셀의 셀 판의 그것과 같은 재료를 사용하는 단계과 : 상기 도체를 커버하는 제3 절연막을 형성하는 단계와 : 상기 리던던트 퓨즈위의 오른쪽에 있는 상기 제3 절연막 부분상에 있으며 상기 도체보다 좁으나 상기 리던던트 퓨즈보다 넓은 포토레지스트의 캐비티 패턴을 형성하는 단계와 : 상기 캐비티 패턴에 대응하는 캐비티를 상기 제3 절연막에 구비하기 위해 상기 포토레지스트를 마스크로 사용함으로써 상기 도체가 노출될때서야 상기 제3 절연막을 에치하는 단계와 : 상기 제2 절연막을 노출시키기 위해 상기 캐비티를 통해 상기 도체를 에치하는 단계를 구비하는 것을 특징으로 하는 반도체 장치용 제조방법.
- 제3항에 있어서, 상기 도체가 폴리실리콘으로 구성되는 것을 특징으로 하는 반도체 장치용 제조방법.
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